KR20030081935A - 플라즈마 디스플레이 패널과 그 구동 장치 및 구동 방법 - Google Patents

플라즈마 디스플레이 패널과 그 구동 장치 및 구동 방법 Download PDF

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Abstract

본 발명은 패널 캐패시터의 일단과 제1 및 제2 전압원 사이에 각각 전기적으로 연결되는 제1 및 제2 인덕터를 가지는 구동 장치를 포함하는 플라즈마 디스플레이 패널을 제공한다. 구동 장치는 패널 캐패시터의 단자 전압을 제2 인덕터와의 LC 공진을 이용하여 제1 전압에서 제2 전압으로 바꾸고, 제2 인덕터에 저장된 에너지를 제1 전압원으로 회수하는 중에 제1 인덕터와의 LC 공진을 이용하여 패널 캐패시터의 단자 전압을 제2 전압에서 제1 전압으로 바꾸고, 제1 인덕터에 저장된 에너지를 제1 전압원으로 회수한다. 이때, 제1 및 제2 인덕터에 흐르는 전류가 최대가 될 때 패널 캐패시터의 단자 전압이 각각 제1 및 제2 전압으로 된다.

Description

플라즈마 디스플레이 패널과 그 구동 장치 및 구동 방법{PLASMA DISPLAY PANEL AND DRIVING APPARATUS AND METHOD THEREOF}
본 발명은 플라즈마 디스플레이 패널(plasma display panel, PDP)과 그 구동 장치 및 구동 방법에 관한 것으로, 특히 플라즈마 디스플레이 발광에 직접 기여하는 전력 회수 회로 및 그 구동 방법에 관한 것이다.
최근 액정 표시 장치(liquid crystal display, LCD), 전계 방출 표시 장치(field emission display, FED), PDP 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 PDP는 다른 평면 표시 장치에 비해 휘도 및 발광효율이 높으며 시야각이 넓다는 장점이 있다. 따라서, PDP가 40인치 이상의 대형 표시 장치에서 종래의 음극선관(cathode ray tube, CRT)을 대체할 표시 장치로서 각광받고 있다.
PDP는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 화소가 매트릭스 형태로 배열되어 있다. 이러한 PDP는 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형(DC형)과 교류형(AC형)으로 구분된다.
직류형 PDP는 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전 공간에 그대로 흐르게 되며, 이를 위해 전류 제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 PDP에서는 전극을 유전체층이 덮고 있어 자연스러운 캐패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
일반적으로 AC형 PDP의 구동 방법은 리셋(초기화) 기간, 기록(어드레싱) 기간, 유지 기간, 소거 기간으로 구성된다.
리셋 기간은 셀에 어드레싱 동작이 원할히 수행되도록 하기 위해 각 셀의 상태를 초기화시키는 기간이며, 기록 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽전하를 쌓아두는 동작을 수행하는 기간이다. 유지 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 방전을 수행하는 기간이며, 소거 기간은 셀의 벽전하를 감소시켜 유지 방전을 종료시키는 기간이다.
AC형 PDP는 그 어드레싱을 위한 어드레스 전극이 용량성 부하로 작용하기 때문에 어드레스 전극에 대한 캐패시턴스가 존재하며, 어드레싱을 위한 파형을 인가하기 위해서는 어드레싱을 위한 전력 이외에 무효 전력이 필요하다. 이런 무효 전력을 회수하여 재사용하는 회로를 전력 회수 회로라고 한다.
이하, 종래의 AC형 PDP의 전력 회수 회로와 그 구동 방법에 대하여 설명한다.
도 5 및 도 6은 종래의 전력 회수 회로와 그 동작 파형을 나타내는 도면이다.
도 5에 도시한 바와 같이, L.F. Weber에 의해 제안된 전력 회수 회로(미국 특허 번호 4,866,349 및 5,081,400)는 AC형 PDP의 전력 회수 회로로서, 직렬로 연결된 두 개의 스위칭 소자(S1, S2), 다이오드(D1, D2), 인덕터(Lc), 전력 회수용 캐패시터(Cc) 및 직렬로 연결된 두 개의 스위칭 소자(S3, S4)를 포함한다.
두 개의 스위칭 소자(S3, S4) 사이의 접점에는 플라즈마 패널이 연결되며, 이 플라즈마 패널을 등가적으로 패널 캐패시터(Cp)로 나타낸다.
도 6에 도시한 바와 같이, 종래의 전력 회수 회로는 스위칭 소자(S1, S2, S3, S4)의 스위칭 동작에 따라 4가지 모드로 동작하고, 스위칭 동작에 따라 단자 전압(Vp)과 인덕터(Lc)에 흐르는 전류(IL)의 파형이 각각 나타나게 된다.
초기 상태에서는 스위칭 소자(S1)가 도통 되기 직전에 스위칭 소자(S4)가 도통되어 있어서 패널의 양단 전압(Vp)은 0V를 유지하게 된다. 이때, 전력 회수용 캐패시터(Cc)는 어드레스 전압(Va)의 1/2만큼의 전압(Va/2)으로 미리 충전되어 있다.
이렇게 패널의 양단 전압(Vp)을 0V로 유지한 상태에서, t0 시점이 되면 스위칭 소자(S1)가 도통(ON)되고 스위칭 소자(S2, S3, S4)가 차단(OFF)되는 모드 1의 동작이 시작된다.
모드 1의 구간(t0∼t1)에서는 전력회수용 캐패시터(Cc), 스위칭 소자(S1), 다이오드(D1), 인덕터(Lc) 및 패널 캐패시터(Cp)의 경로로 LC 공진 회로가 형성된다. 따라서, 도 6에 도시한 바와 같이 인덕터(Lc)에 흐르는 전류(IL)는 LC 공진에 의해 반파형을 이루며, 패널의 단자 전압(Vp)은 점차적으로 증가하여 거의 어드레스 전압(Vs)이 된다. 이때, 패널의 단자 전압(Vp)이 어드레스 전압(Vs)이 되는 시점에서는 인덕터(Lc)에는 거의 전류가 흐르지 않는다.
모드 1이 완료되면, 스위칭 소자(S1, S3)가 도통되고 스위칭 소자(S2, S4)가 차단되는 모드 2가 시작된다. 모드 2의 구간(t1∼t2)에서는 외부 인가 전압(Va)이 스위칭 소자(S3)를 통해 그대로 패널 캐패시터(Cp)로 흐르게 되어 패널의 단자 전압(Vp)을 유지하게 된다.
패널의 단자 전압(Vp)의 방전을 유지한 상태에서 모드 2가 완료되면, 스위칭 소자(S2)가 도통되고 스위칭 소자(S1, S3, S4)가 차단되는 모드 3이 시작된다.
모드 3의 구간(t2∼t3)에서는 모드 1에서와 반대의 경로인 플라즈마 패널 캐패시터(Cp), 인덕터(Lc), 다이오드(D2), 스위칭 소자(S2) 및 전력 회수용 캐패시터(Cc)의 경로로 LC 공진 회로가 형성되어, 도 6에서와 같이 인덕터(Lc)에 전류(IL)가 흐르고 패널의 단자 전압(Vp)은 감소하여 t3 시점에서 인덕터(Lc)의 전류(IL) 및 패널 단자 전압(Vp)은 0이 된다.
모드 4의 동작구간(t3∼t4)에서는 스위칭 소자(S2, S4)가 도통되고, 스위칭 소자(S1, S3)가 차단되어 패널 단자 전압(Vp)은 0V를 그대로 유지한다. 이 상태에서 스위칭 소자(S1)가 다시 도통되면 모드 1의 동작으로 사이클이 반복된다.
그런데 이와 같은 종래의 전력 회수 회로에서는 회수 과정 중 스위치의 도통 손실이나 스위칭 손실 등 회로 자체의 손실이 존재하기 때문에 에너지를 100% 회수하지 못하는 문제점이 있다. 이로 인하여 어드레스 전압을 원하는 전압(Va)까지 올리지 못하거나 접지 전압까지 내리지 못하게 되어, 스위칭 소자들이 하드-스위칭을 하게 되어 전력 손실이 발생하는 문제점이 있다. 또한 어드레스 전압의 상승 시간 및 하강 시간이 길어져서 어드레싱 속도가 느려지는 문제점이 있다.
이와 같은 문제점을 해결하기 위해 본 발명은 패널 전압의 상승 시간 및 하강 시간을 줄여 고속 어드레싱을 하는 것을 그 기술적 과제로 한다.
또한 본 발명은 패널 전압을 어드레스 전압으로 완전히 올리거나 접지 전압으로 완전히 내리는 것을 그 기술적 과제로 한다.
도 1은 본 발명에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 2는 본 발명의 일 실시예에 따른 전력 회수 회로를 나타내는 회로도이다.
도 3a 내지 도 3d는 각각 본 발명의 일 실시예에 따른 전력 회수 회로에서 각 모드의 전류 경로를 나타내는 도면이다.
도 4는 본 발명의 일 실시예에 따른 전력 회수 회로에서의 동작 타이밍을 나타내는 도면이다.
도 5는 종래 기술에 따른 전력 회수 회로를 나타내는 회로도이다.
도 6은 종래 기술에 따른 전력 회수 회로에서의 동작 타이밍을 나타내는 도면이다.
본 발명의 첫 번째 특징에 따르면 복수의 어드레스 전극 및 상기 어드레스 전극에 교차하며 서로 쌍을 이루어 지그재그로 배열된 복수의 주사 전극과 복수의 유지 전극을 포함하며, 상기 어드레스 전극과 상기 주사 전극 사이에 패널 캐패시터가 형성되는 패널을 구동하는 플라즈마 디스플레이 패널의 구동 장치가 제공된다. 이 구동 장치는 제1 및 제2 인덕터, 제1 내지 제3 스위칭 소자 및 제1 내지 제3 다이오드를 포함한다.
제1 스위칭 소자와 제1 다이오드는 제1 전압원과 제2 전압원 사이에 직렬로 연결되며 그 접점이 패널 캐패시터의 일단에 연결되며, 제1 및 제2 인덕터는 제1 스위칭 소자와 제1 다이오드의 접점에 일단이 병렬로 전기적으로 연결된다. 제2 스위칭 소자는 제1 전압원과 제1 인덕터의 타단 사이에 연결되며, 제3 스위칭 소자는 제2 전압원과 제2 인덕터의 타단 사이에 연결된다. 제2 다이오드는 제1 전압원과 제2 인덕터의 타단 사이에 연결되며, 제3 다이오드는 제1 인덕터의 타단과 제2 전압원 사이에 연결된다.
본 발명의 두 번째 특징에 따르면 플라즈마 디스플레이 패널이 제공되며, 이 플라즈마 디스플레이 패널의 구동 장치는 패널 캐패시터의 일단과 제1 및 제2 전압원 사이에 각각 전기적으로 연결되는 제1 및 제2 인덕터를 포함한다. 구동 장치는 패널 캐패시터의 단자 전압을 제2 인덕터와의 LC 공진을 이용하여 제1 전압에서 제2 전압으로 바꾸고, 제2 인덕터에 저장된 에너지를 제1 전압원으로 회수하는 중에 제1 인덕터와의 LC 공진을 이용하여 패널 캐패시터의 단자 전압을 제2 전압에서제1 전압으로 바꾸고, 제1 인덕터에 저장된 에너지를 제1 전압원으로 회수한다.
이때, 제1 및 제2 인덕터에 흐르는 전류가 최대가 될 때 패널 캐패시터의 단자 전압이 각각 제1 및 제2 전압으로 되는 것이 바람직하다.
본 발명의 세 번째 특징에 따르면 플라즈마 디스플레이 패널을 구동하는 방법이 제공된다. 이 방법에 의하면, 먼저 제1 전압으로 충전된 패널 캐패시터의 단자 전압을 패널 캐패시터에 전기적으로 연결되어 있는 제1 인덕터와의 LC 공진을 이용하여 제2 전압으로 바꾼다. 그리고 LC 공진으로 제1 인덕터에 저장된 에너지를 제1 전압원으로 회수하면서 패널 캐패시터의 단자 전압을 제2 전압으로 유지한다. 다음에 제1 인덕터에 저장된 에너지를 제1 전압원으로 회수하는 중에, 패널 캐패시터에 전기적으로 연결되어 있는 제2 인덕터와의 LC 공진을 이용하여 패널 캐패시터의 단자 전압을 제1 전압으로 바꾼다. 그리고 LC 공진으로 제2 인덕터에 저장된 에너지를 제1 전압원으로 회수하면서 패널 캐패시터의 단자 전압을 제1 전압으로 유지한다.
이때, 패널 캐패시터의 단자 전압이 제1 및 제2 전압으로 될 때 각각 제1 및 제2 인덕터에 흐르는 전류가 최대가 되는 것이 바람직하다.
본 발명의 첫 번째 내지 세 번째 특징에 따른 플라즈마 디스플레이 패널의 구동 장치, 플라즈마 디스플레이 패널 및 그 구동 방법에서 제1 전압은 어드레스 전압이며, 제2 전압은 접지 전압인 것이 바람직하다.
그러면 도면을 참조하여 본 발명의 바람직한 실시예에 플라즈마 디스플레이 패널과 그 구동 방법 및 구동 장치에 대하여 설명한다.
먼저, 도 1을 참조하여 본 발명에 따른 플라즈마 디스플레이 패널에 대하여 설명한다.
도 1은 본 발명에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 1에 도시한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널은 플라즈마 패널(100), 어드레스 구동부(200), 주사·유지 구동부(300) 및 제어부(400)를 포함한다.
플라즈마 패널(100)은 열 방향으로 배열되어 있는 복수의 어드레스 전극(A1~Am), 행 방향으로 지그재그로 배열되어 있는 복수의 주사 전극(Y1~Yn) 및 복수의 유지 전극(X1~Xn)을 포함한다.
어드레스 구동부(200)는 제어부(400)로부터 어드레스 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가하며, 무효 전력을 회수하여 재사용하는 전력 회수 회로(210)를 포함한다.
주사·유지 구동부(300)는 제어부(400)로부터 유지 방전 신호를 수신하여 주사 전극과 유지 전극에 유지 펄스 전압을 번갈아 입력함으로써 선택된 방전 셀에 대하여 유지 방전을 수행한다.
제어부(400)는 외부로부터 영상 신호를 수신하여 어드레스 구동 제어 신호와 유지 방전 신호를 생성하여 각각 어드레스 구동부(200)와 주사·유지 구동부(300)에 인가한다.
이하, 도 2 내지 도 4를 참조하여 어드레스 구동부(200)에 포함되어 있는 본발명의 일 실시예에 따른 전력 회수 회로(210)를 설명한다.
도 2는 본 발명의 일 실시예에 따른 전력 회수 회로를 나타내는 회로도이다.
도 2에 도시한 바와 같이, 본 발명의 일 실시예에 따른 전력 회수 회로(210)는 패널(패널 캐패시터(Cp))의 한 전극에 어드레스 구동 IC(도시하지 않음)를 사이에 두고 연결되어 있다. 패널 캐패시터(Cp)의 다른 전극에는 다른 구동 IC, 즉 주사 구동 IC 또는 유지 구동 IC가 연결된다.
이하에서는 어드레스 구동 IC를 생략하고 전력 회수 회로가 패널 캐패시터(Cp)에 전기적으로 연결되었다고 가정하고 설명한다.
이러한 전력 회수 회로(210)는 인덕터(L1, L2), MOSFET 등으로 이루어지며 각각 바디 다이오드를 가지는 스위칭 소자(S1, S2, S3) 및 다이오드(D1, D2, D3)를 포함한다. 스위칭 소자(S1)와 다이오드(D1)는 어드레스 전압(Va)과 접지 전압 사이에 직렬로 연결되어 있으며, 그 접점에 패널 캐패시터(Cp)의 한 전극이 연결되어 있다. 스위칭 소자(S2)와 인덕터(L1)는 어드레스 전압(Va)과 스위칭 소자(S1)와 다이오드(D1)의 접점 사이에 직렬로 연결되어 있다. 그리고 이 접점과 접지 전압 사이에는 인덕터(L2)와 스위칭 소자(S3)가 직렬로 연결되어 있다.
어드레스 전압(Va)과 인덕터(L2)와 스위칭 소자(S3)의 접점 사이에는 다이오드(D2)가 연결되어 있으며, 다이오드(D3)는 스위칭 소자(S2)와 인덕터(L1)의 접점과 접지 전압 사이에 연결되어 있다.
또한 전력 회수 회로(210)는 인덕터(L1)와 패널 캐패시터의 한 전극 사이 및 인덕터(L2)와 패널 캐패시터의 한 전극 사이에 각각 다이오드(D4, D5)를 더 포함할수 있다. 이 다이오드(D4, D5)는 각각 어드레스 전압(Va)에서 패널 캐패시터(Cp)로의 충전 경로 및 패널 캐패시터(Cp)에서 접지 전압으로의 방전 경로를 설정한다.
다음에, 도 3a 내지 도 3d, 도 4를 참조하여 본 발명의 일 실시예에 따른 플라즈마 디스플레이의 구동 방법에 대하여 설명한다.
도 3a 내지 도 3d는 각각 본 발명의 일 실시예에 따른 전력 회수 회로에서 각 모드의 전류 경로를 나타내는 도면이며, 도 4는 본 발명의 일 실시예에 따른 전력 회수 회로에서의 동작 타이밍을 나타내는 도면이다.
본 발명의 일 실시예에서는 모드 1이 시작되기 전에 스위칭 소자(S1)가 도통(on)되고 스위칭 소자(S2, S3)가 차단되어 패널 캐패시터(Cp)의 단자 전압(Vp)이 어드레스 전압(Va)으로 유지되고 있는 것으로 가정한다. 또한 인덕터(L1, L2)의 인덕턴스는 각각 La1 및 La2로 가정한다.
① 모드 1(M1)
도 3a와 도 4의 M1 구간을 참조하여 모드 1에서의 동작을 설명한다.
모드 1 구간(M1)에서는 스위칭 소자(S1)가 차단되고 스위칭 소자(S3)가 도통된다. 그러면 패널 캐패시터(Cp), 다이오드(D5), 인덕터(L2) 및 스위칭 소자(S3)로 전류 경로가 형성되어 패널 캐패시터(Cp)와 인덕터(L2)에 의해 LC 공진 전류가 흐른다. 이 공진 전류에 의해 인덕터(L2)에 흐르는 전류(IL2)는 증가하게 되어 인덕터에는 에너지가 축적되고, 패널 캐패시터(Cp)의 단자 전압(Vp)은 어드레스 전압(Va)에서 접지 전압으로 감소한다. 즉, 패널 캐패시터(Cp)에 축적되어 있던에너지가 인덕터(L2)에 저장된다.
② 모드 2(M2)
도 3b와 도 4의 M2 구간을 참조하여 모드 2에서의 동작을 설명한다.
패널 캐패시터(Cp)의 단자 전압(Vp)이 접지 전압으로 떨어지면 스위칭 소자(S3)를 차단한다. 스위칭 소자(S3)가 차단되면 인덕터(L2)에 흐르던 전류(IL2)는 다이오드(D1), 다이오드(D5), 인덕터(L2) 및 다이오드(D2)의 경로로 흐르며 Va/La2의 기울기로 선형적으로 감소한다. 즉, 인덕터(L2)에 축적된 에너지를 어드레스 전압(Va) 측으로 회수한다. 그리고 패널 캐패시터(Cp)의 단자 전압(Vp)은 접지 전압으로 유지하게 된다.
③ 모드 3(M3)
도 3c와 도 4의 M3 구간을 참조하여 모드 3에서의 동작을 설명한다.
모드 3 구간(M3)에서는 인덕터(L2)에 흐르는 전류(IL2)가 감소하는 중에 스위칭 소자(S2)가 도통된다. 그러면 스위칭 소자(S2), 인덕터(L1), 다이오드(D4) 및 패널 캐패시터(Cp)로 전류 경로가 형성되어 패널 캐패시터(Cp)와 인덕터(L1)에 의해 LC 공진 전류가 흐른다. 이 공진 전류에 의해 인덕터(L1)에는 흐르는 전류(IL1)는 증가하게 되어 인덕터(L1)에는 에너지가 축적되고, 패널 캐패시터(Cp)의 전압은 접지 전압에서 어드레스 전압(Va)으로 상승한다.
그리고, 인덕터(L2)에 흐르는 전류(IL2)는 0A가 될 때까지 어드레스 전압(Va) 측으로 계속 흘러서, 인덕터(L2)에 축적된 에너지는 어드레스 전압(Va)측으로 회수되게 된다.
④ 모드 4(M4)
도 3d와 도 4의 M4 구간을 참조하여 모드 4에서의 동작을 설명한다.
모드 4 구간(M4)에서는 패널 캐패시터(Cp)의 단자 전압(Vp)이 어드레스 전압(Va)으로 상승한 상태에서 스위칭 소자(S2)를 차단하고 스위칭 소자(S1)를 도통시킨다. 스위칭 소자(S1)가 도통되면 어드레스 전압(Va), 스위칭 소자(S1) 및 패널 캐패시터(Cp)로 경로가 형성되어 패널 캐패시터(Cp)의 단자 전압(Vp)은 어드레스 전압(Va)을 유지할 수 있다.
또한 스위칭 소자(S2)가 차단되고 패널 캐패시터(Cp)의 단자 전압(Vp)이 어드레스 전압(Va)으로 되면 스위칭 소자(S1)의 바디 다이오드가 도통되어서, 인덕터(L1)에 흐르던 전류(IL1)는 다이오드(D3), 인덕터(L1), 다이오드(D4) 및 스위칭 소자(S1)의 바디 다이오드의 경로로 흐르며 Va/L1의 기울기로 선형적으로 0A까지 감소한다. 즉, 인덕터(L1)에 축적된 에너지가 어드레스 전압(Va) 측으로 회수된다.
다음에 모드 1부터 모드 4의 과정이 반복되어 패널 캐패시터(Cp)의 단자 전압(Vp)은 어드레스 전압(Va)과 접지 전압을 반복적으로 전환한다.
이상에서 본 발명의 제1 및 제2 실시예에 대하여 설명하였으나, 본 발명은 상기한 실시예에만 한정되는 것은 아니며, 그 외의 다양한 변형이나 변경이 가능하다.
이와 같이 본 발명에 의하면, LC 공진에 의해 인덕터(L1, L2)에 흐르는 전류가 0A에서 최대가 되는 동안 패널 캐패시터(Cp)의 단자 전압(Vp)이 바뀐다. 또한 인덕터의 전류가 완전히 감소하기 전에 패널 캐패시터(Cp)의 단자 전압을 증가시키므로, 즉 1/4 공진을 이용하여 패널 캐패시터(Cp)의 단자 전압(Vp)을 바꾸므로 종래의 반 공진을 이용하는 회로에 비해 고속 어드레싱을 할 수 있으며, 전원 회수율에 관계없이 단자 전압(Vp)을 어드레스 전압으로 완전히 올리거나 접지 전압으로 완전히 내릴 수 있다.
그리고 인덕터(L1, L2)에 저장된 에너지를 어드레스 전압(Va) 측으로 회수함으로써 순환 전류가 발생하지 않는다. 또한 패널 캐패시터(Cp)의 충전 및 방전시의 공진 경로를 분리함으로써 어드레스 전압의 상승 시간 및 하강 시간을 줄일 수 있으며, 상승 및 하강 시간을 서로 다르게 할 수 있다.

Claims (15)

  1. 복수의 어드레스 전극 및 상기 어드레스 전극에 교차하며 서로 쌍을 이루어 지그재그로 배열된 복수의 주사 전극과 복수의 유지 전극을 포함하며, 상기 어드레스 전극과 상기 주사 전극 사이에 패널 캐패시터가 형성되는 패널을 구동하는 플라즈마 디스플레이 패널의 구동 장치에 있어서,
    제1 전압원과 제2 전압원 사이에 직렬로 연결되며 그 접점이 상기 패널 캐패시터의 일단에 연결되는 제1 스위칭 소자 및 제1 다이오드,
    상기 제1 스위칭 소자와 제1 다이오드의 접점에 일단이 병렬로 전기적으로 연결되는 제1 및 제2 인덕터,
    상기 제1 전압원과 상기 제1 인덕터의 타단 사이에 연결되는 제2 스위칭 소자,
    상기 제2 인덕터의 타단과 상기 제2 전압원 사이에 연결되는 제3 스위칭 소자,
    상기 제1 전압원과 상기 제2 인덕터의 타단 사이에 연결되는 제2 다이오드, 그리고
    상기 제1 인덕터의 타단과 상기 제2 전압원 사이에 연결되는 제3 다이오드
    를 포함하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 제1항에 있어서,
    상기 제1 인덕터와 상기 패널 캐패시터 사이에 연결되는 제4 다이오드, 그리고
    상기 패널 캐패시터와 상기 제2 인덕터 사이에 연결되는 제5 다이오드
    를 더 포함하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 제1항에 있어서,
    상기 제1 전압은 어드레스 전압이며, 상기 제2 전압은 접지 전압인 플라즈마 디스플레이 패널의 구동 장치.
  4. 제1항에 있어서,
    상기 제1 스위칭 소자는 바디 다이오드를 가지는 플라즈마 디스플레이 패널의 구동 장치.
  5. 복수의 어드레스 전극 및 상기 어드레스 전극에 교차하며 서로 쌍을 이루어 지그재그로 배열된 복수의 주사 전극과 복수의 유지 전극을 포함하며, 상기 어드레스 전극과 상기 주사 전극 사이에 패널 캐패시터가 형성되는 패널과 상기 패널을 구동하는 구동 장치를 포함하는 플라즈마 디스플레이 패널에 있어서,
    상기 구동 장치는
    상기 패널 캐패시터의 일단과 제1 전압원 및 제2 전압원 사이에 각각 전기적으로 연결되는 제1 및 제2 인덕터를 포함하며,
    상기 패널 캐패시터의 단자 전압을 상기 제2 인덕터와의 LC 공진을 이용하여 상기 제1 전압에서 상기 제2 전압으로 바꾸고, 상기 제2 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하는 중에 상기 제1 인덕터와의 LC 공진을 이용하여 상기 패널 캐패시터의 단자 전압을 상기 제2 전압에서 상기 제1 전압으로 바꾸고, 상기 제1 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하는 플라즈마 디스플레이 패널.
  6. 제5항에 있어서,
    상기 구동 장치는 상기 제1 및 제2 인덕터에 흐르는 전류가 최대가 될 때 상기 패널 캐패시터의 단자 전압이 각각 상기 제1 및 제2 전압으로 되는 플라즈마 디스플레이 패널.
  7. 제5항에 있어서,
    상기 구동 장치는
    상기 제1 전압원과 상기 제1 인덕터 사이에 연결되어 상기 패널 캐패시터의 단자 전압이 상기 제1 전압으로 바뀌도록 스위칭 동작하는 제1 스위칭 소자, 그리고
    상기 제2 전압원과 상기 제2 인덕터 사이에 연결되어 상기 패널 캐패시터의 단자 전압이 상기 제2 전압으로 바뀌도록 스위칭 동작하는 제2 스위칭 소자
    를 더 포함하는 플라즈마 디스플레이 패널.
  8. 제5항에 있어서,
    상기 구동 장치는
    상기 제2 전압원과 상기 제1 인덕터 일단 사이 및 상기 제1 인덕터의 타단과 상기 제1 전압원 사이에 각각 연결되어 상기 제1 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하는 전류 경로를 설정하는 제1 다이오드 및 스위칭 소자, 그리고
    상기 제2 전압원과 상기 제2 인덕터의 일단 사이 및 상기 제2 인덕터의 타단과 상기 제1 전압원 사이에 각각 연결되어 상기 제2 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하는 전류 경로를 설정하는 제2 및 제3 다이오드
    를 더 포함하는 플라즈마 디스플레이 패널.
  9. 제5항에 있어서,
    상기 제1 전압은 어드레스 전압이며, 상기 제2 전압은 접지 전압인 플라즈마 디스플레이 패널의 구동 장치.
  10. 복수의 어드레스 전극 및 상기 어드레스 전극에 교차하며 서로 쌍을 이루어 지그재그로 배열된 복수의 주사 전극과 복수의 유지 전극을 포함하며, 상기 어드레스 전극과 상기 주사 전극 사이에 패널 캐패시터가 형성되는 패널을 포함하는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    제1 전압으로 충전된 상기 패널 캐패시터의 단자 전압을 상기 패널 캐패시터에 전기적으로 연결되어 있는 제1 인덕터와의 LC 공진을 이용하여 상기 제2 전압으로 바꾸는 제1 단계,
    상기 제1 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하면서 상기 패널 캐패시터의 단자 전압을 상기 제2 전압으로 유지하는 제2 단계,
    상기 제1 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하는 중에, 상기 패널 캐패시터에 전기적으로 연결되어 있는 제2 인덕터와의 LC 공진을 이용하여 상기 패널 캐패시터의 단자 전압을 상기 제1 전압으로 바꾸는 제3 단계, 그리고
    상기 제2 인덕터에 저장된 에너지를 상기 제1 전압원으로 회수하면서 상기 패널 캐패시터의 단자 전압을 상기 제1 전압으로 유지하는 제4 단계
    를 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  11. 제10항에 있어서,
    상기 제1 인덕터에 흐르는 전류는 상기 패널 캐패시터의 단자 전압이 상기 제2 전압으로 될 때 최대가 되며,
    상기 제2 인덕터에 흐르는 전류는 상기 패널 캐패시터의 단자 전압이 상기 제1 전압으로 될 때 최대가 되는
    플라즈마 디스플레이 패널의 구동 방법.
  12. 제10항에 있어서,
    상기 제1 단계는 상기 제1 인덕터와 상기 제2 전압원 사이에 연결된 제1 스위칭 소자를 스위칭하여 LC 공진을 형성하며,
    상기 제3 단계는 상기 제2 인덕터와 상기 제1 전압원 사이에 연결된 제2 스위칭 소자를 스위칭하여 LC 공진을 형성하는
    플라즈마 디스플레이 패널의 구동 방법.
  13. 제10항에 있어서,
    상기 제2 단계는 상기 제2 전압원, 상기 제1 인덕터 및 상기 제1 전압원으로 형성되는 전류 경로로 상기 제1 인덕터에 저장된 에너지를 회수하며,
    상기 제4 단계는 상기 제2 전압원, 상기 제2 인덕터 및 상기 제1 전압원으로 형성되는 전류 경로로 상기 제2 인덕터에 저장된 에너지를 회수하는
    플라즈마 디스플레이 패널의 구동 방법.
  14. 제10항에 있어서,
    상기 제4 단계는 상기 패널 캐패시터와 상기 제1 전압원 사이에 연결된 스위칭 소자를 스위칭하여 상기 패널 캐패시터의 단자 전압을 상기 제1 전압으로 유지하는 플라즈마 디스플레이 패널의 구동 방법.
  15. 제10항에 있어서,
    상기 제1 전압은 어드레스 전압이며, 상기 제2 전압은 접지 전압인 플라즈마디스플레이 패널의 구동 방법.
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