KR100502934B1 - 플라즈마 디스플레이 패널, 그의 구동 장치 및 그의 구동방법 - Google Patents

플라즈마 디스플레이 패널, 그의 구동 장치 및 그의 구동방법 Download PDF

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Abstract

본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 방전유지부, 충방전부를 포함한다.
방전유지부는 제1 전압과 제2 전압 사이에 직렬로 연결되며 접점이 상기 패널 캐패시터의 일단에 연결되는 제1 및 제2 스위치와, 상기 제1 전압과 상기 제2 전압 사이에 직렬로 연결되며 접점이 상기 패널 캐패시터의 타단에 연결되는 제3 및 제4 스위치를 포함하며 상기 패널 캐패시터의 단자의 전압을 상기 제1 전압 또는 상기 제2 전압으로 유지한다.
충방전부는 상기 패널 캐패시터의 일단 및 타단에 전기적으로 연결되는 제1 및 제2 인덕터를 포함하며, 상기 패널 캐패시터의 양단 전압이 유지방전전압을 유지하고 있는 동안 전류를 부스팅하여 상기 제1 및 제2 인덕터에 에너지를 저장시키고, 상기 제1 및 제2 인덕터에 저장된 에너지를 이용하여 상기 패널 캐패시터의 양단 전압의 극성을 바꾼다.
이와 같은 본 발명에 따르면 회로의 기생 성분에도 불구하고 영전압 스위칭을 할 수 있으며, 유지 방전 동작 개시시에 돌입 전류를 방지할 수 있다.

Description

플라즈마 디스플레이 패널, 그의 구동 장치 및 그의 구동 방법{A PLASMA DISPLAY PANEL, A DRIVING APPARATUS AND A METHOD OF THE PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널(plasma display panel; PDP), 그의 구동장치 및 방법에 관한 것으로, 특히 플라즈마 디스플레이 발광에 직접 기여하는 전력회수회로 및 그의 구동방법에 관한 것이다.
최근 액정표시장치(liquid crystal display; LCD), 전계 방출 표시장치(field emission display; FED), PDP 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 PDP는 다른 평면 표시 장치에 비해 휘도 및 발광효율이 높으며 시야각이 넓다는 장점이 있다. 따라서, PDP가 40인치 이상의 대형 표시 장치에서 종래의 CRT(cathode ray tube)를 대체할 표시 장치로서 각광받고 있다.
PDP는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 픽셀(pixel)이 매트릭스(matrix)형태로 배열되어 있다. 이러한 PDP는 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형(DC형)과 교류형(AC형)으로 구분된다.
직류형 PDP는 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전공간에 그대로 흐르게 되며, 이를 위해 전류제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 PDP에서는 전극을 유전체층이 덮고 있어 자연스러운 캐패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
도 1은 AC형 플라즈마 디스플레이 패널의 일부 사시도이다.
도 1에 도시한 바와 같이, 제1유리기판(1) 위에는 유전체층(2) 및 보호막(3)으로 덮인 주사전극(4)과 유지전극(5)이 쌍을 이루어 평행하게 설치된다. 제2유리기판(6) 위에는 절연체층(7)으로 덮인 복수의 어드레스전극(8)이 설치된다. 어드레스전극(8)들 사이에 있는 절연체층(7) 위에는 어드레스 전극(8)과 평행하게 격벽(9)이 형성되어 있다. 또한, 절연체층(7)의 표면 및 격벽(9)의 양측면에 형광체(10)가 형성되어 있다. 제1유리기판(1)과 제2유리기판(6)은 주사전극(4)과 어드레스전극(8) 및 유지전극(5)과 어드레스전극(8)이 직교하도록 방전공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스전극(8)과, 쌍을 이루는 주사전극(4)과 유지전극(5)과의 교차부에 있는 방전공간이 방전셀(12)을 형성한다.
도 2는 플라즈마 디스플레이 패널의 전극 배열도를 나타낸다.
도2에 도시한 바와 같이, PDP 전극은 m ×n의 매트릭스 구성을 가지고 있으며, 구체적으로 열 방향으로는 어드레스전극(A1~Am)이 배열되어 있고 행방 향으로는 n행의 주사전극(Y1~Yn) 및 유지전극(X1~Xn)이 지그재그로 배열되어 있다. 도 2에 도시된 방전셀(12)은 도 1에 도시된 방전셀(12)에 대응한다.
일반적으로 AC PDP의 구동 방법은 리셋(초기화)기간, 기록(어드레싱)기간, 유지기간, 소거기간으로 구성된다.
리셋기간은 셀에 어드레싱 동작이 원할히 수행되도록 하기 위해 각 셀의 상태를 초기화시키는 기간이며, 기록기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽전하를 쌓아두는 동작을 수행하는 기간이다. 유지 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 방전을 수행하는 기간이며, 소거기간은 셀의 벽전하를 감소시켜 유지방전을 종료시키는 기간이다.
AC형 PDP는 그 유지 방전을 위한 주사전극(이하에서는 이를 'Y 전극'이라 한다.) 및 유지전극(이하에서는 이를 'X전극'이라 한다.)이 용량성 부하로 작용하기 때문에 주사 전극 및 유지 전극에 대한 캐패시턴스가 존재하며, 유지 방전을 위한 파형을 인가하기 위해서는 방전을 위한 전력 이외에 무효 전력이 필요하다. 이런 무효 전력을 회수하여 재 사용하는 회로를 전력회수회로(또는 유지 방전 회로)라고 한다.
이하에서는 종래의 교류 플라즈마 디스플레이 패널의 전력회수회로와 그의 구동방법을 설명한다.
도3 및 도4는 종래의 전력회수회로와 그 동작 파형을 나타내는 도면이다.
첨부한 도3에서와 같이, L.F. Weber에 의해 제안된 전력회수회로(미국 특허 번호 4,866,349 및 5,081,400)는 교류형 플라즈마 디스플레이 패널의 전력회수회로로서, 교류형 플라즈마 디스플레이 패널의 구동회로는 X 전극의 전력회수회로(10)와 Y 전극의 전력회수회로(11)(도시하지 않음)가 각각 동일하게 구성된다. 이하에서는 편의상 하나의 전극에 대한 전력회수회로에 대해 설명한다.
종래의 전력회수회로(10)는 두 개의 스위치(Sa, Sb), 다이오드(D1, D2), 인덕터(Lc) 및 전력회수용 캐패시터(Cc)로 구성되는 전력 회수부와, 직렬로 연결된 두 개의 스위치(Sc, Sd)로 구성되는 유지 방전부를 포함한다.
유지 방전부의 두 개의 스위치(Sc, Sd) 사이의 접점에는 플라즈마 디스플레이 패널이 연결되며, 이 플라즈마 디스플레이 패널을 등가적으로 캐패시터(Cp)로 나타내었다.
이와 같이 구성된 종래의 전력회수회로는 첨부한 도4에서와 같이, 스위치(Sa ~ Sd)의 스위칭 동작에 따라 4가지 모드로 동작하고, 스위칭 동작에 따라 출력전압(Vp)과 인덕터(Lc)에 흐르는 전류(IL)의 파형이 각각 나타나게 된다.
초기 상태에서는 스위치(Sa)가 도통 되기 직전에 스위치(Sd)가 도통되어 있어서 패널의 양단 전압(Vp)은 0 V를 유지하게 된다. 이때, 전력회수용 캐패시터(Cc)는 유지방전전압(Vs)의 1/2만큼의 전압(Vs/2)으로 미리 충전되어 유지 방전 개시시 돌입 전류가 발생하지 않도록 한다.
이렇게 패널의 양단 전압(Vp)을 0 V로 유지한 상태에서, t0 시점이 되면, 스위치(Sa)가 온(On)되고 스위치(Sb, Sc, Sd)가 오프(Off)되는 모드 1의 동작이 시작된다.
모드 1의 동작구간(t0 ~ t1)에서는 전력회수용 캐패시터(Cc), 스위치(Sa), 다이오드(D1), 인덕터(Lc) 및 플라즈마 패널 캐패시터(Cp)의 경로로 LC 공진회로가 형성된다. 따라서, 도4에 도시한 바와 같이 인덕터(Lc)에 흐르는 전류(IL)는 LC 공진에 의해 반파형을 이루며, 패널의 출력 전압(Vp)은 점차적으로 증가하여 거의 유지방전전압(Vs)이 된다. 이때, 패널의 출력 전압(Vp)이 유지방전전압(Vs)이 되는 시점에서는 인덕터(Lc)에 거의 전류가 흐르지 않는다.
모드 1이 완료되면, 스위치(Sa, Sc)가 온 되고 스위치(Sb, Sd)가 오프되는 모드 2가 시작된다. 모드 2의 동작구간(t1 ~ t2)에서는 외부 인가전압(Vs)이 스위치(Sc)를 통해 그대로 패널 캐패시터(Cp)로 흐르게 되어 패널의 출력 전압(Vp)을 유지하게 된다. 이때, t1에서 이상적으로는 스위치(Sc)양단의 전압이 0이므로 영전압 스위칭(zero voltage switching)을 하게된다.
패널의 출력 전압(Vp)의 방전을 유지한 상태에서 모드 2가 완료되면, 스위치(Sb)가 온 되고 스위치(Sa, Sc, Sd)가 오프되는 모드 3이 시작된다.
모드 3의 동작구간(t2 ~ t3)에서는, 모드 1에서와 반대의 경로 즉, 플라즈마 패널 캐패시터(Cp), 인덕터(Lc), 다이오드(D2), 스위치(S2) 및 전력회수용 캐패시터(Cc)의 경로로 LC 공진회로가 형성되어, 도4에서와 같이 인덕터(Lc)에 전류(IL)가 흐르고 패널의 출력 전압(Vp)은 감소하여 t3 시점에서 인덕터(Lc)의 전류(IL) 및 패널 출력 전압(Vp)은 0이 된다.
모드 4의 동작구간(t3 ~ t4)에서는 스위치(Sb, Sd)가 온 되고, 스위치(Sa, Sc)가 오프되어 패널 출력 전압(Vp)은 0 V를 그대로 유지한다. 이 상태에서 스위치(Sa)가 다시 도통되면 모드 1의 동작으로 사이클(cycle)이 반복된다.
그런데, 상기와 같은 종래의 전력회수회로는 실제 회로의 기생 성분(인덕터의 기생 저항, 캐패시터 및 패널의 기생 저항, 스위치의 도통 저항)에 의해 회로를 구성하는 스위치가 영전압 스위칭하는 것이 불가능하고, 이에 따라 스위치의 턴온시에 스위칭 손실이 매우 커진다는 문제점이 있다. 즉, 종래의 전력회수회로에 따르면, 이상적으로 패널 캐패시터의 한쪽 단자가 유지방전전압(Vs) 만큼 증가한 경우 인덕터(Lc)에 저장되어 있는 자기 에너지는 0이기 때문에, 실제 회로의 기생 성분에 의해 패널 캐패시터의 한쪽 단자가 유지방전 전압(Vs)에 이르지 못한 경우에 패널 캐패시터의 한쪽 단자를 Vs 전압까지 상승시킬 전압 소스가 없게 된다. 따라서, 실제 스위치(Sc)의 영전압 스위칭이 불가능하여 스위치의 턴온시에 스위칭 손실이 매우 커진다는 문제점이 있다.
또한, 종래의 전력회수회로에서는 발광 개시 직후 전력 회수용 캐패시터(Cc)가 항상 Vs/2 전압만큼 충전되어야 하며, 전력 회수용 캐패시터가 Vs/2 만큼 충전되고 있지 않은 상태에서는 유지 방전 펄스 개시시에 매우 큰 돌입 전류가 발생하고, 이를 제한하는 보호회로를 따로 구비해야 하는 문제점이 있다.
또한, 종래의 전력회수회로에서는 패널 전압의 상승이나 하강시간이 길어 패널의 방전이 에너지 회수 구간(패널 전압의 상승 또는 하강 구간)에서 일어날 수 있으며, 이 경우 패널 전압의 드롭이 발생하여 서스테인 스위치(Sc)가 하드 스위칭을 하게 되어 스위치의 턴온시에 스위칭 손실이 매우 커진다는 문제점이 있다.
이와 같은 문제점을 해결하기 위해, 본 발명이 이루고자 하는 기술적인 과제는 실제 회로의 기생 성분에도 불구하고 영전압 스위칭을 할 수 있도록 하는 플라즈마 디스플레이 패널의 구동장치 및 구동방법을 제공하기 위한 것이다.
또한, 유지 방전 동작 개시시에 돌입 전류를 제거할 수 있는 플라즈마 디스플레이 패널의 구동장치 및 구동방법을 제공하기 위한 것이다.
또한, 패널 전압의 상승이나 하강 구간을 단축시켜 유지 구간에 방전이 일어날 수 있도록 하는 플라즈마 디스플레이 패널의 구동장치 및 구동방법을 제공하기 위한 것이다.
이와 같은 목적을 달성하기 위한 본 발명의 한 특징에 따르면, 복수의 제1 전극과 복수의 제2 전극을 포함하며, 상기 제1 전극과 상기 제2 전극에 의해 패널 캐패시터가 형성되는 패널, 그리고 상기 제1 전극과 상기 제2 전극을 구동하는 구동부를 포함하는 플라즈마 표시 패널이 제공된다.
본 발명의 한 실시예에 따르면, 상기 구동부는 유지방전부, 제1 및 제2 충방전부를 포함한다. 유지방정부는 제1 전압을 공급하는 제1 전원과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되며 접점이 상기 제1 전극에 전기적으로 연결되는 제1 및 제2 스위치와, 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되며 접점이 상기 제2 전극에 전기적으로 연결되는 제3 및 제4 스위치를 포함하며, 상기 제1 전극 또는 상기 제2 전극의 전압을 상기 제1 전압 또는 상기 제2 전압으로 유지한다. 제1 충방전부는 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제1 및 제2 캐패시터, 상기 제1 및 제2 캐패시터가 공통으로 연결되는 제1 접점에 각각 병렬로 전기적으로 연결되는 제5 및 제6 스위치, 상기 제5 및 제6 스위치를 통하여 상기 제1 접점과 상기 제1 전극 사이에 형성되는 경로 상에 형성되는 제1 인덕터를 포함하며, 상기 제1 전극의 전압을 변경한다. 그리고 제2 충방전부는 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제3 및 제4 캐패시터, 상기 제3 및 제4 캐패시터가 공통으로 연결되는 제2 접점에 각각 병렬로 전기적으로 연결되는 제7 및 제8 스위치, 상기 제7 및 제8 스위치를 통하여 상기 제2 접점과 상기 제2 전극 사이에 형성되는 경로 상에 형성되는 제2 인덕터를 포함하며, 상기 제2 전극의 전압을 변경한다.
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본 발명의 다른 실시예에 따르면, 상기 구동부의 유지방전부는 제1 전압을 공급하는 제1 전원과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되며 접점이 상기 제1 전극에 전기적으로 연결되는 제1 및 제2 스위치와, 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되며 접점이 상기 제2 전극에 전기적으로 연결되는 제3 및 제4 스위치를 포함하며, 상기 제1 전극 또는 상기 제2 전극의 전압을 상기 제1 전압 또는 상기 제2 전압으로 유지한다. 제1 충방전부는 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제1 캐패시터 및 제1 가변 전압, 상기 제1 캐패시터 및 제1 가변 전압이 공통으로 연결되는 제1 접점에 각각 병렬로 전기적으로 연결되는 제5 및 제6 스위치, 상기 제5 및 제6 스위치를 통하여 상기 제1 접점과 상기 제1 전극 사이에 형성되는 경로 상에 형성되는 제1 인덕터를 포함하며, 상기 제1 전극의 전압을 변경한다. 그리고 제2 충방전부는 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제2 캐패시터 및 제2 가변 전압, 상기 제2 캐패시터 및 제2 가변 전압이 공통으로 연결되는 제2 접점에 각각 병렬로 전기적으로 연결되는 제7 및 제8 스위치, 상기 제7 및 제8 스위치를 통하여 상기 제2 접점과 상기 제2 전극 사이에 형성되는 경로 상에 형성되는 제2 인덕터를 포함하며, 상기 제2 전극의 전압을 변경한다.
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본 발명의 다른 특징에 따르면, 복수의 제1 전극과 복수의 제2 전극을 포함하는 패널, 상기 제1 전극에 제1단이 전기적으로 연결되는 제1 인덕터 및 상기 제2 전극에 제1단이 전기적으로 연결되는 제2 인덕터를 포함하는 플라즈마 디스플레이 패널을 구동하는 방법이 제공된다. 이 구동 방법에 의하면, 상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 제1 전압을 공급하는 제1 전원 및 제2 전압을 공급하는 제2 전원에 전기적으로 연결하여 상기 제1 전극의 전압을 증가시키고 상기 제2 전극의 전압을 감소시킨다. 다음, 상기 제1 전극 및 상기 제2 전극에 각각 상기 제3 전압 및 상기 제3 전압보다 낮은 제4 전압을 인가하고, 상기 제1 및 제2 인덕터를 각각 상기 제1 및 제2 전원과 전기적으로 차단한다. 그리고 상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 상기 제1 전원 및 상기 제2 전원에 전기적으로 연결하여 상기 제1 전극의 전압을 감소시키고 상기 제2 전극의 전압을 증가시킨다. 다음, 상기 제1 전극 및 상기 제2 전극에 각각 상기 제4 전압 및 상기 제3 전압을 인가하고, 상기 제1 및 제2 인덕터를 각각 상기 제1 및 제2 전원과 전기적으로 차단한다.
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본 발명의 또다른 특징에 따르면, 복수의 제1 전극과 복수의 제2 전극을 포함하는 패널, 상기 제1 전극에 제1단이 전기적으로 연결되는 제1 인덕터 및 상기 제2 전극에 제1단이 전기적으로 연결되는 제2 인덕터를 포함하는 플라즈마 디스플레이 패널이 제공된다. 이 플라즈마 디스플레이 패널은 제1 및 제2 공진 수단과 제1 및 제2 유지 수단을 포함한다. 제1 공진 수단은 상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 제1 전압을 공급하는 제1 전원 및 제2 전압을 공급하는 제2 전원에 연결하여 상기 제1 전극의 전압을 증가시키고 상기 제2 전극의 전압을 감소시킨다. 제2 공진 수단은 상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 상기 제1 전원 및 상기 제1 전원에 연결하여 상기 제1 전극의 전압을 감소시키고 상기 제2 전극의 전압을 증가시킨다. 제1 유지 수단은 상기 제1 및 제2 전압보다 높은 제3 전압을 공급하는 제3 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제1 스위치와 상기 제1 및 제2 전압보다 낮은 제4 전압을 공급하는 제4 전원과 상기 제2 전극 사이에 전기적으로 연결되는 제2 스위치를 포함하며, 상기 제1 공진 수단에 의해 상기 제1 및 제2 전극의 전압이 변경된 후 상기 제1 및 제2 전극에 각각 제3 및 제4 전압을 인가한다. 그리고 제2 유지 수단은 상기 제3 전원과 상기 제2 전극 사이에 전기적으로 연결되는 제3 스위치와 상기 제4 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제4 스위치를 포함하며, 상기 제2 공진 수단에 의해 상기 제1 및 제2 전극의 전압이 변경된 후 상기 제1 및 제2 전극에 각각 제4 및 제3 전압을 인가한다.
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이하에서는 본 발명의 기술 분야에서 통상의 지식을 가진 자가 본 발명을 용이하게 실시할 수 있는 가장 바람직한 실시 예를 첨부한 도면을 참조하여 상세히 설명한다.
도5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널(PDP)을 나타내는 도면이다.
도5에 도시한 바와 같이, 본 발명의 실시예에 따른 PDP는 플라즈마 패널(100), 어드레스 구동부(200), 주사·유지 구동부(300) 및 제어부(400)를 포함한다.
플라즈마 패널(100)은 열 방향으로 배열되어 있는 다수의 어드레스 전극(A1~Am), 행 방향으로 지그재그로 배열되어 있는 다수의 주사전극(Y1~Yn) 및 유지전극(X1~Xn)을 포함한다.
어드레스 구동부(200)는 제어부(200)로부터 어드레스 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
주사·유지 구동부(300)는 제어부(200)로부터 유지 방전 신호를 수신하여 주사전극과 유지전극에 유지펄스전압을 번갈아 입력함으로써 선택된 방전셀에 대하여 유지방전을 수행한다.
제어부(400)는 외부로부터 영상 신호를 수신하여 어드레스 구동제어 신호와 유지 방전 신호를 생성하여 각각 어드레스 구동부(200)와 주사·유지 구동부(300)에 인가한다.
본 발명의 실시예에 따른 주사·유지 구동부(300)는 무효 전력을 회수하여 재 사용하는 회로인 전력회수회로를 포함하는데, 본 발명의 제1 실시예에 따른 전력회수회로(320)를 도6에 도시하였다.
도6에 도시한 바와 같이, 본 발명의 실시예에 따른 전력회수회로(320)는 유지방전부(322), Y 전극 충방전부(324)와 X 전극 충방전부(326)를 포함한다.
유지방전부(322)는 유지방전전압(Vs) 또는 접지전압에 연결되며 각각 바디 다이오드를 가지는 MOSFET으로 이루어지는 4개의 서스테인 스위치(Ys, Yg, Xs, Xg)를 포함한다. 패널 캐패시터(Cp)의 양 단자의 전압(Vy, Vx)은 이들 4개의 스위치의 스위칭 동작에 의해 유지방전전압(Vs) 또는 접지전압을 유지한다.
Y 전극 충방전부(324)는 유지방전전압(Vs)과 접지전압 사이에 직렬로 연결되는 전력회수용 캐패시터(Cyer1, Cyer2), 패널 캐패시터(Cp)의 양단간 전압(Vp)을 상승시키거나 하강시키기 위해 캐패시터(Cyer1, Cyer2)의 사이의 접점과 병렬로 연결되는 에너지 회수 스위치(Yr, Yf), 스위치(Yr, Yf) 사이의 접점과 패널 캐패시터(Cp) 사이에 형성되는 인덕터(L1)를 포함한다. 또한, 본 발명의 실시예에 따른 Y 전극 충방전부(324)는 스위치(Yr, Yf)에 각각 연결되며 패널 캐패시터(Cp)로 공급되는 전류 경로 및 패널 캐패시터로부터 회수되는 전류 경로를 설정하는 다이오드(Dy1, Dy2)를 더 포함할 수 있다. 이러한 Y 전극 충방전부(324)는 패널 캐패시터의 Y 전극 단자를 유지방전전압(Vs)으로 충전하거나 접지전압으로 방전시키는 역할을 한다.
X 전극 충방전부(326)는 유지방전전압(Vs)과 접지전압 사이에 직렬로 연결되는 전력회수용 캐패시터(Cxer1, Cxer2), 패널 캐패시터(Cp)의 양단간 전압(Vp)을 상승시키거나 하강시키기 위해 캐패시터(Cxer1, Cxer2)의 사이의 접점과 병렬로 연결되는 에너지 회수 스위치(Xr, Xf), 스위치(Xr, Xf) 사이의 접점과 패널 캐패시터(Cp) 사이에 형성되는 인덕터(L2)를 포함한다. 또한, 본 발명의 실시예에 따른 X 전극 충방전부(326)는 스위치(Xr, Xf)에 각각 연결되며 패널 캐패시터(Cp)로 공급되는 전류 경로 및 패널 캐패시터로부터 회수되는 전류 경로를 설정하는 다이오드(Dx1, Dx2)를 더 포함할 수 있다. 이러한 X 전극 충방전부(326)는 패널 캐패시터의 X 전극 단자를 유지방전전압(Vs)으로 충전하거나 접지전압으로 방전시키는 역할을 한다.
다음은 도7A 내지 도7H, 도8을 참조하여 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 설명한다.
도7A 내지 도7H는 본 발명의 제1 실시예에 따른 각 모드의 전류 경로를 나타내는 도면이며, 도8은 본 발명의 제1 실시예에 따른 동작 타이밍도를 나타내는 도면이다.
본 발명의 제1 실시예에서는 모드 1이 시작되기 전에 스위치(Yg, Xs)가 도통되어 있고, Cyer1=V1, Cyer2=V2, Cxer1=V3, Cxer2=V4의 전압이 충전되어 있으며, L1 = L2 = L이라 가정한다.
① 모드 1 (t0-t1) - 도7A 참조
모드 1 구간에서는 스위치(Yg, Xs)가 도통된 상태에서 스위치(Yr, Xf)가 도통된다. 스위치(Yg, Xs)가 도통된 상태에서, Y 전극 충방전부(324)의 스위치(Yr)가 도통되면, 도7A에 도시한 바와 같이 캐패시터(Cyer2)-스위치(Yr)-인덕터(L1)-스위치(Yg)로 전류경로가 형성된다. 또한, X 전극 충방전부(326)의 스위치(Xf)가 도통되면, 스위치(Xs)-인덕터(L2)-스위치(Xf)-캐패시터(Cxer2)로 전류경로가 형성된다. 따라서, 도8에 도시한 바와 같이 모드 1 구간에서 인덕터(L1)와 인덕터(L2)에 흐르는 전류(IL1) 및 전류(IL2)는 각각 V2/L와 V4/L의 기울기를 가지고 선형적으로 증가하며, 인덕터(L1)와 인덕터(L2)에는 자기(magnetic) 에너지가 축적된다.
② 모드 2 (t1 - t2) - 도7B 참조
모드 2 구간(t1~t2)에서는 스위치(Yr, Xf)가 도통된 상태에서 스위치(Xs ,Yg)가 차단된다. 그러면, 도7B에 도시한 바와 같이, 캐패시터(Cyer2)-스위치(Yr)-인덕터(L1)-패널 캐패시터(Cp)-인덕터(L2)-스위치(Xf)-캐패시터(Cxer2)로 전류 경로가 형성된다. 이때, 도8에 도시한 바와 같이 L1 및 L2에는 패널 캐패시턴스에 의한 공진 전류가 흐르며, 패널 캐패시터의 양단 전압(Vp)이 -Vs에서 Vs로 극성이 바뀐다. 즉, 모드 2 구간에서 패널 캐패시터(Cp)의 Y 전극 단자의 전압(Vy)이 접지전압에서 방전유지전압(Vs)으로 상승하고, 패널 캐패시터(Cp)의 X 전극 단자의 전압(Vx)이 방전유지전압(Vs)에서 접지전압으로 하강하므로, 패널 캐패시터의 양단의 전압(Vp)은 -Vs에서 Vs로 극성이 바뀌게 된다.
③ 모드 3 (t2 - t3) - 도 7C 참조
모드 3에서는 스위치 (Yr, Xf)가 도통된 상태에서, 스위치 (Ys, Xg)를 도통시킨다.
t=t2에서 Vy 전압이 유지방전전압인 Vs가 되고, Vx 전압이 접지전압이 되면, 스위치 (Ys, Xg)의 바디 다이오드가 도통하게 된다. 이때, 도8에 도시한 바와 같이 스위치 (Ys, Xg)를 도통시키면 스위치 (Ys, Xg)의 드레인-소스 사이의 전압이 0 전압인 상태에서 도통하게 되므로, 즉 스위치 (Ys, Xg)가 영전압 스위칭을 하기 때문에, 스위치 (Ys, Xg)의 턴온 스위칭 손실이 발생하지 않는다. 본 발명의 실시예에 따르면 이상적으로 패널 캐패시터의 Y전극의 전압이 유지방전전압(Vs)에 도달하는 시점에서도 인덕터(L1)에 충분한 에너지가 저장되어 있기 때문에, 회로의 기생 성분 등이 있는 실제의 경우에도 인덕터(L1)에 저장된 에너지에 의해 패널 캐패시터의 Y 전극의 전압이 유지방전전압인 Vs까지 증가할 수 있다. 따라서, 스위치(Ys)가 회로의 기생 성분이 있는 경우에도 영전압 스위칭을 할 수 있다.
모드 3에서는 도8에 도시한 바와 같이 패널 양단 전압(Vp)이 전압(+Vs)을 유지하면서, Y 전극 충방전부(324)의 인덕터(L1)에 흐르고 있던 전류(IL1)는 캐패시터(Cyer1)-스위치(Yr)-인덕터(L1)-스위치(Ys)의 바디 다이오드-전원 소스(Vs)의 경로로 -V1/L 의 기울기를 가지며 선형적으로 0까지 감소한다. 즉, 인덕터(L1)에 저장된 에너지는 스위치(Ys)의 바디 다이오드를 통해 캐패시터(Cyer1)로 회수된다. 또한, X 전극 충방전부(326)의 인덕터(L2)에 흐르고 있던 전류(IL2)는 스위치(Xg)의 바디 다이오드-인덕터(L2)-스위치(Xf)-캐패시터(Cxer2)의 경로를 통해 -V4/L 의 기울기를 가지며 선형적으로 0까지 감소한다. 즉, 인덕터(L2)에 저장된 에너지는 스위치(Xf)를 통해 캐패시터(Cxer2)로 회수된다.
여기서, 인덕터(L1,L2)를 통해 흐르는 전류(IL1,IL2)가 음의 값을 가지는 것은 전류의 흐름 방향이 기준 방향과 반대 방향으로 전류가 흐르는 것을 의미한다.
④ 모드 4 (t3 - t4) - 도7D 참조
모드 4 구간에서는 스위치(Ys, Xg)가 도통된 상태에서 스위치(Yr, Xf)가 차단되며, 패널 양단 전압(Vp)을 유지방전전압(+Vs)으로 유지한다.
모드 4 구간 동안에는 패널 캐패시터의 Y 전극의 전압(Vy)이 Vs를 유지하고, 패널 캐패시터의 X 전극의 전압(Vx)이 접지전압을 유지하기 때문에, 패널의 캐패시터의 양단전압(Vp)이 +Vs를 유지하여 패널은 발광하게 된다.
⑤ 모드 5 (t4-t5) - 도7E 참조
모드 5 구간에서는 스위치(Ys, Xg)가 도통된 상태에서 스위치(Yf, Xr)가 도통된다. 스위치(Ys, Xg)가 도통된 상태에서, Y 전극 충방전부(324)의 스위치(Yf)가 도통되면, 스위치(Ys)-인덕터(L1)-스위치(Yf)-캐패시터(Cyer2)로 전류경로가 형성된다. 또한, X 전극 충반전부(326)의 스위치(Xr)가 도통되면, 도7E에 도시한 바와 같이 캐패시터(Cxer2)-스위치(Xr)-인덕터(L2)-스위치(Xg)로 전류경로가 형성된다. 따라서, 도8에 도시한 바와 같이 모드 5 구간에서 인덕터(L1)와 인덕터(L2)에 흐르는 전류(IL1) 및 전류(IL2)는 각각 -V4/L와 -V2/L의 기울기를 가지고 선형적으로 감소하며, 인덕터(L1)와 인덕터(L2)에는 자기(magnetic) 에너지가 축적된다.
⑥ 모드 6 (t5 - t6) - 도7F 참조
모드 6 구간(t5~t6)에서는 스위치(Xr, Yf)가 도통된 상태에서 스위치(Ys ,Xg)가 차단된다. 그러면, 도7F에 도시한 바와 같이, 캐패시터(Cxer2)-스위치(Xr)-인덕터(L2)-패널 캐패시터(Cp)-인덕터(L1)-스위치(Yf)-캐패시터(Cyer2)로 전류 경로가 형성된다. 이때, 도8에 도시한 바와 같이 L1 및 L2에는 패널 캐패시턴스에 의한 공진 전류가 흐르며, 패널 캐패시터의 양단 전압(Vp)이 Vs에서 -Vs로 극성이 바뀐다. 즉, 모드 6 구간에서 패널 캐패시터(Cp)의 X 전극 단자의 전압(Vx)이 접지전압에서 방전유지전압(Vs)으로 상승하고, 패널 캐패시터(Cp)의 Y 전극 단자의 전압(Vy)이 방전유지전압(Vs)에서 접지전압으로 하강하므로, 패널 캐패시터의 양단의 전압(Vp)은 Vs에서 -Vs로 극성이 바뀌게 된다.
⑦ 모드 7 (t6 - t7) - 도 7G 참조
모드 7에서는 스위치 (Xr, Yf)가 도통된 상태에서, 스위치 (Xs, Yg)를 도통시킨다.
t=t6에서 Vx 전압이 유지방전전압인 Vs가 되고, Vy 전압이 접지전압이 되면, 스위치 (Xs, Yg)의 바디 다이오드가 도통하게 된다. 이때, 도8에 도시한 바와 같이 스위치 (Xs, Yg)를 도통시키면 스위치 (Xs, Yg)의 드레인-소스 사이의 전압이 0 전압인 상태에서 도통하게 되므로, 즉 스위치 (Xs, Yg)가 영전압 스위칭을 하기 때문에, 스위치 (Xs, Yg)의 턴온 스위칭 손실이 발생하지 않는다.
모드 7에서는 도8에 도시한 바와 같이 패널 양단 전압(Vp)이 전압(-Vs)을 유지하면서, Y 전극 충방전부(324)의 인덕터(L1)에 흐르고 있던 전류(IL1)는 스위치(Yg)의 바디 다이오드-인덕터(L1)-스위치(Yf)-캐패시터(Cyer2)의 경로를 통해 V2/L 의 기울기를 가지며 선형적으로 0까지 증가한다. 즉, 인덕터(L1)에 저장된 에너지는 스위치(Yf)를 통해 캐패시터(Cyer2)로 회수된다. 또한, X 전극 충방전부(326)의 인덕터(L2)에 흐르고 있던 전류(IL2)는 캐패시터(Cxer1)-스위치(Xr)-인덕터(L2)-스위치(Xs)의 바디 다이오드-전원 소스(Vs)의 경로로 V3/L 의 기울기를 가지며 선형적으로 0까지 증가한다. 즉, 인덕터(L2)에 저장된 에너지는 스위치(Xs)의 바디 다이오드를 통해 캐패시터(Cxer1)로 회수된다.
⑧ 모드 8 (t7 - t8) - 도7H 참조
모드 8 구간에서는 스위치(Xs, Yg)가 도통된 상태에서 스위치(Xr, Yf)가 차단되며, 패널 양단 전압(Vp)을 유지방전전압(-Vs)으로 유지한다.
모드 8 구간 동안에는 패널 캐패시터의 X 전극의 전압(Vx)이 Vs를 유지하고, 패널 캐패시터의 Y 전극의 전압(Vy)이 접지전압을 유지하기 때문에, 패널의 캐패시터의 양단전압이 -Vs를 유지하여 패널은 발광하게 된다.
이상에서 설명한 본 발명의 제1 실시예에 따르면, 패널 캐패시터(Cp)의 극성을 바꾸기 전인 모드 1 및 모드 5에서 에너지 회수를 위한 인덕터 전류를 부스팅(boosting)시키고, 모드 2 및 모드 6에서 패널 캐패시터의 극성을 바꿀 때 부스팅된 전류(에너지)를 사용함으로써 전력 회수율에 상관없이 패널 캐패시터의 양 단자를 방전유지전압(Vs)으로 올리거나 접지전압으로 내릴 수 있다. 따라서, 본 발명의 제1 실시예에 따르면 인덕터에 부스팅된 전류를 이용하여 스위치의 영전압 스위칭을 달성할 수 있다.
한편, 도6에 도시한 본 발명의 실시예에 따른 전력회수회로는 에너지 회수 스위치(Yr, Yf, Xr, Xf)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간을 조절함으로써 에너지 회수 캐패시터(Cyer1, Cyer2, Cxer1, Cxer2)의 전압 레벨의 조정이 가능하다.
즉, 도8에 도시한 본 발명의 제1 실시예와 같이 서스테인 스위치(Ys, Xg; Xs, Yg)의 게이트 온 신호와 에너지 회수 스위치(Yr, Yf, Xr, Yf)의 게이트 온 신호가 겹치는 구간을 동일하게 하면, 도9에 도시한 바와 같이, 캐패시터(Cyer2)와 캐패시터(Cxer2)의 충방전 전류가 같아져 캐패시터(Cyer2, Cxer2)의 양단 전압 V2, V4가 Vs/2를 유지한다. 따라서, 본 발명의 제1 실시예에 따르면 V1 = V2 = V3 = V4 =Vs/2가 성립한다.
한편, 도10에 도시한 본 발명의 제2 실시예와 같이, 에너지 회수 스위치(Yr, Xr)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간을 스위치(Yf, Xf)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간보다 길게 해 주면, 도11에 도시한 바와 같이 캐패시터(Cyer2, Cxer2)의 방전 전류가 충전 전류보다 커지게 되어 캐패시터(Cyer2, Cxer2)의 양단 전압(V2, V4)은 Vs/2 보다 작아지게 된다.
반대로, 도12에 도시한 제3 실시예와 같이, 에너지 회수 스위치(Yr, Xr)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간을 스위치(Yf, Xf)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간보다 짧게 해 주면, 도13에 도시한 바와 같이 캐패시터(Cyer2, Cxer2)의 방전 전류가 충전 전류보다 작아지게 되어 캐패시터(Cyer2, Cxer2)의 양단 전압(V2, V4)은 Vs/2 보다 커지게 된다.
도10 및 도12에 각각 도시한 본 발명의 제2 실시예 및 제3 실시예에 따른 구동 타이밍도는 도6에 기재된 전력회수회로와 동일한 회로를 사용하며, 단지 스위치의 구동 타이밍만이 다를 뿐이다. 또한, 본 발명의 제2 실시예 및 제3 실시예에 따른 전력회수회로의 동작 설명은 도6 내지 도8을 참조한 이전의 설명으로부터 당업자가 쉽게 이해할 수 있기 때문에 중복되는 설명은 생략한다.
이와 같이, 도6에 도시한 전력회수회로는 도3에 도시한 종래의 회로와 달리, 에너지 회수용 캐패시터의 전압이 전류를 부스팅해주는 전압원으로서만 존재하며, 그 전압 값을 반드시 Vs/2로 유지할 필요가 없다는 장점이 있다.
한편, 도6에 도시한 본 발명의 실시예에 따른 전력회수회로는 에너지 회수 스위치(Yr, Yf, Xr, Xf)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간을 조절함으로써 에너지 회수 캐패시터(Cyer1, Cyer2, Cxer1, Cxer2)의 전압 레벨을 조정하였으나, 다음과 같은 방법으로 전압 레벨을 조절할 수 있다.
도14는 본 발명의 제4 실시예에 따른 전력회수회로(340)를 나타내는 도면이다. 도14에 도시한 바와 같이, 본 발명의 제4 실시예에 따른 전력회수회로는 유지방전부(342), Y 전극 충방전부(344)와 X 전극 충방전부(346)를 포함한다.
도14에 도시한 유지방전부(342), Y 전극 충방전부(344) 및 X 전극 충방전부(346)는 도6에 도시한 유지방전부(322), Y전극 충방전부(324) 및 X 전극 충방전부(326)의 구성요소와 동작이 거의 동일하며, 단지 캐패시터(Cyer2, Cxer2)를 가변 전압 (Vyer2, Vxer 2)으로 대체한 것이 다를 뿐이다.
도14에 도시한 본 발명의 제4 실시예에 따른 전력회수회로는 에너지 회수 스위치(Yr, Yf, Xr, Xf)와 서스테인 스위치(Ys, Yg, Xs, Xg)의 게이트 신호가 겹치는 구간을 고정시킨 상태에서, 예컨대 서스테인 스위치(Ys, Xg; Xs, Yg)의 게이트 온 신호와 에너지 회수 스위치(Yr, Yf, Xr, Yf)의 게이트 온 신호가 겹치는 구간을 동일하게 한 상태에서, 가변 전압(Vyer2, Vxer2)의 전압 값을 조정함으로써 캐패시터의 충방전 전류를 조절할 수 있다.
한편, 본 발명의 실시예에 따르면, 모드 2 및 모드 6에서의 극성 반전에 필요한 시간()은 다음과 같이 구할 수 있다.
먼저, 극성 반전에 필요한 시간()을 구하기 위해 모드 2에서의 회로상태를 도15와 같이 모델링한다. 여기서, L1=L2=L, V2=V4=V라 가정한다. 초기조건인 t=t1에서의 인덕터 전류(IL)와 패널 캐패시터의 양단 전압(Vp)은 각각 Ipk와 Vs이다.
여기서, Ipk는 다음의 수학식 1과 같다.
.
이 등가회로를 바탕으로 극성반전에 필요한 시간()을 구하면 다음의 수학식2와 같다.
여기서, 이다.
수학식 2로부터 알 수 있듯이, 본 발명의 실시예에 따르면 인덕터와 전력 회수용 캐패시터 값을 설정함으로써 극성반전시간을 구할 수 있다. 따라서, 본 발명의 실시예에 따르면 인덕턴스와 전력회수용 캐패시턴스를 적절히 선택함으로써 패널 전압의 상승 및 하강 구간을 제외한 방전유지구간에서 패널이 방전을 수행할 수 있도록 패널 전압의 상승 및 하강 시간을 단축할 수 있다.
이상에서는 본 발명의 실시예에 대하여 설명하였으나, 본 발명은 상기한 실시예에만 한정되는 것을 아니며, 그 외의 다양한 변형이나 변경이 가능하다.
예컨대, 본 발명의 실시예의 전력회수회로는 플라즈마 디스플레이 패널의 구동회로를 예로서 사용한 것이나, 그 외의 용량성 부하를 갖는 소자의 전력회수 회로로서도 사용할 수 있다.
이상에서 설명한 바와 같이 본 발명은 회로의 기생 성분에도 불구하고 영전압 스위칭을 할 수 있으며, 유지 방전 동작 개시시에 돌입 전류를 방지할 수 있다. 또한 본 발명은 패널 전압의 상승 및 하강 구간을 제외한 유지 구간에서 패널이 방전을 수행할 수 있도록 구동 소자에 흐르는 전류의 증가 없이 패널 전압의 상승 및 하강 시간을 단축시킬 수 있다. 그리고 회로 동작이 개시될 때 에너지 회수용 캐패시터에는 입력전압이 분할되어 충전되므로 초기 기동시 에너지 회수스위치의 내압이 분할된 전압이 인가되므로 저내압의 스위치를 사용할 수 있어 비용절감 및 효율 증대를 꾀할 수 있다.
도1은 교류형 플라즈마 디스플레이 패널의 일부 사시도이다.
도2는 플라즈마 디스플레이 패널의 전극 배열도이다.
도3 및 도4는 각각 종래 전력회수회로와 그의 구동 파형을 나타내는 도면이다.
도5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도6은 본 발명의 실시예에 따른 전력회수회로를 나타내는 도면이다.
도7A 내지 도7H는 각각 도6에 도시한 전력회수회로의 동작 모드를 나타내는 도면이다.
도8은 본 발명의 제1 실시예에 따른 동작 타이밍을 나타내는 도면이다.
도9는 본 발명의 제1 실시예에 따른 인덕터의 충방전 전류를 나타내는 도면이다.
도10은 본 발명의 제2 실시예에 따른 동작 타이밍을 나타내는 도면이다.
도11은 본 발명의 제2 실시예에 따른 인덕터의 충방전 전류를 나타내는 도면이다.
도12는 본 발명의 제3 실시예에 따른 동작 타이밍을 나타내는 도면이다.
도13은 본 발명의 제3 실시예에 따른 인덕터의 충방전 전류를 나타내는 도면이다.
도14는 본 발명의 제4 실시예에 따른 전력회수회로를 나타내는 도면이다.
도15는 본 발명의 실시예의 모드 2의 등가회로를 나타내는 도면이다.

Claims (15)

  1. 복수의 제1 전극과 복수의 제2 전극을 포함하며, 상기 제1 전극과 상기 제2 전극에 의해 패널 캐패시터가 형성되는 패널, 그리고
    상기 제1 전극과 상기 제2 전극을 구동하는 구동부를 포함하며,
    상기 구동부는,
    제1 전압을 공급하는 제1 전원과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되며 접점이 상기 제1 전극에 전기적으로 연결되는 제1 및 제2 스위치와, 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되며 접점이 상기 제2 전극에 전기적으로 연결되는 제3 및 제4 스위치를 포함하며, 상기 제1 전극 또는 상기 제2 전극의 전압을 상기 제1 전압 또는 상기 제2 전압으로 유지하는 유지방전부,
    상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제1 및 제2 캐패시터, 상기 제1 및 제2 캐패시터가 공통으로 연결되는 제1 접점에 각각 병렬로 전기적으로 연결되는 제5 및 제6 스위치, 상기 제5 및 제6 스위치를 통하여 상기 제1 접점과 상기 제1 전극 사이에 형성되는 경로 상에 형성되는 제1 인덕터를 포함하며, 상기 제1 전극의 전압을 변경하는 제1 충방전부, 그리고
    상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제3 및 제4 캐패시터, 상기 제3 및 제4 캐패시터가 공통으로 연결되는 제2 접점에 각각 병렬로 전기적으로 연결되는 제7 및 제8 스위치, 상기 제7 및 제8 스위치를 통하여 상기 제2 접점과 상기 제2 전극 사이에 형성되는 경로 상에 형성되는 제2 인덕터를 포함하며, 상기 제2 전극의 전압을 변경하는 제2 충방전부를 포함하며,
    상기 제1 및 제2 충방전부는 상기 제1 전극과 상기 제2 전극의 전압을 동시에 변경하는 플라즈마 디스플레이 패널.
  2. 복수의 제1 전극과 복수의 제2 전극을 포함하며, 상기 제1 전극과 상기 제2 전극에 의해 패널 캐패시터가 형성되는 패널, 그리고
    상기 제1 전극과 상기 제2 전극을 구동하는 구동부를 포함하며,
    상기 구동부는,
    제1 전압을 공급하는 제1 전원과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되며 접점이 상기 제1 전극에 전기적으로 연결되는 제1 및 제2 스위치와, 상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되며 접점이 상기 제2 전극에 전기적으로 연결되는 제3 및 제4 스위치를 포함하며, 상기 제1 전극 또는 상기 제2 전극의 전압을 상기 제1 전압 또는 상기 제2 전압으로 유지하는 유지방전부,
    상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제1 캐패시터 및 제1 가변 전압, 상기 제1 캐패시터 및 제1 가변 전압이 공통으로 연결되는 제1 접점에 각각 병렬로 전기적으로 연결되는 제5 및 제6 스위치, 상기 제5 및 제6 스위치를 통하여 상기 제1 접점과 상기 제1 전극 사이에 형성되는 경로 상에 형성되는 제1 인덕터를 포함하며, 상기 제1 전극의 전압을 변경하는 제1 충방전부, 그리고
    상기 제1 전원과 상기 제2 전원 사이에 직렬로 연결되는 제2 캐패시터 및 제2 가변 전압, 상기 제2 캐패시터 및 제2 가변 전압이 공통으로 연결되는 제2 접점에 각각 병렬로 전기적으로 연결되는 제7 및 제8 스위치, 상기 제7 및 제8 스위치를 통하여 상기 제2 접점과 상기 제2 전극 사이에 형성되는 경로 상에 형성되는 제2 인덕터를 포함하며, 상기 제2 전극의 전압을 변경하는 제2 충방전부를 포함하며,
    상기 제1 및 제2 충방전부는 상기 제1 전극과 상기 제2 전극의 전압을 동시에 변경하는 플라즈마 디스플레이 패널.
  3. 제1항 또는 제2항에 있어서,
    상기 제1 및 제2 충방전부는, 상기 제1 전극 또는 상기 제2 전극의 전압이 실질적으로 상기 제1 전압 또는 제2 전압으로 유지되고 있는 동안 상기 제1 및 제2 인덕터에 전류를 주입하고, 상기 제1 및 제2 인덕터에 주입된 전류와 공진을 이용하여 상기 제1 전극 또는 상기 제2 전극의 전압을 변경하는 플라즈마 디스플레이 패널.
  4. 제1항 또는 제2항에 있어서,
    상기 제1 내지 제8 스위치는 각각 바디 다이오드를 가지는 트랜지스터인 플라즈마 디스플레이 패널.
  5. 제4항에 있어서,
    상기 제1 충방전부는, 상기 제5 스위치의 바디 다이오드와 반대 방향으로 상기 제5 스위치에 직렬로 연결되는 제1 다이오드 및 상기 제6 스위치의 바디 다이오드와 반대 방향으로 상기 제6 스위치에 직렬로 연결되는 제2 다이오드를 더 포함하며,
    상기 제2 충방전부는, 상기 제7 스위치의 바디 다이오드와 반대 방향으로 상기 제7 스위치에 직렬로 연결되는 제3 다이오드 및 상기 제8 스위치의 바디 다이오드와 반대 방향으로 상기 제8 스위치에 직렬로 연결되는 제4 다이오드를 더 포함하는 플라즈마 디스플레이 패널.
  6. 제1항 또는 제2항에 있어서,
    상기 제1 전압과 상기 제2 전압의 차이는 유지방전 전압인 플라즈마 디스플레이 패널.
  7. 복수의 제1 전극과 복수의 제2 전극을 포함하는 패널, 상기 제1 전극에 제1단이 전기적으로 연결되는 제1 인덕터 및 상기 제2 전극에 제1단이 전기적으로 연결되는 제2 인덕터를 포함하는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 제1 전압을 공급하는 제1 전원 및 제2 전압을 공급하는 제2 전원에 전기적으로 연결하여 상기 제1 전극의 전압을 증가시키고 상기 제2 전극의 전압을 감소시키는 단계,
    상기 제1 전극 및 상기 제2 전극에 각각 상기 제3 전압 및 상기 제3 전압보다 낮은 제4 전압을 인가하고, 상기 제1 및 제2 인덕터를 각각 상기 제1 및 제2 전원과 전기적으로 차단하는 단계,
    상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 상기 제1 전원 및 상기 제2 전원에 전기적으로 연결하여 상기 제1 전극의 전압을 감소시키고 상기 제2 전극의 전압을 증가시키는 단계, 그리고
    상기 제1 전극 및 상기 제2 전극에 각각 상기 제4 전압 및 상기 제3 전압을 인가하고, 상기 제1 및 제2 인덕터를 각각 상기 제1 및 제2 전원과 전기적으로 차단하는 단계
    를 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  8. 제7항에 있어서,
    상기 제1 전극의 전압을 증가시키고 상기 제2 전극의 전압을 감소시키기 전에, 상기 제1 및 제2 전극에 각각 상기 제4 및 제3 전압을 인가한 상태에서 상기 제1 및 제2 인덕터에 소정량의 전류를 주입하는 단계를 더 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  9. 제7항에 있어서,
    상기 제1 전극의 전압을 감소시키고 상기 제2 전극의 전압을 증가시키기 전에, 상기 제1 및 제2 전극에 각각 상기 제3 및 제4 전압을 인가한 상태에서 상기 제1 및 제2 인덕터에 소정량의 전류를 주입하는 단계를 더 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  10. 제7항 내지 제9항 중 어느 한 항에 있어서,
    상기 제3 전압과 상기 제4 전압의 차이는 유지방전 전압인 플라즈마 디스플레이 패널의 구동 방법.
  11. 복수의 제1 전극과 복수의 제2 전극을 포함하는 패널, 상기 제1 전극에 제1단이 전기적으로 연결되는 제1 인덕터 및 상기 제2 전극에 제1단이 전기적으로 연결되는 제2 인덕터를 포함하는 플라즈마 디스플레이 패널에 있어서,
    상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 제1 전압을 공급하는 제1 전원 및 제2 전압을 공급하는 제2 전원에 연결하여 상기 제1 전극의 전압을 증가시키고 상기 제2 전극의 전압을 감소시키는 제1 공진 수단,
    상기 제1 인덕터의 제2단 및 상기 제2 인덕터의 제2단을 각각 상기 제1 전원 및 상기 제1 전원에 연결하여 상기 제1 전극의 전압을 감소시키고 상기 제2 전극의 전압을 증가시키는 제2 공진 수단,
    상기 제1 및 제2 전압보다 높은 제3 전압을 공급하는 제3 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제1 스위치와 상기 제1 및 제2 전압보다 낮은 제4 전압을 공급하는 제4 전원과 상기 제2 전극 사이에 전기적으로 연결되는 제2 스위치를 포함하며, 상기 제1 공진 수단에 의해 상기 제1 및 제2 전극의 전압이 변경된 후 상기 제1 및 제2 전극에 각각 제3 및 제4 전압을 인가하는 제1 유지 수단, 그리고
    상기 제3 전원과 상기 제2 전극 사이에 전기적으로 연결되는 제3 스위치와 상기 제4 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제4 스위치를 포함하며, 상기 제2 공진 수단에 의해 상기 제1 및 제2 전극의 전압이 변경된 후 상기 제1 및 제2 전극에 각각 제4 및 제3 전압을 인가하는 제2 유지 수단
    를 포함하는 플라즈마 디스플레이 패널.
  12. 제11항에 있어서,
    상기 제1 공진 수단에 의해 상기 제1 전극의 전압이 증가되고 상기 제2 전극의 전압이 감소되기 전에, 상기 제1 및 제2 인덕터에 소정량의 전류를 주입하는 전류 주입 수단를 더 포함하는 플라즈마 디스플레이 패널.
  13. 제12항에 있어서,
    상기 전류 주입 수단은, 상기 제1 인덕터의 제1단 및 제2단을 각각 상기 제4 전원 및 상기 제1 전원에 전기적으로 연결하고, 상기 제2 인덕터의 제1단 및 제2단을 각각 상기 제3 전원 및 상기 제2 전원에 전기적으로 연결하여 상기 제1 및 제2 인덕터에 소정량의 전류를 주입하는 플라즈마 디스플레이 패널.
  14. 제11항에 있어서,
    상기 제2 공진 수단에 의해 상기 제1 전극의 전압이 감소되고 상기 제2 전극의 전압이 증가되기 전에, 상기 제1 및 제2 인덕터에 소정량의 전류를 주입하는 전류 주입 수단를 더 포함하는 플라즈마 디스플레이 패널.
  15. 제14항에 있어서,
    상기 전류 주입 수단은, 상기 제1 인덕터의 제1단 및 제2단을 각각 상기 제3 전원 및 상기 제1 전원에 전기적으로 연결하고, 상기 제2 인덕터의 제1단 및 제2단을 각각 상기 제4 전원 및 상기 제2 전원에 전기적으로 연결하여 상기 제1 및 제2 인덕터에 소정량의 전류를 주입하는 플라즈마 디스플레이 패널.
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