KR20050082627A - 플라즈마 디스플레이 패널의 구동 장치 - Google Patents

플라즈마 디스플레이 패널의 구동 장치 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동 장치에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동 장치는 제1 전극과 제2 전극, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되며, 제1 전극에 제1 전압과 상기 제1 전압보다 낮은 제2 전압을 교대로 인가하는 유지방전 구동 회로에서 상기 제1 전극의 전압을 감소시키는 하강 경로 위에 인덕터를 형성시킨다.
이와 같이 하면, 트랜지스터 턴온시 발생하는 피크 전류를 제한할 수 있어 유지 방전 회로의 효율을 개선할 수 있다.

Description

플라즈마 디스플레이 패널의 구동 장치{A DRIVING APPARATUS OF PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널(plasma display panel, PDP)의 구동 장치에 관한 것이다.
플라즈마 디스플레이 패널은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 화소가 매트릭스 형태로 배열되어 있다. 이러한 플라즈마 표시 패널은 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형과 교류형으로 구분된다.
직류형 플라즈마 표시 패널은 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전공간에 그대로 흐르게 되며, 이를 위해 전류 제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 플라즈마 표시 패널에서는 전극을 유전체층이 덮고 있어 자연스러운 커패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
이러한 교류형 플라즈마 표시 패널에는 그 한쪽 면에 서로 평행인 주사 전극 및 유지 전극이 형성되고 다른 쪽 면에 이들 전극과 직교하는 방향으로 어드레스 전극이 형성된다. 그리고 유지 전극은 각 주사 전극에 대응해서 형성되며, 그 일단이 서로 공통으로 연결되어 있다.
도 1은 일반적인 교류형 플라즈마 디스플레이 패널의 일부 사시도이다.
도 1에 나타낸 바와 같이, 플라즈마 디스플레이 패널은 서로 마주보며 떨어져 있는 두 개의 유리 기판(1, 6)을 포함한다. 유리 기판(1) 위에는 주사 전극(4)과 유지 전극(5)이 쌍을 이루어 평행하게 형성되어 있으며, 주사 전극(4)과 유지 전극(5)은 유전체층(2) 및 보호막(3)으로 덮여 있다. 유리 기판4(6) 위에는 복수의 어드레스 전극(8)이 형성되어 있으며, 어드레스 전극(8)은 절연체층(7)으로 덮여 있다. 어드레스 전극(8) 사이에 있는 절연체층(7) 위에는 어드레스 전극(8)과 격벽(9)이 형성되어 있다. 또한 절연체층(7)의 표면 및 격벽(9)의 양측면에 형광체(10)가 형성되어 있다. 유리 기판(1, 6)은 주사 전극(4)과 어드레스 전극(8) 및 유지 전극(5)과 어드레스 전극(8)이 직교하도록 방전 공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스 전극(8)과, 쌍을 이루는 주사 전극(4)과 유지 전극(5)과의 교차부에 있는 방전 공간(11)이 방전 셀(12)을 형성한다.
도 2는 플라즈마 표시 패널의 전극 배열도를 나타낸다.
도 2에 도시한 바와 같이, 플라즈마 표시 패널의 전극은 n×m의 매트릭스 형태를 가지고 있으며, 구체적으로 열 방향으로는 어드레스 전극(A1~Am)이 뻗어 있고 행 방향으로는 주사 전극(Y1∼Yn) 및 유지 전극(X1∼Xn)이 뻗어 있다. 도 2에 도시된 방전 셀(12)은 도 1에 도시된 방전 셀(12)에 대응한다.
일반적으로 플라즈마 디스플레이 패널은 1 프레임이 복수의 서브필드로 나누어져 구동되며, 서브필드의 조합에 의해 계조가 표현된다. 일반적으로 각 서브필드는 리셋 기간(reset period), 어드레스 기간(address period), 유지 기간(sustain period)으로 이루어진다.
리셋 기간은 이전의 유지방전으로 형성된 벽 전하를 소거하고 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽 전하를 셋업(setup) 하는 역할을 한다.
어드레스 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽 전하를 쌓아두는 동작을 수행하는 기간이다.
서스테인 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지방전을 수행하는 기간이다.
한편, 교류형 플라즈마 디스플레이 패널은 어드레싱을 위한 어드레스 전극이 용량성 부하로 작용하기 때문에 어드레스 전극에 대한 캐패시턴스가 존재하며, 어드레싱을 위한 파형을 인가하기 위해서는 어드레싱을 위한 전력 이외에 무효 전력이 필요하다. 이런 무효 전력을 회수하여 재사용하는 회로를 전력 회수 회로라고 한다. 플라즈마 표시 장치의 구동 회로는 전력 회수 회로를 일반적으로 포함한다.
이하, 종래 기술에 따른 전력 회수 회로(ERC)를 포함하는 플라즈마 디스플레이 패널의 유지방전 구동 회로에 대해 설명한다.
도 3은 종래 기술에 따른 전력 회수 회로(ERC)를 포함하는 플라즈마 디스플레이 패널의 유지방전 구동 회로를 나타내는 도면이다.
도 3에 나타낸 바와 같이, L.F.Weber에 의해 제안된 유지 방전 회로(미국특허 제4,866,349호)는 스위칭 소자(Yr, Yf, Ys, Yg), 다이오드(D 1, D2, D3, D4), 인덕터(L1) 및 전력회수용 커패시터(Cc)를 포함한다. 이와 같이 구성된 유지 방전 회로는 스위칭 소자(Yr, Yf, Ys, Yg)의 스위칭 시퀀스(switching sequence) 동작에 따라 4가지 모드의 동작으로 유지방전 펄스 전압을 인가한다.
유지 방전 회로는 초기 시에 스위칭 소자(Yg)가 도통되어 있어 패널의 양단 전압(VP)은 0V를 유지하게 된다. 이 때, 전력회수용 커패시터(Cc)에는 외부 인가전압(Vs)의 1/2만큼의 전압(Vs/2)을 미리 충전한다.
이렇게 패널의 양단 전압(VP)을 0V로 유지한 상태에서 스위칭 소자(Yr)가 턴온(turn-on)되고 나머지 스위칭 소자(Yf, Ys, Yg)가 턴오프(turn-off)되는 모드 1의 동작이 시작된다. 모드 1의 동작구간에서는 전력회수용 커패시터(Cc), 스위칭 소자(Yr), 다이오드(D1), 인덕터(L1) 및 패널 커패시터(CP)의 경로가 형성되고 이 경로에 의해 LC 공진 회로가 형성되어 패널의 출력 전압(VP)은 Vs 전압으로 증가한다. 이 때, 스위칭 소자(Yr)가 턴온되는 시점 즉, 즉, 도 4a에서와 같이 스위칭 소자(Yr)의 소스-드레인 간 전압이 Vs/2 인 상태에서 스위칭 소자(Yr)가 턴온되면 스위칭 소자(Yr)의 소스-드레인 간 전압이 0V로 된다. 이 때, 스위칭 소자(Yr)의 하드 스위칭(hard switching)이 발생한다.
모드 1이 완료되면, 스위칭 소자(Ys)가 턴온되고 나머지 스위칭 소자(Yr, Yf , Yg)가 턴오프(turn-off)되는 모드 2의 동작이 시작된다. 모드 2의 동작 구간에서는 외부 인가전압(Vs)이 스위칭 소자(Ys)를 통해 패널 커패시터(CP)로 흐르게 되어 패널 커패시터(CP)는 Vs 전압을 유지한다.
모드 2가 완료되면, 스위칭 소자(Yf)가 턴온되고 나머지 스위칭 소자(Yr, Ys , Yg)가 턴오프(turn-off)되는 모드 3의 동작이 시작된다. 모드 3 동작 구간에서는 모드 1에서와 반대의 경로 즉, 패널 커패시터(CP), 인덕터(L1), 다이오드(D2), 스위칭 소자(Yf), 전력회수용 커패시터(Cc)의 경로가 형성되고 이 경로에 의해 LC 공진 회로가 형성되어 패널의 출력 전압(VP)은 0V 전압까지 감소한다. 이 때, 스위칭 소자(Yf)가 턴온되는 시점 즉, 스위칭 소자(Yf)의 소스-드레인 간 전압이 Vs /2 인 상태에서 스위칭 소자(Yf)가 턴온되면 스위칭 소자(Yf)의 소스-드레인 간 전압이 0V로 된다. 이 때, 스위칭 소자(Yf)의 하드 스위칭이 발생한다.
모드 3이 완료되면, 스위칭 소자(Yg)가 턴온되고 나머지 스위칭 소자(Yr, Yf , Ys)가 턴오프(turn-off)되는 모드 4의 동작이 시작된다. 모드 4의 동작 구간에서는 스위칭 소자(Yg)를 통해 패널의 출력 전압(VP)은 0V 전압을 유지한다. 이 상태에서 스위칭 소자(Yr)가 턴온되면 모드 1의 동작으로 사이클(cycle)이 반복된다.
도 4a 내지 도 4b에 나타낸 바와 같이 모드 1과 모드 3에서 LC 공진에 의한 공진 전류와는 별도로 스위칭 소자(Yr)와 스위칭 소자(Yf)의 동작 시점에서 스위칭 소자(Yr)와 스위칭 소자(Yf)의 양단 전압이 순간적으로 Vs/2 인 상태에서 0V로 변하게 되어 스위칭 소자(Yr, Yf)에 도 4a 및 도 4b와 같은 노이즈성의 과전류가 흐르게 된다.
특히, 도 4b를 보면 모드 3에서와 같이 스위칭 소자(Yf)가 턴온되면서 스위칭 소자(Yf)에 상당량의 서지(surge) 전류가 관통하면서 과도한 스위칭 손실이 유발된다.
본 발명이 이루고자 하는 기술적 과제는 유지 방전 회로에서 하강(에너지 회수) 동작 시 발생하는 스위칭 손실을 줄일 수 있는 플라즈마 디스플레이 패널의 구동 장치를 제공하고자 하는 것이다.
이러한 과제를 해결하기 위해 본 발명의 한 특징에 따르면, 복수의 제1 전극과 복수의 제2 전극이 형성되어 있으며, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되는 플라즈마 디스플레이 패널의 구동 장치가 제공된다. 이 구동 장치는 제1 전극과 제1단이 전기적으로 연결되는 적어도 하나의 제1 인덕터; 제1 전압을 공급하는 제1 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제1 스위칭 소자; 상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제2 스위칭 소자; 상기 제1 인덕터의 제2단과 상기 제1 전압과 상기 제2 전압 사이의 제3 전압을 공급하는 제3 전원 사이에 전기적으로 연결되는 제3 스위칭 소자; 상기 제1 인덕터의 제2단과 상기 제3 전원 사이에 전기적으로 연결되는 제4 스위칭 소자; 및 상기 제3 전원과 상기 제4 스위칭 소자 사이 및 상기 제4 스위칭 소자과 상기 제1 인덕터 사이 중 적어도 하나에 전기적으로 연결되는 제2 인덕터를 포함한다.
그리고 상기 제3 및 제4 스위칭 소자는 바디 다이오드를 가지는 트랜지스터이고, 상기 제3 전원과 상기 제1 인덕터 사이에서 상기 제3 스위칭 소자에 의해 형성되는 제1 경로에 전기적으로 연결되는 제1 다이오드; 및 상기 제3 전원과 상기 제1 인덕터 사이에서 상기 제4 스위칭 소자에 의해 형성되는 제2 경로에 전기적으로 연결되는 제2 다이오드를 더 포함할 수 있다.
그리고 본 발명의 다른 특징에 따르면, 복수의 제1 전극과 복수의 제2 전극이 형성되어 있으며, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되며, 제1 전극에 제1 전압과 상기 제1 전압보다 낮은 제2 전압을 교대로 인가하는 플라즈마 디스플레이 패널의 구동 장치가 제공된다. 이 구동 장치는, 상기 제1 전극과 제1단이 전기적으로 연결되는 적어도 하나의 제1 인덕터; 상기 제1 인덕터의 제2단에 전기적으로 연결되며, 상기 제1 전압과 상기 제2 전압 사이의 제3 전압을 공급하는 전원; 상기 전원, 상기 제1 인덕터 및 상기 제1 전극으로 형성되어 상기 제1 전극의 전압을 증가시키는 상승 경로; 및 상기 제1 전극, 상기 제1 인덕터 및 상기 전원으로 형성되어 상기 제1 전극의 전압을 감소시키는 하강 경로르 포함하며, 상기 하강 경로 위에 제2 인덕터가 형성된다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다.
도 5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 5에 나타낸 바와 같이, 본 발명의 실시예에 따른 플라즈마 디스플레이 패널은 플라즈마 패널(100), 제어부(200), 어드레스 구동부(300), 유지전극 구동부(400) 및 주사전극 구동부(500)를 포함한다.
플라즈마 패널(100)은 열 방향으로 배열되어 있는 다수의 어드레스 전극(A1~Am), 행 방향으로 배열되어 있는 다수의 유지전극(X1~Xn) 및 주사 전극(Y1~Yn)을 포함한다.
제어부(200)는 외부로부터 영상신호를 수신하여 어드레스구동 제어 신호, 유지 전극(X) 구동 제어신호 및 주사 전극(Y) 구동 제어신호를 출력한다.
어드레스 구동부(300)는 제어부(200)로부터 어드레스구동 제어신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
유지전극 구동부(400)는 제어부(200)로부터 유지전극(X)구동 제어신호를 수신하여 유지 전극(X)에 구동 전압을 인가한다.
주사전극 구동부(500)는 제어부(200)로부터 주사전극(Y)구동 제어신호를 수신하여 주사 전극(Y)에 구동 전압을 인가한다.
일반적으로 교류형 플라즈마 디스플레이 패널에서 유지방전을 위한 구동회로는 유지전극 구동부(400)에 포함되는 유지 방전 회로와 주사전극 구동부(500)에 포함되는 유지 방전 회로가 각각 동일하게 구성된다.
이하, 편의상 주사전극 구동부(500)에 포함되는 유지 방전 회로에 대해서 도 6 및 도 7a 내지 도 7d를 참조하여 설명한다.
도 6은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 유지방전 구동 회로를 나타내는 도면이다.
도 6에 나타낸 바와 같이 유지방전 구동 회로는 스위칭 소자(Yr, Yf, Ys, Yg), 다이오드(D1, D2, D3, D4), 인덕터(L1 , L2) 및 전력회수용 커패시터(Cc)를 포함한다. 도 6에서 스위칭 소자(Yr, Yf, Ys, Yg)는 n채널 트랜지스터로 도시하였다. 그리고 이들 스위칭 소자(Yr, Yf, Ys, Yg)는 대용량의 방전 전류와 전력 회수 회로의 전류를 견디기 위하여 다수의 트랜지스터가 병렬로 연결되어 형성될 수 있으며, 이들 트랜지스터는 바디 다이오드를 가진다. 그리고 스위칭 소자(Yr, Yf, Ys, Yg)는 동일 또는 유사한 기능을 하는 다른 스위칭 소자로 이루어질 수 있다.
스위칭 소자(Ys, Yg)는 유지 방전 전압인 Vs 전압과 접지 전압 사이에 직렬로 연결되어, Vs 전압과 접지 전압을 각각 패널 커패시터(CP)에 공급하기 위한 소자이다. 다이오드(D1, D2)는 스위칭 소자(Yr, Yf)에 각각 직렬로 연결되며, 다이오드(D1, D2) 간 접점과 스위칭 소자(Ys, Yg) 간에 인덕터(L1)가 전기적으로 연결되고, 인덕터(L1)의 타단에는 패널 커패시터(CP)가 직렬로 연결된다.
그리고 다이오드(D1, D2) 사이의 접점과 다이오드(D2) 사이에 인덕터(L 2)가 전기적으로 연결되고 스위칭 소자(Yr)의 드레인과 스위칭 소자(Yf)의 소스 사이에 전력회수용 커패시터(Cc)가 전기적으로 연결된다.
또한, 인덕터(L1)의 일단과 스위칭 소자(Ys)의 드레인 사이에 다이오드(D3)가 연결되고, 인덕터(L1)의 일단과 스위칭 소자(Yg)의 소스 사이에 다이오드(D4 )가 연결된다.
이 때, 다이오드(D1)는 스위칭 소자(Yr, Yf)가 바디 다이오드를 가질 경우 패널 커패시터(CP)의 전압을 증가시키는 상승 경로를 설정하기 위한 것이다. 다이오드(D2)는 스위칭 소자(Yr, Yf)가 바디 다이오드를 가질 경우 패널 커패시터(CP)의 전압을 하강시키는 하강 경로를 설정하기 위한 것이다. 그리고 다이오드(D3)는 인덕터(L1)에 걸리는 전압을 Vs 전압보다 높지 않도록 클램핑한다. 다이오드(D4)는 인덕터(L1)에 걸리는 전압을 0V 전압보다 높지 않도록 클램핑한다.
그리고 전력회수용 커패시터(Cc), 인덕터(L1, L2) 및 스위칭 소자(Yr , Yf)는 전력 회수 회로(Energy Recovery Circuit)를 구성하여 패널 커패시터(CP)의 전압을 Vs 전압으로 충전시키거나 접지 전압으로 방전시키는 역할을 한다. 특히, 인덕터(L2)는 저항 소자로서 스위칭 소자(Yf)가 턴온하는 시점에서 흐르는 전류를 제한한다.
다음, 본 발명의 실시 예에 따른 유지 방전 구동 회로의 동작 과정에 대해 도 7a 내지 도 7d를 참조하여 상세하게 설명한다.
도 7a 내지 도 7d는 도 6의 유지방전 구동 회로에서 스위칭 소자(Yr, Yf, Ys, Yg)의 온-오프 동작에 따른 유지방전 구동 모드를 나타낸 도면이다.
본 발명에 실시 예에 따른 유지 방전 구동 회로의 동작은, 제1 모드(M1) 내지 제4 모드(M4)로 이루어진다.
제1 모드는 패널 커패시터(CP)의 전압을 Vs 전압으로 충전한다.
제2 모드는 유지 방전을 위해 패널 커패시터(CP)의 전압을 Vs 전압으로 유지한다.
제3 모드는 패널 커패시터(CP)의 전압을 접지 전압으로 방전한다.
제4 모드는 유지 방전을 위해 패널 커패시터(CP)의 전압을 접지 전압으로 유지한다.
먼저, 제1 모드(M1)가 시작되기 전에 패널 커패시터(CP)의 일측 단자에 연결된 전력회수용 커패시터(Cc)에는 Vs/2 전압을 미리 충전하고, 유지방전 펄스 전압(Vs)이 인가되는 패널 커패시터(CP)의 타측 단자에는 패널 커패시터 양단 전압이 방전 셀을 선택할 수 있을 정도의 전압이 인가되는데 이 전압을 접지전압(0V)으로 가정하고, 주사 전극(Y)에 유지방전 펄스를 인가하는 것으로 설명한다.
도 7a에 나타낸 바와 같이 제1 모드(M1)는 스위칭 소자(Yr)가 턴온되고 그 외 다른 스위칭 소자(Yf, Ys, Yg)들은 턴오프된다. 그러면 전력회수용 커패시터(C c)-스위칭 소자(Yr)-다이오드(D1)-인덕터(L1)-패널 커패시터(CP)의 경로가 형성된다. 이러한 경로를 통해 LC 공진 회로가 형성되어 인덕터(L1)에는 공진 전류가 흐르게 되고 패널 커패시터(CP)의 출력 전압(VP)은 Vs 전압 근처까지 증가한다.
제1 모드(M1)가 완료되면, 도 7b에 나타낸 바와 같이 제2 모드(M2)가 동작된다. 제2 모드(M2)는 스위칭 소자(Ys)가 턴온되고 그 외 다른 스위칭 소자(Yr , Yf, Yg)가 턴오프(turn-off)된다. 그러면 전원(Vs)-스위칭 소자(Ys)-패널 커패시터(C P)의 경로가 형성된다. 이러한 경로를 통해 Vs 전압이 스위칭 소자(Ys)를 통과하여 패널 커패시터(CP)에 흐르게 되어 패널 커패시터(CP)의 출력 전압(VP)은 Vs 전압을 유지한다.
제2 모드(M2)가 완료되면, 도 7c에 나타낸 바와 같이 제3 모드(M3)가 동작된다. 제3 모드(M3)는 스위칭 소자(Yf)가 턴온되고 그 외 다른 스위칭 소자(Yr , Ys, Yg)가 턴오프(turn-off)된다. 그러면 제1 모드(M1)와 반대의 경로 즉, 패널 커패시터(CP)-인덕터(L1)-인덕터(L2)-다이오드(D2)-스위칭 소자(Y f)-전력회수용 커패시터(Cc)의 경로가 형성된다. 이러한 경로를 통해 LC 공진 회로가 형성되어 인덕터(L1)에는 공진 전류가 흐르게 되고 패널 커패시터(CP)의 출력 전압(VP)은 0V 전압 근처까지 감소한다.
한편, 스위칭 소자(Yf)가 턴온되는 시점 즉, 스위칭 소자(Yf)의 소스-드레인 간 전압이 Vs/2 전압에서 0V로 급격하게 변하게 되면서 스위칭 소자(Yf)로 서지 전류가 관통한다. 이 때, 본 발명의 실시 예에 따른 유지 방전 구동 회로에서는 인덕터(L2)를 사용하여 스위칭 소자(Yf)로 흐르는 서지 전류를 제한한다. 인덕터(L2 )는 저항 소자로서 스위칭 소자(Yf) 동작 시에 발생하는 피크 전류를 제한하여 스위칭 소자(Yf)의 스위칭 손실 및 회로 소비전력을 감소시킨다.
여기서, 다이오드(D1) 및 스위칭 소자(Yr)은 제1 모드에서 형성되는 경로 내에서 각 소자의 위치 변경이 가능하며, 인덕터(L2), 다이오드(D2) 및 스위칭 소자(Yf) 또한 제3 모드에서 형성되는 경로 내에서 각 소자의 위치 변경이 가능하다. 또한, 스위칭 소자(Yr, Yf)에 의해 각각 형성되는 상승 경로 및 하강 경로를 분리할 수 있으며, 이 때 상승 경로 및 하강 경로 각각에 인덕터(L1)가 연결될 수 있다.
다음, 제3 모드(M3)가 완료되면, 도 7d에 나타낸 바와 같이 제4 모드(M4)가 동작한다. 제4 모드(M4)는 스위칭 소자(Yg)가 턴온되고 그 외 다른 스위칭 소자(Y r, Yf, Ys)가 턴오프(turn-off)된다. 그러면 패널 커패시터(CP)-스위칭 소자(Y g)의 경로가 형성된다. 이 경로를 통해 패널의 출력 전압(VP)은 0V 전압을 유지한다. 이 상태에서 스위칭 소자(Yr)가 턴온되면 제1 모드(M1)가 동작하고 제1 모드(M1)에서 제4 모드(M4)가 반복된다.
상술한 바와 같이 본 발명의 실시 예에 따른 유지 방전 구동 회로는 상승(0V에서 Vs 전압) 동작 시에는 종래와 같이 인덕터(L1)을 경유하여 공진 전류를 흐르게 하고 하강(Vs 전압에서 0V) 동작 시에는 인덕터(L1)와 인덕터(L2)를 경유하도록 하여 스위칭 소자(Xf)가 턴온하는 시점에서 흐르는 피크 전류를 감소시킨다.
도 8은 본 발명의 실시 예에 따른 유지방전 구동 회로에서 도 7c의 하강 동작 시 피크 전류를 나타내는 도면이다.
도 8을 보면, 스위칭 소자(Xf)가 턴온하는 시점에서 흐르는 피크 전류가 종래 도 4b보다 감소한 것을 알 수 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이와 같이 본 발명에 의하면, 유지 방전 구동 회로에서 하강 동작 시에 발생하는 피크 전류를 제한하여 스위칭 소자의 스위칭 손실을 개선하여 회로 소비전력을 감소시킬 수 있으며 소비전력 개선에 의해 소자의 발열을 저감시킬 수 있다.
또한, 회로 EMI를 감소시킬 수 있으며 그로 인하여 노이즈 특성을 개선할 수 있는 효과가 있다.
도 1은 플라즈마 디스플레이 패널의 개략적인 일부 사시도이다.
도 2는 플라즈마 디스플레이 패널의 전극 배열도이다.
도 3은 종래 기술에 따른 전력 회수 회로(ERC)를 포함하는 플라즈마 디스플레이 패널의 유지방전 구동 회로를 나타내는 도면이다.
도 4a 및 도 4b는 종래 유지방전 구동 회로의 상승 및 하강 동작 시 각각의 피크 전류를 나타낸 도면이다.
도 5는 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 개략적인 개념도이다
도 6은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 유지방전 구동 회로를 나타내는 도면이다.
도 7a 내지 도 7d는 도 6의 유지방전 구동 회로에서 스위칭 소자의 온-오프 동작에 따른 유지방전 구동 동작을 나타낸 도면이다.
도 8은 본 발명의 실시 예에 따른 유지방전 구동 회로에서 도 7c의 하강 동작 시 피크 전류를 나타내는 도면이다.

Claims (3)

  1. 복수의 제1 전극과 복수의 제2 전극이 형성되어 있으며, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되는 플라즈마 디스플레이 패널의 구동 장치에 있어서,
    제1 전극과 제1단이 전기적으로 연결되는 적어도 하나의 제1 인덕터;
    제1 전압을 공급하는 제1 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제1 스위칭 소자;
    상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원과 상기 제1 전극 사이에 전기적으로 연결되는 제2 스위칭 소자;
    상기 제1 인덕터의 제2단과 상기 제1 전압과 상기 제2 전압 사이의 제3 전압을 공급하는 제3 전원 사이에 전기적으로 연결되는 제3 스위칭 소자;
    상기 제1 인덕터의 제2단과 상기 제3 전원 사이에 전기적으로 연결되는 제4 스위칭 소자; 및
    상기 제3 전원과 상기 제4 스위칭 소자 사이 및 상기 제4 스위칭 소자과 상기 제1 인덕터 사이 중 적어도 하나에 전기적으로 연결되는 제2 인덕터
    를 포함하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 제 1항에 있어서,
    상기 제3 및 제4 스위칭 소자는 바디 다이오드를 가지는 트랜지스터이고,
    상기 제3 전원과 상기 제1 인덕터 사이에서 상기 제3 스위칭 소자에 의해 형성되는 제1 경로에 전기적으로 연결되는 제1 다이오드; 및
    상기 제3 전원과 상기 제1 인덕터 사이에서 상기 제4 스위칭 소자에 의해 형성되는 제2 경로에 전기적으로 연결되는 제2 다이오드
    를 더 포함하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 복수의 제1 전극과 복수의 제2 전극이 형성되어 있으며, 상기 제1 전극과 상기 제2 전극에 의해 용량성 부하가 형성되며, 제1 전극에 제1 전압과 상기 제1 전압보다 낮은 제2 전압을 교대로 인가하는 플라즈마 디스플레이 패널의 구동 장치에 있어서,
    상기 제1 전극과 제1단이 전기적으로 연결되는 적어도 하나의 제1 인덕터;
    상기 제1 인덕터의 제2단에 전기적으로 연결되며, 상기 제1 전압과 상기 제2 전압 사이의 제3 전압을 공급하는 전원;
    상기 전원, 상기 제1 인덕터 및 상기 제1 전극으로 형성되어 상기 제1 전극의 전압을 증가시키는 상승 경로; 및
    상기 제1 전극, 상기 제1 인덕터 및 상기 전원으로 형성되어 상기 제1 전극의 전압을 감소시키는 하강 경로
    를 포함하며,
    상기 하강 경로 위에 제2 인덕터가 형성되는 플라즈마 디스플레이 패널의 구동 장치.
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