KR20030032152A - 패키지용 인쇄회로기판 - Google Patents
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Abstract
BGA 반도체 패키지 제조에 사용되는 인쇄회로기판의 칩 탑재부에 다양한 형태의 접촉면적 확장부를 형성함으로써, 인쇄회로기판과 은-에폭시 접착제와의 접촉 면적을 증가시키고, 은-에폭시 접착제가 금속 성분의 접촉면적 확장부와 직접 접착되게 하여, 반도체 칩과 인쇄회로기판 사이의 접착력을 보다 향상시킬 수 있다. 이러한 구성의 인쇄회로기판은 접착제가 솔더 마스크와 접착됨과 동시에 금속 재료로 된 접촉면적 확장부와도 접착될 수 있게 함으로써, 반도체 칩과 인쇄회로기판 사이의 접착력을 보다 강화시켜, 반도체 패키지의 제조 공정 등의 고온 환경에 보다 잘 견딜 수 있는 반도체 패키지를 제조할 수 있다.
Description
본 발명은 BGA(Ball Grid Array) 타입 반도체 패키지의 제조에 사용되는 인쇄회로기판(Printed Circuit Board)의 구조에 관한 것으로서, 보다 자세하게는, 인쇄회로기판의 칩 탑재부에 접촉면적 확장부를 형성함으로써, 접착제에 의한 반도체 칩(Chip)과의 접착력을 향상시켜 패키지의 제조시 발생되는 열적 스트레스에 의한 계면 박리 현상을 방지하여 신뢰성이 있는 반도체 패키지를 제조하기 위한 것이다.
일반적으로, BGA 반도체 패키지는 인쇄회로기판의 밑면에 형성된 솔더 볼을 입/출력 수단으로 이용함으로써 다수의 입/출력 핀 수를 확보할 수 있는 반도체 패키지를 말하며, 종래 BGA 반도체 패키지의 구조를 도 4에 나타내었다.
도 4에서, 인쇄회로기판(10)은 열경화성 수지(20)를 기본으로 하여, 그 상면 및 하면에 전도성 박막으로 된 회로 패턴(30)을 형성하되, 상면에서의 회로 패턴(30)은 반도체 칩이 안착될 열경화성 수지(20)의 중앙 부분을 제외한 주변부에 형성한다. 다음으로, 이들 회로 패턴(30) 및 반도체 칩이 탑재될 중앙 부분을 고분자 물질로 이루어진 솔더 마스크(50)로 코팅하고, 반도체 칩(70)을 접착제(60)로 칩이 탑재될 중앙 부분 위에 접착시키고, 열경화성 수지(20)의 상면에 형성된 회로 패턴을 전도성 와이어(80)를 통하여 반도체 칩(70)과 연결한다. 열경화성 수지(20)의 상면 및 하면에 형성된 회로 패턴들은 관통 홀(90)에 의해 연결되고, 열경화성 수지(20)의 하면에는 솔더 마스크(50)에 의해 지지되어 있는 솔더 볼(100)이 형성되며, 마지막으로 열경화성 수지(20) 상면의 반도체 칩(70)과 전도성 와이어(80) 등을 외부로부터 보호하기 위해 봉지재(110)로 몰딩하여 패키지를 제조하게 된다.
그러나, 이러한 BGA 반도체 패키지는 그 제조 공정 및 메인 보드에의 실장 공정 등에서 고온의 환경에 노출되는데, 이때 패키지를 구성하는 각각의 구성 요소의 열팽창 계수가 상이함으로 인해 각각의 접착 부분에 높은 열적 스트레스가 발생하여, 결국 가장 약하게 접착된 부분에서부터 계면 박리 현상이 발생하게 된다.
특히, 인쇄회로기판 상면의 중앙 부분에 칩을 접착하는 경우, SR(Solder Resister)로서의 솔더 마스크와 반도체 칩 사이에 은-에폭시(Ag-Epoxy) 접착제를 도포하고 이를 경화시켜 접착하게 되는데, 솔더 마스크와 반도체 칩과의 접착력이 우수하지 않기 때문에 상기와 같은 계면 박리 현상은 주로 상기 접착제와 칩 탑재 영역에 도포된 솔더 마스크의 표면에서 자주 발생하게 된다. 이와 같은 계면 박리 현상으로 인하여, 장기 신뢰성 시험 중 패키지 내에 균열이 발생되거나 전도성 와이어가 끊어지는 등의 불량이 지속적 발견되므로 BGA 반도체 패키지의 신뢰성이 크게 감소되는 문제점이 발생하게 된다.
따라서 상술한 문제점을 해결하기 위하여, 본 발명에 따른 BGA 반도체 패키지의 제조에 사용되는 인쇄회로기판은, 그 상면의 칩 탑재부에 접착제와의 접촉 면적을 증가시키기 위한 접촉면적 확장부를 형성하여 반도체 칩과 인쇄회로기판 사이의 접착력을 향상시키는 것을 목적으로 한다.
도 1a는 본 발명에 따른 접촉면적 확장부가 형성된 인쇄회로기판의 평면도이다.
도 1b는 접촉면적 확장부가 형성되어 있지 않은 종래의 인쇄회로기판의 평면도이다.
도 2a는 도 1a에 도시된 본 발명에 따른 인쇄회로기판의 칩 탑재부에 반도체 칩을 접착제로 접착한 단면을 도 1a의 X-X 방향을 따라 도시한 단면도이다.
도 2b는 본 발명에 따른 인쇄회로기판의 칩 탑재부에 오목하게 형성된 접촉면적 확장부를 도시한 도면이다.
도 3a 및 도 3b는 본 발명에 따른 접촉면적 확장부가 형성된 인쇄회로기판의 또 다른 변형 실시예를 도시한 도면이다.
도 4는 종래 BGA 반도체 패키지의 단면도이다.
본 발명에 따른 BGA 반도체 패키지의 제조에 사용되는 인쇄회로기판은, 열경화성 수지를 기본 재료로 하며, 상기 열경화성 수지의 대향하는 양면에 전도성 박막으로 된 회로 패턴이 각각 형성되고, 상기 열경화성 수지의 상면 중앙에는 반도체 칩이 접착될 칩 탑재부가 형성되고, 상기 칩 탑재부에는 반도체 칩을 접착시키는 접착제와의 접촉 면적을 증가시키기 위한 접촉면적 확장부가 형성되고, SR 재료로서 솔더 마스크가 접촉면적 확장부를 제외한 상기 칩 탑재부의 표면 위에 도포되는 것을 특징으로 한다.
또한, 본 발명은 접착제로서 은-에폭시 접착제를 사용하는 경우 접착력을 보다 향상시키기 위하여, 상기 접촉면적 확장부를 금속 재료로 구성하는 것을 특징으로 한다.
또한, 칩 탑재부에 형성된 접촉면적 확장부는 돌출형 또는 오목형으로 형성될 수 있으며, 나아가 접촉면적 확장부의 평단면이 원형, 사각형 또는 선형으로 형성될 수 있다. 또한, 이들 원형, 사각형 또는 선형의 평단면을 갖는 접촉면적 확장부도 돌출형 또는 오목형으로 형성될 수 있다.
이하에서는, 본 발명에 따른 실시예를 도면을 참조하여 설명하기로 한다.
도 1a는 본 발명에 따른 접촉면적 확장부가 형성된 인쇄회로기판의 평면도이다. 점선으로 표시된 영역은 칩 탑재부(4)로서 그 내부에 접촉면적 확장부(3)가 원형의 평단면을 갖도록 형성되어 있다. 상기 칩 탑재부(4) 주위에는, 전도성 와이어(도면에 도시되지 않음)에 의해 반도체 칩(도면에 도시되지 않음)과 연결될 인쇄회로기판(1)의 상면에 형성된 회로 패턴의 일부인 접속 패드(9)가 도시되어 있다. 도 1a에서 도시된 인쇄회로기판(1)의 상면에는, 상기 접촉면적 확장부(3) 및 접속 패드(9)를 제외한 대부분의 영역이 솔더 마스크(5)로 도포되어 있다.
종래의 인쇄회로기판과 비교하기 위하여, 도 1b에 접촉면적 확장부가 형성되어 있지 않은 인쇄회로기판(11)을 도시하였다. 도 1b의 칩 탑재 영역(14)에는, 도 1a와는 달리, 접촉면적 확장부가 형성되어 있지 않다. 후술하겠지만, 본 발명에 따른 인쇄회로기판은 상기 칩 탑재부에 솔더 마스크가 도포되지 않은 접촉면적 확장부를 형성함으로써 은-에폭시 접착제와의 접착력을 효과적으로 향상시켜 고온 환경에서의 계면 박리 현상을 방지할 수 있게 된다.
도 2a는 도 1a에 도시된 칩 탑재부에 반도체 칩을 접착제로 접착한 단면을 도 1a의 X-X 방향을 따라 도시한 단면도이다. 도 2a에서, 열경화성 수지(2)의 상면에는 금속 재료로 구성된 칩 탑재부(4)가 형성되고, 상기 칩 탑재부(4) 위에 솔더 마스크(5)가 도포된다. 본 실시예에서는 상기 솔더 마스크(5) 위로 상기 칩 탑재부(4)에 형성된 접촉면적 확장부(3)가 돌출되어 있으며, 그 위로 접착제를 도포하여 반도체 칩(7)을 접착한다. 본 실시예에서와 같이 칩 탑재부(4)에 형성된 돌출형 접촉면적 확장부(3)로 인해 접착제(6)와의 접착 면적이 증가하고, 또한 상기 돌출형 접촉면적 확장부(3)는 금속 재료로 되어 있으므로 접착제로 사용되는 은-에폭시 접착제와의 접착력이 보다 강화된다.
도 2b는 본 발명에 따른 인쇄회로기판의 칩 탑재부에 형성된 접촉면적 확장부의 또 다른 형태를 보여준다. 앞에서의 실시예에서는 접촉면적 확장부가 솔더 마스크 위로 돌출되어 있는 돌출형으로 구성되었으나, 본 실시예에서는 오목형 접촉면적 확장부로 구성하였다. 이러한 구성에 의하여도 접착제의 접촉 면적이 증가될 수 있고, 금속재의 접촉면적 확장부가 은-에폭시 접착제와 직접 접착될 수 있게 된다.
도 3a 및 도 3b는 본 발명에 따른 접촉면적 확장부가 형성된 인쇄회로기판의 또 다른 변형 실시예를 보여준다. 상기 도면들에서는 칩 탑재부에 형성된 접촉면적확장부의 다양한 형태를 도시하였다. 즉, 도 1a에서는 평단면이 원형으로 형성된 접촉면적 확장부을 도시하였으나, 도 3a에서는 평단면이 사각형으로 형성된 접촉면적 확장부을, 또한 도 3b에서는 평단면이 선형으로 형성된 접촉면적 확장부을 도시하였다. 이러한 구성을 통하여도 상술한 효과 즉, 접착제와의 접촉 면적의 증가 및 금속재의 접촉면적 확장부와 은-에폭시 접착제와의 접촉을 통한 접착력의 향상을 꾀할 수 있다. 한편, 특별히 도시하지 않았지만 원형, 사각형 및 선형의 평단면을 갖는 접촉면적 확장부는 돌출형 및 오목형으로 형성될 수도 있다. 또한, 그 밖에 다양한 형태의 접촉면적 확장부를 형성할 수 있음을 당업자에게 쉽게 이해될 수 있을 것이다.
본 발명에 따르면, BGA 반도체 패키지 제조에 사용되는 인쇄회로기판의 칩 탑재부에 접촉면적 확장부를 형성함으로써, 은-에폭시 접착제와의 접촉 면적의 증가 및 은-에폭시 접착제와 금속 성분의 접촉면적 확장부와의 접착력을 통하여, 반도체 칩과 인쇄회로기판 사이의 접착력을 보다 향상시킬 수 있다.
또한, 인쇄회로기판의 칩 탑재부의 표면에는 접촉면적 확장부를 제외한 나머지 영역이 고분자 재료인 솔더 마스크로 도포되어 있으므로, 접착제는 솔더 마스크와 접착됨과 동시에 금속 재료로 된 접촉면적 확장부와도 접착될 수 있게 되어, 접촉면적 확장부가 형성되어 있지 않은 인쇄회로기판 상에 반도체 칩을 접착하는 것보다 훨씬 강하게 접착될 수 있다.
현재, 인쇄회로기판을 사용하는 패키지의 제조 부품이 다양화되고 복합화되는 시점에서, 칩 사이즈가 확대되고 패키지의 몸체 크기가 확대되는 경향에 따라, 본 발명의 적용은 인쇄회로기판의 접촉면적 확장부는 다이 접착제와의 접착력을 개선을 통해 패키지 제품의 신뢰성을 보다 향상시킬 수 있을 것이다.
Claims (4)
- 반도체 패키지의 제조에 사용되는 인쇄회로기판에 있어서,인쇄회로기판의 주 몸체를 구성하는 열경화성 수지;상기 열경화성 수지의 대향하는 양면에 각각 형성되고 전도성 박막으로 된 회로 패턴; 및상기 열경화성 수지의 상면 중앙에 형성되어 있는, 반도체 칩이 접착될 칩 탑재부;를 포함하고, 상기 칩 탑재부에는 반도체 칩을 접착시키는 접착제와의 접촉 면적을 증가시키기 위한 접촉면적 확장부가 형성되고, SR 재료로서 솔더 마스크가 접촉면적 확장부를 제외한 상기 칩 탑재부의 표면 위에 도포되는 것을 특징으로 하는 인쇄회로기판.
- 제1항에 있어서, 상기 칩 탑재부에 형성된 상기 접촉면적 확장부가 금속 재료로 형성되는 것을 특징으로 하는 인쇄회로기판.
- 제1항 및 제2항 중 어느 하나의 항에 있어서, 상기 접촉면적 확장부가 돌출형 또는 오목형으로 형성되는 것을 특징으로 하는 인쇄회로기판.
- 제3항에 있어서, 상기 접촉면적 확장부가 원형, 사각형 또는 선형의 평단면을 갖도록 형성되는 것을 특징으로 하는 인쇄회로기판.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020010063729A KR20030032152A (ko) | 2001-10-16 | 2001-10-16 | 패키지용 인쇄회로기판 |
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Application Number | Priority Date | Filing Date | Title |
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Family
ID=29564873
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
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Country | Link |
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Publication number | Priority date | Publication date | Assignee | Title |
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KR100752011B1 (ko) * | 2006-04-12 | 2007-08-28 | 삼성전기주식회사 | 패키지 기판의 스트립 포맷 및 그 배열 |
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2001
- 2001-10-16 KR KR1020010063729A patent/KR20030032152A/ko not_active Application Discontinuation
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Publication number | Priority date | Publication date | Assignee | Title |
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KR100752011B1 (ko) * | 2006-04-12 | 2007-08-28 | 삼성전기주식회사 | 패키지 기판의 스트립 포맷 및 그 배열 |
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