KR20030014097A - 플라즈마 디스플레이 장치의 구동 방법 - Google Patents

플라즈마 디스플레이 장치의 구동 방법 Download PDF

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Abstract

본원 발명은 인접 셀의 전극이 근처에 존재하는 ALIS 방식의 패널에서도, 배경 발광을 저감하고, 암실 콘트라스트를 더욱 향상시킨 PDP 장치의 구동 방법을 실현하는 것이다. 제1 방향으로 신장하는 제1 전극 X와 제2 전극 Y를 인접시켜서 교대로 배치하고, 제2 전극의 양측에서 제1 및 제2 표시 라인을 형성하며, 이들을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하는 플라즈마 디스플레이 장치의 구동 방법에 있어서, 1표시 필드는 복수의 서브 필드로 구성되고, 각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되며, 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하고, 기입 방전 공정의 전압을 적어도 일부의 서브 필드에서 다르게 한다.

Description

플라즈마 디스플레이 장치의 구동 방법{METHOD OF DRIVING PLASMA DISPLAY APPARATUS}
본 발명은 플라즈마 디스플레이(PDP) 장치 및 그 구동 방법에 관한 것으로, 특히 각 유지 방전 전극의 양측에 표시 라인을 형성하고, 인터레이스 표시를 행하는 ALIS(Alternate Lighting of Surfaces) 방식의 PDP 장치 및 그 구동 방법에 관한 것이다.
특허 제2001893호는 고선명의 표시를 저비용으로 실현하는 ALIS 방식의 PDP 장치를 개시한다. 도 1은 이 문헌에 개시된 ALIS 방식의 PDP 장치의 개략적인 구성을 나타내는 블록도이다. 도시한 바와 같이, ALIS 방식의 PDP 장치는, 유지 방전 전극을 구성하는 제1 전극(X 전극) X-1, X-2, … 및 제2 전극(Y 전극) Y-1, Y-2, …과, 어드레스 전극 A-1, A-2, …이 설치된 패널(1)과, 제어 회로(11)와, 어드레스 드라이버(13)와, 주사 드라이버(12)와, 홀수 Y 유지 방전(서스테인) 회로(16)와, 짝수 Y 유지 방전(서스테인) 회로(17)와, 홀수 X 유지 방전(서스테인) 회로(14)와, 짝수 X 유지 방전(서스테인) 회로(15)와, 전원 회로(18)를 포함한다. 각 요소의 구성 및 동작에 대해서는, 특허 제2001893호에 개시되어 있기 때문에, 여기서는 자세한 설명을 생략한다.
ALIS 방식의 특징은, 각 Y 전극의 상측에 인접하는 X 전극과의 사이에 제1 표시 라인을 형성하고, 그 Y 전극의 하측에 인접하는 X 전극과의 사이에 제2 표시 라인을 형성하고, 홀수 필드에서 제1 표시 라인을 표시하고, 짝수 필드에서 제2 표시 라인을 표시하는 인터레이스 표시를 행하는 점에서, 이 특징에 의해 동일한 X 전극 및 Y 전극의 개수로, 종래의 2배의 표시 라인이 얻어져 고선명화할 수 있는 점이다.
또한, PDP 장치에는 표시 품질이나 신뢰성의 향상, 소비 전력의 저감, 저비용화 등을 위한 각종 기술이 제안되어 있다. 본 발명은 리세트 동작에 관계되는데, 이에 관계되는 기술로서는, 예를 들면, 특개2000-75835는 ALIS 방식의 패널에서 경사가 완만한 전압 파형을 갖는 리세트 펄스를 이용하여 콘트라스트를 개선하는 기술을 개시하고 있다. 또, 특개2000-501199는 램프파(ramp wave)를 이용한 리세트 방식을 개시하고 있다. 또한, 특개2000-242224는 모든 표시 셀의 점등을 동반하는 리세트 펄스를 제1 서브 필드에만 적용하여 콘트라스트를 향상시키는 기술을 개시하고 있다. 또한, 특개2000-29431은 서브 필드의 발광 화소 비율에 따라리세트 전압을 변화시킴으로써 동작을 안정시키는 기술을 개시하고 있고, 특개2000-172224는 직전의 서브 필드의 유지 방전 횟수에 따라 리세트 펄스의 전압을 설정함으로써 오동작을 저감시키는 기술을 개시하고 있다.
최근, PDP 장치의 표시 성능은 현저하게 향상되고, 휘도, 선명도 및 콘트라스트 등도 브라운관에 가까운 성능이 얻어지게 되었다. 그러나, 방송이나 영상 소프트의 진화에 따라, 표시 장치측에도 더욱 더 성능 향상이 기대되고 있으며, 암실 콘트라스트에 관해서도 향상이 기대되고 있다. 이 암실 콘트라스트를 저하시키는 원인인 흑 표시(black display)의 휘도는 방전의 안정화를 위한 리세트 방전에 의한 발광으로의 결과로서, 많은 표시 라인을 고속으로 어드레스하기 위해서는 충분한 리세트 방전이 필요하고, 그 때문에 어느 정도의 휘도를 동반하는 방전이 필요하였다. 이와 같이 안정 동작과 암실 콘트라스트는 상반되는 관계에 있다. 상기한 특개2000-242224에 따르면, 모든 표시 셀의 점등을 동반하는 리세트 펄스를 1필드에 1회, 즉 1개의 서브 필드에만 인가하고, 다른 서브 필드에서는 이전의 서브 필드에서 점등된 표시 셀에서만 소거 방전만을 실행함으로써, 배경 발광(흑 휘도)이 대폭적으로 저감되고, 암실 콘트라스트가 향상된다.
한편, 특허 제2001893호에 개시된 ALIS 방식의 PDP 장치에서는, 특개2000-75835에 개시된 슬로프 파형의 리세트 펄스를 이용함으로써, 500 : 1 정도의 암실 콘트라스트를 얻을 수 있다. 그러나, 이 방법은 모든 서브 필드에서 모든 표시 셀을 대상으로 한 리세트 방전을 실시하고 있기 때문에, 특개2000-242224에 개시된 기술을 적용한 경우의 배경 발광의 휘도보다 휘도가 10배 정도 높아진다. ALIS 방식과 같은 모든 전극의 간극을 표시 라인으로서 이용하는 패널 또는 고선명 패널에서는, 상하로 인접하는 표시 셀 간의 결합이 강하고, 점등 셀로부터 소등 셀로의 전하의 확산이 발생하기 쉽다. 그에 따라, 리세트 후에 어드레스 방전이나 유지 방전을 실시하지 않은 경우라도 표시 셀의 상태가 변화된다. 그 때문에, 다음의 서브 필드의 어드레스 방전을 안정적으로 실시하기 위해서는, 소등 셀을 포함해서 모든 표시 셀을 대상으로 한 리세트 방전을 실시할 필요가 있었다.
도 2는 ALIS 방식의 패널에서 유지 방전에 의해 전하가 인접하는 표시 셀로 확산되는 모습을 나타내고 있다. ALIS 방식의 패널에서는, 유지 전극(X 전극, Y 전극)은 등간격으로 배치되어 있고, 모든 전극의 간극에서 방전이 가능한 구조로 되어 있다. 이 도 2에서는 홀수 필드에서 X2 전극과 Y2 전극 사이에 점등 셀이 형성되는 경우의 동작을 나타낸다. 도 2의 (a)는 유지 방전 기간의 초기의 모습을 나타낸다. 방전에 의해 생성된 전자나 양이온 등의 하전 입자는 방전 공간 내를 전계에 의해 이동한다. ALIS 방식의 패널 또는 고선명 패널에서는, 인접 셀의 전극이 점등 셀의 근방에 있고, 거기에는 강전계가 걸려 있기 때문에 전하가 이동하여 축적되기 쉽다. 이 경우, 인접 셀로 확산되는 전하는 대부분이 이동도가 큰 전자이다.
도 2의 (b)는, 유지 방전을 반복하여 실시한, 즉 유지 방전 펄스 수가 많은(유지 방전 기간이 긴) 서브 필드의 유지 방전 기간의 후반의 상태를 나타낸다. 다음의 서브 필드로 이행하는 단계에서, 만약 특개2000-242224에 개시된 바와 같이점등 셀만을 대상으로 한 리세트(소거)를 실시한 경우, 점등 셀에 인접하는 소등 셀의 전하는 그대로 잔류하게 된다. 그와 같은 상태에서 어드레스 기간에 들어 가서, 도 2의 (c)에 도시한 바와 같이, Y1 전극에 주사 펄스가 인가되면, 주사 펄스의 -170V에, Y1 전극에 축적된 부전하에 의한 전압이 중첩된다. 그 때문에, 소등 셀에 어드레스 펄스가 인가되지 않고, 어드레스 전극 A와 Y 전극 간에 방전이 없는 표시 셀에서도 X 전극과 Y 전극 사이에 방전이 발생한다. 이 표시 셀은 다음의 유지 방전 기간에 발광하게 되어 오표시를 유발하게 된다. 또한, 도 2의 (d)에 도시한 바와 같이, X3 전극에 부전하가 축적되어 있는 경우에는 Y3 전극에 주사 펄스가 인가되고, 어드레스 전극 A에 어드레스 펄스가 인가되어 Y3 전극과 어드레스 전극 간에서 방전이 실행되어도, X 전극측의 부전하가 실효 전압을 저하시키기 때문에 X 전극과 Y 전극 간의 방전이 불발로 되어, 유지 방전에 필요한 벽 전하가 형성되지 않아 유지 방전이 행해지지 않는다. 즉 불점등이 된다.
이와 같이, ALIS 방식의 패널과 같은 인접 셀의 전극이 근처에 존재하는 패널에서는, 모든 서브 필드마다의 모든 표시 셀을 대상으로 한 리세트 방전이 불가결하였다. 또한, 축적 전하가 가장 많은 경우를 상정하여 리세트 전압을 설정하고, 모든 서브 필드에서 그 전압으로 리세트를 행하였다. 이 때문에, 리세트 전압은 높아지고, 배경 발광을 어느 정도 이하로 저감하는 것이 어려워 암실 콘트라스트 향상이 불충분하였다.
본 발명은 이러한 문제를 해결하기 위해 이루어진 것으로, ALIS 방식의 패널과 같은 인접 셀의 전극이 근처에 존재하는 패널에서도 배경 발광을 충분히 저감하고, 암실 콘트라스트를 더욱 향상시킬 수 있는 PDP 장치의 구동 방법 및 PDP 장치를 실현하는 것을 목적으로 한다.
도 1은 ALIS 방식의 플라즈마 디스플레이 장치(PDP 장치)의 개략적인 구성을 나타내는 블록도.
도 2는 종래 기술의 문제점을 설명하는 도면.
도 3은 본 발명의 실시예에서의 구동 파형을 나타내는 도면.
도 4는 실시예의 리세트 파형을 나타내는 도면.
도 5는 실시예의 유지 전극 구동 회로의 구성을 나타내는 도면.
도 6은 본 발명의 제1 실시예에서의 각 서브 필드의 리세트 파형을 나타내는 도면.
도 7은 본 발명의 제2 실시예에서의 각 서브 필드의 리세트 파형을 나타내는 도면.
도 8은 본 발명의 제3 실시예의 유지 전극 구동 회로의 구성을 나타내는 도면.
도 9는 제3 실시예에서의 각 서브 필드의 리세트 파형을 나타내는 도면.
도 10은 본 발명의 효과를 설명하는 도면.
<도면의 주요 부분에 대한 부호의 설명>
1 : 플라즈마 디스플레이 패널
11 : 제어 회로
12 : 주사 회로
13 : 어드레스 드라이버
14 : 홀수 X 유지 방전(서스테인) 회로
15 : 짝수 X 유지 방전(서스테인) 회로
16 : 홀수 Y 유지 방전(서스테인) 회로
17 : 짝수 Y 유지 방전(서스테인) 회로
18 : 전원 회로
본 발명은 상기 목적을 실현하기 위해, 배경 발광의 강도에 직접 관계되는 리세트 전압을 각 서브 필드의 유지 방전 횟수나 표시 상태 등에 따라 가변적이다. 이에 따라, 서브 필드마다 최소한의 전압으로 리세트 방전을 행하기 때문에, 종래보다 배경 발광을 억제하여 암실 콘트라스트를 향상시킬 수 있다. 구체적으로는, 리세트 기간은 주로 이전의 서브 필드에서 점등된 표시 셀의 벽 전하를 소거하는 제1 소거 기간, 다음으로 모든 표시 셀을 대상으로 하여 방전시켜 벽 전하를 형성하는 기입 기간, 및 마지막으로 벽 전하의 전부 또는 일부를 다시 방전에 의해 소거하는 제2 소거 기간으로 구성되며, 그 중의 기입 기간의 최종 전압을 조정한다.
<실시예>
이하에 본 발명의 실시예를 설명하지만, 여기서는 특허 제2001893호에 개시된 도 1에 도시한 바와 같은 구성을 갖는 ALIS 방식의 PDP 장치에 본 발명을 적용한 경우를 예로 들어 설명한다.
도 3은 본 발명의 실시예의 PDP 장치의 구동 파형을 나타내는 도면으로, 홀수 필드에서의 구동 파형을 나타낸다. 본 발명은 리세트 기간의 구동 파형에 특징이 있고, 어드레스 기간 및 유지 방전 기간은 종래예와 동일하기 때문에, 여기서는 설명은 생략하고, 리세트 기간의 전압 파형에 대하여 설명한다.
도 4는, 본 발명의 실시예에서, 리세트 기간에 X 전극과 Y 전극에 인가되는전압 파형을 나타내는 도면이다. 리세트 기간에는 서서히 -Vwx(-120V)에 도달하는 경사가 완만한 슬로프 파형의 펄스를 X 전극에 인가한다. 이러한 파형을 사용함으로써, 이전의 서브 필드에서 점등된 표시 셀의 벽 전하를 소거한다. 이것이 제1 소거 기간이다. 다음으로 X 전극의 전압을 유지한 상태에서 Y 전극에 슬로프 파형의 펄스를 인가하고, 모든 표시 셀을 대상으로 하여 방전시켜 벽 전하를 형성한다. 이것이 기입 기간이다. 그 후, X 전극에 전압 Vx(90V)를 인가한 상태에서, -Vey(-160V)에 도달하는 슬로프 파형의 펄스를 Y 전극에 인가한다. 이것이 제2 소거 기간이다.
본 발명에서는, 제1 소거 기간 및 기입 기간에 X 전극과 Y 전극 간에 인가하는 전압을 조정하는 것이 특징이다. 또, 도 4에 도시한 바와 같이 인가 전압은 슬로프 파형으로 서서히 변화되기 때문에, 여기서 전압을 조정한다는 것은 최종적으로 인가되는 전압 레벨을 조정하는 것을 의미한다. 전압의 조정 방법으로서는, Y 전극측의 전압을 조정하는 방법, X 전극측의 전압을 조정하는 방법, 또한 양자를 조정하는 방법이 있다. 도 4에서는, X 전극에 인가하는 슬로프 파형이 도달하는 최종 전압이 -Vwx1 내지 -Vwx2의 범위에서 변화되고, Y 전극에 인가하는 슬로프 파형이 도달하는 최종 전압이 Vw1 내지 Vw2의 범위에서 변화된다. -Vwx2는 종래와 동일한 -120V이고, -Vwx1은 -50V이며, 이 범위 내에서 각 서브 필드마다 소정의 값으로 설정된다. 또한, Vw2는 종래와 동일한 200V이고, Vw1은 100V이며, 서브 필드의 조건이나 표시 상태에 따라 이 범위 내에서 소정의 값으로 설정된다.
도 5는 상기한 바와 같은 리세트 파형을 발생하는 구동 회로의 구성을 나타내는 도면으로, 도 1의 홀수 X 서스테인 회로(14), 짝수 X 서스테인 회로(15), 홀수 Y 서스테인 회로(16), 및 짝수 Y 서스테인 회로(17)의 부분에 상당한다. 참조 번호(31)는 X 전극에 인가하는 유지 방전 펄스를 생성하는 회로이고, 참조 번호(41)는 Y 전극에 인가하는 유지 방전 펄스를 생성하는 회로이다. 이 구동 회로에서는, X 전극측 및 Y 전극측 각각에, 사전에 4종류의 리세트용의 전압값이 준비되어 있다. 패널(1)의 표시 셀(21)의 Y 전극에 인가하는 전압은 스위치(42∼45) 중 어느 하나를 선택적으로 온함으로써 대응하는 전압값이 출력된다. 또한, X 전극측에 대해서는 가장 낮은(절대치가 가장 큰) 전압 -Vwx의 전원이 설치되고, 이 전압을 출력할 때는 스위치(37)를 온한 후에 스위치(35)를 온한다. 또한, 그보다 높은(절대값이 작은) 전압을 출력하는 경우에는 스위치(37)를 오프한 상태에서 스위치(38) 또는 스위치(39)를 온으로 하거나 또는 양방을 오프로 하고 스위치(35)를 온한다. 스위치(37)를 온한 경우에는, 전압 -Vwx가 패널(1)의 표시 셀(21)의 X 전극으로 출력되고, 그 이외일 때에는 1개 내지 3개의 제너 다이오드로 규정되는 전압을 뺀 전압이 출력된다. 또한, 본 실시예에서는, Y 전극측은 복수의 전원으로부터, X 전극측은 단일 전원으로부터 제너 다이오드를 이용하여 출력 전압을 생성하지만, X 전극측과 Y 전극측의 양자 모두 어느 쪽의 방식으로도 실현할 수 있다. 또, 본 실시예에서는 출력 전압이 취할 수 있는 전압값은 4종류이지만, 이것만으로도 배경 발광을 충분히 저감할 수 있다.
도 6은 본 발명의 제1 실시예에서의 각 서브 필드의 리세트 파형을 나타내는 도면이다. PDP 장치는 발광 여부의 제어밖에 행할 수 없기 때문에, 계조 레벨의표시는 1필드를 복수의 서브 필드로 구성하고, 점등되는 서브 필드를 조합함으로써 행한다. 제1 실시예에서는 1필드(홀수 필드 또는 짝수 필드)는 10개의 서브 필드로 구성되고, 제1 서브 필드와 제10 서브 필드의 유지 방전 기간이 가장 길고, 유지 방전 펄스가 가장 많기 때문에 가장 밝다. 그리고, 중앙의 서브 필드일수록 유지 방전 기간이 짧아진다. 이것은 PDP 장치 특유의 화질 열화 현상인 의사 색 윤곽(color false contour)을 저감하기 위한 표시 시퀀스이다.
제1 실시예에서는, 리세트 기간의 기입 기간에 Y 전극에 인가하는 전압 Vw만을 가변으로 하고, 이것을 리세트 전압이라 하기로 한다. 제1 실시예에서는, 다음에 설명하는 이유로, 제1 서브 필드의 리세트 전압을 더욱 크게 설정한다. 제1 이유는, ALS 방식의 경우, 제1 서브 필드에서 홀수 행의 표시와 짝수 행의 표시가 전환되기 때문에, 이전의 필드에서 점등되지 않았던 전극쌍측도 활성화해 둘 필요가 있다. 제2 이유는, 필드의 주기는 표시 장치의 외부로부터 입력되는 수직 동기 신호에 동기한다. 그 때문에, 수직 동기 신호의 주기가 긴 영상 신호의 경우, 최종 서브 필드가 종료되고 나서 제1 서브 필드가 개시되기까지의 시간이 길어지고, 방전의 안정도를 좌우하는 프라이밍 효과가 저하되므로, 사전에 모든 표시 셀에 대하여 비교적 강한 방전을 실시하여 공간 전하를 생성할 필요가 있다. 제3 이유는, 제10 서브 필드의 유지 방전 횟수가 많기 때문에, 도 2의 (b)에 도시한 바와 같이, 다량의 전자가 인접 셀에 축적되어 있는 경우가 있으며, 예를 들면, Y 전극측에 축적된 전자는 리세트 전압(Vw)의 실효값을 내리기 위해 높은 전압이 필요하다. 이상의 이유에 의해, 제1 서브 필드의 리세트 전압은 약 200V로 설정할 필요가 있다.종래는 여기서 필요한 200V의 전압을 모든 서브 필드에 인가하였기 때문에 제1 서브 필드 이외에는 과도한 전압이 인가되었다.
제2 서브 필드의 리세트 전압은, 직전의 제1 서브 필드의 유지 방전 횟수는 많지만, 상기한 제1 및 제2 이유가 없기 때문에 제1 서브 필드보다 낮추는 것이 가능하다.
제5 서브 필드의 유지 방전 횟수는 수회로 가장 적고, 도 2에서 설명한 인접하는 표시 셀에서의 전하의 축적은 거의 없기 때문에, 점등 셀에 인접하는 소등 셀이라도 이전의 리세트 기간에 형성된 상태가 유지된다. 따라서, 그 후의 제6 서브 필드의 리세트 전압은 가장 낮게 약 100V로 설정된다. X 전극과 Y 전극 사이의 방전 임계치 전압은 220V 정도이기 때문에, 소등 셀은 거의 방전을 행하지 않는다.
제3 서브 필드 내지 제5 서브 필드의 리세트 전압은, 제2 서브 필드와 제6 서브 필드의 리세트 전압 사이의 값이고, 제7 서브 필드 내지 제10 서브 필드의 리세트 전압은 유지 방전 기간이 서서히 길어지기 때문에 그에 따라 제6 서브 필드의 리세트 전압보다 약간 높게 설정된다. 또, 제1 실시예에서는 리세트 기간의 길이는 고정이다.
도 7은 본 발명의 제2 실시예에서의 각 서브 필드의 리세트 파형을 나타내는 도면이다. 도 6의 제1 실시예와의 차이는, Y 전극에 인가하는 전압 Vw를 변화시킴과 함께, 전극에 인가하는 전압을 다양한 조건에 따라 변화시키는 점이다. 제1 서브 필드의 리세트 기간의 제1 소거 기간에서의 X 전극으로의 인가 전압과 기입 기간에서의 Y 전극으로의 인가 전압은, 상기와 동일한 이유로 양자 모두 절대값을 크게 한다. 제1 실시예에서는 제1 서브 필드의 리세트 전압을 낮게 하고 있지만, 이 제2 실시예에서는 Y 전극으로의 인가 전압은 높은 상태로 유지한 후에, X 전극측의 전압의 절대값을 작게 한다(부전압이기 때문에 실제로는 더 높게 됨). 그 이유는 다음과 같다. 유지 방전 기간에서는 어드레스 전극은 평균적으로 음극으로 되기 때문에, 어드레스 방전으로 어드레스 전극측에 형성된 부전하는 유지 방전에 노출되어 서서히 소거된다. 그러나, 유지 방전 횟수가 적은 경우에는 소거되기 어렵다. 그리고, 그 전하가 그대로 잔류하면 어드레스 펄스 전압의 실행값을 낮추는 방향으로 작용하기 때문에 바람직하지 못하다. 따라서, 리세트 기간에서의 어드레스 전극측의 부전하를 소거하기 위해, X 전극과 Y 전극 사이의 전압은 작게 설정해도, Y 전극과 어드레스 전극 사이의 전압이 커지도록 설정하고, 어드레스 전극과 Y 전극 간의 방전에 의해 어드레스 전극측의 마이너스 전하를 소거하는 기능을 강화한다.
도 8은 본 발명의 제3 실시예의 유지 전극 구동 회로의 구성을 나타내는 도면이다. 도 5의 제1 및 제2 실시예의 구동 회로에서는 전압이 다른 복수의 전원을 설치하거나, 단일 전원으로부터 제너 다이오드를 이용하여 출력 전압을 생성하지만, 제3 실시예의 구동 회로에서는 전극에 인가하는 전압을 서서히 변화시키고, 전극의 전압을 감시하여 소정의 값에 도달했을 때에 전압의 인가를 정지시키는 점이 다르다. 또한, 제3 실시예의 X 전극측 구동 회로(30)는 도 8의 X 전극측 구동 회로와 동일한 구성을 갖는 것으로 한다. 리세트 전압 Vw는 스위치(54)를 온함으로써, 전류 제한기(55)를 통해 표시 셀(21)의 Y 전극으로 인가된다. 전류제한기(55)가 설치되어 있기 때문에, 패널(1)로 유입되는 전류가 제한되고, Y 전극의 전압은 경사가 완만한 슬로프 파형으로 변화된다. 또한, Y 전극에 인가되는 리세트 펄스 전압은 전압 검출기(56)에 의해 감시되어, 소정의 전압에 도달했을 때에 리세트 전압 제어 회로(53)에 의해 스위치(54)가 오프된다. 리세트 전압 제어 회로(53)는, 표시 시퀀스 제어 회로(51)로부터의 실행 중인 서브 필드의 정보, 유지 방전의 횟수 정보 등을 받아, 이들 정보로부터 리세트 인가 전압을 결정한다.
제3 실시예에서는, 리세트 전압이 소정의 값에 도달하여 스위치(54)를 오프함과 동시에, 다음의 소거 공정으로 이행한다. 도 9는 제3 실시예에서의 각 서브 필드의 리세트 파형을 나타내는 도면이다. 도 6 및 도 7에서는 Y 전극의 전압이 각각 소정의 값에 도달한 후 잠시동안 유지되는 데 반하여, 제3 실시예에서는 Y 전극의 전압이 각각 소정의 값에 도달한 직후에 인가가 정지되고, 다음의 소거 기간의 동작으로 이행한다. 이에 따라, 동작 시간을 단축할 수 있고, 단축한 시간을, 예를 들면 유지 방전 기간의 연장에 사용할 수 있다.
이상 제1 내지 제3 실시예를 설명하였지만, 각 설정 전압이나 어느 것의 전압을 출력할지에 대해서는, 패널의 설계나 구동 조건에 따라 최적값을 설정하는 것은 물론이다.
도 10은 본 발명의 효과를 설명하는 도면으로, 제1 내지 제3 실시예에서 설명한 바와 같이 각 서브 필드의 리세트 전압을 최적이 되도록 제어한 경우의 리세트 발광 강도를 종래 기술에 의한 경우와 대비하여 나타낸다. 도시한 바와 같이, 중앙에서의 리세트 펄스에 의한 발광 강도가 작아지고, 배경 휘도는 종래의 약 1/2내지 1/3로 되며, 암실 콘트라스트는 2배 내지 3배로 개선되었다.
또한, 상기한 바와 같이, 유지 방전 횟수가 많은 경우에 방전으로 발생하는 전하가 확산되어 인접하는 표시 셀의 전극에 축적되는 것이 큰 원인이다. 따라서, 이전의 필드의 유지 방전 횟수가 적은 경우에는, 다음의 필드의 리세트 전압을 낮게 하는 것이 가능하다. 예를 들면, PDP 장치에서는, 표시율이 높을 때에는 유지 방전 기간의 길이를 짧게 하여 전력 증가를 제한하지만, 그와 같은 경우에는 기입 방전 공정의 리세트 전압을 작게 하는 것이 가능하다.
(부기 1)
제1 방향으로 신장하는 제1 전극과 제2 전극을 인접시켜서 교대로 배치하고, 상기 제2 전극의 한쪽에 인접하는 제1 전극과의 사이에 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 제1 전극과의 사이에 제2 표시 라인을 형성하여, 상기 제1 표시 라인과 상기 제2 표시 라인을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하는 플라즈마 디스플레이 장치의 구동 방법에 있어서,
1표시 필드는 복수의 서브 필드로 구성되고,
각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되며,
또한, 상기 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하며,
상기 기입 방전 공정의 전압을 적어도 일부의 서브 필드에서 다르게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치의 구동 방법.(1)
(부기 2)
부기 1에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
상기 유지 방전 기간에서의 유지 방전 횟수가 적은 서브 필드 후의 서브 필드의 상기 리세트 기간의 상기 기입 방전 공정의 전압을 작게 하는 플라즈마 디스플레이 장치의 구동 방법.
(부기 3)
부기 1에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
상기 플라즈마 디스플레이 장치는 상기 제1 전극과 제2 전극에 대하여 수직 방향으로 신장하는 제3 전극을 더 포함하고,
상기 기입 방전 공정에서는, 상기 제3 전극에 소정의 전압을 인가한 상태에서, 상기 제1 전극에 인가하는 전압 또는 제2 전극에 인가하는 전압 또는 그 양방의 전압을 변화시키는 플라즈마 디스플레이 장치의 구동 방법.(2)
(부기 4)
부기 1에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
상기 제1 또는 제2 표시 라인을 표시하는 필드가 종료된 후, 다음 필드의 최초의 서브 필드의 리세트 기간에서의 상기 기입 방전 공정의 전압을 다른 서브 필드보다 크게 하는 플라즈마 디스플레이 장치의 구동 방법.
(부기 5)
부기 1에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
1필드의 시간이 짧아지고, 필드 내의 최후의 서브 필드가 종료된 후 다음 필드의 최초의 서브 필드를 개시할 때까지의 동안에 중지 기간이 발생했을 때에는, 상기 중지 기간의 길이에 따라 최초의 서브 필드의 리세트 기간에서의 상기 기입 방전 공정의 전압을 크게 하는 플라즈마 디스플레이 장치의 구동 방법.
(부기 6)
부기 1에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
상기 기입 방전 공정의 전압 파형은, 전압이 완만하게 변화되는 슬로프 파형인 플라즈마 디스플레이 장치의 구동 방법.(3)
(부기 7)
부기 6에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
상기 기입 방전 공정의 시간은 일정하고, 각 서브 필드마다 소정의 전압에 도달한 후, 그 전압을 기입 방전 공정 종료까지 유지하는 플라즈마 디스플레이 장치의 구동 방법.
(부기 8)
부기 6에 기재된 플라즈마 디스플레이 장치의 구동 방법에 있어서,
상기 기입 방전 공정의 전압 파형의 전압 변화율은 모든 서브 필드에서 동일하고, 전압이 소정의 값에 도달한 후 바로 다음의 소거 공정으로 이행하는 플라즈마 디스플레이 장치의 구동 방법.
(부기 9)
제1 방향으로 신장하며, 인접하여 교대로 배치된 제1 전극 및 제2 전극과, 상기 제1 및 제2 전극에 구동 전압을 인가하는 구동 회로를 포함하는 플라즈마 디스플레이 장치에 있어서,
상기 제2 전극의 한쪽에 인접하는 제1 전극과의 사이에 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 제1 전극과의 사이에 제2 표시 라인을 형성하고, 상기 제1 표시 라인과 상기 제2 표시 라인을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하고,
1표시 필드는 복수의 서브 필드로 구성되며,
각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되고, 또한, 상기 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하며,
상기 구동 회로는 적어도 일부의 서브 필드의 상기 기입 방전 공정에서, 다른 전압을 출력하는 것을 특징으로 하는 플라즈마 디스플레이 장치.(4)
(부기 10)
부기 9에 기재된 플라즈마 디스플레이 장치에 있어서,
상기 구동 회로는 기입 방전용의 복수의 전압원을 포함하고, 그 복수의 전압원을 선택하여 전압을 다르게 한 플라즈마 디스플레이 장치.
(부기 11)
부기 9에 기재된 플라즈마 디스플레이 장치에 있어서,
상기 구동 회로는, 시간 경과에 따라, 전압이 소정의 값까지 서서히 증가되는 전압원 회로와, 전극에 인가되는 전압을 감시하는 전압 감시 회로를 포함하고, 전극의 전압이 소정의 값에 도달한 시점에서 전압 인가를 중단하는 플라즈마 디스플레이 장치.
(부기 12)
제1 방향으로 신장하는 제1 전극과 제2 전극을 인접시켜서 교대로 배치하고, 상기 제2 전극의 한쪽에 인접하는 제1 전극과의 사이에 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 제1 전극과의 사이에 제2 표시 라인을 형성하여, 상기 제1 표시 라인과 상기 제2 표시 라인을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하는 플라즈마 디스플레이 장치의 구동 방법에 있어서,
1표시 필드는 복수의 서브 필드로 구성되고,
각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되며,
또한, 상기 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하고,
표시율이 높을 때는 상기 유지 방전 기간의 길이를 짧게 하여 전력 증가를 제한하도록, 표시율에 따라 상기 유지 방전 기간의 길이를 제어하고,
상기 유지 방전 기간이 짧을 때는 상기 기입 방전 공정의 최종 전압을 작게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치의 구동 방법.(5)
이상 설명한 바와 같이, 본 발명에 따르면, 각 서브 필드의 리세트 방전에 있어서, 필요 이상으로 큰 전압을 인가하지 않기 때문에, 배경 휘도를 저감할 수 있으며, 암실 콘트라스트를 향상시킬 수 있다.

Claims (5)

  1. 제1 방향으로 신장하는 제1 전극과 제2 전극을 인접시켜서 교대로 배치하고, 상기 제2 전극의 한쪽에 인접하는 제1 전극과의 사이에 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 제1 전극과의 사이에 제2 표시 라인을 형성하고, 상기 제1 표시 라인과 상기 제2 표시 라인을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하는 플라즈마 디스플레이 장치의 구동 방법에 있어서,
    1표시 필드는 복수의 서브 필드로 구성되고,
    각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되며,
    또한, 상기 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하고,
    상기 기입 방전 공정의 전압을 적어도 일부의 서브 필드에서 다르게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치의 구동 방법.
  2. 제1항에 있어서,
    상기 플라즈마 디스플레이 장치는, 상기 제1 전극과 제2 전극에 대하여 수직 방향으로 신장하는 제3 전극을 더 포함하고,
    상기 기입 방전 공정에서는, 상기 제3 전극에 소정의 전압을 인가한 상태에서, 상기 제1 전극에 인가하는 전압 또는 제2 전극에 인가하는 전압 또는 그 양방의 전압을 변화시키는 플라즈마 디스플레이 장치의 구동 방법.
  3. 제1항에 있어서,
    상기 기입 방전 공정의 전압 파형은 전압이 완만하게 변화되는 슬로프 파형인 플라즈마 디스플레이 장치의 구동 방법.
  4. 제1 방향으로 신장하며, 인접하여 교대로 배치된 제1 전극 및 제2 전극과, 상기 제1 및 제2 전극에 구동 전압을 인가하는 구동 회로를 포함하는 플라즈마 디스플레이 장치에 있어서,
    상기 제2 전극의 한쪽에 인접하는 제1 전극과의 사이에 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 제1 전극과의 사이에 제2 표시 라인을 형성하고, 상기 제1 표시 라인과 상기 제2 표시 라인을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하고,
    1표시 필드는 복수의 서브 필드로 구성되며,
    각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되고,
    또한, 상기 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하며,
    상기 구동 회로는 적어도 일부의 서브 필드의 상기 기입 방전 공정에서, 다른 전압을 출력하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  5. 제1 방향으로 신장하는 제1 전극과 제2 전극을 인접시켜서 교대로 배치하고, 상기 제2 전극의 한쪽에 인접하는 제1 전극과의 사이에 제1 표시 라인을 형성하고, 상기 제2 전극의 다른쪽에 인접하는 제1 전극과의 사이에 제2 표시 라인을 형성하고, 상기 제1 표시 라인과 상기 제2 표시 라인을 교대로 서로 다른 필드에서 표시하는 인터레이스 표시를 행하는 플라즈마 디스플레이 장치의 구동 방법에 있어서,
    1표시 필드는 복수의 서브 필드로 구성되고,
    각 서브 필드는 적어도 리세트 기간, 어드레스 기간 및 유지 방전 기간으로 구성되며,
    또한, 상기 리세트 기간은 적어도 기입 방전 공정과 소거 방전 공정을 포함하고,
    표시율이 높을 때는 상기 유지 방전 기간의 길이를 짧게 하여 전력 증가를 제한하도록, 표시율에 따라 상기 유지 방전 기간의 길이를 제어하고,
    상기 유지 방전 기간이 짧을 때는 상기 기입 방전 공정의 최종 전압을 작게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치의 구동 방법.
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