KR20020041814A - 집적회로를 위한 위상 시프트 및 트림 마스크를 결정하는방법 및 장치 - Google Patents

집적회로를 위한 위상 시프트 및 트림 마스크를 결정하는방법 및 장치 Download PDF

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KR20020041814A
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Abstract

딥 서브-마이크론 레이아웃의 최적화를 위한 방법 및 장치가 기재된다. 집적회로(IC) 설계의 구성요소들(예로, 게이트)은, 위상 시프트 공정없이 제조된 회로에 비해 회로 밀도 및/또는 성능을 개선하기 위해, 위상 시프트 공정(phase shifting process)을 이용하여 제조될 수 있다. 일실시예에서, 제1 마스크(예로, 위상 시프트 마스크)가 생성되는데. 이것은 위상 시프트 공정을 이용하여 제조되는 구성요소들을 포함한다. 또한, 제1 마스크를 이용하여 생성된 구조를 다시 처리하기 위해 제2 마스크(예로, 트림 마스크)가 생성된다. 두 마스크 모두 위상 시프트 공정으로 생성되는 구조(예로, 게이트)와는 상이한 집적회로 레이아웃 층에서의 영역(예로, 확산 영역)에 기반하여 정의된다.

Description

집적회로를 위한 위상 시프트 및 트림 마스크를 결정하는 방법 및 장치{METHOD AND APPARATUS FOR DETERMINING PHASE SHIFTS AND TRIM MASKS FOR AN INTEGRATED CIRCUIT}
집적회로가 점점 조밀해짐에 따라, 라인 및 소자들의 폭 뿐만 아니라 라인 사이의 간격이 점점 작아지고 있다. 현재, 딥 서브-마이크론(<0.25㎛) 공정이 사용되고 있다. 그러나, 딥 서브-마이크론 공정에 있어서, 실리콘 양품률은 레티클(reticle)/마스크 패턴 충실도(fidelity), 광학적 근접 효과, 및 레지스트 및 에칭 처리과정 동안의 부하 효과 및 확산을 포함한 몇몇 인자에 의해 영향을 받는다. 통상적인 문제점은 국부적 패턴 밀도 및 토폴로지(topology), 및 라인 엔드 풀백(line end pullback)에 의존하는 라인-폭 변화를 포함한다.
도1a는 예시적인 딥 서브-마이크론 설계 레이아웃을 도시하고 있다. 도1a는의도된 레이아웃을 도시하고 있지만, 딥 서브-마이크론 공정의 물리적 특성으로 인해, 결과로서 생성되는 회로는 이 설계 레이아웃과는 상이하다. 도1b는 도1a의 설계에 기반한 보정되지 않은(uncorrected) 구조이다.
도1b의 구조에서, 라인 폭은 동작의 속도 및 정확성에 영향을 줄 수 있는 밀도 및 토폴로지에 기반하여 변화한다. 또한, 라인 에지가 짧아지고 둥글게 되는데, 이것은 접속을 파괴하고 회로 장애를 야기할 수 있다. Wang 등에 의한 미국특허번호 제5,858,580호("'580 특허")에는 게이트 폭을 본래의 사이즈로부터 서브-마이크론 치수가 될 수 있는 축소된 사이즈로 줄이기 위한 장치 및 방법이 기재되어 있다.
'580 특허는 게이트 사이즈를 제1의 최소 실현가능 치수를 갖는 제1 제조 공정으로부터 제2의 최소 실현가능 치수를 갖는 제2 제조 공정으로 감소시킨다. 제2의 최소 실현가능 치수는 제1의 최소 실현가능 치수보다 작다. 그러나, '580 특허는 제1 공정을 위해 설계된 집적회로 레이아웃, 및 제2 공정에 사용되기 위해 축소된 집적회로 레이아웃을 필요로 한다. 따라서, 본래의 회로 레이아웃으로 수행할 수 있는 개선된 딥 서브-마이크론 처리가 요구된다.
본 발명은 집적회로 처리에 관한 것이다. 특히, 본 발명은 딥 서브-마이크론(deep sub-micron)(<0.25㎛) 집적회로에 대한 광 보정(optical correction)에 관한 것이다.
본 발명은 첨부된 도면에서 제한적이 아닌 예시적인 방법으로 도시되어 있고, 여기서, 동일한 참조 번호는 유사한 구성요소를 나타낸다.
도1a는 예시적인 딥 서브-마이크론 설계 레이아웃을 도시한 도면.
도1b는 도1a의 설계에 기반한 보정되지 않은 구조를 도시한 도면.
도2는 집적회로 처리 배열의 일실시예를 도시한 도면.
도3은 확산 영역 위에 2개의 게이트를 갖는 설계 레이아웃을 도시한 도면.
도4는 본 발명의 일실시예에 따른 위상 시프트 및 트림 마스크 생성에 사용되는 라인 세그먼트 표시를 포함한 도3의 설계 레이아웃을 도시한 도면.
도5는 본 발명의 일실시예에 따른 도3의 레이아웃에 대한 위상 시프트 마스크를 도시한 도면.
도6은 본 발명의 일실시예에 따른 도3의 레이아웃에 대한 트림 마스크를 도시한 도면.
도7은 도3의 레이아웃에 기반하여 결과로서 생성된 회로를 도시한 도면.
도8은 본 발명의 일실시예에 따른 위상 시프트 및 트림 마스크 생성 과정을 도시한 순서도.
도9는 본 발명의 일실시예에 따른 위상 시프트 및 트림 마스크 생성 과정을 도시한 순서도.
도10은 본 발명의 일실시예에 따른 시뮬레이션 툴을 포함하는 EDA 툴을 도시한 도면.
도11은 본 발명을 실시하는데 적합한 컴퓨터 시스템의 일실시예를 도시한 도면.
발명의 요약
집적회로 제조를 위한 위상 시프트 마스크(phase shifting mask) 및 트림 마스크(trim mask)를 생성하기 위한 장치 및 방법이 기재되어 있다. 집적회로의 제1층에서 제1 영역을 정의하는 제1 마스크가 생성된다. 제1 영역은 적어도 부분적으로 집적회로의 제2 층에서의 영역에 기반한다. 집적회로의 제1 층에서 제2 영역을 정의하는 제2 마스크가 생성된다. 제2 영역 또한 적어도 부분적으로 집적회로의 제2 층에서의 영역에 기반한다. 제2 마스크는 또한 제2 마스크에 의해 생성된 아티팩트를 제거한다.
집적회로 제조를 위한 위상 시프트 마스크 및 트림 마스크를 생성하는 방법 및 장치가 기재되어 있다. 다음의 설명에서, 본 발명의 완전한 이해를 제공하기 위해 여러 특정한 세부사항들이 제시된다. 그러나, 이 기술분야의 통상의 지식을 가진 자에게는 본 발명이 이러한 특정한 세부사항없이 실시될 수 있다는 것이 명백할 것이다. 다른 예에서, 본 발명을 모호하지 않게 하기 위해 구조 및 장치들이 블록도 형식으로 도시되어 있다.
명세서에서 "일실시예" 또는 "하나의 실시예"라는 용어는 그 실시예와 함께 설명된 특정한 형태, 구조 또는 특징들이 본 발명의 적어도 일실시예에 포함된다는 것을 의미한다. 명세서 중의 여러 곳에서 "일실시예에서"라는 표현은 반드시 모두 동일한 실시예를 언급하는 것은 아니다.
딥 서브-마이크론 레이아웃의 최적화를 위한 방법 및 장치가 기재된다. 집적회로(IC) 설계의 구성요소들(예로, 게이트)은, 위상 시프트 공정없이 제조된 회로에 비해 회로 밀도 및/또는 성능을 개선하기 위해, 위상 시프트 공정(phase shifting process)을 이용하여 제조될 수 있다. 일실시예에서, 제1 마스크(예로, 위상 시프트 마스크)가 생성되는데. 이것은 위상 시프트 공정을 이용하여 제조되는 구성요소들을 포함한다. 또한, 제1 마스크를 이용하여 생성된 구조를 다시 처리하기 위해 제2 마스크(예로, 트림 마스크)가 생성된다. 두 마스크 모두 위상 시프트 공정으로 생성되는 구조(예로, 게이트)와는 상이한 집적회로 레이아웃 층에서의 영역(예로, 확산 영역)에 기반하여 정의된다.
도2는 집적회로 처리 배열의 일실시예를 도시하고 있다. 도2의 배열은 본 발명에 사용되는데 적합하고, 후술되는 바와 같이 구성요소 사이즈를 줄이기 위해 사용될 수 있다. 도2의 구성요소들의 일반적인 사용은 이 기술분야에서 주지되어 있다. 변형예가 아래에 보다 상세히 기술된다. 예를 들면, 도2의 나머지 구성요소들을 이용하여 특정한 레티클 및/또는 마스크 구조 및 변형이 사용될 수 있다.
광원(200)이 웨이퍼(230) 쪽으로 빛을 공급한다. 마스크/레티클(210)은 웨이퍼(230)의 소정의 부분에 대해 빛을 차단한다. 스테퍼 스캐너(stepper scanner)(220)는 마스크/레티클(210)의 패턴을 웨이퍼(230)에 조성되는 다수의 집적회로 중 하나에 향하게 한다.
도3은 확산 영역 위에 2개의 게이트를 갖는 설계 레이아웃을 도시하고 있다. 도3의 레이아웃은 여기서 본 발명을 설명하는데 사용된다. 그러나, 본 발명의 유용성은 도3의 설계로 제한되지는 않는다.
확산 영역(310)은, 예를 들면, 트랜지스터에 대한 콜렉터 및 이미터를 제공하는데 사용될 수 있다. 확산 영역(310)은 이 기술분야에서 주지된 어떠한 방식으로도 제공될 수 있다. 예를 들면, 이온 주입에 의해 확산 영역(310)이 제공될 수 있다.
금속(또는 폴리실리콘) 영역(300)은 구성요소들 사이에 전도성을 제공한다. 예를 들면, 금속 영역(300)은 확산 영역(310)을 가로지르는 2개의 게이트와, 이 2개의 게이트와 다른 장치(도3에 미도시)와의 접속을 제공한다. 금속 영역(300)은, 예를 들면, 알루미늄, 구리 등으로 이루어질 수 있다.
도4는 본 발명의 일실시예에 따른 위상 시프트 및 트림 마스크 생성에 사용되는 라인 세그먼트 표시가 포함된 도3의 설계 레이아웃을 도시하고 있다. 일실시예에서, 위상 시프트 마스크의 영역을 정의하기 위해 라인 세그먼트가 사용된다. 대안의 실시예에서는, 위상 시프트 마스크를 정의하기 위해 라인 세그먼트로부터 오프셋(offset)이 사용된다.
라인 세그먼트(405, 445)는 확산 영역(310)의 끝단을 넘는다. 라인 세그먼트(400, 430)는 금속 영역(300)의 게이트의 중심에 대응된다. 라인 세그먼트(415, 410, 435, 440)는 각각의 엔드 라인 세그먼트(즉, 405, 445)와 게이트 라인 세그먼트(즉, 400, 430)를 연결한다. 라인 세그먼트(420, 425)는 게이트 라인 세그먼트를 연결한다. 대안의 실시예에서, 게이트 라인 세그먼트는 금속 영역(300)의 게이트에 중심이 맞춰지지 않을 수 있다.
일실시예에서, 도4의 라인 세그먼트는 확산 영역(310)의 경계로부터 소정 양만큼 오프셋된다. 일실시예에서, 그 오프셋은보다 크며, 여기서,는 빛의 파장이고,는 사용된 개구수(numerical aperture)이다. 따라서, 오프셋은 게이트의 폭보다 크다. 도4의 라인 세그먼트는, 보다 상세히 후술되는 바와 같이, 확산 영역(310) 위에 제조되는 위상 시프트 영역의 치수를 나타낸다. 확산 영역(310)에 기반하여 위상 시프트 영역을 정의함으로써, 위상 시프트 마스크가 게이트 또는 위상 시프트 기술을 이용하여 생성되는 다른 영역에 기반하여 정의되는 것보다 쉽게 정의될 수 있다.
도5는 본 발명의 일실시예에 따른 도3의 레이아웃에 대한 위상 시프트 마스크를 도시하고 있다. 도5에 관해 설명된 실시예에서는, 본 발명에 따른 게이트를 생성하기 위한 위상 시프트 마스크를 정의하기 위해 도4에 관해 설명된 라인 세그먼트가 사용된다.
라인 세그먼크(400, 405, 410, 415)는 위상 시프트 마스크의 제1 노출 영역을 정의한다. 라인 세그먼트(430, 435, 440, 445)는 위상 시프트 마스크의 제2 노출 영역을 정의한다. 대안의 실시예에서는, 제1 및 제2 노출 영역을 정의하기 위해 도5의 라인 세그먼트로부터의 오프셋이 사용된다.
라인 세그먼트(400, 405, 410, 415) 및 라인 세그먼트(430, 435, 440, 445)는 위상 시프트 마스크 내의 위상 시프트 영역을 정의한다. 일실시예에서, 라인 세그먼트는 위상이 빛을 180도만큼 시프트하는 영역을 정의하고, 인접한 영역은 빛을시프트하지 않는다. 대안적으로, 라인 세그먼트 외부의 영역은 180도 위상 시프트된 영역일 수 있고, 내부 영역은 0도 위상 시프트된 영역이 될 수 있다.
그 밖의 위상 시프트된 영역 및 위상 시프트되지 않은 영역이 위상 시프팅 마스크에 포함될 수도 있다. 대안의 실시예에서는, 0도 및 180도 이외의 위상 시프트가 사용될 수 있다. 위상 시프트 마스크는 또한 게이트 또는 위상 시프트 기술을 이용하여 생성되는 다른 영역 이외의 금속 층에 부가적인 구조를 제공하는데 사용될 수도 있다.
도6은 본 발명의 일실시예에 따른 도3의 레이아웃에 대한 트림 마스크를 도시한 도면이다. 트리밍 영역은 제조되는 트랜지스터 게이트의 일부분이 아닌 위상 시프트 마스크에 의해 생성되는 아티팩트(artifacts)를 제거한다.
위상 시프트 마스크의 위상 시프트 영역에 대응하는 트리밍 영역은 라인 세그먼트(500, 505, 510, 515) 및 라인 세그먼트(530, 535, 540, 545)에 의해 정의된다. 일실시예에서, 트리밍 영역을 정의하는 라인 세그먼트는 위상 시프트 영역을 정의하는 대응 라인 세그먼트로부터 소정 양만큼 오프셋된다. 또한, 다른 구조적 영역(도6에 미도시)이 트리밍 마스크에 포함될 수도 있다.
도7은 도3의 레이아웃에 기반하여 결과로서 생성된 회로를 도시한 도면이다. 확산 영역(310)은 도3의 레이아웃과 동일한 사이즈이다. 일실시예에서, 확산 영역(310) 위의 2개의 게이트는 도3의 본래의 회로 레이아웃에 비해 축소된 치수를 갖는다. 일실시예에서, 게이트 사이의 커넥션은 축소된 치수를 갖는다. 따라서, 금속 또는 폴리실리콘 영역(700)의 일부 또는 전부가 도3의 회로 레이아웃에 비해 축소된 치수를 갖는다.
도8은 본 발명의 일실시예에 따른 위상 시프트 및 트림 마스크 생성 과정을 도시한 순서도이다. 블록(810)에서, 설계 레이아웃이 생성 및/또는 액세스된다. 설계 레이아웃은, 예를 들면, 제조되는 회로의 GDS-II 기술이 될 수 있다. 다른 레이아웃 형식이 지원될 수도 있다.
블록(810)에서 설계 레이아웃이 액세스된다. 일실시예에서, 설계 레이아웃은 GDS-II 형식의 회로 기술이지만, 다른 형식이 사용될 수도 있다. 설계 레이아웃은 회로 설계를 기술하는데, 이로부터 마스크 및/또는 레티클이 설계되어, 설계 레이아웃에 의해 기술된 회로를 구현하게 된다.
블록(820)에서, 설계 레이아웃에 기반하여 위상 할당이 이루어진다. 일실시예에서, 사용된 집적회로 제조 공정의 최소 실현가능 치수보다 작은 치수를 갖는 게이트 구조를 생성하도록 위상 할당이 이루어진다.
전술된 바와 같이, 위상 할당은, 위상 시프트 처리가 사용되는 층 이외의 회로층에서의 회로 구조에 기반하여 이루어진다. 예를 들면, 게이트 구조를 생성하기 위해 위상 시프트가 사용되는 경우, 게이트 구조에 대한 위상 할당은, 그 위에 게이트 구조가 제조되는, 확산 영역에 기반하여 이루어진다. 위상 시프트 마스크는 위상 할당에 기반하여 생성된다.
블록(830)에서, 트림 마스크가 생성된다. 트림 마스크는 위상 시프트 마스크에 의해 생성된 아티팩트를 제거하는 기능을 한다. 일실시예에서, 트림 마스크는 위상 시프트 마스크와 동일한 회로 구조에 기반한다. 트림 마스크는 또한 여기서기술된 2개의 마스크 위상 시프트 공정을 이용하여 생성된 구조 이외의 구조를 정의할 수도 있다. 예를 들면, 트림 마스크는 위상 편이 마스크 및 트림 마스크를 이용하여 생성된 게이트 영역 사이에 금속 또는 다른 접속 구조를 정의할 수 있다.
블록(840)에서 설계 검증(design verification)이 수행된다. 일실시예에서는, 위상 할당이 이루어진 후에, 설계 검증이 수행된다. 통상적으로, 설계 검증은 설계 규칙 검사 및/또는 전기적 연속성 검사를 포함하는데, 이것을 LVS(layout versus schematic) 검사라고 한다. 일실시예에서, 위상 시프트 마스크의 레이아웃에 의해 생성된 물리적인 게이트 폭은 종래의 설계 검증의 실패를 야기할 수 있기 때문에, 설계 검증의 목적으로 인위적인 게이트 폭이 사용된다. 필요에 따라, 종래의 LVS 검사가 실행되도록, 본래의 레이아웃 토폴로지에 매칭시키기 위해 설계 검증에 기반하여 설계에 대한 수정이 이루어진다. 블록(850)에서, 집적회로를 제조하는데 사용되는 다수의 마스크가 제조된다.
도9는 본 발명의 일실시예에 따른 위상 시프트 및 트림 마스크 생성 과정을 도시한 순서도이다. 도9의 실시예는 위상 할당 전에 설계 검증을 수행한다. 이 실시예에서는, 축소된 게이트 폭이 설계 검증의 실패를 야기하지 않는다.
블록(910)에서, 설계 레이아웃이 액세스된다. 전술된 바와 같이, 레이아웃은 GDS-II 형식이거나 또는 다른 적합한 형식으로 이루어질 수 있다. 블록(920)에서, 설계 검증을 위해 설계 레이아웃이 사용된다. 설계 검증이 본래의 설계 레이아웃에 대해 수행되기 때문에, 전술된 이중-마스크 위상 시프트 제조에 의해 제공된 축소된 치수는 설계 검증의 실패를 야기하지 않는다.
블록(930)에서, 위상 할당이 제공된다. 일실시예에서, 위상 할당은 위상 마스크에 사용되는 층과는 상이한 회로층에서의 회로 구조에 기반하여 수행된다. 블록(940)에서, 전술된 위상 할당에 대응하는 회로층에 대해 트림 마스크가 생성된다. 블록(950)에서, 적합한 마스크가 제조된다.
도10은 본 발명의 일실시예에 따른 시뮬레이션 툴을 포함한 EDA 툴을 도시하고 있다. 도시된 바와 같이, EDA 툴 스위트(100)는 전술된 본 발명의 요지가 포함된 시뮬레이션 툴(1002)을 포함한다. 또한, EDA 툴 스위트(1000)는 다른 툴 모듈(1004)을 포함한다. 다른 툴 모듈(1002)의 예는 통합 모듈, 레이아웃 검증 모듈 등을 포함하지만 이것으로 제한되지는 않는다.
도11은 본 발명을 실시하는데 사용될 수 있는 컴퓨터 시스템의 일실시예를 도시하고 있다. 도시된 바와 같이, 컴퓨터 시스템(1100)은 시스템 버스(1106)를 통해 서로 연결된 메모리(1104) 및 프로세서(1102)를 포함한다. 하드 디스크, 플로피 디스크 등과 같은 비-휘발성 대용량 저장장치(1108), 키보드, 디스플레이 등의 입/출력 장치(1110) 및 모뎀, LAN 인터페이스 등의 통신 인터페이스(1112)가 시스템 버스(1106)에 결합된다. 이들 각각의 구성요소들은 이 기술분야에서 주지된 통상적인 기능을 수행한다.
특히, 시스템 메모리(1104) 및 비-휘발성 대용량 저장장치(1108)는 전술된 본 발명의 요지를 구현하는 프로그래밍 명령어의 실행 카피 및 영구 카피를 저장하는데 사용된다. 또한, 시스템 메모리(1104) 및 비-휘발성 대용량 저장장치(1108)는 IC 설계를 저장하는데 사용될 수도 있다. 본 발명을 실시하기 위한 프로그래밍 명령어의 영구 카피는, 분배 소스/매체(1114) 및 선택적으로, 통신 인터페이스(1112)를 이용하여, 공장 또는 필드에서 비-휘발성 대용량 저장장치(1108)에 로딩될 수 있다. 분배 매체(1114)의 예는 테이프, CDROM, DVD 등과 같은 기록가능 매체를 포함한다. 일실시예에서, 프로그래밍 명령어는 도10의 EDA 툴(1000)을 구현하는 프로그래밍 명령어의 집합의 일부이다. 구성요소들(1102-1114)의 구성은 주지되어 있으므로, 더이상 설명되지는 않는다.
이상의 상세한 설명에서, 본 발명은 특정한 실시예를 참조하여 설명되었다. 그러나, 본 발명의 보다 넓은 사상 및 범위를 벗어나지 않는 한, 다양한 수정 및 변경이 이루어질 수 있다는 것이 명백할 것이다. 따라서, 상기의 명세서 및 도면은 제한적이라기 보다는 예시적인 의미로 간주되어야 한다.

Claims (24)

  1. 집적회로를 위한 마스크 세트를 생성하는 방법에 있어서,
    상기 집적회로의 제1 층에서 제1 영역을 정의하기 위해 제1 마스크를 생성하는 단계 - 여기서, 상기 제1 영역은 적어도 부분적으로 상기 집적회로의 제2 층에서의 영역에 기반함 - ; 및
    상기 집적회로의 상기 제1 층에서 제2 영역을 정의하기 위해 제2 마스크를 생성하는 단계 - 여기서, 상기 제2 영역은 적어도 부분적으로 상기 집적회로의 제2 층에서의 상기 영역에 기반하고, 상기 제2 마스크는 또한 상기 제1 마스크에 의해 생성되는 아티팩트(artifacts)를 제거함 -
    를 포함하는 방법.
  2. 제1항에 있어서,
    상기 제1 영역은 파괴적 광 간섭(destructive light interference)에 의해 생성되는
    방법.
  3. 제1항에 있어서,
    상기 제1 마스크는 상기 제1 영역을 정의하기 위한 위상 시프트 엘리먼트를 포함하는
    방법.
  4. 제1항에 있어서,
    상기 제2 마스크는 상기 제1 집적회로층에서 부가의 구조적 엘리먼트를 더 정의하는
    방법.
  5. 제1항에 있어서,
    상기 집적회로의 제2 층에서의 상기 영역은 확산 영역인
    방법.
  6. 제1항에 있어서,
    상기 제2 마스크는 위상 시프트 엘리먼트를 포함하지 않는
    방법.
  7. 제1항에 있어서,
    상기 제1 마스크 및 제2 마스크는 트랜지스터 게이트를 정의하는
    방법.
  8. 제1항에 있어서,
    상기 제2 마스크는 본래의 집적회로 레이아웃의 토폴로지를 유지하는
    방법.
  9. 집적회로 제조를 위한 마스크 세트를 생성하기 위한 장치에 있어서,
    상기 집적회로의 제1 층에서 제1 영역을 정의하기 위해 제1 마스크를 생성하기 위한 수단 - 여기서, 상기 제1 영역은 적어도 부분적으로 상기 집적회로의 제2 층에서의 영역에 기반함 - ; 및
    상기 집적회로의 상기 제1 층에서 제2 영역을 정의하기 위해 제2 마스크를 생성하기 위한 수단 - 여기서, 상기 제2 영역은 적어도 부분적으로 상기 집적회로의 제2 층에서의 상기 영역에 기반하고, 상기 제2 마스크는 또한 상기 제1 마스크에 의해 생성되는 아티팩트를 제거함 -
    을 포함하는 장치.
  10. 제9항에 있어서,
    상기 제1 영역은 파괴적 광 간섭에 의해 생성되는
    장치.
  11. 제9항에 있어서,
    상기 제1 마스크는 상기 제1 영역을 정의하기 위한 위상 시프트 수단을 포함하는
    장치.
  12. 제9항에 있어서,
    상기 제2 마스크는 상기 제1 집적회로층에서 부가의 구조적 엘리먼트를 더 정의하는
    장치.
  13. 제9항에 있어서,
    상기 집적회로의 제2 층에서의 상기 영역은 확산 영역인
    장치.
  14. 제9항에 있어서,
    상기 제2 마스크는 위상 시프트 엘리먼트를 포함하지 않는
    장치.
  15. 제9항에 있어서,
    상기 제1 마스크 및 제2 마스크는 트랜지스터 게이트를 정의하는
    장치.
  16. 제9항에 있어서,
    상기 제2 마스크는 본래의 집적회로 레이아웃의 토폴로지를 유지하는
    장치.
  17. 일련의 명령어가 저장된 머신-판독가능 매체에 있어서,
    상기 명령어는 하나 또는 그 이상의 프로세서에 의해 실행되면 전기 장치로하여금,
    집적회로의 제1 층에서 제1 영역을 정의하는 제1 마스크 정의를 생성하고 - 상기 제1 영역은 적어도 부분적으로 상기 집적회로의 제2 층에서의 영역에 기반함 -,
    상기 집적회로의 상기 제1 층에서 제2 영역을 정의하는 제2 마스크 정의를 생성하도록 야기하는 - 여기서, 상기 제2 영역은 적어도 부분적으로 상기 집적회로의 제2 층에서의 상기 영역에 기반하고, 상기 제2 마스크는 또한 상기 제1 마스크에 의해 생성되는 아티팩트를 제거함 -
    머신-판독가능 매체.
  18. 제17항에 있어서,
    상기 제1 영역은 파괴적 광 간섭에 의해 생성되는
    머신-판독가능 매체.
  19. 제17항에 있어서,
    상기 제1 마스크는 상기 제1 영역을 정의하기 위한 위상 시프트 엘리먼트를 포함하는
    머신-판독가능 매체.
  20. 제17항에 있어서,
    상기 제2 마스크는 상기 제1 집적회로층에서 부가의 구조적 엘리먼트를 더 정의하는
    머신-판독가능 매체.
  21. 제17항에 있어서,
    상기 집적회로의 제2 층에서의 상기 영역은 확산 영역인
    머신-판독가능 매체.
  22. 제17항에 있어서,
    상기 제2 마스크는 위상 시프트 엘리먼트를 포함하지 않는
    머신-판독가능 매체.
  23. 제17항에 있어서,
    상기 제1 마스크 및 제2 마스크는 트랜지스터 게이트를 정의하는
    머신-판독가능 매체.
  24. 제17항에 있어서,
    상기 제2 마스크는 본래의 집적회로 레이아웃의 토폴로지를 유지하는
    머신-판독가능 매체.
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