KR20020009214A - 반도체 소자의 게이트 스택 형성 방법 - Google Patents

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안재영
강만석
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윤종용
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Abstract

본 발명의 반도체 소자의 게이트 스택 형성 방법은, 반도체 기판 위에 게이트 절연막을 형성하는 단계와, 이 게이트 절연막 위에 폴리실리콘막 및 금속 실리사이드층을 포함하는 게이트 스택을 형성하는 단계와, 이 게이트 스택을 덮는 화학 기상 증착 산화막을 형성하는 단계, 및 열산화 공정을 수행하여 화학 기상 증착 산화막 내부에서 폴리실리콘막 및 금속 실리사이드층의 측벽을 덮는 산화막을 형성하는 단계를 포함한다.

Description

반도체 소자의 게이트 스택 형성 방법{Method for forming gate stack in semiconductor device}
본 발명은 반도체 소자의 제조 방법에 관한 것으로서, 보다 상세하게는 반도체 소자의 게이트 스택 형성 방법에 관한 것이다.
도 1 내지 도 3은 종래의 반도체 소자의 게이트 스택 형성 방법을 설명하기 위하여 나타내 보인 단면도들이다.
먼저 도 1을 참조하면, 반도체 기판(100) 위에 게이트 절연막, 예컨대 게이트 산화막(110)을 형성한다. 이어서 게이트 산화막(110) 위에 폴리실리콘막(120), 텅스텐 실리사이드층(130), 실리콘 나이트라이드막(140) 및 제1 실리콘 산화막(150)을 순차적으로 형성한다. 다음에 통상의 리소그라피법을 사용한 노광및 현상을 수행하여, 제1 실리콘 산화막(150) 위에 포토레지스트막 패턴(PR)을 형성한다.
다음에 도 2를 참조하면, 상기 포토레지스트막 패턴(PR)을 식각 마스크로 하여 식각 공정을 수행하여 제1 실리콘 산화막(150), 실리콘 나이트라이드막(140), 텅스텐 실리사이드층(130) 및 폴리실리콘막(120)의 일부를 순차적으로 식각하여 게이트 스택(160)을 형성한다. 상기 게이트 스택(160)을 형성한 후에 상기 포토레지스트막 패턴(PR)을 제거한다.
다음에 도 3을 참조하면, 산화 공정을 수행하여 상기 폴리실리콘막(120) 및 텅스텐 실리사이드층(130)의 측벽을 덮도록 절연막으로서의 제2 실리콘 산화막(170)을 형성한다.
그런데 상기 제2 실리콘 산화막(170)을 형성하기 위한 열산화 공정시에 폴리실리콘막(120) 내의 실리콘(Si)이 상부의 텅스텐 실리사이드층(130)으로 확산하며, 이에 따라 텅스텐 실리사이드층(130)과 폴리실리콘막(120) 사이의 계면 부분에 보이드(void)(도 3의 180)가 발생되는 문제가 발생한다. 즉 산화 공정 온도 혹은 텅스텐 실리사이드층(130)의 증착 조건 등에 의해 산화 속도가 빠르게 되는 경우, 폴리실리콘막(120) 내의 실리콘이 상부의 텅스텐 실리사이드층(130)으로 확산하는 속도 증가에 의해, 폴리실리콘막(120)과 텅스텐 실리사이드층(130)의 계면에서 단위 면적당 및 단위 시간당 폴리실리콘막(120)으로부터 빠져나가는 실리콘 원자의 양이 폴리실리콘막(120)으로 공급되는 실리콘 원자의 양보다 많아진다. 이 경우 폴리실리콘막(120) 및 텅스텐 실리사이드층(130)의 계면이 이동하여 상기 보이드(180)가형성되지 않을 수도 있다. 그러나 결함이 존재하거나 입자 경계나 계면에서는 과잉 공백(excess vacancy)에 의한 핵 생성과 성장 과정을 거쳐 상기 보이드(180)가 발생된다. 상기 보이드(180)가 발생하게 되면 소자의 동작 불량 및 신뢰도 저하의 문제가 발생된다.
본 발명이 이루고자 하는 기술적 과제는 보이드를 발생시키지 않고 게이트 스택을 형성하기 위한 반도체 소자의 게이트 스택 형성 방법을 제공하는 것이다.
도 1 내지 도 3은 종래의 반도체 소자의 게이트 스택 형성 방법을 설명하기 위하여 나타내 보인 단면도들이다.
도 4 내지 도 7은 본 발명에 따른 반도체 소자의 게이트 스택 형성 방법을 설명하기 위하여 나타내 보인 단면도들이다.
상기 기술적 과제를 달성하기 위하여, 본 발명에 따른 반도체 소자의 게이트 스택 형성 방법은, 반도체 기판 위에 게이트 절연막을 형성하는 단계; 상기 게이트 절연막 위에 폴리실리콘막 및 금속 실리사이드층을 포함하는 게이트 스택을 형성하는 단계; 상기 게이트 스택을 덮는 화학 기상 증착 산화막을 형성하는 단계; 및 열산화 공정을 수행하여 상기 화학 기상 증착 산화막 내부에서 상기 폴리실리콘막 및 금속 실리사이드층의 측벽을 덮는 산화막을 형성하는 단계를 포함하는 것을 특징으로 한다.
상기 화학 기상 증착 산화막은 저압 화학 기상 증착법 혹은 상압 화학 기상 증착법을 사용하여 형성하는 것이 바람직하다.
상기 화학 기상 증착 산화막의 두께는 10Å 이상이 되도록 하는 것이 바람직하다.
이하 첨부 도면을 참조하면서 본 발명의 바람직한 실시예를 상세히 설명하기로 한다.
도 4 내지 도 7은 본 발명에 따른 반도체 소자의 게이트 스택 형성 방법을 설명하기 위하여 나타내 보인 단면도들이다.
먼저 도 4를 참조하면, 반도체 기판(400) 위에 게이트 절연막, 예컨대 게이트 산화막(410)을 형성한다. 게이트 산화막(410) 위에는 폴리실리콘막(420)을 형성한다. 폴리실리콘막(420) 위에는 금속 실리사이드층, 예컨대, 텅스텐 실리사이드층(430)을 형성한다. 텅스텐 실리사이드층(430) 위에는 실리콘 나이트라이드막(440)을 형성하고, 실리콘 나이트라이드막(440) 위에는 실리콘 산화막(450)을 형성한다. 다음에 통상의 리소그라피법을 사용한 노광 및 현상을 수행하여, 실리콘 산화막(450) 위에 포토레지스트막 패턴(PR)을 형성한다.
다음에 도 5를 참조하면, 상기 포토레지스트막 패턴(PR)을 식각 마스크로 하여 식각 공정을 수행하여 실리콘 산화막(450), 실리콘 나이트라이드막(440), 텅스텐 실리사이드층(430) 및 폴리실리콘막(420)의 일부를 순차적으로 식각하여 게이트 스택(460)을 형성한다. 상기 게이트 스택(460)을 형성한 후에 상기 포토레지스트막 패턴(PR)을 제거한다. 통상적으로 상기 포토레지스트막 패턴(PR)을 제거한 후에는 세정 공정을 수행한다.
다음에 도 6을 참조하면, 도 5의 구조체 전면에 화학 기상 증착 산화막(470)을 형성한다. 상기 화학 기상 증착 산화막(470)은 저압 화학 기상 증착(LPCVD: Low Pressure CVD) 혹은 상압 화학 기상 증착(APCVD: Atmosphere Pressure CVD)법을 사용하여 대략 10Å 이상의 두께로 형성한다. 상기 화학 기상 증착법에 의해산화막을 형성하는 공정은 소스 가스로부터 공급되는 실리콘 원자의 반응에 의해 반도체 기판 표면에 산화막이 증착되는 것으로서, 폴리실리콘막(420)으로부터의 실리콘 원자의 확산이 일어나지 않는다.
다음에 도 7을 참조하면, 열산화 공정을 수행하여 상기 화학 기상 증착 산화막(470) 내부에서 상기 폴리실리콘막(420) 및 텅스텐 실리사이드층(430)의 측벽을 덮는 산화막(480)을 형성한다. 상기 열산화 공정은 대략 700-1000℃의 온도에서 O2/N2/H2O/NO/N2O의 조합으로 상압 혹은 그 이하 압력에서 진행한다. 그러면 화학 기상 증착 산화막(470)과 폴리실리콘막(420) 사이의 계면 및 화학 기상 증착 산화막(470)과 텅스텐 실리사이드층(430) 사이의 계면에 대략 100Å 이하의 얇은 열적 산화막(480)이 형성된다.
이상의 설명에서와 같이, 본 발명에 따른 반도체 소자의 게이트 스택 형성 방법은 게이트 스택 형성 후에 화학 기상 증착 산화막을 형성하고, 이어서 열적 산화막을 형성함으로써 게이트 스택을 구성하는 폴리실리콘막과 금속 실리사이드층 사이의 계면에 보이드가 발생되지 않으며, 이에 따라 소자의 신뢰도를 향상시킬 수 있다는 이점이 있다.

Claims (3)

  1. 반도체 기판 위에 게이트 절연막을 형성하는 단계;
    상기 게이트 절연막 위에 폴리실리콘막 및 금속 실리사이드층을 포함하는 게이트 스택을 형성하는 단계;
    상기 게이트 스택을 덮는 화학 기상 증착 산화막을 형성하는 단계; 및
    열산화 공정을 수행하여 상기 화학 기상 증착 산화막 내부에서 상기 폴리실리콘막 및 금속 실리사이드층의 측벽을 덮는 산화막을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 게이트 스택 형성 방법.
  2. 제1항에 있어서,
    상기 화학 기상 증착 산화막은 저압 화학 기상 증착법 혹은 상압 화학 기상 증착법을 사용하여 형성하는 것을 특징으로 하는 반도체 소자의 게이트 스택 형성 방법.
  3. 제1항에 있어서,
    상기 화학 기상 증착 산화막의 두께가 10Å 이상이 되도록 하는 것을 특징으로 하는 반도체 소자의 게이트 스택 형성 방법.
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