KR100870616B1 - 트랜치 절연 영역 형성 방법 - Google Patents
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- 반도체 기판 상부에 마스크 물질을 형성하는 단계로서, 상기 마스크 물질은 보론 및 질소 중 하나 이상의 물질을 포함하는 비결정성 탄소를 포함하는 상기 형성 단계와;상기 마스크 물질을 통해 상기 반도체 기판 내에 개구부를 형성하여, 상기 반도체 기판의 반도체 물질 내에 절연 트랜치를 형성하는 단계와;상기 절연 트랜치 내부 및 상기 절연 트랜치 외부의 상기 마스크 물질의 상부에 트랜치 절연 물질을 형성하여 상기 절연 트랜치를 채우는 단계와;상기 비결정성 탄소를 포함하는 마스크 물질의 가장 바깥쪽 표면까지 상기 트랜치 절연 물질을 연마하는 단계와; 그리고상기 반도체 기판으로부터 상기 비결정성 탄소를 식각하는 단계를 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
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- 반도체 기판 상부에 마스크 물질을 형성하는 단계로서, 상기 마스크 물질은 텅스텐, 질화 티타늄 및 비결정성 탄소 중 하나 이상의 물질을 포함하는 상기 형성 단계와;상기 마스크 물질을 통해 상기 반도체 기판 내에 개구부를 형성하여, 상기 반도체 기판의 반도체 물질 내에 절연 트랜치를 형성하는 단계와;상기 절연 트랜치 내부 및 상기 절연 트랜치 외부의 상기 마스크 물질의 상부에 트랜치 절연 물질을 형성하여 상기 절연 트랜치를 채우는 단계와;상기 마스크 물질의 텅스텐, 질화 티타늄 및 비결정성 탄소 중 하나 이상의 물질의 가장 바깥쪽 표면까지 상기 트랜치 절연 물질을 연마하는 단계와; 그리고상기 연마 단계 이후에, 상기 반도체 기판으로부터 남아있는 모든 상기 마스크 물질들을 식각하는 단계를 포함하고,상기 마스크 물질은 질화 규소를 포함하지 않는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
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- 반도체 기판 상부에 마스크 물질을 형성하는 단계로서, 상기 마스크 물질은 보론 및 질소 중 하나 이상의 물질을 포함하는 비결정성 탄소를 포함하는 상기 형성 단계와;상기 마스크 물질을 통해 상기 반도체 기판 내에 개구부를 형성하여, 상기 반도체 기판의 반도체 물질 내에 절연 트랜치를 형성하는 단계와;상기 절연 트랜치 내부 및 상기 절연 트랜치 외부의 상기 마스크 물질의 상부에 트랜치 절연 물질을 형성하여 상기 절연 트랜치를 채우는 단계로서, 상기 트랜치 절연 물질은 그 상부에 형성된 질화 규소 이외에 하나 이상의 물질을 가지는 질화 규소-포함 막(silicon nitride-comprising layer)를 포함하는 상기 단계;상기 마스크 물질의 비결정성 탄소의 가장 바깥쪽 표면까지 상기 트랜치 절연 물질을 연마하는 단계와; 그리고상기 질화 규소-포함 막에 대하여 선택적으로, 상기 반도체 기판으로부터 상기 마스크 물질의 비결정성 탄소를 에칭하는 단계를 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
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- 반도체 기판 상부에 마스크 물질을 형성하는 단계로서, 상기 마스크 물질은 텅스텐, 질화 티타늄 및 비결정성 탄소 중 하나 이상의 물질을 포함하는 상기 형성 단계와;상기 마스크 물질을 통해 상기 반도체 기판 내에 개구부를 형성하여, 상기 반도체 기판의 반도체 물질 내에 절연 트랜치를 형성하는 단계와;상기 절연 트랜치를 채우기 위해서, 상기 절연 트랜치 내부 및 상기 절연 트랜치 외부의 상기 마스크 물질의 상부에 트랜치 절연 물질을 형성하는 단계 - 상기 트랜치 절연 물질은 질화 규소 이외의 하나 이상의 물질이 그 상부에 형성된 질화 규소-포함 막(silicon nitride-comprising layer)을 포함 -;상기 마스크 물질의 텅스텐, 질화 티타늄 및 비결정성 탄소 중 하나 이상의 물질의 가장 바깥쪽 표면까지 상기 트랜치 절연 물질을 연마하는 단계와; 그리고상기 연마하는 단계 후에, 상기 질화 규소-포함 막에 대하여 선택적으로, 상기 반도체 기판으로부터 텅스텐, 질화 티타늄 및 비결정성 탄소 중 하나 이상 물질을 식각하고, 상기 반도체 기판으로부터 상기 마스크 물질의 모든 잔존물을 에칭하는 단계를 포함하고,상기 마스크 물질은 질화 규소를 포함하지 않는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
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- 반도체 기판 상부에 마스크 물질을 형성하는 단계와;상기 마스크 물질을 통해 상기 반도체 기판 내에 개구부를 형성하여 상기 반도체 기판의 반도체 물질 내부에 절연 트랜치를 형성하는 단계와;상기 절연 트랜치 및 상기 마스크 물질의 상부에 질화 규소-포함 막을 증착하여 상기 절연 트랜치를 라이닝하는 단계와;상기 절연 트랜치 내부 및 상기 절연 트랜치 외부의 마스크 물질의 상부에 상기 질화 규소-포함 막 상부에 트랜치 절연 물질을 증착하는 단계와;상기 트랜치 절연 물질 및 상기 질화 규소-포함 막을 상기 마스크 물질까지 연마하는 단계와; 그리고상기 반도체 기판의 반도체 물질로부터 바깥쪽으로 돌출된 상기 질화 규소-포함 막의 일 부분을 남기기 위해서, 상기 질화 규소-포함 막에 대하여, 상기 반도체 기판의 반도체 물질 바깥쪽으로부터 상기 마스크 물질 및 상기 트랜치 절연 물질을 제거하는 단계 - 상기 제거 단계 후 상기 질화 규소-포함 막의 일 부분은 상기 제거 단계 후 상기 트랜치 절연 물질의 높이상 가장 바깥쪽 표면의 바깥쪽을 수용하는 높이상 가장 바깥쪽 표면을 가짐 -;를 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 43 항에 있어서,상기 마스크 물질은 질화 규소를 포함하지 않는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 43항에 있어서,상기 마스크 물질은 폴리실리콘, 텅스텐, 질화 티타늄 및 비결정성 탄소 중 하나 이상의 물질을 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 45 항에 있어서,상기 마스크 물질은 폴리 실리콘을 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 45 항에 있어서,상기 마스크 물질은 텅스텐을 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 45 항에 있어서,상기 마스크 물질은 질화 티타늄을 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 45 항에 있어서,상기 마스크 물질은 비결정성 탄소를 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 49 항에 있어서,상기 비결정성 탄소를 포함하는 막은 보론 및 질소 중 하나 이상의 물질을 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 49 항에 있어서,상기 비결정성 탄소를 포함하는 막은 가시광선에 대하여 투명한 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 45 항에 있어서,상기 마스크 물질은 폴리 실리콘, 텅스텐, 질화 티타늄 및 비결정성 탄소 중 둘 이상의 물질을 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
- 제 52 항에 있어서,상기 마스크 물질은 비결정성 탄소를 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
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- 제43항에 있어서,상기 제거 단계 후에, 상기 트랜치 절연 물질의 높이상 가장 바깥쪽 표면은 상기 반도체 기판의 상기 반도체 물질과 높이가 일치하는 트랜치 절연 영역 형성 방법.
- 제43항에 있어서,상기 트랜치 절연 물질은 이산화 규소를 포함하고, 상기 마스크 물질은 폴리 실리콘을 포함하며, 상기 제거하는 단계는 H2O 및 HF를 포함하는 용액에 상기 반도체 기판을 노출하는 단계를 포함하는 트랜치 절연 영역 형성 방법.
- 제57항에 있어서,H2O 및 HF를 포함하는 용액에 상기 반도체 기판을 노출한 후에, 상기 반도체 기판을 TMAH(Tetramethylammonium hydroxide)를 포함하는 용액에 노출시키는 단계를 더 포함하는 트랜치 절연 영역 형성 방법.
- 반도체 기판 상부에 마스크 물질을 형성하는 단계와;상기 마스크 물질을 통해 상기 반도체 기판 내에 개구부를 형성하여 상기 반도체 기판의 반도체 물질 내부에 절연 트랜치를 형성하는 단계와;상기 절연 트랜치 및 상기 마스크 물질의 상부에 질화 규소-포함 막을 증착하여 상기 절연 트랜치를 라이닝하는 단계와;상기 절연 트랜치 내 상기 질화 규소-포함 막 상부에 트랜치 절연 물질을 증착하는 단계와; 그리고상기 반도체 기판의 반도체 물질로부터 바깥쪽으로 돌출된 상기 질화 규소-포함 막의 일 부분을 남기기 위해서, 상기 질화 규소-포함 막에 대하여, 상기 반도체 기판의 반도체 물질 바깥쪽으로부터 상기 마스크 물질 및 상기 트랜치 절연 물질을 제거하는 단계 - 상기 제거 단계 후 상기 질화 규소-포함 막의 일 부분은, 상기 제거 단계 후 상기 트랜치 절연 물질의 높이상 가장 바깥쪽 표면의 바깥쪽을 수용하는 높이상 가장 바깥쪽 표면을 가짐 -;를 포함하는 것을 특징으로 하는 트랜치 절연 영역 형성 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US10/817,029 | 2004-04-01 | ||
US10/817,029 US7015113B2 (en) | 2004-04-01 | 2004-04-01 | Methods of forming trench isolation regions |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20060130680A KR20060130680A (ko) | 2006-12-19 |
KR100870616B1 true KR100870616B1 (ko) | 2008-11-25 |
Family
ID=34964282
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020067019876A KR100870616B1 (ko) | 2004-04-01 | 2005-03-25 | 트랜치 절연 영역 형성 방법 |
Country Status (7)
Country | Link |
---|---|
US (3) | US7015113B2 (ko) |
EP (1) | EP1738403A1 (ko) |
JP (1) | JP2007531324A (ko) |
KR (1) | KR100870616B1 (ko) |
CN (1) | CN1938831B (ko) |
SG (2) | SG148896A1 (ko) |
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- 2004-04-01 US US10/817,029 patent/US7015113B2/en not_active Expired - Lifetime
-
2005
- 2005-03-25 KR KR1020067019876A patent/KR100870616B1/ko active IP Right Grant
- 2005-03-25 SG SG200704899-4A patent/SG148896A1/en unknown
- 2005-03-25 EP EP05731310A patent/EP1738403A1/en not_active Withdrawn
- 2005-03-25 JP JP2007506404A patent/JP2007531324A/ja active Pending
- 2005-03-25 CN CN2005800104955A patent/CN1938831B/zh active Active
- 2005-03-25 WO PCT/US2005/010197 patent/WO2005098923A1/en not_active Application Discontinuation
- 2005-03-25 SG SG200704900-0A patent/SG148897A1/en unknown
- 2005-08-22 US US11/208,965 patent/US7402498B2/en active Active
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---|---|
KR20060130680A (ko) | 2006-12-19 |
US20060003543A1 (en) | 2006-01-05 |
CN1938831B (zh) | 2011-01-12 |
US20060003544A1 (en) | 2006-01-05 |
JP2007531324A (ja) | 2007-11-01 |
US7279396B2 (en) | 2007-10-09 |
US7015113B2 (en) | 2006-03-21 |
US7402498B2 (en) | 2008-07-22 |
SG148896A1 (en) | 2009-01-29 |
CN1938831A (zh) | 2007-03-28 |
WO2005098923A1 (en) | 2005-10-20 |
EP1738403A1 (en) | 2007-01-03 |
SG148897A1 (en) | 2009-01-29 |
US20050227450A1 (en) | 2005-10-13 |
WO2005098923A8 (en) | 2006-12-07 |
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Date | Code | Title | Description |
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A201 | Request for examination | ||
AMND | Amendment | ||
E902 | Notification of reason for refusal | ||
AMND | Amendment | ||
E601 | Decision to refuse application | ||
AMND | Amendment | ||
J201 | Request for trial against refusal decision | ||
B701 | Decision to grant | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
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|
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|
FPAY | Annual fee payment |
Payment date: 20151016 Year of fee payment: 8 |
|
FPAY | Annual fee payment |
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|
FPAY | Annual fee payment |
Payment date: 20171018 Year of fee payment: 10 |
|
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|
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