KR20000027877A - 칩 스케일 반도체 패키지 및 그 제조 방법 - Google Patents

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Abstract

본 발명은 탭필름 마스크를 이용하여 경박단소화됨과 더불어 신뢰성이 높은 새로운 타입의 칩 스케일 반도체 패키지를 제공하도록 한 것이다.
이를 위해, 본 발명은 일면에 복수개의 본딩패드(10)가 형성된 반도체칩(1)과, 상기 반도체칩(1) 상면에 부착되며 상기 반도체칩(1)의 각 본딩패드(10) 위치에 대응하는 복수개의 인너홀(20)과 상기 각 인너홀(20)로부터 일정간격 이격된 위치에 형성되는 아우터홀(21)이 구비되는 탭필름 마스크(2)와, 상기 인너홀(20) 내에 도팅되어 본딩패드(10)와 접속되는 인너 솔더(3)와, 상기 아우터홀(21) 내에 도팅되어 반도체칩(1) 표면에 접속되는 아우터 솔더(4)와, 상기 인너홀(20) 내의 인너 솔더(3)와 아우터홀(21) 내의 아우터 솔더(4)를 전기적으로 연결하도록 탭필름 마스크(2) 내에 형성되는 신호선(22)이 구비됨을 특징으로 하는 칩 스케일 반도체 패키지가 제공된다.

Description

칩 스케일 반도체 패키지 및 그 제조 방법
본 발명은 칩 스케일 반도체 패키지(CSP:Chip Scale Package) 및 그 제조방법에 관한 것으로서, 더욱 상세하게는 탭필름 마스크를 이용한 새로운 타입의 칩 스케일 반도체 패키지에 관한 것이다.
일반적으로, 반도체소자는 집적회로가 형성된 웨이퍼를 낱개의 칩으로 각각 분리한 후, 이것을 플라스틱 패키지나 세라믹 패키지에 탑재하여 기판에의 실장이 용이하도록 조립하는 공정을 거치게 된다.
이와 같은, 반도체소자에 대한 조립공정의 주목적은 기판이나 소켓에 실장하기 위한 형상의 확보와 기능보호에 있다고 할 수 있다.
또한, 최근에는 집적회로의 고집적화에 따라 다핀화, 미세조립기술, 또 실장형태의 다양화에 따른 패키지의 다종류화 등, 조립공정과 관련된 기술도 각각 세분된 분야에 따라 크게 변화하고 있다.
반도체 조립공정의 개요에 대해 현재 가장 많이 사용되고 있는 플라스틱 DIP(Dual Inline Package) 타입의 반도체소자를 도 1을 참조하여 예로 들어 설명하면 다음과 같다.
먼저, 전기적 회로가 형성된 웨이퍼를 각각의 단일칩으로 분리하는데, 이때 Si(실리콘)는 모스경도 7로서 딱딱하고 깨지기 쉬운 성질을 갖고 있으므로 웨이퍼의 제조시 미리 분리할 라인에 절단하기 위한 물질을 넣어두고 이 분리라인을 따라 브레이크 응력을 가해 파괴, 분리시키는 방법을 취하는 경우가 많다.
또한, 분리된 각각의 반도체칩(1a)은 리드프레임의 칩부착부(8)에 본딩되고, 이때의 접합방법은 Au-Si 공정(共晶)법, 납땜법, 수지접착법 등이 있으며 용도에 따라 알맞은 방법이 선택되어 사용된다.
한편, 전술한 바와같이 반도체칩(1a)을 리드프레임의 칩부착부(8)에 접착하는 목적은 조립이 완료된 후 기판에 실장시키기 위해서 뿐만 아니라 전기적 입출력단자나 어스(earth)를 겸하는일도 있으며 소자의 동작시 발생하는 열의 방열통로로서도 필요로하는 경우가 있기 때문이다.
상기와 같이 반도체칩을 본딩한 후에는 칩과 리드프레임의 인너리드부를 와이어(9)로 본딩하므로써 연결하게 되며, 와이어 본딩의 방법으로 플라스틱 봉함 패키지에서는 일반적으로 골드와이어를 사용한 열압착법 또는 열압착법과 초음파법을 혼용한 방법이 주로 이용되고 있다.
또한, 와이어 본딩에 의해 칩과 인너리드가 전기적으로 연결된 후에는 칩을 고순도의 에폭시 수지를 사용하여 성형 봉합하는 몰딩공정이 수행되는데, 이때 사용되는 에폭시 수지는 집적회로의 신뢰성을 좌우하는 중요한 요소이며, 수지의 고순도화와 몰딩시 집적회로에 주어지는 응력을 저감시키기 위한 저응력화 등의 개선이 추진되고 있다.
그리고, 상기한 공정이 완료된 후에는 IC 패키지를 소켓이나 기판에 실장하기 위해 아웃리드(out lead)를 형상으로 절단하고 성형하는 공정이 행해지며, 아웃리드부에는 실장접합성(납땜성)을 향상시키기 위해 도금이나 납딥(dip)이 처리된다.
한편, 반도체 패키지는 실장형태 및 리드형태에 따라 여러 가지 유형의 패키지가 있으며, 대표적인 예로서는 전술한 DIP(Dual Inline Package)외에 QFP(Quad Flat Package), TSOP ; Thin Small Outline Package), BGA 패키지( Ball Grid Array package) 등이 있으며, 계속 다(多)핀(pin)화 또는 경박단소화 되고 있다.
상기한 패키지 타입중, BGA 패키지(Ball Grid Array package)는 반도체칩이 부착된 기판의 이면에 구형의 솔더볼을 소정의 상태로 배열(Array)하여 아우터 리드(outer lead) 대신으로 사용하게 되며, 상기 볼 그리드 어레이 패키지는 패키지 몸체(Package Body) 면적을 QFP(Quad Flat Package) 타입보다 작게 할 수 있으며, QFP와는 달리 리드의 변형이 없는 장점이 있다.
한편, 이와 같은 패키지들은 실장면적, 전기적 신뢰성, 제조공정등에 있어 제각기 문제점을 갖고 있으며, 이를 해소하기 위해 새로운 타입의 반도체 패키지가 계속적으로 연구 개발되고 있는 실정이다.
본 발명은 상기한 제반 문제점을 해결하기 위한 것으로서, 탭필름 마스크(TAB film mask)를 이용하여 경박단소화됨과 더불어 신뢰성이 높은 새로운 타입의 칩 스케일 반도체 패키지를 제공하는데 그 목적이 있다.
도 1은 종래 반도체 패키지의 일예를 나타낸 종단면도
도 2a 내지 도 2d는 본 발명의 반도체 패키지 제조과정을 나타낸 것으로서,
도 2a는 본 발명의 반도체 패키지 제조를 위한 반도체칩을 나타낸 평면도
도 2b는 본 발명의 반도체 패키지 제조를 위한 탭필름 마스크를 나타낸 평면도
도 2c는 도 2a의 반도체칩 상면에 탭필름 마스크가 부착되는 과정을 나타낸 평면시도
도 2d는 도 2c의 아우터 홀 및 인너 홀에 고온용융 솔더가 도팅되어 패키지가 완성된 상태를 나타낸 평면도
도 3은 도 2d의 Ⅰ-Ⅰ선을 나타낸 종단면도
도 4a 및 도 4b는 본 발명의 패키지가 인쇄회로기판상에 실장되는 과정을 나타낸 것으로서,
도 4a는 솔더링된 상태를 나타낸 종단면도
도 4b는 봉지된 상태를 나타낸 종단면도
* 도면의 주요부분에 대한 부호의 설명 *
1:반도체칩 10:본딩패드
2:탭필름 마스크 20:인너홀
21:아우터홀 22:신호선
3:인너 솔더 4:아우터 솔더
5:인쇄회로기판 6:봉지제
7:솔더 페이스트
상기한 목적을 달성하기 위해, 본 발명은 일면에 복수개의 본딩패드가 형성된 반도체칩과, 상기 반도체칩 상면에 부착되며 상기 반도체칩의 각 본딩패드 위치에 대응하는 복수개의 인너홀과 상기 각 인너홀로부터 일정간격 이격된 위치에 형성되는 아우터홀이 구비되는 탭필름 마스크와, 상기 인너홀 내에 위치하여 본딩패드와 접속되는 인너 솔더와, 상기 아우터홀 내에 위치하여 반도체칩 표면에 접속되는 아우터 솔더와, 상기 인너홀 내의 인너 솔더와 아우터홀 내의 아우터 솔더를 전기적으로 연결하도록 탭필름 마스크 내에 형성되는 신호선이 구비됨을 특징으로 하는 칩 스케일 반도체 패키지가 제공된다.
상기한 목적을 달성하기 위한 본 발명의 다른 형태에 따르면, 본 발명은 복수개의 본딩패드가 형성된 반도체칩의 본딩패드 형성면 상에 상기 반도체칩의 각 본딩패드 위치에 대응하는 복수개의 인너홀과 상기 각 인너홀로부터 일정간격 이격된 위치에 형성되는 아우터홀이 구비되고 상기 인너홀과 아우터홀을 연결하는 신호선이 내장된 탭필름 마스크를 부착한 다음, 상기 상기 인너홀 및 아우터홀에 고온용용 솔더를 도팅하여서 됨을 특징으로 하는 칩 스케일 반도체 패키지 제조방법이 제공된다.
이하, 본 발명의 일실시예를 첨부도면 도 2a 내지 도 4b를 참조하여 상세히 설명하면 다음과 같다.
도 2d는 본 발명의 반도체 패키지를 나타낸 것으로서, 본 발명은 일면에 복수개의 본딩패드(10)가 형성된 반도체칩(1)과, 상기 반도체칩(1) 상면에 부착되며 상기 반도체칩(1)의 각 본딩패드(10) 위치에 대응하는 복수개의 인너홀(20)과 상기 각 인너홀(20)로부터 일정간격 이격된 위치에 형성되는 아우터홀(21)이 구비되는 탭필름 마스크(2)와, 상기 인너홀(20) 내에 도팅되어 본딩패드(10)와 접속되는 인너 솔더(inner solder)(3)와, 상기 아우터홀(21) 내에 도팅되어 반도체칩(1) 표면에 접속되는 아우터 솔더(outer solder)(4)와, 상기 인너홀(20) 내의 인너 솔더(3)와 아우터홀(21) 내의 아우터 솔더(4)를 전기적으로 연결하도록 탭필름 마스크(2) 내에 형성되는 신호선(22)이 구비된다.
이 때, 상기 인너 솔더(3) 및 아우터 솔더(4)는 고온용융솔더(High melting solder)가 사용되며, 상기 아우터홀(21)은 인너홀(20)에 비해 2배 이상 큰 직경을 갖도록 형성된다.
또한, 상기 아우터홀(21)에 위치하는 고온용융솔더 또한 상기 인너홀(20)의 고온용융솔더(High melting solder)의 직경보다 2배 이상 큰 직경을 갖도록 도팅된다.
이와 같이 구성된 본 발명의 반도체 패키지 제조 과정은 다음과 같다.
도 2a에 나타낸 바와 같이 상면 중앙부에 복수개의 본딩패드(10)가 형성된 반도체칩(1)을 준비하고, 이와 더불어 도 2b에 나타낸 바와 같이 복수개의 인너홀(20)과 상기 각 인너홀(20)로부터 일정간격 이격된 위치에 형성되는 아우터홀(21)이 구비됨과 동시에 상기 인너홀(20)과 아우터홀(21)을 연결하는 신호선(22)이 구비된 탭필름 마스크(2)를 준비한다.
이와 같이 반도체칩(1)과 탭필름 마스크(2)가 준비된 후에는, 도 2c에 나타낸 바와 같이 상기 반도체칩(1) 상면에 형성된 본딩패드(10)와 탭필름 마스크(2)의 인너홀(20)이 일치되도록 정렬시킨 다음 상기 반도체칩(1) 상면에 탭필름 마스크(2)를 부착시키게 된다.
그 후, 상기 탭필름 마스크(2)의 인너홀(20) 및 아우터홀(21)에 고온용융솔더를 각각 도팅하면 반도체 패키지가 완성된다.
이와 같이 완성된 패키지는 인쇄회로기판 상에 실장하게 되는데, 도 4a와 같이 솔더페이스트(7)를 이용하여 회로기판(5) 상부에 솔더링시킨 후, 리플로우 공정을 통과하도록하여 실장하게 된다.
그 다음, 도 4b에 나타낸 바와 같이 반도체칩(1) 하부 영역을 봉지제(6)를 이용하여 봉지(under fill)함에 따라, 반도체 모듈을 구성하게 된다.
인쇄회로기판(5) 상에 실장시, 인너 솔더(3)에 비해 아우터 솔더(4)의 직경이 2배 이상 크므로 인너 솔더(3)는 회로기판(5) 표면과 간섭을 일으키지 않게 된다.
이상에서와 같이, 본 발명은 탭필름 마스크(2)를 이용하여 경박단소화됨과 더불어 신뢰성이 높은 새로운 타입의 칩 스케일 반도체 패키지를 제공가능하게 되므로, 반도체 모듈 제작시 실장밀도를 높일 수 있게 된다.

Claims (5)

  1. 일면에 복수개의 본딩패드가 형성된 반도체칩과,
    상기 반도체칩 상면에 부착되며 상기 반도체칩의 각 본딩패드 위치에 대응하는 복수개의 인너홀과 상기 각 인너홀로부터 일정간격 이격된 위치에 형성되는 아우터홀이 구비되는 탭필름 마스크와,
    상기 인너홀 내에 위치하여 본딩패드와 접속되는 인너 솔더와, 상기 아우터홀 내에 위치하여 반도체칩 표면에 접속되는 아우터 솔더와,
    상기 인너홀 내의 인너 솔더와 아우터홀 내의 아우터 솔더를 전기적으로 연결하도록 탭필름 마스크 내에 형성되는 신호선이 구비됨을 특징으로 하는 칩 스케일 반도체 패키지.
  2. 제 1항에 있어서,
    상기 인너 솔더 및 아우터 솔더가 고온용융솔더(High melting solder)임을 특징으로 하는 칩 스케일 반도체 패키지.
  3. 제 1항에 있어서,
    상기 아우터 솔더가 인쇄회로기판상에 접합된 다음, 반도체칩 하부가 봉지제에 의해 봉지되어 상기 아우터 솔더 및 인너 솔더가 노출되지 않도록 됨을 특징으로 하는 칩 스케일 반도체 패키지.
  4. 복수개의 본딩패드가 형성된 반도체칩의 본딩패드 형성면 상에,
    상기 반도체칩의 각 본딩패드 위치에 대응하는 복수개의 인너홀과 상기 각 인너홀로부터 일정간격 이격된 위치에 형성되는 아우터홀이 구비됨과 더불어 상기 인너홀과 아우터홀을 연결하는 신호선이 내장된 탭필름 마스크를 부착한 다음,
    상기 상기 인너홀 및 아우터홀에 고온용융솔더를 도팅시켜서 상기 인너홀과 아우터홀의 고온용융솔더를 전기적으로 연결시키게 됨을 특징으로 하는 칩 스케일 반도체 패키지 제조방법.
  5. 제 4항에 있어서,
    상기 아우터홀의 고온용융솔더가 인너홀의 고온용융솔더에 비해 2배 이상 큰 직경을 갖도록 도팅됨을 특징으로 하는 칩 스케일 반도체 패키지 제조방법.
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