KR19980701804A - 증폭기 회로 및 증폭기 회로 동조 방법 - Google Patents

증폭기 회로 및 증폭기 회로 동조 방법 Download PDF

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제임스 프랭크 롱
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안쏘니 제이. 살리，주니어
모토롤라, 인크
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Abstract

증폭기 회로는 반송파 증폭기 출력 신호를 발생시키는 반송파 증폭기(24), 반송파 증폭기(24)에 도허티 구성으로 결합된 피킹 증폭기(26), 및 반송파 증폭기(24)와 피킹 증폭기(26)에 응답하는 결합 회로를 포함한다. 피킹 증폭기(26)의 전압은 조정된 혼변조 기생 신호를 발생시키도록 바이어스된다. 조합 회로(35)는 조정된 혼변조 기생 신호를 반송파 증폭기 출력 신호에 결합시켜서 거의 선형화된 증폭기 회로 출력 신호를 발생시킨다.

Description

증폭기 회로 및 증폭기 회로 동조 방법
종래의 도허티형 증폭기 회로는 본 기술 분야의 통상의 전문가에게 잘 알려져 있다. 그 한 예로서, Institute of Radio Engineers의 회보 Vol. 24, No. 9, pp. 1163-1182(1936년 9월)에 실린 A New High Efficiency Power Amplifier for Modulated Waves가 있다. 그러나, 종래의 도허티형 증폭기는 통상적으로 비교적 선형성이 좋지 못하다고 알려져 있다. 또한, 이 선형성은 통상적으로 그 효율에 반비례한다. 따라서, 종래의 도허티형 증폭기는 효율성이 좋은 반면 선형성이 좋지 못하다. 선형성이 나쁘기 때문에 종래의 도허티형 증폭기 회로는 셀룰러 기지국 장비 내의 복수 반송파 전력 증폭기와 같은 많은 응용 분야에 잘 맞지 않는다. 따라서, 도허티형 증폭기 회로의 선형성을 개선할 필요가 있다.
발명의 요약
이러한 필요에 따라서, 본 발명은 개선된 증폭기 회로와 도허티형 증폭기 회로의 동조 방법을 제공한다. 본 발명의 일 양상에 따라서, 증폭기 회로는 도허티 배열로 구성된 반송파 증폭기와 피크 증폭기를 구비한 제1 증폭기, 도허티 배열로 구성된 반송파 증폭기와 피크 증폭기를 구비한 제2 증폭기, 및 제1 및 제2 증폭기에 응답하는 조합 회로를 포함한다. 제1 증폭기는 제1 주파수 대역폭을 통해 거의 선형인 제1 출력 신호를 발생시킨다. 제2 증폭기는 제2 대역폭을 통해 거의 선형인 제2 출력 신호를 발생시킨다. 조합 회로는 제1 및 2 출력 신호에 응답하여 제3 주파수 대역폭을 통해 거의 선형인 제3 출력 신호를 발생시킨다. 제3 주파수 대역폭은 제1 또는 2 주파수 대역폭보다 더 크다.
본 발명의 다른 양상에 따라서, 증폭기 회로는 반송파 증폭기 출력 신호를 발생시키는 반송파 증폭기, 도허티 구성으로 반송파 증폭기에 결합된 피킹 증폭기, 및 반송파 증폭기와 피킹 증폭기에 응답하는 조합 회로를 포함한다. 피킹 증폭기 전압은 조정된 혼변조 기생 신호(intermodulation product signal)를 발생시키도록 바이어스된다. 조합 회로는 조정된 혼변조 기생 신호를 반송파 출력 신호와 결합시켜 거의 선형화된 증폭기 회로 출력 신호를 발생시킨다.
도허티형 증폭기 회로의 동조 방법은 도허티형 증폭기를 제공하는 단계, 도허티형 증폭기의 혼변조 성능을 피킹 증폭기 바이어스 전압 함수로서 측정하는 단계, 및 측정된 혼변조 성능에 따라서 피킹 증폭기 바이어스 전압을 선택하는 단계를 포함한다. 본 발명과 그에 수반되는 잇점은 첨부 도면과 참조한 다음의 상세한 설명으로부터 잘 이해될 것이다.
본 발명은 일반적으로 증폭기 회로에 관한 것으로, 특히 도허티형(Doherty type) 증폭기 회로에 관한 것이다.
도 1은 도허티형 증폭기 회로의 개략 회로도.
도 2는 도 1의 도허티형 증폭기에 대한 혼변조 기생 신호의 그래프도.
도 3은 도 1의 도허티형 증폭기를 이용한 피드포워드 증폭기의 회로도.
도 4는 병렬 도허티형 증폭기 구성을 도시한 블럭도.
도 5는 도허티형 증폭기 동조 방법의 플로우챠트.
도 6은 정합 회로의 특정 실시예를 나타낸 도면.
도 1을 참조로 설명하면, 도허티 배열로 구성된 반송파 증폭기(24)와 피킹 증폭기(26)를 포함하는 증폭기 회로(20)가 도시되어 있다. 증폭기(24, 26) 각각은 바이어스 전압을 수신한다. 따라서, 증폭기 회로(20)는 입력부(22)와 출력부(38)를 갖고 있다. 증폭기 회로는 지연 라인(28)과 변압기 라인(30)을 포함하며, 지연 라인(28)은 바람직하게는 90°지연이다. 반송파 증폭기(24)는 위상 라인(32)과 변압기 라인(30)을 통해 전송되는 출력 신호를 발생시킨다. 피킹 증폭기(26)는 제2 위상 라인(34)을 통해 전송되는 출력 신호를 발생시킨다. 반송파 및 피킹 증폭기(24, 26)로부터의 출력 신호들은 공통 노드와 같은 조합 회로(35)에서 결합되어, 최종적으로 증폭기 회로 출력부(38)에서 출력된다.
반송파 증폭기(24)는 등급 AB 모드에서 동작하는 모토롤라사로부터 입수가능한 MRF183 계열 증폭기와 같은 금속 산화물 반도체 전계 효과 트랜지스터(MOSFET)형 증폭기이다. 피킹 증폭기(26)는 바람직하게는 등급 C 모드에서 동작하는 모토롤라사로부터 입수가능한 MRF183 계열 증폭기와 같은 MOSFET형 증폭기이다. MRF183 계열 증폭기는 미국 85008 아리조나주 포레익스 맥도웰 로드 5008 이(E)에 거주하는 모토롤라사로부터 입수가능하다. 지연 라인(28)은 바람직하게는 본 기술 분야의 통상의 전문가에게 알려진 방식으로 마이크로스트립 또는 스트립 라인 기법으로 구현된다. 변압기 라인(30)은 약 50Ω 정도의 임피던스를 갖고 있으며 1/4 파장이다. 바람직한 실시예에서 변압기 라인(36)도 1/4 파장이며 약 35Ω의 임피던스를 갖고 있다. 피킹 증폭기(26)는 지연 라인(28)에 응답하며 위상 라인(34)에 결합된다. 변압기 라인(30)은 반송파 증폭기(24)에 응답하여 반송파 및 피킹 증폭기(24, 26)로부터의 출력들을 상호 접속시킨다. 동작 중에, 반송파 증폭기(24) 전압은 선형 동작에 대해 바이어스 되고 피킹 증폭기(26) 전압은 비선형 동작에 대해 바이어스된다. 소정의 주파수 범위에서 피킹 증폭기(26)는 3차 혼변조 기생 신호와 같은 혼변조 기생 신호를 발생시키는데, 이 기생 신호는 반송파 증폭기(24)로부터의 혼변조 기생 신호와 상쇄적으로 결합하여 전체 증폭기 회로(20)가 거의 선형적으로 동작하게 한다. 그러나, 각 증폭기 내의 변동 때문에 증폭기 회로(20)는 원하는 주파수 범위에서 성능의 선형성을 개선시키기 위해 동조되어야 한다.
이제, 특정 주파수 범위에서 거의 선형이 되는 증폭기 회로(20)를 동조시키는 바람직한 방법에 대해 설명한다. 먼저, 증폭기 회로(20)에 2개의 톤 여기 신호(tone excitation signal)를 인가하여 베이스라인 혼변조(IM) 기생 성능을 결정한다. 두번째로, 측정된 IM 성능에 따라서, 이득, IM 성능, 및 효율성과 같은 주문자 설계에 따른 반송파 증폭기(24) 전압을 바이어스시킨다. 세번째로, 증폭기 회로(20)의 IM 성능을 피킹 증폭기(26) 바이어스 전압 함수로 스위프(sweep)시킨다. 예시적인 피킹 증폭기 스위프가 도 2에 도시되어 있다. 양호한 IM 소거가 관찰된다면, 피킹 증폭기(26)의 바이어스 전압을 조정하여 증폭기 회로(20)를 미세하게 동조시켜 IM 기생 신호를 더 감소시킨다.
그러나, IM 소거가 관찰되지 않으면, 반송파 증폭기(24) 및/또는 피킹 증폭기(26)를 재정합시키고, 및/또는 위상 라인(32, 34)의 길이를 조정한다. 증폭기 회로(20) 내의 구성 소자를 조정한 후에, 만족할 만한 IM 성능이 달성될 때까지 상기 첫번째 단계 내지 세번째 단계를 반복한다. 바람직한 방법의 플로우챠트는 도 5에 도시되어 있으며, 도 6에는 동조된 도허티 증폭기의 일례가 도시되어 있다.
도 3을 참조로 설명하면, 증폭기 회로(150)의 다른 바람직한 실시예가 도시되어 있다. 증폭기 회로(150)는 바람직하게는 병렬로 구성된 제1(154), 제2(156), 및 제3(158) 도허티형 증폭기를 포함한다. 증폭기(154, 156, 158) 각각은 입력 신호(164)를 수신하여 드라이버 신호(160)를 발생시키는 드라이버 증폭기(152)에 응답한다. 드라이버 신호(160)는 증폭기(154, 156, 158) 각각의 입력부 내로 공급된다. 증폭기(154, 156, 158) 각각은 증폭된 출력을 발생시키며, 이 출력은 공통 노드에서 결합되어 증폭기 회로(150)의 출력부(166)로 전송된다. 도허티형 증폭기(154, 156, 158) 각각은 바람직하게는 도 1에 도시된 증폭기(20) 구성과 유사하며 상술한 바람직한 동조 방법에 의해 설명된 바와 같이 거의 선형적으로 동작하도록 동조된다.
그러나, 증폭기(154, 156, 158) 각각은 서로 다른 주파수 대역에서 거의 선형적인 모드로 동작하도록 설계된다. 예컨대, 제1 증폭기(154)는 약 865 ㎒와 약 875 ㎒ 사이에서 거의 선형적으로 동작하도록 설계될 수 있고, 제2 증폭기(156)는 약 875 ㎒와 약 885 ㎒ 사이에서 거의 선형적으로 동작하도록 설계될 수 있고, 그리고 제3 증폭기(158)는 약 885 ㎒와 약 895 ㎒ 사이에서 거의 선형적으로 동작하도록 설계될 수 있다. 도 4의 바람직한 실시예에서, 제1 증폭기(154)는 약 870 ㎒의 중심 주파수를 가지며, 제2 증폭기(156)는 약 880 ㎒의 중심 주파수를 가지며, 제3 증폭기(158)는 약 890 ㎒의 중심 주파수를 가진다. 도허티형 증폭기는 좁은 주파수 범위에서 거의 선형적으로 동작하도록 동조될 수 있다. 선형 동적의 특정 주파수 대역폭은 도허티 증폭기 내의 정합 회로를 조정함으로써, 증폭기(20) 내의 위상 라인(32, 34)과 같은 위상 라인의 길이를 조정함으로써, 또는 반송파나 피킹 증폭기(24, 26)의 바이어스 전압을 조정함으로써 결정될 수 있다. 대안으로서, 증폭기(154, 156, 158) 각각은 선형성의 주파수 대역을 변화시키는 다른 전이 전압에서 동작될 수 있다.
도허티 증폭기 구조는 내재적인 대역폭 제한을 갖는다. 이 제한은 피킹 증폭기에 의한 반송파 증폭기의 회로 부하 때문이다. 회로 부하의 정도는 피킹 증폭기 출력 정합 회로 리액턴스, 소자의 내재적인 리액턴스, 및 소자 패키지의 관련 기생 리액턴스에 의해 결정된다. 피드포워드 증폭기는 일반적으로 능동 소자를 통한 시간 지연을 최소화시키고 광대역 반송파 소거를 용이하게 하기 위하여 광대역 메인 증폭기를 필요로 한다.
몇개의 도허티 증폭기가 병렬로 조합된 바람직한 실시예에서는, 도허티 증폭기 대역폭을 확장시키고 혼변조 성능, 이득 평탄화, 및 고효율을 유지하는 동조 방법론을 이용하여 내재적인 대역폭 제한을 극복할 수 있다. X ㎒의 전체 시스템 대역폭을 달성하기 위한 이 동조 방법론은 몇가지 부분으로 구성된다.
(병렬 접속된 총 N개의 도허티 단계에 대해)반송파 증폭기 및 피킹 증폭기 단계 각각은 X/N ㎒의 대역폭에서 원하는 혼변조, 효율성, 및 이득 평탄화를 위해 정합된다. 정합 회로는 커패시터, 인덕터 및/또는 분포 전송 라인과 같은 종래의 이산 리액티브 소자들로 구성되며, RF 회로에 대해 직렬 및 병렬 구성을 하고 있다. 도 6에는 동조된 정합 회로의 일례가 도시되어 있다. 더 좁은 X/N ㎒ 대역폭에서 원하는 성능을 위해 반송파 증폭기와 피킹 증폭기를 정합시킴으로써, 전체 도허티 구성에 대한 혼변조 성능과 효율이 향상된다. 예컨대, 3개의 도허티 단계가 병렬로 접속되어 있고, 전체 시스템 대역폭 필요 조건이 30 ㎒이라면, 피킹 및 반송파 증폭기 각각은 10 ㎒ 대역폭(X= 30 ㎒, N=3)에 대해 정합되어야 한다. 증폭기의 대역 중심이 855 ㎒라면, 제1 도허티 단계는 840-850 ㎒ 대역에서 정합되고, 제2 도허티 단계는 850-860 대역에서 정합되고, 그리고 마지막 도허티 단계는 860-870 ㎒ 대역에서 정합될 것이다. 단계들이 병렬로 되어 있을 경우에는 이득 응답은 오버랩되며, 이는 전체 X ㎒ 대역폭에서 평탄화 이득 응답으로 나타내게 된다. 유사한 대역폭 확장 메카니즘은 광대역 필터 설계에 도움이 된다.
도허티 회로 내의 반송파 증폭기와 피킹 증폭기 각각은 바람직하게는 증폭기들 간에 전력을 적절하게 결합시키기 위해 결합된다. 이 결합은 종종 대략 λ/4 파장의 전송 라인을 이용하여 달성된다. 전송 라인(또는 위상 라인)은 주파수에 감응하므로, 최대 전력 결합을 위한 반송파 증폭기와 피킹 증폭기의 바람직한 결합은 단일 주파수에서 생긴다. 따라서, 도허티 효율(피킹 증폭기 회로 부하에 따라 변함)과 혼변조 성능(반송파 증폭기 출력 부하에 따라 변함)은 전체 X ㎒ 대역폭에서가 아닌 X/N ㎒ 대역폭에서 위상 라인 최적화가 이루어질 때 향상된다. 따라서, 동조 방법론에서는 각 N 도허티 증폭의 위상 라인 길이는 다른 X/N ㎒ 대역폭에 대해 정합된 위상 라인을 이용한다. 상기 예를 이용하면, 3개의 다른 위상 라인 길이가 이용된다. 다시 상기 예를 참조하여 설명하면, 840-850 ㎒ 도허티 단계는 λ845 ㎒/4의 λ/4 위상 라인 길이를 가진다. 850-860 ㎒ 도허티 단계는 λ865 ㎒/4의 λ/4 위상 라인 길이를 가진다.
도허티 증폭기 각각은 피킹 증폭기 바이어스를 조정함으로써 이득 평탄화와 혼변조 성능을 개선시킨다. 따라서, 대역폭 X/N ㎒의 도허티 증폭기 각각은 원하는 이득 평탄화와 혼변조 성능에 대해 바이어스가 설정되어 있다. 그러나, 모듈 병렬화로 인해 기생 부하 효과가 생길 수 있으며, 이는 병렬 구성 혼변조 및/또는 이득 평탄화를 변동시킨다. 병렬 도허티 구성에 대한 바람직한 실시예는 도허티 메인 증폭기 혼변조 성능, 효율성, 및 이득 평탄화를 동시에 조정하는 각 도허티 증폭기의 피킹 증폭기 바이어스 전압의 최종 조정을 포함한다. 바이어스 조정은 3가지 변수(이득, 평탄화, IM, 효율성)의 동시적인 최적화를 포함하므로, 통상적으로 바이어스 조정 알고리즘을 이용한다. 바이어스 조정 알고리즘은 플로우챠트로 가장 잘 설명된다.
피드포워드 메인 증폭기 도허티 증폭기 성능 개선은 IM 성능, 대역폭, 이득, 효율성, 및 그룹 지연 타겟이 모두 거의 동시에 충족될 때에 실현된다.
서로 다른 주파수 대역에서 거의 선형적으로 동작하는 다수의 도허티형 증폭기를 구비함으로써, 증폭기 회로(150)는 도허티 증폭기 각자의 주파수 대역보다 더 큰 주파수 대역에서 거의 선형적으로 동작될 수 있다. 도 3의 특정 실시예에서는 증폭기 회로(150)는 약 865 ㎒ 내지 약 895 ㎒의 주파수 대역에서 거의 선형적으로 동작한다. 따라서, 증폭기 회로(150)는 도허티형 증폭기를 이용함으로써 효율적으로 동작하는 잇점이 있으며 양호하게는 비교적 넓은 대역폭에서 거의 선형적으로 동작한다.
상술한 바람직한 실시예는 많은 잇점을 갖고 있다. 예컨대, 도허티 증폭기를 통한 그룹 지연은 도허티 회로의 내재적인 대역 제한 성질로 인한 종래의 증폭기에서의 그룹 지연보다 더 클 것이다. 바람직한 실시예는 도허티 증폭기를 통한 그룹 지연을 감소시킨다. 또한, 복수 반송파 증폭기 응용에서는 소정 주파수에서 벡터적으로 가산되는 다수의 혼변조 기생 신호들 간에 위상 관계를 가능한 많이 임의로 추출하는 것이 중요하다. 병렬 도허티 단계들 각각에서 발생된 혼변조 기생 신호들 간에는 위상 오프셋(임의 추출)이 생긴다. 위상 오프셋은 각 도허티 단계가 고유의 정합 구조, 고유의 위상 라인 길이, 및 고유의 피킹 증폭기 바이어스 설정점을 갖고 있기 때문에 생기는 것이다. 그 결과, 복수 반송파 혼변조 기생 신호들이 종래의 병렬 증폭기 설계에서 보다 덜 자주 피크치에 벡터적으로 가산되어 더욱 낮은 평균 혼변조 레벨을 발생시키게 된다. 또한, 바람직한 X/N ㎒ 설계법은 내재적 대역 제한 도허티 증폭기의 대역폭을 증가시키며, 이에 따라서 이득, 효율성, 및 혼변조 성능에 대한 영향이 크게 감소된다.
도 4는 피드포워드 증폭기 회로(100)의 바람직한 실시예를 도시한 것이다. 증폭기 회로(100)는 메인 증폭기(106)와 에러 증폭기(114)를 포함한다. 증폭기 회로(100)는 입력부(102), 제1 결합기(104), 제2 결합기(108), 제3 결합기(112), 및 제4 결합기(116)를 포함한다. 증폭기 회로(100)는 제1 지연 라인(110)과 제2 지연 라인(116)을 더 포함한다. 제1 결합기(104)는 입력부(102)에서 수신된 RF 입력 신호를 샘플링하여 지연 라인(110)에 의해 지연된 순수 신호(clean signal)를 발생시킨다. 제2 결합기(108)는 메인 증폭기(106)의 출력(120)을 샘플링한다. 제3 결합기(112)는 결합기(108)로부터 샘플링된 출력 신호를 수신하여 메인 증폭기(106)의 출력부(120)로부터의 출력 신호를 제1 결합기(104)에 의해 샘플링된 입력 신호의 지연된 신호와 결합시킨다. 제3 결합기의 출력은 바람직하게는 증폭된 에러 신호(118)를 발생시키기 위한 에러 증폭기(114)에 의해 증폭된 에러 신호이다. 증폭된 에러 신호(122)는 제4 결합기(116)에 의해 제2 지연 라인(116)에 의해 발생된 지연된 출력 신호(122)에 결합된다. 지연된 출력 신호(122)를 증폭된 에러 신호(116)에 결합시킴으로써, 도출되는 출력(118)은 출력 신호(120)에 비해 에러 레벨이 감소된다. 이런 식으로, 메인 증폭기(106)으로 인한 비선형성 때문에 에러의 적어도 일부가 제4 결합기(116)에 의해 소거되어 더욱 선형적인 출력(118)을 발생시킨다. 바람직한 실시예에서는 메인 증폭기(106)는 상술한 동조법에 따라 동조되었던 도 1에 도시된 증폭기 회로(20)와 같이 도허티형 증폭기이다.
도허티 구성 메인 증폭기(106)는 직류(DC)를 크게 증가시켜서 피드포워드 증폭기 회로(100)의 RF 변환 효율성을 개선시킨다. 이 효율성은 종래의 피드포워드 증폭기 회로보다 약 40% 정도 개선되며, 이는 하아모닉 터미네이션(harmonic termination)과 같은 종래의 다른 효율성 향상 기법보다 훨씬 우수한 것이다. 작은 대역폭(통상적으로 1% 미만임)에 대해서는 도허티 구성 메인 증폭기(106)도 혼변조 성능을 개선시킬 수 있다. 또한, 도허티 구성 메인 증폭기는 큰 대역폭에 이용될 수도 있다.
상술한 장치와 방법의 또 다른 잇점과 변경도 가능함은 본 기술 분야의 통상의 전문가라면 잘 알 것이다. 따라서, 본 발명은 더 넓은 견지에서 보면 상술한 실시예들에 한정되는 것은 아니다. 본 발명의 범위나 본질에서 벗어남이 없이 상기 설명을 여러가지로 수정 또는 변형시킬 수 있으며, 본 발명은 이러한 수정이나 변형도 포함한다.

Claims (10)

  1. 도허티 배열로 구성된 반송파 증폭기와 피크 증폭기를 구비하며, 제1 주파수 대역폭에서 거의 선형적인 제1 출력 신호를 발생시키는 제1 증폭기,
    도허티 배열로 구성된 반송파 증폭기와 피크 증폭기를 구비하며, 제2 대역폭에서 거의 선형적인 제2 출력 신호를 발생시키는 제2 증폭기, 및
    상기 제1 및 제2 증폭기와 상기 제1 및 제2 출력 신호에 응답하여, 상기 제1 및 제2 주파수 대역 중 어느 한 대역보다 더 큰 조합된 주파수 대역폭에서 거의 선형적인 조합된 출력 신호를 발생시키는 조합 회로
    를 포함하는 증폭기 회로.
  2. 제1항에 있어서, 도허티 배열로 구성된 반송파 증폭기와 피크 증폭기를 구비하며, 제3 대역폭에서 거의 선형적인 제3 출력 신호를 발생시키는 제3 증폭기를 더 포함하며, 상기 조합 회로는 상기 제3 출력 신호에 더 응답하는 것을 특징으로 하는 증폭기 회로.
  3. 제2항에 있어서, 상기 제1 증폭기는 제1 전이 전압에서 동작하고, 상기 제2 증폭기는 제2 전이 전압에서 동작하는 것을 특징으로 하는 증폭기 회로.
  4. 제2항에 있어서, 상기 제1 증폭기는 상기 피크 증폭기와 통신하는 지연 라인, 상기 반송파 증폭기에 결합된 전송 라인, 상기 피크 증폭기에 결합된 위상 전송 라인, 및 상기 피크 및 반송파 증폭기에 응답하는 출력 전송 라인을 포함하는 것을 특징으로 하는 증폭기 회로.
  5. 반송파 증폭기 출력 신호를 발생시키는 반송파 증폭기,
    상기 반송파 증폭기에 도허티 구성으로 결합되며, 조정된 혼변조 기생 신호를 발생시키도록 바이어스된 전압을 갖는 피킹 증폭기, 및
    상기 반송파 증폭기와 상기 피킹 증폭기에 응답하여, 상기 조정된 혼변조 기생 신호를 상기 반송파 증폭기 출력 신호에 결합시켜 거의 선형화된 증폭기 회로 출력 신호를 발생시키는 조합 회로
    를 포함하는 증폭기 회로.
  6. 제5항에 있어서, 상기 피킹 증폭기에 결합된 위상 전송 라인을 더 포함하는 것을 특징으로 하는 증폭기 회로.
  7. 반송파 증폭기 출력 신호를 발생키는 반송파 증폭기,
    상기 반송파 증폭기에 도허티 구성으로 결합된 피킹 증폭기, 및
    상기 반송파 증폭기 및 상기 피킹 증폭기에 응답하여, 상기 조정된 혼변조 기생 신호를 상기 반송파 증폭기 출력 신호에 결합시켜 거의 선형화된 증폭기 회로 출력 신호를 발생시키는 조합 회로
    를 포함하는, 입력부와 출력부를 구비한 메인 증폭기,
    상기 메인 증폭기의 입력부에서 수신된 입력 신호를 샘플링하는 제1 결합기,
    상기 메인 증폭기의 출력부에 결합된 제2 결합기,
    상기 제1 및 제2 결합기에 응답하는 제3 결합기, 및
    상기 제2 결합기 및 상기 메인 증폭기에 응답하여, 에러 저감 증폭 출력 신호를 발생시키는 제4 결합기
    를 포함하는 증폭기 회로.
  8. 도허티형 증폭기를 제공하는 단계,
    상기 도허티형 증폭기의 혼변조 성능을 피킹 증폭기 바이어스 전압 함수로서 측정하는 단계, 및
    상기 측정된 혼변조 성능에 따라서 피킹 증폭기 바이어스 전압을 선택하는 단계
    를 포함하는 도허티형 증폭기 회로의 동조 방법.
  9. 제8항에 있어서, 상기 도허티형 증폭기 내의 정합 회로를 조정하는 단계를 더 포함하는 것을 특징으로 하는 도허티형 증폭기 회로의 동조 방법.
  10. 제8항에 있어서, 상기 도허티형 증폭기 내의 위상 라인 길이를 조정하는 단계를 더 포함하는 것을 특징으로 하는 도허티형 증폭기 회로의 동조 방법.
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