KR102583783B1 - 발광표시장치 및 이의 구동방법 - Google Patents

발광표시장치 및 이의 구동방법 Download PDF

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Abstract

본 발명은 표시패널, 패널 구동부 및 타이밍 콘트롤러를 포함하는 발광표시장치를 제공한다. 표시패널은 다수의 픽셀들로 구현된 픽셀 라인들이 적어도 하나 이상의 A 영역과 적어도 하나 이상의 B 영역으로 구분된다. 패널 구동부는 픽셀 라인들에 연결된다. 타이밍 콘트롤러는 패널 구동부의 동작을 제어하여, A 영역과 B 영역 중 어느 하나에 속하는 복수의 픽셀 라인들에 입력 영상 데이터를 순차적으로 기입하기 위한 IDW(Image Data Writing) 구동을 구현하고, IDW 구동이 이뤄지지 않는 수직 블랭크 기간에서 A 영역과 B 영역 중 어느 하나에 속하는 특정 픽셀 라인에 센싱용 데이터를 기입하기 위한 SDW(Sensing Data Writing) 구동을 구현한다. 또한, 타이밍 콘트롤러는 수직 블랭크 기간 동안 입력 영상 데이터와 센싱용 데이터 사이에 커플링 보상 데이터를 기입한다.

Description

발광표시장치 및 이의 구동방법{Light Emitting Display and Driving Method Thereof}
본 발명은 발광표시장치 및 이의 구동방법에 관한 것이다.
정보화 기술이 발달함에 따라 사용자와 정보간의 연결 매체인 표시장치의 시장이 커지고 있다. 이에 따라, 발광표시장치(Light Emitting Display: LED), 양자점표시장치(Quantum Dot Display; QDD), 액정표시장치(Liquid Crystal Display: LCD) 등과 같은 표시장치의 사용이 증가하고 있다.
앞서 설명한 표시장치들은 서브 픽셀들을 포함하는 표시패널, 표시패널을 구동하는 구동 신호를 출력하는 구동부 및 표시패널 또는 구동부에 공급할 전원을 생성하는 전원 공급부 등이 포함된다.
위와 같은 표시장치들은 표시패널에 형성된 서브 픽셀들에 구동 신호 예컨대, 스캔신호 및 데이터신호 등이 공급되면, 선택된 서브 픽셀이 빛을 투과시키거나 빛을 직접 발광을 하게 됨으로써 영상을 표시할 수 있게 된다.
한편, 앞서 설명한 표시장치들 중 발광표시장치는 빠른 응답속도, 고휘도 및 시야각이 넓은 전기적 그리고 광학적 특성과 더불어 유연한 형태로 구현할 수 있는 기구적 특성 등과 같이 많은 장점이 있으나 표시패널에 포함된 소자의 열화 개선이나 수명을 향상하는 등의 개선점도 있다.
상술한 배경기술의 문제점을 해결하기 위한 본 발명은 표시패널에 포함된 소자의 열화 개선이나 수명 향상을 위한 보상 동작시 유발될 수 있는 센싱 편차를 고려하여 장치 및 구동방법을 구현하는 것이다.
상술한 과제 해결 수단으로 본 발명은 표시패널, 패널 구동부 및 타이밍 콘트롤러를 포함하는 발광표시장치를 제공한다. 표시패널은 다수의 픽셀들로 구현된 픽셀 라인들이 적어도 하나 이상의 A 영역과 적어도 하나 이상의 B 영역으로 구분된다. 패널 구동부는 픽셀 라인들에 연결된다. 타이밍 콘트롤러는 패널 구동부의 동작을 제어하여, A 영역과 B 영역 중 어느 하나에 속하는 복수의 픽셀 라인들에 입력 영상 데이터를 순차적으로 기입하기 위한 IDW(Image Data Writing) 구동을 구현하고, IDW 구동이 이뤄지지 않는 수직 블랭크 기간에서 A 영역과 B 영역 중 어느 하나에 속하는 특정 픽셀 라인에 센싱용 데이터를 기입하기 위한 SDW(Sensing Data Writing) 구동을 구현한다. 또한, 타이밍 콘트롤러는 수직 블랭크 기간 동안 입력 영상 데이터와 센싱용 데이터 사이에 커플링 보상 데이터를 기입한다.
커플링 보상 데이터는 수직 블랭크 기간이 시작되기 직전에 인가된 직전 입력 영상 데이터를 기반으로 마련될 수 있다.
커플링 보상 데이터는 수직 블랭크 기간이 시작되기 직전에 인가된 직전 입력 영상 데이터와 동일할 수 있다.
커플링 보상 데이터는 센싱용 데이터가 인가되기 직전까지 인가 상태가 유지될 수 있다.
타이밍 콘트롤러는 A 영역과 B 영역 중 나머지 하나에 속하는 복수의 픽셀 라인들에 블랙 영상 데이터를 동시에 삽입하기 위한 BDI(Back Data Insertion) 구동을 구현할 수 있다.
타이밍 콘트롤러는 수직 블랭크 기간 동안 블랙 영상 데이터를 커플링 보상 데이터로 사용할 수 있다.
타이밍 콘트롤러는 블랙 영상 데이터 사용에 의해 표시패널에 배치된 수평라인들과 수직라인들 간의 커플링 현상에 따른 센싱 편차를 보상하는 편차 보상부를 포함할 수 있다.
다른 측면에서 본 발명은 표시패널에서 다수의 픽셀들로 구현된 픽셀 라인들이 적어도 하나 이상의 A 영역과 적어도 하나 이상의 B 영역으로 구분된 발광표시장치의 구동방법을 제공한다. 발광표시장치의 구동방법은 A 영역과 B 영역 중 어느 하나에 속하는 복수의 픽셀 라인들에 입력 영상 데이터를 순차적으로 기입하기 위한 IDW(Image Data Writing) 구동을 구현하는 단계를 포함한다. 또한, IDW 구동이 이뤄지지 않는 수직 블랭크 기간에서 A 영역과 B 영역 중 어느 하나에 속하는 특정 픽셀 라인에 센싱용 데이터를 기입하기 위한 SDW(Sensing Data Writing) 구동을 구현하는 단계를 포함한다. 또한, 수직 블랭크 기간 동안 입력 영상 데이터와 센싱용 데이터 사이에 커플링 보상 데이터를 기입하는 단계를 포함한다.
커플링 보상 데이터는 수직 블랭크 기간이 시작되기 직전에 인가된 직전 입력 영상 데이터와 동일하게 마련될 수 있다.
커플링 보상 데이터는 센싱용 데이터가 인가되기 직전까지 인가 상태가 유지될 수 있다.
본 발명은 표시패널에 포함된 소자의 열화 개선이나 수명 향상을 위한 보상 동작시 유발될 수 있는 센싱 편차를 고려하여 장치 구현은 물론 구동방법을 선택할 수 있는 효과가 있다. 또한, 본 발명은 표시패널에 포함된 소자의 열화 개선을 보상 동작시 센싱 편차 발생 가능성을 최소화할 수 있어 균일하고 정확한 보상과 더불어 균일한 표시품질을 유지할 수 있는 효과가 있다. 또한, 본 발명은 표시패널에 포함된 소자의 열화 개선을 보상 동작시 픽셀 어레이를 상하 2개의 영역으로 분할 구동하기 위해 클록 배선을 분리하지 않고 공통으로 사용할 수 있어 베젤 영역의 증가를 방지할 수 있는 효과가 있다.
도 1은 본 발명의 실시예에 따른 발광표시장치를 나타낸 도면.
도 2는 도 1의 발광표시장치에 포함된 픽셀 어레이를 보여주는 도면.
도 3은 도 2의 픽셀 어레이에 포함된 픽셀 중 하나를 보여주는 도면.
도 4 내지 도 6은 도 1의 발광표시장치에 적용되는 블랙 영상 삽입 기술을 보여주는 도면들.
도 7은 제k 픽셀 라인에서 도 6의 IDW 구동과 BDI 구동을 구현하기 위한 게이트신호 및 데이터신호의 타이밍도.
도 8a는 도 7의 프로그래밍 기간에 대응되는 픽셀의 등가회로도이고, 도 8b는 도 7의 발광 기간에 대응되는 픽셀의 등가회로도이고, 도 8c는 도 7의 블랙 기간에 대응되는 픽셀의 등가회로도.
도 9, 도 10a 및 도 10b는 위상 분리된 A 클럭군과 B 클럭군을 기초로 픽셀 어레이를 A 영역과 B 영역으로 분할 구동하는 일 예를 보여주는 도면들.
도 11 및 도 12는 위상 분리된 A 클럭군과 B 클럭군을 기초로 픽셀 어레이를 복수의 A 영역들과 복수의 B 영역들로 분할 구동하는 예를 보여주는 도면들.
도 13은 블랙 영상 삽입 기술에서 수직 블랭크 기간 동안 실시간 센싱이 수행되는 것을 보여주는 도면.
도 14는 도 13의 실시간 센싱을 위한 게이트신호 및 데이터신호의 타이밍도.
도 15a는 도 13의 셋업 기간에 대응되는 픽셀의 등가회로도이고, 도 15b는 도 13의 센싱 기간에 대응되는 픽셀의 등가회로도이고, 도 15c는 도 13의 리셋 기간에 대응되는 픽셀의 등가회로도.
도 16 및 도 17은 수평 방향 및 수직 방향에 배치된 라인들 사이에 발생할 수 있는 커플링 현상을 설명하기 위한 도면들.
도 18 및 도 19는 도 16 및 도 17에서 설명한 커플링 현상에 따라 수직 블랭크 기간 동안 야기될 수 있는 센싱 편차를 설명하기 위한 도면들.
도 20 및 도 21은 제1예시에 따른 구동기법을 보여주는 도면들.
도 22 및 도 23은 제2예시에 따른 구동기법을 보여주는 도면들.
이하, 본 발명의 실시예를 설명하기 위해 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 도시된 사항에 한정되는 것은 아니다. 그리고 이하에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 ' ~ 만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 그리고 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.
아울러, 이하에 설명된 구성 요소를 해석할 경우, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다. 그리고 위치 관계에 대한 설명일 경우, 예를 들어, ' ~ 상에', ' ~ 상부에', ' ~ 하부에', ' ~ 옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다. 그리고 이하의 설명에서는 제1, 제2 등 다양한 구성요소들을 서술하기 위해서 사용될 수 있으나, 이 구성요소들은 그 용어에 의해 제한되지 않는다. 즉, 이 용어들은 단지 하나의 구성요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제1 구성요소는 본 명세서의 기술적 사상 내에서 제2 구성요소일 수도 있다.
더욱이, 이하에서 설명되는 표시패널의 기판 상에 형성되는 픽셀 회로와 게이트 드라이버는 n 타입 MOSFET(Metal Oxide Semiconductor Field Effect Transistor) 구조의 TFT로 구현될 수 있으나 이에 한정되지 않고 p 타입 MOSFET 구조의 TFT로 구현될 수도 있다. TFT는 게이트(gate), 소스(source) 및 드레인(drain)을 포함한 3 전극 소자이다. 소스는 캐리어(carrier)를 트랜지스터에 공급하는 전극이다. TFT 내에서 캐리어는 소스로부터 흐르기 시작한다. 드레인은 TFT에서 캐리어가 외부로 나가는 전극이다. 즉, MOSFET에서의 캐리어의 흐름은 소스로부터 드레인으로 흐른다. n 타입 TFT (NMOS)의 경우, 캐리어가 전자(electron)이기 때문에 소스에서 드레인으로 전자가 흐를 수 있도록 소스 전압이 드레인 전압보다 낮은 전압을 가진다. n 타입 TFT에서 전자가 소스로부터 드레인 쪽으로 흐르기 때문에 전류의 방향은 드레인으로부터 소스 쪽으로 흐른다. 이에 반해, p 타입 TFT(PMOS)의 경우, 캐리어가 정공(hole)이기 때문에 소스로부터 드레인으로 정공이 흐를 수 있도록 소스 전압이 드레인 전압보다 높다. p 타입 TFT에서 정공이 소스로부터 드레인 쪽으로 흐르기 때문에 전류가 소스로부터 드레인 쪽으로 흐른다. MOSFET의 소스와 드레인은 고정된 것이 아니라는 것에 주의하여야 한다. 예컨대, MOSFET의 소스와 드레인은 인가 전압에 따라 변경될 수 있다. 따라서, 본 발명의 실시예에 대한 설명에서는 소스와 드레인 중 어느 하나를 제1 전극, 소스와 드레인 중 나머지 하나를 제2 전극으로 기술한다.
이하에서 설명되는 발광표시장치는 유기발광 물질을 포함하는 유기발광표시장치를 중심으로 설명한다. 그러나 본 발명은 이에 한정되지 않고, 무기발광 물질을 포함하는 무기발광표시장치에도 적용될 수 있다.
마지막으로, 이하의 설명에서는 발광표시장치와 관련된 공지 기능 혹은 구성에 대한 구체적인 설명으로 인하여 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략된 것임을 참조한다.
도 1은 본 발명의 실시예에 따른 발광표시장치를 나타낸 도면이고, 도 2는 도 1의 발광표시장치에 포함된 픽셀 어레이를 보여주는 도면이고, 도 3은 도 2의 픽셀 어레이에 포함된 픽셀 중 하나를 보여주는 도면이다.
도 1 내지 도 3에 도시된 바와 같이, 본 발명의 실시예에 따른 발광표시장치는 표시패널(10), 타이밍 콘트롤러(11), 패널 구동부(12,13)를 포함할 수 있다. 패널 구동부(12,13)는 표시패널(10)의 데이터라인들(15)을 구동하는 데이터 구동부(12)와, 표시패널(10)의 게이트라인들(17)을 구동하는 게이트 구동부(13)를 포함한다.
표시패널(10)에는 다수의 데이터라인들(15), 기준전압라인들(16) 및 게이트라인들(17)이 구비된다. 데이터라인들(15), 기준전압라인들(16) 및 게이트라인들(17)의 교차영역에는 픽셀들(PXL)이 배치된다. 픽셀들(PXL)에 의해 표시패널(10)의 표시 영역(AA)에는 도 2와 같은 픽셀 어레이가 형성된다.
픽셀 어레이에 포함된 픽셀들(PXL)은 일 방향을 기준으로 라인 별로 구분될 수 있다. 예컨대, 픽셀들(PXL)은 게이트라인 연장 방향(또는 수평 방향)을 기준으로 다수의 픽셀 라인들(Line 1~Line 4 등)로 구분될 수 있다. 여기서, 픽셀 라인은 물리적인 신호라인이 아니라, 수평 방향을 따라 서로 이웃하게 배치된 픽셀들(PXL)의 집합체를 의미한다. 따라서, 동일 픽셀 라인을 구성하는 픽셀들(PXL)은 동일한 게이트라인들(17A,17B)에 연결될 수 있다.
픽셀들(PXL) 각각은 데이터라인(15)을 통해 디지털-아날로그 컨버터(이하, DAC)(121)에 연결되고, 기준전압라인(16)을 통해 센싱부(SU)(122)에 연결될 수 있다. 기준전압라인(16)은 기준 전압의 공급을 위해 DAC(121)에 더 연결될 수 있다. DAC(121)와 센싱부(SU)는 데이터 구동부(12)에 내장될 수 있으나, 이에 한정되지 않는다.
픽셀들(PXL) 각각은 전원라인(18)을 통해 고전위 픽셀전원(EVDD)에 연결될 수 있다. 그리고 픽셀들(PXL) 각각은 제1게이트라인(17A)과 제2게이트라인(17B)을 통해 게이트 구동부(13)에 연결될 수 있다.
각 픽셀(PXL)은 도 3과 같이 구현될 수 있다. k(k는 정수)번째 픽셀라인에 배치된 픽셀(PXL)은, OLED, 구동 TFT(Thin Film Transistor)(DT), 스토리지 커패시터(Cst), 제1 스위치 TFT(ST1), 및 제2 스위치 TFT(ST2)를 포함하며, 제1 스위치 TFT(ST1)와 제2 스위치 TFT(ST2)가 서로 다른 게이트라인(17A,17B)에 연결될 수 있다.
OLED는 소스 노드(Ns)에 접속된 애노드전극과, 저전위 픽셀전원(EVSS)의 입력단에 접속된 캐소드전극과, 애노드전극과 캐소드전극 사이에 위치하는 유기화합물층을 포함한다. 구동 TFT(DT)는 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압차에 따라 OLED에 흐르는 구동 전류를 제어한다. 구동 TFT(DT)는 게이트 노드(Ng)에 접속된 게이트전극, 고전위 픽셀전원(EVDD)의 입력단에 접속된 제1 전극, 및 소스 노드(Ns)에 접속된 제2 전극을 구비한다. 스토리지 커패시터(Cst)는 게이트 노드(Ng)와 소스 노드(Ns) 사이에 접속되어 구동 TFT(DT)의 게이트-소스 간 전압을 저장한다.
제1 스위치 TFT(ST1)는 제1 게이트신호(SCAN(k))에 따라 데이터라인(15)과 게이트 노드(Ng) 사이의 전류 흐름을 온 시켜, 데이터라인(15)에 충전되어 있는 데이터전압을 게이트 노드(Ng)에 인가한다. 제1 스위치 TFT(ST1)는 제1 게이트라인(17A)에 접속된 게이트전극, 데이터라인(15)에 접속된 제1 전극, 및 게이트 노드(Ng)에 접속된 제2 전극을 구비한다. 제2 스위치 TFT(ST2)는 제2 게이트신호(SEN(k))에 따라 기준전압라인(16)과 소스 노드(Ns) 사이의 전류 흐름을 온 시켜, 기준전압라인(16)에 충전된 기준전압을 소스 노드(Ns)에 인가하거나 또는, 픽셀 전류에 따른 소스 노드(Ns) 전압 변화를 기준전압라인(16)으로 전달한다. 제2 스위치 TFT(ST2)는 제2 게이트라인(17B)에 접속된 게이트전극, 기준전압라인(16)에 접속된 제1 전극, 및 소스 노드(Ns)에 접속된 제2 전극을 구비한다.
각 픽셀(PXL)에 연결되는 게이트라인(17)의 개수는 픽셀(PXL) 구조에 따라 달라질 수 있다. 예컨대, 제1 스위치 TFT(ST1)와 제2 스위치 TFT(ST2)가 서로 다르게 구동되는 2-스캔 픽셀 구조의 경우, 각 픽셀(PXL)에 연결되는 게이트라인(17)의 개수는 2개이다. 2-스캔 픽셀 구조에서 게이트라인(17) 각각은 스캔 신호가 인가되는 제1 게이트라인(17A)과 센스 신호가 인가되는 제2 게이트라인(17B)을 포함한다. 이하에서는 설명의 편의상, 2-스캔 픽셀 구조를 예시 대상으로 하지만, 본 명세서의 기술적 사상은 픽셀 구조나 게이트라인의 개수 등에 제한되지 않는다.
타이밍 콘트롤러(11)는 호스트 시스템(14)으로부터 입력되는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 도트클럭신호(DCLK) 및 데이터 인에이블신호(DE) 등의 타이밍 신호들에 기초하여 데이터 구동부(12)의 동작 타이밍을 제어하기 위한 데이터 제어신호(DDC)와, 게이트 구동부(13)의 동작 타이밍을 제어하기 위한 게이트 제어신호(GDC)를 생성할 수 있다. 게이트 제어신호(GDC)는 게이트 스타트 신호, 게이트 쉬프트 클럭들, 픽셀라인 선택&해제 신호들, 센싱 시작타이밍 지시신호, 센싱 종료타이밍 지시신호 등을 포함할 수 있다. 데이터 제어신호(DDC)는 소스 스타트 펄스, 소스 샘플링 클럭, 및 소스 출력 인에이블신호 등을 포함한다. 소스 스타트 펄스는 데이터 구동부(12)의 데이터 샘플링 시작 타이밍을 제어한다. 소스 샘플링 클럭은 라이징 또는 폴링 에지에 기준하여 데이터의 샘플링 타이밍을 제어한다. 소스 출력 인에이블신호는 데이터 구동부(12)의 출력 타이밍을 제어한다.
타이밍 콘트롤러(11)는 타이밍 제어신호들(GDC,DDC)을 기초로 표시패널(10)의 픽셀 라인들에 대한 디스플레이 구동 타이밍과 센싱 구동 타이밍을 제어함으로써, 화상 표시 중에 실시간으로 픽셀들의 구동 특성이 센싱되도록 할 수 있다.
여기서, 센싱 구동이란 특정 픽셀 라인에 배치된 픽셀들(PXL)에 센싱용 데이터(SD)를 기입하여 해당 픽셀들(PXL)의 구동 특성을 센싱하고, 이 센싱 결과를 기초로 해당 픽셀들(PXL)의 구동 특성 변화를 보상하기 위한 보상 값을 업데이트하는 구동이다. 이하, 센싱 구동에서 특정 픽셀 라인에 배치된 픽셀들(PXL)에 센싱용 데이터(SD)를 기입하기 위한 동작을 SDW(Sensing Data Writing) 구동이라 칭한다.
디스플레이 구동이란 1 프레임 내에서 입력 영상 데이터(ID)와 블랙 영상 데이터(BD)를 일정 시간차를 두고 픽셀 라인들에 기입하기 시작하여 입력 영상과 블랙 영상을 순차적으로 표시패널(10)에서 재현하는 구동이다. 디스플레이 구동은 입력 영상 데이터(ID)를 픽셀 라인들에 기입하기 위한 IDW 구동과, 블랙 영상 데이터(BD)를 픽셀 라인들에 기입하기 위한 BDI 구동을 포함한다. 고속 구동에 최적화된 표시장치가 구현될 수 있도록, 1 프레임 내에서 IDW 구동이 완료되기 전에 BDI 구동이 시작될 수 있다. 즉, 1 프레임 내에서 제1 픽셀 라인을 대상으로 한 IDW 구동과 제2 픽셀 라인을 대상으로 한 BDI 구동은 시간적으로 중첩해서 이뤄질 수 있다.
타이밍 콘트롤러(11)는 1 프레임 내에서 BDI 구동의 시작 타이밍을 제어함으로써, IDW 구동의 시작 타이밍과 BDI 구동의 시작 타이밍 간의 시간 차이 즉, 발광 듀티를 조정할 수 있다. BDI 구동은 IDW 구동과 중첩해서 이뤄지므로, 발광 듀티를 조정함에 있어 중요하게 고려해야 할 사항은 데이터 충돌 문제이다. 데이터 충돌을 방지하면서 발광 듀티를 조정하는 다양한 실시예에 대해서는 도 16 내지 도 30을 통해 후술한다.
타이밍 콘트롤러(11)는 입력 영상 데이터(ID)의 움직임에 연동하여 1 프레임 내에서 BDI 구동의 시작 타이밍을 제어할 수 있다. 타이밍 콘트롤러(11)는 공지의 다양한 영상 처리 기술을 통해 입력 영상 데이터(ID)의 움직임을 검출한 후, 입력 영상 데이터(ID)의 움직임 변화량이 클수록 1 프레임 내에서 BDI 구동의 시작 타이밍을 앞당겨 발광 듀티를 줄일 수 있다. 이를 통해 급격한 영상 변화가 있을 때는 MPRT 성능이 향상되고 모션 블러링(Motion blurring)이 완화될 수 있다. 한편, 영상 변화가 없을 때는 BDI 구동의 시작 타이밍을 늦추고 발광 듀티를 늘려서 화소의 최대 순간 휘도를 낮출 수 있다.
타이밍 콘트롤러(11)는 한 프레임 중의 수직 액티브 기간에서 IDW 구동을 구현하고, IDW 구동이 이뤄지지 않는 수직 블랭크 기간에서 SDW 구동을 구현할 수 있다. 타이밍 콘트롤러(11)는 수직 액티브 기간과 수직 블랭크 기간을 모두 이용하여 BDI 구동을 구현할 수 있다. 따라서, BDI 구동 타이밍은, 수직 액티브 기간에서 IDW 구동 타이밍과 중첩되고, 수직 블랭크 기간에서 SDW 구동 타이밍과 중첩될 수 있다.
타이밍 콘트롤러(11)는 IDW/BDI/SDW 구동을 위해 캐리 클럭신호, 스캔 클럭신호, 센스 클럭신호를 포함하는 게이트 쉬프트 클럭들과 게이트 스타트 신호를 게이트 구동부(13)에 출력한다. 타이밍 콘트롤러(11)는 IDW 구동/BDI 구동 간 데이터 충돌을 방지하기 위해, 게이트 쉬프트 클럭들을 위상이 다른 A 클럭군과 B 클럭군으로 분리하고, A 클럭군과 B 클럭군을 기초로 게이트 구동부(13)의 동작을 제어하여 픽셀 어레이를 적어도 하나 이상의 A 영역과 적어도 하나 이상의 B 영역으로 분할 구동할 수 있다. A 클럭군은 A 영역의 픽셀 라인들에 연결된 게이트 구동부(13)의 A 스테이지들에 입력되며, B 클럭군은 B 영역의 픽셀 라인들에 연결된 게이트 구동부(13)의 B 스테이지들에 입력된다. A 클럭군과 B 클럭군은 각각 IDW/SDW용 캐리 클럭신호들, BDI용 캐리 클럭신호들, IDW/SDW용 스캔 클럭신호들, BDI용 스캔 클럭신호들, IDW/SDW용 센스 클럭신호들을 포함할 수 있다(도 9 내지 도 12 참조).
게이트 구동부(13)의 일 스테이지를 기준으로 볼 때, IDW/SDW용 캐리 클럭신호들과 BDI용 캐리 클럭신호들은 동일한 캐리 클럭신호 배선들을 통해 게이트 구동부(13)에 입력되고, IDW/SDW용 스캔 클럭신호들과 BDI용 스캔 클럭신호들은 동일한 스캔 클럭신호 배선들을 통해 게이트 구동부(13)에 입력된다.
타이밍 콘트롤러(11)는 BDI용 스캔 클럭신호들의 펄스 구간(온 전압 구간)과 IDW/SDW용 스캔 클럭신호들의 펄스 구간을 서로 비중첩시키면서 IDW 구동과 BDI 구동이 A 영역과 B 영역에서 서로 분리되어 수행되도록 제어할 수 있다. 다시 말해, 타이밍 콘트롤러(11)는 A 영역을 대상으로 IDW 구동이 수행되는 동안 B 영역을 BDI 구동시키고, 이와 반대로 A 영역을 대상으로 BDI 구동이 수행되는 동안 B 영역을 IDW 구동시킬 수 있다. 이렇게 함으로써, 블랙 영상을 삽입하여 MPRT 성능을 향상하는 기술에서 입력 영상 데이터(ID)와 블랙 영상 데이터(BD) 간의 원하지 않는 데이터 뒤섞임(즉, 데이터 충돌)이 방지될 수 있다.
타이밍 콘트롤러(11)는 A 클럭군의 BDI용 스캔 클럭신호들과 B 클럭군의 BDI용 스캔 클럭신호들을 1 클럭 주기 내에서 적어도 한번씩 번갈아 출력하되, 동일 클럭군의 BDI용 스캔 클럭신호들을 소정 개수씩 동시에 출력할 수 있다. 이를 통해 MPRT 성능을 향상하는 기술에서 블랙 영상 데이터(BD)의 삽입 시간이 줄어들고 그 대신 입력 영상 데이터(ID)의 기입 시간이 충분히 확보될 수 있다.
타이밍 콘트롤러(11)는 게이트 쉬프트 클럭들 외에 픽셀라인 선택&해제 신호들, 센싱 시작타이밍 지시신호, 센싱 종료타이밍 지시신호를 게이트 구동부(13)에 더 출력하여 센싱의 대상이 되는 특정 픽셀 라인을 SDW 구동시킬 수 있다.
타이밍 콘트롤러(11)는 SDW 구동과 BDI 구동 간 데이터 충돌을 방지하기 위해, 픽셀라인 선택&해제 신호들을 위상이 다른 A 픽셀라인 선택&해제 신호와 B 픽셀라인 선택&해제 신호로 분리하고, A 영역의 픽셀 라인들에 연결된 게이트 구동부(13)의 스테이지들에 A 픽셀라인 선택&해제 신호를 입력하고, B 영역의 픽셀 라인들에 연결된 게이트 구동부(13)의 스테이지들에 B 픽셀라인 선택&해제 신호를 입력할 수 있다. 그리고 타이밍 콘트롤러(11)는 A 픽셀라인 선택&해제 신호와 B 픽셀라인 선택&해제 신호 중 어느 하나를 선택적으로 온 전압으로 활성화하고, A 영역을 대상으로 BDI 구동이 수행되는 경우 B 픽셀라인 선택&해제 신호만을 활성화하여 B 영역만을 SDW 구동시키고, 이와 반대로 B 영역을 대상으로 BDI 구동이 수행되는 경우 A 픽셀라인 선택&해제 신호만을 활성화하여 A 영역만을 SDW 구동시킬 수 있다. 그 결과, 블랙 영상을 삽입하여 MPRT 성능을 향상하는 기술에서 센싱용 데이터(SD)와 블랙 영상 데이터(BD) 간의 원하지 않는 데이터 뒤섞임이 방지되고, 픽셀의 구동 특성이 보다 정확히 센싱될 수 있다.
타이밍 콘트롤러(11)는 호스트 시스템(14)으로부터 입력되는 입력 영상 데이터(ID)를 데이터 구동부(12)에 출력한다. 타이밍 콘트롤러(11)는 내부적으로 생성된(또는 특정값으로 미리 설정된) 블랙 영상 데이터(BD)와 센싱용 데이터(SD)를 데이터 구동부(12)에 출력한다. 블랙 영상 데이터(BD)는 입력 영상 데이터(ID)의 최하위 계조 데이터에 대응되는 것으로 BDI 구동시 블랙 영상을 표시하기 위한 것이다. 센싱용 데이터(SD)는 SDW 구동시 센싱 대상 픽셀 라인의 픽셀들(PXL)에 일정한 픽셀 전류를 흐르게 하기 위한 것이다. R,G,B 픽셀들(PXL)에 기입될 센싱용 데이터(SD)는 서로 같을 수도 있고, 경우에 따라서 서로 다를 수도 있다.
게이트 구동부(13)는 타이밍 콘트롤러(11)로부터의 게이트 제어신호(DDC)에 기초하여 스캔 신호(SCAN)와 센스 신호(SEN)를 생성한다. 게이트 구동부(13)는 IDW/SDW용 캐리 클럭신호들과 IDW/SDW용 스캔 클럭신호들을 기초로 IDW/SDW용 스캔 신호(SCAN)를 생성하고, BDI용 캐리 클럭신호들과 BDI용 스캔 클럭신호들을 기초로 BDI용 스캔 신호(SCAN)를 생성한다. 그리고 게이트 구동부(13)는 IDW/SDW용 캐리 클럭신호들과 IDW/SDW용 센스 클럭신호들을 기초로 IDW/SDW용 센스 신호(SEN)를 생성한다.
게이트 구동부(13)는 IDW 구동과 BDI 구동을 구현하기 위해, A 영역(또는 B 영역)의 제1 게이트라인들(17A)에 IDW/SDW용 스캔 신호(SCAN)를 순차적으로 공급하는 도중에, B 영역(또는 A 영역)에서 일정 개수만큼의 제1 게이트라인들(17A)에 BDI용 스캔 신호(SCAN)를 동시에 공급한다. 그리고 게이트 구동부(13)는 A 영역(또는 B 영역)의 제1 게이트라인들(17A)에 IDW/SDW용 스캔 신호(SCAN)가 공급되는 타이밍에 동기하여 A 영역(또는 B 영역)의 제2 게이트라인들(17B)에 IDW/SDW용 센스 신호(SEN)를 순차적으로 공급한다.
게이트 구동부(13)는 SDW 구동을 구현하기 위해, A 영역(또는 B 영역)의 특정 제1 게이트라인(17A)에 더블 펄스 구간들을 갖는 IDW/SDW용 스캔 신호(SCAN)를 공급하고, A 영역(또는 B 영역)의 특정 제2 게이트라인(17B)에 IDW/SDW용 센스 신호(SEN)를 공급한다. 여기서, 특정 제1 및 제2 게이트라인(17A, 17B)은 동일한 센싱 대상 픽셀 라인에 연결되는 게이트라인들이다.
게이트 구동부(13)는 게이트 드라이버 인 패널 방식(GIP)에 따라 표시패널(10)의 비 표시영역(NA)에 내장될 수 있다.
데이터 구동부(12)는 복수의 DAC들(121)과, 복수의 센싱부들(SU)(122)을 포함한다. DAC(121)는 타이밍 콘트롤러(11)로부터의 데이터 제어신호(DDC)에 기초하여 입력 영상 데이터(ID)를 IDW용 데이터전압(VIDW)으로 변환하고, 블랙 영상 데이터(BD)를 BDI용 데이터전압(VBDI)으로 변환하며, 센싱용 데이터(SD)를 SDW용 데이터전압(VSDW)으로 변환한다. 그리고 DAC(121)는 픽셀들(PXL)에 인가될 기준 전압을 생성한다.
DAC(121)는 IDW 구동과 BDI 구동을 구현하기 위해, IDW/SDW용 스캔 신호(SCAN)에 동기하여 IDW용 데이터전압(VIDW)을 데이터라인들(15)에 출력하고, BDI용 스캔 신호(SCAN)에 동기하여 BDI용 데이터전압(VBDI)을 데이터라인들(15)에 출력하며, IDW/SDW용 센스 신호(SEN)에 동기하여 기준 전압을 기준 라인들(16)에 출력한다.
DAC(121)는 SDW 구동을 구현하기 위해, IDW/SDW용 스캔 신호(SCAN)의 제1 펄스에 동기하여 SDW용 데이터전압(VSDW)을 데이터라인들(15)에 출력하고, IDW/SDW용 센스 신호(SEN)에 동기하여 기준 전압을 기준 라인들(16)에 출력함으로써, 센싱 대상 픽셀 라인을 셋업한다. 센싱부들(SU)(122)은 센싱 대상 픽셀 라인의 픽셀들(PXL)에 흐르는 픽셀 전류를 기준 라인들(16)을 통해 센싱한다. 센싱이 종료된 후, DAC(121)는 IDW/SDW용 스캔 신호(SCAN)의 제2 펄스에 동기하여 SDW용 원복전압을 데이터라인들(15)에 출력하여, 센싱 대상 픽셀 라인의 표시 상태를 센싱 직전과 동일하게 원복시킨다. SDW용 원복전압은 IDW용 데이터전압(VIDW) 또는 BDI용 데이터전압(VBDI)일 수 있다.
도 4 내지 도 6은 도 1의 발광표시장치에 적용되는 블랙 영상 삽입 기술을 보여주는 도면들이다.
도 4에 도시된 바와 같이, 동일 픽셀 라인을 기준으로, IDW 구동과 BDI 구동은 1 프레임 내에서 일정 시간차를 두고 연속해서 이루어진다. 동일 프레임 내에서 IDW 구동의 시작 타이밍과 BDI 구동의 시작 타이밍 간의 시간 차이에 의해 픽셀들(PXL)의 발광 듀티가 결정된다. IDW 구동의 시작 타이밍은 고정 팩터(factor)이나, BDI 구동의 시작 타이밍은 조정 가능한 설계 팩터이다. IDW 구동의 시작 타이밍은 게이트 스타트 신호의 제1 펄스에 의해 정해지고, BDI 구동의 시작 타이밍은 제1 펄스보다 위상이 늦은 게이트 스타트 신호의 제2 펄스에 의해 정해진다. 따라서, 게이트 스타트 신호의 제2 펄스의 출력 타이밍을 앞당기거나 늦추어 BDI 구동의 시작 타이밍을 조정하면 픽셀들(PXL)의 발광 듀티를 제어할 수 있다. 다시 말해, 게이트 스타트 신호의 제2 펄스의 출력 타이밍을 늦추어 상기 시간 차이를 크게 할수록 픽셀들(PXL)의 발광 듀티는 증가하고 블랙 듀티는 감소하며, 상기 제2 펄스의 출력 타이밍을 앞당겨 상기 시간 차이를 작게 할수록 픽셀들(PXL)의 발광 듀티는 감소하고 블랙 듀티는 증가한다. 이렇게 픽셀들(PXL)의 발광 듀티가 결정되면, 프레임 변경에 상관없이 발광 듀티가 유지된다. 즉, 픽셀 라인들에 대한 IDW 구동 타이밍과 BDI 구동 타이밍은 시간 경과에 따라 발광 듀티를 유지하면서 동일하게 쉬프트된다.
도 5에 도시된 바와 같이, 한 프레임 내에서 IDW/SDW용 스캔 신호(SCAN)와 BDI용 스캔 신호(SCAN)는 발광 듀티에 대응되는 일정 시간차를 두고 출력된다. 도 5에서, 설명의 편의상 IDW/SDW용 센스 신호(SEN)는 생략되었다. IDW/SDW용 스캔 신호들(SCAN1~SCAN10)은 라인 순차 방식으로 위상이 쉬프트되어 픽셀 라인들(Line 1~Line 10)을 1라인씩 선택하고, 선택된 픽셀 라인들(Line 1~Line 10)에는 IDW용 데이터전압(VIDW)이 순차적으로 인가된다. BDI용 스캔 신호들(SCAN1~SCAN10)은 블록 순차 방식으로 위상이 쉬프트되어 픽셀 라인들(Line 1~Line 10)을 복수개씩 동시에 선택하고, 선택된 블록의 픽셀 라인들(Line 1~Line 8)에는 BDI용 데이터전압(VBDI)이 동시에 인가된다.
도 6에 도시된 바와 같이, 픽셀 라인들(Line 1~Line z)에 대한 IDW 구동 타이밍과 BDI 구동 타이밍이 프레임이 바뀌더라도 발광 듀티를 유지하면서 쉬프트될 수 있다. 이러한 구동 콘셉을 채용하면, BDI 구동을 위해 별도의 프레임을 더 추가하지 않아도 되기 때문에, 프레임 레이트(frame rate)를 높이지 않아도 되는 장점이 있다.
다만, IDW 구동 타이밍이 BDI 구동 타이밍에 비해 발광 듀티만큼 앞서고, IDW 구동 타이밍과 BDI 구동 타이밍의 쉬프트 속도가 실질적으로 동일하기 때문에, 제1 픽셀 라인에 대한 IDW 구동과 제2 픽셀 라인에 대한 BDI 구동이 중첩적으로 진행되는 오버랩 구간(OA)이 필연적으로 생긴다. 오버랩 구간(OA)에서는 2개의 픽셀 라인들이 중첩적으로 구동되기 때문에 데이터 충돌(또는 데이터 뒤섞임) 위험성이 있다.
도 7은 제k 픽셀 라인에서 도 6의 IDW 구동과 BDI 구동을 구현하기 위한 게이트신호 및 데이터신호의 타이밍도이고, 도 8a는 도 7의 프로그래밍 기간에 대응되는 픽셀의 등가회로도이고, 도 8b는 도 7의 발광 기간에 대응되는 픽셀의 등가회로도이고, 도 8c는 도 7의 블랙 기간에 대응되는 픽셀의 등가회로도이다.
도 7은 제k 픽셀 라인(Line k)의 특정 픽셀을 대상으로 한 IDW/BDI 구동을 나타낸다. 도 7을 참조하면, IDW/BDI 구동을 위한 한 프레임은 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압을 계조 표현용 픽셀 전류에 맞게 설정하는 프로그래밍 기간(Tp)과, 픽셀 전류에 따라 OLED가 발광하는 발광 기간(Te)과, OLED의 발광이 중지되는 블랙 기간(Tb)을 포함한다. 발광 듀티는 발광 기간(Te)에 대응되고, 블랙 듀티는 블랙 기간(Tb)에 대응될 수 있다. 도 7에서, IDW용 스캔 신호(SCAN)는 Pa1으로 도시되었고, BDI용 스캔 신호(SCAN)는 Pa2로 도시되었으며, IDW용 센스 신호(SEN)는 Pb으로 도시되었다.
도 7 및 도 8a를 참조하면, 프로그래밍 기간(Tp)에서 픽셀의 제1 스위치 TFT(ST1)는 IDW용 스캔 신호(Pa1)에 따라 턴 온 되어 게이트 노드(Ng)에 IDW용 데이터전압(VIDW)을 인가한다. 프로그래밍 기간(Tp)에서 픽셀의 제2 스위치 TFT(ST2)는 IDW용 센스 신호(Pb)에 따라 턴 온 되어 소스 노드(Ns)에 기준전압(Vref)을 인가한다. 이를 통해 프로그래밍 기간(Tp)에서 픽셀의 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압이 원하는 픽셀 전류에 맞게 설정된다.
도 7 및 도 8b를 참조하면, 발광 기간(Te)에서 픽셀의 제1 스위치 TFT(ST1)와 제2 스위치 TFT(ST2)는 턴 오프 된다. 프로그래밍 기간(Tp)에서 픽셀에 기 설정된 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압(Vgs)은 발광 기간(Te)에서도 유지된다. 이러한 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압(Vgs)은 픽셀의 구동 TFT(DT)의 문턱전압보다 크기 때문에, 발광 기간(Te) 동안 픽셀의 구동 TFT(DT)에는 픽셀 전류(Ioled)가 흐른다. 이 픽셀 전류(Ioled)에 의해 발광 기간(Te)에서 게이트 노드(Ng)의 전위와 소스 노드(Ns)의 전위가 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압(Vgs)을 유지한 채 부스팅된다. 소스 노드(Ns)의 전위가 OLED의 동작점 레벨까지 부스팅되면 픽셀의 OLED는 발광한다.
도 7 및 도 8c를 참조하면, 블랙 기간(Tb)에서 픽셀의 제1 스위치 TFT(ST1)는 BDI용 스캔 신호(Pa2)에 따라 턴 온 되어 게이트 노드(Ng)에 BDI용 데이터전압(VBDI)을 인가한다. 블랙 기간(Tb)에서 픽셀의 제2 스위치 TFT(ST2)는 턴 오프 상태를 유지하므로, 소스 노드(Ns)의 전위가 OLED의 동작점 레벨을 유지한다. BDI용 데이터전압(VBDI)은 OLED의 동작점 레벨보다 낮은 전압이다. 따라서, 블랙 기간(Tb)에서 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압(Vgs)은 구동 TFT(DT)의 문턱전압보다 작기 때문에, 픽셀의 구동 TFT(DT)에는 픽셀 전류(Ioled)가 흐르지 못하고, OLED는 발광을 멈춘다.
도 9, 도 10a 및 도 10b는 위상 분리된 A 클럭군과 B 클럭군을 기초로 픽셀 어레이를 A 영역과 B 영역으로 분할 구동하는 일 예를 보여주는 도면들이다.
도 6의 오버랩 구간(OA)에서는 2개의 픽셀 라인들이 중첩적으로 구동되기 때문에 데이터 충돌(또는 데이터 뒤섞임)이 생길 수 있다. 이러한 데이터 충돌을 방지하기 위해, 본 발명은 도 9 내지 도 10b와 같이 게이트 쉬프트 클럭들을 A 클럭군(CLKA1~CLKAk)과 B 클럭군(CLKB1~CLKBk)으로 분리하고, A 클럭군(CLKA1~CLKAk)과 B 클럭군(CLKB1~CLKBk)을 기초로 픽셀 어레이를 화면 상부의 한개의 A 영역과 화면 하부의 한개의 B 영역으로 분할 구동할 수 있다.
게이트 구동부(13)에서, A 영역의 게이트라인들을 구동하는 스테이지들에는 A 클럭군(CLKA1~CLKAk)이 입력되고, B 영역의 게이트라인들을 구동하는 스테이지들에는 B 클럭군(CLKB1~CLKBk)이 입력된다. A 영역의 게이트라인들을 구동하는 스테이지들은 게이트 스타트 신호의 제1 펄스에 따라 IDW 구동을 위한 게이트 신호를 출력하고, 게이트 스타트 신호의 제2 펄스에 따라 BDI 구동을 위한 게이트 신호를 출력한다. 화면 상부 A 영역과 화면 하부 B 영역의 픽셀 라인들이 순차적으로 구동되도록 게이트 구동부(13)의 스테이지들이 종속적(cascade)으로 접속될 수 있다.
상기 A 영역 최하부 픽셀 라인 다음에 상기 B 영역 최상부 픽셀 라인이 구동된다. 게이트 스타트 신호의 제1 펄스에 따른 IDW 구동이 B 영역에서 시작되는 시점에 게이트 스타트 신호의 제2 펄스가 B 영역에 인가되고, 게이트 스타트 신호의 제2 펄스에 따른 BDI 구동이 B 영역에서 시작되는 시점에 게이트 스타트 신호의 제1 펄스가 A 영역에 인가된다. 이렇게 하면 A 영역에서 제1 펄스에 따른 IDW 구동이 진행될 때 동시에 B 영역에서 제2 펄스에 따른 BDI 구동이 진행되고, 반대로 B 영역에서 제1 펄스에 따른 IDW 구동이 진행될 때 동시에 A 영역에서 제2 펄스에 따른 BDI 구동이 진행될 수 있다.
본 발명에 따른 발광표시장치는 도 10a와 같이 A 클럭군(CLKA1~CLKAk)에 따라 A 영역을 IDW 구동시킴과 동시에 B 클럭군(CLKB1~CLKBk)에 따라 B 영역을 BDI 구동시킬 수 있다. 또한, 본 발명에 따른 발광표시장치는 도 10b와 같이 A 클럭군(CLKA1~CLKAk)에 따라 A 영역을 BDI 구동시킴과 동시에 B 클럭군(CLKB1~CLKBk)에 따라 B 영역을 IDW 구동시킬 수 있다.
A 클럭군(CLKA1~CLKAk)과 B 클럭군(CLKB1~CLKBk)은 위상이 분리되어 있기 때문에, A 영역의 제1 픽셀 라인에 대한 IDW용 데이터전압(VIDW)의 기입 타이밍(또는 BDI용 데이터전압(VBDI)의 기입 타이밍)과 B 영역의 제2 픽셀 라인에 대한 BDI용 데이터전압(VBDI)의 기입 타이밍(또는 IDW용 데이터전압(VIDW)의 기입 타이밍)은 시간적으로 겹치지 않고 데이터전압들(VBDI,VIDW)의 뒤섞임 현상은 발생되지 않는다. 다만, 이렇게 픽셀 어레이를 상하 2개의 영역들(A,B)로 분할 구동하면, 50%의 발광 듀티비만을 구현할 수 있다.
도 11 및 도 12는 위상 분리된 A 클럭군과 B 클럭군을 기초로 픽셀 어레이를 복수의 A 영역들과 복수의 B 영역들로 분할 구동하는 예를 보여주는 도면들이다.
도 11에 도시된 도면에서 복수의 A 영역들과 복수의 B 영역들은 번갈아 배치될 수 있으며, 이 배치 구성을 기반으로 픽셀 어레이를 A 영역들과 B 영역들로 분할 구동하면, 발광 듀티비를 조정하기 위한 설계 자유도가 높아지는 장점이 있다.
도 11에 도시된 게이트 구동부(13)에서, A 영역들의 게이트라인들을 구동하는 스테이지들에는 도 12에 도시된 A 클럭군(CLKA1~CLKAk)이 입력되고, B 영역들의 게이트라인들을 구동하는 스테이지들에는 도 12에 도시된 B 클럭군(CLKB1~CLKBk)이 입력된다. A 영역과 B 영역의 모든 경계부들에서 픽셀 라인들이 순차적으로 구동되도록, 스테이지들은 종속적(cascade)으로 접속되어 있다.
도 12에는 A 클럭군(CLKA1~CLKAk)과 게이트 스타트 신호의 제1 펄스에 따라 픽셀 어레이의 최상부 A 영역에서부터 순차적으로 IDW용 데이터전압(VIDW)의 기입 타이밍이 쉬프트되고 있고, 그와 동시에 B 클럭군(CLKB1~CLKBk)과 게이트 스타트 신호의 제2 펄스에 따라 픽셀 어레이 중간부 B 영역에서부터 순차적으로 BDI용 데이터전압(VBDI)의 기입 타이밍이 쉬프트되고 있다. 게이트 스타트 신호의 제1 펄스에 따른 IDW 구동이 어느 B 영역에 들어가는 시점에 게이트 스타트 신호의 제2 펄스가 인가되면 상기와 같이 구동할 수 있다. 또한, 게이트 스타트 신호의 제2 펄스에 따른 BDI 구동이 어느 B 영역에 들어가는 시점에 게이트 스타트 신호의 제1 펄스 인가되면 상기와 같이 구동될 수 있다.
도 13은 블랙 영상 삽입 기술에서 수직 블랭크 기간 동안 실시간 센싱이 수행되는 것을 보여주는 도면이고, 도 14는 도 13의 실시간 센싱을 위한 게이트신호 및 데이터신호의 타이밍도이고, 도 15a는 도 13의 셋업 기간에 대응되는 픽셀의 등가회로도이고, 도 15b는 도 13의 센싱 기간에 대응되는 픽셀의 등가회로도이고, 도 15c는 도 13의 리셋 기간에 대응되는 픽셀의 등가회로도이다.
도 13에 도시된 바와 같이, 타이밍 콘트롤러(11)는 타이밍 제어신호들(GDC,DDC)을 기초로 각 프레임의 수직 액티브 기간(VWP) 내에서 IDW 구동을 구현하고, 각 프레임의 수직 블랭크 기간(VBP) 내에서 SDW 구동을 구현할 수 있다. 그리고 타이밍 콘트롤러(11)는 제k 프레임의 일부 수직 액티브 기간(VWP)과 수직 블랭크 기간(VBP), 및 제k+1 프레임의 일부 수직 액티브 기간(VWP)을 통해 BDI 구동을 구현할 수 있다. 모든 픽셀 라인들을 BDI 구동시키는 데 할당되는 시간은 수직 액티브 기간의 길이(VWP)와 실질적으로 동일할 수 있다. 한편, 수직 블랭크 기간(VBP)은 수직 액티브 기간(VWP)에 비해 매우 짧기 때문에, 특정 픽셀 라인을 대상으로 한 SDW 구동은 IDW 구동과 BDI 구동에 비해 훨씬 짧은 시간 동안 이뤄질 수 있다.
도 13의 상단에 도시된 확대도를 통해 알 수 있듯이, 수직 블랭크 기간(VBP) 내에 존재하는 A 클럭군(CLKA1~CLKAk)은 BDI 구동에 필요한 클록으로 정의될 수 있고, B 클럭군(CLKB1~CLKBk)은 IDW 구동 또는 SDW 구동에 필요한 클록으로 정의될 수 있다. A 클럭군(CLKA1~CLKAk)과 B 클럭군(CLKB1~CLKBk)은 수직 블랭크 기간(VBP) 내에서도 동시에 인가해 주서야 하기 때문에 확대도와 같이 전반과 후반으로 클럭을 나누어 구동을 한다. 이처럼, 클럭군을 나누면 전반부 센싱 가능시간(TSA)과 후반부 센싱 가능시간(TSB)으로 센싱 가능시간 또한 나누어진다. 그런데 전반과 후반으로 클럭을 나누어 구동할 경우, A 클럭군(CLKA1~CLKAk)과 B 클럭군(CLKB1~CLKBk)이 중복될 경우 그에 따른 문제가 발생하게 되므로 센싱시간은 양분되고 또한 센싱 가능시간은 양분되기 전보다도 짧아진다.
도 14는 제j 픽셀 라인(Line j)의 특정 픽셀을 대상으로 한 SDW 구동을 나타내고 있다. 도 14 및 도 15a ~ 15c에 도시된 바와 같이, SDW 구동을 위한 수직 블랭크 기간(VBP)은 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압을 센싱용 픽셀 전류에 맞게 설정하는 셋업 기간(①)과, 픽셀 전류를 샘플링하는 센싱 기간(②)과, 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압을 셋업 기간(①)의 직전 상태로 원복 시키는 리셋 기간(③)을 포함한다. 도 14에서, SDW용 스캔 신호(SCAN)는 Pc1과 Pc2로 도시되었고, SDW용 센스 신호(SEN)는 Pd로 도시되었다.
도 13, 도 14 및 도 15a에 도시된 바와 같이, 셋업 기간(①)에서 픽셀의 제1 스위치 TFT(ST1)는 SDW용 스캔 신호(Pc1)에 따라 턴 온 되어 게이트 노드(Ng)에 SDW용 데이터전압(VSDW)을 인가한다. 셋업 기간(①)에서 픽셀의 제2 스위치 TFT(ST2)는 SDW용 센스 신호(Pd)에 따라 턴 온 되어 소스 노드(Ns)에 기준전압(Vref)을 인가한다. 이를 통해 셋업 기간(①)에서 픽셀의 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압이 센싱용 픽셀 전류에 맞게 설정된다.
도 13, 도 14 및 도 15b에 도시된 바와 같이, 센싱 기간(②)에서 픽셀의 제1 스위치 TFT(ST1)는 턴 오프 되지만 제2 스위치 TFT(ST2)는 턴 온 상태를 유지한다. 그리고 기준전압라인(16)은 DAC에서 센싱부(SU)로 연결된다. 센싱 기간(②)에서 센싱부(SU)는 제2 스위치 TFT(ST2)와 기준전압라인(16)을 통해 입력되는 센싱용 픽셀 전류(Ipix)를 샘플링한다.
도 13, 도 14 및 도 15c에 도시된 바와 같이, 리셋 기간(③)에서 픽셀의 제1 스위치 TFT(ST1)는 SDW용 스캔 신호(Pc)에 따라 턴 온 되어 게이트 노드(Ng)에 원복용 데이터전압(VREC)을 인가한다. 원복용 데이터전압(VREC)은 IDW용 데이터전압 또는 BDI용 데이터전압일 수 있다. SDW 구동 직전에 해당 픽셀 라인에 IDW용 데이터전압이 유지되어 있다면 원복용 데이터전압(VREC)은 IDW용 데이터전압이 된다. 반면, SDW 구동 직전에 해당 픽셀 라인에 BDI용 데이터전압이 유지되어 있다면 원복용 데이터전압(VREC)은 BDI용 데이터전압이 된다. 리셋 기간(③)에서 기준전압라인(16)은 DAC에 다시 연결되고, 픽셀의 제2 스위치 TFT(ST2)는 SDW용 센스 신호(Pd)에 따라 턴 온 되어 소스 노드(Ns)에 기준전압(Vref)을 인가한다. 이를 통해 리셋 기간(③)에서 픽셀의 게이트 노드(Ng)와 소스 노드(Ns) 간의 전압이 SDW 구동 직전의 상태로 원복된다.
도 16 및 도 17은 수평 방향 및 수직 방향에 배치된 라인들 사이에 발생할 수 있는 커플링 현상을 설명하기 위한 도면들이고, 도 18 및 도 19는 도 16 및 도 17에서 설명한 커플링 현상에 따라 수직 블랭크 기간 동안 야기될 수 있는 센싱 편차를 설명하기 위한 도면들이다.
도 16 및 도 17에 도시된 바와 같이, 제1 게이트라인(17A)과 제2 게이트라인(17B)은 수평 방향으로 배치되고 데이터라인(15)과 기준전압라인(16)은 수직 방향으로 배치된다. 이 때문에, 수평 방향의 수평라인들(17A, 17B) 및 수직 방향의 수직라인들(15, 16) 사이에는 기생 커패시터들(Cpar1 ~ Cpar3)이 형성된다. 특히, 기생 커패시터들(Cpar1 ~ Cpar3)에 충전되는 기생 전하량은 데이터라인(15)을 통해 인가되는 데이터전압들의 변화 즉 전압변동에 대응하여 증가 또는 감소한다. 제1 게이트라인(17A)과 제2 게이트라인(17B)을 하나의 게이트라인(Gate Line)으로 정의하고, 데이터전압의 변화에 따라 그 주변에 발생할 수 있는 커플링 현상을 설명하면 다음과 같다.
게이트라인(17A, 17B; Gate Line)을 통해 인가되는 게이트신호는 픽셀에 포함된 제1 스위치 TFT(ST1)나 제2 스위치 TFT(ST2)를 동작시킬 수 있는 전압 형태로 형성된다. 이 때문에, 데이터라인(15)을 통해 인가되는 데이터전압의 변화가 발생하면 기생 커패시터들(Cpar1 ~ Cpar3)에 충전되는 기생 용량의 변화를 일으키게 된다. 통상, 게이트신호는 로직하이나 로직로우의 전압 형태로 형성되므로 데이터전압의 변화에 대응하여 위로 또는 아래(Positive/Negative)로 커플링에 따른 전압 변화를 일으킨다.
게이트라인(17A, 17B; Gate Line)에 커플링 현상이 발생한 이후 P1, P2 및 P3 순으로 이어지는 지점에서 나타나는 전압 변화를 통해 알 수 있듯이, 이 현상은 시간에 따라 완만하게 복원되는 성질을 가지고 있다. 그러나 커플링 현상에 따른 기생 용량의 변화로 인한 여파는 전기적으로 플로팅(Floating) 상태에 놓여있는 기준전압라인(16)까지 영향을 미치게 되고 결국 센싱 편차를 야기할 수 있다.
도 18에 도시된 바와 같이, 센싱 편차 발생(S150)은 수직 블랭크 기간(VBP)이 시작(S110)된 다음 마지막 데이터라인에 블랙 영상 데이터(BD)가 인가된 경우(S120) 발생 가능성이 크다. 마지막 데이터라인에 블랙 영상 데이터(BD)가 인가된 경우(S120), 커플링 영향은 데이터라인과 게이트라인 간의 커플링(Data -> Gate Line)(S130) 그리고 게이트라인과 기준전압라인 간의 커플링(Gate -> Vref Line)(S140)으로 이어지는 것처럼 주변에 관계되어 있는 라인들로 전파된다.
이전의 설명을 통해 알 수 있듯이, 본 발명의 실시예는 2 가지의 클럭군을 가지므로 크게 2가지의 센싱 타이밍으로 나누어지게 되고, 이 타이밍을 기반으로 발광표시장치를 구동하면 도 11과 같이 픽셀 어레이를 복수의 A 영역들과 복수의 B 영역들로 분할 구동할 수 있다. 그리고 도 13과 같이 수직 블랭크 기간(VBP) 동안 특정 픽셀을 센싱 및 보상할 수 있는 SDW 구동할 수 있다. 그리고 수직 블랭크 기간(VBP)이 시작(S110)되기 전에는 입력 영상 데이터가 인가되지만 수직 블랭크 기간(VBP)이 시작(S110)된 다음에는 블랙 영상 데이터(BD)를 인가한다.
도 19(a) 및 도 19(b)와 같이, 데이터라인에 인가되는 데이터전압(Data)은 입력 영상 데이터(ID)이 인가되다가 수직 블랭크 기간(VBP)이 시작 되면 블랙 영상 데이터(BD)로 변하고 이후 센싱용 데이터(SD)로 변하게 된다. 도 19(a) 및 도 19(b)에서 볼 수 있듯이, 수직 블랭크 기간(VBP)이 시작된 다음 픽셀의 위치마다 블랙 영상 데이터(BD)가 인가되는 시간의 차이가 존재할 경우 "TS1, TS2"와 같이 센싱까지 걸리는 시간적인 측면에서도 차이가 존재하게 된다. 게다가, 데이터라인에 인가된 데이터전압(Data)과 기준전압라인에 인가된 기준전압(Vref)의 변화에서 보이듯이, 수직 블랭크 기간(VBP) 동안 전압 변화에 따른 커플링(Coupling) 영향을 받게 된다. 그리고 센싱까지 걸리는 시간 차이의 존재로 어느 한편(어떠한 영역에 존재하는 픽셀은)에서는 센싱 가능 시간이 짧아짐에 따른 영향을 받게 된다.
앞서 설명하였듯이, 커플링 영향은 시간에 따라 완만하게 복원되는 성질을 갖고 있지만 센싱까지 걸리는 시간 차이가 존재할 경우 센싱시간이 같더라도 센싱 시작 시점이 달라져 결국 센싱 편차로 이어지게 된다. 설명을 덧붙이면, SDW 구동은 프레임별로 적어도 하나의 특정 서브 픽셀을 대상으로 이루어지기 때문에 제I픽셀은 커플링 현상이 크게 나타나는 지점에서 센싱용 픽셀 전류가 샘플링이 되는 반면 이와 다른 위치의 제L픽셀은 커플링 현상이 적게 나타나는 지점에서 센싱용 픽셀 전류가 샘플링이 되어 양자 간의 센싱 편차를 야기하게 된다.
도 20 및 도 21은 제1예시에 따른 구동기법을 보여주는 도면들이고, 도 22 및 도 23은 제2예시에 따른 구동기법을 보여주는 도면들이다.
도 20에 도시된 바와 같이, 제1예시에 따른 구동기법은 입력 영상 데이터(ID)를 인가하다가 수직 블랭크 기간(VBP)이 시작 되면 입력 영상 데이터(ID)와 다른 데이터 예컨대 블랙 영상 데이터(BD)를 인가한다. 이때, 블랙 영상 데이터(BD) 등은 이전에 인가된 입력 영상 데이터(ID)의 특성에 따라 가변될 수 있다. 블랙 영상 데이터(BD)를 인가한 이후 SDW 구동을 위해 센싱용 데이터(SD)를 인가하고 이를 센싱하기 위한 샘플링신호(SAM)를 인가한다. 예컨대, 로직하이의 샘플링신호(SAM)가 인가되면 기준전압라인에 충전된 전압은 센싱부를 통해 센싱된다.
도 16 내지 도 19 등을 통해 설명한 바와 같이, 제1예시에 따른 구동기법을 사용할 경우 수직 블랭크 기간(VBP)이 시작된 이후 게이트라인(17A, 17B; Gate Line)에 커플링 현상에 따른 전압차가 형성된다. 이 때문에, 수직 블랭크 기간(VBP) 동안 예컨대, 도 11의 A영역에 존재하는 제I픽셀과 B영역에 존재하는 제L픽셀에 대한 SDW 구동을 위해 기준전압라인을 샘플링할 경우 도 21과 같이 설명된다.
도 21에 도시된 바와 같이, A영역에 존재하는 제I픽셀의 기준전압라인은 수직 블랭크 기간(VBP)이 시작된 이후 "T1" 시간이 지난 다음에 인가된 제1샘플링신호(SAM1)에 의해 샘플링이 이루어진다. 그리고 B영역에 존재하는 제L픽셀의 기준전압라인은 수직 블랭크 기간(VBP)이 시작된 이후 "T2" 시간이 지난 다음에 인가된 제2샘플링신호(SAM2)에 의해 샘플링이 이루어진다.
앞서 설명하였듯이, A영역에 존재하는 제I픽셀과 B영역에 존재하는 제L픽셀은 구동방법의 특성상 샘플링이 이루어지는 시간은 같지만 샘플링 시작 시점이 달라 "T1" 시간과 "T2" 시간과 같이 각기 다른 시점에서 샘플링이 이루어진다. 그러나 A영역에 존재하는 제I픽셀은 커플링 현상이 높은 P1 지점에서 샘플링이 이루어지는 반면 B영역에 존재하는 제L픽셀은 P1 보다 낮은 P2 지점에서 샘플링이 이루어진다.
그 결과, A영역에 존재하는 제I픽셀의 샘플링값과 B영역에 존재하는 제L픽셀의 샘플링값에 차이가 발생(SAM1 ≠ SAM2)하므로, 이 센싱 편차를 보정 또는 보상할 수 있는 편차 보상부가 필요하다.
도 22에 도시된 바와 같이, 제2예시에 따른 구동기법은 입력 영상 데이터(ID1)를 인가하다가 수직 블랭크 기간(VBP)이 시작 되더라도 데이터를 변경하지 않고 입력 영상 데이터(ID1)와 동일하게 유지한다. 설령, 수직 블랭크 기간(VBP) 직전에 입력 영상 데이터가(ID1)가 ID2나 ID3로 변경되더라도 센싱용 데이터(SD)가 인가되기 직전까지 입력(또는 변경)된 입력 영상 데이터(ID2나 ID3)와 동일한 데이터로 유지한다. 그리고 SDW 구동을 위해 입력 영상 데이터(ID1~ID3)의 인가를 차단함과 동시에 센싱용 데이터(SD)를 인가하고 이를 센싱하기 위한 샘플링신호(SAM)를 인가한다. 앞서 예와 마찬가지로, 로직하이의 샘플링신호(SAM)가 인가되면 기준전압라인에 충전된 전압은 센싱부를 통해 센싱된다.
제2예시에 따른 구동기법을 사용할 경우 수직 블랭크 기간(VBP)이 시작된 이후 게이트라인(17A, 17B; Gate Line)에 커플링 현상에 따른 전압차가 형성될 수 있으나 제1예시에 따른 구동기법보다 현저히 낮은 커플링 현상만 존재하거나 커플링 현상에 따른 영향은 거의 존재하지 않게 된다. 그 이유는 수직 블랭크 기간(VBP)에 들어서도 이전 데이터를 계속 유지하게 됨에 따라 데이터전압 변화에 따른 커플링 현상 발생이 억제되기 때문이다. 이 때문에, 수직 블랭크 기간(VBP) 동안 예컨대, 도 11의 A영역에 존재하는 제I픽셀과 B영역에 존재하는 제L픽셀에 대한 SDW 구동을 위해 기준전압라인을 샘플링할 경우 도 23과 같이 설명된다.
도 23에 도시된 바와 같이, A영역에 존재하는 제I픽셀의 기준전압라인은 수직 블랭크 기간(VBP)이 시작된 이후 "T1" 시간이 지난 다음에 인가된 제1샘플링신호(SAM1)에 의해 샘플링이 이루어진다. 그리고 B영역에 존재하는 제L픽셀의 기준전압라인은 수직 블랭크 기간(VBP)이 시작된 이후 "T2" 시간이 지난 다음에 인가된 제2샘플링신호(SAM2)에 의해 샘플링이 이루어진다.
앞서 설명하였듯이, A영역에 존재하는 제I픽셀과 B영역에 존재하는 제L픽셀은 구동방법의 특성상 샘플링이 이루어지는 시간은 같지만 샘플링 시작 시점이 달라 "T1" 시간과 "T2" 시간과 같이 각기 다른 시점에서 샘플링이 이루어진다. 그러나 A영역에 존재하는 제I픽셀과 B영역에 존재하는 제L픽셀은 커플링 편차가 거의 존재하지 않는 즉 커플링 편차가 수렴된 지점에서 샘플링이 이루어진다.
그 결과, A영역에 존재하는 제I픽셀의 샘플링값과 B영역에 존재하는 제L픽셀의 샘플링값은 거의 유사(SAM1 ≒ SAM2)하므로, 센싱 편차를 보정 또는 보상할 수 있는 편차 보상부를 생략(삭제)할 수 있다. 즉, 제2예시에 따른 구동기법은 커플링 현상 발생을 최소화하기 위해 입력 영상 데이터와 센싱용 데이터 사이에 일종의 커플링 보상 데이터(또는 커플링 안정화 데이터)를 삽입하는 기법이다.
이상의 설명에 따르면, 본 발명은 픽셀 어레이를 상하 2개의 영역들(A,B)로 분할 구동하기 위해 게이트 구동부에 인가되는 클록을 분리 운영(도 10a 등의 A 클럭군과 B 클럭군 참조)함에 따라 전·후반의 타이밍 차이와 이로 인한 센싱 편차 유발을 고려하여 제1예시 또는 제2예시에 따른 구동기법을 기반으로 장치를 구현할 수 있다. 그리고 본 발명은 수직 블랭크 기간(VBP)에 돌입하지 전에 인가된 데이터와 이에 따른 커플링 영향을 고려하여 제1예시에 따른 구동기법 또는 제2예시에 따른 구동기법 중 하나로 구동하도록 장치를 구현할 수 있다. 한편, 도 21 및 도 23에서의 샘플링 시점은 두 픽셀 간의 극단적인 비교를 위해 샘플링이 이루어지는 시점에 차이를 두고 설명한 예시의 하나로 이해되어야 한다.
이상 본 발명은 표시패널에 포함된 소자의 열화 개선이나 수명 향상을 위한 보상 동작시 유발될 수 있는 센싱 편차를 고려하여 장치 구현은 물론 구동방법을 선택할 수 있는 효과가 있다. 또한, 본 발명은 표시패널에 포함된 소자의 열화 개선을 보상 동작시 센싱 편차 발생 가능성을 최소화할 수 있어 균일하고 정확한 보상과 더불어 균일한 표시품질을 유지할 수 있는 효과가 있다. 또한, 본 발명은 표시패널에 포함된 소자의 열화 개선을 보상 동작시 픽셀 어레이를 상하 2개의 영역으로 분할 구동하기 위해 클록 배선을 분리하지 않고 공통으로 사용할 수 있어 베젤 영역의 증가를 방지할 수 있는 효과가 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
10: 표시패널 11: 타이밍 콘트롤러
12,13: 패널 구동부 15: 데이터라인(들)
16: 기준전압라인(들) PXL: 픽셀
17, 17A,17B: 게이트라인(들)

Claims (10)

  1. 다수의 픽셀들로 구현된 픽셀 라인들이 적어도 하나 이상의 A 영역과 적어도 하나 이상의 B 영역으로 구분된 표시패널;
    상기 픽셀 라인들에 연결된 패널 구동부; 및
    상기 패널 구동부의 동작을 제어하여, 상기 A 영역과 상기 B 영역 중 어느 하나에 속하는 복수의 픽셀 라인들에 입력 영상 데이터를 순차적으로 기입하기 위한 IDW(Image Data Writing) 구동을 구현하고, 상기 IDW 구동이 이뤄지지 않는 수직 블랭크 기간에서 상기 A 영역과 상기 B 영역 중 어느 하나에 속하는 특정 픽셀 라인에 센싱용 데이터를 기입하기 위한 SDW(Sensing Data Writing) 구동을 구현하는 타이밍 콘트롤러를 포함하고,
    상기 타이밍 콘트롤러는 상기 수직 블랭크 기간 동안 상기 입력 영상 데이터와 상기 센싱용 데이터 사이에 커플링 보상 데이터를 기입하고,
    상기 타이밍 콘트롤러는
    상기 A 영역과 상기 B 영역 중 나머지 하나에 속하는 복수의 픽셀 라인들에 블랙 영상 데이터를 동시에 삽입하기 위한 BDI(Back Data Insertion) 구동을 구현하는 발광표시장치.
  2. 제1항에 있어서,
    상기 커플링 보상 데이터는
    상기 수직 블랭크 기간이 시작되기 직전에 인가된 직전 입력 영상 데이터를 기반으로 마련되는 발광표시장치.
  3. 제1항에 있어서,
    상기 커플링 보상 데이터는
    상기 수직 블랭크 기간이 시작되기 직전에 인가된 직전 입력 영상 데이터와 동일한 발광표시장치.
  4. 제1항에 있어서,
    상기 커플링 보상 데이터는
    상기 센싱용 데이터가 인가되기 직전까지 인가 상태가 유지되는 발광표시장치.
  5. 삭제
  6. 제1항에 있어서,
    상기 타이밍 콘트롤러는
    상기 수직 블랭크 기간 동안 상기 블랙 영상 데이터를 상기 커플링 보상 데이터로 사용하는 발광표시장치.
  7. 제6항에 있어서,
    상기 타이밍 콘트롤러는
    상기 블랙 영상 데이터 사용에 의해 상기 표시패널에 배치된 수평라인들과 수직라인들 간의 커플링 현상에 따른 센싱 편차를 보상하는 편차 보상부를 포함하는 발광표시장치.
  8. 표시패널에서 다수의 픽셀들로 구현된 픽셀 라인들이 적어도 하나 이상의 A 영역과 적어도 하나 이상의 B 영역으로 구분된 발광표시장치의 구동방법에 있어서,
    상기 A 영역과 상기 B 영역 중 어느 하나에 속하는 복수의 픽셀 라인들에 입력 영상 데이터를 순차적으로 기입하기 위한 IDW(Image Data Writing) 구동 및 상기 A 영역과 상기 B 영역 중 나머지 하나에 속하는 복수의 픽셀 라인들에 블랙 영상 데이터를 동시에 삽입하기 위한 BDI(Back Data Insertion) 구동을 구현하는 단계;
    상기 IDW 구동이 이뤄지지 않는 수직 블랭크 기간에서 상기 A 영역과 상기 B 영역 중 어느 하나에 속하는 특정 픽셀 라인에 센싱용 데이터를 기입하기 위한 SDW(Sensing Data Writing) 구동을 구현하는 단계; 및
    상기 수직 블랭크 기간 동안 상기 입력 영상 데이터와 상기 센싱용 데이터 사이에 커플링 보상 데이터를 기입하는 단계를 포함하는 발광표시장치의 구동방법.
  9. 제8항에 있어서,
    상기 커플링 보상 데이터는
    상기 수직 블랭크 기간이 시작되기 직전에 인가된 직전 입력 영상 데이터와 동일하게 마련되는 발광표시장치의 구동방법.
  10. 제8항에 있어서,
    상기 커플링 보상 데이터는
    상기 센싱용 데이터가 인가되기 직전까지 인가 상태가 유지되는 발광표시장치의 구동방법.
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