KR102246419B1 - 전기 인터페이스 - Google Patents

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로젠버거 호흐프리쿠벤츠테흐닉 게엠베하 운트 코. 카게
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Abstract

본 발명은 전기 인터페이스 특히, 인터포저에 관한 것으로서, 제1 및 제2 접촉면(18, 20, 18a, 20a)을 각각 구비하고, 적어도 하나의 제1 접촉면 쌍(19, 19a)을 가진 제1 연결 평면(12), 및 제3 및 제4 접촉면(22, 24, 22a, 24a)을 각각 구비하고, 적어도 하나의 제2 접촉면 쌍(23, 23a)을 가진 제2 연결 평면(14)을 구비한다. 제1 및 제2 접촉면 쌍(18, 20, 18a, 20a)의 각각을 위하여, 제1 연결 평면(12)의 제1 접촉면(18, 18a)을 제2 연결 평면(14)의 제3 접촉면(22, 22a)에 전기적으로 연결하는 제1 전기 연결(26, 26a) 및 제1 연결 평면(12)의 제2 접촉면(20, 20a)을 제2 연결 평면(14)의 제4 접촉면(24, 24a)에 전기적으로 연결하는 제2 전기 연결(28, 28a)을 구비한다. 제1 및 제3 접촉면(18, 18a, 22, 22a) 사이의 제1 전기 연결(26, 26a)은 특정의 제1 기하학적 길이를 가지고 제2 및 제4 접촉면(20, 20a, 24, 24a) 사이의 제2 전기 연결(28, 28a)은 특정의 제2 기하학적 길이를 가지며, 제1 및 제2 기하학적 길이들은 상이하게 되어 있다.

Description

전기 인터페이스{ELECTRIC INTERFACE}
본 발명은 전기 인터페이스에 관한 것으로서, 특히 청구항 1에 따른, 제1 및 제2 접촉면을 포함하는 적어도 하나의 제1 접촉면 쌍을 각각 가진 제1 연결 평면, 및 제3 및 제4 접촉면을 포함하는 적어도 하나의 제2 접촉면 쌍을 각각 가진 제2 연결 평면을 구비하고, 제1 및 제2 접촉면 쌍의 각각을 위하여, 제1 연결 평면의 제1 접촉면을 제2 연결 평면의 제3 접촉면에 전기적으로 연결하는 제1 전기 연결, 및 제1 연결 평면의 제2 접촉면을 제2 연결 평면의 제4 접촉면에 전기적으로 연결하는 제2 전기 연결을 구비하는, 인터포저(interposer)에 관한 것이다.
대형 컴퓨터 시스템 내에서, 서버를 각각 형성하고, 실장된 인쇄회로기판들의 형태로, 또한 “블레이드들”로서 명명되는 다양한 프로세서 보드들이, 플러그-인 슬롯들을 통해 그 자체가 또한 실장된 인쇄회로기판인, 소위 “백플레인(backplane)”에 전기적으로 그리고 기계적으로 연결되는 것이 보통이다. 이러한 목적을 위하여, 각각의 블레이드와 관련된 백플레인 사이에서 상응하는 데이터 전송 채널들을 수립하기 위하여 한편으로, 블레이드들 상의 플러그 커넥터들 또는 연결 포인트들과 다른 한편으로, 백플레인 상의 플러그 커넥터들 또는 연결 포인트들 사이의 접촉을 수립하는 앵글(angle) 커넥터들이 제공된다.
그러나, 앵글 커넥터를 통한 전기 연결은 전기 연결들의 고-주파 신호 전송 성질에 영향을 미치는 다양한 상이한 문제점들을 야기한다. 예를 들어, 인쇄회로기판 플러그 커넥터들 내의 도체들은 모두 85옴(Ohm)의 동일한 임피던스를 가져야만 한다. 그러나, 기하학적 환경들 때문에, 만약 이들이 제1 평면으로부터 제2 평면까지 뻗어 있는 최단 경로들 상에 직접적으로 배치되면, 앵글 플러그 커넥터 내의 모든 도체들이 동일한 기하학적 길이를 가지지는 것은 아니다. 그러나, 도체들은 앵글 커넥터들 내에 파동과 같은 방식으로 종종 놓여지기 때문에, 모든 도체들이 동일한 기하학적 길이 및 따라서 동일한 전기적 길이를 가지기 위해서, 앵글 커넥터의 도체들을 통한 고-주파 신호들의 전송 내의 위상차들이 회피되어야 한다. 그러나, 이것은 파동과 같은 방식의 간격 변화에 기인하여 85옴의 필요한 특성 임피던스가 2개의 인접한 도체들 사이의 각각의 포인트에 존재하지 않는 단점을 가진다. 인쇄회로기판 플러그 커넥터 내의 도체들은 서로 영향을 미치기 때문에, 예를 들어 고-주파 신호들의 차동 전송 동안, 도체들의 코스(course)를 따라 이러한 변화하는 특성 임피던스는 최대 전송가능한 대역폭과 비트 전송률의 면에서 엄청난 제약들로 이어진다.
본 발명은 고-주파 신호들의 전송 동안 높은 대역폭들과 비트 전송률들이 얻어지도록 전술한 형태의 전기 인터페이스를 개선하는 문제점에 기반한다.
본 발명에 따르면, 이러한 문제점은 청구항 1의 구성요소들을 특징으로 하는 전술한 형태의 전기 인터페이스를 통해 해결된다. 본 발명의 유용한 실시예들은 다른 청구항들에 개시된다.
본 발명에 따르면, 전술한 형태의 전기 인터페이스는, 제1 및 제3 접촉면 사이의 제1 전기 연결이 특정의 제1 기하학적 길이를 가지고, 제2 및 제4 접촉면 사이의 제2 전기 연결이 특정의 제2 기하학적 길이를 가지며, 제1 및 제2 기하학적 길이는 상이하게 되어 있다.
이것은, 전기 인터페이스를 사용하면, 예를 들어, 제1 및 제3 접촉면을 통해 전송되는 제1 전기 신호 컴포넌트와 제2 및 제4 접촉면을 통해 전송되는 제2 전기 신호 컴포넌트 사이의, 전기 인터페이스에 인접하는 회로들에 기인하는, 실행 시간 또는 위상차들이 의도적으로 영향을 받고 특히 영(zero)의 차이로 보상되는 점에서 장점을 가진다.
전기 앵글 커넥터를 통해 전송되는 신호들의 실행 시간 또는 위상차들을 보상하기 위하여, 전기 인터페이스는 데이터 신호의 차동 전송을 위해 적어도 하나의 도체 쌍을 가진 연결 포인트를 가진 전기 앵글 커넥터의 편평한 끝단면과 인쇄회로기판 상의 접촉면들 사이에 개재되도록 설계된다.
성형 콰드(star quad) 케이블 방식으로, 또는 성형 콰드 케이블의 끝단면들과 접촉하도록 구성된 접촉면들의 배치가 2개의 제1 및 제2 접촉면 쌍들 내에서 얻어지고, 제1 접촉면 쌍의 제1 및 제2 접촉면이 각각의 경우 서로 대각선으로 반대로(서로 마주보도록) 배치되도록 제1 연결 평면 상의 2개의 제1 접촉면 쌍들의 제1 및 제2 접촉면들이 정사각형의 코너들에 배치되고, 제2 접촉면 쌍의 제3 및 제4 접촉면이 각각의 경우 서로 대각선으로 반대로(서로 마주보도록) 배치되도록 제2 연결 평면 상의 2개의 제2 접촉면 쌍들의 제3 및 제4 접촉면들이 정사각형의 코너들에 배치된다.
모든 제1 전기 연결들이 서로에 대해 동일한 기하학적 길이를 가지고 모든 제2 전기 연결들이 서로에 대해 동일한 기하학적 길이를 가지는 점에서, 모든 도체들 또는 접촉면 쌍들을 위해 실행 시간 또는 위상차들의 동일한 보상이 얻어진다.
제1 및 제2 연결 평면이 서로 평행하게 배치되는 점에서, 작은 구성 공간이 필요한 전기 인터페이스가 얻어진다.
제2 전기 연결이 연결 평면들에 직교하는 방향에서 제1 연결 평면으로부터 제2 연결 평면까지 뻗어 있는 관통-연결인 점에서, 실질적으로 0(zero)의 값을 가진 제2 전기 연결을 위한 기하학적 길이가 얻어진다.
연결 평면들에 직교하는 방향에서 서로 정렬하기 위하여 제1 및 제2 접촉면 쌍의 제2 및 제4 접촉면이 배치되고, 제1 및 제2 접촉면 쌍의 제1 및 제3 접촉면이 연결 평면들에 직교하는 방향에서 서로로부터 분리되는 점에서, 특히 양호한 임피던스-제어된 전기 인터페이스가 얻어진다.
제1 및 제2 접촉 평면 사이에 배치된 제3 평면이 형성되고, 제1 전기 연결과 제2 전기 연결이 제3 평면 내에 형성되는 점에서, 특히 전기적으로 기계적으로 간단하고 기능적으로 신뢰할 수 있는 구조가 얻어진다.
제3 평면이 제1 및/또는 제2 연결 평면에 평행하게 형성되는 점에서, 전기적으로 특히, 임피던스의 면에서 잘 제어될 수 있는 컴팩트한 구조가 얻어진다.
본 발명은 첨부된 도면을 참조하여 아래에서 설명된다.
도 1은 본 발명의 전기 인터페이스의 예시적 실시예의 평면도이다.
도 2는 도 1에 따른 전기 인터페이스의 측면도이다.
도 3은 도 1의 전기 인터페이스의 사시도이다.
도 4는 하측이 생략된 채로 도 1에 따른 전기 인터페이스의 평면도이다.
도 5는 위에서부터 하측만 예시되도록 상측이 생략된 도 1에 따른 전기 인터페이스의 평면도이다.
도 6은 앵글 커넥터와 함께 사용된 도 1에 따른 전기 인터페이스를 도시한다.
도 7은 도 6에 따른 앵글 커넥터의 상세도를 도시한다.
도 1 내지 도 5에 예시된 전기 인터페이스(10)의 바람직한 실시예는 제1 연결 평면(12), 제2 연결 평면(14) 및 모두 서로 평행하게 방위된 제3 평면(16)을 구비하고, 제3 평면(16)은 제1 및 제2 연결 평면(12, 14) 사이에 배치된다. 제1 접촉면(18, 18a)과 제2 접촉면(20, 20a)을 각각 가진, 2개의 제1 접촉면 쌍들(19, 19a)은 제1 연결 평면(12) 내에 배치된다. 제3 접촉면(22, 22a)과 제4 접촉면(24, 24a)을 각각 가진 2개의 제2 접촉면 쌍들(23, 23a)은 제2 연결 평면(14) 내에 배치된다. 이와 관련하여, “평면”이라는 용어는 3-차원 공간 내에서 2-차원 물체로서 간주되는 경계가 정해진 레벨 또는 편평한 표면을 의미한다. 아래에서 기술되는 예시적 실시예에서, “평면들(12, 14, 16)”은 편평한(즉, 만곡이 없는), 정사각형 표면들이다.
제1 연결 평면(12) 내에서 하나의 제1 접촉면 쌍(19)의 제1 접촉면(18)은 제1 전기 연결(26)을 통해 제2 연결 평면(14) 내의 제2 접촉면 쌍(23)의 제3 접촉면(22)과 전기적으로 연결된다. 제1 연결 평면(12) 내의 제1 접촉면 쌍(19)의 제2 접촉면(20)은 제2 전기 연결(28)을 통해 제2 연결 평면(14) 내의 제2 접촉면 쌍(23)의 제4 접촉면(24)에 전기적으로 연결된다.
제1 연결 평면(12) 내의 제1 접촉면 쌍(19a)의 제1 접촉면(18a)은 다른 제1 전기 연결(26a)을 통해 제2 연결 평면(14) 내의 다른 제2 접촉면 쌍(23a)의 제3 접촉면(22a)과 전기적으로 연결된다. 제1 연결 평면(12) 내의 다른 제1 접촉면 쌍(19a)의 제2 접촉면(20a)은 다른 제2 전기 연결(28a)을 통해 제2 연결 평면(14) 내의 다른 제2 접촉면 쌍(23a)의 제4 접촉면(24a)에 전기적으로 연결된다.
다시 말해서, 인터페이스(10) 내에서, 제1 연결 평면(12) 내의 하나의 제1 접촉면 쌍(19)은 제2 연결 평면(14) 내의 하나의 제2 접촉면 쌍(23)으로 트랜스포즈(transpose) 되고 제1 연결 평면(12) 내의 다른 제1 접촉면 쌍(19a)은 제2 연결 평면(14) 내의 다른 제2 접촉면 쌍(23a)으로 트랜스포즈 된다.
2개의 제1 전기 연결들(26, 26a)은 제3 평면(16) 내에 배치되고 제1 및 제2 접촉 평면(12, 14)에 실질적으로 평행하게 뻗어 있다. 2개의 제2 전기 연결들(28, 28a)은 제1 연결 평면(12)으로부터, 제3 평면(16)을 통해, 제2 연결 평면(14)까지 뻗어 있고, 3개의 평면들(12, 14, 16)에 실질적으로 수직으로 뻗어 있는 관통-연결들이다. 제1 전기 연결들(26, 26a)의 기하학적 길이들은 동일하고 동시에 제2 전기 연결들(28, 28a)의 각각의 기하학적 길이들보다 길다. 제2 전기 연결들(28, 28a)의 기하학적 길이들 또한 서로 동일하다.
제1 연결 평면(12) 내의 제1 및 제2 접촉면들(18, 18a, 20, 20a)은 제1 연결 평면(12) 내의 가상의 정사각형(40)(도 4)의 코너들에 배치됨으로써, 접촉면 쌍(19 또는 19a)의 접촉면들(18, 20 또는 18a, 20a)은 서로 대각선으로 반대편에 배치된다. 그러므로, 예시된 실시예에서, 하나의 제1 접촉면 쌍(19)의 제1 및 제2 접촉면(18, 20)은 가상의 정사각형(40)(도 4)에 대하여 서로 대각선으로 반대로 배치되고 다른 제1 접촉면 쌍(19a)의 제1 및 제2 접촉면(18a, 20a)은 가상의 정사각형(40)(도 4)의 코너들에서 서로 대각선으로 반대로 배치된다.
유사하게, 제2 연결 평면(14)에서, 제2 접촉면 쌍들(23 또는 23a)의 제3 및 제4 접촉면들(22, 24 또는 22a, 24a)은 제2 연결 평면(14) 내의 가상의 정사각형(50)(도 5)의 코너들에서 서로 대각선으로 반대로 배치된다. 그러므로, 예시된 실시예에서, 제2 접촉면 쌍(23)의 제3 및 제4 접촉면(22, 24)은 가상의 정사각형(50)(도 50)에 대하여 서로 대각선으로 반대로 배치되고 다른 제2 접촉면 쌍(23a)의 제3 및 제4 접촉면(22a, 24a)은 가상의 정사각형(50)(도 5)에 대하여 서로 대각선으로 반대로 배치된다.
전술한 제1 연결 평면(12) 내의 제1 및 제2 접촉면들(18, 20, 18a, 20a)의 배치 또는 소위, “푸트프린트(footprint)”는 동일한 치수들과 배치들을 이용하여 본 발명의 인터페이스(10)를 통해 전술한 제2 연결 평면 내의 제3 및 제4 접촉면들(22, 24 또는 22a, 24a)의 배치 또는 “푸트프린트”로 트랜스포즈 된다. 동시에, 제1 접촉면(18, 18a)과 제3 접촉면(22, 22a) 사이의 전기 연결을 제공하는 제1 전기 연결(26, 26a)의 도움으로, 기하학적 경로들 및 따라서 전송된 고-주파 신호를 위한 전기적 경로들은 제2 접촉면(20, 20a)과 제4 접촉면(24, 24a) 사이의 제2 전기 연결들(28, 28a)과 비교하여 길어지게 된다.
접촉면 쌍들(19, 19a, 23, 23a)의 접촉면들(18/20, 18a/20a, 22/24, 22a/24a)의 배치는, 특히 고-주파 신호들의 차동 전송에 적합한, 소위, 성형 콰드 전송 케이블 내의 도체들의 배치에 상응한다. 그러므로, 본 발명에 따른 인터페이스는, 도 6에 예시된 바와 같은, 앵글 커넥터와 인쇄회로기판(미도시) 사이의 인터포저의 역할을 한다. 도 7로부터 볼 수 있는 바와 같이, 도 6에 예시된 앵글 커넥터는, 성형 콰드 케이블의 방식으로 배치된, 2쌍의 도체들(32, 34, 32a, 34a)을 포함하고, 앵글 커넥터(30)의 각각의 단면에서 도체들은 가상의 정사각형(36)의 코너들에 배치되고, 도체의 2개의 도체들(32, 34 또는 32a, 34a)은 가상의 정사각형(36)에 대하여 항상 서로 대각선으로 반대로 배치된다. 다시 말해서, 한편으로 도체들(32, 34)은 가상의 정사각형(36)에 관하여 서로 대각선으로 반대로 배치되고 다른 한편으로 도체들(32a, 34a)은 가상의 정사각형(36)에 관하여 서로 대각선으로 반대로 배치된다.
도 6에 도시된 앵글 커넥터(30)는 90°의 각도를 가지므로, 도체들(34, 34a)이 내측 트랙을 따라 뻗어 있고 도체들(32, 32a)이 앵글 커넥터(30)의 90° 각도 주변의 외측 트랙을 따라 뻗어 있기 때문에, 도체들(34, 34a)은, 앵글 커넥터(30)의 일단으로부터 타단까지, 도체들(32, 32a)보다 더 짧은 기하학적 길이를 가진다. 앵글 커넥터(30) 내의 더 짧은 기하학적 경로들을 가진 도체들(34, 34a) 각각이 제1 연결 평면(12) 내의 2개의 제1 접촉면들(18, 18a) 상에서 만나도록 앵글 커넥터(30)와 인쇄회로기판(미도시) 사이에, 소위 인터포저로서, 인터페이스(10)가 배치됨으로써, 하나의 제1 접촉면(18)은 도체(34)와 전기적으로 접촉하고 다른 제1 접촉면(18a)은 도체(34a)와 전기적으로 접촉한다. 동시에, 도체(32)는 하나의 제2 접촉면(20)과 전기적으로 접촉하고 도체(32a)는 제1 연결 평면(12) 내의 다른 제2 접촉면(20a)과 전기적으로 접촉한다. 도체들(32, 32a)을 통해 전송되는 전기적 신호들이 관통-연결(28, 28a)의 도움으로 제2 접촉면들(20, 20a)로부터, 인터페이스(10)를 관통하는 최단 경로에 의해, 제2 연결 평면(14) 내의 제4 접촉면들(24, 24a)까지 직접적으로 전송되는 한편, 도체들(34, 34a)로부터 전송되는 신호들은 긴 제1 제1 전기 연결들(26, 26a)들을 통해 제3 접촉면들(22, 22a)로 전송된다. 그러므로, 제1 전기 도체들(26, 26a)은 다른 도체들(32, 32a) 상에서 전송되는 신호들에 대한 위상 또는 실행 시간 변환이 보상되는 그들의 기하학적 길이의 면에서 그렇게 설계된다. 다시 말해서, 앵글 커넥터(30) 내의 기하학적으로 더 긴 도체들(32, 32a)에 대한 앵글 커넥터(30) 내의 기하학적으로 더 짧은 도체들(34, 34a) 사이의 위상 또는 실행 시간 변환은 제1 전기 연결(26, 26a)에 의해 보상된다. 각각의 경우 앵글 커넥터(30) 내에서 서로 대각선으로 반대로 배치된 도체 쌍(32, 34 또는 32a, 34a)을 위해 보상이 발생되므로, 도체(32)에 대한 도체(34) 내의 신호의 위상 또는 실행 시간 변환은 하나의 제1 전기 연결(26)을 통해 보상되고 도체(32a)에 대한 도체(34a) 내의 신호의 위상 또는 실행 시간 변환은 다른 제1 전기 연결(26a)을 통해 보상된다.
각각의 도체(32, 34, 32a, 34a)는 예를 들어, 0.3mm의 직경을 가진 구리선(42)뿐만 아니라 예를 들어, 테프론으로 제조된 코팅(44)을 구비한다. 4개의 도체들(32, 34, 32a, 34a)은 예를 들어, 1.7mm의 직경을 가진, 유전체(46) 내에 내장된다. 유전체는 예를 들어, 폴리옥시메틸렌(축약:POM) 물질로 제조된다.
연결 평면들(12, 14)은 예를 들어, NELCO®N4000-13으로 명명되고 예를 들어, 4mm의 두께를 가진 에폭시 수지 라미네이트로부터 제조된다.
10…전기 인터페이스
12…제1 연결 평면
14…제2 연결 평면
16…제3 평면
18, 18a…제1 접촉면
19, 19a…제1 접촉면 쌍
22, 22a…제3 접촉면
23, 23a…제2 접촉면 쌍
24, 24a…제4 접촉면
26, 26a…제1 전기 연결
28, 28a…제2 전기 연결
30…앵글 커넥터
32, 32a, 34, 34a…도체
36, 40, 50…가상의 정사각형
42…구리선
46…유전체

Claims (19)

  1. 인터 포저(interpose)와 같은 전기 인터페이스에 있어서,
    제1 및 제2 접촉면(18, 20, 18a, 20a)을 각각 구비하고, 2개의 제1 접촉면 쌍(19, 19a)을 가진 제1 연결 평면(12), 및 제3 및 제4 접촉면(22, 24, 22a, 24a)을 각각 구비하고, 2개의 제2 접촉면 쌍(23, 23a)을 가진 제2 연결 평면(14)을 구비하고,
    제1 전기 연결(26, 26a)은 상기 제1 연결 평면(12)의 제1 접촉면(18, 18a)을 상기 제2 연결 평면(14)의 제3 접촉면(22, 22a)에 전기적으로 연결하고, 제2 전기 연결(28, 28a)은 상기 제1 연결 평면(12)의 제2 접촉면(20, 20a)을 상기 제2 연결 평면(14)의 제4 접촉면(24, 24a)에 전기적으로 연결하고,
    제1 및 제3 접촉면(18, 18a, 22, 22a) 사이의 상기 제1 전기 연결(26, 26a)은 특정의 제1 기하학적 길이를 가지고 제2 및 제4 접촉면(20, 20a, 24, 24a) 사이의 상기 제2 전기 연결(28, 28a)은 특정의 제2 기하학적 길이를 가지며, 제1 및 제2 기하학적 길이들은 상이하고,
    상기 제1 연결 평면(12) 상에 2개의 제1 접촉면 쌍(19, 19a)의 상기 제1 및 제2 접촉면(18, 20, 18a, 20a)은 정사각형의 코너들에 배치되어, 제1 접촉면 쌍(19, 19a)의 제1 및 제2 접촉면(18, 20, 18a, 20a)은 서로 대각선으로 마주보도록(diagonally opposite) 배치되고, 상기 제2 연결 평면(14) 상에 2개의 제2 접촉면 쌍(23, 23a)의 상기 제3 및 제4 접촉면(22, 24, 22a, 24a)은 정사각형의 코너들에 배치되어, 제2 접촉면 쌍(23, 23a)의 제3 및 제4 접촉면(22, 24, 22a, 24a)은 서로 대각선으로 마주보도록 배치되는, 전기 인터페이스.
  2. 제 1항에 있어서,
    상기 제1 전기 연결(26, 26a)은 상기 제1 연결 평면(12) 및/또는 제2 연결 평면(14)과 평행하게 뻗어 있는 편편한 도체 트랙으로 설계된, 전기 인터페이스.
  3. 제 1항에 있어서,
    상기 제1 연결 평면(12) 및 제2 연결 평면(14)은 서로 평행하게 배치되는, 전기 인터페이스.
  4. 제 3항에 있어서,
    제1 및 제2 접촉면 쌍(19, 23, 19a, 23a)의 상기 제2 및 제4 접촉면(20, 24, 20a, 24a)은 상기 연결 평면들(12, 14)에 직교하는 방향에서 서로 정렬되도록 배치되고,
    제1 및 제2 접촉면 쌍(19, 23, 19a, 23a)의 상기 제1 및 제3 접촉면(18, 22, 18a, 22a)은 상기 연결 평면들(12, 14)에 직교하는 방향에서 서로로부터 이격되도록 배치되는, 전기 인터페이스.
  5. 제 1항에 있어서,
    상기 제1 연결 평면(12)과 상기 제2 연결 평면(14) 사이에 배치된 제3 평면(16)을 포함하고,
    상기 제1 전기 연결(26, 26a)과 상기 제2 전기 연결(28, 28a)은 상기 제3 평면(16) 내에 형성되는, 전기 인터페이스.
  6. 제 5항에 있어서,
    상기 제3 평면(16)은 상기 제1 연결 평면(12) 및/또는 제2 연결 평면(14)에 평평하게 형성되는, 전기 인터페이스.
  7. 제 1항에 있어서,
    상기 전기 인터페이스(10)는 데이터 신호들의 차동 전송을 위해 적어도 하나의 도체 쌍(32, 34 또는 32a, 34a)을 가진 전기 앵글 커넥터(30)의 편평한 끝단면과 인쇄회로기판 상의 접촉면들을 가진 연결 포인트 사이에 개재되도록 설계된, 전기 인터페이스.
  8. 삭제
  9. 제 7항에 있어서,
    모든 제1 전기 연결들(26, 26a)은 서로에 대해 동일한 기하학적 길이를 가지고, 모든 제2 전기 연결들(28, 28a)은 서로에 대해 동일한 기하학적 길이를 가지는, 전기 인터페이스.
  10. 제 3항에 있어서,
    상기 제2 전기 연결(28, 28a)은 연결 평면들(12, 14)에 직교하는 방향에서 상기 제1 연결 평면(12)으로부터 상기 제2 연결 평면(14)까지 뻗어 있는 관통-연결인, 전기 인터페이스.
  11. 제 10항에 있어서,
    제1 및 제2 접촉면 쌍(19, 23, 19a, 23a)의 상기 제2 및 제4 접촉면(20, 24, 20a, 24a)은 상기 연결 평면들(12, 14)에 직교하는 방향에서 서로 정렬되도록 배치되는, 전기 인터페이스.
  12. 제 10항에 있어서,
    제1 및 제2 접촉면 쌍(19, 23, 19a, 23a)의 상기 제1 및 제3 접촉면(18, 22, 18a, 22a)은 상기 연결 평면들(12, 14)에 직교하는 방향에서 서로로부터 이격되도록 배치되는, 전기 인터페이스.
  13. 제 9항에 있어서,
    상기 제1 연결 평면(12) 및 제2 연결 평면(14)은 서로 평행하게 배치되는, 전기 인터페이스.
  14. 제 13항에 있어서,
    상기 제1 연결 평면(12)과 상기 제2 연결 평면(14) 사이에 배치된 제3 평면(16)을 포함하고,
    상기 제1 전기 연결(26, 26a)과 상기 제2 전기 연결(28, 28a)은 상기 제3 평면(16) 내에 형성되는, 전기 인터페이스.
  15. 제 14항에 있어서,
    상기 제3 평면(16)은 상기 제1 연결 평면(12) 및/또는 제2 연결 평면(14)에 평평하게 형성되는, 전기 인터페이스.
  16. 제 15항에 있어서,
    상기 제1 전기 연결(26, 26a)은 상기 제1 연결 평면(12) 및/또는 제2 연결 평면(14)과 평행하게 뻗어 있는 편편한 도체 트랙으로 설계된, 전기 인터페이스.
  17. 인터 포저(interpose)와 같은 전기 인터페이스에 있어서,
    제1 및 제2 접촉면(18, 20, 18a, 20a)을 각각 구비하고, 2개의 제1 접촉면 쌍(19, 19a)을 가진 제1 연결 평면(12), 및 제3 및 제4 접촉면(22, 24, 22a, 24a)을 각각 구비하고, 2개의 제2 접촉면 쌍(23, 23a)을 가진 제2 연결 평면(14)을 구비하고,
    제1 전기 연결(26, 26a)은 상기 제1 연결 평면(12)의 제1 접촉면(18, 18a)을 상기 제2 연결 평면(14)의 제3 접촉면(22, 22a)에 전기적으로 연결하고, 제2 전기 연결(28, 28a)은 상기 제1 연결 평면(12)의 제2 접촉면(20, 20a)을 상기 제2 연결 평면(14)의 제4 접촉면(24, 24a)에 전기적으로 연결하고,
    제1 및 제3 접촉면(18, 18a, 22, 22a) 사이의 상기 제1 전기 연결(26, 26a)은 특정의 제1 기하학적 길이를 가지고 제2 및 제4 접촉면(20, 20a, 24, 24a) 사이의 상기 제2 전기 연결(28, 28a)은 특정의 제2 기하학적 길이를 가지며, 제1 및 제2 기하학적 길이들은 상이하고,
    모든 제1 전기 연결들(26, 26a)은 서로에 대해 동일한 기하학적 길이를 가지고, 모든 제2 전기 연결들(28, 28a)은 서로에 대해 동일한 기하학적 길이를 가지는, 전기 인터페이스.
  18. 제 17항에 있어서,
    상기 제1 전기 연결(26, 26a)은 상기 제1 연결 평면(12) 및/또는 제2 연결 평면(14)과 평행하게 뻗어 있는 편편한 도체 트랙으로 설계되고,
    상기 제2 전기 연결(28, 28a)은 연결 평면들(12, 14)에 직교하는 방향에서 상기 제1 연결 평면(12)으로부터 상기 제2 연결 평면(14)까지 뻗어 있는 관통-연결인, 전기 인터페이스.
  19. 제 17항에 있어서,
    상기 제1 연결 평면(12) 및 제2 연결 평면(14)은 서로 평행하게 배치된, 전기 인터페이스.

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