KR101100965B1 - 디지털 제어 vga를 갖는 스태거형 agc - Google Patents
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Abstract
Description
Claims (19)
- 무선 주파수 신호가 수신되고, 다운컨버팅(downconverting)되고, I(in-phase) 및 Q(quadrature) 신호 경로로 처리되는 무선 수신기에서의, 자동 이득 제어(Automatic Gain Control; AGC) 방법에 있어서,⒜ 다중 자동 이득 제어(AGC) 스테이지를 갖는 I/Q 베이스밴드 스트립(baseband strip)의 특정 스테이지에서 - 여기서, 상기 다중 AGC 스테이지는 각각은 상기 다중 AGC 스테이지 각각과 연관된 제어 신호를 국부적으로 발생시킴 - ,ⅰ. 상기 특정 AGC 스테이지와 연관된 개별 I 및 Q 가변 이득 증폭기(Variable Gain Amplifier; VGA)들로부터 수신되는 개별 I 및 Q 출력 신호들을 검파하여 검파된 I 및 Q 신호를 생성하고;ⅱ. 상기 검파된 I 및 Q 신호와 적어도 하나의 기준 신호 사이의 차에 응답하여 적어도 하나의 디지털 카운터 신호를 생성하고;ⅲ. 상기 적어도 하나의 디지털 카운터 신호와 상기 적어도 하나의 기준 신호를 멀티플렉싱하여 제어 신호를 생성하며;ⅳ. 상기 제어 신호로 상기 개별 I 및 Q VGA들을 제어하는 것; 및⒝ 각 AGC 스테이지를 통해 상기 ⒜를 반복하는 것을 포함하고,상기 개별 I 및 Q 출력 신호들을 검파하는 것은,개별 고역 통과 필터(high pass filter; HPF)들을 통해 상기 개별 I 및 Q 출력 신호들을 통과시켜서 직류 오프셋을 제거하고;필터링된 상기 개별 I 및 Q 출력 신호들을 각각 정류하고;필터링되고 정류된 개별 I 및 Q 출력 신호들을 연산 증폭기(operational amplifier)에서 합산하며;필터링되고 정류되어 합산된 개별 I 및 Q 출력 신호를 저역 통과 필터(low pass filter; LPF)를 통해 통과시켜서 상기 검파된 I 및 Q 신호를 생성하는 것을 포함하는 것인 자동 이득 제어 방법.
- 제1항에 있어서,멀티레벨 비교기 및 로직 회로를 이용하여 디지털 업/다운 및 카운트/홀드 제어 신호들을 생성하는 것을 포함하는 자동 이득 제어 방법.
- 제2항에 있어서,상기 적어도 하나의 디지털 카운터 신호는 적어도 디지털 업/다운 및 카운트/홀드 제어 신호를 포함하고,상기 적어도 하나의 디지털 카운터 신호를 생성하는 것은,업/다운 카운터에서 상기 디지털 업/다운 및 카운트/홀드 제어 신호들을 수신하고;상기 개별 I 및 Q VGA들의 이득을 설정하는 것을 포함하는 것인 자동 이득 제어 방법.
- 제3항에 있어서,상기 개별 I 및 Q VGA들의 이득을 설정하는 것은,상기 검파된 I 및 Q 신호가 미리 정의된 경계 범위 밖에 있으면, 상기 개별 I 및 Q 출력 신호들이 원하는 크기(magnitude)에 도달할 때까지 상기 개별 I 및 Q VGA들의 이득을 변경하고;상기 검파된 I 및 Q 신호가 미리 정의된 경계 범위 밖에 있지 않으면, 상기 개별 I 및 Q VGA들의 이득을 유지하는 것을 포함하는 것인 자동 이득 제어 방법.
- 제4항에 있어서,상기 개별 I 및 Q VGA들의 이득을 변경하는 것은, 상기 검파된 I 및 Q 신호가 제1 미리 정의된 범위를 넘으면 상기 개별 I 및 Q VGA들을 고속(fast rate)으로 조정하거나, 또는 상기 검파된 I 및 Q 신호가 제2 미리 정의된 범위를 넘되 상기 제1 미리 정의된 범위를 넘지 않으면 상기 개별 I 및 Q VGA들을 저속(slow rate)으로 조정하는 것을 포함하는 것인 자동 이득 제어 방법.
- 제4항에 있어서,상기 개별 I 및 Q VGA들의 이득을 변경하는 것은, 상기 검파된 I 및 Q 신호가 제1 미리 정의된 범위를 넘으면 상기 개별 I 및 Q VGA들을 큰 크기(large magnitude)로 조정하거나, 또는 상기 검파된 I 및 Q 신호가 제2 미리 정의된 범위를 넘되 상기 제1 미리 정의된 범위를 넘지 않으면 상기 개별 I 및 Q VGA들을 작은 크기(small magnitude)로 조정하는 것을 포함하는 것인 자동 이득 제어 방법.
- 무선 주파수 신호가 수신되고, 다운컨버팅되고, I 및 Q 신호 경로로 처리되는 무선 수신기에서의, 다중 AGC 스테이지를 포함하는 자동 이득 제어(AGC) 회로에 있어서,상기 다중 AGC 스테이지는 각각,⒜ 개별 I 및 Q 가변 이득 증폭기(VGA)들;⒝ 상기 개별 I 및 Q VGA들로부터 수신된 개별 I 및 Q 출력 신호들을 검파하고 검파된 I 및 Q 출력 신호를 생성하기 위한 검파기;⒞ 상기 검파된 I 및 Q 출력 신호를 디지털 검파된 I 및 Q 출력 신호로 변환하기 위한 아날로그-디지털 컨버터(ADC); 및⒟ 상기 디지털 검파된 I 및 Q 출력 신호에 응답하여 상기 개별 I 및 Q VGA들을 디지털 방식으로 조정하기 위한 디지털 엔진을 포함하는 것이고,상기 검파기는,ⅰ. 상기 개별 I 및 Q 출력 신호들로부터 직류(DC) 오프셋을 제거하기 위한 개별 I 및 Q 고역 통과 필터(HPF)들;ⅱ. 상기 개별 I 및 Q HPF들과 연결되어, 필터링된 개별 I 및 Q 출력 신호들을 교류(AC)로부터 직류(DC)로 변경하기 위한 개별 정류기들;ⅲ. 상기 개별 정류기들과 연결되어, 필터링되고 정류된 I 및 Q 출력 신호들을 합산하기 위한 연산 증폭기(Op-amp); 및ⅳ. 상기 연산 증폭기와 연결되어, 필터링되고 정류되어 합산된 I 및 Q 출력 신호를 필터링하여 상기 검파된 I 및 Q 출력 신호를 생성하기 위한 저역 통과 필터(LPF)를 포함하는 것이고,상기 ADC는,ⅰ. 상기 검파된 I 및 Q 출력 신호를 적어도 하나의 기준 신호와 비교하기 위한 멀티레벨 비교기; 및ⅱ. 상기 멀티레벨 비교기에 응답하여 적어도 하나의 디지털 카운터 신호를 생성하기 위한 논리 회로를 포함하는 것이고,상기 디지털 엔진은,ⅰ. 상기 적어도 하나의 디지털 카운터 신호에 응답하여 업/다운 카운터 신호를 생성하기 위한 업/다운 카운터; 및ⅱ. 상기 업/다운 카운터 신호를 상기 적어도 하나의 기준 신호와 멀티플렉싱하여 상기 개별 I 및 Q VGA들을 디지털 방식으로 조정하는 제어 신호를 생성하기 위한 멀티플렉서를 포함하는 것인 자동 이득 제어 회로.
- 제7항에 있어서,상기 멀티레벨 비교기의 레벨의 수는 적어도 4인 것인 자동 이득 제어 회로.
- 제8항에 있어서,상기 업/다운 카운터는 상기 개별 I 및 Q 가변 이득 증폭기(VGA)들과 연관된 이득을 설정하도록 구성된 것인 자동 이득 제어 회로.
- 복수 개의 직렬로 연결된 자동 이득 제어 스테이지를 포함하는 무선 수신기에 있어서,각 스테이지는,I 및 Q 신호들을 각각 생성하기 위한 I 및 Q 가변 이득 증폭기(VGA)들;상기 I 및 Q 신호들로부터 검파 신호를 생성하기 위한 검파기;상기 검파 신호를 디지털 검파 신호로 변환하기 위한 아날로그-디지털 변환기(ADC); 및상기 디지털 검파 신호 및 기준 신호에 응답하여 제어 신호를 생성하기 위한 디지털 엔진을 포함하고,상기 검파기는,ⅰ. 상기 I 및 Q 신호들로부터 직류(DC) 오프셋을 제거하기 위한 개별 I 및 Q 고역 통과 필터(HPF)들;ⅱ. 상기 개별 I 및 Q HPF들과 연결되어, 필터링된 I 및 Q 신호들을 교류(AC)로부터 직류(DC)로 변경하기 위한 개별 정류기들;ⅲ. 상기 개별 정류기들과 연결되어, 필터링되고 정류된 I 및 Q 신호들을 합산하기 위한 연산 증폭기(Op-amp); 및ⅳ. 상기 연산 증폭기와 연결되어, 필터링되고 정류되어 합산된 I 및 Q 신호를 필터링하여 상기 검파된 I 및 Q 출력 신호를 생성하기 위한 저역 통과 필터(LPF)를 포함하는 것이고,상기 ADC는,ⅰ. 상기 검파된 I 및 Q 신호를 상기 기준 신호와 비교하기 위한 멀티레벨 비교기; 및ⅱ. 상기 멀티레벨 비교기에 응답하여 적어도 하나의 디지털 카운터 신호를 생성하기 위한 논리 회로를 포함하는 것이고,상기 디지털 엔진은,ⅰ. 상기 적어도 하나의 디지털 카운터 신호에 응답하여 업/다운 카운터 신호를 생성하기 위한 업/다운 카운터; 및ⅱ. 상기 업/다운 카운터 신호를 상기 기준 신호와 멀티플렉싱하여 상기 I 및 Q VGA들을 디지털 방식으로 조정하는 제어 신호를 생성하기 위한 멀티플렉서를 포함하는 것인 무선 수신기.
- 제10항에 있어서,상기 I 및 Q 신호들을 각각 버퍼링하기 위해 상기 가변 이득 증폭기와 상기 검파기 사이에 위치한 I 및 Q 버퍼 증폭기들을 포함하는 무선 수신기.
- 제10항에 있어서,상기 개별 I 및 Q 고역 통과 필터들은 상기 I 및 Q 신호들로부터 직류 오프셋을 제거하여 필터링된 I 및 Q 신호들을 생성하도록 구성된 것인 무선 수신기.
- 제12항에 있어서,상기 개별 I 및 Q 고역 통과 필터들과 연결된 상기 개별 정류기들은, 필터링된 상기 I 및 Q 신호 각각을 교류로부터 직류로 변경하여, 필터링되고 정류된 I 및 Q 신호들을 생성하도록 구성된 것인 무선 수신기.
- 복수 개의 직렬로 연결된 자동 이득 제어 스테이지 -상기 스테이지 각각은 개별 I 출력 신호를 갖는 개별 I 가변 이득 증폭기 및 개별 Q 출력 신호를 갖는 개별 Q 가변 이득 증폭기를 가짐 - 각각에서, 상기 개별 I 및 Q 출력 신호로들부터 개별 검파 신호를 생성하고;상기 복수 개의 스테이지 각각에서, 상기 개별 검파 신호를 개별 디지털 검파 신호로 변환하고;상기 복수 개의 스테이지 각각에서, 상기 개별 디지털 검파 신호에 응답하여 상기 개별 I 및 Q 가변 이득 증폭기들을 제어하기 위해 개별 제어 신호를 생성하며;상기 복수 개의 스테이지 각각에서, 상기 개별 제어 신호에 응답하여, 상기 개별 I 및 Q 가변 이득 증폭기들을 조정하는 것을 포함하고,상기 검파 신호를 생성하는 것은,상기 개별 I 및 Q 출력 신호들로부터 직류 오프셋을 제거하여 상기 I 및 Q 출력 신호들을 고역 통과 필터링하고;고역 통과 필터링된 상기 I 및 Q 출력 신호들을 정류하여 상기 고역 통과 필터링된 I 및 Q 출력 신호들을 교류로부터 직류 I 및 Q 정류 신호들로 변경하고;상기 직류 I 및 Q 정류 신호들을 합산하며, 합산된 I 및 Q 출력 신호를 생성하며;상기 합산된 I 및 Q 출력 신호를 저역 통과 필터링하여, 상기 검파 신호를 생성하는 것을 포함하는 것이고,상기 디지털 검파 신호로 변환하는 것은,멀티레벨 비교기를 통해 상기 검파 신호를 적어도 하나의 개별 기준 신호와 비교하고;비교된 신호를 논리적으로 조작하여 적어도 하나의 디지털 카운터 신호를 생성하는 것을 포함하는 것이고,상기 제어 신호를 생성하는 것은,상기 비교된 신호를 논리적으로 조작하여 업/다운 카운터 신호를 생성하고;상기 업/다운 카운터 신호를 상기 적어도 하나의 개별 기준 신호와 멀티플렉싱하여 상기 제어 신호를 생성하는 것을 포함하는 것인 방법.
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