KR100857676B1 - 디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와평판 표시장치 - Google Patents

디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와평판 표시장치 Download PDF

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Abstract

본 발명은 면적을 최소화할 수 있도록 한 디지털-아날로그 변환기에 관한 것이다.
본 발명의 디지털-아날로그 변환기는 자신에게 공급되는 데이터의 비트값에 대응하여 제 1제어신호 또는 제 2제어신호를 생성하는 제어부와; 제 1전압 및 제 2전압 사이에 위치되어 제 1전압 및 제 2전압을 분할하기 위한 다수의 저항을 구비하는 전압 생성부와; 상기 저항들 각각의 노드와 출력단자 사이에 접속되는 제 1스위치들과; 상기 제어부로부터 출력되는 상기 제 1제어신호 또는 제 2제어신호를 상기 제 1스위치들의 게이트전극으로 전달하기 위한 제 2스위치들과; 상기 제 2스위치들과 각각 접속되며, 상기 제 1제어신호 또는 제 2제어신호의 전압을 충전하는 커패시터들과; 상기 제 2스위치들로 리셋신호들 또는 쉬프트신호들을 공급하기 위한 쉬프트 레지스터들을 구비한다.

Description

디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와 평판 표시장치{Digital-Analog Converter, Data Driver and Flat Panel Display Using the Digital-Analog Converter}
도 1은 종래의 디지털-아날로그 변환기를 나타내는 도면이다.
도 2는 본 발명의 실시예에 의한 평판 표시장치를 나타내는 도면이다.
도 3은 도 2에 도시된 평판 표시장치가 액정 표시장치인 경우 화소의 실시예를 나타내는 도면이다.
도 4는 도 2에 도시된 평판 표시장치가 유기전계발광 표시장치인 경우 화소의 실시예를 나타내는 도면이다.
도 5는 도 2에 도시된 데이터 구동부를 나타내는 블록도이다.
도 6은 도 5에 도시된 데이터신호 생성부를 나타내는 도면이다.
도 7은 도 6에 도시된 신호 생성부를 나타내는 도면이다.
도 8은 도 7에 도시된 신호 생성부의 구동과정을 나타내는 파형도이다.
도 9는 도 7에 도시된 신호 생성부의 시뮬레이션 결과를 나타내는 도면이다.
도 10은 도 9의 시뮬레이션 결과를 확대하여 나타내는 도면이다.
도 11은 본 발명의 디지털-아날로그 변환기가 사용되는 일례를 나타내는 도 면이다.
<도면의 주요 부분에 대한 부호의 설명>
2,2041,300,305 : 전압 생성부 4 : 전압 선택부
6 : 디코더 110 : 주사 구동부
120 : 데이터 구동부 123 : 쉬프트 레지스터부
124 : 샘플링 래치부 125 : 홀딩 래치부
126 : 데이터신호 생성부 127 : 버퍼부
130 : 화소부 140 : 화소
142 : 화소회로 150 : 타이밍 제어부
200 : 쉬프트 레지스터 202 : 제어부
204 : 신호 생성부 302 : 버퍼
304,306 : 디지털-아날로그 변환기
본 발명은 디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와 평판 표시장치에 관한 것으로, 특히 면적을 최소화할 수 있도록 한 디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와 평판 표시장치에 관한 것이다.
최근, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판 표시장치들이 개발되고 있다. 평판 표시장치로는 액정 표시장치(Liquid Crystal Display), 전계방출 표시장치(Field Emission Display), 플라즈마 표시패널(Plasma Display Panel) 및 유기전계발광 표시장치(Organic Light Emitting Display) 등이 있다.
평판 표시장치들 중 액정 표시장치는 외부의 백라이트로부터 발생하는 빛의 투과여부를 제어하면서 화상을 표시한다. 이와 같은 액정 표시장치는 기술의 발달로 인하여 대면적의 화상을 높은 해상도로 표시할 수 있고, 이에 따라 다양한 분야에서 사용되고 있다. 또한, 유기전계발광 표시장치는 전자와 정공의 재결합에 의하여 빛을 발생하는 유기 발광 다이오드를 이용하여 화상을 표시한다. 이와 같은 유기전계발광 표시장치는 빠른 응답속도를 가짐과 동시에 낮은 소비전력으로 구동되기 때문에 차세대 디스플레이로 각광받고 있다.
액정 표시장치 및 유기전계발광 표시장치는 주사선들 및 데이터선들의 교차부에 위치되는 화소와, 데이터선들을 구동하기 위한 데이터 구동부 및 주사선들을 구동하기 위한 주사 구동부를 구비한다.
주사 구동부는 주사선들로 주사신호를 순차적으로 공급하면서 화소들을 수평 라인 단위로 순차적으로 선택한다. 데이터 구동부는 주사선들로부터 공급되는 주사신호와 동기되도록 데이터선들로 데이터신호를 공급한다. 그러면, 주사신호에 선택된 화소들로 데이터신호가 공급되고, 공급된 데이터신호에 대응하여 소정 휘도의 화상이 표시된다.
여기서, 데이터 구동부는 외부로부터 공급되는 디지털 데이터를 소정의 전압값(즉, 데이터신호)으로 변환하기 위하여 디지털-아날로그 변환기가 사용된다.
도 1은 종래의 디지털-아날로그 변환기를 나타내는 도면이다. 도 1에서는 데이터(Data)가 8bit인 경우를 나타낸다.
도 1을 참조하면, 종래의 디지털-아날로그 변환기는 전압을 생성하기 위한 전압 생성부(2)와, 전압 생성부(2)에서 생성된 전압 중 어느 하나를 선택하기 위한 전압 선택부(4)를 구비한다.
전압 생성부(2)는 외부로부터 입력되는 전압(VRH, VRL)을 다수의 전압으로 분할한다. 이를 위해, 전압 생성부(2)는 제 1전압(VRH) 및 제 2전압(VRL) 사이에 위치되는 다수의 저항(R0 내지 R255)을 구비한다. 저항들(R0 내지 R255)은 제 1전압(VRH) 및 제 2전압(VRL) 사이에 직렬로 위치되어 제 1전압(VRH) 및 제 2전압(VRL)을 다수의 전압으로 분할한다.
전압 선택부(4)는 저항들(R0 내지 R255) 각각의 노드와 출력단자(OUT) 사이에 위치되는 다수의 스위치들(SW)과, 데이터(Data)의 비트에 대응하여 다수의 스위치들(SW)의 턴-온 및 턴-오프를 제어하기 위한 디코더(6)를 구비한다.
스위치들(SW)은 저항들(R0 내지 R255) 각각의 노드와 출력단자(OUT) 사이마다 설치된다. 일례로, 데이터(Data)가 8비트인 경우 저항들(R0 내지 R255) 각각의 노드와 출력단자(OUT) 사이마다 8개의 스위치(SW)들이 설치된다.
디코더(6)는 외부로부터 입력되는 데이터(Data)의 비트값에 대응하여 스위치 들(SW)의 턴-온 및 턴-오프를 제어한다. 실제로, 디코더(6)는 저항들(R0 내지 R255) 각각의 노드에 인가된 전압 중 어느 하나의 전압이 출력단자(OUT)로 공급될 수 있도록 스위치들(SW)의 턴-온 및 턴-오프를 제어한다.
동작과정을 간략히 설명하면, 먼저 외부로부터 데이터(Data)가 디코더(6)로 공급된다. 데이터(Data)를 입력받은 디코더(6)는 데이터(Data)의 비트값에 대응하여 스위치들(SW)의 턴-온 및 턴-오프를 제어하여 전압 생성부(2)에서 생성된 전압 중 어느 하나의 전압을 출력단자(OUT)로 공급한다. 출력단자(OUT)로 공급된 전압은 데이터신호로써 화소로 공급된다.
하지만, 이와 같은 종래의 디지털-아날로그 변환기는 다수의 스위치들(SW)이 포함되기 때문에 실장 면적이 커지는 단점이 있다. 일례로, 데이터(Data)가 8비트인 경우 전압 선택부(4)에는 2048개의 스위치들(SW)이 삽입된다. 특히, 도 1에 도시된 디지털-아날로그 변환기는 각각의 데이터선들(또는 각각의 채널) 마다 설치되기 때문에 디지털-아날로그 변환기에 의하여 제조비용이 증가함과 동시에 패널의 사이즈가 커지는 문제점이 발생된다.
따라서, 본 발명의 목적은 면적을 최소화할 수 있도록 한 디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와 평판 표시장치를 제공하는 것이다.
상기 목적을 달성하기 위하여, 본 발명의 실시 예에 따른 디지털-아날로그 변환기는 자신에게 공급되는 데이터의 비트값에 대응하여 제 1제어신호 또는 제 2제어신호를 생성하는 제어부와; 제 1전압 및 제 2전압 사이에 위치되어 제 1전압 및 제 2전압을 분할하기 위한 다수의 저항을 구비하는 전압 생성부와; 상기 저항들 각각의 노드와 출력단자 사이에 접속되는 제 1스위치들과; 상기 제어부로부터 출력되는 상기 제 1제어신호 또는 제 2제어신호를 상기 제 1스위치들의 게이트전극으로 전달하기 위한 제 2스위치들과; 상기 제 2스위치들과 각각 접속되며, 상기 제 1제어신호 또는 제 2제어신호의 전압을 충전하는 커패시터들과; 상기 제 2스위치로 리셋신호들 또는 쉬프트신호들을 공급하기 위한 쉬프트 레지스터들을 구비한다.
바람직하게, 상기 리셋신호들은 상기 쉬프트 레지스터들에서 동시에 공급되며, 상기 리셋신호들이 공급될 때 상기 제 2스위치들이 턴-온된다. 상기 리셋신호가 공급되는 기간 동안 상기 제 1제어신호가 상기 제 1스위치들로 공급되어 상기 제 1스위치들이 턴-오프된다. 상기 쉬프트 레지스터들은 상기 쉬프트 신호를 순차적으로 공급하여 상기 제 2스위치들을 순차적으로 턴-온시킨다. 상기 제어부는 상기 쉬프트신호들 중 어느 하나의 쉬프트신호와 동기되도록 상기 제 2제어신호를 공급하고, 그 외의 경우에는 상기 제 1제어신호를 공급한다. 상기 제 2제어신호를 공급받은 상기 제 1스위치가 턴-온되어 상기 전압 생성부에서 생성되는 다수의 전압들 중 어느 하나의 전압이 데이터신호로써 출력된다. 상기 전압 생성부에서 가장 낮은 전압을 생성하는 노드와 상기 출력단자 사이에 접속되는 프리차지 스위치를 더 구비한다. 상기 프리차지 스위치는 상기 데이터신호가 출력되기 이전에 턴-온된다. 상기 데이터가 k(k는 자연수)비트로 설정되는 경우 상기 쉬프트 레지스터들은 2k개로 설정된다. 상기 전압 생성부는 2k개의 전압을 생성한다.
본 발명의 실시예에 따른 데이터 구동부는 샘플링신호를 순차적으로 생성하기 위한 제 1쉬프트 레지스터부와; 상기 샘플링신호에 대응하여 데이터를 순차적으로 저장하기 위한 샘플링 래치부와; 상기 샘플링 래치부에 저장된 데이터를 저장하고, 저장된 데이터를 동시에 출력하기 위한 홀딩 래치부와; 상기 홀딩 래치부로부터 공급되는 데이터에 대응하여 데이터신호를 생성하기 위한 복수의 디지털-아날로그 변환기를 포함하는 데이터신호 생성부와; 상기 디지털-아날로그 변환기와 공통적으로 접속되어 리셋신호들 및 쉬프트신호들을 공급하기 위한 제 2쉬프트 레지스터들을 구비하며; 상기 디지털-아날로그 변환기 각각은 제 1전압 및 제 2전압 사이에 위치되어 제 1전압 및 제 2전압을 분할하기 위한 다수의 저항을 구비하는 전압 생성부와; 상기 데이터의 비트값에 대응하여 특정 시점에 제 2제어신호를 생성하고, 그 외의 기간 동안 제 1제어신호를 생성하는 제어부와; 상기 쉬프트신호와 동기되도록 상기 제 2제어신호가 공급될 때 상기 전압 생성부에서 생성된 전압들 중 어느 하나의 전압을 상기 데이터신호로써 출력하고, 상기 제 1제어신호가 공급될 때 상기 전압 생성부에서 생성된 전압들을 출력하지 않는 신호 생성부를 구비한다.
바람직하게, 상기 신호 생성부는 상기 저항들 각각의 노드와 출력단자 사이에 접속되는 제 1스위치들과; 상기 제 1제어신호 또는 제 2제어신호를 상기 제 1스위치들의 게이트전극으로 전달하기 위한 제 2스위치들과; 상기 제 2스위치들과 접속되며, 상기 제 1제어신호 또는 제 2제어신호의 전압을 충전하는 커패시터들을 구비한다. 상기 리셋신호는 상기 제 2쉬프트 레지스터들에서 동시에 공급되어 상기 제 2스위치들을 동시에 턴-온시킨다. 상기 리셋신호가 공급되는 기간 동안 상기 제 1제어신호가 상기 제 1스위치들로 공급되어 상기 제 1스위치들이 턴-오프된다. 상기 제 2쉬프트신호들은 상기 쉬프트 레지스터들에서 순차적으로 공급되면서 상기 제 2스위치들을 순차적으로 턴-온시킨다. 상기 쉬프트신호들 중 어느 하나와 동기되도록 공급되는 상기 제 2제어신호에 의하여 상기 다수의 제 1스위치들 중 어느 하나가 턴-온되어 상기 데이터신호가 출력된다. 상기 전압 생성부에서 가장 낮은 전압을 생성하는 노드와 상기 출력단자 사이에 접속되는 프리차지 스위치를 더 구비한다. 상기 프리차지 스위치는 상기 출력단자로 상기 데이터신호가 출력되기 이전에 턴-온된다.
본 발명의 실시예에 따른 평판 표시장치는 주사선들로 주사신호를 순차적으로 공급하기 위한 주사 구동부와; 데이터선들로 상기 주사신호와 동기되도록 데이터신호들을 공급하기 위하여 상기 제 11항 내지 제 18항 중 어느 한 항에 기재된 데이터 구동부와; 상기 주사선들과 데이터선들의 교차부에 위치되며 상기 주사신호가 공급될 때 상기 데이터신호에 대응되는 전압을 충전하고, 충전된 전압에 대응하는 빛을 생성하는 화소들을 구비한다.
본 발명의 다른 실시예에 의한 평판 표시장치는 주사선들로 주사신호를 순차적으로 공급하기 위한 주사 구동부와; 제 1전압과 제 2전압을 분할하기 위하여 다수의 저항을 포함하는 제 1전압 생성부와, k(k는 자연수)비트의 데이터 중 상위 i(i는 k보다 작은 자연수)비트를 입력받고 입력받은 i비트에 대응하여 상기 제 1전압 생성부에서 생성된 전압들 중 인접된 2개의 전압을 출력하는 제 1디지털-아날로그 변환기들과, 상기 제 1디지털-아날로그 변화기에서 출력된 2개의 전압을 다수의 전압으로 분할하기 위한 제 2전압 생성부들과, 상기 k비트의 데이터 중 i비트를 제외한 하위비트들에 대응하여 상기 제 2전압 생성부에서 생성된 전압들 중 어느 하나의 전압을 데이터신호로 출력하기 위한 제 2디지털-아날로그 변환기들과, 상기 제 2디지털-아날로그 변환기와 공통적으로 접속되어 리셋신호들 및 쉬프트신호들을 공급하기 위한 쉬프트 레지스터들을 구비하는 데이터 구동부와; 상기 데이터신호에 대응되는 빛을 생성하기 위한 화소들을 구비하며; 상기 제 2디지털-아날로그 변환기들 각각은 상기 데이터의 비트값에 대응하여 특정 시점에 제 2제어신호를 생성하고, 그 외의 기간 동안 제 1제어신호를 생성하는 제어부와; 상기 쉬프트신호와 동기되도록 상기 제 2제어신호가 공급될 때 상기 제 2전압 생성부에서 생성된 전압들 중 어느 하나의 전압을 상기 데이터신호로써 출력하고, 상기 제 1제어신호가 공급될 때 상기 제 2전압 생성부에서 생성된 전압들을 출력하지 않는 신호 생성부를 구비한다.
이하, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명을 용이하게 실시할 수 있는 바람직한 실시 예를 첨부된 도 2 내지 도 11을 참조하여 상세히 설명하면 다음과 같다.
도 2는 본 발명의 실시예에 의한 평판 표시장치를 나타내는 도면이다.
도 2를 참조하면, 본 발명의 실시예에 의한 평판 표시장치는 주사선들(S1 내지 Sn) 및 데이터선들(D1 내지 Dm)의 교차부에 위치되는 화소들(140)을 포함하는 화소부(130)와, 주사선들(S1 내지 Sn)을 구동하기 위한 주사 구동부(110)와, 데이터선들(D1 내지 Dm)을 구동하기 위한 데이터 구동부(120)와, 주사 구동부(110) 및 데이터 구동부(120)를 제어하기 위한 타이밍 제어부(150)를 구비한다.
주사 구동부(110)는 타이밍 제어부(150)로부터 주사 구동제어신호(SCS)를 공급받는다. 주사 구동제어신호(SCS)를 공급받은 주사 구동부(110)는 주사신호를 생성하고, 생성된 주사신호를 주사선들(S1 내지 Sn)로 순차적으로 공급한다.
데이터 구동부(120)는 타이밍 제어부(150)로부터 데이터 구동제어신호(DCS) 및 데이터(Data)를 공급받는다. 데이터 구동제어신호(DCS)를 공급받은 데이터 구동부(120)는 데이터신호를 생성하고, 생성된 데이터신호를 주사신호와 동기되도록 데이터선들(D1 내지 Dm)로 공급한다.
타이밍 제어부(150)는 외부로부터 공급되는 동기신호들에 대응하여 데이터 구동제어신호(DCS) 및 주사 구동제어신호(SCS)를 생성한다. 타이밍 제어부(150)에서 생성된 데이터 구동제어신호(DCS)는 데이터 구동부(120)로 공급되고, 주사 구동제어신호(SCS)는 주사 구동부(110)로 공급된다. 여기서, 데이터 구동제어신호(DCS)에는 소스 스타트 펄스, 소스 쉬프트 클럭, 소스 출력 인에이블 신호 등이 포함된다.
화소부(130)는 주사선들(S1 내지 Sn) 및 데이터선들(D1 내지 Dm)의 교차부에 위치되는 화소들(140)을 구비한다. 화소들(140)은 주사신호가 공급될 때 선택되어 데이터신호를 공급받는다. 데이터신호를 공급받은 화소들(140)은 데이터신호에 대응되는 휘도의 빛을 외부로 공급하고, 이에 따라 화소부(130)에서 소정 휘도의 영상을 표시된다.
한편, 본 발명에서 평판 표시장치는 외부로부터 데이터(Data)를 공급받고, 공급받은 데이터(Data)를 이용하여 아날로그 전압(즉, 데이터신호)을 생성하기 위한 데이터 구동부(120)를 포함하는 것들 중 어느 하나로 선택될 수 있다. 예를 들어, 평판 표시장치는 액정 표시장치 및 유기전계발광 표시장치 중 어느 하나로 선택될 수 있다.
도 3은 도 2의 평판 표시장치가 액정 표시장치로 선택되는 경우 화소의 구조를 나타내는 회로도이다. 도 3에서는 설명의 편의성을 위하여 제 n주사선(Sn) 및 제 m데이터선(Dm)과 접속된 화소를 도시하기로 한다.
도 3을 참조하면, 화소(140)는 주사선(Sn)과 데이터선(Dm) 사이에 위치되는 박막 트랜지스터(Thin Film Transistor)와, 박막 트랜지스터(TFT)와 접속되는 스토리지 커패시터(Cst) 및 액정 커패시터(Clc)를 구비한다.
박막 트랜지스터(TFT)는 주사선(Sn)으로 주사신호가 공급될 때 턴-온된다. 박막 트랜지스터(TFT)가 턴-온되면 데이터선(Dm)으로 공급되는 데이터신호가 스토리지 커패시터(Cst)로 전달된다.
스토리지 커패시터(Cst)는 데이터신호가 공급될 때 데이터신호에 대응되는 전압을 저장한다.
액정 커패시터(Clc)는 박막 트랜지스터(TFT)의 소오스전극과 접속되는 화소전극(미도시)과 공통전극(미도시) 사이의 액정을 등가적으로 표현한 것이다. 액정 커패시터(Clc)는 스토리지 커패시터(Cst)에 저장된 전압에 대응하여 액정의 광 투과율을 제어한다.
한편, 도 3에 도시된 화소(140)의 구조는 본 발명의 실시예로써 본 발명이 이에 한정되지는 않는다. 실제로, 화소(140)의 구조는 적어도 하나의 박막 트랜지스터(TFT)가 포함되도록 다양하게 변경될 수 있다.
도 4는 도 2의 평판 표시장치가 유기전계발광 표시장치로 선택되는 경우 화소의 구조를 나타내는 회로도이다. 도 4에서는 설명의 편의성을 위하여 제 n주사선(Sn) 및 제 m데이터선(Dm)과 접속된 화소를 도시하기로 한다.
도 4를 참조하면, 화소(140)는 유기 발광 다이오드(OLED)와, 데이터선(Dm) 및 주사선(Sn)에 접속되어 유기 발광 다이오드(OLED)를 제어하기 위한 화소회로(142)를 구비한다.
유기 발광 다이오드(OLED)의 애노드전극은 화소회로(142)에 접속되고, 캐소드전극은 제 2전원(ELVSS)에 접속된다. 이와 같은 유기 발광 다이오드(OLED)는 화소회로(142)로부터 공급되는 전류에 대응되어 소정 휘도의 빛을 생성한다.
화소회로(142)는 주사선(Sn)에 주사신호가 공급될 때 데이터선(Dm)으로 공급되는 데이터신호에 대응되어 유기 발광 다이오드(OLED)로 공급되는 전류량을 제어한다. 이를 위해, 화소회로(142)는 제 1전원(ELVDD)과 유기 발광 다이오드(OLED) 사이에 접속된 제 2트랜지스터(M2)와, 데이터선(Dm) 및 주사선(Sn)의 사이에 접속된 제 1트랜지스터(M1)와, 제 2트랜지스터(M2)의 게이트전극과 제 1전극 사이에 접속된 스토리지 커패시터(Cst)를 구비한다.
제 1트랜지스터(M1)의 게이트전극은 주사선(Sn)에 접속되고, 제 1전극은 데이터선(Dm)에 접속된다. 그리고, 제 1트랜지스터(M1)의 제 2전극은 스토리지 커패시터(Cst)의 제 1단자에 접속된다. 여기서, 제 1전극은 소오스전극 및 드레인전극 중 어느 하나로 설정되고, 제 2전극은 제 1전극과 다른 전극으로 설정된다. 예를 들어, 제 1전극이 소오스전극으로 설정되면 제 2전극은 드레인전극으로 설정된다. 주사선(Sn) 및 데이터선(Dm)에 접속된 제 1트랜지스터(M1)는 주사선(Sn)으로부터 주사신호가 공급될 때 턴-온되어 데이터선(Dm)으로부터 공급되는 데이터신호를 스토리지 커패시터(Cst)로 공급한다. 이때, 스토리지 커패시터(Cst)는 데이터신호에 대응되는 전압을 충전한다.
제 2트랜지스터(M2)의 게이트전극은 스토리지 커패시터(Cst)의 제 1단자에 접속되고, 제 1전극은 스토리지 커패시터(Cst)의 제 2단자 및 제 1전원(ELVDD)에 접속된다. 그리고, 제 2트랜지스터(M2)의 제 2전극은 유기 발광 다이오드(OLED)의 애노드전극에 접속된다. 이와 같은 제 2트랜지스터(M2)는 스토리지 커패시터(Cst)에 저장된 전압값에 대응하여 제 1전원(ELVDD)으로부터 유기 발광 다이오드(OLED)를 경유하여 제 2전원(ELVSS)으로 흐르는 전류량을 제어한다. 이때, 유기 발광 다이오드(OLED)는 제 2트랜지스터(M2)로부터 공급되는 전류량에 대응되는 빛을 생성한다.
한편, 도 4에 도시된 화소(140)의 구조는 본 발명의 실시예로써 본 발명이 이에 한정되지는 않는다. 실제로, 화소(140)의 구조는 다수의 트랜지스터들이 포함될 수 있도록 다양하게 변경될 수 있다.
도 5는 본 발명의 실시예에 의한 데이터 구동부를 나타내는 도면이다. 도 5에서는 설명의 편의성을 위하여 데이터 구동부가 m개의 채널을 갖는다고 가정하기로 한다.
도 5를 참조하면, 본 발명의 실시예에 의한 데이터 구동부(120)는 샘플링 신호를 순차적으로 생성하기 위한 쉬프트 레지스터부(123)와, 샘플링 신호에 응답하여 데이터(Data)를 순차적으로 저장하기 위한 샘플링 래치부(124)와, 샘플링 래치부(124)에 저장된 데이터(Data)들을 일시 저장함과 아울러 저장된 데이터(Data)들을 데이터신호 생성부(126)로 공급하기 위한 홀딩 래치부(125)와, 데이터(Data)의 비트값에 대응하는 데이터신호를 생성하기 위한 데이터신호 생성부(126)와, 데이터신호를 데이터선들(D1 내지 Dm)로 공급하기 위한 버퍼부(127)를 구비한다.
쉬프트 레지스터부(123)는 타이밍 제어부(150)로부터 소스 쉬프트 클럭(SSC) 및 소스 스타트 펄스(SSP)를 공급받는다. 소스 쉬프트 클럭(SSC) 및 소스 스타트 펄스(SSP)를 공급받은 쉬프트 레지스터부(123)는 소스 쉬프트 클럭(SSC)에 대응하여 소스 스타트 펄스(SSP)를 쉬프트 시키면서 순차적으로 m개의 샘플링 신호를 생성한다. 이를 위해, 쉬프트 레지스터부(123)는 m개의 쉬프트 레지스터(1231 내지 123m)를 구비한다.
샘플링 래치부(124)는 쉬프트 레지스터부(123)로부터 순차적으로 공급되는 샘플링신호에 대응하여 데이터(Data)를 순차적으로 저장한다. 이를 위해, 샘플링 래치부(124)는 m개의 데이터(Data)를 저장하기 위한 m개의 샘플링 래치들(1241 내지 124m)을 구비한다. 여기서, 샘플링 래치들(1241 내지 124m) 각각의 크기는 k비트의 데이터(Data)를 저장할 수 있도록 설정된다.
홀딩 래치부(125)는 타이밍 제어부(150)로부터 공급되는 소스 출력 인에이블(SOE) 신호에 응답하여 샘플링 래치부(124)로부터 데이터(Data)를 입력받아 저장하고, 저장된 데이터(Data)들을 데이터신호 생성부(126)로 공급한다. 이를 위해, 홀딩 래치부(125)는 m개의 홀딩 래치들(1251 내지 125m)을 구비한다. 그리고, 홀딩 래치들(1251 내지 125m) 각각은 크기는 k비트의 데이터(Data)를 저장할 수 있도록 설정된다.
데이터신호 생성부(126)는 데이터(Data)의 비트값(또는 계조값)에 대응하는 데이터신호를 생성하고, 생성된 데이터신호를 버퍼부(127)로 공급한다. 이와 같은 데이터신호 생성부(126)는 각각의 채널마다 위치되는 m개의 디지털-아날로그 변환기(DAC)(1261 내지 126m)를 구비한다.
버퍼부(127)는 데이터신호 생성부(126)로부터 공급되는 데이터신호를 데이터선들(D1 내지 Dm)로 공급한다. 버퍼부(127)는 설계과정에서 제거될 수 있다. 이 경우, 데이터신호 생성부(126)가 데이터선들(D1 내지 Dm)과 접속된다.
도 6은 데이터신호 생성부를 상세히 나타내는 도면이다. 이후, 설명의 편의 성을 위하여 데이터(Data)를 8비트로 가정하기로 한다.
도 6을 참조하면, 본 발명의 데이터신호 생성부(126)는 각각의 채널마다 위치되는 디지털-아날로그 변환기(1261 내지 126m)와, 디지털-아날로그 변환기들(1261 내지 126m)과 공통적으로 접속되는 쉬프트 레지스터들(200)을 구비한다.
디지털-아날로그 변환기(1261 내지 126m) 각각은 제어부(202) 및 신호 생성부(204)를 구비한다.
쉬프트 레지스터들(200)은 리셋신호 및 쉬프트신호를 신호 생성부들(204)로 공급한다. 여기서, 리셋신호는 모든 쉬프트 레지스터들(200)에서 동시에 공급되고, 쉬프트신호는 쉬프트 레지스터들(200)에서 순차적으로 공급된다. 여기서, 데이터(Data)가 8비트인 경우 쉬프트 레지스터들(200)에는 28개, 즉 256개의 쉬프트 레지스터가 포함된다.
제어부(202)는 홀딩 래치부(125)로부터 데이터(Data)를 공급받는다. 여기서, 제 1디지털-아날로그 변환기(1261)에 포함되는 제어부(202)는 제 1홀딩 래치(1251)로부터 데이터(Data)를 공급받고, 제 m디지털-아날로그 변환기(126m)에 포함되는 제어부(202)는 제 m홀딩 래치(125m)로부터 데이터(Data)를 공급받는다. 데이터(Data)를 공급받은 제어부(202)는 데이터(Data)의 비트값에 대응하여 제어신호를 생성하고, 생성된 제어신호를 신호 생성부(204)로 공급한다. 실제로, 제어부(202)는 데이터(Data)의 비트값에 대응하여 특정 시점에 제 2제어신호를 공급하고, 그 외의 경우에는 제 1제어신호를 공급한다.
신호 생성부(204)는 제 2제어신호가 공급되는 특정 시점에 대응하여 소정 전압의 데이터신호를 생성하고, 생성된 데이터신호를 데이터선(D) 또는 버퍼부(127)로 공급한다.
도 7은 도 6에 도시된 신호 생성부를 상세히 나타내는 도면이다.
도 7을 참조하면, 본 발명의 신호 생성부(204)는 전압 생성부(2041), 제 1스위치들(SW1), 제2스위치들(SW2), 프리차지 스위치(SWP) 및 커패시터들(C1)을 구비한다.
전압 생성부(2041)는 외부로부터 입력되는 전압(VRH, VRL)을 다수의 전압으로 분할한다. 이를 위해, 전압 생성부(2041)는 제 1전압(VRH) 및 제 2전압(VRL) 사이에 위치되는 다수의 저항(R0 내지 R255)을 구비한다. 저항들(R0 내지 R255)은 제1전압(VRH) 및 제 2전압(VRL) 사이에 직렬로 위치되어 제 1전압(VRH) 및 제 2전압(VRL)을 다수의 전압으로 분할한다.
제 1스위치들(SW1)은 저항들(R0 내지 R255) 각각의 노드와 출력단자(OUT)(즉, 데이터선(D)) 사이에 설치된다. 이와 같은 제 1스위치들(SW1)은 제 2스위치들(SW2)이 턴-온될 때 공급되는 제 1제어신호 또는 제 2제어신호에 대응하여 턴-온 또는 턴-오프된다.
제 2스위치들(SW2)은 각각의 제 1스위치들(SW1)과 접속된다. 이와 같은 제 2스위치들(SW2)은 쉬프트 레지스터들(200)로부터 리셋신호 또는 쉬프트신호가 공급될 때 턴-온되어 제어부(202)로부터 공급되는 제 1제어신호 또는 제 2제어신호를 제 1스위치들(SW1)로 공급한다.
커패시터(C1)는 제 1스위치들(SW1) 각각의 게이트전극과 접속되도록 설치된다. 이와 같은 커패시터(C1)는 제 1제어신호 또는 제 2제어신호에 대응되는 전압을 충전한다. 즉, 커패시터(C1)는 제 1제어신호 또는 제 2제어신호에 대응되는 전압을 충전하여 제 1스위치들(SW1)의 턴-온 및 턴-오프 상태를 소정시간 동안 안정적으로 유지한다. 커패시터(C1)는 제 1스위치들(SW1) 각각에 포함되는 기생 커패시터 및 외부에서 삽입되는 외부 커패시터 중 어느 하나로 설정된다.
프리차지 스위치(SWP)는 전압 생성부(2041)에서 가장 낮은 전압(즉, 가장 낮은 계조의 전압)을 생성하는 노드(즉, R0와 제 2전압(VRL) 사이)와 출력단자(OUT) 사이에 접속된다. 이와 같은 프리차지 스위치(SWP)는 데이터신호가 공급되기 이전에 데이터선(D)을 선충전하기 위하여 사용된다.
이와 같은 본 발명에서 신호 생성부(204)에는 512개의 스위치가 포함된다. 즉, 종래에 비하여 디지털-아날로그 변환기(1261 내지 126m) 각각에 포함되는 스위치의 수가 1/4으로 줄어들고, 이에 따라 면적을 줄일 수 있는 장점이 있다. 또한, 스위치의 수가 줄어들면 스위치의 오동작 확률이 줄어들어 신뢰성을 향상시킬 수 있다.
한편, 도 7에서는 전압 생성부(2041)가 신호 생성부(204)의 내부에 포함되는 것으로 도시되었지만 본 발명이 이에 한정되지는 않는다. 일례로, 전압 생성부(2041)는 신호 생성부(204)의 외부에 신호 생성부(204)와 접속되도록 설치될 수 있다.
도 8은 도 7에 도시된 신호 생성부의 동작과정을 나타내는 도면이다. 도 8에서는 설명의 편의성을 위하여 제 2스위치들(SW2)이 엔타입(N-type)으로 형성되고, 제 1스위치들(SW1)이 피타입(P-type)으로 형성되었다고 가정하기로 한다.
도 8을 참조하면, 먼저 신호 생성부(204)는 리셋기간, 프리차지 기간 및 구동 기간으로 나누어 구동된다.
리셋기간 동안 모든 쉬프트 레지스터들(200)에서 리셋신호가 공급된다. 모든 쉬프트 레지스터들(200)에서 리셋신호가 공급되면 모든 제 2스위치들(SW2)이 턴-온된다. 이때, 제어부(202)에서는 제 1제어신호(하이극성)가 출력된다. 따라서, 제 2스위치(SW2)이 턴-온되면 제 1제어신호가 제 1스위치들(SW1)로 공급되고, 이에 따라 제 1스위치들(SW1)이 턴-오프된다. 커패시터들(C1)은 제 1제어신호에 대응되는 전압을 충전한다. 따라서, 리셋기간 이후에도 제 1커패시터들(C1)에 충전된 전압에 의하여 제 1스위치들(SW1)은 턴-오프 상태를 유지한다.
프리차지 기간 동안에는 외부로부터 공급되는 신호에 의하여 프리차지 스위치(SWP)가 턴-온된다. 프리차지 스위치(SWP)가 턴-온되면 전압 생성부(2041)의 가장 낮은 계조전압이 데이터선(D)으로 공급되고, 이에 따라 데이터선(D)에 등가적으로 형성되는 기생 커패시터에 가장 낮은 계조전압이 프리차징 된다. 프리차지 기간 동안 데이터선(D)이 선충전되면 이후 데이터신호의 공급시간이 단축될 수 있다. 한편, 본 발명에서 프리차지 기간은 생략될 수도 있다.
구동 기간에는 쉬프트 레지스터(200)들에서 쉬프트신호가 순차적으로 공급된 다. 예를 들어, 가장 낮은 계조전압을 출력하는 제 1스위치(SW1)와 접속된 제 2스위치(SW2)로부터 가장 높은 계조전압을 출력하는 제 1스위치(SW1)와 접속된 제 2스위치(SW2)로 쉬프트신호가 순차적으로 출력된다. 여기서, 쉬프트신호는 가장 높은 계조전압을 출력하는 제 1스위치(SW1)와 접속된 제 2스위치(SW2)로부터 가장 낮은 계조전압을 출력하는 제 1스위치(SW1)와 접속된 제 2스위치(SW2)로 순차적으로 공급될 수도 있다.
쉬프트 레지스터들(200)에서 쉬프트신호가 순차적으로 공급되면 제 2스위치들(SW2)이 순차적으로 턴-온된다. 한편, 제어부(202)는 자신에게 입력된 데이터(Data)의 비트값에 대응하여 특정 시점에 제 2제어신호(로우극성)를 공급한다. 실제로, 제어신호는 쉬프트 레지스터들(200)에서 공급되는 쉬프트신호들 중 어느 하나와 동기되도록 공급된다.
상세히 설명하면, 쉬프트신호에 의하여 제 2스위치들(SW2)이 순차적으로 턴-온될 때 제어부(202)는 제 1제어신호를 공급한다. 그러면, 턴-온된 제 2스위치(SW2)를 경유하여 제 1제어신호가 제 1스위치(SW1)로 공급되고, 이에 따라 제 1스위치(SW1)는 턴-오프 상태를 유지한다.
한편, 특정 시점에 제 2스위치(SW2)가 턴-온될 때 제 2제어신호가 공급된다. 그러면, 턴-온된 제 2스위치(SW2)를 경유하여 제 2제어신호를 공급받은 제 1스위치(SW1)가 턴-온된다. 제 1스위치(SW1)가 턴-온되면 전압 생성부(2041)에서 생성된 다수의 전압 중 어느 하나의 전압이 데이터선(D)으로 출력된다. 데이터선(D)으로 출력되는 전압은 데이터신호로써 주사신호에 의하여 선택된 화소로 공급된다.
이후, 구동기간에는 다수의 제 1스위치들(SW1) 중 제 2제어신호를 공급받은 어느 하나의 제 1스위치(SW1)가 턴-온 상태를 유지하면서 데이터신호를 데이터선(D)으로 공급한다. 그러면, 주사신호에 선택된 화소에 안정적으로 데이터신호가 공급된다.
도 9는 신호 생성부의 동작과정을 나타내는 시뮬레이션 파형도이다.
도 9를 참조하면, 프리차지 기간 동안 데이터선(D)으로 공급되는 가장 낮은 계조의 전압에 의하여 데이터선(D)의 전압이 가장 낮은 계조의 전압으로 상승된다. 그리고, 구동기간 동안 다수의 쉬프트신호들 중 어느 하나의 쉬프트신호와 동기되도록 공급되는 제 2제어신호에 의하여 데이터선(D)으로 데이터신호(즉, 데이터(Data)의 비트값에 대응하는 전압)가 출력된다. 데이터선(D)으로 출력되는 데이터신호는 구동기간 동안 데이터선(D)으로 공급되면서 화소에 안정적으로 공급된다.
한편, 도 9에서는 프리차지 전압과 데이터신호의 전압이 서로 유사한 전압으로 보이지만 실제로는 도 10에 도시된 바와 같이 데이터신호의 전압은 프리차지 전압보다 소정 전압 상승된다. 여기서, 데이터(Data)의 비트에 따라서 프리차지 전압이 데이터신호로 선택될 때 프리차지 전압과 데이터신호의 전압이 동일해질 수도 있다.
도 11은 종래의 디지털-아날로그 변환기와 본 발명의 디지털-아날로그 변화 기를 동시에 사용하는 실시예를 나타내는 도면이다. 도 11에서는 설명의 편의성을 위하여 종래의 디지털-아날로그 변환기를 "DAC"(또는 제 1디지털-아날로그 변환기)로 표시하고, 본 발명의 디지털-아날로그 변환기를 "SCRDAC"(또는 제 2디지털-아날로그 변환기)로 표시하기로 한다. 그리고, 도 11에서는 8비트의 데이터가 입력된다고 가정하기로 한다.
도 11을 참조하면, 먼저 제 1전압 생성부(300)에서 생성된 다수의 전압이 버퍼(302)를 경유하여 DAC(304)로 공급된다. 그러면, DAC(304)는 데이터(Data)의 상위 3비트에 대응하여 서로 인접된 2개의 전압을 추출하고, 추출된 전압을 제 2전압 생성부(305)로 공급한다. 여기서, DAC(304)는 현재 공지된 다양한 형태의 디지털-아날로그 변환기가 사용될 수 있다. 실제로, 데이터(Data)의 일정비트에 대응하여 2개의 전압을 추출하는 다양한 DAC가 공지되어 있다. 그리고, 제 1전압 생성부(300)에서 출력되는 전압들은 도 11에 도시된 바와 같이 모든 DAC에서 공통적으로 사용된다.
제 2전압 생성부(305)는 자신에 공급된 2개의 전압을 다수의 전압으로 분할하고, 분할된 전압을 SCRDAC(306)로 공급한다. 그러면, SCRDAC(306)는 데이터(Data)의 하위 5비트에 대응하여 제 2전압 생성부(305)로부터 공급되는 전압 중 어느 하나의 전압을 추출하고, 추출된 전압을 버퍼(310)를 경유하여 데이터선(D)으로 공급한다.
한편, 본 발명에서는 도 6에 도시된 바와 같이 제어신호를 생성하기 위하여 제어부(202)가 별도로 구비된 것으로 도시되었다. 하지만, 본 발명에서는 제어 부(202) 없이 홀딩 래치부(125)로부터 제어신호를 공급받을 수 있다. 홀딩 래치부(125)에서 제어신호를 공급할 수 있는 구성은 본원 발명과 동일 날짜로 출원된 출원번호 10-2007-0011012에 기재되어 있다.
상기 발명의 상세한 설명과 도면은 단지 본 발명의 예시적인 것으로서, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 따라서, 이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 보호 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허청구범위에 의해 정하여 져야만 할 것이다.
상술한 바와 같이, 본 발명의 실시 예에 따른 디지털-아날로그 변환기 및 이를 이용한 데이터 구동부와 평판 표시장치에 의하면 디지털-아날로그 변환기에 포함되는 스위치들의 숫자를 최소화할 수 있고, 이에 따라 디지털-아날로그 변환기의 면적을 줄일 수 있는 장점이 있다. 또한, 디지털-아날로그 변환기에 포함되는 스위치들의 숫자가 줄어들게 되면 스위치들의 오동작 확률이 줄어들고, 이에 따라 신뢰성을 향상시킬 수 있는 장점이 있다.

Claims (27)

  1. 자신에게 공급되는 데이터의 비트값에 대응하여 제 1제어신호 또는 제 2제어신호를 생성하는 제어부와;
    제 1전압 및 제 2전압 사이에 위치되어 제 1전압 및 제 2전압을 분할하기 위한 다수의 저항을 구비하는 전압 생성부와;
    상기 저항들 각각의 노드와 출력단자 사이에 접속되는 제 1스위치들과;
    상기 제어부로부터 출력되는 상기 제 1제어신호 또는 제 2제어신호를 상기 제 1스위치들의 게이트전극으로 전달하기 위한 제 2스위치들과;
    상기 제 2스위치들과 각각 접속되며, 상기 제 1제어신호 또는 제 2제어신호의 전압을 충전하는 커패시터들과;
    상기 제 2스위치들로 리셋신호들 또는 쉬프트신호들을 공급하기 위한 쉬프트 레지스터들을 구비하는 것을 특징으로 하는 디지털-아날로그 변환기.
  2. 제 1항에 있어서,
    상기 리셋신호들은 상기 쉬프트 레지스터들에서 동시에 공급되며, 상기 리셋신호들이 공급될 때 상기 제 2스위치들이 턴-온되는 것을 특징으로 하는 디지털-아날로그 변환기.
  3. 제 2항에 있어서,
    상기 리셋신호가 공급되는 기간 동안 상기 제 1제어신호가 상기 제 1스위치들로 공급되어 상기 제 1스위치들이 턴-오프되는 것을 특징으로 하는 디지털-아날로그 변환기.
  4. 제 1항에 있어서,
    상기 쉬프트 레지스터들은 상기 쉬프트 신호를 순차적으로 공급하여 상기 제 2스위치들을 순차적으로 턴-온시키는 것을 특징으로 하는 디지털-아날로그 변환기.
  5. 제 4항에 있어서,
    상기 제어부는 상기 쉬프트신호들 중 어느 하나의 쉬프트신호와 동기되도록 상기 제 2제어신호를 공급하고, 그 외의 경우에는 상기 제 1제어신호를 공급하는 것을 특징으로 하는 디지털-아날로그 변환기.
  6. 제 5항에 있어서,
    상기 제 2제어신호를 공급받은 상기 제 1스위치가 턴-온되어 상기 전압 생성부에서 생성되는 다수의 전압들 중 어느 하나의 전압이 데이터신호로써 출력되는 것을 특징으로 하는 디지털-아날로그 변환기.
  7. 제 6항에 있어서,
    상기 전압 생성부에서 가장 낮은 전압을 생성하는 노드와 상기 출력단자 사이에 접속되는 프리차지 스위치를 더 구비하는 것을 특징으로 하는 디지털-아날로그 변환기.
  8. 제 7항에 있어서,
    상기 프리차지 스위치는 상기 데이터신호가 출력되기 이전에 턴-온되는 것을 특징으로 하는 디지털-아날로그 변환기.
  9. 제 1항에 있어서
    상기 데이터가 k(k는 자연수)비트로 설정되는 경우 상기 쉬프트 레지스터들은 2k개로 설정되는 것을 특징으로 하는 디지털-아날로그 변환기.
  10. 제 9항에 있어서
    상기 전압 생성부는 2k개의 전압을 생성하는 것을 특징으로 하는 디지털-아날로그 변환기.
  11. 샘플링신호를 순차적으로 생성하기 위한 제 1쉬프트 레지스터부와;
    상기 샘플링신호에 대응하여 데이터를 순차적으로 저장하기 위한 샘플링 래치부와;
    상기 샘플링 래치부에 저장된 데이터를 저장하고, 저장된 데이터를 동시에 출력하기 위한 홀딩 래치부와;
    상기 홀딩 래치부로부터 공급되는 데이터에 대응하여 데이터신호를 생성하기 위한 복수의 디지털-아날로그 변환기를 포함하는 데이터신호 생성부와;
    상기 디지털-아날로그 변환기와 공통적으로 접속되어 리셋신호들 및 쉬프트신호들을 공급하기 위한 제 2쉬프트 레지스터들을 구비하며;
    상기 디지털-아날로그 변환기 각각은
    제 1전압 및 제 2전압 사이에 위치되어 제 1전압 및 제 2전압을 분할하기 위한 다수의 저항을 구비하는 전압 생성부와;
    상기 데이터의 비트값에 대응하여 특정 시점에 제 2제어신호를 생성하고, 그 외의 기간 동안 제 1제어신호를 생성하는 제어부와;
    상기 쉬프트신호와 동기되도록 상기 제 2제어신호가 공급될 때 상기 전압 생성부에서 생성된 전압들 중 어느 하나의 전압을 상기 데이터신호로써 출력하고, 상기 제 1제어신호가 공급될 때 상기 전압 생성부에서 생성된 전압들을 출력하지 않는 신호 생성부를 구비하는 것을 특징으로 하는 데이터 구동부.
  12. 제 11항에 있어서,
    상기 신호 생성부는
    상기 저항들 각각의 노드와 출력단자 사이에 접속되는 제 1스위치들과;
    상기 제 1제어신호 또는 제 2제어신호를 상기 제 1스위치들의 게이트전극으로 전달하기 위한 제 2스위치들과;
    상기 제 2스위치들과 접속되며, 상기 제 1제어신호 또는 제 2제어신호의 전압을 충전하는 커패시터들을 구비하는 것을 특징으로 하는 데이터 구동부.
  13. 제 12항에 있어서,
    상기 리셋신호는 상기 제 2쉬프트 레지스터들에서 동시에 공급되어 상기 제 2스위치들을 동시에 턴-온시키는 것을 특징으로 하는 데이터 구동부.
  14. 제 13항에 있어서,
    상기 리셋신호가 공급되는 기간 동안 상기 제 1제어신호가 상기 제 1스위치들로 공급되어 상기 제 1스위치들이 턴-오프되는 것을 특징으로 하는 데이터 구동부.
  15. 제 12항에 있어서,
    상기 쉬프트신호들은 상기 제 2쉬프트 레지스터들에서 순차적으로 공급되면서 상기 제 2스위치들을 순차적으로 턴-온시키는 것을 특징으로 하는 데이터 구동부.
  16. 제 15항에 있어서,
    상기 쉬프트신호들 중 어느 하나와 동기되도록 공급되는 상기 제 2제어신호에 의하여 상기 다수의 제 1스위치들 중 어느 하나가 턴-온되어 상기 데이터신호가 출력되는 것을 특징으로 하는 데이터 구동부.
  17. 제 12항에 있어서,
    상기 전압 생성부에서 가장 낮은 전압을 생성하는 노드와 상기 출력단자 사이에 접속되는 프리차지 스위치를 더 구비하는 것을 특징으로 하는 데이터 구동부.
  18. 제 17항에 있어서,
    상기 프리차지 스위치는 상기 출력단자로 상기 데이터신호가 출력되기 이전에 턴-온되는 것을 특징으로 하는 데이터 구동부.
  19. 주사선들로 주사신호를 순차적으로 공급하기 위한 주사 구동부와;
    데이터선들로 상기 주사신호와 동기되도록 데이터신호들을 공급하기 위하여 상기 제 11항 내지 제 18항 중 어느 한 항에 기재된 데이터 구동부와;
    상기 주사선들과 데이터선들의 교차부에 위치되며 상기 주사신호가 공급될 때 상기 데이터신호에 대응되는 전압을 충전하고, 충전된 전압에 대응하는 빛을 생성하는 화소들을 구비하는 것을 특징으로 하는 평판 표시장치.
  20. 주사선들로 주사신호를 순차적으로 공급하기 위한 주사 구동부와;
    제 1전압과 제 2전압을 분할하기 위하여 다수의 저항을 포함하는 제 1전압 생성부와, k(k는 자연수)비트의 데이터 중 상위 i(i는 k보다 작은 자연수)비트를 입력받고 입력받은 i비트에 대응하여 상기 제 1전압 생성부에서 생성된 전압들 중 인접된 2개의 전압을 출력하는 제 1디지털-아날로그 변환기들과, 상기 제 1디지털-아날로그 변화기에서 출력된 2개의 전압을 다수의 전압으로 분할하기 위한 제 2전압 생성부들과, 상기 k비트의 데이터 중 i비트를 제외한 하위비트들에 대응하여 상기 제 2전압 생성부에서 생성된 전압들 중 어느 하나의 전압을 데이터신호로 출력하기 위한 제 2디지털-아날로그 변환기들과, 상기 제 2디지털-아날로그 변환기와 공통적으로 접속되어 리셋신호들 및 쉬프트신호들을 공급하기 위한 쉬프트 레지스터들을 구비하는 데이터 구동부와;
    상기 데이터신호에 대응되는 빛을 생성하기 위한 화소들을 구비하며;
    상기 제 2디지털-아날로그 변환기들 각각은
    상기 데이터의 비트값에 대응하여 특정 시점에 제 2제어신호를 생성하고, 그 외의 기간 동안 제 1제어신호를 생성하는 제어부와;
    상기 쉬프트신호와 동기되도록 상기 제 2제어신호가 공급될 때 상기 제 2전압 생성부에서 생성된 전압들 중 어느 하나의 전압을 상기 데이터신호로써 출력하고, 상기 제 1제어신호가 공급될 때 상기 제 2전압 생성부에서 생성된 전압들을 출력하지 않는 신호 생성부를 구비하는 것을 특징으로 하는 평판 표시장치.
  21. 제 20항에 있어서,
    상기 신호 생성부는
    상기 제 2전압 생성부에 포함되는 저항들 각각의 노드와 출력단자 사이에 접속되는 제 1스위치들과;
    상기 제 1제어신호 또는 제 2제어신호를 상기 제 1스위치들의 게이트전극으로 전달하기 위한 제 2스위치들과;
    상기 제 2스위치들과 접속되며, 상기 제 1제어신호 또는 제 2제어신호의 전압을 충전하는 커패시터들을 구비하는 것을 특징으로 하는 평판 표시장치.
  22. 제 21항에 있어서,
    상기 리셋신호는 상기 쉬프트 레지스터들에서 동시에 공급되어 상기 제 2스위치들을 동시에 턴-온시키는 것을 특징으로 하는 평판 표시장치.
  23. 제 22항에 있어서,
    상기 리셋신호가 공급되는 기간 동안 상기 제 1제어신호가 상기 제 1스위치들로 공급되어 상기 제 1스위치들이 턴-오프되는 것을 특징으로 하는 평판 표시장치.
  24. 제 21항에 있어서,
    상기 쉬프트신호들은 상기 쉬프트 레지스터들에서 순차적으로 공급되면서 상기 제 2스위치들을 순차적으로 턴-온시키는 것을 특징으로 하는 평판 표시장치.
  25. 제 24항에 있어서,
    상기 쉬프트신호들 중 어느 하나와 동기되도록 공급되는 상기 제 2제어신호에 의하여 상기 다수의 제 1스위치들 중 어느 하나가 턴-온되어 상기 데이터신호가 출력되는 것을 특징으로 하는 평판 표시장치.
  26. 제 21항에 있어서,
    상기 전압 생성부에서 가장 낮은 전압을 생성하는 노드와 상기 출력단자 사이에 접속되는 프리차지 스위치를 더 구비하는 것을 특징으로 하는 평판 표시장치.
  27. 제 26항에 있어서,
    상기 프리차지 스위치는 상기 출력단자로 상기 데이터신호가 출력되기 이전에 턴-온되는 것을 특징으로 하는 평판 표시장치.
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