KR100804632B1 - 전류 소모를 줄이는 데이터 전송 장치 및 방법, 액정 표시장치의 소스 드라이버 및 소스 구동 방법, 이를 포함하는액정 표시 장치 - Google Patents

전류 소모를 줄이는 데이터 전송 장치 및 방법, 액정 표시장치의 소스 드라이버 및 소스 구동 방법, 이를 포함하는액정 표시 장치 Download PDF

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Abstract

전류 소모를 줄이는 데이터 전송 장치 및 방법, 액정 표시 장치의 소스 드라이버 및 소스 구동 방법, 이를 포함하는 액정 표시 장치를 개시한다. 전류 소모를 줄이는 데이터 전송 장치는 데이터를 제공하는 데이터 소스, 복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인, 상기 각 데이터 전송 구간과 연결되는 복수의 데이터 저장부들 및 특정 데이터 저장부에 상기 제공된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함하고, 상기 복수의 데이터 저장부들은 상기 데이터 저장부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 결정하고, 상기 결정된 결과를 기초로 상기 제공된 데이터를 저장한다. 따라서 데이터 전송시 발생하는 전류 소모를 줄일 수 있으며, 전자파 잡음(EMI) 역시 감소할 수 있다.
액정 표시 장치, LCD, 소스 드라이버, SOURCE DRIVER

Description

전류 소모를 줄이는 데이터 전송 장치 및 방법, 액정 표시 장치의 소스 드라이버 및 소스 구동 방법, 이를 포함하는 액정 표시 장치{DEVICES AND METHOD OF TRANSMITTING DATA, SOURCE DRIVERS AND METHOD OF SOURCE DRIVING IN LIQUID CRYSTAL DISPLAY CONSUMING LESS POWER, LIQUID CRYSTAL DISPLAY DEVICES HAVING THE SAME}
도 1은 액정 표시 장치의 전자파 장애 (Electromagnetic Interference, EMI)측정을 위한 환경을 나타낸다.
도 2는 EMI에 대한 국제 규격을 나타내는 그래프이다.
도 3은 본 발명의 일 실시예에 따른 액정 표시 장치(Liquid Crystal Device, LCD)를 나타내는 블록도이다.
도 4는 도 3의 소스 드라이버의 일 실시예를 나타내는 블록도이다.
도 5는 본 발명의 일 실시예에 따른 소스 드라이버의 일부 구성을 나타내는 블록도이다.
도 6은 데이터 전송 컨트롤러(570)의 동작을 나타내는 타이밍도이다.
도 7은 종래의 액정 표시 장치 및 본 발명의 일 실시예에 따른 액정 표시 장치에 있어 전류량의 변화를 나타내는 그래프이다.
도 8은 도 7에서 도시된 각 파형을 FFT (Fast Fourier Transform)를 수행한 결과를 나타내는 그래프이다.
<도면의 주요 부분에 대한 부호의 설명>
310 : 타이밍 컨트롤러 320 : 소스 드라이버
330 : 게이트 드라이버 430 : 데이터 레지스터
440 : 쉬프트 레지스터부 450 : 데이터 래치부
본 발명은 데이터 전송 장치 및 방법, 액정 표시 장치의 소스 드라이버 및 소스 구동 방법, 이를 포함하는 액정 표시 장치에 관한 것으로 특히, 전류 소모를 줄이기 위한 데이터 전송 장치 및 방법, 액정 표시 장치의 소스 드라이버 및 소스 구동 방법, 이를 포함하는 액정 표시 장치에 관한 것이다.
액정 표시 장치(Liquid Crystal Display Device, LCD)는 액정(Liquid Crystal, LC)을 이용하여 영상을 표시하는 평판 표시 장치(flat display device)의 하나이며, 오늘날 사용자의 요구에 따라 액정 표시 장치의 평판 크기는 점차적으로 증가하고 있다. 상기 액정 표시 장치의 평판 크기가 증가함에 따라 액정 표시 장치가 표시해야 할 화소의 수 역시 증가하므로 액정 표시 장치의 전류 소모 역시 증가하고 있다.
상기 액정 표시 장치와 같이 대부분의 전류를 소모하는 장치는 그 장치의 목적이 전파 방출이 아님에도 불구하고 전자파 잡음을 발생시키며, 상기 전자파 잡음 은 전파 방사의 형태로 전달된다. 상기 전자파 잡음은 전자파 장애(Electromagnetic Interference, EMI)로 불린다.
도 1은 액정 표시 장치의 전자파 장애 (Electromagnetic Interference, EMI)측정을 위한 환경을 나타내고, 도 2는 EMI에 대한 국제 규격을 나타내는 그래프이다.
도 1에 나타난 바와 같이, EMI 측정 방법은 액정 표시 장치의 패널에 H 패턴을 표시한 후 상기 액정 표시 장치로부터 3 또는 10 미터 떨어진 거리에서 안테나를 사용하여 EMI 레벨을 측정한다.
도 2의 국제무선장해특별위원회의 CISPR 22 규격은 EMI 레벨은 액정 표시 장치로부터 3 미터 떨어진 거리에서 측정한다. 주파수 대역 30 ~ 238 MHz 구간의 경우 액정 표시 장치의 EMI 레벨은 40 dB을 초과하지 않아야 하며, 주파수 대역 238 ~ 1000 MHz 구간의 경우 액정 표시 장치의 EMI 레벨은 49.8 dB을 초과하지 않아야 한다.
도 2의 국제무선장해특별위원회의 CISPR 22-B 규격은 EMI 레벨은 액정 표시 장치로부터 10 미터 떨어진 거리에서 측정한다. 주파수 대역 30 ~ 238 MHz 구간의 경우 액정 표시 장치의 EMI 레벨은 30 dB을 초과하지 않아야 하며, 주파수 대역 238 ~ 1000 MHz 구간의 경우 액정 표시 장치의 EMI 레벨은 37 dB을 초과하지 않아야 한다.
만일 액정 표시 장치가 도 2에 나타난 상기 CISPR 22 및 CISPR 22 B 규격을 만족시키지 못할 경우 불량으로 처리되므로, EMI 레벨은 액정 표시 장치에 있어서 중요한 문제이다.
일반적으로 EMI는 전자기파의 일종이므로, 전자기파의 전기장 크기를 나타내는 다음의 수학식 1을 만족시킨다.
[수학식 1]
Figure 112006033239752-pat00001
(k는 상수, I는 전류, l은 도선의 길이, f는 주파수, r은 거리)
상기 수학식 1을 살펴보면, 전기장의 크기는 전류, 도선의 길이 및 주파수에 비례하고, 거리에 반비례한다. 따라서 EMI의 감소시키는 효과적인 방법은 전류를 감소시키고, 도선의 길이를 줄이는 것이다.
일반적으로 액정 표시 장치는 영상을 라인단위로 출력하므로 짧은 시간에 많은 데이터를 전송하며, 결과적으로 많은 전류를 소모한다.
본 발명의 목적은 상기 종래 기술의 문제점을 해결하기 위하여 전류 소모를 줄이기 위한 데이터 전송 장치 및 방법을 제공하는데 있다.
본 발명의 다른 목적은 전류 소모를 줄이기 위한 액정 표시 장치의 소스 드라이버 및 소스 구동 방법을 제공하는 데 있다.
본 발명의 또 다른 목적은 전류 소모를 줄이기 위한 소스 드라이버를 포함하 는 액정 표시 장치를 제공하는 데 있다.
상기 목적을 달성하기 위하여 본 발명의 전류 소모를 줄이기 위한 데이터 전송 장치는 데이터를 제공하는 데이터 소스, 복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인, 상기 각 데이터 전송 구간과 연결되는 복수의 데이터 저장부들 및 특정 데이터 저장부에 상기 제공된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함하고, 상기 상기 복수의 데이터 저장부들은 상기 데이터 저장부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 결정하고, 상기 결정된 결과를 기초로 상기 제공된 데이터를 저장한다.
상기 데이터 전송 장치는 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위칭부를 더 포함할 수 있고, 상기 데이터 전송 제어기는 상기 특정 데이터 저장부에 상기 제공된 데이터를 저장하기 위하여 상기 스위칭부를 제어할 수 있다.
상기 데이터 전송 제어기는 상기 스위칭부를 제어하여 상기 데이터 소스에서 상기 특정 데이터 저장부 간의 제1 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송할 수 있고, 상기 제1 데이터 전송 구간 이외의 제2 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하지 않을 수 있다. 전류의 소모를 감소시키기 위함이다.
상기 데이터 전송 장치는 상기 데이터 저장부에 클럭 신호를 제공하는 클럭 공급기를 더 포함할 수 있고, 상기 각 데이터 저장부는 상기 제공된 클럭을 기초로 상기 제공된 데이터의 저장 여부를 결정할 수 있다.
상기 각 데이터 저장부는 상기 제공된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 제공된 데이터의 저장 여부를 결정할 수 있다.
상기 다른 목적을 달성하기 위하여 전류 소모를 줄이기 위한 액정 표시 장치의 소스 드라이버는 데이터를 제공하는 데이터 레지스터, 복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인, 상기 각 데이터 전송 구간들과 연결되고, 상기 제공된 데이터를 저장하는 복수의 데이터 래치부들, 상기 제공된 데이터를 상기 데이터 래치부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 나타내는 제어 신호를 상기 각 데이터 래치부들에 제공하는 쉬프트 레지스터부 및 특정 데이터 래치부에 상기 제공된 데이터를 전송하도록 상기 각 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함한다.
상기 쉬프트 레지스터부는 외부로부터 클럭 신호를 입력받고, 상기 입력된 클럭 신호를 쉬프팅 연산하여 상기 제어 신호를 생성할 수 있다. 또한, 상기 클럭 신호를 상기 쉬프트 레지스터부에 공급하는 클럭 공급기를 더 포함할 수 있다.
소스 드라이버는 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위칭부를 더 포함할 수 있고, 상기 데이터 전송 제어기는 상기 특정 데이터 래치부에 상기 제공된 데이터를 저장하기 위하여 상기 스위칭부를 제어할 수 있다.
상기 데이터 전송 제어기는 상기 스위칭부를 제어하여 상기 데이터 소스에서 상기 특정 데이터 래치부간의 제1 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송할 수 있고, 상기 제1 데이터 전송 구간 이외의 제2 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하지 않을 수 있다.
상기 데이터 전송 제어기는 상기 입력된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 제1 데이터 전송 구간을 결정할 수 있다.
예를 들어, 상기 데이터 래치부들은 N개의 데이터 래치부를 포함하고, 상기 각 데이터 래치부는 M개의 데이터 래치 회로를 포함할 경우, 상기 스위치 컨트롤러는 상기 카운팅된 클럭 수를 M X N 값으로 나눈 나머지 나누고, 상기 나눈 결과 값을 상기 M으로 나눈 값을 기초로 상기 제1 데이터 전송 구간을 결정할 수 있다.
상기 다른 목적을 달성하기 위하여 전류 소모를 줄이기 위한 액정 표시 장치는 복수개의 게이트 라인들과 복수개의 데이터 라인들을 구비하는 액정 디스플레이 패널, 상기 액정 디스플레이 패널의 게이트 라인들을 구동하기 위한 게이트 드라이버 및 상기 액정 디스플레이 패널의 데이터 라인들을 구동하기 위한 소스 드라이버를 포함하고, 상기 소스 드라이버는 데이터를 제공하는 데이터 레지스터, 복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인, 상기 각 데이터 전송 구간들과 연결되고, 상기 제공된 데이터를 저장하는 복수의 데이터 래치부들, 상기 제공된 데이터를 상기 데이터 래치부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 나타내는 제어 신호를 상기 각 데이터 래치부들에 제공하는 쉬프트 레지스터부 및 특정 데이터 래치부에 상기 제공된 데이터를 전송하도록 상기 각 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함한다.
상기 쉬프트 레지스터부는 외부로부터 클럭 신호를 입력받고, 상기 입력된 클럭 신호를 쉬프팅 연산하여 상기 제어 신호를 생성할 수 있다. 또한, 상기 클럭 신호를 상기 쉬프트 레지스터부에 공급하는 클럭 공급기를 더 포함할 수 있다.
상기 소스 드라이버는 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위칭부를 더 포함할 수 있고, 상기 데이터 전송 제어기는 상기 특정 데이터 래치부에 상기 제공된 데이터를 저장하기 위하여 상기 스위칭부를 제어할 수 있다.
상기 데이터 전송 제어기는 상기 스위칭부를 제어하여 상기 데이터 소스에서 상기 특정 데이터 래치부간의 제1 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송할 수 있고, 상기 제1 데이터 전송 구간 이외의 제2 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하지 않을 수 있다.
상기 데이터 전송 제어기는 상기 입력된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 제1 데이터 전송 구간을 결정할 수 있다.
예를 들어, 상기 데이터 래치부들은 N개의 데이터 래치부를 포함하고, 상기 각 데이터 래치부는 M개의 데이터 래치 회로를 포함할 경우, 상기 스위치 컨트롤러는 상기 카운팅된 클럭 수를 M X N 값으로 나눈 나머지 나누고, 상기 나눈 결과 값을 상기 M으로 나눈 값을 기초로 상기 제1 데이터 전송 구간을 결정할 수 있다.
상기 또 다른 목적을 달성하기 위하여 본 발명의 전류 소모를 줄이기 위한 데이터 전송 방법은 데이터 소스로부터 데이터를 출력하는 단계, 복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인을 통하여 상기 출력된 데이터를 상기 각 데이터 전송 구간들과 연결된 데이터 저장부들에 전송하는 단계, 상기 출력된 데이터를 상기 데이터 전송 저장부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 출력된 데이터의 저장 여부를 결정하는 단계, 특정 데이터 저장부에 상기 출 력된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 제어하는 단계를 포함한다.
상기 출력된 데이터의 저장 여부를 결정하는 단계는 외부로부터 입력된 클럭 신호를 쉬프팅하여 상기 쉬프팅된 클럭 신호를 기초로 상기 출력된 데이터의 저장 여부를 결정하는 단계를 포함할 수 있다. 또한, 상기 데이터 전송 구간들을 제어하는 단계는 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위치부를 제어하는 단계를 포함할 수 있다.
상기 또 다른 목적을 달성하기 위하여 본 발명의 전류 소모를 줄이기 위한 액정 표시 장치의 소스 구동 방법은 데이터 레지스터로부터 데이터를 출력하는 단계, 복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인을 통하여 상기 출력된 데이터를 상기 각 데이터 전송 구간들과 연결된 데이터 래치부들에 전송하는 단계, 상기 출력된 데이터를 상기 데이터 전송 래치부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 출력된 데이터의 저장 여부를 결정하는 단계 및 특정 데이터 래치부에 상기 출력된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 제어하는 단계를 포함한다.
상기 출력된 데이터의 저장 여부를 결정하는 단계는 외부로부터 입력된 클럭 신호를 쉬프팅하여 상기 쉬프팅된 클럭 신호를 기초로 상기 출력된 데이터의 저장 여부를 결정하는 단계를 포함할 수 있다. 또한, 상기 데이터 전송 구간들을 제어하는 단계는 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위치부를 제어하는 단계를 포함할 수 있다.
상기 스위치부를 제어하는 단계는 상기 입력된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 데이터 레지스터에서 상기 특정 데이터 래치부간의 데이터 전송 구간을 결정하는 단계를 포함할 수 있다.
따라서 본 발명의 일 실시예에 따른 액정 표시 장치는 데이터 레지스터와 데이터 래치부 간의 데이터 전송 구간을 제어하여 액정 표시 장치의 소스 드라이버에 소모되는 전류를 감소시킬 수 있다.
또한, 소스 드라이버에서 소모되는 전류를 감소하여 전류와 비례하는 EMI를 감소시킬 수 있다.
본문에 개시되어 있는 본 발명의 실시예들에 대해서, 특정한 구조적 내지 기능적 설명들은 단지 본 발명의 실시예를 설명하기 위한 목적으로 예시된 것으로, 본 발명의 실시예들은 다양한 형태로 실시될 수 있으며 본문에 설명된 실시예들에 한정되는 것으로 해석되어서는 아니 된다.
본 발명은 다양한 변경을 가할 수 있고 여러 가지 형태를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 본문에 상세하게 설명하고자 한다. 그러나, 이는 본 발명을 특정한 개시 형태에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 모든 변경, 균등물 내지 대체물을 포함하는 것으로 이해되어야 한다.
제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다. 예를 들어, 본 발명의 권리 범위로부터 이탈되지 않은 채 제1 구성요소는 제2 구성요소로 명명될 수 있고, 유사하게 제2 구성요소도 제1 구성요소로 명명될 수 있다.
어떤 구성요소가 다른 구성요소에 "연결되어" 있다거나 "접속되어" 있다고 언급된 때에는, 그 다른 구성요소에 직접적으로 연결되어 있거나 또는 접속되어 있을 수도 있지만, 중간에 다른 구성요소가 존재할 수도 있다고 이해되어야 할 것이다. 반면에, 어떤 구성요소가 다른 구성요소에 "직접 연결되어" 있다거나 "직접 접속되어" 있다고 언급된 때에는, 중간에 다른 구성요소가 존재하지 않는 것으로 이해되어야 할 것이다. 구성요소들 간의 관계를 설명하는 다른 표현들, 즉 "~사이에"와 "바로 ~사이에" 또는 "~에 이웃하는"과 "~에 직접 이웃하는" 등도 마찬가지로 해석되어야 한다.
본 출원에서 사용한 용어는 단지 특정한 실시예를 설명하기 위해 사용된 것으로, 본 발명을 한정하려는 의도가 아니다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다. 본 출원에서, "포함하다" 또는 "가지다" 등의 용어는 설시된 특징, 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.
다르게 정의되지 않는 한, 기술적이거나 과학적인 용어를 포함해서 여기서 사용되는 모든 용어들은 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에 의해 일반적으로 이해되는 것과 동일한 의미를 가지고 있다. 일반적으로 사용되는 사전에 정의되어 있는 것과 같은 용어들은 관련 기술의 문맥 상 가지는 의미와 일치하는 의미를 가지는 것으로 해석되어야 하며, 본 출원에서 명백하게 정의하지 않는 한, 이상적이거나 과도하게 형식적인 의미로 해석되지 않는다.
한편, 어떤 실시예가 달리 구현 가능한 경우에 특정 블록 내에 명기된 기능 또는 동작이 순서도에 명기된 순서와 다르게 일어날 수도 있다. 예를 들어, 연속하는 두 블록이 실제로는 실질적으로 동시에 수행될 수도 있고, 관련된 기능 또는 동작에 따라서는 상기 블록들이 거꾸로 수행될 수도 있다.
이하 본 발명의 실시예들을 도면과 함께 설명하고자 한다.
도 3은 본 발명의 일 실시예에 따른 액정 표시 장치(Liquid Crystal Device, LCD)를 나타내는 블록도이다.
도 3을 참조하면, 액정 표시 장치(300)는 타이밍 컨트롤러(310), 소스 드라이버(320), 게이트 드라이버(330), 패널(340) 및 전원 공급부(350)를 포함한다.
타이밍 컨트롤러(310)는 그래픽 컨트롤러(미도시됨)로부터 프레임에 대한 수직 동기 신호(VSYNC), 수평 동기 신호(HSYNC), 데이터 인에이블 신호(DE), 클럭 신호(CLK) 및 RGB (Red, Green, Blue) 신호를 입력받아 소스 드라이버(320) 및 게이트 드라이버(330)에 RGB 데이터 및 소스 드라이버 제어 신호 및 게이트 드라이버 제어 신호를 각각 전송한다.
소스 드라이버(320)는 타이밍 컨트롤러(310)로부터 출력된 RGB 데이터 및 소스 드라이버 제어 신호를 입력받아 수평 동기 신호(HSYNC)에 응답하여 라인 단위로 데이터를 패널(340)에 출력한다.
게이트 드라이버(330)는 복수의 게이트 라인들을 포함하며, 타이밍 컨트롤러(310)로부터 출력된 게이트 드라이버 제어 신호를 입력받는다. 게이트 드라이버(330)는 소스 드라이버(230)로부터 출력된 데이터를 패널(340)에 순차적으로 출력하기 위하여 상기 게이트 라인들을 제어한다.
전원 공급부(350)는 타이밍 컨트롤러(310), 소스 드라이버(320), 게이트 드라이버(330) 및 패널(340)에 전원을 공급한다.
이하 도 3에 나타난 액정 표시 장치의 동작을 설명하기로 한다.
우선, 타이밍 컨트롤러(310)는 그래픽 컨트롤러(미도시됨)로부터 영상을 나타내는 RGB 데이터 및 수직 및 수평 동기 신호(VSYNC, HSYNC)와 같은 제어신호를 입력받는다.
게이트 드라이버(330)는 수직 동기 신호(VSYNC)와 같은 게이트 라인 제어 신호를 입력받고, 순차적으로 상기 입력된 수직 동기 신호(VSYNC)를 순차적으로 쉬프팅하여 복수의 게이트 라인을 순차적으로 제어한다.
소스 드라이버(320)는 타이밍 컨트롤러(310)로부터 RGB 데이터 및 소스 드라이버 제어 신호를 입력받고, 게이트 드라이버(330)가 게이트 라인을 제어할 때 한 라인에 해당하는 영상 신호를 패널(340)에 출력한다.
도 4는 도 3의 소스 드라이버의 일 실시예를 나타내는 블록도이다.
도 4를 참조하면, 소스 드라이버(320)는 클럭 공급부(410), RSDS 입력기(420), 데이터 레지스터부(430), 쉬프트 레지스터부(440), 데이터 래치부(450), 디지털-아날로그 변환기(460) 및 출력 버퍼(470)를 포함한다.
클럭 공급부(410)는 외부로부터 클럭 신호를 입력받아 데이터 레지스터부(430) 및 쉬프트 레지스터(440)에 상기 클럭 신호를 제공한다. 상기 클럭 신호는 데이터 레지스터부(430)의 출력 및 쉬프트 레지스터(440)의 출력을 동기화하는데 사용될 수 있다.
RSDS 입력기(420)는 타이밍 컨트롤러(310)로부터 감소된 스윙 차등 신호(Reduced Swing Differential Signaling, RSDS)를 입력받고, RGB 데이터를 각각 데이터 레지스터부(430)에 출력한다. 예를 들어 상기 RGB 데이터는 각각 8 비트로 구성될 수 있다.
데이터 레지스터부(430)는 클럭 공급부(410)로부터 입력된 클럭 신호를 기초로 RGB 데이터를 데이터 래치부(450)에 출력한다. 예를 들어, 데이터 레지스터부(430)는 RGB 데이터를 각각 저장하는 레지스터들로 구성될 수 있다. 또한, 데이터 레지스터부(430)는 RSDS 입력기(420)의 클럭과 같은 속도로 동작하여 8 비트의 데이터를 출력하거나 또는 RSDS 입력기(420)의 클럭의 1/2 속도로 동작하여 16 비트의 데이터를 출력할 수 있다.
쉬프트 레지스터부(440)는 클럭 공급부(410)로부터 클럭 신호를 입력받고, 상기 입력된 클럭 신호에 대하여 순차적으로 쉬프팅 연산을 수행한다. 쉬프트 레지스터부(440)는 상기 쉬프팅된 클럭 신호를 순차적으로 데이터 래치부(450)에 출력한다.
데이터 래치부(450)는 복수의 래치 회로들로 구성되며, 쉬프트 레지스터부(440)로부터 출력된 쉬프팅된 클럭 신호 및 데이터 레지스터부(430)로부터 출력 된 RGB 데이터를 입력받는다. 데이터 래치부(450)는 쉬프팅된 클럭 신호를 기초로 래치 회로들의 한 끝에서 다른 한 끝까지 순차적으로 RGB 데이터를 저장한다.
디지털-아날로그 변환기(460)는 데이터 래치부(450)로부터 저장된 영상의 한 라인에 상응하는 디지털 데이터를 입력받고, 상기 디지털 데이터를 아날로그 데이터로 변환한다.
출력 버퍼(470)는 디지털-아날로그 변환기(460)에 의하여 변환된 아날로그 데이터를 소스 드라이버 제어 신호에 응답하여 패널(450)에 출력한다.
이하, 소스 드라이버(320)의 데이터 레지스터부(430), 쉬프트 레지스터부(440) 및 데이터 래치부(450)의 동작을 설명하기로 한다.
데이터 레지스터부(430) 및 쉬프트 레지스터부(440)는 클럭 공급부(410)로부터 입력된 클럭 신호를 입력받는다. 데이터 레지스터부(430)는 상기 입력된 클럭 신호를 기초로 데이터 래치부(450)에 RGB 데이터를 출력한다. 쉬프트 레지스터부(440)는 상기 입력된 클럭 신호에 대하여 쉬프팅 연산을 수행하고, 상기 쉬프팅된 클럭 신호를 기초로 데이터 래치부(450)에 래치 제어 신호를 출력한다.
데이터 래치부(450)는 상기 쉬프팅된 클럭 신호를 기초로 데이터 레지스터부(430)로부터 출력된 RGB 데이터를 데이터 래치부(450)를 구성하는 래치 회로의 한 끝부터 다른 한 끝까지 순차적으로 저장한다.
예를 들어, 쉬프트 레지스터부(440)는 복수의 쉬프트 레지스터들로 구성될 수 있으며, 상기 쉬프트 레지스터 회로는 래치 회로의 한 끝부터 다른 한 끝까지 순차적으로 저장하기 위하여 데이터 래치부(450)를 구성하는 래치 회로에 각각 대 응할 수 있다.
도 5는 본 발명의 일 실시예에 따른 소스 드라이버의 일부 구성을 나타내는 블록도이다.
도 5를 참조하면, 소스 드라이버(500)는 데이터 레지스터들(512~516), 데이터 전송 라인들(522~526), 데이터 저장부들(530, 540, 550, 560), 데이터 전송 컨트롤러(570) 및 쉬프트 레지스터 클럭 공급부(580), 스위치들(581~592)을 포함한다.
데이터 레지스터들(512~616)은 RGB 데이터 및 클럭 신호를 RSDS 입력기(420) 및 클럭 공급부(410)로부터 각각 입력받고, 상기 클럭에 응답하여 RGB 데이터를 데이터 전송 라인들(522~526)에 각각 출력한다.
데이터 전송 라인들(522~526)은 복수의 데이터 전송 구간들을 포함한다. 예를 들어, 상기 복수의 데이터 전송 구간들은 스위치들(581~592)에 의하여 제어될 수 있다.
데이터 저장부들(530, 540, 550, 560)은 각각 쉬프트 레지스터부들(532, 542, 552, 562) 및 데이터 래치부들(534, 544, 554, 564)을 포함하고, 상기 데이터 저장부들(530, 540, 550, 560)의 한 끝부터 다른 끝의 순서(예를 들어, 제1 데이터 저장부(530)부터 제4 데이터 저장부(560)의 순서)로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 결정하고, 상기 결정된 결과를 기초로 상기 제공된 데이터를 저장한다.
쉬프트 레지스터부들(532, 542, 552, 562)은 데이터 저장부들(530, 540, 550, 560)의 한 끝부터 다른 끝의 순서(예를 들어, 제1 데이터 저장부(530)부터 제4 데이터 저장부(560)의 순서)로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 결정하기 위하여 쉬프트 레지스터 클럭 공급부(580)로부터 클럭 신호를 각각 입력 받고, 상기 입력된 클럭 신호에 대하여 쉬프팅 연산을 수행하여 상기 쉬프팅된 클럭 신호를 쉬프트 레지스터부들(532, 542, 552, 562)에 상응하는 데이터 래치부들(532, 542, 552, 562)에 출력한다.
데이터 래치부들(534, 544, 554, 564)은 상기 쉬프팅된 클럭 신호를 입력받고 쉬프팅된 클럭에 상응하는 순서대로 상기 제공된 데이터를 저장한다.
쉬프트 레지스터 클럭 공급부(580)는 클럭 공급부(410)로부터 입력된 클럭 신호를 기초로 쉬프트 레지스터부들(532, 542, 552, 562) 및 데이터 전송 컨트롤러(570)에 클럭 신호를 제공한다.
데이터 전송 컨트롤러(570)는 쉬프트 레지스터 클럭 공급부(680)로부터 입력된 클럭 신호를 기초로 데이터 전송 라인들(522~526)을 구성하는 데이터 전송 구간들을 제어한다. 예를 들어, 데이터 전송 컨트롤러(570)는 스위치 제어신호들(C1~C4)을 스위치들(581~592)에 입력하여 스위치들(581~592)을 턴온 또는 턴오프할 수 있다. 즉, 데이터 전송 컨트롤러(570)는 스위치들(581~592)을 턴온 또는 턴오프하여 상기 데이터 전송 구간들을 제어할 수 있다.
예를 들어, 데이터 전송 라인들(522~526)이 8 비트 구성되고 각 라인의 부하 커패시턴스(Load Capacitance)가 2.8 pF 라면, 전체 커패시턴스는 67.2 pF 이다. 그러나 데이터 전송 컨트롤러(570)가 데이터 전송 구간들을 제어하는 경우에는 가 장 최악의 경우에도 전체 커패시턴스가 33.6 pF 이다. 따라서 데이터 전송 라인들(522~526)이 반복적으로 고전압에서 저전압 또는 저전압에서 고전압으로 토글될 경우 발생하는 스위칭 노이즈는 감소할 수 있다.
도 6은 데이터 전송 컨트롤러(570)의 동작을 나타내는 타이밍도이다.
도 6을 참조하면, 데이터 전송 컨트롤러(570)의 동작은 5개의 스텝들(T1~T5)로 구성된다.
이하, 도 5 및 도 6을 참조하여, 데이터 전송 컨트롤러(570)의 동작을 설명하기로 한다.
(1) 첫 번째 스텝(T0, 610~620)에 있어, 데이터 전송 컨트롤러(570)는 스위치들 중 일부 스위치들(581~584, 587~588)을 턴온하기 위하여 제1 제어 신호(C1) 및 제2 제어 신호(C2)에 논리 하이(예를 들어 비트'1')를 출력하고, 제3 제어 신호(C3) 및 제4 제어 신호(C4)에 논리 로우(예를 들어 비트'0')를 출력한다.
즉, 데이터 전송 컨트롤러(570)는 데이터 전송 구간을 조절하여 데이터 레지스터들(512~516)로부터 출력된 RGB 데이터를 제1 데이터 저장부(530)에 출력하고, 상기 RGB 데이터를 제3 및 제4 데이터 저장부들(550, 560)에 출력하지 않는다.
(2) 두 번째 스텝(T1, 620~630)에 있어, 데이터 전송 컨트롤러(570)는 스위치들 중 일부 스위치들(587~588)을 턴온하기 위하여 제2 제어 신호(C2)에 논리 하이(예를 들어 비트'1')를 출력하고, 제1 제어 신호(C1), 제3 제어 신호(C3) 및 제4 제어 신호(C4)에 논리 로우(예를 들어 비트'0')를 출력한다.
즉, 데이터 전송 컨트롤러(570)는 데이터 전송 구간을 조절하여 데이터 레지 스터들(512~516)로부터 출력된 RGB 데이터를 제2 데이터 저장부(540)에 출력하고, 상기 RGB 데이터를 제1, 제3 및 제4 데이터 저장부들(530, 550, 560)에 출력하지 않는다.
(3) 세 번째 스텝(T2, 630~640)에 있어, 데이터 전송 컨트롤러(570)는 스위치들 중 일부 스위치들(585~586)을 턴온하기 위하여 제3 제어 신호(C3)에 논리 하이(예를 들어 비트'1')를 출력하고, 제1 제어 신호(C1), 제2 제어 신호(C2) 및 제4 제어 신호(C4)에 논리 로우(예를 들어 비트'0')를 출력한다.
즉, 데이터 전송 컨트롤러(570)는 데이터 전송 구간을 조절하여 데이터 레지스터들(512~516)로부터 출력된 RGB 데이터를 제3 데이터 저장부(550)에 출력하고, 상기 RGB 데이터를 제1, 제2 및 제4 데이터 저장부들(530, 540, 560)에 출력하지 않는다.
(4) 네 번째 스텝(T3, 640~650)에 있어, 데이터 전송 컨트롤러(570)는 스위치들 중 일부 스위치들(585~586, 589~592)을 턴온하기 위하여 제3 제어 신호(C3) 및 제4 제어 신호(C4)에 논리 하이(예를 들어 비트'1')를 출력하고, 제1 제어 신호(C1) 및 제2 제어 신호(C2)에 논리 로우(예를 들어 비트'0')를 출력한다.
즉, 데이터 전송 컨트롤러(570)는 데이터 전송 구간을 조절하여 데이터 레지스터들(512~516)로부터 출력된 RGB 데이터를 제4 데이터 저장부(560)에 출력하고, 상기 RGB 데이터를 제1 및 제2 데이터 저장부들(530, 540)에 출력하지 않는다.
상기 스텝들(T0~T3)은 데이터 저장부들에 각각 포함된 데이터 래치부들의 개수가 N이고, 상기 데이터 래치부들에 포함된 데이터 래치 회로들이 각각 M이라면, 데이터 전송 컨트롤러(570)는 쉬프트 레지스터 클럭 공급부(580)로부터 입력된 클럭을 카운팅하고, 상기 카운팅된 클럭을 M X N으로 나눈 값을 M으로 나눈 값을 기초로 결정한다. 만일 상기 결과 값이 '0'이면, 데이터 전송 컨트롤러(570)는 첫 번째 스텝(T0)에 상응하는 제어신호들을 출력한다.
예를 들어, 데이터 저장부들(530, 540, 550, 560)에 각각 포함된 데이터 래치부들(534, 544, 554, 564)의 개수가 4이고, 상기 데이터 래치부들(532, 534, 536, 538)에 포함된 데이터 래치 회로들이 각각 120이며, 카운팅된 클럭이 500이라면, 데이터 전송 컨트롤러(570)의 연산 결과는 0이다. 따라서 데이터 전송 컨트롤러(570)는 첫 번째 스텝(T0)에 상응하는 제어신호들(C1~C4)을 출력한다. 즉, 제1 데이터 저장부(530)에 상기 RGB 데이터를 출력한다.
도 7은 종래의 액정 표시 장치 및 본 발명의 일 실시예에 따른 액정 표시 장치에 있어 전류량의 변화를 나타내는 그래프이고, 도 8은 도 7에서 도시된 각 파형을 FFT (Fast Fourier Transform)를 수행한 결과를 나타내는 그래프이다.
도 7을 참조하면, 제1 그래프(710)는 종래 액정 표시 장치에 있어 전류량의 변화를 나타내고, 제2 그래프(720)는 본 발명의 일 실시예에 따른 액정 표시 장치에 있어 전류량의 변화를 나타낸다.
종래 액정 표시 장치의 전류에 대한 피크 대 피크 값은 약 150이고, 본 발명의 일 실시예에 따른 액정 표시 장치에 대한 피크 대 피크 값은 약 30 내지 40 이다. 즉, 본 발명의 일 실시예에 따른 액정 표시 장치에 대한 전류 피크 값은 종래 액정 표시 장치와 비교할 경우 50% 이상 감소한다.
또한, 본 발명의 일 실시예에 따른 액정 표시 장치에 있어 전원 공급부(350)에 흐르는 전류량은 종래 액정 표시 장치에 비교하여 10% 이상 감소한다.
도 8을 참조하면, 제3 그래프(810)는 종래 액정 표시 장치에 있어 FFT 수행 결과를 나타내고, 제4 그래프(820)는 본 발명의 일 실시예에 따른 액정 표시 장치에 있어 FFT 수행 결과를 나타낸다.
본 발명의 일 실시예에 따른 액정 표시 장치에 대한 잡음은 종래 액정 표시 장치와 비교할 경우 10 dB 이상 감소한다.
상술한 바와 같이 본 발명에서는 액정 표시 장치의 데이터 레지스터와 데이터 래치부 간의 데이터 전송 구간을 제어하여 액정 표시 장치의 소스 드라이버에 소모되는 전류를 감소시킬 수 있다.
또한, 소스 드라이버에서 소모되는 전류를 감소하여 전류와 비례하는 EMI를 감소시킬 수 있다.
상기에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.

Claims (26)

  1. 데이터를 제공하는 데이터 소스;
    복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인;
    상기 각 데이터 전송 구간과 연결되는 복수의 데이터 저장부들 - 상기 복수의 데이터 저장부들은 상기 데이터 저장부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 결정하고, 상기 결정된 결과를 기초로 상기 제공된 데이터를 저장함 -; 및
    특정 데이터 저장부에 상기 제공된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함하는 전류 소모를 줄이기 위한 데이터 전송 장치.
  2. 제1항에 있어서,
    상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위칭부를 더 포함하고,
    상기 데이터 전송 제어기는 상기 특정 데이터 저장부에 상기 제공된 데이터를 저장하기 위하여 상기 스위칭부를 제어하는 것을 특징으로 하는 데이터 전송 장치.
  3. 제2항에 있어서, 상기 데이터 전송 제어기는
    상기 스위칭부를 제어하여 상기 데이터 소스에서 상기 특정 데이터 저장부 간의 제1 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하고, 상기 제1 데이터 전송 구간 이외의 제2 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하지 않는 것을 특징으로 하는 데이터 전송 장치.
  4. 제1항에 있어서,
    상기 데이터 저장부에 클럭 신호를 제공하는 클럭 공급기를 더 포함하고,
    상기 각 데이터 저장부는 상기 제공된 클럭을 기초로 상기 제공된 데이터의 저장 여부를 결정하는 것을 특징으로 하는 데이터 전송 장치.
  5. 제4항에 있어서,
    상기 각 데이터 저장부는 상기 제공된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 제공된 데이터의 저장 여부를 결정하는 것을 특징으로 하는 데이터 전송 장치.
  6. 데이터를 제공하는 데이터 레지스터;
    복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인;
    상기 각 데이터 전송 구간들과 연결되고, 상기 제공된 데이터를 저장하는 복수의 데이터 래치부들;
    상기 제공된 데이터를 상기 데이터 래치부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 나타내는 제어 신호를 상기 각 데이터 래치부들에 제공하는 쉬프트 레지스터부; 및
    특정 데이터 래치부에 상기 제공된 데이터를 전송하도록 상기 각 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함하는 전류 소모를 줄이기 위한 액정 표시 장치의 소스 드라이버.
  7. 제6항에 있어서, 상기 쉬프트 레지스터부는 외부로부터 클럭 신호를 입력받고, 상기 입력된 클럭 신호를 쉬프팅 연산하여 상기 제어 신호를 생성하는 것을 특징으로 하는 액정 표시 장치의 소스 드라이버.
  8. 제7항에 있어서,
    상기 클럭 신호를 상기 쉬프트 레지스터부에 공급하는 클럭 공급기를 더 포함하는 것을 특징으로 하는 액정 표시 장치의 소스 드라이버.
  9. 제7항에 있어서,
    상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위칭부를 더 포함하고,
    상기 데이터 전송 제어기는 상기 특정 데이터 래치부에 상기 제공된 데이터를 저장하기 위하여 상기 스위칭부를 제어하는 것을 특징으로 하는 액정 표시 장치의 소스 드라이버.
  10. 제9항에 있어서, 상기 데이터 전송 제어기는
    상기 스위칭부를 제어하여 상기 데이터 소스에서 상기 특정 데이터 래치부간의 제1 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하고, 상기 제1 데이터 전송 구간 이외의 제2 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하지 않는 것을 특징으로 하는 액정 표시 장치의 소스 드라이버.
  11. 제10항에 있어서, 상기 데이터 전송 제어기는
    상기 입력된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 제1 데이터 전송 구간을 결정하는 것을 특징으로 하는 액정 표시 장치의 소스 드라이버.
  12. 제11항에 있어서,
    상기 데이터 래치부들은 N개의 데이터 래치부를 포함하고, 상기 각 데이터 래치부는 M개의 데이터 래치 회로를 포함하며,
    상기 스위치 컨트롤러는 상기 카운팅된 클럭 수를 M X N 값으로 나눈 나머지 나누고, 상기 나눈 결과 값을 상기 M으로 나눈 값을 기초로 상기 제1 데이터 전송 구간을 결정하는 것을 특징으로 하는 액정 표시 장치의 소스 드라이버.
  13. 복수개의 게이트 라인들과 복수개의 데이터 라인들을 구비하는 액정 디스플레이 패널;
    상기 액정 디스플레이 패널의 게이트 라인들을 구동하기 위한 게이트 드라이 버; 및
    상기 액정 디스플레이 패널의 데이터 라인들을 구동하기 위한 소스 드라이버를 포함하고,
    상기 소스 드라이버는
    데이터를 제공하는 데이터 레지스터;
    복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인;
    상기 각 데이터 전송 구간들과 연결되고, 상기 제공된 데이터를 저장하는 복수의 데이터 래치부들;
    상기 제공된 데이터를 상기 데이터 래치부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 상기 제공된 데이터의 저장 여부를 나타내는 제어 신호를 상기 각 데이터 래치부들에 제공하는 쉬프트 레지스터부; 및
    특정 데이터 래치부에 상기 제공된 데이터를 전송하도록 상기 각 데이터 전송 구간들을 제어하는 데이터 전송 제어기를 포함하는 전류 소모를 줄이기 위한 액정 표시 장치.
  14. 제13항에 있어서, 상기 쉬프트 레지스터부는 외부로부터 클럭 신호를 입력받고, 상기 입력된 클럭 신호를 쉬프팅 연산하여 상기 제어 신호를 생성하는 것을 특징으로 하는 액정 표시 장치.
  15. 제14항에 있어서,
    상기 클럭 신호를 상기 쉬프트 레지스터부에 공급하는 클럭 공급기를 더 포함하는 것을 특징으로 하는 액정 표시 장치.
  16. 제14항에 있어서,
    상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위칭부를 더 포함하고,
    상기 데이터 전송 제어기는 상기 특정 데이터 래치부에 상기 제공된 데이터를 저장하기 위하여 상기 스위칭부를 제어하는 것을 특징으로 하는 액정 표시 장치.
  17. 제16항에 있어서, 상기 데이터 전송 제어기는
    상기 스위칭부를 제어하여 상기 데이터 소스에서 상기 특정 데이터 래치부간의 제1 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하고, 상기 제1 데이터 전송 구간 이외의 제2 데이터 전송 구간에 대하여는 상기 제공된 데이터를 전송하지 않는 것을 특징으로 하는 액정 표시 장치.
  18. 제17항에 있어서, 상기 데이터 전송 제어기는
    상기 입력된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 제1 데이터 전송 구간을 결정하는 것을 특징으로 하는 액정 표시 장치.
  19. 제18항에 있어서,
    상기 데이터 래치부들은 N개의 데이터 래치부를 포함하고, 상기 각 데이터 래치부는 M개의 데이터 래치 회로를 포함하며,
    상기 스위치 컨트롤러는 상기 카운팅된 클럭 수를 M X N 값으로 나눈 나머지 나누고, 상기 나눈 결과 값을 상기 M으로 나눈 값을 기초로 상기 제1 데이터 전송 구간을 결정하는 것을 특징으로 하는 액정 표시 장치.
  20. 데이터 소스로부터 데이터를 출력하는 단계;
    복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인을 통하여 상기 출력된 데이터를 상기 각 데이터 전송 구간들과 연결된 데이터 저장부들에 전송하는 단계;
    상기 출력된 데이터를 상기 데이터 전송 저장부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 외부로부터 입력된 클럭 신호를 쉬프팅하여 상기 쉬프팅된 클럭 신호를 기초로 상기 출력된 데이터의 저장 여부를 결정하는 단계;
    특정 데이터 저장부에 상기 출력된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위치부를 제어하는 단계를 포함하는 전류 소모를 줄이기 위한 데이터 전송 방법.
  21. 삭제
  22. 삭제
  23. 데이터 레지스터로부터 데이터를 출력하는 단계;
    복수의 데이터 전송 구간들을 포함하는 데이터 전송 라인을 통하여 상기 출력된 데이터를 상기 각 데이터 전송 구간들과 연결된 데이터 래치부들에 전송하는 단계;
    상기 출력된 데이터를 상기 데이터 전송 래치부들의 한 끝부터 다른 끝의 순서로 저장하기 위하여 외부로부터 입력된 클럭 신호를 쉬프팅하여 상기 쉬프팅된 클럭 신호를 기초로 상기 출력된 데이터의 저장 여부를 결정하는 단계;
    특정 데이터 래치부에 상기 출력된 데이터를 전송하기 위하여 상기 데이터 전송 구간들을 턴온 또는 턴오프하는 스위치부를 제어하는 단계를 포함하는 전류 소모를 줄이기 위한 액정 표시 장치의 소스 구동 방법.
  24. 삭제
  25. 삭제
  26. 제23항에 있어서, 상기 스위치부를 제어하는 단계는
    상기 입력된 클럭을 카운팅하여 상기 카운팅된 클럭 수를 기초로 상기 데이터 레지스터에서 상기 특정 데이터 래치부간의 데이터 전송 구간을 결정하는 단계를 포함하는 것을 특징으로 하는 액정 표시 장치의 소스 구동 방법.
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