KR100784525B1 - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명은 어드레스 전극(X)을 구동시키기 위한 데이터 구동부를 개선한 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것으로, 어드레스 기간에서 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 사용함으로써, 노이즈 및 전자파 장애(EMI)의 발생을 저감시키는 효과가 있다.
이러한 본 발명의 플라즈마 디스플레이 장치는 어드레스 전극이 형성된 플라즈마 디스플레이 패널과, 어드레싱(Addressing)을 위한 어드레스 기간에서 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 상기 어드레스 전극으로 공급하는 데이터 구동부를 포함하는 것이 바람직하다.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
도 1은 종래의 플라즈마 디스플레이 장치의 구동부에 대해 설명하기 위한 도면.
도 2는 종래 플라즈마 디스플레이 장치의 구동부의 동작을 설명하기 위한 도면.
도 3은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면.
도 4a 내지 도 4b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 장치의 구조의 일례를 설명하기 위한 도면.
도 5는 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면.
도 6은 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 상세히 설명하기 위한 도면.
도 7은 본 발명의 플라즈마 디스플레이 장치의 데이터 구동부의 구성을 보다 상세히 설명하기 위한 도면.
도 8은 본 발명에 따른 데이터 구동부가 데이터 펄스를 발생시키는 방법에 대해 설명하기 위한 도면.
도 9a 내지 도 9b는 본 발명에 따른 데이터 구동부의 동작의 또 다른 일례를 설명하기 위한 도면.
도 10은 본 발명에 따른 데이터 구동부의 또 다른 구성에 대해 설명하기 위한 도면.
<도면의 주요 부분에 대한 부호의 설명>
300 : 플라즈마 디스플레이 패널 301 : 데이터 구동부
302 : 스캔 구동부 303 : 서스테인 구동부
본 발명은 플라즈마 디스플레이 장치에 관한 것으로, 보다 상세하게는 어드레스 전극(X)을 구동시키기 위한 데이터 구동부를 개선한 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.
플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 이러한 플라즈마 디스플레이 패널의 전극에 소정의 구동 신호를 공급하는 구동부를 포함하여 이루어진다.
일반적으로 플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode), 예를 들면 스캔 전극(Y), 서스테인 전극(Z), 어드레스 전극(X)이 형성된다.
그리고 구동부는 전극을 통해 방전 셀로 구동 신호를 공급한다.
그러면, 방전 셀 내에서는 공급되는 구동 전압에 의해 방전이 발생한다. 여 기서, 방전 셀 내에서 구동 전압에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.
여기서, 플라즈마 디스플레이 패널의 방전 셀 내에서 발생하는 방전은 리셋 방전, 어드레스 방전, 서스테인 방전 등이 있다.
리셋 방전은 모든 방전 셀을 초기화하기 위한 방전이고, 어드레스 방전은 표시 방전인 서스테인 방전이 발생될 방전 셀을 선택하기 위한 방전이고, 서스테인 방전은 영상을 화면상에 표시하기 위한 표시 방전이다.
여기서 어드레스 방전은 어드레스 전극(X)으로 공급되는 데이터 펄스와 스캔 전극(Y)으로 공급되는 스캔 펄스에 의해 발생한다.
이러한 어드레스 방전을 발생시키기 위한 종래 구동부에 대해 첨부된 도 1을 참조하여 살펴보면 다음과 같다.
도 1은 종래의 플라즈마 디스플레이 장치의 구동부에 대해 설명하기 위한 도면이다.
도 1을 살펴보면, 종래의 플라즈마 디스플레이 장치의 구동부는 데이터 전압(Vd)을 공급하는 데이터 전압원(미도시)과 기저 전압(GND)을 공급하는 기저 전압원(미도시) 사이에 직렬로 연결된 탑(Top) 스위치(Qt)와 바텀(Bottom) 스위치(Qb)를 포함한다.
이러한 탑(Top) 스위치(Qt)와 바텀(Bottom) 스위치(Qb)의 사이에서 플라즈마 디스플레이 패널의 어드레스 전극(X)과 접속된다.
이러한 종래의 플라즈마 디스플레이 장치의 구동부의 동작을 첨부된 도 2를 결부하여 살펴보면 다음과 같다.
도 2는 종래 플라즈마 디스플레이 장치의 구동부의 동작을 설명하기 위한 도면이다.
도 2를 살펴보면, 어드레스 기간에서 탑 스위치(Qt)가 턴 온(Turn On)되면 데이터 전압원(미도시)으로부터 데이터 전압(Vd)이 전술한 탑 스위치(Qt)를 통해 어드레스 전극(X)으로 공급되고, 이에 따라 어드레스 전극(X)의 전압이 Vd까지 상승하여 유지된다.
이후, 탑 스위치(Qt)가 턴 오프(Turn Off)되고, 바텀 스위치(Qb)가 턴 온 되면, 어드레스 전극(X)의 전압은 기저 전압(GND)이 된다.
이와 같이, 탑 스위치(Qt)와 바텀 스위치(Qb)가 교대로 동작하면서 어드레스 전극(X)에 데이터 전압(Vd)의 데이터 펄스를 공급한다.
여기서, 어드레스 전극(X)에 데이터 전압(Vd)이 공급될 때는 탑 스위치(Qt)에 대부분의 전류가 흐르게 되고, 이에 따라 탑 스위치(Qt)에서 상대적으로 많은 열이 발생하는 문제점이 있다.
아울러, 어드레스 전극(X)에 기저 전압(GND)이 공급될 때는 바텀 스위치(Qb)에 대부분의 전류가 흐르게 되고, 이에 따라 바텀 스위치(Qb)에서도 상대적으로 많은 열이 발생하는 문제점이 있다.
특히, 논리(Logic) 값이 1과 0이 반복되는 격자 패턴(Lattice Pattern) 등의 특정 패턴의 영상이 입력되는 경우에는 탑 스위치(Qt) 또는 바텀 스위치(Qb)의 스위칭(Switching) 횟수가 과도하게 증가하게 되고, 이에 따라 순간적으로 매우 큰 전류가 탑 스위치(Qt) 또는 바텀 스위치(Qb)에 흐르게 된다. 이에 따라 탑 스위치(Qt) 또는 바텀 스위치(Qb)에 과도하게 큰 열이 발생하게 되어 탑 스위치(Qt) 또는 바텀 스위치(Qb)가 오동작을 일으킬 가능성이 높아지게 되고, 심지어는 탑 스위치(Qt) 또는 바텀 스위치(Qb)가 열적 손상을 입어 동작 불능이 되는 문제점이 발생한다.
한편, 종래의 플라즈마 디스플레이 장치에서 사용되는 데이터 펄스는 여기 도 2에서와 같이 그 전압이 급격히 상승하고 하강한다. 이에 따라, 데이터 펄스의 전압 상승하는 시점 및 하강 하는 시점에서 인접하는 다른 어드레스 전극(X)으로 공급되는 데이터 펄스간의 커플링(Coupling) 효과로 인해 노이즈(Noise) 및 전자파(EMI : Electro Magnetic Interference)가 발생하는 문제점이 있다.
상술한 문제점을 해결하기 위해 본 발명은 어드레스 전극(X)을 구동시키기 위한 데이터 구동부를 개선하여 노이즈 및 전자파의 발생을 저감시키며 데이터 구동부에 사용되는 스위칭 소자의 손상을 방지하는 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.
상술한 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 장치는 어드레스 전극이 형성된 플라즈마 디스플레이 패널과, 어드레싱(Addressing)을 위한 어드레 스 기간에서 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 상기 어드레스 전극으로 공급하는 데이터 구동부를 포함하는 것이 바람직하다.
또한, 상기 전압 공유 기간은 두 개 이상의 어드레스 전극의 전압이 실질적으로 균등하게 분배되는 기간인 것을 특징으로 한다.
또한, 상기 전압 공유 기간은 제 1 전압 공유 기간과 제 2 전압 공유 기간을 포함하고, 상기 데이터 펄스는 제 1 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 제 2 전압 공유 기간, 전압 하강 기간을 차례로 포함하는 것을 특징으로 한다.
또한, 상기 데이터 구동부는 데이터 전압을 공급하는 제 1 스위치부와, 상기 제 1 스위치부가 공급하는 데이터 전압을 어드레스 기간에서 어드레스 전극에 공급하는 제 2 스위치부 및 상기 어드레스 전극을 접지(GND)시키는 제 3 스위치부를 포함하는 것을 특징으로 한다.
또한, 상기 제 2 스위치부는 복수개이고, 상기 복수의 제 2 스위치부 중 적어도 두개 이상은 상기 제 1 스위치부가 오프(Off) 되는 기간의 일부에서 함께 온(On) 되는 것을 특징으로 한다.
또한, 상기 제 1 스위치부가 오프(Off) 되는 기간의 일부는 전압 공유 기간인 것을 특징으로 한다.
또한, 하나의 상기 제 1 스위치부당 두개 이상의 제 2 스위치부가 대응되는 것을 특징으로 한다.
또한, 상기 제 2 스위치부는 하나의 어드레스 전극당 하나씩 대응되는 것을 특징으로 한다.
또한, 상기 제 1 스위치부와 제 2 스위치부의 연결지점과 접지(GND) 사이에는 더미 캐패시터부(Capacitor)가 더 구비되는 것을 특징으로 한다.
또한, 상기 제 1 스위치부의 일단은 데이터 전압을 발생시키는 데이터 전압원과 연결되고, 타단은 제 2 스위치부의 일단과 연결되고, 상기 제 2 스위치부의 타단은 제 3 스위치부의 일단과 연결되고, 제 3 스위치부의 타단은 접지(GND)되고, 상기 제 2 스위치부와 제 3 스위치부의 사이에서 상기 어드레스 전극과 연결되는 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.
도 3은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면이다.
도 3을 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(300)과, 데이터 구동부(301)를 포함한다. 아울러, 본 발명의 플라즈마 디스플레이 장치는 스캔 구동부(302)와 서스테인 구동부(303)를 더 포함하는 것이 바람직하다.
여기서, 데이터 구동부(301)는 플라즈마 디스플레이 패널(300)의 어드레스 전극(X)에 데이터 펄스를 공급하여 어드레스 전극(X)을 구동시킨다.
특히, 데이터 구동부(301)는 어드레싱(Addressing)을 위한 어드레스 기간에 서 플라즈마 디스플레이 패널(300)의 어드레스 전극(X)으로 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 공급함으로써 어드레스 전극(X)을 구동시킨다.
여기서, 본 발명의 플라즈마 디스플레이 장치의 주요 특징인 데이터 구동부(301)는 이후의 설명을 통해 보다 명확히 될 것이다.
스캔 구동부(302)는 플라즈마 디스플레이 패널(300)의 스캔 전극(Y)에 리셋 펄스, 스캔 펄스, 서스테인 펄스를 공급하는 방법 등을 통해 스캔 전극(Y)을 구동시킨다.
서스테인 구동부(303)는 플라즈마 디스플레이 패널(300)의 서스테인 전극(Z)에 서스테인 바이어스 전압(Vzb), 서스테인 펄스를 공급하는 방법 등을 통해 서스테인 전극(Z)을 구동시킨다.
플라즈마 디스플레이 패널(300)에는 어드레스 전극(X)이 형성되고, 더욱 바람직하게는 스캔 전극(Y)과 서스테인 전극(Z)이 함께 형성된다.
여기서, 플라즈마 디스플레이 패널(300)의 구조의 일례를 첨부된 도 4a 내지 도 4b를 결부하여 상세히 살펴보면 다음과 같다.
도 4a 내지 도 4b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 장치의 구조의 일례를 설명하기 위한 도면이다.
먼저, 도 4a를 살펴보면 본 발명의 플라즈마 디스플레이 패널은 전극(Electrode), 바람직하게는 스캔 전극(402, Y)과 서스테인 전극(403, Z)이 형성되는 전면 기판(401)을 포함하는 전면 패널(400)과, 전술한 스캔 전극(402, Y) 및 서 스테인 전극(403, Z)과 교차하는 전극, 바람직하게는 어드레스 전극(413, X)이 형성되는 후면 기판(411)을 포함하는 후면 패널(410)이 합착되어 이루어진다.
여기서, 전면 기판(401) 상에 형성되는 전극, 바람직하게는 스캔 전극(402, Y)과 서스테인 전극(403, Z)은 방전 공간, 즉 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지한다.
이러한 스캔 전극(402, Y)과 서스테인 전극(403, Z)이 형성된 전면 기판(401)의 상부에는 스캔 전극(402, Y)과 서스테인 전극(403, Z)을 덮도록 유전체 층, 바람직하게는 상부 유전체 층(404)이 형성된다.
이러한, 상부 유전체 층(404)은 스캔 전극(402, Y) 및 서스테인 전극(403, Z)의 방전 전류를 제한하며 스캔 전극(402, Y)과 서스테인 전극(403, Z) 간을 절연시킨다.
이러한, 상부 유전체 층(404) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(405)이 형성된다. 이러한 보호 층(405)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(404) 상부에 증착하는 방법 등을 통해 형성된다.
한편, 후면 기판(411) 상에 형성되는 전극, 바람직하게는 어드레스 전극(413, X)은 방전 셀에 데이터(Data) 펄스를 공급하기 위한 전극이다.
이러한 어드레스 전극(413, X)이 형성된 후면 기판(411)의 상부에는 어드레스 전극(413, X)을 덮도록 유전체 층, 바람직하게는 하부 유전체 층(415)이 형성된다.
이러한, 하부 유전체 층(415)은 어드레스 전극(413, X)을 절연시킨다.
이러한 하부 유전체 층(415)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type) 또는 웰 타입(Well Type) 등의 격벽(412)이 형성된다. 이에 따라, 전면 기판(401)과 후면 기판(411)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 등의 방전 셀이 형성된다.
여기서, 격벽(412)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워진다.
아울러, 격벽(412)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(414)이 형성된다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.
이상에서 설명한 본 발명의 플라즈마 디스플레이 패널에서는 스캔 전극(402, Y), 서스테인 전극(403, Z) 또는 어드레스 전극(413, X) 중 적어도 하나 이상의 전극으로 도 3의 데이터 구동부(301), 스캔 구동부(302), 서스테인 구동부(303) 중 적어도 하나 이상에 의해 구동 전압이 공급되면, 격벽(412)에 의해 구획된 방전 셀 내에서 방전이 발생한다.
그러면, 방전 셀 내에 채워진 방전 가스에서 진공 자외선이 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체 층(414)에 가해진다. 그러면, 형광체 층(414)에서 소정의 가시광선이 발생되고, 이렇게 발생된 가시광선이 상부 유전체 층(404)이 형성된 전면 기판(401)을 통해 외부로 방출되고, 이에 따라 전면 기판(401)의 외부 면에 소정의 영상이 표시된다.
한편, 여기 도 4a의 설명에서는 스캔 전극(402, Y) 및 서스테인 전극(403, Z)이 각각 하나의 층(Layer)으로 이루어지는 경우만을 도시하고 설명하였지만, 이와는 다르게 스캔 전극(402, Y) 또는 서스테인 전극(403, Z) 중 하나 이상이 복수의 층으로 이루어지는 것도 가능하다. 이에 대해 도 4b를 참조하여 살펴보면 다음과 같다.
도 4b를 살펴보면, 스캔 전극(402, Y)과 서스테인 전극(403, Z)은 각각 두 개의 층(Layer)으로 이루어질 수 있다.
특히, 광 투과율 및 전기 전도도를 고려하면 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율을 확보하는 차원에서 스캔 전극(402, Y)과 서스테인 전극(403, Z)은 불투명한 은(Ag) 재질의 버스 전극(402b, 403b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO) 재질의 투명 전극(402a, 403a)을 포함하는 것이 바람직하다.
이와 같이, 스캔 전극(402, Y)과 서스테인 전극(403, Z)이 투명 전극(402a, 403a)을 포함하도록 하는 이유는, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패널의 외부로 방출될 때 효과적으로 방출되도록 하기 위해서이다.
아울러, 스캔 전극(402, Y)과 서스테인 전극(403, Z)이 버스 전극(402b, 403b)을 포함하도록 하는 이유는, 스캔 전극(402, Y)과 서스테인 전극(403, Z)이 투명 전극(402a, 403a)만을 포함하는 경우에는 투명 전극(402a, 403a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있어서, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(402a, 403a)의 낮은 전기 전도도를 보상하기 위해서이다.
이상의 도 4a 내지 도 4b에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 4a 내지 도 4b와 같은 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 4a 내지 도 4b의 플라즈마 디스플레이 패널에는 상부 유전체 층(404) 및 하부 유전체 층(415)이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 상부 유전체 층(404) 및 하부 유전체 층(415) 중 적어도 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.
이상의 내용을 고려할 때, 본 발명의 플라즈마 디스플레이 장치에 적용될 수 있는 플라즈마 디스플레이 패널은 어드레스 전극(X, 413)이 형성된 것이고, 그 이외의 조건은 무방한 것이다.
이러한 플라즈마 디스플레이 패널을 포함하는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례에 대해 첨부된 도 5 내지 도 6을 결부하여 살펴보면 다음과 같다.
도 5는 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면이다.
또한, 도 6은 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 상세히 설명하기 위한 도면이다.
먼저, 도 5를 살펴보면 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 프레임은 발광횟수가 다른 여러 서브필드로 나누어진다. 또한, 도시하지는 않았지만 각 서브필드는 다시 모든 방전 셀을 초기화시 키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어진다.
예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 예컨대, 도 5와 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
여기서, 각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일하다.
한편, 서스테인 기간에 공급되는 서스테인 펄스의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 펄스의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.
이러한 본 발명의 플라즈마 디스플레이 장치는 1초의 영상을 표시하기 위해 복수의 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 프레임 을 사용하는 것이다.
여기 도 5에서는 하나의 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 프레임을 구성할 수도 있는 것이다.
이러한, 프레임으로 영상의 계조를 구현하는 플라즈마 디스플레이 장치가 구현하는 영상의 화질은 프레임에 포함되는 서브필드의 개수에 따라 결정될 수 있다. 즉, 프레임에 포함되는 서브필드가 12개인 경우는 212 가지의 영상의 계조를 표현할 수 있고, 프레임에 포함되는 서브필드가 8개인 경우는 28 가지의 영상의 계조를 구현할 수 있게 되는 것이다.
또한, 여기 도 5에서는 하나의 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.
다음, 도 6을 살펴보면 도 5와 같은 프레임에 포함된 복수의 서브필드 어느 하나의 서브필드(Subfield)에서의 본 발명의 플라즈마 디스플레이 장치의 동작의 일례가 나타나 있다.
도 6을 살펴보면, 도 3의 본 발명의 플라즈마 디스플레이 장치에서 스캔 구 동부(302)는 리셋 기간의 셋업 기간에서 스캔 전극(Y)에 전압이 점진적으로 상승하는 상승 램프(Ramp-Up) 파형을 공급할 수 있다.
이러한, 상승 램프 파형에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓이게 된다.
또한, 셋업 기간 이후의 셋다운 기간에서는 스캔 전극(Y)에 상승 램프 파형을 공급한 후, 상승 램프 파형의 피크전압보다 낮은 소정의 정극성 전압에서부터 전압이 점진적으로 하강하는 하강 램프(Ramp-Down) 파형을 공급할 수 있다.
이에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 이전의 셋업 방전에 의해 방전 셀 내에 쌓여있던 벽 전하의 일부가 소거되어 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.
이러한, 셋업 기간과 셋다운 기간을 포함하는 리셋 기간 이후의 어드레스 기간에서는 스캔 기준 전압(Vsc) 및 이러한 스캔 기준 전압(Vsc)으로부터 하강하는 부극성 스캔 펄스(Scan)의 전압(-Vy)을 스캔 전극(Y)에 공급할 수 있다.
아울러, 스캔 구동부(302)가 부극성 스캔 펄스의 전압(-Vy)을 스캔 전극(Y)으로 공급할 때, 이에 대응되게 데이터 구동부(301)는 어드레스 전극(X)에 데이터 펄스를 공급한다.
이러한 데이터 펄스는 여기 도 6과 같이 전압 공유 기간(d1, d4), 전압 상승 기간(d2), 전압 유지 기간(d3), 전압 하강 기간(d5)을 포함한다.
여기서, 전압 공유 기간(d1, d4)은 두 개 이상의 어드레스 전극(X)의 전압이 실질적으로 균등하게 분배되는 기간으로서, 제 1 전압 공유 기간(d1)과 제 2 전압 공유 기간(d4)을 포함하는 것이 바람직하다.
제 1 전압 공유 기간은 데이터 펄스의 전압이 상승하는 동안 두 개 이상의 어드레스 전극(X)의 전압을 분배하는 기간이고, 제 2 전압 공유 기간은 데이터 펄스의 전압이 하강하는 동안 두 개 이상의 어드레스 전극(X)의 전압을 분배하는 기간이다.
이에 따라, 데이터 펄스는 제 1 전압 공유 기간(d1), 전압 상승 기간(d2), 전압 유지 기간(d3), 제 2 전압 공유 기간(d4), 전압 하강 기간(d5)을 차례로 포함한다.
아울러, 서스테인 구동부(303)는 어드레스 기간에서 서스테인 전극(Z)의 간섭으로 인한 오방전의 발생을 방지하기 위해 어드레스 기간에서 서스테인 전극(Z)에 서스테인 바이어스 전압(Vzb)을 공급한다.
이러한, 어드레스 기간에서는 부극성 스캔 펄스의 전압(-Vy)과 데이터 펄스의 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 펄스의 전압(Vd)이 인가되는 방전 셀 내에는 어드레스 방전이 발생된다.
이러한, 어드레스 방전에 의해 선택된 방전 셀 내에는 서스테인 펄스의 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽 전하가 형성된다.
이러한, 어드레스 기간 이후의 서스테인 기간에서 스캔 구동부(302)와 서스테인 구동부(303)는 스캔 전극(Y) 또는 서스테인 전극(Z)에 서스테인 펄스(SUS)를 공급한다.
이에 따라 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 펄스(SUS)의 서스테인 전압(Vs)이 더해지면서 매 서스테인 펄스(SUS)가 공급될 때 마다 스캔 전극(Y)과 서스테인 전극(Z) 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다. 이에 따라, 플라즈마 디스플레이 패널 상에 소정의 영상이 구현되는 것이다.
여기서, 전술한 어드레스 기간에서 어드레스 전극(X)에 데이터 펄스를 공급하는 데이터 구동부에 대해 보다 상세히 살펴보면 다음과 같다.
도 7은 본 발명의 플라즈마 디스플레이 장치의 데이터 구동부의 구성을 보다 상세히 설명하기 위한 도면이다.
도 7을 살펴보면, 본 발명에 따라 어드레싱(Addressing)을 위한 어드레스 기간에서 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 어드레스 전극(X)으로 공급하는 데이터 구동부는 제 1 스위치부(710), 제 2 스위치부(720, 721, 722, 723), 제 3 스위치부(730, 731, 732, 733)를 포함한다.
여기서, 제 1 스위치부(710)는 S10 스위치를 포함하고, 이러한 S10 스위치를 이용하여 데이터 전압원이 발생하는 데이터 전압(Vd)을 공급한다.
제 2 스위치부(720, 721, 722, 723)는 각각 S20, S21, S22, S23 스위치를 포 함하고, 이러한 S20, S21, S22, S23 스위치를 이용하여 제 1 스위치부(710)가 공급하는 데이터 전압(Vd)을 어드레스 기간에서 어드레스 전극(X)에 공급한다.
이러한 제 2 스위치부(720, 721, 722, 723)는 하나의 제 1 스위치부(710)당 두개 이상이 대응되는 것이 바람직하다. 예를 들면, 여기 도 7에서와 같이 하나의 제 1 스위치부(710)에 4 개의 제 2 스위치부(720, 721, 722, 723)가 대응되는 것이다.
그리고 제 2 스위치부(720, 721, 722, 723)는 하나의 어드레스 전극당 하나씩 대응된다. 예를 들면, 여기 도 7에서와 같이 부호 720의 제 2 스위치부는 Xa 어드레스 전극과 대응되고, 부호 721의 제 2 스위치부는 Xb 어드레스 전극과 대응되고, 부호 722의 제 2 스위치부는 Xc 어드레스 전극과 대응되고, 부호 723의 제 2 스위치부는 Xd 어드레스 전극과 대응된다.
제 3 스위치부(730, 731, 732, 733)는 각각 S30, S31, S32, S33 스위치를 포함하고, 이러한 S30, S31, S32, S33 스위치를 이용하여 어드레스 전극(X)을 접지(GND)시킨다.
여기서, 제 1 스위치부(710)의 일단은 데이터 전압(Vd)을 발생시키는 데이터 전압원과 연결되고, 타단은 제 2 스위치부(720, 721, 722, 723)의 일단과 제 20 노드(n20)에서 공통 연결된다.
제 2 스위치부(720, 721, 722, 723)의 타단은 각각 대응되는 제 3 스위치부(730, 731, 732, 733)의 일단과 제 10, 11, 12, 13 노드(n10, n11, n12, 13) 연결된다.
그리고 제 3 스위치부(730, 731, 732, 733)의 타단은 접지(GND)되며, 아울러 제 2 스위치부(720, 721, 722, 723)와 제 3 스위치부(730, 731, 732, 733)의 사이에서 각각 어드레스 전극(Xa, Xb, Xc, Xd)과 연결된다.
이러한, 제 2 스위치부(720, 721, 722, 723) 중 적어도 두개 이상은 제 1 스위치부(710)가 오프(Off) 되는 기간의 일부에서 함께 온(On) 된다.
여기서, 제 1 스위치부(710)가 오프(Off) 되는 기간의 일부는 앞선 도 6에서의 d1 또는 d4의 전압 공유 기간이다.
이와 같이, 제 1 스위치부(710)가 오프(Off) 되는 기간의 일부, 즉 전압 공유 기간에서 제 2 스위치부(720, 721, 722, 723) 중 적어도 두개 이상이 함께 온(On) 되도록 하는 이유는 두 개 이상의 어드레스 전극(X)의 전압이 실질적으로 균등하게 분배되도록 하기 위해서이다.
이상에서 설명한 본 발명에 따른 데이터 구동부가 앞선 도 6에서와 같은 데이터 펄스를 발생시키는 방법에 대해 살펴보면 다음과 같다.
도 8은 본 발명에 따른 데이터 구동부가 데이터 펄스를 발생시키는 방법에 대해 설명하기 위한 도면이다.
도 8을 살펴보면, 먼저 d1기간에서 제 1 스위치부(710)의 S10 스위치, 부호 720의 제 2 스위치부의 S20 스위치, 부호 731의 제 3 스위치부의 S31 스위치가 온 되고, 부호 730의 제 3 스위치부의 S30 스위치와 부호 721의 제 2 스위치부의 S21 스위치는 오프 된다.
그러면, 데이터 전압원이 발생시키는 데이터 전압(Vd)이 S10 스위치, S20 스 위치를 경유하여 Xa 어드레스 전극으로 공급된다. 이에 따라 Xa 어드레스 전극이 데이터 전압(Vd)을 유지한다.
반면에, Xb 어드레스 전극은 S31 스위치가 온 됨에 따라 접지(GND)된다. 이에 따라 Xb 어드레스 전극은 실질적으로 그라운드 레벨의 전압을 유지한다.
이러한, d1기간은 Xa 어드레스 전극 입장에서는 전압 유지 기간이다.
다음, d2기간에서 제 1 스위치부(710)의 S10 스위치와 부호 731의 제 3 스위치부의 S31 스위치는 오프 되고, 부호 720의 제 2 스위치부의 S20 스위치는 온 상태를 유지하며 아울러, 부호 730의 제 3 스위치부의 S30 스위치는 오프 상태를 유지하고, 부호 721의 제 2 스위치부의 S21 스위치는 온 된다.
그러면, Xa 어드레스 전극과 Xb 어드레스 전극이 전기적으로 서로 연결된 상태가 된다. 이에 따라, Xa 어드레스 전극과 Xb 어드레스 전극이 전압을 서로 공유(Sharing) 함으로써, d1기간에서 상대적으로 높은 전압을 가졌던 Xa 어드레스 전극의 전압이 Xb 어드레스 전극으로 일정 부분 분배된다.
이에 따라, Xa 어드레스 전극의 전압은 소정의 기울기를 갖는 상태에서 실질적으로 데이터 전압(Vd)에서부터 제 1 전압(V1)까지 점진적으로 하강하고, 반면에 Xb 어드레스 전극의 전압은 실질적으로 그라운드 레벨의 전압으로부터 제 3 전압(V3)까지 점진적으로 상승한다.
이러한 d2기간은 Xa 어드레스 전극과 Xb 어드레스 전극의 전압 공유 기간이다.
다음, d3기간에서 제 1 스위치부(710)의 S10 스위치와 부호 730의 제 3 스위 치부의 S30 스위치는 온 되고, 부호 720의 제 2 스위치부의 S20 스위치는 오프 되며 아울러, 부호 731의 제 3 스위치부의 S31 스위치는 오프 상태를 유지하고, 부호 721의 제 2 스위치부의 S21 스위치는 온 상태를 유지한다.
그러면, 데이터 전압원이 발생시키는 데이터 전압(Vd)이 S10 스위치, S21 스위치를 경유하여 Xb 어드레스 전극으로 공급된다. 이에 따라 Xb 어드레스 전극의 전압이 제 3 전압(V3)으로부터 데이터 전압(Vd)까지 상승한다.
반면에, Xa 어드레스 전극은 S30 스위치가 온 됨에 따라 접지(GND)된다. 이에 따라 Xa 어드레스 전극의 전압은 제 1 전압(V1)으로부터 실질적으로 그라운드 레벨의 전압까지 하강한다.
이러한, d3기간은 Xa 어드레스 전극의 입장에서 보면 전압 하강 기간이고, Xb 어드레스 전극의 입장에서 보면 전압 상승 기간이다.
다음, d4기간에서는 앞선 d3기간과 동일한 상태를 유지한다.
이에 따라 Xa 어드레스 전극은 실질적으로 그라운드 레벨의 전압을 유지하고, Xb 어드레스 전극은 실질적으로 데이터 전압(Vd)을 유지한다.
이러한, d4기간은 Xb 어드레스 전극의 입장에서 보면 전압 유지 기간이다.
다음, d5기간에서 제 1 스위치부(710)의 S10 스위치와 부호 730의 제 3 스위치부의 S30 스위치는 오프 되고, 부호 720의 제 2 스위치부의 S20 스위치는 온 되고, 아울러, 부호 731의 제 3 스위치부의 S31 스위치는 오프 상태를 유지하고, 부호 721의 제 2 스위치부의 S21 스위치는 온 상태를 유지한다.
그러면, Xa 어드레스 전극과 Xb 어드레스 전극이 전기적으로 서로 연결된 상 태가 된다. 이에 따라, Xa 어드레스 전극과 Xb 어드레스 전극이 전압을 서로 공유(Sharing) 함으로써, d4기간에서 상대적으로 높은 전압을 가졌던 Xb 어드레스 전극의 전압이 Xa 어드레스 전극으로 일정 부분 분배된다.
이에 따라, Xb 어드레스 전극의 전압은 소정의 기울기를 갖는 상태에서 실질적으로 데이터 전압(Vd)에서부터 제 4 전압(V4)까지 점진적으로 하강하고, 반면에 Xa 어드레스 전극의 전압은 실질적으로 그라운드 레벨의 전압으로부터 제 2 전압(V2)까지 점진적으로 상승한다.
이러한 d5기간은 Xa 어드레스 전극과 Xb 어드레스 전극의 전압 공유 기간이다.
다음, d6기간에서 제 1 스위치부(710)의 S10 스위치와 부호 731의 제 3 스위치부의 S31 스위치는 온 되고, 부호 720의 제 2 스위치부의 S20 스위치는 온 상태를 유지하며 아울러, 부호 730의 제 3 스위치부의 S30 스위치는 오프 상태를 유지하고, 부호 721의 제 2 스위치부의 S21 스위치는 오프 된다.
그러면, 데이터 전압원이 발생시키는 데이터 전압(Vd)이 S10 스위치, S20 스위치를 경유하여 Xa 어드레스 전극으로 공급된다. 이에 따라 Xa 어드레스 전극의 전압이 제 2 전압(V2)으로부터 데이터 전압(Vd)까지 상승한다.
반면에, Xb 어드레스 전극은 S31 스위치가 온 됨에 따라 접지(GND)된다. 이에 따라 Xb 어드레스 전극의 전압은 제 4 전압(V4)으로부터 실질적으로 그라운드 레벨의 전압까지 하강한다.
이러한, d6기간은 Xa 어드레스 전극의 입장에서 보면 전압 상승 기간이고, Xb 어드레스 전극의 입장에서 보면 전압 하강 기간이다.
다음, d7기간에서는 앞선 d6기간과 동일한 상태를 유지한다.
이에 따라 Xb 어드레스 전극은 실질적으로 그라운드 레벨의 전압을 유지하고, Xa 어드레스 전극은 실질적으로 데이터 전압(Vd)을 유지한다.
이와 같은 방법을 통해 본 발명에 따른 데이터 구동부는 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 발생시킬 수 있다.
이러한 본 발명에 따른 데이터 구동부가 발생시키는 데이터 펄스는 전압을 공유하는 전압 공유 기간으로 인해 전압이 상승하거나 하강하는 기간 동안 시간당 전압 변화율이 종래의 도 2와 같은 경우에 비해 저감된다.
따라서 본 발명의 플라즈마 디스플레이 장치에서는 서로 인접하는 어드레스 전극(X)으로 공급되는 데이터 펄스간의 커플링(Coupling) 효과가 감소되고, 이에 따라 데이터 펄스의 전압이 상승하거나 하강하는 동안 노이즈(Noise) 및 전자파 장애(EMI : Electro Magnetic Interference)의 발생이 저감된다.
아울러, 어드레스 전극(X)에 데이터 전압(Vd)이 공급될 때 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)가 함께 동작함으로써, 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)에 전체 전류가 분산되어 흐른다. 즉, 어드레스 전극(X)에 데이터 펄스가 공급되는 경우에 특정한 스위칭 소자에 전류가 집중되지 않고 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)에 전체 전류가 분산되어 흐른다.
이에 따라 스위칭(Switching) 동작에 의해 발생하는 열도 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)에 분산됨으로써, 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)가 열적 손상을 입는 것이 방지된다.
심지어는, 논리(Logic) 값이 1과 0이 반복되는 격자 패턴(Lattice Pattern) 등의 특정 패턴의 영상이 입력되는 경우에도 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)에 열이 고르게 분산되기 때문에 스위칭 소자의 열적 손상이 방지된다.
아울러, 어드레스 전극(X)의 전압을 공유함으로써, 어드레스 전극(X)으로 공급된 데이터 펄스의 전압을 재사용하게 된다. 이에 따라 전력 효율이 증가한다.
다음, 도 9a 내지 도 9b는 본 발명에 따른 데이터 구동부의 동작의 또 다른 일례를 설명하기 위한 도면이다.
먼저, 도 9a를 살펴보면 d1기간에서 S10, S20, S21, S32, S33 스위치가 온 된다. 그리고 나머지 스위치들은 오프 상태이다.
여기, 도 9a에서 Xa 어드레스 전극과 Xc 어드레스 전극에 인가되는 데이터 펄스에 대해서는 앞선 도 8에서 이미 상세히 설명하였으므로 그 설명은 생략하고, Xb 어드레스 전극 및 Xd 어드레스 전극에 해당되는 내용만 설명하기로 한다. 아울러, 중복되는 다른 설명도 생략하기로 한다.
이러한 d1기간에서는 Xb 어드레스 전극은 데이터 전압(Vd)을 유지하고, Xd 어드레스 전극은 실질적으로 그라운드 레벨의 전압을 유지한다.
다음, d2기간에서는 S20, S21, S22, S23 스위치가 온 된다. 이에 따라 Xa, Xb, Xc, Xd 어드레스 전극이 전기적으로 서로 연결된 상태가 됨으로써, Xa, Xb, Xc, Xd 어드레스 전극의 전압이 실질적으로 균일하게 분배된다.
이에 따라, Xb 어드레스 전극의 전압은 데이터 전압(Vd)으로부터 제 3 전압(V3)까지 점진적으로 하강한다. 그리고 Xd 어드레스 전극의 전압은 그라운드 레벨의 전압으로부터 제 7 전압(V7)까지 점진적으로 상승한다.
다음, d3기간에서는 S10, S30, S21, S22, S33 스위치가 온 된다.
그러면, Xb 어드레스 전극의 전압은 d2기간에서 제 3 전압(V3)까지 하강하였다가 다시 제 3 전압(V3)으로부터 데이터 전압(Vd)까지 상승한다.
Xd 어드레스 전극의 전압은 d2기간에서 제 7 전압(V7)까지 상승하였다가 다시 제 7 전압(V7)으로부터 다시 그라운드 레벨의 전압까지 하강한다.
이러한 Xb 어드레스 전극의 파형은 Xb 어드레스 전극에 데이터 펄스가 계속해서 인가되는 경우이고, Xd 어드레스 전극의 파형은 Xb 어드레스 전극에 데이터 펄스가 전혀 공급되지 않는 경우이다. 이후 d4, d5, d6, d7 기간에 대해서는 앞선 도 8의 설명을 통해 유추될 수 있으므로 그 설명을 생략하기로 한다.
다음, 도 9b를 살펴보면 앞선 도 9a와는 다르게 d2기간에서 S23 스위치가 오프 되어 있다.
그러면, 데이터 펄스가 공급되지 않는 Xd 어드레스 전극의 전압이 실질적으로 그라운드 레벨의 전압을 계속 유지한다.
이러한 도 9a와 도 9b를 비교하면, 도 9b의 경우는 도 9a의 경우에 비해 데이터 펄스가 공급되지 않는 Xd 어드레스 전극의 전압을 그라운드 레벨의 전압으로 유지하게 됨으로써 전력 소모가 더 적다는 장점이 있을 수 있다.
반면에, 도 9a의 경우는 도 9b의 경우에 비해 스위칭 동작의 제어가 더 용이하다는 장점이 있다.
본 발명에 따른 데이터 구동부는 상황에 따라 앞선 도 9a 또는 도 9b의 방법을 선택적으로 사용할 수 있다.
다음, 도 10은 본 발명에 따른 데이터 구동부의 또 다른 구성에 대해 설명하기 위한 도면이다.
도 10을 살펴보면, 본 발명에 따른 데이터 구동부는 더미(Dummy) 캐패시터부(1000 : Cdummy)를 더 구비하는 것이 바람직하다.
이러한 더미 캐패시터부(1000)는 제 1 스위치부(710)와 제 2 스위치부(720, 721, 722, 723)의 연결지점, 즉 제 20 노드(n20)와 접지(GND) 사이에 배치된다.
이러한 더미 캐패시터부(1000)는 데이터 펄스에 발생하는 피킹(Peaking) 노이즈 성분을 제거하여 본 발명의 플라즈마 디스플레이 장치의 동작을 안정시킨다.
아울러, 이러한 더미 캐패시터부(1000)는 전압 공유 기간에서 공유 되는 어드레스 전극(X)의 전압의 일부를 저장함으로써, 공유 기간의 길이 또는 공유 기간에서의 데이터 펄스의 전압 변동 폭 등을 다양하게 조절한 수 있다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적 인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서 상세히 설명한 바와 같이 본 발명의 플라즈마 디스플레이 장치는 어드레스 기간에서 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 사용함으로써, 노이즈 및 전자파 장애(EMI)의 발생을 저감시키는 효과가 있다.

Claims (10)

  1. 어드레스 전극이 형성된 플라즈마 디스플레이 패널과,
    어드레싱(Addressing)을 위한 어드레스 기간에서 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 전압 하강 기간을 포함하는 데이터 펄스를 상기 어드레스 전극으로 공급하는 데이터 구동부를 포함하며,
    상기 데이터 구동부는
    데이터 전압을 공급하는 제 1 스위치부;
    상기 제 1 스위치부가 공급하는 데이터 전압을 어드레스 기간에서 어드레스 전극에 공급하는 제 2 스위치부; 및
    상기 어드레스 전극을 접지(GND)시키는 제 3 스위치부를 포함하고,
    상기 제 1 스위치부와 제 2 스위치부의 연결지점과 접지(GND) 사이에는 더미 캐패시터부(Capacitor)가 더 구비되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 제 1 항에 있어서,
    상기 전압 공유 기간은 두 개 이상의 어드레스 전극의 전압이 실질적으로 균등하게 분배되는 기간인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제 1 항에 있어서,
    상기 전압 공유 기간은 제 1 전압 공유 기간과 제 2 전압 공유 기간을 포함하고,
    상기 데이터 펄스는 제 1 전압 공유 기간, 전압 상승 기간, 전압 유지 기간, 제 2 전압 공유 기간, 전압 하강 기간을 차례로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 삭제
  5. 제 1 항에 있어서,
    상기 제 2 스위치부는 복수개이고, 상기 복수의 제 2 스위치부 중 적어도 두개 이상은 상기 제 1 스위치부가 오프(Off) 되는 기간의 일부에서 함께 온(On) 되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  6. 제 1 항에 있어서,
    상기 제 1 스위치부가 오프(Off) 되는 기간의 일부는 전압 공유 기간인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  7. 제 1 항에 있어서,
    하나의 상기 제 1 스위치부당 두개 이상의 제 2 스위치부가 대응되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  8. 제 1 항에 있어서,
    상기 제 2 스위치부는 하나의 어드레스 전극당 하나씩 대응되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  9. 삭제
  10. 제 1 항에 있어서,
    상기 제 1 스위치부의 일단은 데이터 전압을 발생시키는 데이터 전압원과 연결되고, 타단은 제 2 스위치부의 일단과 연결되고,
    상기 제 2 스위치부의 타단은 제 3 스위치부의 일단과 연결되고,
    제 3 스위치부의 타단은 접지(GND)되고,
    상기 제 2 스위치부와 제 3 스위치부의 사이에서 상기 어드레스 전극과 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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