KR100673187B1 - Method of manufacturing a capacitor - Google Patents
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Abstract
본 발명은 커패시터 제조 방법에 관한 것으로, 루테늄을 이용하여 하부 전극을 형성한 후 하부 전극의 표면을 플라즈마 처리하여 유효 산화막 두께를 낮추고, Ta2O5 유전체막을 2회에 걸쳐 증착하되 제 1 Ta2O5막 증착 후 플라즈마 처리하여 상기 제 1 Ta2O5막 내의 탄소를 제거하고 산소 결핍을 억제하므로써 커패시터의 전기적 특성을 향상시킬 수 있는 커패시터 제조 방법이 개시된다.
The present invention relates to a capacitor manufacturing method, after forming the lower electrode by using a ruthenium and plasma treating the surface of the lower electrode reduces the effective oxide thickness, Ta 2 O 5 dielectric film but deposited twice claim 1 Ta 2 Disclosed is a capacitor manufacturing method capable of improving the electrical characteristics of a capacitor by removing carbon in the first Ta 2 O 5 film by suppressing oxygen deficiency by plasma treatment after O 5 film deposition.
커패시터, Ru 하부 전극, Ta2O5 유전체막Capacitor, Ru Bottom Electrode, Ta2O5 Dielectric Film
Description
도 1a 내지 도 1e는 본 발명에 따른 커패시터 제조 방법을 설명하기 위하여 순차적으로 도시한 단면도.1A to 1E are cross-sectional views sequentially illustrating the method of manufacturing a capacitor according to the present invention.
도 2는 본 발명의 커패시터 제조 방법에 따라 제조된 커패시터와 종래 커패시터의 누설 전류 특성을 비교한 그래프.Figure 2 is a graph comparing the leakage current characteristics of a capacitor manufactured according to the capacitor manufacturing method of the present invention and a conventional capacitor.
도 3은 본 발명의 커패시터 제조 방법에 따라 제조된 커패시터와 종래 커패시터의 I-V 특성을 비교한 그래프.
Figure 3 is a graph comparing the IV characteristics of the capacitor and the capacitor manufactured according to the capacitor manufacturing method of the present invention.
<도면의 주요 부분에 대한 부호 설명><Description of the symbols for the main parts of the drawings>
10 : 반도체 기판 20 : Ru 하부 전극10
30a : 제 1 Ta2O5막 30b : 제 2 Ta2O5막30a: first Ta 2 O 5 film 30b: second Ta 2 O 5 film
30 : Ta2O5 유전체막 40 : TiN 상부 전극30 Ta 2 O 5
A : 종래의 누설전류 특성곡선 B : 본발명에 따른 누설전류 특성곡선A: Conventional Leakage Current Characteristic Curve B: Leakage Current Characteristic Curve According to the Present Invention
C : 종래의 I-V 특성곡선 D : 본발명에 따른 I-V 특성곡선
C: Conventional IV Characteristic Curve D: IV Characteristic Curve According to the Present Invention
본 발명은 커패시터 제조 방법에 관한 것으로, 특히 MIM(Metal-Insulator-Metal) 구조의 Ta2O5 커패시터 제조시 하부 전극을 Ru로 사용하는 경우, Ru 하부 전극 표면 처리와 2단계 Ta2O5 증착을 통해 Ta2O5 커패시터의 전기적 특성을 향상시킬 수 있는 커패시터 제조 방법에 관한 것이다.
BACKGROUND OF THE
최근에는 소자가 점점 고집적화 됨에 따라 커패시터의 사이즈는 줄어드는 반면 안정된 소자동작을 위해서는 셀의 커패시턴스(Capacitance)는 그대로 유지해야 하는 어려움이 있다. In recent years, as the device becomes more and more integrated, the size of the capacitor decreases, but there is a difficulty in maintaining the capacitance of the cell for stable device operation.
일반적으로 커패시터는 다결정 실리콘 콘택 플러그, 확산 방지막, 하부 전극, 유전체막 그리고 상부 전극으로 구성된다. 커패시턴스에 영향을 미치는 요인 중 중요한 것은 하부 전극의 유효 산화막 두께(Tox)를 낮추는 것과 유전체막의 유전 특성을 향상시키는 것이다. Generally, a capacitor is composed of a polycrystalline silicon contact plug, a diffusion barrier, a lower electrode, a dielectric film, and an upper electrode. Important factors affecting the capacitance are to lower the effective oxide thickness (Tox) of the lower electrode and to improve the dielectric properties of the dielectric film.
종래에는 Ta2O5 커패시터의 하부 전극을 RTN 표면 처리된 폴리실리콘으로 사용해 왔다. 그러나 유효산화막의 두께인 30Å 정도의 폴리실리콘을 하부 전극으로 이용하는 Ta2O5 커패시터 구조는 유효 산화막 두께로 인한 Ta2O5 유전체막의 유전 특성 저하로 한계에 도달하게 된다.
Conventionally, the bottom electrode of a Ta 2 O 5 capacitor has been used as RTN surface treated polysilicon. However, the Ta 2 O 5 capacitor structure using polysilicon having a thickness of about 30 kHz as the lower electrode reaches a limit due to a decrease in the dielectric properties of the Ta 2 O 5 dielectric film due to the effective oxide thickness.
따라서, 본 발명은 루테늄(Ru)을 이용하여 하부 전극을 형성한 후 표면을 플라즈마 처리하고 Ta2O5 유전체막을 2 단계에 걸쳐 증착하되 중간에 열처리로 여기 과정을 실시하여 Ta2O5 유전체막 내의 탄소를 제거하고 산소 결핍을 방지하므로써 유효 산화막 두께를 낮추고 유전 특성을 향상시켜 커패시터의 전기적 특성을 향상시킬 수 있는 커패시터 제조 방법을 제공하는데 그 목적이 있다.
Therefore, in the present invention, after the lower electrode is formed using ruthenium (Ru), the surface is plasma treated and a Ta 2 O 5 dielectric film is deposited in two steps, but the Ta 2 O 5 dielectric film is subjected to an excitation process by heat treatment in the middle. An object of the present invention is to provide a capacitor manufacturing method capable of improving the electrical characteristics of a capacitor by removing the carbon therein and preventing oxygen deficiency, thereby lowering the effective oxide thickness and improving dielectric properties.
이러한 목적을 달성하기 위한 본 발명에 따른 커패시터 제조 방법은 반도체 소자를 형성하기 위한 여러 가지 요소가 형성된 반도체 기판 상에 루테늄 하부 전극을 형성하는 단계; 상기 루테늄 하부 전극을 표면 처리하는 단계; 상기 루테늄 하부 전극 상에 제 1 Ta2O5막을 증착하는 단계; 상기 제 1 Ta2O5막을 표면 처리하는 단계; 상기 제 1 Ta2O5막 상에 제 2 Ta2O5막을 형성하여 Ta
2O5 유전체막을 형성하는 단계; 상기 Ta2O5 유전체막을 열처리하는 단계; 및 상기 Ta2O5 유전체막 상에 상부 전극을 형성하는 단계를 포함하여 이루어지는 것을 특징으로 한다.
According to an aspect of the present invention, there is provided a capacitor manufacturing method including: forming a ruthenium lower electrode on a semiconductor substrate on which various elements for forming a semiconductor device are formed; Surface treating the ruthenium lower electrode; Depositing a first Ta 2 O 5 film on the ruthenium bottom electrode; Surface treating the first Ta 2 O 5 film; Forming on the first 1 Ta 2 O 5 film of
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 상세히 설명하기로 한다. Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.
도 1a를 참조하면, 반도체 소자를 형성하기 위한 여러 요소가 형성된 반도체 기판(10) 상에 100 내지 500Å의 두께로 루테늄(Ru)층을 형성하고 패터닝하여 Ru 하부 전극(20)을 형성한다. Ru 하부 전극(20)은 200 내지 400℃의 온도 범위, 500 내지 1000Watt의 직류 전력(D.C Power) 및 0.2 내지 1 Torr의 압력에서 100 내지 1000sccm의 아르곤 가스를 운송 가스로 이용하여 물리적 기상증착법(PVD)으로 증착한다. 이후, Ru 하부 전극(20)을 표면 처리한다. 표면 처리는 0.1 내지 2Torr의 압력 및 300 내지 400℃의 온도범위에서 10 내지 500Watt의 R.F 전력으로 10 내지 500sccm의 N2+O2 플라즈마, O2 플라즈마, N2O 플라즈마, O3 플라즈마 및 UV/O3 중 어느 한 분위기에서 10 내지 500초 동안 실시한다. 커패시터를 제조하기 위해서는 고온의 산소 분위기에서 공정이 진행되는데 이러한 공정에서 Ru 하부 전극(20)으로 산소가 침투하여 유효 산화막 두께(Tox)가 높아지는 것을 방지하기 위하여 표면 처리를 한다. Referring to FIG. 1A, a Ru
도 1b를 참조하면, Ru 하부 전극(20) 상에 제 1 Ta2O5막(30a)을 저압 화학기상 증착법(LPCVD)으로 증착한다. 제 1 Ta2O5막(30a)은 증착 소오스 물질로 탄탈륨 에칠레이트(Ta(OC2H5)5)를 이용하여 170 내지 190℃로 유지되는 기화기에서 기상상태로 만들고, 10 내지 1000sccm의 산소(O2) 가스를 반응가스로 이용하여 형성한다. 이때, 반응로 내의 압력은 0.1 내지 1.2Torr의 범위로 하고 반도체 기판(10)은 300 내지 400℃의 온도범위로 가열한다. NH3 가스를 활성화 가스로 이용하기도 하는데 유량은 10 내지 1000sccm의 범위로 한다. Referring to FIG. 1B, a first Ta 2 O 5 film 30a is deposited on the Ru
도 1c를 참조하면, 제 1 Ta2O5막(30a)을 형성한 후 10 내지 500sccm의 N2+O
2 플라즈마, O2 플라즈마, N2O 플라즈마, O3 플라즈마 및 UV/O3 중 어느 한 분위기에서 인-시튜(In-Situ)로 제 1 Ta2O5막(30a)을 표면 처리한다. 이러한 표면 처리는 제 1 Ta2O5 유전체막(30a) 내의 탄소를 제거하고 산소 결핍을 억제하기 위하여 실시한다. 예를 들면, 플라즈마 처리 중 N2+O2 플라즈마 처리는 0.1 내지 2Torr의 압력 및 300 내지 400℃의 온도범위에서 10 내지 500Watt의 R.F 전력으로 10 내지 500sccm의 N2+O2 가스를 이용하여 10 내지 500초 동안 실시한다.Referring to FIG. 1C, after forming the first Ta 2 O 5 film 30a, any one of 10 to 500 sccm of N 2 + O 2 plasma, O 2 plasma, N 2 O plasma, O 3 plasma, and UV / O 3 may be used . The first Ta 2 O 5
도 1d를 참조하면, 제 1 Ta2O5막(30a) 상에 제 2 Ta2O5막(30b)을 증착하여 Ta2O5 유전체막(30)을 형성한다. 제 2 Ta2O5막(30b)을 증착하는 공정 조건은 제 1 Ta2O5막(30a)을 증착하는 공정조건과 동일하다. 유전체막(30)이 형성된 후에 후속 열처리 공정을 실시하는데, 500 내지 650℃의 온도범위에서 N2 분위기로 10 내지 30분동안 반응로 열처리를 실시하거나, 300 내지 500℃의 온도범위에서 N2O 플라즈마 또는 UV/O3 중 어느 한 분위기로 1 내지 5분동안 열처리를 실시한다.Referring to FIG. 1D, a Ta 2 O 5 film 30b is deposited on the first Ta 2 O 5
도 1e를 참조하면, Ta2O5 유전체막(30) 상에 100 내지 500Å의 두께로 상부 전극(40)을 형성하여 본 발명의 MIM 구조의 Ta2O5 커패시터가 제조된다. 상부 전극(40)은 TiN 등과 같은 금속을 이용한다.
Referring to FIG. 1E, the Ta 2 O 5 capacitor having the MIM structure of the present invention is manufactured by forming the
도 2는 본 발명의 커패시터 제조 방법에 따라 제조된 커패시터와 종래 커패시터의 누설 전류 특성을 비교한 그래프이다. 도면 부호 A는 종래의 방법에 따라 제조된 커패시터의 누설 전류 특성 곡선이고, 도면 부호 B는 본 발명에 따라 제조된 커패시터의 누설 전류 특성 곡선이다. 도시한 바와 같이, 종래 폴리실리콘 하부 전극에서의 유효 산화막 두께(약 30Å)보다 낮은 본 발명의 Ru 하부 전극의 유효 산화막 두께(12.68Å)에서 더 우수한 누설 전류 특성을 나타내고 있다.2 is a graph comparing leakage current characteristics of a capacitor manufactured according to the capacitor manufacturing method of the present invention and a conventional capacitor. A is a leakage current characteristic curve of a capacitor manufactured according to the conventional method, and B is a leakage current characteristic curve of a capacitor manufactured according to the present invention. As shown, better leakage current characteristics are exhibited at the effective oxide film thickness (12.68 mA) of the Ru bottom electrode of the present invention, which is lower than the effective oxide film thickness (about 30 mA) in the conventional polysilicon bottom electrode.
도 3은 본 발명의 커패시터 제조 방법에 따라 제조된 커패시터와 종래 커패시터의 I-V 특성을 비교한 그래프이다. 도시한 바와 같이, 종래 폴리실리콘 하부 전극에서의 유효 산화막 두께(약 30Å)보다 낮은 본 발명의 Ru 하부 전극의 유효 산화막 두께(12.68Å)에서 동일한 I-V 특성을 나타내고 있다.
3 is a graph comparing IV characteristics of a capacitor manufactured according to the capacitor manufacturing method of the present invention and a conventional capacitor. As shown, the same IV characteristics are exhibited in the effective oxide film thickness (12.68 ms) of the Ru bottom electrode of the present invention which is lower than the effective oxide film thickness (about 30 ms) in the conventional polysilicon bottom electrode.
상기한 바와 같이, 본 발명은 루테늄 하부 전극의 표면을 플라즈마 처리하고 Ta2O5 유전체막의 불순물 제거 및 산소 결핍을 억제하므로써 커패시터의 전기적 특성을 향상시키는 효과가 있다.
As described above, the present invention has the effect of improving the electrical characteristics of the capacitor by plasma-processing the surface of the ruthenium lower electrode and suppressing impurities removal and oxygen deficiency of the Ta 2 O 5 dielectric film.
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