KR100613185B1 - 전체 ｄｔｘ 동작 모드 기간중에 전력 절감을 개선한시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스사용자 장치 - Google Patents

전체 ｄｔｘ 동작 모드 기간중에 전력 절감을 개선한시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스사용자 장치 Download PDF

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Abstract

본 발명에 따르면, 전체 DTX 동작 모드중에 전력 절감을 개선하는 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자는 전체 DTX에 기인하여 전송되지 않은 코드와 타임슬롯을 처리하는 기저대역의 전체 또는 일부를 턴오프시킴으로써 전력 절감을 달성한다. 전체 DTX가 특수 버스트(SB)의 수신에 의해 검출된 경우, 수신기는 특수 버스트 스케줄링 기간(SBSP)의 지속 기간에 대한 모든 타임슬롯과 프레임에 대해 턴오프된다. 송신기는 소정의 유휴 기간이 뒤따르는 전송을 스케줄링하여 SBSP의 경계에서 개시한다. 수신기는 SBSP와, 몇몇 초기화 전체 DTX 주기의 수신에 의해 SBSP에 따른 전송을 초기화하는지 여부를 결정한다.

Description

전체 ＤＴＸ 동작 모드 기간중에 전력 절감을 개선한 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치{TIME DIVISION DUPLEX OR TIME DIVISION SYNCHRONOUS CODE DIVISION MULTIPLE ACCESS USER EQUIPMENT HAVING IMPROVED POWER SAVINGS DURING FULL DTX MODE OF OPERATION}
도 1은 데이터 전송 개시부를 SB의 전송 타이밍에 동기된 프레임에 대해 제한하기 위한 MAC에 대한 처리 절차를 도시하는 흐름도.
도 2는 데이터를 버퍼링하기 전에 서비스 품질 결정을 포함하는 도 1의 처리 절차에 대한 다른 처리 절차를 도시하는 흐름도.
도 3은 SBSP를 학습하기 위한 UE에 대한 처리 절차를 도시하는 흐름도.
도 4는 데이터를 갖지 않고 하나의 SB를 갖는 소정의 TTI가 뒤따르는 UTRAN MAC이 SBSP 경계에서 전송용 데이터를 스케줄할 것인지 여부를 학습하는 UE를 위한 처리 절차를 도시하는 흐름도.
도 5는 하향링크의 전체 DTX 중에 전력을 절약하기 위한 단순화된 처리 절차를 도시하는 흐름도.
도 6은 본 발명에 따라서 구성된 시스템을 도시하는 블록도.
〈도면의 주요 부분에 대한 부호의 설명>
102 : 코드 전력 추정부
104 : 버스트 품질 추정부
108 : DTX 검출 종료부
110 : 특수 버스트 검출부
114 : UE 학습부
116 : 수신기 온/오프 제어부
본 발명은 무선 통신 분야에 관한 것으로서, 특히 전체 불연속 전송(DTX) 동작 모드 기간 중에 하향링크에서 고속 칩 속도 시분할 전이중(TDD)형 시스템과 고속 칩속도 시분할 전이중형 시스템의 전력을 절감하는 것에 관한 것이다.
제3 세대 파트너쉽 프로젝트(3GPP) 시분할 전이중(TDD) 시스템에서는 시간을 전송 시간 간격(TTI)으로 구획하고, 그 전송 시간 간격을 프레임으로 세분하며, 그 프레임을 타임슬롯으로 더 세분한다. 1 개의 TTI는 하나 또는 그 이상의 무선 프레임으로서 형성된다. 특히, 1 개의 무선 프레임은 10 ㎳이고, 1 개의 TTI는 10 ㎳, 20 ㎳, 40 ㎳ 또는 80 ㎳ 중 어느 하나이어도 된다. 저속 칩 속도 TDD에서는 각 프레임을 2 개의 하위 프레임으로 분할한다. 이어서, 그들 하위 프레임은 복수 개의 타임슬롯으로 분할된다. 코드 복합 전송 채널(CCTrCH)은 하나 또는 그 이상의 전송 채널(TrCH)을 포함하고 있다. CCTrCH는 타임슬롯 및 코드로 된 하나 또는 그 이상의 세트의 컬렉션(collection)에 맵핑된다.
최대 데이터 크기의 어떤 CCTrCH가 전송될 때에는 TTI 내의 모든 할당 코드 및 타임슬롯이 사용된다. 1 개의 TTI 기간 중에 전송되는 실수(實數)의 코드 및 타임슬롯이 전송 형식 조합 인덱스(TFCI)를 통해서 수신 장치에 시그널링된다. 코드와 타임슬롯은 송신 장치와 수신 장치의 양자에 잘 알려진 규칙의 흐름에 따라서 할당되므로, TFCI를 복호화함으로써 코드 및 타임슬롯의 수가 수신 장치에 알려지면, 각각의 슬롯 내에서 어떤 코드들이 전송되었는지도 알 수 있다.
3GPP TDD 시스템에서는, CCTrCH의 총 비트 레이트가 TTI 내에서 CCTrCH에 할당된 코드 및 타임슬롯의 총 비트 레이트보다 적을 때 무선 프레임의 불연속 전송(DTX)의 지원을 포함하고 있다. TDD 송신 장치의 코드화 및 다중화 기능에 의해서 데이터는 코드 및 타임슬롯에 맵핑된다.
불연속 전송(DTX)은 각각의 CCTrCH에 개별적으로 적용된다. 어떤 CCTrCH가 DTX 상태에 있는 경우, 그 CCTrCH에 할당된 코드 및 타임슬롯의 일부 또는 전부는 전송되지 않는다. 불연속 전송(DTX)은 부분 DTX와 전체 DTX라고 칭하는 2 개의 부류로 나뉜다. 부분 DTX 기간 중에는, CCTrCH가 활성 중이지만 최대수 이하의 코드 및 타임슬롯에 데이터가 채워져 있고, 일부의 코드 및 타임슬롯은 TTI 내에 전송되지 않는다. 전체 DTX 기간 중에는 상위 프로토콜 계층에 의해서 CCTrCH에 제공되는 데이터는 없으며, 하나의 TTI 내에 전송할 데이터도 전혀 없다. CCTrCH는 상이한 TTI를 갖는 복수의 TrCH를 포함할 수 있다. 이 경우, CCTrCH 내의 모든 TrCH에 대한 TTI 중 최단 TTI와 동일한 각각의 기간 중에 전송된 코드가 변화될 수 있다. 본 명세서 전체를 통하여, 참조 부호 TTI는 CCTrCH 내의 모든 TrCH 중 최단 TTI를 의미한다. 본 발명은 전체 DTX에 관련되어 있기 때문에, 이후에는 전체 DTX만에 대해서 설명한다.
전체 DTX 기간 중에는 특수 버스트(SB)가 전송된다. 각각의 SB는 CCTrCH에 할당된 제1 타임슬롯의 제1 코드의 0-값의 TFCI에 의해 식별된다. 제1 SB는 전체 DTX의 개시를 나타낸다. 후속 SB가 주기적으로 특수 버스트 스케줄링 파라미터(SBSP) 프레임마다 전송된다. 후속 SB는 CCTrCH가 아직 활성 상태임을 결정하기 위한 수신기용 메카니즘을 제공하며, 수신기가 동기 이탈(out-of-sync)을 선택하는 것을 방지한다. 전체 DTX는 상위 프로토콜 계층이 데이터를 제공할 때 종료된다.
3GPP 표준에 있어서, MAC 실체는 데이터를 전송용 물리층에 제공한다. 물리층은, MAC가 소정의 전송용 데이터의 제공을 실패할 때마다 전체 DTX를 나타내는 SB를 발생한다. 물리층은 MAC가 데이터를 제공하자 마자 전체 DTX가 전송을 재초기화하는 것을 종료한다.
SBSP는 송신기에 대해 알고 있지만, UE는 알지 못한다. 따라서, 전체 DTX 기간 중에는, 비록 SB가 일단 모든 SBSP 프레임에 전송되더라도, UE는 SB가 전송될 가능성이 있는 대부분의 프레임을 처리해야 한다. 또한, 송신기는 데이터가 최상위 계층에서 이용 가능하자 마자 데이터 전송을 재초기화하며, SB 전송에 의해 개시되는 SBSP 프레임의 시퀀스의 개시부 또는 종단부를 갖는 데이터 전송의 개시와 동기하지 않는다. 따라서, 비록 CCTrCH가 아직 전체 DTX 상태일 수 있더라도, UE는 데이터 전송이 개시될 가능성이 있는 대다수의 프레임을 처리하여야 한다. 각 각의 시간에, UE는 프레임을 처리하도록 턴온하여 데이터 또는 SB를 찾아서 전력을 사용한다. 따라서, SB와 데이터 양쪽 모두를 전송하지 않을 때 프레임 기간 동안 턴온하는 요구를 피함으로써 모바일용 전력을 상당히 절감할 수 있다.
전체 DTX 동작 모드중에 전력 절감을 개선하는 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자는 전체 DTX에 기인하여 전송되지 않는 코드와 타임슬롯을 처리하는 기저대역의 전체 또는 일부를 턴오프시킴으로써 전력 절감을 달성한다. 전체 DTX가 특수 버스트(SB)의 수신에 의해 검출된 경우, 수신기는 특수 버스트 스케줄링 기간(SBSP)의 지속 기간에 대한 모든 타임슬롯과 프레임에 대해 턴오프된다. 송신기는 소정의 유휴 기간이 뒤따르는 전송을 스케줄링하여 SBSP의 경계에서 개시한다. 수신기는 SBSP와, 몇몇 초기화 전체 DTX 주기의 수신에 의해 SBSP에 따른 전송을 초기화하는지 여부를 결정한다.
본 발명은 유사한 참조 번호가 유사한 소자 전체를 나타내는 도면을 참조하여 설명되고 있다. 본 발명은 하향링크(DL)에서 전체 DTX에 이용 가능하며, 여기서 하향링크는 노드 B와 사용자 장치(UE) 사이의 링크이다. 본 발명의 일실시예에 있어서, UTRAN MAC는, SB가 전송되는 프레임을 알 수 있고, 또한 SBSP도 알 수 있다. 이에 따라, 이어서 유휴 기간 중에, UTRAN MAC는 데이터가 SBSP 프레임 경계만에 대해 다시 개시될 때 전송을 제한한다.
도 1에는 UTRAN MAC에 의해 구현되는 처리 절차(10)가 도시되어 있다. 처리 절차(10)는 전송하기 위한 데이터의 각각의 TTI를 모니터하는 UTRAN MAC 송신기에 의해 개시된다(단계 12). 이 후, UTRAN MAC는 전송하기 위한 데이터가 존재하는지 여부를 결정한다(단계 14). 전송하기 위한 데이터가 존재하는 경우, 데이터는 MAC 및 다음의 TTI에 의해 전송하기 위해 처리되고(단계 15), 처리 절차(10)는 다시 개시된다. 그러나, 데이터가 그 TTI에서 전송되지 않는다고 결정하는 경우(단계 14), 그 TTI의 개시부의 접속 프레임 번호(CFN)가 기록되고(단계 16), 전송 스케줄링 유휴 기간이 설정된다(단계 18).
UTRAN MAC는 모든 전송을 스케줄링하며, 이에 따라 전송용 데이터를 포함하지 않는 제1 TTI에 대응하는 CFN을 알 수 있다. 이 무선 프레임은 전체 DTX의 개시부이며, SB를 포함한다. 유휴 기간은 데이터가 UTRAN MAC에 의해 전송되도록 처리된 것이 아닌 SBSP 기간의 지속 기간이다. 예를 들면, UTRAN MAC 송신기가, 그 프레임(106)이 데이터가 전송된 것인 아닌 TTI의 제1 프레임임을 검출하고, 이에 따라 DTX가 도입되는 경우, SB는 프레임(106)에 전송되며, SBSP가 8인 경우(즉, 8 무선 프레임), 이 때 전송 스케줄링 유휴 기간이 프레임 113에서 종료하도록 설정된다.
이에 따라, 단계 20에서, 데이터의 처리가 턴오프되고, 모든 데이터(데이터가 하나라도 존재하면)는 무선 링크 제어기(RLC)에서 유지된다(단계 22)(즉, 버퍼링됨). 이 후, 유휴 기간이 만기되었는지 여부를 결정한다(단계 24). 유휴 기간이 만기되기 않은 경우, 데이터의 버퍼링(단계 22)이 계속된다. 유휴 기간이 유휴 기간이 단계 18에서 SBSP를 더하여 개시되는 CFN과 동일한 현재의 CFN에 의해 결정된 바와 같이 만기되는 경우, 이 때 소정의 버퍼링된 데이터가 존재하는지 여부를 결정한다(단계 26). 소정의 버퍼링된 데이터가 존재하는 경우, 데이터는 MAC에 의해 처리된다(단계 15). 소정의 버퍼링된 데이터가 존재하지 않는 경우, 단계 16 내지 단계 26이 반복된다.
도 10의 처리 절차는 애플리케이션의 서비스 품질(QoS)이 데이터의 버퍼링에 기인하는 보다 큰 데이터 지연 시간을 허용한다고 가정한다.
도 2에는 허용 가능한 보다 큰 데이터 지연 시간이 이루어지지 않았다고 가정한 흐름도가 도시되어 있다. 이 처리 절차(50)는 단계 12 내지 단계 26이 동일한 도 1의 처리 절차(10)와 유사하다. 그러나, 도 2의 처리 절차(50)는 그 애플리케이션에 대한 QoS 요구가 데이터의 버퍼링을 허용할 수 있는지 여부를 결정하는 단계 52와 단계 54를 포함한다.
도 2에 도시된 처리 절차(50)의 단계 12 내지 단계 26과 동일한 단계 12 내지 단계 26이 도 1의 처리 절차(10)의 대응하는 단계 12 내지 단계 26와 동일하기 때문에, 이들 단계는 도 2를 참조하여 다시 설명하지 않는다. 단계(52)를 참조하면, UTRAN MAC는 데이터가 전송을 위해 이용 가능한지 여부를 결정한다. 데이터가 전송에 이용 가능한 것이 아니라고 결정된 경우(단계 52), 단계 24 내지 단계 26은 상기한 바와 같이 실행된다. 그러나, 데이터가 수신되었다고 결정된 경우(단계 52), UTRAN MAC는 QoS 요구가 버퍼링을 허용하는지 여부를 결정한다(단계 54). QoS 요구가 버퍼링을 허용하지 않는 경우, 데이터는 즉시 전송에 대해 해제된다(단계 14). QoS 요구가 버퍼링을 허용한다고 결정된 경우(단계 54), 데이터는 RLS에 남겨지며(단계 22), 단계 24 내지 단계 26이 상기한 바와 같이 수행된다.
당업자라면 이해할 수 있는 바와 같이, 도 1의 처리 절차(10) 및 도 2의 처리 절차(50)에 의해, UTRAN MAC가 SBSP 프레임에 의해 분할된 시간 간격에 대해 데이터의 전송 스케줄링 및 처리를 제한할 수 있다. 상세하게는, 데이터 전송의 초기화는, SB가 데이터가 버퍼링되지 않는 경우에 전송될 때에 대응하는 프레임에서만 발생된다. SBSP를 알 수 있거나 알 수 있게 되는 UE와 UTRAN MAC에 의해 구현되는 이 처리는 전송 데이터를 빠뜨릴 위험이 없이 SB의 예상 도달 시간 간의 SBSP-1 프레임 기간중에 오프 상태를 유지할 수 있다. 다시 말하면, SB의 예상 도달 시간에는, SB 또는 데이터 중 하나가 수신된다. 전체 DTX 중에 매 SBSP 프레임에서 이탈하는 SBSP-1에 대해 턴오프하는 UE의 능력은 상당한 전력 절감을 제시한다.
일반적으로, UE는 SBSP 또는 UTRAN MAC가 도 1 및 도 2에 각각 도시된 바와 같은 처리 절차(10, 50)를 구현하는지 여부의 결정 중 하나를 알 수 없다. 이러한 경우, UE의 달성될 전력 절감에 대해서는, UE가 UTRAN MAC 전송 스캐줄링과 결합하기 위해서 여러 부분의 정보를 결정 또는 "학습"하여야 한다. 이들 정보의 부분은 (1) SBSP 및 (2) UTRAN MAC 스케줄 유휴 하향링크 데이터 기간이 SBSP에 대응하는지 여부이다.
SBSP는 UTRAN에 대해서만 알려진 구성 가능한 파라미터이다. 이에 따라, 도 3에는 SBSP를 학습하는 UE를 위한 처리 절차(30)가 도시되어 있다. 단계 32에서, 처리 절차(30)는 CCTrCH의 TrCH 중 최단 TTI의 개시부에서 TFCI를 판독함으로써 개 시된다. 상기한 바와 같이, 0-값 TFCI는 전체 DTX의 개시를 나타내는 SB를 나타낸다. TFCI가 SB를 나타내지 않는 경우(단계 33), 그 TTI에 대한 데이터가 처리되고(단계 34), 처리 절차는 다음의 TTI의 개시부에서 반복된다. TFCI가 SB를 나타내는 경우, 이 때 CCTrCH는 전체 DTX 상태에 있고, 타이밍값이 초기화되거나 현재의 CFN이 기록된다(단계 35). 타이밍값이 TTI의 지속 기간에 의해 증분되고(단계 38), TFCI가 그 다음의 TTI에서 판독된다(단계 39). SB가 수신되었다고 결정된 경우(단계 40), 그 타이밍값(또는, 현재의 CFN과 단계 35에서 기록된 CFN 사이의 차)이 SBSP로서 저장된다(단계 41). SB가 수신되지 않았다고 결정된 경우(단계 40), 수신기는 CCTrCH가 아직 전체 DTX 상태에 있지만 SBSP가 확인되지 않았다고 가정하고 있기 때문에, 처리 절차(30)는 단계 38로 복귀한다. 이 처리 절차(30)의 결과에 따라, 하나의 샘플 SBSP가 결정된다.
단계 35 내지 단계 41이 단계 41의 몇몇 타이밍값을 메모리에 저장하기 위해 반복될 수 있음을 주목해야 한다. TFCI 수신이 항상 정밀한 TFCI값을 산출하는 것은 아니기 때문에, SB 검출은 허위의 정(positive)의 결과와 허위의 부(negative)의 결과를 산출할 수 있다. 따라서, 검출된 SBSP값의 임계값은, UE가 SBSP가 결정되었다고 확신하기 전에 필요할 수 있다. 예를 들면, 일실시예에 있어서, UE는 SBSP의 결정을 선언하기 전에 단계 35 내지 단계 41의 5 회 반복을 필요로 할 수 있다(즉, 저장된 값 5는 등가임). 물론, 이것은 애플리케이션에서 원하는 바와 같이 증분 또는 감분될 수 있는 구성 가능한 파라미터이다.
일단, SBSP가 결정되면, UE는 이제 SBSP를 이용하여 UTRAN MAC(데이터와 SB 가 전송되지 않는 소정의 TTI가 뒤따름)가 SBSP 경계에서 데이터의 전송을 스케줄하는지 여부를 결정할 수 있다.
도 4에는 데이터와 SB가 전송되지 않은 소정의 TTI가 뒤따르는 UTRAN MAC가 SBSP 경계에서 전송용 데이터를 스케줄하는지 여부를 학습하는 UE를 위한 제1 다른 처리 절차(130)가 도시되어 있다. 단계 131에서, 처리 절차(130)는 지능형 스케줄링 파라미터(ISP)를 개시함으로써 시작된다. 후술하는 바와 같이, ISP는 데이터의 수신과 SBSP에 기초한 SP의 예상 도달 시간 사이의 상관 관계의 정도를 결정하는데 이용되는 지시자이다. 이 후, TFCI는 CCTrCH 내의 TrCHs 중 최단 TTI의 개시부에서 판독된다. TFCI가 SB(단계 133)를 나타내지 않는 경우, 수신기는 전체 DTX 내에 존재하지 않는다. 따라서, 최단 TTI에 대한 데이터는 처리되고(단계 134), 처리 절차(130)가 다음의 TTI의 개시부에서 반복된다.
TFCI가 특수 버스트를 나타내는 경우(단계 133), CCTrCH는 전체 DTX 내에 존재한다. 다음의 TTI에 있어서, 수신기는 TFCI를 판독한다(단계 137). 유효 TFCI가 수신되지 않았다고 결정되면(단계 138), 처리 절차(130)는 단계 137로 복귀된다. 그러나, 유효 TFCI가 수신된 경우, 수신기는 유효 TFCI가 SB인지의 여부를 결정한다(단계 139). 유효 TFCI가 SB인 경우, 처리 절차(130)는 단계 137로 복귀된다.
단계 139에서, 수신기가 유효 TFCI는 SB가 아니라고 결정된 경우, 데이터 전송의 재시작을 나타낸다. 이에 따라, 이 후 유효 TFCI가 SB의 예상 도달 시간, 다시 말해서, 정확하게 이전의 SB의 수신 이후의 SBSP 프레임과 일치하는지 여부의 결정이 이루어진다(단계 140). SBSP 프레임과 일치하는 경우, ISP는 증가되고(단계 142), SBSP 프레임과 일치하지 않는 경우, ISP는 감소된다(단계 141). 단계 143에서는 ISP가 소정의 임계치를 초과하는지 여부가 결정된다. 예를 들면, 소정의 임계치가 5 배로 전송되는 경우, 그것보다 5 배로 발생된 전체 DTX 후에 데이터 전송의 재시작은 발생되지 않음을 나타낸다.
ISP는 핸드오버(handover) 등과 같은 특정 이벤트, 또는 UE가 상이한 SBSP를 갖는 셀에 관계되도록 하는 임의의 다른 이벤트, 또는 지능형 스케줄링을 이용하지 않은 것 후에 ISP는 재설정된다(그리고 SBSP는 재학습됨)는 점에 유의해야 한다.
ISP 임계치가 초과되지 않았다고 결정된 경우, 상기 TTI에 대한 데이터의 처리는 수행된다(단계 134). 그러나, ISP가 임계치를 초과하였다고 결정된 경우(단계 143), UTRAN MAC를 대신한 지능형 스케줄링이 확인되고(단계 144), 상기 TTI에 대한 데이터가 처리된다(단계 134).
도 4에 도시한 처리 절차에 대한 다른 방법은 전체 DTX의 시작과 관련된 다수의 SBSP로 끝나는 복수의 순차적인 전체 DTX 주기를 결정하기 위한 것이다. 예를 들면, 도 3에 도시한 처리 절차(30)에서, SBSP가 결정되었다는 점을 UE가 확신하기 전에 검출된 SBSP 값의 임계수가 필요할 수 있음이 개시되어 있다. 이 처리는 다수의 전체 DTX 주기를 가질 수 있고, 이러한 DTX 주기 동안에 전체 DTX의 종료부가 SBSP 경계에 있는지에 관하여 검사될 수 있다. 전체 DTX의 종료부가 SBSP 경계에 있는 경우, 카운터는 증분되고, 전체 DTX의 종료부가 SBSP 경계에 있지 않은 경우, 카운터는 소거되거나 감분된다. 따라서, UE가 방법 30 및 방법 130의 양쪽 모두, 또는 이와 유사한 다른 방법을 동시에 처리하는 것은 가능하다.
도 3에 도시된 처리 절차(30)와 도 4에 도시된 처리 절차(130)의 결과, UE가 UTRAN MAC가 지능형 스케줄링을 구현한다고 결정된 경우, 수신기가 전체 DTX를 입력할 때, SB의 예상 도달 시간 간의 SBSP-1 프레임 중에 수신기의 처리에 전력을 공급할 필요가 없다는 점을 UE는 확신할 수 있다. 이 처리는 UE 처리를 감소시키고 이에 대응하여 전력 절감을 감소시킨다.
도 4에 도시된 처리 절차(130)가 UE로 하여금 UTRAN MAC가 전체 DTX 후에 데이터의 전송을 지능형으로 스케줄링하는지 여부를 결정하도록 할 수 있지만, UE는 UTRAN MAC이 SBSP 경계에서 전체 DTX 후에 데이터 전송의 재시작을 스케줄링하는 지 여부를 알지 못하더라도 여전히 전력 절감을 달성할 수 있다.
도 5에는 하향링크 내의 전체 DTX 중에 전력 절감에 대한 단순화된 처리 절차(200)가 도시되어 있다. 이 처리 절차(200)에 앞서, 도 3에 도시된 처리 절차(30)는 SBSP를 결정하는데 적용되었다. 처리 절차(200)는 CCTrCH 내의 TrCH 중에 최단 TTI의 개시부에서 TFCI가 판독될 때 시작된다(단계 202). 이 후, SB인지의 여부가 결정된다(단계 204). TTI가 SB가 아닌 경우, 데이터는 수신된 후, 상기 TTI 내의 데이터가 처리되며(단계 205), 이 후 절차(200)가 시작된다.
TFCI는 SB이라고 결정이 이루어지면(단계 204), 수신기의 처리는 오프된다(단계 206). 이 후, 수신기의 처리는 SBSP-1 프레임 후에 온된다(단계 208). 이 후, TFCI가 판독되고(단계 210), 유효 TFCI가 수신되었는지의 여부에 대한 결정이 이루어진다(단계 212). SB가 수신된 경우, 수신기 처리는 또 다시 오프되고(단계 206) 단계 206-212는 반복된다. 그러나, 유효 TFCI가 수신되었다고 결정이 이루어지면( 단계 212), 절차(200)는 단계 204로 복귀된다.
도 5에 도시된 처리 절차(200)가 도 4에 도시된 처리 절차(130)보다 더욱 적은 처리와 더욱 큰 전력의 절감을 수반하지만, 결점은 UTRAN MAC이 SBSP 경계에서 데이터를 지능형으로 스케줄링하지 않는 경우, 이 처리 절차는 데이터를 손실한다는 것이다. 따라서, 전력 절감 대 성능의 합의가 이루어진다.
또한, 도 5에 도시한 절차(200)가 UE로 하여금 UTRAN MAC이 데이터를 지능형으로 스케줄링하는지 여부를 결정하도록 할 필요가 없지만, 그럼에도 불구하고 UE는 도 5에 도시된 단순화된 처리 절차(200)를 구현하기 위해 도 3에 도시된 SBSP를 결정하기 위한 처리 절차(30)를 여전히 구현해야 하는 점에 유의해야 한다.
도 6에는 본 발명에 따른 시스템(100)이 도시되어 있다. 이 시스템(100)은 코드 전력 추정부(102), 버스트 품질 추정부(104), DTX 검출 종료부(108), 특수 버스트 검출부(110), UE 학습부(114) 및 수신기 온/오프 제어부(116)를 구비하고 있다. 코드 전력 추정부(102) 및 버스트 품질 추정부(104)가 별도의 개체로 도시되어 있지만, 이들은 당업자에 의해 인식되는 바와 같이, 단일의 전처리부(106)로 쉽게 결합될 수 있다. 마찬가지로, DTX 검출 종료부(108)와 특수 버스트 검출부(110)가 별도의 개체로 도시되어 있지만, 이들은 TFCI 필드 내의 정보를 검출하고 해석하는 단일 검출부(112)로 결합될 수 있다.
코드 전력 추정부(102)는 각각의 수신 코드의 전력을 측정한다. 버스트 품질 추정부(104)는, 예를 들어 신호대 잡음비와 같은 수신 버스트 상의 품질 메터(quality metric)를 추정한다. 동시에, 코드 전력 추정부(102) 및 버스트 품질 추정부(104)는 수신 신호의 전처리를 수행하고, 이것은 DTX 검출 종료부(108) 및 특수 버스트 검출부(110)가 유효 TFCI가 수신되었는지 여부를 결정하는 것에 도움이 된다. 원래, 코드 전력 추정부(102) 및 버스트 품질 추정부(104)는 수신 신호가 극복해야 하는 제1 임계치를 제공한다. 이것은 시스템(100)이 수신기에 의해 수신되는 다른 에너지로부터 유효 버스트를 결정하는데 도움이 된다. 이것은 또한 수신된 에너지의 오류 검출(유효 TFCI가 아님)을 유효 TFCI로 피하는데 도움이 된다. 상기 오류 검출로 인하여 수신기는 불필요하게 온하여 결국 오류 데이터를 발생하여 필요한 처리량을 증가시키고, 전력을 낭비하며 전송 전력을 불필요하게 증가시키는 BLER를 오류로 증가시키게 된다.
DTX 검출 종료부(108)는 데이터가 수신될 때를 식별하기 위해 TFCI 비트를 해석한다.
특수 버스트 검출부(110)는 SB가 수신되는지 여부를 결정하여 전체 DTX의 시작을 나타낸다. 도 6에 도시된 바와 같이, DTX 검출 종료부(108)와 특수 버스트 검출부(110)의 출력은 UE 학습부(114)에 입력된다.
DTX 검출 종료부(108)는 SB가 아닌 유효 TFCI의 존재를 검출하여, 유효 데이터의 수신의 시작과 DTX 검출 종료를 나타낸다. 이러한 표시는 UE 학습부(114)에 전송된다. 마찬가지로, 특수 버스트 검출부(110)가 SB의 존재를 검출하여 전체 DTX가 시작되었다는 것을 나타내는 경우, UE 학습부(114)에 통지된다.
수신기 온/오프 제어부(116)는 UE 학습부(114)에 의해 유도된 바와 같이 수신기를 오프한다. UE 학습부(114) 및 수신기 온/오프 제어부(116)가 별도의 부로 설명되었지만, 수신기 온/오프 제어부(116)는 UE 학습부(114)에 포함될 수 있는 점에 유의해야 한다. 이와 달리, 수신기 온/오프 제어부(116)는 추정될 수 있고 UE 학습부(114)는 수신기의 제어 기능을 수행할 수 있다. 일반적으로, 도 6에 설명된 모든 소자는 기능성 유닛이고, 본 명세서에서 분리되고 구별된 유닛으로서 이에 대한 설명은 실시예에 의해 이해를 용이하게 하기 위해 제공된다. 이 기능성 블록이 제한 목적의 블록이라고 이해해서는 안된다. 예를 들면, 이러한 모든 기능은 원하는 경우 단일 프로그래머블 제어기로 구현될 수 있다.
UE 학습부(114)는 DTX 검출 종료부(108)와 특수 버스트 검출부(110)의 양쪽 모두로부터 입력을 수신하고 그것을 도 3, 도 4 및 도 5를 각각 참조하여 위에 설명한 처리 절차(30, 130, 200)로 처리한다.
수신기가 DTX를 입력한 경우, TFCI를 판독하기 위한 시도로 다음의 TTI에서 온될 것이다. 코드 전력 추정부(102) 및 버스트 품질 추정부(104)는 신호가 수신되었다는 것을 선언하기 위해 신호가 극복해야 하는 임계치를 제공한다. 임계치를 초과하는 경우, DTX 검출 종료부(108) 및 특수 버스트 검출부(110)는 TFCI가 유효(예컨대, TFCS 내의 값에 대응)인지의 여부, 또는 TFCI가 0(SB를 나타냄)인지 여부를 결정한다. 임계치를 초과하지 않는 경우, TFCI는 유효값과 동일하지 않거나, TFCI는 0이고(SB 및 전체 DTX의 연속을 나타냄), 수신기 온/오프 제어부(116)는 다음의 SBSP-1 프레임에 대해 수신기를 오프시키도록 통보된다. 임계치를 초과하고 TFCI가 유효의 0이 아닌 값과 동일한 경우, UE는 전체 DTX가 종료되었다고 결론짓고 이 프레임 및 다음의 프레임 내의 수신된 데이터 처리를 계속한다.
본 발명은 현재의 광대역 및 협대역 TDD 표준 및 TD-SCDMA와 양립될 수 있다. 본 발명은 SB의 수신 후에 (SBSP-1) 프레임 동안 모든 수신기의 처리를 오프시킴으로써 UE 전력을 절감할 능력을 제공하고 있다.
본 발명에 따르면, 전체 불연속 전송(DTX) 동작 모드 기간 중에 하향링크에서 고속 칩 속도 시분할 전이중(TDD)형 시스템과 고속 칩속도 시분할 전이중형 시스템의 전력을 절감할 수 있는 무선 통신 장치를 제공할 수 있다.

Claims (5)

  1. 불연속 전송(DTX) 동안에 전력을 절감하는 저속 칩 속도 시분할 전이중 또는 고속 칩 속도 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치(UE)에 있어서,
    수신된 신호가 유효한 TFCI를 구비하고 있는지 여부를 결정하기 위한 사전처리부와;
    상기 사전처리부에 결합되어, 상기 유효한 TFCI가 특수 버스트(SB)인지 여부를 결정하기 위해 상기 유효한 TFCI를 판독하기 위한 검출부와;
    상기 검출부에 결합되어, 데이터가 전송될 때를 결정하며, 학습부의 결정에 응답하여 수신기의 처리를 턴온 및 턴오프하기 위한 학습부를 포함하는 것을 특징으로 하는 저속 칩 속도 시분할 전이중 또는 고속 칩 속도 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치.
  2. 제1항에 있어서, 상기 사전처리부는 상기 수신된 신호의 전력을 추정하기 위한 코드 전력 추정부를 더 포함하는 것인 저속 칩 속도 시분할 전이중 또는 고속 칩 속도 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치.
  3. 제2항에 있어서, 상기 사전처리부는 상기 수신된 신호의 품질을 추정하기 위한 버스트 품질 추정부를 더 포함하는 것인 저속 칩 속도 시분할 전이중 또는 고속 칩 속도 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치.
  4. 제1항에 있어서, 상기 검출부는 상기 유효한 TFCI를 판독하여, 데이터가 전송되고 있는지 여부를 식별하기 위한 DTX 판독부의 종료부를 더 포함하는 것인 저속 칩 속도 시분할 전이중 또는 고속 칩 속도 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치.
  5. 제4항에 있어서, 상기 검출부는 상기 유효한 TFCI를 판독하여, 그 유효한 TFCI가 전체 DTX를 나타내는 특수 버스트인지 여부를 식별하기 위한 특수 버스트 검출부를 더 포함하는 것인 저속 칩 속도 시분할 전이중 또는 고속 칩 속도 시분할 전이중 또는 시분할 동기 코드 분할 다중 액세스 사용자 장치.
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