상기와 같은 목적을 달성하기 위한 본 발명에 따른 승압전압 안정화장치의 전압 감지부는 클럭신호에 따라 전원전압보다 높은 전압 레벨을 가지도록 생성된 승압전압의 레벨 변동을 감지하고, 감지된 레벨 변동에 따른 제1 내지 제N 감지신호를 출력하며, 구동버퍼 제어부는 제1 내지 제N 감지신호에 따른 제1 내지 제2N 전류 제어신호를 출력하고, 구동버퍼부는 제1 내지 제2N 전류 제어신호에 따라 선택적으로 동작되어 승압전압을 생성하기 위한 충전 전류량을 조절하는 제1 내지 제N 인버터 구동부를 포함한다.
본 발명에 따른 승압전압 안정화방법은 클럭신호에 따라 전원전압보다 높은 전압 레벨을 가지도록 생성된 승압전압의 레벨 변동을 감지하고, 감지된 레벨 변동에 따른 제1 내지 제N 감지신호를 출력하는 제1 단계, 제1 내지 제N 감지신호에 따른 제1 내지 제2N 전류 제어신호를 출력하는 제2 단계 및 제1 내지 제2N 전류 제어신호에 따라 선택적으로 동작되어 승압전압을 생성하기 위한 충전 전류량을 조절하는 제3 단계를 포함한다.
본 발명에 따른 승압전압 생성장치의 승압전압 생성부는 클럭신호에 의해 전원전압보다 높은 승압전압을 출력하고, 전압 감지부는 승압전압의 레벨 변동을 감지하고, 감지된 레벨 변동에 따른 제1 내지 제N 감지신호를 출력하며, 구동버퍼 제어부는 제1 내지 제N 감지신호에 따른 제1 내지 제2N 전류 제어신호를 출력하고, 구동버퍼부는 제1 내지 제2N 전류 제어신호에 의해 선택적으로 동작되어 승압전압 생성부에 인가되는 충전 전류량을 조절하는 제1 내지 제N 인버터 구동부를 갖는다.
본 발명에 따른 승압전압 생성방법은 클럭신호에 의해 전원전압보다 높은 승압전압을 출력하는 단계, 승압전압의 레벨 변동을 감지하고, 감지된 레벨 변동에 따른 제1 내지 제N 감지신호를 출력하는 단계, 제1 내지 제N 감지신호에 따른 제1 내지 제2N 전류 제어신호를 출력하는 단계 및 제1 내지 제2N 전류 제어신호에 의해 선택적으로 동작되어 승압전압 생성부에 인가되는 충전 전류량을 조절하는 단계를 포함한다.
본 발명에 따른 승압회로의 제1 차지펌프는 제1클럭신호에 응답하여 제1노드에 차지를 펌핑하고, 제2 차지펌프는 제1클럭신호와 위상이 반전된 제2클럭신호에 응답하여 피드백신호에 따라 가변되는 전류구동능력을 가지고 제2노드에 차지를 펌핑하며, 출력스위치는 제1노드의 전압신호에 응답하여 제2노드에 차지된 전압신호를 출력커패시터에 스위칭하고, 전압 안정화부는 출력 커패시터의 양단 전압이 기준레벨에 비교하여 낮아지면 이를 높이는 방향으로, 높아지면 이를 낮추는 방향으로 피드백신호를 발생한다.
이러한, 본 발명에 따르면, 승압전압의 변동을 감지하고, 감지된 변동량에 상응하여 충전전류량을 조절하므로, 항상 일정한 레벨을 가지는 안정적인 승압전압을 생성할 수 있다.
이하, 본 발명의 바람직한 실시예에 따른 승압전압 생성장치 및 방법을 첨부 도면을 참조하여 상세히 설명한다.
도 1은 본 발명의 일 실시예에 따른 승압전압 생성장치의 구성을 나타낸 블록도이고, 도 2는 도 1에 도시된 전압 감지부의 상세 구성을 나타낸 회로도이다. 도 3은 도 1에 도시된 구동버퍼부의 상세 구성을 나타낸 회로도이고, 도 4는 도 1에 도시된 구동버퍼 제어부의 상세 구성을 나타낸 회로도이다.
도 1에 도시된 바와 같이, 본 발명의 일 실시예에 따른 승압전압 생성장치는 외부로부터 입력되는 제1 클럭신호(CLK)가 인버팅된 제2 클럭신호(CLK2)에 따라 제1 전압(V1)보다 높은 제2 전압(V2)을 생성하여 출력하는 승압전압 생성부(100), 상기 제2 전압(V2)을 감지하고, 상기 제2 전압(V2)의 변동에 따른 감지신호를 출력하는 전압 감지부(110), 상기 감지신호에 따른 전류 제어신호를 출력하는 구동버퍼 제어부(120), 상기 전류 제어신호에 따라 승압전압 생성부(100)에 인가되는 충전 전류량을 조절하여 상기 제2 전압(V2)을 일정하게 유지하는 구동버퍼부(130) 및 상기 제1 클럭신호(CLK1)의 주파수를 조절하여 상기 제2 전압(V2)의 리플을 감소시키기 위한 주파수 체배부(140)를 포함한다. 이때, 제1 전압(V1)은 전원전압이고, 제2 전압(V2)은 제1 전압(V1)의 2배 레벨을 가지는 전압이다.
상기 승압전압 생성부(100)는 제1 및 제2 다이오드(D1,D2), 외부로부터 입력되는 상기 제1클럭신호(CLK)를 인버팅하는 제1 인버터(102), 제1 다이오드(D1)에 일단이 연결되고, 제1 인버터(102)의 출력단에 타단이 연결되는 제1 커패시터(C1), 제2 다이오드(D2)에 일단이 연결되고, 구동버퍼부(130)의 출력단에 타단이 연결되는 제2 커패시터(C2) 및 제1 다이오드(D1)에 게이트 단자가 연결되고, 제2 다이오드(D2)에 소오스 단자가 연결되는 스위치 트랜지스터(104)를 포함한다. 이때, 스위치 트랜지스터(104)는 게이트 단자와 드레인 단자가 연결된 피모스 트랜지스터이다.
여기서, 승압전압 생성부(100)는 2개의 차지펌프(charge pump)를 가지는 구성 형태이다. 즉, 제1 차지펌프는 제1 다이오드(D1), 제1 인버터(102) 및 제1 커패시터(C1)를 포함하고, 제2 차지펌프는 제2 다이오드(D2) 및 제2 커패시터(C2)를 포 함한다. 이때, 제2 차지펌프는 구동버퍼부(130)를 포함할 수 있다.
상기 제1 및 제2 다이오드(D1,D2)는 피모스 다이오드이다. 여기서, 엔모스 다이오드는 피-웰(P-Well)에서 그라운드로 동작되어 신호가 반전되기 때문에 그라운드와 피-웰을 절연시키기 위한 별도의 웰이 구성되므로, 트리플 웰(tripple well) 구조를 가진다. 따라서, 본 발명에서는 트리플 웰 구조의 사용을 피하여 공정 측면에서 저렴하게 구현할 수 있는 피모스 다이오드를 사용한다.
상기 제2 커패시터(C2)는 제1 인버터(102)에 의해 인버팅된 제2 클럭신호(CLK2)의 하이구간에서 제1 전압(V1)에 상응하는 전하가 충전되고, 제2 클럭신호(CLK2)의 로우 구간에서 상기 제1 전압(V1)의 2배의 크기에 상응하는 제2 전압(V2)에 상응하는 전하가 충전됨과 동시에 스위치 트랜지스터(104)를 통해 제2 전압(V2)을 출력한다.
이때, 제1 커패시터(C1)는 제2 커패시터(C2)에 제1 전압(V1)에 상응하는 전하가 충전되는 동안 스위치 트랜지스터(104)를 오프시키고, 제2 클럭신호(CLK2)의 로우 구간에서 스위치 트랜지스터(104)를 턴온시키고, 제2 커패시터(C2)에 충전된 제2 전압(V2)은 스위치 트랜지스터(104)를 통해 출력된다.
상기 전압 감지부(110)는 도 2에 도시된 바와 같이, 밴드갭(Bandgap) 기준신호(Vref)를 발생하는 기준신호 발생부(200), 승압전압 생성부(100)에서 출력되는 제2 전압(V2)을 분배하는 제1 내지 제4 분배저항(R1,R2,R3,R4) 및 제1 내지 제4 분배저항(R1,R2,R3,R4)에 의해 전압 분배된 제1 내지 제3 분배전압(Vd1,Vd2,Vd3
)과 밴드 갭 기준신호(Vref)를 비교하여 그에 따른 감지신호를 출력하는 비교부(210)를 포함한다.
여기서, 밴드갭 기준신호(Vref)는 온도(Temperature) 및 프로세스(Process)의 변화에 무관하게 항상 일정한 레벨의 기준전압이다. 이때, 본 발명에서 밴드갭 기준신호(Vref)는 0.7V이다.
또한, 비교부(210)는 제2 전압(V2)이 제1 저항(R1)과 제2 저항(R2), 제3 저항(R3), 제4 저항(R4)에 의해 전압 분배된 제1 분배전압(Vd1)과 기준신호(Vref)를 비교하여 제1 감지신호(comp1)를 출력하는 제1 비교기(212), 제1 분배전압(Vd1)이 제1 저항(R1), 제2 저항(R2)과 제3 저항(R3), 제4 저항(R4)에 의해 전압 분배된 제2 분배전압(Vd2)과 밴드갭 기준신호(Vref)를 비교하여 제2 감지신호(comp2)를 출력하는 제2 비교기(214) 및 제2 분배전압(Vd2)이 제1 저항(R1), 제2 저항(R2), 제3 저항(R3)과 제4 저항(R4)에 의해 전압 분배된 제3 분배전압(Vd3)과 밴드갭 기준전압(Vref)을 비교하여 제3 감지신호(comp3)를 출력하는 제3 비교기(216)를 포함한다.
이때, 제1 비교기(212)는 제2 전압(V2)이 낮은 경우에 동작을 시작하고, 제3 비교기(216)는 제2 전압(V2)이 높은 경우에 동작을 시작하며, 제2 비교기(214)는 제1 비교기(212)와 제3 비교기(216)의 동작전압 사이의 전압 레벨에서 동작을 시작 하게 된다.
예를 들어, 제1 비교기(212)는 제2 전압(V2)이 5.029V 이상인 경우부터 하이신호 '1'을 출력하고, 제3 비교기(216)는 제2 전압(V2)이 5.12V 이상인 경우부터 하이신호 '1'을 출력하며, 제2 비교기(214)는 제2 전압(V2)이 5.075V 이상인 경우부터 하이신호 '1'을 출력한다.
따라서, 제1 내지 제4 분배저항(R1,R2,R3,R4)은 제2 전압(V2)이 5.029V 이상인 경우에 제1 비교기(212)가 '1'을 출력하고, 제2 전압(V2)이 5.075V 이상인 경우에 제2 비교기(214)가 '1'을 출력하고, 제2 전압(V2)이 5.12V 이상인 경우에 제3 비교기(216)가 '1'을 출력하기 위하여 제2 전압(V2)을 분배하기 위한 저항값을 가진다.
또한, 구동버퍼부(130)는 도 3에 도시된 바와 같이, 제1 인버터(102)로부터 입력되는 제2 클럭신호(CLK2)를 인버팅하고, 제2 클럭신호(CLK2)의 로우 구간에서 제1 충전전류(I1)를 제2 커패시터(C2)로 인가하는 제2 인버터(300), 구동버퍼 제어부(120)로부터 입력되는 전류 제어신호에 의해 선택적으로 동작되어 제2 내지 제4 충전전류(I2,I3,I4)를 제2 커패시터(C2)에 선택적으로 인가하는 전류 조절부(310)를 포함한다. 이때, 전류 제어신호는 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)와 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)를 포함한다.
상기 전류 조절부(310)는 제1 피모스 제어신호(CPM1) 및 제1 엔모스 제어신호(CNM1)에 의해 선택적으로 동작되는 제1 인버터 구동부(312), 제2 피모스 제어신 호(CPM2) 및 제2 엔모스 제어신호(CNM2)에 의해 선택적으로 동작되는 제2 인버터 구동부(314), 제3 피모스 제어신호(CPM3) 및 제3 엔모스 제어신호(CNM3)에 의해 선택적으로 동작되는 제3 인버터 구동부(316)를 포함한다.
상기 제2 인버터(300)는 제1 피모스 트랜지스터(PM1) 및 제1 엔모스 트랜지스터(NM1)를 포함하고, 제1 피모스 트랜지스터(PM1) 및 제1 엔모스 트랜지스터(NM1)는 게이트 단자가 공통 접속되고, 상기 게이트 단자가 제1 인버터(102)의 출력단자에 연결된다. 또한, 제1 피모스 트랜지스터(PM1)와 제1 엔모스 트랜지스터(NM)의 드레인 단자가 서로 연결되고, 상기 드레인 단자는 제2 커패시터(C2)의 타단에 연결된다.
상기 제1 인버터 구동부(312)는 게이트 단자를 통해 제1 피모스 제어신호(CPM1)를 입력받는 제2 피모스 트랜지스터(PM2)와 게이트 단자를 통해 제1 엔모스 제어신호(CNM1)를 입력받는 제2 엔모스 트랜지스터(NM2)를 포함한다. 상기 제2 피모스 트랜지스터(PM2)와 제2 엔모스 트랜지스터(NM2)는 드레인 단자가 서로 연결되고, 상기 드레인 단자는 제2 커패시터(C2)의 타단에 연결된다.
상기 제2 인버터 구동부(314)는 게이트 단자를 통해 제2 피모스 제어신호(CPM2)를 입력받는 제3 피모스 트랜지스터(PM3)와 게이트 단자를 통해 제2 엔모스 제어신호(CNM2)를 입력받는 제3 엔모스 트랜지스터(NM3)를 포함한다. 상기 제3 피모스 트랜지스터(PM3)와 제3 엔모스 트랜지스터(NM3)는 드레인 단자가 서로 연결되고, 상기 드레인 단자는 제2 커패시터(C2)의 타단에 연결된다.
상기 제3 인버터 구동부(316)는 게이트 단자를 통해 제3 피모스 제어신호(CPM3)를 입력받는 제4 피모스 트랜지스터(PM4)와 게이트 단자를 통해 제3 엔모스 제어신호(NM3)를 입력받는 제4 엔모스 트랜지스터(NM4)를 포함한다. 상기 제4 피모스 트랜지스터(PM4)와 제4 엔모스 트랜지스터(NM4)는 드레인 단자가 서로 연결되고, 상기 드레인 단자는 제2 커패시터(C2)의 타단에 연결된다.
이처럼 구성되는 제1 내지 제3 인버터 구동부(312,314,316)는 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3) 및 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)에 의해 선택적으로 구동되어 제2 내지 제4 충전전류(I2,I3,I4)의 출력이 조절됨에 따라 제2 커패시터(C2)의 타단에 인가되는 충전전류의 양을 조절한다.
또한, 도 4에 도시된 바와 같이, 구동버퍼 제어부(120)는 전압 감지부(110)의 제1 내지 제3 비교기(212,214,216)에서 출력되는 제1 내지 제3 감지신호(comp1,comp2,comp3)를 인버팅하는 제1 인버팅부(400), 제1 인버팅부(400)를 거치면서 인버팅된 제1 내지 제3 감지신호(comp1,comp2,comp3)에 의해 동작되어 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)를 출력하는 제1 제어신호 출력부(410), 제1 인버팅부(400)에서 인버팅된 제1 내지 제3 감지신호(comp1,comp2,comp3)를 다시 인버팅하는 제2 인버팅부(420), 제2 인버팅부(420)에서 다시 인버팅된 제1 내지 제3 감지신호(comp1,comp2,comp3)에 의해 동작되어 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)를 출력하는 제2 제어신호 출력부(430)를 포함한다.
상기 제1 인버팅부(400)는 제1 감지신호(comp1)를 인버팅하는 제3 내지 제5 인버터(IN3,IN4,IN5), 제2 감지신호(comp2)를 인버팅하는 제6 내지 제8 인버터(IN6,IN7,IN8), 제3 감지신호(comp3)를 인버팅하는 제9 내지 제11 인버터(IN9,IN10,IN11)를 포함한다.
이때, 제3 내지 제5 인버터(IN3,IN4,IN5)는 이전단의 인버터에 대하여 그 크기가 증가하여, 제1 감지신호(comp1)를 인버팅함과 동시에 제1 감지신호(comp1)를 증폭한다. 예를 들어, 제3 인버터(IN3)의 크기가 10이면, 제4 인버터(IN4)는 100의 크기를 가지고, 제5 인버터(IN5)는 1000의 크기를 갖는다. 이처럼, 제3 내지 제5 인버터(IN3,IN4,IN5)의 크기를 증가시켜 제1 감지신호(comp1)를 인버팅함과 동시에 증폭하는 이유는 구동버퍼부(130)의 동작신호 크기가 전압 감지부(110)에서 출력되는 제1 감지신호(comp1)보다 크기 때문이다.
또한, 제6 내지 제8 인버터(IN6,IN7,IN8)와 제9 내지 제11 인버터(IN9,IN10,IN11)는 제3 내지 제5 인버터(IN3,IN4,IN5)와 동일한 구성을 갖는다.
상기 제1 제어신호 출력부(410)는 제3 내지 제5 인버터(IN3,IN4,IN5)에 의해 인버팅된 제1 감지신호(comp1)와 제2 클럭신호(CLK2)를 입력받는 제1 낸드 게이트(NAND1), 제6 내지 제8 인버터(IN6,IN7,IN8)에 의해 인버팅된 제2 감지신호(comp2)와 제2 클럭신호(CLK2)를 입력받는 제2 낸드 게이트(NAND2), 제9 내지 제11 인버터(IN9,IN10,IN11)에 의해 인버팅된 제3 감지신호(comp3)와 제2 클럭신호(CLK2)를 입력받는 제3 낸드 게이트(NAND3)를 포함한다.
또한, 제1 제어신호 출력부(410)는 제1 낸드 게이트(NAND1)에서 출력되는 신 호를 인버팅하여 제1 엔모스 제어신호(CNM1)를 출력하는 제12 인버터(IN12), 제2 낸드 게이트(NAND2)에서 출력되는 신호를 인버팅하여 제2 엔모스 제어신호(CNM2)를 출력하는 제13 인버터(IN13), 제3 낸드 게이트(NAND3)에서 출력되는 신호를 인버팅하여 제3 엔모스 제어신호(CNM3)를 출력하는 제14 인버터(IN14)를 포함한다.
상기 제2 인버팅부(420)는 제1 인버팅부(400)의 제3 내지 제5 인버터(IN3,IN4,IN5)에서 순차적으로 인버팅된 제1 감지신호(comp1)를 다시 인버팅하는 제15 인버터(IN15), 제6 내지 제8 인버터(IN6,IN7,IN8)에서 순차적으로 인버팅된 제2 감지신호(comp2)를 다시 인버팅하는 제16 인버터(IN16), 제9 내지 제11 인터버(IN9,IN10,IN11)에서 인버팅된 제3 감지신호(comp3)를 다시 인버팅하는 제17 인버터(IN17)를 포함한다. 따라서, 제15 내지 제17 인버터(IN15,IN16,IN17)에서 출력되는 신호는 제1 내지 제3 감지신호(comp1,comp2,comp3)와 동일한 상태의 신호이다.
상기 제2 제어신호 출력부(430)는 제2 인버팅부(420)의 제15 인버터(IN15)에 의해 다시 인버팅된 제1 감지신호(comp1)와 제2 클럭신호(CLK2)를 입력받는 제1 노어 게이트(NOR1), 제16 인버터(IN16)에 의해 다시 인버팅된 제2 감지신호(comp2)와 제2 클럭신호(CLK2)를 입력받는 제2 노어 게이트(NOR2), 제17 인버터(IN17)에 의해 다시 인버팅된 제3 감지신호(comp3)와 제2 클럭신호(CLK2)를 입력받는 제3 노어 게이트(NOR3)를 포함한다.
또한, 제2 제어신호 출력부(430)는 제1 노어 게이트(NOR1)에서 출력되는 신호를 인버팅하여 제1 엔모스 제어신호(CNM1)를 출력하는 제18 인버터(IN18), 제2 노어 게이트(NOR2)에서 출력되는 신호를 인버팅하여 제2 엔모스 제어신호(CNM2)를 출력하는 제19 인버터(IN19) 및 제3 노어 게이트(NOR3)에서 출력되는 신호를 인버팅하여 제3 엔모스 제어신호(CNM3)를 출력하는 제20 인버터(IN20)를 포함한다.
상기의 구동버퍼 제어부(120)는 전압 감지부(110)에 의해 감지된 제2 전압(V2)의 레벨이 미리 설정된 기준레벨보다 낮아지면, 제2 전압(V2)을 높이는 방향으로, 제2 전압(V2)의 레벨이 기준레벨보다 높아지면, 제2 전압(V2)을 낮추는 방향으로 전류제어신호 즉, 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3) 및 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)를 출력하는 전압 안정화 동작을 수행한다.
한편, 주파수 체배부(140)는 제1 클럭신호(CLK1)의 주파수를 조절 즉, 주파수를 높게 하여 승압전압 출력부(100)에서 생성된 제2 전압(V2)의 리플을 감소시킨다.
이와 같이 구성되는 본 발명의 일 실시예에 따른 승압전압 생성장치의 동작을 상세히 설명하면 다음과 같다.
먼저, 제1 전압(V1)의 승압 전압인 제2 전압(V2) 생성동작을 설명한다.
제1 인버터(102)는 외부로부터 입력되는 제1 클럭신호(CLK1)를 인버팅시켜 제2 클럭신호(CLK2)를 출력한다. 제2 커패시터(C2)는 제2 클럭신호(CLK2)의 하이 구간에서 제1 전압(V1)에 상응하는 전하를 충전한다. 이때, 구동버퍼부(130) 내의 제2 인버터(300)의 제1 엔모스 트랜지스터(NM1)는 턴온되고, 스위치 트랜지스터(104)는 턴오프된다.
이어, 제2 클럭신호(CLK2)의 로우 구간에서 제1 피모스 트랜지스터(PM1)가 턴온되고, 그에 따라 제2 커패시터(C2)는 제1 전압(V1)의 2배 레벨인 제2 전압(V2)에 상응하는 전하가 충전된다. 이때, 스위치 트랜지스터(104)는 게이트 단자에 로우 신호가 인가됨에 따라 턴온되고, 제2 커패시터(C2)는 충전된 전하 제2 전압(V2)이 턴온된 스위치 트랜지스터(104)를 통해 출력단(output)으로 출력된다.
상기의 동작에 의해 생성된 제2 전압(V2)의 출력 안정화 동작을 설명한다.
상기 제2 전압(V2)은 출력단(output)에 접속된 로드 커패시터(Cload)의 영향에 의해 그 레벨이 변화된다.
전압 감지부(110)의 제1 내지 제3 비교기(212,214,216)는 제2 전압(V2)과 밴드갭 기준신호(Vref)를 비교하고, 그에 따른 제1 내지 제3 감지신호(comp1,comp2,comp3)를 출력한다.
즉, 제1 비교기(212)는 제2 전압(V2)이 제1 저항(R1)과 제2 저항(R2), 제3 저항(R3), 제4 저항(R4)에 의해 분배된 제1 분배전압(Vd1)과 밴드갭 기준신호(Vref)를 비교하여 제1 감지신호(comp1)를 출력하고, 제2 비교기(214)는 제1 분배전압(Vd1)이 제1 저항(R1), 제2 저항(R2)과 제3 저항(R3), 제4 저항(R4)에 의해 분배된 제2 분배전압(Vd2)과 밴드갭 기준신호(Vref)를 비교하여 제2 감지신호(comp2)를 출력한다. 또한, 제3 비교기(216)는 제2 분배전압(Vd2)이 제1 저항(R1), 제2 저항(R2), 제3 저항(R3)과 제4 저항(R4)에 의해 분배된 제3 분배전압(Vd3)과 밴드갭 기준전압(Vref)을 비교하여 제3 감지신호(comp3)를 출력한다.
여기서, 본 발명의 일 실시예에서 생성하고자 하는 제2 전압(V2)이 5V인 경우, 제1 내지 제3 비교기(212,214,216)는 표 1에서와 같은 제1 내지 제3 감지신호(comp1,comp2,comp3)를 출력한다.
비교신호 제2전압 |
COMP1 |
COMP2 |
COMP3 |
V2<5.029V |
0 |
0 |
0 |
5.029V<V2<5.075V |
1 |
0 |
0 |
5.075V<V2<5.12V |
1 |
1 |
0 |
5.12V<V2 |
1 |
1 |
1 |
상기 표 1에 나타난 바와 같이, 제2 전압(V2)이 5.029V 이하인 경우에는 제1 내지 제3 비교기(212,214,216)에서 출력되는 제1 내지 제3 감지신호(comp1,comp2,comp3)는 모두 '0'이다.
한편, 제2 전압(V2)이 5.029V보다 크고, 5.075V보다 작은 경우에는 제1 비교기(212)에서 출력되는 제1 감지신호(comp1)는 '1'이고, 제2 비교기(214) 및 제3 비교기(216)에서 출력되는 제2 및 제3 감지신호(comp2,comp3)는 '0'이다.
또한, 제2 전압(V2)이 5.075V보다 크고, 5.12V보다 작은 경우에는 제1 및 제2 비교기(212,214)에서 출력되는 제1 및 제2 감지신호(comp1,comp2)는 '1'이고, 제3 비교기(216)에서 출력되는 제3 감지신호(comp3)는 '0'이다.
또한, 제2 전압(V2)이 5.12V보다 큰 경우에는 제1 내지 제3 비교기(212,214,216)에서 출력되는 제1 내지 제3 비교신호(comp1,comp2,comp3)는 모두 '1'이다.
구동버퍼 제어부(120)는 전압 감지부(110)로부터 입력되는 제1 내지 제3 감지신호(comp1,comp2,comp3)에 상응하는 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3) 및 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)를 구동버퍼부(130)로 출력한다.
제1 내지 제3 감지신호(comp1,comp2,comp3)가 모두 '0'인 경우, 제1 인버팅부(400)에서 '1'로 인버팅되어 제1 내지 제3 낸드 게이트(NAND1,NAND2,NAND3)에 입력된다. 즉, 제1 감지신호(comp1)는 제3 내지 제5 인버터(IN3,IN4,IN5)에 의해 '1'로 인버팅되어 제1 제어신호 출력부(410)의 제1 낸드 게이트(NAND1)에 입력되고, 제2 감지신호(comp2)는 제6 내지 제8 인버터(IN6,IN7,IN8)에 의해 '1'로 인버팅되어 제2 낸드 게이트(NAND2)에 입력된다. 또한, 제3 감지신호(comp3)는 제9 내지 제11 인버터(IN9,IN10,IN11)에 의해 '1'로 인버팅되어 제3 낸드 게이트(NAND3)에 입력된다.
여기서, 제1 내지 제3 낸드 게이트(NAND1,NAND2,NAND3)는 제2 클럭신호(CLK2)의 하이 구간에서는 '0'을 출력하고, 제2 클럭신호(CLK2)가 로우 구간에서는 '1'을 출력한다. 이어, 제12 내지 제14 인버터(IN12,IN13,IN14)는 제1 내지 제3 낸드 게이트(NAND1,NAND2,NAND3)에서 '0'이 입력되는 경우, 모두 하이 상태 즉 '1'의 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)를 출력하고, 제1 내지 제3 낸드 게이트(NAND1,NAND2,NAND3)에서 '1'이 입력되는 경우, 모두 로우 상태 즉, '0'인 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)를 출력한다.
즉, 제12 내지 제14 인버터(IN12,IN13,IN14)에서 출력되는 제1 내지 제3 엔 모스 제어신호(CNM1,CNM2,CNM3)는 제2 클럭신호(CLK2)에 동기된다.
한편, 제2 인버팅부(420)는 제1 인버팅부(400)에서 모두 '1'로 인버팅된 제1 내지 제3 감지신호(comp1,comp2,comp3)를 다시 '0'으로 인버팅하여 제2 제어신호 출력부(430)로 출력한다. 즉, 제2 인버팅부(420)의 제15 인버터(IN15)는 '1'로 인버팅된 제1 감지신호(comp1)를 다시 '0'으로 인버팅하여 제2 제어신호 출력부(420)의 제1 노어 게이트(NOR1)로 출력하고, 제16 인버터(IN16)는 '1'로 인버팅된 제2 감지신호(comp2)를 다시 '0'으로 인버팅하여 제2 노어 게이트(NOR2)로 출력한다. 또한, 제17 인버터(IN17)는 '1'로 인버팅된 제3 감지신호(comp3)를 다시 '0'으로 인버팅하여 제3 노어 게이트(NOR3)로 출력한다.
여기서, 제1 내지 제3 노어 게이트(NOR1,NOR2,NOR3)는 제2 인버팅부(420)에서 입력되는 되는 제1 내지 제3 감지신호(comp1,comp2,comp3)가 모두 '0'인 경우, 제2 클럭신호(CLK2)의 하이 구간에서는 '0'을 출력하고, 제2 클럭신호(CLK2)가 로우 구간에서는 '1'을 출력한다. 이어, 제18 내지 제20 인버터(IN18,IN19,IN20)는 제1 내지 제3 노어 게이트(NOR1,NOR2,NOR3)에서 '0'이 입력되는 경우, 모두 하이 상태 즉 '1'의 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)를 출력하고, 제1 내지 제3 노어 게이트(NOR1,NOR2,NOR3)에서 '1'이 입력되는 경우, 모두 로우 상태 즉, '0'인 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)를 출력한다.
즉, 제18 내지 제20 인버터(IN18,IN19,IN20)에서 출력되는 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)는 제2 클럭신호(CLK2)에 동기된다.
또한, 제1 감지신호(comp1)가 '1'이고, 제2 및 제3 감지신호(comp2,comp3)가 '0'인 경우, 제1 인버팅부(400)의 제3 내지 제5 인버터(IN3,IN4,IN5)에 의해 인버팅된 제1 감지신호(comp1)는 '0'이 되어 제1 낸드 게이트(NAND1)에 입력된다. 또한, 제2 감지신호(comp2)는 제6 내지 제8 인버터(IN6,IN7,IN8)에 의해 '1'로 인버팅되어 제2 낸드 게이트(NAND2)에 입력되고, 제3 감지신호(comp3)는 제9 내지 제11 인버터(IN9,IN10,IN11)에 의해 '1'로 인버팅되어 제3 낸드 게이트(NAND3)에 입력된다.
여기서, 제1 낸드 게이트(NAND1)는 제2 클럭신호(CLK2)의 로우 및 하이 구간에서 항상 '1'을 출력하고, 제2 및 제3 낸드 게이트(NAND2,NAND3)는 제2 클럭신호(CLK2)의 하이 구간에서는 '0'을 출력하고, 제2 클럭신호(CLK2)의 로우 구간에서는 '1'을 출력한다. 따라서, 제12 인버터(IN12)는 제1 낸드 게이트(NAND1)로부터 입력되는 '1'을 인버팅하여 '0' 상태의 제1 엔모스 제어신호(CNM1)를 출력한다. 한편, 제13 및 제14 인버터(IN13,IN14)는 제2 및 제3 낸드 게이트(NAND2,NAND3)에서 '0'이 입력되는 경우, '1' 상태의 제2 및 제3 엔모스 제어신호(CNM2,CNM3)를 출력하고, 제2 및 제3 낸드 게이트(NAND2,NAND3)에서 '1'이 입력되는 경우, '0' 상태의 제2 및 제3 엔모스 제어신호(CNM2,CNM3)를 출력한다.
즉, 제12 인버터(IN12)에서 출력되는 제1 엔모스 제어신호(CNM1)는 제2 클럭신호(CLK2)에 무관하게 항상 '0' 상태 신호이고, 제13 및 제14 인버터(IN13,IN14)에서 출력되는 제2 및 제3 엔모스 제어신호(CNM2,CNM3)는 제2 클럭신호(CLK2)에 동기된다.
한편, 제1 감지신호(comp1)가 '1'이고, 제2 및 제3 감지신호(comp2,comp3)가 '0'인 경우, 제2 인버팅부(420)의 제15 인버터(IN15)는 제1 인버팅부(400)의 제3 내지 제5 인버터(IN3,IN4,IN5)에 의해 '0'으로 인버팅된 제1 감지신호(comp1)를 다시 '1'로 인버팅하여 제1 노어 게이트(NOR1)로 출력한다. 또한, 제16 인버터(IN16)는 제6 내지 제8 인버터(IN6,IN7,IN8)에 의해 '1'로 인버팅된 제2 감지신호(comp2)를 다시 '0'으로 인버팅하여 제2 노어 게이트(NOR2)로 출력하고, 제17 인버터(IN17)는 제9 내지 제11 인버터(IN9,IN10,IN11)에 의해 '1'로 인버팅된 제3 감지신호(comp3)를 다시 '0'으로 인버팅하여 제3 노어 게이트(NOR3)로 출력한다.
여기서, 제1 노어 게이트(NOR1)는 제2 클럭신호(CLK2)의 로우 구간 및 하이 구간에서 항상 '0'을 출력하고, 제2 및 제3 노어 게이트(NOR2,NOR3)는 제2 클럭신호(CLK2)의 하이 구간에서는 '0'을 출력하고, 로우 구간에서는 '1'을 출력한다. 이어, 제 18 인버터(IN18)는 제1 노어 게이트(NOR1)로부터 입력되는 '0'을 인버팅하여 '1'의 제1 피모스 제어신호(CPM1)를 출력한다. 제19 및 제20 인버터(IN19,IN20)는 제2 및 제3 노어 게이트(NOR2,NOR3)로부터 '0 '이 입력되는 경우, '1'의 제2 및 제3 피모스 제어신호(CNM2,CNM3)를 출력하고, '1'이 입력되는 경우, '0'의 제2 및 제3 피모스 제어신호(CNM2,CNM3)를 출력한다.
즉, 제18 인버터(IN18)에서 출력되는 제1 피모스 제어신호(CPM1)는 제2 클럭신호(CLK2)에 무관하게 항상 '1'이고, 제19 및 제20 인버터(IN19,IN20)에서 출력되는 제2 및 제3 피모스 제어신호(CPM2,CPM3)는 제2 클럭신호(CLK2)에 동기된다.
상기의 동작에서와 같이, 제1 내지 제3 감지신호(comp1,comp2,comp3)가 각각 '1,1,0'인 경우, 제1 및 제2 엔모스 제어신호(CNM1,CNM2)는 제2 클럭신호(CLK2)에 무관하게 항상 '0' 상태신호이고, 제3 엔모스 제어신호(CNM3)는 제2 클럭신호(CLK2)에 동기된다. 또한, 제1 및 제2 피모스 제어신호(CPM1,CPM2)는 제2 클럭신호(CLK2)에 무관하게 항상 '1' 상태신호이고, 제3 피모스 제어신호(CPM3)는 제2 클럭신호(CLK2)에 동기된다.
한편, 제1 내지 제3 감지신호(comp1,comp2,comp3)가 각각 '1,1,1'인 경우, 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)는 '0'이고, 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)는 '1'이다.
전류제어신호 CMP1,2,3 |
CNM1 |
CNM2 |
CNM3 |
CPM1 |
CPM2 |
CPM3 |
0,0,0 |
CLK2 |
1,0,0 |
0 |
CLK2 |
1 |
CLK2 |
1,1,0 |
0 |
0 |
CLK2 |
1 |
1 |
CLK2 |
1,1,1 |
0 |
0 |
0 |
1 |
1 |
1 |
상기의 표 2에 나타난 바와 같이, 제1 내지 제3 감지신호(comp1,comp2,comp3)가 모두 '0'인 경우, 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)와 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)는 제2 클럭신호(CLK2)에 동기된다.
한편, 제1 감지신호(comp1)가 '1'이고, 제2 및 제3 감지신호(comp2,comp3)가 '0'인 경우, 제1 엔모스 제어신호(CNM1)는 '0'이고, 제1 피모스 제어신호(CPM1)는 '1'이며, 그 외의 제2 및 제3 엔모스 제어신호(CNM2,CNM3)와 제2 및 제3 피모스 제어신호(CPM2,CPM3)는 제2 클럭신호(CLK2)에 동기된다.
또한, 제1 및 제2 감지신호(comp1,comp2)가 '1'이고, 제3 감지신호(comp3)가 '0'인 경우, 제1 및 제2 엔모스 제어신호(CNM1,CNM2)는 '0'이고, 제1 및 제2 피모스 제어신호(CPM1,CPM2)는 '1'이며, 제3 엔모스 제어신호(CNM3) 및 제3 피모스 제어신호(CPM3)는 제2 클럭신호(CLK2)에 동기된다.
또한, 제1 내지 제3 감지신호(comp1,comp2,comp3)가 모두 '1'인 경우, 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)는 '0'이고, 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)는 '1'이다.
상기의 표 2에서와 같이 입력되는 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3) 및 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)에 의해 구동버퍼부(130)의 제1 내지 제3 인버터 구동부(312,314,316)가 선택적으로 동작되어 제2 커패시터(C2)의 타단으로 인가되는 충전 전류량이 조절된다.
하기의 표 3에 나타난 바와 같이, 제2 전압(V2)이 5.029V보다 작은 경우에는 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3) 및 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)가 제2 클럭신호(CLK2)에 동기되므로, 제2 클럭신호(CLK2)의 로우 구간에서 제1 내지 제3 인버터 구동부(312,314,316)의 제2 내지 제4 피모스 트랜지스터(PM2,PM3,PM4)가 턴온되고, 제2 내지 제4 엔모스 트랜지스터(NM2,NM3,NM4)가 턴오프된다. 이때, 제2 인버터(300)의 제1 피모스 트랜지스터(PM1)도 턴온되고, 제1 엔모스 트랜지스터(NM1)도 턴오프된다.
따라서, 제2 커패시터(C2)에는 제2 인버터(300)와 제1 내지 제3 인버터 구동부(312,314,316)에서 출력되는 제1 내지 제4 충전전류(I1,I2,I3,I4)가 모두 인가된다.
트랜지스터 제2 전압 |
CNM1 |
CNM2 |
CNM3 |
CPM1 |
CPM2 |
CPM3 |
V2<5.029V |
CLK2 |
5.029V<V2<5.075V |
0 |
CLK2 |
CLK2 |
1 |
CLK2 |
CLK2 |
5.075V<V2<5.12V |
0 |
0 |
CLK2 |
1 |
1 |
CLK2 |
5.12V<V2 |
0 |
0 |
0 |
1 |
1 |
1 |
한편, 제2 전압(V2)이 5.029V보다 크고, 5.075V보다 작은 경우, 제1 엔모스 제어신호(CNM1)는 '0' 상태 신호이고, 제1 피모스 제어신호(CPM1)는 '1' 상태 신호이다. 또한, 제2 및 제3 엔모스 제어신호(CNM2,CNM3)와 제2 및 제3 피모스 제어신호(CPM2,CPM3)는 제2 클럭신호(CLK2)에 동기된다. 따라서, 제1 인버터 구동부(312)의 제2 피모스 트랜지스터(PM2) 및 제2 엔모스 트랜지스터(NM2)는 제2 클럭신호(CLK2)에 무관하게 턴오프 상태이고, 제2 및 제3 인버터 구동부(314,316)의 제3 및 제4 피모스 트랜지스터(PM3,PM4)는 제2 클럭신호(CLK2)의 로우 구간에서 턴온된다. 이때, 제2 인버터(300)의 제1 피모스 트랜지스터(PM1)도 턴온된다.
그러므로, 제2 커패시터(C2)에는 제2 인버터(300)와 제2 및 제3 인버터 구동부(314,316)에 의한 제1 내지 제3 충전전류(I1,I2,I3)만 인가되고, 제1 인버터 구동부(312)에 의한 제4 충전전류(I4)는 인가되지 않아, 제2 전압(V2)의 레벨이 감소된다.
또한, 제2 전압(V2)이 5.075V보다 크고, 5.12V보다 작은 경우, 제1 및 제2 엔모스 제어신호(CNM1,CNM2)는 '0' 상태신호이고, 제1 및 제2 피모스 제어신호(CPM1,CPM2)는 '1' 상태신호이다. 또한, 제3 엔모스 제어신호(CNM3) 및 제3 피모스 제어신호(CPM3)는 제2 클럭신호(CLK2)에 동기되어 동작된다.
따라서, 제1 및 제2 인버터 구동부(312,314)의 제2 및 제3 엔모스 트랜지스터(NM2,NM3)와 제2 및 제3 피모스 트랜지스터(PM2,PM3)는 제2 클럭신호(CLK2)와 무관하게 항상 턴오프 상태를 유지하고, 제3 인버터 구동부(316)의 제4 피모스 트랜지스터(PM4)는 제2 클럭신호(CLK2)의 로우 구간에서 턴온된다. 이때, 제2 인버터(300)의 제1 피모스 트랜지스터(PM1)도 턴온된다.
그러므로, 제2 커패시터(C2)에는 제2 인버터(300)와 제3 인버터 구동부(316)에 의한 제1 및 제2 충전전류(I1,I2)만 인가되고, 제1 및 제2 인버터 구동부(312,314)에 의한 제3 및 제4 충전전류(I3,I4)는 인가되지 않아, 제2 전압(V2)의 레벨이 감소된다.
또한, 제2 전압(V2)이 5.12V보다 큰 경우, 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)는 '0' 상태신호이고, 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)는 '1' 상태신호이다. 따라서, 제1 내지 제3 인버터 구동부(312,314,316)의 제2 내지 제4 피모스 트랜지스터(PM2,PM3,PM4) 및 제2 내지 제4 엔모스 트랜지스터(NM2,NM3,NM4)는 제2 클럭신호(CLK2)에 무관하게 턴오프 상태이다. 한편, 제2 클럭신호(CLK2)의 로우 구간에서 제2 인버터(300)의 제1 피모스 트랜지스터(PM1)는 턴온된다.
그러므로, 제2 커패시터(C2)에는 제2 인버터(300)에 의한 제1 충전전류(I1) 만이 인가되고, 제1 내지 제3 인버터 구동부(312,314,316)에 의한 제2 내지 제4 충전전류(I2,I3,I4)는 인가되지 않는다.
이처럼, 제2 전압(V2)이 소정의 전압 레벨 예를 들어, 5V보다 증가하는 범위 에 따라 제1 내지 제3 인버터 구동부(312,314,316)를 선택적으로 동작시켜, 제2 커패시터(C2)에 인가되는 충전 전류량을 조절하여 제2 전압(V2)의 레벨을 일정하게 유지시킨다.
상기에서와 같이, 제2 내지 제4 피모스 트랜지스터(PM2,PM3,PM4)는 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)에 따라 순차적으로 턴온되거나 또는 턴오프되는데, 이를 서모미터 코드식으로 동작된다고 한다. 또한, 제2 내지 제4 엔모스 트랜지스터(NM2,NM3,NM4)는 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)에 따라 서모미터 코드식으로 동작된다.
한편, 주파수 체배부(140)는 제1 클럭신호(CLK1)의 주파수를 조절하여 승압 전압 생성부(100)에서 생성되는 제2 전압(V2)의 리플을 감소시킨다.
도 5는 클럭신호의 주파수 변화에 따른 제2 전압의 리플 변화를 나타낸 도면이다.
도 5에 도시된 바와 같이, (a)와 같은 주파수를 가지는 제1 클럭신호(CLK1)에 의해 생성되는 제2 전압(V2)은 (b)와 같다. 한편, 제1 클럭신호(CLK1)가 (c)와 같이 (a)에 비하여 주파수가 높아지면, 그에 따라 생성되는 제2 전압(V2)은 (d)와 같은 형태로 생성된다. 따라서, 제1 클럭신호(CLK1)에 의해 생성되는 제2 전압(V2)은 제1 클럭신호(CLK2)의 주파수가 높아질수록 (b)와 같은 리플의 진폭이 (d)에서와 같이 감소한다.
그러므로, 주파수 체배부(140)는 제1 클럭신호(CLK1)의 주파수를 높여서 제2 전압(V2)의 리플을 감소시킨다.
이와 같이 구성되어 동작되는 본 발명의 일 실시예에 따른 승압전압 생성장치에 의한 승압전압 생성방법을 첨부 도면을 참조하여 설명하면 다음과 같다.
도 6은 본 발명의 일 실시예에 따른 승압전압 생성방법을 수행하기 위한 플로우챠트이다.
먼저, 승압전압 생성부(100)는 제1 클럭신호(CLK1)가 인버팅된 제2 클럭신호(CLK2)의 하이 구간에서 제1 전압(V1)에 따른 차징(charging) 동작이 이루어지고, 그에 따라 생성된 제2 전압(V2)이 제2 클럭신호(CLK2)의 로우 구간에서 펌핑(pumping)되어 출력된다(S600).
이어, 전압 감지부(110)는 출력된 제2 전압(V2)을 감지하고, 감지된 제2 전압(V2)의 레벨 변동량에 따른 감지신호(comp1,comp2,comp3)를 출력하고(S610), 구동버퍼 제어부(120)는 감지신호(comp1,comp2,comp3)에 따른 전류 제어신호(CNM1~CNM3,CPM1~CPM3)를 출력한다(S620).
구동버퍼부(130)는 위의 단계(S620)에서 출력된 전류 제어신호(CNM1~CNM3,CPM1~CPM3)에 따라 제1 내지 제3 인버터 구동부(312,314,316)의 동작이 선택적으로 이루어져 충전 전류량이 조절된다(S630).
위의 단계(S630)에서 충전 전류양이 조절됨에 따라 출력되는 제2 전압(V2)의 레벨이 일정하게 유지된다.
도 7은 도 6에 도시된 감지동작 및 충전 전류량 조절 동작을 보다 상세하게 나타낸 플로우챠트이다.
먼저, 전압 감지부(110)는 제2 전압(V2)을 감지한다(S700).
위의 단계(S700)에서 감지된 제2 전압(V2)이 5.029V보다 작은지를 비교하고(S702), 제2 전압(V2)이 5.029V보다 작은 경우, 전압 감지부(110)는 '0' 상태인 제1 내지 제3 감지신호(comp1,comp2,comp3)를 출력한다(S704).
한편, 감지된 제2 전압(V2)이 5.029V보다 크고 5.075V보다 작은 경우(S706), 전압 감지부(110)는 '1' 상태의 제1 감지신호(comp1)와 '0' 상태의 제2 및 제3 감지신호(comp2,comp3)를 출력한다(S708).
또한, 감지된 제2 전압(V2)이 5.075V보다 크고 5.12V보다 작은 경우(S710), 전압 감지부(110)는 '1' 상태의 제1 및 제2 감지신호(comp1,comp2)와 '0' 상태의 제3 감지신호(comp3)를 출력한다(S712).
또한, 감지된 제2 전압(V2)이 5.12V보다 큰 경우(S714), 전압 감지부(110)는 '1' 상태의 제1 내지 제3 감지신호(comp1,comp2,comp3)를 출력한다(S716).
위의 단계(S704)에서 '0' 상태의 제1 내지 제3 감지신호(comp1,comp2,comp3)가 출력되는 경우, 구동버퍼 제어부(120)는 제2 클럭신호(CLK2)에 동기되는 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3) 및 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)를 출력한다(S718).
한편, 위의 단계(S708)에서 '1' 상태의 제1 감지신호(comp1)와 '0' 상태의 제2 및 제3 감지신호(comp2,comp3)가 출력되는 경우, 구동버퍼 제어부(120)는 '0' 상태의 제1 엔모스 제어신호(CNM1), '1' 상태의 제1 피모스 제어신호(CPM1), 제2 클럭신호(CLK2)에 동기되는 제2 및 제3 엔모스 제어신호(CNM2,CNM3)와 제2 및 제3 피모스 제어신호(CPM2,CPM3)를 출력한다(S720).
위의 단계(S712)에서 '1' 상태의 제1 및 제2 감지신호(comp1,comp2)와 '0' 상태의 제3 감지신호(comp3)가 출력되는 경우, 구동버퍼 제어부(120)는 '0' 상태의 제1 및 제2 엔모스 제어신호(CNM1,CNM2), '1' 상태의 제1 및 제2 피모스 제어신호(CPM1,CPM2), 제2 클럭신호(CLK2)에 동기되는 제3 엔모스 제어신호(CNM3)와 제3 피모스 제어신호(CPM3)를 출력한다(S721).
위의 단계(S716)에서 '1' 상태의 제1 내지 제3 감지신호(comp1,comp2,comp3)가 출력되는 경우, 구동버퍼 제어부(120)는 '0' 상태의 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)와 '1' 상태의 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)를 출력한다(S722).
이어, 위의 단계(S718)에서 제2 클럭신호(CLK2)에 동기되는 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3) 및 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)가 출력되는 경우, 구동버퍼부(130)의 제2 인버터(300) 및 제1 내지 제3 인버터 구동부(312,314,316)에 의한 제1 내지 제4 충전전류(I1,I2,I3,I4)가 모두 제2 커패시터(C2)에 인가한다(S723).
한편, 위의 단계(S720)에서 '0' 상태의 제1 엔모스 제어신호(CNM1), '1' 상태의 제1 피모스 제어신호(CPM1), 제2 클럭신호(CLK2)에 동기되는 제2 및 제3 엔모스 제어신호(CNM2,CNM3)와 제2 및 제3 피모스 제어신호(CPM2,CPM3)를 출력되는 경우, 구동버퍼부(130)의 제2 인버터(300)와 제2 및 제3 인버터 구동부(314,316)에 의한 제1 내지 제3 충전전류(I1,I2,I3)만이 제2 커패시터(C2)에 인가된다(S724).
위의 단계(S721)에서 '0' 상태의 제1 및 제2 엔모스 제어신호(CMN1,CNM2), '1' 상태의 제1 및 제2 피모스 제어신호(CPM1,CPM2), 제2 클럭신호(CLK2)에 동기되는 제3 엔모스 제어신호(CNM3)와 제3 피모스 제어신호(CPM3)를 출력되는 경우, 구동버퍼부(130)의 제2 인버터(300)와 제3 인버터 구동부(316)에 의한 제1 및 제2 충전전류(I1,I2)만이 제2 커패시터(C2)에 인가된다(S724).
또한, 위의 단계(S722)에서 '0' 상태의 제1 내지 제3 엔모스 제어신호(CNM1,CNM2,CNM3)와 '1' 상태의 제1 내지 제3 피모스 제어신호(CPM1,CPM2,CPM3)를 출력되는 경우, 구동버퍼부(130)의 제2 인버터(300)에 의한 제1 충전전류(I1)만이 제2 커패시터(C2)에 인가된다(S726).
상술한 바와 같이, 제2 전압(V2)의 레벨이 커질수록 제2 커패시터(C2)에 인가되는 충전전류의 양이 적어지므로, 제2 전압(V2)의 레벨이 감소되는 폭이 증가하여, 제2 전압(V2)이 일정하게 유지된다.
본 발명에서는 구동버퍼부 내에 인버터 구동부가 3개 있는 경우를 예로 들어 설명하였으나 그보다 많거나 또는 적은 수로 구성할 수 있다. 예를 들어, 인버터 구동부가 2개 있는 경우에는 전압 감지부 내의 비교기가 2개이고, 인버터 구동부가 4개인 경우에는 4개의 비교기가 구성된다.
이처럼, 인버터 구동부의 구성 개수가 증가할수록 제2 전압의 출력변동을 보다 민감하게 감지하여 조절할 수 있으나, 승압전압 생성장치의 동작 효율이 감소되므로, 최적의 인버터 구동부의 개수는 3개가 가장 바람직하다.