KR100535351B1 - 박막 트랜지스터 액정표시장치 - Google Patents

박막 트랜지스터 액정표시장치 Download PDF

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Abstract

본 발명은 정전기에 의한 손상을 손쉽게 리페어할 수 있도록 한 박막트랜지스터 액정표시장치를 개시한다. 개시된 본 발명의 박막 트랜지스터 액정표시장치는, 절연막의 개재하에 수 개의 게이트라인들 및 데이터라인들이 수직 교차하도록 배열되어 있고, 상기 게이트라인과 데이터라인의 교차부에 인접된 부분에는 박막트랜지스터가 배치되어 있으며, 상기 한 쌍의 게이트라인들과 한 쌍의 데이터라인들에 의해 한정된 화소영역 내에는 화소전극이 배치된 박막트랜지스터 액정표시장치에 있어서, 상기 게이트라인은 데이터라인과 교차되는 부분에 정전기 방전 유도 홀이 구비된 것을 특징으로 한다.

Description

박막트랜지스터 액정표시장치{Thin film transistor liquid crystal display}
본 발명은 액정표시장치에 관한 것으로, 보다 상세하게는, 정전기 방전에 의한 손상을 손쉽게 리페어할 수 있는 박막 트랜지스터 액정표시장치에 관한 것이다.
텔레비젼 및 그래픽 디스플레이 등의 표시 장치에 이용되는 액정표시장치(Liquid Crystal Display: 이하, LCD)는 CRT(Cathode ray tube)를 대신하여 개발되어져 왔다.
특히, 매트릭스 형태로 배열된 각 화소에 스위칭 소자로서 박막트랜지스터(Thin Film Transistor; 이하, TFT)가 구비되는 TFT LCD는 고속 응답 특성을 갖는 잇점과 높은 화소수에 적합하다는 잇점 때문에 CRT에 필적할만한 표시화면의 고화질화, 대형화 및 컬러화 등을 실현하였다.
도 1은 상기한 TFT LCD를 개략적으로 도시한 평면도이다. 도시된 바와 같이, 유리기판(1) 상에 게이트라인(2) 및 보조용량전극라인(3)이 평행하게 소정 간격 이격되어 번갈아 배열되어 있으며, 상기 게이트라인(2) 및 보조용량전극라인(3)과 수직 교차되게 데이터라인(4)이 배치되어 있고, 상기 게이트라인(2)과 데이터라인(4)의 교차부에 인접된 부분에는 스위칭소자인 TFT(7)가 배치되어 있다.
그리고, 한 쌍의 게이트라인들(2)과 한 쌍의 데이터라인들(4)에 의해 한정된 화소영역에는 ITO로된 화소전극(8)이 배치되어 있으며, 이때, 화소 전극(8)은 드레인 전극(6)과 콘택된다.
한편, 도시되지는 않았지만, 게이트라인(2)과 데이터라인(6) 사이에는 그들간의 전기적 절연을 목적으로 게이트절연막이 도포되어 있다.
그러나, 종래의 TFT LCD는 그의 제조 공정 동안에 필연적으로 정전기 방전 (electrostatic discharge)이 발생하게 되며, 이러한 정전기 방전이 게이트라인 및 데이터라인들을 손상시키게 되고, 심한 경우에는, 도 2에 도시된 바와 같이, 게이트라인과 데이터라인의 교차점에서 쇼트(Short)를 유발시킴으로써, TFT LCD의 제조수율을 감소시키게 된다.
한편, 종래에는 정전기로 인한 제조수율의 감소를 방지하기 위하여 액정패널의 제조시에 리던던시 라인을 더 형성시킨 상태에서, 쇼트가 발생된 라인 부분은 레이저로 절단시키고, 나머지 부분을 상기 리던던시 라인에 연결시키는 리페어 공정을 실시하고 있다. 그러나, 이러한 방법은 공정이 복잡해짐은 물론 생산성을 저하시키게 되는 문제점이 있다.
따라서, 상기와 같은 종래의 문제점을 해결하기 위해 안출된 본 발명은, 정전기에 의한 손상에 대해서 보다 용이하게 리페어 공정을 실시할 수 있도록 한 TFT LCD를 제공함에 그 목적이 있다.
상기와 같은 목적을 달성하기 위하여, 본 발명은, 절연막의 개재하에 수 개의 게이트라인들 및 데이터라인들이 수직 교차하도록 배열되어 있고, 상기 게이트 라인과 데이터라인의 교차부에 인접된 부분에는 TFT가 배치되어 있으며, 상기 한 쌍의 게이트라인들과 한 쌍의 데이터라인들에 의해 한정된 화소영역 내에는 화소전극이 배치된 TFT LCD로서, 상기 게이트라인은 데이터라인과 교차되는 부분에 정전기 방전 유도 홀이 구비된 것을 특징으로 하는 TFT LCD를 제공한다.
본 발명에 따르면, 데이터라인과 교차되는 게이트라인 부분에 정전기 방전 유도 홀을 구비시켜 이 부분에서 정전기에 의한 손상이 발생하게 함으로써, 이후에 손상이 발생된 부분만을 절단시킴으로써, 별도의 리던던시 라인의 형성없이도 리페어 공정을 손쉽게 실시할 수 있다.
(실시예)
이하, 본 발명의 바람직한 실시예를 첨부된 도면을 참조하여 보다 상세하게 설명한다.
도 3 내지 도 4는 본 발명의 실시예에 따른 TFT LCD를 설명하기 위한 도면으로서, 도 3은 게이트라인 및 데이터라인이 형성된 TFT LCD의 하부기판을 개략적으로 도시한 도면이며, 도 4는 도 3의 Ⅳ-Ⅳ′선을 따라 절단한 단면도이다.
도 3을 참조하면, 유리기판 상에 게이트라인(20)과 데이터라인(30)을 형성함에 있어서, 상기 게이트라인(20)은 데이터라인(30)과 교차되는 부분에 정전기 방전유도 홀(11)을 구비시키고, 데이터라인(30)은 게이트라인(20)과 교차되는 부분이 다른 부분 보다 상대적으로 넓은 폭을 갖도록 형성한다.
이때, 정전기 방전 유도 홀(11)은 적어도 두 개 이상을 형성하며, 아울러, 게이트라인(20)과 교차되지 않는 데이터라인(30) 부분에 대하여 좌·우 대칭이 되도록 구비시킨다.
또한, 게이트라인(20)과 교차되는 데이터라인(30) 부분은 게이트절연막(도시안됨)의 개재하에 상기 게이트라인(20)에 구비된 정전기 방전 유도 홀(11)을 매립시키는 형태로 형성한다.
도 4는 은 도 3의 Ⅳ-Ⅳ′선을 따라 절단하여 나타낸 도면으로서, 도시된 바와 같이, 유리기판(10) 상에 정전기 방전 유도 홀(11)들이 구비된 게이트라인(20)을 형성하고, 상기 게이트라인(20)이 덮혀지도록 게이트절연막(25)을 도포하고, 이 상부에 상기 정전기 방전 유도 홀(11)들을 매립하는 형태로 데이터라인(30)을 형성한다.
통상, 정전기에 의한 손상, 예를들어, 쇼트는 상기 게이트라인과 데이터라인의 교차부에서 주로 발생되는 것이기 때문에, 상기와 같은 구조로 게이트라인 및 데이트 라인을 형성하는 경우에는 정전기 방전에 의한 쇼트가 종래 보다 4배 이상 발생될 확률이 많아지게 된다.
즉, 도시된 바와 같이, 게이트라인(20)과 데이터라인(30)이 게이트절연막(25)의 개재하에 대향하는 부분이 4곳이 되기 때문에 이러한 부분에서 정전기 방전에 의한 쇼트가 발생하게 된다.
그런데, 정전기에 의한 쇼트는 게이트라인(20)에 구비시킨 정전기 유도 홀(11)에 의해 이 부분에서 발생될 확률은 높아지게 되지만, 게이트라인(20)과 데이터라인(30)이 대향하고 있는 모든 부분에서 동시에 발생되지는 않게 된다.
따라서, 도 5에 도시된 바와 같이, 적어도 1곳 이상에서는 정전기에 의한 쇼트가 발생되지 않기 때문에 리페어 공정시에 쇼트가 발생된 곳만을 레이저로 절단시키게 되면, 별도의 리던던시 라인을 형성하지 않고도, 손쉽게 리페어 공정을 수행할 수 있게 된다.
도 5에서, 도면번호 40a는 쇼트 발생 영역이고, 40b는 쇼트가 발생되지 않은 쇼트 비발생 영역이다.
이상에서 설명된 바와 같이, 본 발명은 게이트라인을 형성함에 있어서 데이터라인과 교차되는 부분에 정전기 방전 유도 홀을 구비시키고, 아울러, 데이터라인은 상기 정전기 유도 홀을 매립시키는 형태로 형성함으로써, 리페어 공정시에 쇼트가 발생된 부분만을 절단시키는 방법으로 손쉽게 리페어 공정을 실시하기 때문에 TFT LCD의 생산성을 향상시킬 수 있다.
한편, 여기에서는 본 발명의 특정 실시예에 대하여 설명하고 도시하였지만, 당업자에 의하여 이에 대한 수정과 변형을 할 수 있다. 따라서, 이하, 특허청구의 범위는 본 발명의 진정한 사상과 범위에 속하는 한 모든 수정과 변형을 포함하는 것으로 이해할 수 있다.
도 1은 종래 박막트랜지스터 액정표시장치를 개략적으로 도시한 평면도.
도 2는 종래 정전기 방전에 의한 쇼트 발생을 설명하기 위한 도면.
도 3은 본 발명의 실시예에 따른 박막트랜지스터 액정표시장치를 개략적으로 도시한 평면도.
도 4는 도 3의 Ⅳ-Ⅳ′선을 따라 절단하여 나타낸 단면도.
도 5는 본 발명의 실시예에 따른 정전기 방전에 의한 쇼트 발생을 설명하기 위한 도면.
* 도면의 주요 부분에 대한 부호의 설명 *
10 : 유리기판 11 : 정전기 방전 유도 홀
20 : 게이트라인 25 : 게이트절연막
30 : 데이터라인

Claims (2)

  1. 절연막의 개재하에 수 개의 게이트라인들 및 데이터라인들이 수직 교차하도록 배열되어 있고, 상기 게이트라인과 데이터라인의 교차부에 인접된 부분에는 박막트랜지스터가 배치되어 있으며, 상기 한 쌍의 게이트라인들과 한 쌍의 데이터라인들에 의해 한정된 화소영역 내에는 화소전극이 배치된 박막트랜지스터 액정표시장치에 있어서,
    상기 게이트라인은 데이터라인과 교차되는 부분에 정전기 방전 유도 홀이 구비된 것을 특징으로 하는 박막트랜지스터 액정표시장치.
  2. 제 1 항에 있어서, 상기 정전기 방전 유도 홀은 적어도 두 개 이상이 구비된 것을 특징으로 하는 박막트랜지스터 액정표시장치.
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