KR100508964B1 - 플라즈마 표시장치의 서스테인 펄스 인가방법 - Google Patents

플라즈마 표시장치의 서스테인 펄스 인가방법 Download PDF

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Abstract

본 발명은 각 색상의 서스테인 기간을 독립적으로 조절하기 위해 특정 칼라 소거 펄스를 인가시켜 어드레스 전극이나 서스테인 전극에 인가되는 서스테인 펄스를 조절하여 화이트 밸런스를 맞추도록 한 플라즈마 표시장치의 서스테인 펄스 인가방법에 관한 것이다.
이를 위해, 본 발명은 각 서브 필드에 인가하는 신호 파형은 리셋 기간과 어드레스 기간과 서스테인 기간으로 나누어 그 중 리셋 기간과 어드레스 기간은 서브 필드마다 모두 동일하게 할당하나 서스테인 기간은 어드레스 기간에 표시되는 디지털 화상 데이터의 비트 가중치에 따라 서로 다르게 할당하되 각 서브 필드마다 R,G,B 각각의 휘도와 색좌표를 측정하여 서스테인 전극과 어드레스 전극에 화이트 밸런스가 맞는 서스테인 펄스의 개수에서 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라1 소거 펄스를 동기되게 인가함과 아울러 서스테인 전극과 어드레스 전극에 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라2 소거 펄스를 동기되게 인가한다.

Description

플라즈마 표시장치의 서스테인 펄스 인가방법
본 발명은 플라즈마 표시장치의 서스테인 펄스 인가방법에 관한 것으로, 특히 각 색상의 서스테인 기간을 독립적으로 조절하기 위해 특정 칼라 소거 펄스를 인가시켜 어드레스 전극이나 서스테인 전극에 인가되는 서스테인 펄스를 조절하여 화이트 밸런스(White balance)를 맞추도록 한 플라즈마 표시장치의 서스테인 펄스 인가방법에 관한 것이다.
주지와 같이 플라즈마 표시장치는 발광형 소자인 플라즈마 표시패널(PDP)을 포함하여 구성된 후 PDP 내부의 기체 방전 현상을 이용하여 동화상 또는 정지화상을 표시하는 평면 표시장치를 일컫는다.
상기 PDP는 도 1에 도시된 바와 같이, 화상의 표시면인 상부 유리기판(1)과, 상기 상부 유리기판(1)과 소정 거리를 사이에 두고 평행하게 위치한 하부 유리기판(2)과, 상기 상부 유리기판(1)과 하부 유리기판(2) 사이에 배열 형성되어 방전 공간을 형성하는 격벽(3)과, 상기 상부 유리기판(1) 중 하부 유리기판(2)과의 대향면에 상기 격벽(3)과 직교하도록 교대로 배열 형성된 스캔 전극(4) 및 공통 전극(5)(이하, "제 1, 2 서스테인 전극"이하 칭함)과, 상기 상부 유리기판(1) 중 하부 유리기판(2)과의 대향면 밑에 형성되어 방전시 방전 전류를 제한하는 유전층(6)과, 상기 각 격벽(3) 사이의 하부 유리기판(2) 중 상부 유리기판(1)과의 대향면에 상기 격벽(3)과 평행하게 형성되어 상기 제 1, 2 서스테인 전극(4,5)과 함께 방전을 일으키는 어드레스 전극(7)과, 상기 방전공간 내부의 하부 유리기판(2)과 격벽(3)과 어드레스 전극(7) 위에 각각 형성되어 각 셀의 방전시 적,녹,청(R,G,B)의 가시광을 각각 방출하는 형광층(8)으로 구성되어져 있다.
이와 같이 구성된 PDP는 전극 사이의 방전시 나오는 자외선에 형광체를 여기시켜 가시광을 발생시키는데 이러한 방전 원리를 도 1 내지 도 3을 참조하여 설명하면 다음과 같다.
먼저, 화소의 계조를 구현하는데 있어서 CRT는 전자 빔의 세기를 이용하여 밝기를 조절할 수 있지만 PDP는 방전의 강약 조정이 난이하여 단위 시간당 방전 회수를 통해 계조를 구현한다.
그리고, 하나의 화소는 R,G,B 세 개의 방전 셀로 이루어는데 256 계조의 경우 매 프레임마다 각 방전 셀의 방전 회수를 0∼255회로 나누어 방전시키면 방전 회수에 따라 밝기가 달라져 256 계조가 구현된다.
이때, 각 셀의 내부에서 선택적으로 일어나는 방전의 종류로는 최초의 방전을 위한 어드레스 방전과 방전 셀의 방전을 유지시키는 서스테인 방전 및 방전 셀의 유지를 멈추게하는 소거 방전으로 이루어진다.
여기서, 하부 유리기판(2)의 어드레스 전극(7)과 상부 유리기판(1)의 서스테인 전극(4,5)간의 어드레스 방전으로 방전 공간 내부에 이전에 없던 벽전하가 제 1, 2 서스테인 전극(4,5) 근처의 유전층(6)에 형성되고, 상부 유리기판(1)의 제 1, 2 서스테인 전극(4,5) 간의 서스테인 방전으로 유지된다.
일예로, 각 전극(4,5,7)에 도 2에 도시된 구동 파형이 인가될 때 (가) 내지 (아)지점에서 벽전하의 진행 상태는 도 3에 도시된 (가) 내지 (아)상태를 나타낸다.
상술하면, (가)상태 이전에는 방전 셀에 벽전하는 없는 상태이다. (가)지점에서 어드레스 전극(7)과 제 1 서스테인 전극(4)사이에서 어드레스 방전이 일어나면 (나)지점에서 어드레스 방전후 셀 내부에 벽전하가 형성된다.
이때, 벽전하의 대부분은 제 1, 2 서스테인 전극(4,5)에 형성된다. 어드레스 전극(7)에 가해지는 써넣기 펄스는 2㎲이상의 폭을 가지며, 이는 벽전하를 형성하기 위한 시간이 된다.
그리고, (다)지점에서 제 1, 2 서스테인 전극(4,5)사이에 서스테인 방전이 일어나고, (라)지점에서 서스테인 방전후 벽전하는 (나)지점에서 나타난 벽전하가 반대로 형성된 것으로 나타난다.
이때, 각 전극(4,5,7)의 서스테인 전압 차이는 어드레스 전극(7)과 제 1 서스테인 전극(4)사이의 써넣기 전압 차이보다 낮은 전압을 사용할 수 있다. 이는 유전층(6)에 형성된 벽전하 때문이다. 이것이 바로 메모리 효과이며, 벽전하가 형성되어 있지 않은 셀에서는 서스테인 방전이 일어나지 않는다.
이후의, (마)지점과 (바)지점은 서스테인 펄스에 의한 서스테인 방전을 나타내며, 벽전하는 (라)지점의 반대가 된다.
따라서, 한 서스테인 주기는 (다)지점에서 (바)지점까지이고, 한 서스테인 주기 동안 방전 회수는 2회가 된다.
아울러, 소거 방전은 (사)지점에서 일어나고, 소거 방전은 펄스 폭이 1㎲이하이며, 펄스 높이도 서스테인 전압보다 낮다. 이 펄스에 의해 제 1, 2 서스테인 전극(4,5)간은 방전을 일으키나 벽전하를 형성할 시간이 없어 (아)지점에서 벽전하가 없는 셀이되고, 이 벽전하가 없는 셀에는 서스테인 펄스를 가해도 방전이 일어나지 않는다.
도 4는 상기와 같은 방전 원리를 이용한 일반적인 플라즈마 표시장치의 블록 구성도를 나타낸 것으로서, 640개의 R, G, B 어드레스 전극라인(R1, G1, B1, …, R640, G640, B640)과 480개의 제 1, 2 서스테인 전극라인쌍(S1, S2, …, S479, S480)을 구비한 PDP(10)와, 외부에서 입력되는 R, G, B 화상 데이터를 디지털화하여 8비트의 R, G, B 디지털 화상 데이터(256 계조 구현)를 출력함과 아울러 상기 디지털 화상 데이터와 외부신호에 따라 PDP(10)의 구동에 필요한 각종 제어신호를 출력하는 마이컴(20)과, 상기 마이컴(20)의 제어신호에 따라 480개의 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 스캔(scan) 펄스를 공급하여 1개 라인씩 순차적으로 주사한 다음 모든 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 서스테인(sustain) 펄스를 공급하여 각 셀의 방전 및 발광을 유지시키는 스캐닝 및 서스테인 구동부(30)와, 상기 마이컴(20)에서 출력되는 R, G, B 디지털 화상 데이터를 프레임별, 컬러별, 비트별로 저장하는 메모리부(40)와, 상기 스캐닝 및 서스테인 구동부(30)에 의해 주사되는 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 대응되는 640개의 R, G, B 디지털 화상 데이터의 비트값을 상기 메모리부(40)로부터 읽어 들여 640개의 R, G, B 어드레스 전극라인(R1∼B640)에 공급하는 어드레스 구동부(50)로 구성되어져 있다.
상기 스캐닝 및 서스테인 구동부(30)는 상기 마이컴(20)의 제어신호에 따라 클록 신호(CLK)와 데이터 신호(DO)를 발생시켜 출력하는 클록 및 데이터 발생부(31)와, 상기 마이컴(20)의 제어신호에 따라 서스테인 펄스를 발생시켜 출력하는 서스테인 펄스 발생부(32)와, 480개 제 1, 2 서스테인 전극라인쌍(S1∼S480)과 연결된 상태에서 상기 클록 신호(CLK)와 데이터 신호(DO)와 서스테인 펄스에 따라 480개 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 순차적으로 스캔 펄스를 공급한 후 서스테인 펄스를 동시에 공급하는 구동 IC(Integrated Circuit, 33)로 구성되어져 있다.
상기와 같이 구성된 플라즈마 표시장치가 여러 구동방식 중 하나인 ADS 서브 필드(Addressing-Display-Separating sub-field) 방식에 따라 패널 상에 256 계조의 화상을 표시하는 과정을 도 1 내지 도 4를 참조하여 설명하면 다음과 같다.
ADS 서브 필드 방식은 2X 계조의 구현을 위하여 1 프레임 화면을 X개의 서브 필드 화면으로 나누어 표시하고, 외부에서 입력되는 화상 데이터를 X비트의 디지털 화상 데이터(최하위 B1 ∼ 최상위 BX)로 디지털화하여 패널에 공급하는 방식이다.
그리고, 각 서브 필드 화면은 리셋 기간과 어드레스 기간과 서스테인 기간으로 구성되는데, 그 중 리셋 기간과 어드레스 기간은 서브 필드마다 모두 동일하게 할당되어 있으나 서스테인 기간은 어드레스 기간에 표시되는 디지털 화상 데이터의 비트 가중치에 따라 서로 다르게 할당되어 있어 각 서브 필드의 조합으로(눈의 적분효과를 이용함) 화상의 계조 구현이 가능하게 된다.
즉, 한 프레임을 8개의 서브 필드(SF1∼SF8)로 나눈 후 각 서브 필드(SF1∼SF8)의 서스테인 기간은 20: 21: 22: … 2X-2: 2X-1의 비율로 할당된다.
따라서, 마이컴(20)은 256 계조의 구현을 위하여 외부에서 입력되는 R, G, B 화상 데이터를 디지털화하여 8비트의 R, G, B 디지털 화상 데이터(최하위 비트값 B1 ∼ 최상위 비트값 B8)를 출력하고, 상기 디지털 화상 데이터와 외부신호에 따라 PDP(10)의 구동에 필요한 각종 제어신호를 출력한다.
이 때, 상기 마이컴(20)에서 출력되는 8비트의 R, G, B 디지털 화상 데이터는 메모리부(40)에 프레임별, 컬러별, 비트별로 저장된다.
그 후, 제 1 내지 8 서브필드 화면(SF1∼SF8)의 리셋 기간과 어드레스 기간에는 구동 IC(33)가 전체 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 1 단계로 이전의 필드에 생성된 벽전하를 제거하는 소거 펄스, 2 단계로 패널(10) 전체에 균등한 벽전하를 형성하기 위한 써넣기(write) 펄스, 3 단계로 다시 소거 펄스를 공급하여 640개의 R, G, B 어드레스 전극라인(R1∼B640) 위에 벽전하를 형성시켜 이후에 공급되는 어드레스 방전 전압이 낮아지도록 하고, 4 단계로 클록 신호(CLK)와 데이터 신호(DO)와 서스테인 펄스에 따라 480개의 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 순차적으로 1개 라인씩 스캔 펄스가 공급되면 480개 제 1, 2 서스테인 전극라인쌍(S1∼S480)의 주사가 완료된다.
아울러, 상기 4 단계의 스캔 펄스 공급시 어드레스 구동부(50)는 스캔 펄스가 공급되어 주사되는 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 대응되는 어드레스 펄스(R, G, B 디지털 화상 데이터의 1 비트값)를 상기 스캔 신호와 동기화하여 640개의 R, G, B 어드레스 전극라인(R1∼B640)에 각각 공급함으로써 상기 어드레스 펄스로 논리 "하이(high)" 가 공급된 각 셀의 방전공간 내부에서 방전이 일어나도록 한다.
이 때, 상기 어드레스 구동부(50)는 각 셀에 대응되는 8비트의 R, G, B 디지털 화상 데이터(B1∼B8)를 B1→SF1, B2→SF2, … B7→SF7, B8→SF8 에 각각 공급한다.
한편, 각 서브필드 화면(SF1∼SF8)의 어드레스 기간이 완료되면 구동 IC(33)는 서스테인 펄스 발생부(32)로부터 서스테인 펄스를 입력받아 전체 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 SF1: SF2: … SF7: SF8 = 20: 21: … 26: 27 (휘도 상대비)에 비례하는 개수의 서스테인 펄스를 공급하여 어드레스 기간에서 방전이 일어난 일부 셀의 방전 및 발광이 서스테인 펄스가 공급되는 기간(서스테인 기간) 동안 유지되도록 한다.
상기와 같은 과정을 거쳐 제 1 내지 8 서브필드 화면(SF1∼SF8)의 구성이 완료되면 PDP(10)에 256 계조의 화상이 표시된다.
그러나, 이와 같은 종래 플라즈마 표시장치의 구동방식에서는 R,G,B 모두 같이 서스테인되므로 서스테인 펄스의 개수로 화이트 밸런스를 맞출수가 없었다.
따라서, 룩업 테이블(Lookup table)을 사용하거나 형광체를 바꾸는 방법을 사용할 수 밖에 없었는데 룩업 테이블을 사용할 경우에는 표현할 수 있는 색이 적어졌으며 형광체를 바꾸는 경우에는 미세한 조정을 할 수 없게 될 뿐만 아니라 각 세트(Set)마다의 차이 즉, 형광제의 도포 두께나 전극의 차이로 인한 구동 전압의 변화로 정확한 R: G: B의 밝기 비율을 맞추기 어려운 문제점이 있었다.
따라서 본 발명은 상기한 종래 기술의 문제점을 해결하기 위해 제안한 것으로서, 각 색상의 서스테인 기간을 독립적으로 조절하기 위해 특정 칼라 소거 펄스를 인가시켜 어드레스 전극이나 제 1, 2 서스테인 전극에 인가되는 서스테인 펄스를 조절하여 화이트 밸런스를 맞추도록 한 플라즈마 표시장치의 서스테인 펄스 인가방법을 제공하는데 그 목적이 있다.
이러한 목적을 달성하기 위한 본 발명에 의한 플라즈마 표시장치의 구동방법은, 서브 필드 구동방식에서 각 서브 필드마다 색신호 각각의 휘도와 색좌표를 측정하여 서스테인 전극에 서스테인 펄스를 인가하되 서스테인 전극과 어드레스 전극에 상호 위상은 반대이고 동기되는 적어도 한 쌍 이상의 특정 칼라 소거 펄스를 인가시켜 해당 색신호의 서스테인 기간을 독립적으로 조절하여 색신호의 비율을 조절하는 것을 그 기술적 수단으로 한다.
이하, 본 발명을 첨부한 도면에 의거하여 설명하면 다음과 같다.
도 5는 본 발명의 일실시예에 의한 플라즈마 표시장치의 서스테인 펄스 인가방법에 따라 각 전극에 인가되는 구동 파형도를 나타낸 것으로서, 각 서브 필드에 인가하는 신호 파형은 리셋 기간과 어드레스 기간과 서스테인 기간으로 나누어 그 중 리셋 기간과 어드레스 기간은 서브 필드마다 모두 동일하게 할당하나 서스테인 기간은 어드레스 기간에 표시되는 디지털 화상 데이터의 비트 가중치에 따라 서로 다르게 할당하되 각 서브 필드마다 색신호(R,G,B) 각각의 휘도와 색좌표를 측정하여 제 1 서스테인 전극과 어드레스 전극에 화이트 밸런스가 맞는 서스테인 펄스의 개수에서 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라1 소거 펄스를 동기되게 인가함과 아울러 제 1 서스테인 전극과 어드레스 전극에 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라2 소거 펄스를 동기되게 인가하게 구성되어져 있다.
이와 같이 구성된 본 발명의 일실시예에 의한 플라즈마 표시장치의 서스테인 펄스 인가방법에 따라 패널 상에 화상을 표시하는 과정에서 종래 기술에 대비하여 차별화되는 서스테인 기간을 도 1과 도 3 내지 도 5 및 도 7을 참조하여 설명하면 다음과 같다.
먼저, 마이컴(20)은 각 서브 필드 화면(SF1∼SF8)마다 R,G,B 각각의 휘도와 색좌표를 측정하여 화이트 밸런스가 맞는 R: G: B 비율의 서스테인 펄스 개수를 산출하여 서스테인 펄스 발생부(32)와 어드레스 구동부(50)로 제어 신호를 출력한다.
이에, 서스테인 펄스 발생부(32)가 서스테인 펄스를 출력하면 이를 입력받은 구동 IC(33)는 클록 신호(CLK)와 데이터 신호(DO)와 서스테인 펄스에 따라 480개의 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 순차적으로 1개 라인씩 스캔 펄스를 인가한다.
아울러, 구동 IC(33)의 스캔 펄스 인가시 어드레스 구동부(50)는 스캔 펄스가 공급되어 주사되는 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 대응되는 어드레스 펄스(R, G, B 디지털 화상 데이터의 1 비트값)를 상기 스캔 신호와 동기화하여 640개의 R, G, B 어드레스 전극라인(R1∼B640)에 각각 공급함으로써 상기 어드레스 펄스로 논리 "하이(high)" 가 공급된 각 셀의 방전공간 내부에서 방전이 일어나도록 한다.
그리고, 각 서브필드 화면(SF1∼SF8)의 어드레스 기간이 완료되면 구동 IC(33)는 전체 제 1, 2 서스테인 전극라인쌍(S1∼S480)에 서스테인 펄스를 공급하여 어드레스 기간에서 방전이 일어난 일부 셀의 방전 및 발광이 서스테인 펄스가 공급되는 기간(서스테인 기간) 동안 유지되게 한다.
이때, 각 서브필드 화면(SF1∼SF8)에서 산출된 R: G: B 비율에 따라 특정 색상의 서스테인 펄스가 모두 인가되면 서스테인 펄스 발생부(32)와 어드레스 구동부(50)는 제 1 서스테인 전극(도 1의 참조부호 4)과 어드레스 전극(도 1의 참조부호 7)에 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라1 소거 펄스를 동기되게 인가하여 소거방전이 발생된다.
이와 같이, R,G,B 중 특정 색상의 셀에서 소거방전이 발생될 때까지의 벽전하 진행 상태는 도 7에 나타내었다.
즉, 도 5에 도시된 구동 파형에서 (가) 내지 (아)지점의 벽전하 진행 상태는 도 7에서 (가) 내지 (아)상태에 나타낸 바와 같다.
상술하면, 서스테인 기간의 (가)지점에서 (가)상태와 같이 어드레스 방전이 일어나면 (나)지점에서는 (나)상태와 같이 셀 내부의 제 1 서스테인 전극(4)에는 양(+)의 벽전하가 형성되고, 제 2 서스테인 전극(5)에는 음(-)의 벽전하가 형성된다.
그리고, (다)지점에서 제 1, 2 서스테인 전극(4,5)사이에 서스테인 방전이 일어나면 서스테인 방전후 (라)지점의 벽전하는 (나)지점에서 나타난 벽전하가 반대로 형성된 것으로 나타난다.
다시, (마)지점에서 제 1, 2 서스테인 전극(4,5)사이에 서스테인 방전이 일어나 (바)지점의 벽전하는 (바)상태 즉, (라)지점에서 나타난 벽전하와 반대로 형성된다.
이후, (사)지점에서 제 1 서스테인 전극(4)과 어드레스 전극(7)에 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라1 소거 펄스가 동기되어 인가되면 이 펄스에 의해 칼라1에 해당하는 셀에서만 제 1, 2 서스테인 전극(4,5)간에 소거방전이 일어나 (사a)상태가 된다.
그러나, 이때 인가되는 칼라1 소거 펄스는 펄스 높이가 서스테인 전압보다 낮음과 아울러 펄스 폭이 1㎲이하인 펄스가 인가되므로 벽전하를 형성할 시간이 없어 (아)지점에서 해당 셀은 (아a)상태와 같이 벽전하가 없는 셀이 된다.
그리고, (아)지점에서 해당 셀은 벽전하가 없으므로 (자)지점에서 서스테인 펄스가 가해져도 (자a)상태와 같이 방전이 일어나지 않는다.
이때, 칼라1을 제외한 칼라2와 칼라3에 해당하는 셀은 칼라1 소거 펄스의 영향을 받지 않으므로 (사)와 (아) 및 (자)지점에서 (사b)와 (아b) 및 (자b)상태가 된다.
또한, 산출된 R: G: B 비율에 따라 R,G,B 중 상기와 같이 칼라1 소거 펄스가 인가된 특정 색상을 제외한 소정 색상에서 서스테인 펄스가 모두 인가된 후 도 5에 도시된 바와 같이 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라2 소거 펄스가 동기되어 인가된다.
그러면, (사)와 (아)지점에서의 벽전하 진행 상태인 도 7의 (사a)와 (아a)상태와 동일하게 소정 색상의 셀에서도 소거 방전이 일어나 벽전하가 없는 셀이 되고, 서스테인 펄스가 가해져도 (자a)상태와 같이 방전이 일어나지 않는다.
상기와 같이, R,G,B 각각의 색상에 서스테인 펄스의 적정 개수에 따라 소거 펄스를 인가하면 R: G: B 비율을 미세 조정할 수 있으므로 화이트 밸런스를 맞출수가 있게 된다.
도 6은 본 발명의 다른 실시예에 의한 플라즈마 표시장치의 서스테인 펄스 인가방법에 따라 각 전극에 인가되는 구동 파형도를 나타낸 것으로서, 도 5에 도시된 구동 파형과 동일하게 서스테인 기간은 어드레스 기간에 표시되는 디지털 화상 데이터의 비트 가중치에 따라 서로 다르게 할당하되 각 서브 필드마다 R,G,B 각각의 휘도와 색좌표를 측정하여 제 2 서스테인 전극과 어드레스 전극에 화이트 밸런스가 맞는 서스테인 펄스의 개수에서 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라1 소거 펄스를 동기되게 인가함과 아울러 제 2 서스테인 전극과 어드레스 전극에 펄스폭은 같으나 위상이 반대인 한 쌍의 칼라2 소거 펄스를 동기되게 인가함으로써, 도 7에 도시된 벽전하 진행 상태와 동일한 과정을 거쳐 소거 방전이 발생되므로 도 5에 도시된 본 발명의 일실시예와 동일한 결과를 얻는다.
이상에서 설명한 바와 같이 본 발명은 R,G,B 각 색상의 서스테인 기간을 독립적으로 조절하기 위해 어드레스 전극과 서스테인 전극에 적어도 한 쌍 이상의 특정 칼라 소거 펄스를 인가하여 색신호의 비율을 조절함으로써, 화이트 밸런스를 정확하게 맞출수 있는 효과가 있다.
도 1은 일반적인 플라즈마 표시패널의 셀 구조도.
도 2는 도 1에 도시된 각 전극에 인가되는 구동 파형의 예시도.
도 3은 도 2에 도시된 구동 파형에 따른 해당 셀의 벽전하 진행 상태도.
도 4는 일반적인 플라즈마 표시장치의 블록 구성도.
도 5는 본 발명의 일실시예에 의해 각 전극에 인가되는 구동 파형도.
도 6은 본 발명의 다른 실시예에 의해 각 전극에 인가되는 구동 파형도.
도 7은 도 5에 도시된 각 전극의 구동 파형에 의한 각 전극의 벽전하 진행 상태도.

Claims (6)

  1. 서스테인 기간을 갖는 각 서브 필드마다 색신호 각각의 휘도와 색좌표를 측정하여 서스테인 전극에 서스테인 펄스를 인가하는 서스테인기간에 상기 서스테인 전극과 어드레스 전극에 각각 특정 칼라 소거 펄스를 인가하여 상기 색신호 각각의 서스테인 기간을 독립적으로 조절하는 것을 특징으로 하는 플라즈마 표시장치의 서스테인 펄스 인가방법.
  2. 제 1 항에 있어서,
    상기 특정 칼라 소거 펄스는 상기 서스테인 전극 중 스캔 전극(제 1 서스테인 전극)과 상기 어드레스 전극에 각각 인가하는 것을 특징으로 하는 플라즈마 표시장치의 서스테인 펄스 인가방법.
  3. 제 1 항에 있어서,
    상기 특정 칼라 소거 펄스는 상기 서스테인 전극 중 공통 전극(제 2 서스테인 전극)과 상기 어드레스 전극에 각각 인가하는 것을 특징으로 하는 플라즈마 표시장치의 서스테인 펄스 인가방법.
  4. 제 1 항에 있어서,
    상기 색신호는 적색과 녹색 및 청색(R,G,B)신호인 것을 특징으로 하는 플라즈마 표시장치의 서스테인 펄스 인가방법.
  5. 제 1 항 내지 제 3 항 중 어느 한 항에 있어서,
    상기 서스테인 전극과 상기 어드레스 전극에 각각 인가하는 특정 칼라 소거 펄스는 상호 위상은 반대이나 펄스폭은 같고 동기되는 것을 특징으로 하는 플라즈마 표시장치의 서스테인 펄스 인가방법.
  6. 제 1 항 내지 제 3 항 중 어느 한 항에 있어서,
    상기 특정 칼라 소거 펄스는 상기 색신호 중 적어도 두 색상의 서스테인 기간이 독립적으로 조절되게 적어도 두 쌍 이상을 인가하여 상기 색신호의 비율을 조절하는 것을 특징으로 하는 플라즈마 표시장치의 서스테인 펄스 인가방법.
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