KR100470108B1 - 디스플레이 장치 - Google Patents

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KR100470108B1
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후미따까 아사미
가즈오 요시까와
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히로요시 가와따
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Abstract

본 명세서 및 도면에서는, 어드레스 펄스로 구동되는 어드레스 전극과 상기 어드레스 전극에 대해 교차형으로 설치되고 서스테인 펄스로 구동되는 서스테인 전극을 구비한 표시 패널과, 상기 서스테인 펄스와 스캔 펄스를 형성하는 회로에 있어서 작동 상태를 바꿔 상기 서스테인 펄스 형성과 상기 스캔 펄스 형성에 공용되는 공용 회로부를 지니고 상기 서스테인 전극에 상기 양 펄스를 출력하는 서스테인 전극 드라이브 회로와, 상기 어드레스 펄스를 형성하는 어드레스 드라이브 회로와, 상기 서스테인 전극 드라이브 회로의 상기 작동 상태를 바꾸는 제어 신호를 형성하는 제어 신호 형성 회로를 포함하고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 서스테인 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스한 화소를, 상기 서스테인 펄스에 의한 상기 서스테인 전극의 전계에 의해 점등시키는 바와 같이 한 구성을 개시하고 있다.

Description

디스플레이 장치{DISPLAY APPARATUS}
본 발명은 플라즈마 디스플레이 장치 등의 디스플레이 장치에 관한 것으로,특히 표시부를 구동하는 회로부의 구성에 관한 것이다.
종래, 디스플레이 장치로서는 여러가지의 것이 알려져 있다. 디스플레이 장치 중, 예를 들면, 플라즈마 디스플레이 장치는, 방전을 이용하여 형광체를 발광시켜 영상을 재생하는 것으로, 대화면을 공간 절약으로 실현할 수 있고, 금후의 디스플레이 장치로서 주목된다.
도 2는 종래의 플라즈마 디스플레이 장치의 구성예의 블록도이다. 도 2에 있어서, 참조 번호 3은 플라즈마 디스플레이 패널, 8은 제1 전극 드라이브 회로, 27은 드라이브 회로부, 25, 26은 파워 MOSFET, X는 제1 전극(공통 X 전극)이다. 단자(7)에 서스테인 전원이 입력된다. 또한, 참조 번호 10은 어드레스 드라이브 회로이며, A1∼AN은 어드레스 전극이다. 참조 번호 82는 제2 전극 서스테인 회로, 33은 드라이브 회로부, 31, 32는 파워 MOSFET, Y1∼Yn은 제2 전극이다. 단자(29)에 제2 전극 Y1∼Yn의 서스테인 전원이 입력된다. 참조 번호 34는 스캔 드라이브 회로이며, 제1 내지 제n 서스테인 드라이브 회로(34a∼34n)로 구성되고, 그 출력에는 제2 전극(Y1∼Yn)이 구비되어 있다. 스캔 드라이브 회로(34)는 시프트 레지스터(36), 논리 회로(35, 37), 정전류원(39, 47), 파워 MOSFET(38, 40, 42, 43, 46, 48, 50, 51), 저항(41, 49), 다이오드(44, 45, 52, 53, 80)로 구성되어 있고, 단자(28)에 스캔 전원이 입력되고, 다이오드(80)를 통해 스캔 드라이브 회로(34)에 전원이 공급된다. 참조 번호 11은 파형 제어 회로이며, 제1 전극 드라이브회로(8), 어드레스 드라이브 회로(10), 및 제2 전극 서스테인 회로(82)의 각각에 제어 신호 Dxs, Dad, Dys를 공급함과 동시에, 절연 회로(30)를 통해 스캔 드라이브 회로(34)에 제어 신호 Dscn이 공급된다. 또한, 제2 전극 서스테인 회로(82)와 스캔 드라이브 회로(34)로부터 제2 전극 드라이브 회로(81)가 구성된다.
도 2에 있어서, 파형 제어 회로(11)로부터 출력된 스캔 신호 Dscn은, 예를 들면 포토커플러의 절연 회로(30)를 통해, 스캔 드라이브 회로(34n)의 시프트 레지스터(36)에 입력된다. 시프트 레지스터(36)는 스캔 신호 Dscn을 순차 스캔 드라이브 회로(34a∼34n)로 분류한다. 스캔 드라이브 회로(34)에서는, 스캔 신호 Dscn에 기초하여, 플라즈마 디스플레이 패널(3)의 제2 전극(Y1∼Yn)으로 순차 스캔 펄스를 공급한다. 제2 전극 서스테인 회로(82)에서는, 파형 제어 회로(11)로부터 출력되는 서스테인 펄스 DYS에 기초하여, 상기 제2 전극(Y1∼Yn)에 공급하는 서스테인 펄스 YS를 형성한다. 제2 전극 서스테인 회로(82)에서 형성된 서스테인 펄스 YS는, 스캔 드라이브 회로(34)의 공통 단자(83)로 입력되고, 다이오드(45, 53)를 통해, 플라즈마 디스플레이 패널(3)의 제2 전극(Y1∼Yn)으로 공급된다. 파형 제어 회로(11)에서 형성된 어드레스 신호 Dad는, 어드레스 드라이브 회로(10)로 공급된다. 어드레스 드라이브 회로(10)에서는, 상기 어드레스 신호 Dad에 기초하여, 플라즈마 디스플레이 패널(3)의 어드레스 전극(A1∼An)으로 어드레스 드라이브 펄스를 공급한다. 파형 제어 회로(11)에서 형성된 제1 전극 드라이브 신호 DXS는, 제1 전극 드라이브 회로(8)로 공급된다. 제1 전극 드라이브 회로(8)에서는, 상기 제1 전극 드라이브 신호 DXS에 기초하여, 플라즈마 디스플레이 패널(3)의 제1 전극 X로 드라이브 펄스를 공급한다. 스캔 드라이브 회로(34)는, 스캔 드라이브용 IC로서 시판되고 있다.
도 2에 도시한 플라즈마 디스플레이 장치에 관련한 종래예는, 미국 특허 제5,745,086호 공보에 개재되어 있다. 이 미국 공보의 도 10(Fig. 10)에는, 플라즈마 디스플레이 장치를 구동하기 위한 기본 회로 블록도가 도시되어 있다.
상기 도 2에 도시한 플라즈마 디스플레이 장치에서는, 제2 전극 드라이브 회로를 구성하는 스캔 드라이브 회로(34)와 제2 전극 서스테인 회로(82)는, 각각 독립한 회로를 이용하고 있다. 예를 들면, 스캔 드라이브 회로(34)는, 도 2에 도시한 회로 구성의 스캔 드라이브 IC를 이용하고, 제2 전극 서스테인 회로(82)는 파워 모듈을 이용하여 구성된다. 또한, 제2 전극 서스테인 회로(82)의 단자(83)는 접지로부터 부유한 상태로 되어 있기 때문에, 스캔 신호 Dscn을 절연 회로(30)를 통해서 접지로부터 부유한 상태로 할 필요가 있다.
또한, 이 제2 전극 드라이브 회로(34)의 회로 규모는, 제1 전극 드라이브 회로(8)에 비교하여 크고, 플라즈마 디스플레이 장치 전 회로에 대한 비율도 크다. 이 때문에, 플라즈마 디스플레이 장치를 소형화하는데 있어서 장해가 된다.
본 발명의 목적은, 상기 종래의 관련 기술이 안고 있는 문제점을 해결하여, 간략하고 또한 소형화 가능한 구성으로 오동작을 방지한 디스플레이 장치를 제공하는 것이다.
상기 목적을 달성하기 위해 본 발명에서는,
1) 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서, 영상 입력 신호에 기초하는 어드레스 펄스로 구동되는 어드레스 전극과, 상기 어드레스 전극에 대해 화소의 방전부를 끼워 교차형으로 설치되고 서스테인 펄스로 구동되는 서스테인 전극을 포함하는 표시 패널과, 상기 서스테인 펄스와 스캔 펄스를 형성하는 회로에 있어서, 상기 서스테인 펄스의 하이 레벨 전압의 상기 서스테인 전극으로의 공급과 상기 스캔 펄스의 하이 레벨 전압의 상기 서스테인 전극으로의 공급을 행하는 제1 스위치 소자와, 상기 서스테인 펄스의 로우 레벨 전압의 상기 서스테인 전극으로의 공급과 상기 스캔 펄스의 로우 레벨 전압의 상기 서스테인 전극으로의 공급을 행하는 제2 스위치 소자를 포함하여 구성되는 서스테인 전극 드라이브 회로와, 상기 어드레스 펄스를 형성하여 출력하는 어드레스 드라이브 회로와, 상기 서스테인 전극 드라이브 회로에서의 상기 서스테인 펄스의 형성과 상기 스캔 펄스 펄스의 형성 중 어느 것을 행할지를 제어하는 제어 신호를 형성하는 제어 신호 형성 회로를 포함하고, 상기 제1 스위치 소자와 상기 제2 스위치 소자는 대략 동등한 전류 용량과 스위칭 속도를 갖고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 서스테인 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 서스테인 펄스에 의한 상기 서스테인 전극의 전계에 의해 상기 어드레스한 화소를 점등시키고, 상기 서스테인 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하여 영상 표시하도록 한 구성으로 한다.
2) 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서, 어드레스 전극과, 상기 어드레스 전극에 대해 방전부를 끼워 교차형으로 설치되고 상호 대략 평행하게 된 제1, 제2 전극을 포함한 표시 패널과, 상기 제1 전극을 구동하기 위한 제1 전극 서스테인 펄스를 형성하는 제1 전극 드라이브 회로와, 제2 전극 서스테인 펄스와 스캔 펄스를 형성하는 회로에 있어서, 상기 제2 전극 서스테인 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제1 스위치 소자와, 상기 제2 전극 서스테인 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제2 스위치 소자를 포함하여 구성되는 제2 전극 드라이브 회로와, 영상 신호에 기초하는 어드레스 펄스로 상기 어드레스 전극을 구동하는 어드레스 드라이브 회로와, 상기 제2 전극 드라이브 회로에서의 상기 제2 전극 서스테인 펄스의 형성과 상기 스캔 펄스의 형성 중 어느 것을 행할지를 제어하는 제어 신호를 형성하는 제어 신호 형성 회로를 포함하고, 상기 제1 스위치 소자와 상기 제2 스위치 소자는 대략 동등한 전류 용량과 스의칭 속도를 갖고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 제2 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스한 화소를, 상기 제1 전극 서스테인 펄스, 상기 제2 전극 서스테인 펄스에 의한 상기 제1, 제2 전극 사이의 전계에 의해 점등시키고, 상기 제2 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하여 영상 표시하도록 한 구성으로 한다.
3) 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서, 어드레스 전극과, 상기 어드레스 전극에 대해 방전부를 끼워 교차형으로 설치되고 상호 대략 평행하게 된 제1, 제2 전극을 포함한 표시 패널과, 상기 제1 전극을 구동하기 위한 제1 전극 서스테인 펄스를 형성하는 제1 전극 드라이브 회로와, 제2 전극 서스테인 펄스와 스캔 펄스를 형성하는 회로에 있어서, 상기 제2 전극 서스테인 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제1 스위치 소자와, 상기 제2 전극 서스테인 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제2 스위치 소자를 포함하여 구성되는 제2 전극 드라이브 회로와, 영상 신호에 기초하는 어드레스 펄스로 상기 어드레스 전극을 구동하는 어드레스 드라이브 회로와, 상기 스캔 펄스 형성용의 스캔 전원과 상기 제2 전극 서스테인 펄스 형성용의 서스테인 전원을 전환하는 스위치부와, 상기 스위치부 및 상기 제2 전극 드라이브 회로에서의 상기 제2 전극 서스테인 펄스의 형성과 상기 스캔 펄스의 형성 중 어느 것을 행할지를 제어하는 제어 신호를 형성하는 제어 신호 형성 회로를 포함하고, 상기 제1 스위치 소자와 상기 제2 스위치 소자는 대략 동등한 전류 용량과 스위칭 속도를 갖고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 제2 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스한 화소를, 상기 제1 전극 서스테인 펄스, 상기 제2 전극 서스테인 펄스에 의한 상기 제1, 제2 전극 사이의 전계에 의해 점등시키고, 상기 제2 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하여 영상 표시하도록 한 구성으로 한다.
4) 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서, 어드레스 전극과 상기 어드레스 전극에 대해 방전부를 끼워 교차형으로 설치되고 상호 대략 평행하게 된 제1, 제2 전극을 구비한 표시 패널과, 상기 제1 전극을 구동하기 위한 제1 전극 서스테인 펄스를 형성하는 제1 전극 드라이브 회로와, 작동 상태를 바꿈으로써 스캔 펄스의 형성과, 상기 제2 전극을 구동하기 위한 제2 전극 서스테인 펄스의 형성에 공용되는 공용 회로부를 포함하고 상기 양 펄스를 상기 제2 전극으로 출력하는 제2 전극 드라이브 회로와, 영상 신호에 기초하는 어드레스 펄스로 상기 어드레스 전극을 구동하는 어드레스 드라이브 회로와, 코일, 스위치 수단 및 컨덴서를 포함하고, 상기 제1 전극 드라이브 회로, 상기 제2 전극 드라이브 회로 중 어느 한쪽 또는 양쪽의 출력단에 다이오드를 통해 접속된 전력 회수 회로와, 상기 제2 전극 드라이브 회로의 상기 작동 상태, 및 상기 스위치 수단의 작동 상태를 바꾸기 위한 제어 신호를 형성하는 제어 신호 형성 회로를 포함하고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 제2 전극과 상기어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스한 화소를, 상기 제1 전극 서스테인 펄스, 상기 제2 전극 서스테인 펄스에의한 상기 제1, 제2 전극 사이의 전계에 의해 점등시키고, 상기 제2 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하고, 또한, 상기 제1 전극 서스테인 펄스 또는 상기 제2 전극 서스테인 펄스의 펄스 하강 시에, 상기 전력 회수 회로의 상기 스위치 수단을 상기 제어 신호 형성 회로에 의해 도통 상태로 하고, 상기 코일에 의한 공진을 이용하여, 상기 제1, 제2 전극 중 어느 한쪽 또는 양쪽으로부터 전력을 상기 컨덴서측으로 회수한 상태에서 영상 표시하도록 한 구성으로 한다.
도 1은 본 발명에 따른 디스플레이 장치의 제1 실시예를 나타내는 블록도.
도 2는 종래의 디스플레이 장치의 구성예의 블록도.
도 3은 본 발명에 따른 디스플레이 장치의 제2 실시예를 나타내는 블록도.
도 4는 본 발명에 따른 디스플레이 장치의 제3 실시예를 나타내는 블록도.
도 5는 본 발명에 따른 디스플레이 장치의 제4 실시예를 나타내는 블록도.
도 6은 본 발명에 따른 디스플레이 장치의 제5 실시예를 나타내는 블록도.
도 7은 본 발명에 따른 디스플레이 장치의 제6 실시예를 나타내는 블록도.
도 8은 디스플레이 장치에 공급되는 전압 파형을 나타내는 도면.
<도면의 주요 부분에 대한 부호의 설명>
2 : 라인 드라이브 회로
11 : 파형 제어 회로
12, 13, 14, 15, 16, 17, 18, 19 : 논리 회로
34 : 스캔 드라이브 회로
82 : 서스테인 회로
이하, 본 발명의 실시예를, 플라즈마 디스플레이 장치의 경우에 대해 설명한다.
또, 각 도면에 있어서, 동일 기능을 갖는 것에 대해서는 동일 부호를 붙여 중복 설명을 피한다.
도 1은 본 발명에 따른 디스플레이 장치의 제1 실시예를 나타내는 블록도이다. 도 1에 있어서, 참조 번호 1은 라인 드라이브 전원 입력 단자, 2는 라인 드라이브 회로, 3은 플라즈마 디스플레이 패널, Y1∼Yn은 제2 전극, X는 제1 전극, 7은 제1 전극의 서스테인 전원 입력 단자, 8은 제1 전극 드라이브 회로, A1, An은 어드레스 전극, 10은 어드레스 드라이브 회로, 11은 파형 제어 회로, 12, l9는 논리 회로, 13, 20, 27은 드라이브 회로부, 14, 15, 21, 22는 파워 MOSFET, 16, 17,23, 24는 다이오드, 18은 시프트 레지스터, 80은 제2 전극 드라이브 회로이다.
도 1에 있어서, 제2 전극 드라이브 회로(80)는, 전극 라인에 대응하여 제1 라인 드라이브 회로(2a) 내지 제n 라인 드라이브 회로(2n)로 이루어지는 라인 드라이브 회로(2)를 이용하여 구성되어 있다. 제1번째의 라인 드라이브 회로(2a)는 논리 회로(12), 드라이브 회로부(13), 파워 MOSFET(14, 15), 다이오드(16, 17)를 포함하여 구성되고, 제 n번째의 라인 드라이브 회로(2n)는 시프트 레지스터(18), 논리 회로(19), 드라이브 회로부(20), 파워 MOSFET(21, 22), 다이오드(23, 24)를 포함하여 구성되어 있다. 다른 개개의 라인 드라이브 회로도 마찬가지로 구성된다. 제n번째의 라인 드라이브 회로(2n)의 시프트 레지스터(18)에는 파형 제어 회로(11)로부터 스캔 신호 Dscn이 공급되고, 논리 회로(19)에는 서스테인 펄스 DYS가 공급되어 있다. 상기 라인 드라이브 회로(2)에 있어서, 파워 MOSFET(14, 21)는 제1 스위치 소자이며, 파워 MOSFET(15, 22)는 제2 스위치 소자이다.
도 1에 도시한 본 발명의 실시예는, 도 2에 도시한 종래의 플라즈마 디스플레이 장치와 비교하여, 제2 전극 서스테인 회로(82), 절연 회로(30)를 삭제하고, 라인 드라이브 회로(2)에 의해, 스캔 펄스와 제2 전극(Y1∼Yn)의 서스테인 펄스의 양쪽을 형성하고 있는 점이 다르다.
이하, 도 1에 도시한 플라즈마 디스플레이 장치의 동작에 대해 설명한다.
도 1에 있어서의 파형 제어 회로(11)로부터 출력되는 스캔 신호 Dscn은, 제 n번째의 라인 드라이브 회로(2n)를 구성하는 시프트 레지스터(18)로 출력된다. 스캔 신호 Dscn은 시프트 레지스터(18)로 직렬-병렬 변환되고, 제1번째로부터 제n 번째의 라인 드라이브 회로(2a∼2n)의 논리 회로(12∼18)로 순차 공급되고, 각각 논리 회로(12, 19), 드라이브 회로부(13, 20)에 공급되고, 또한, 각각 파워 MOSFET(14, 15) 및 파워 MOSFET(21, 22)에 의해 증폭되고 제2 전극(Y1∼Yn)으로 스캔 펄스로서 공급된다.
또한, 도 1에 있어서의 파형 제어 회로(11)로부터 출력되는 제2 전극(Y1∼Yn)의 서스테인 펄스 DYS는, 라인 드라이브 회로(2)를 구성하는 논리 회로(19)로 입력된다. 제2 전극(Y1∼Yn)의 서스테인 펄스 DYS는, 동시에 논리 회로(12)로도 공급되고, 드라이브 회로부(20, 13), 및, 파워 MOSFET(21, 22, 14, 15)에서 증폭되어 제2 전극(Y1∼Yn)으로 제2 전극(Y1∼Yn)의 서스테인 펄스로서 공급된다.
도 1에 도시한 플라즈마 디스플레이 장치의 특징은, 스캔 펄스와 제2 전극 Y1∼Yn의 서스테인 펄스를 공용의 회로에서 형성하고 있는 점이다. 이 때문에, 도 1에 있어서의 라인 드라이브 회로(2)에는, 도 2에 도시한 종래의 플라즈마 디스플레이 장치를 구성하고 있는 제2 전극 서스테인 회로(82)와 스캔 드라이브 회로(34)의 양쪽의 기능을 포함하고 있다. 이 결과, 도 1에 도시한 플라즈마 디스플레이 장치에서는, 도 2에 도시한 종래의 플라즈마 디스플레이 장치에 비교하여, 회로 규모의 축소를 도모할 수 있다.
도 1에 있어서의 라인 드라이브 회로(2)의 구성은, 도 2에 있어서의 스캔 드라이브 회로(34)의 구성과 유사하지만, 라인 드라이브 회로(2)에서는, 제2 전극(Y1∼Yn)으로, 스캔 펄스보다도 진폭이 크고, 방전 전류가 큰 제2 전극(Y1∼Yn)의 서스테인 펄스를 공급할 수 있도록, 드라이브 회로부(13, 20), 파워 MOSFET(14, 15, 21, 22)의 전류 용량, 스위칭 속도를 설정하고 있다. 또한, 논리 회로(19)로 입력되는 제2 전극(Y1∼Yn)의 서스테인 펄스 DYS를 이용하여, 상기 드라이브 회로부(13, 20), 파워 MOSFET(14, 15, 21, 22)를 동작시키는 구성으로 하고 있는 점도 다르다.
도 1에 도시한 플라즈마 디스플레이 장치의 동작 파형을, 도 2에 도시한 종래의 플라즈마 디스플레이 장치의 동작 파형과 비교하여 도 8에 도시한다.
도 8은 플라즈마 디스플레이 장치에 공급되는 전압 파형도이며, 도 8의 (a)는 제1 전극 X에 공급되는 전압 VX의 파형도이고, 도 8의 (b)는 제2 전극 Y1에 공급되는 전압 VY1의 파형도, 도 8의 (c)는 제2 전극 Yn에 공급되는 전압 VYn의 파형도, 도 8의 (d)는 어드레스 전극 A1에 공급되는 전압 VA1의 파형도, 도 8의 (e)는 어드레스 전극 An에 공급되는 전압 VA2의 파형도, 도 8의 (f)는 도 2의 논리 회로(35)의 출력 전압 DY1의 파형도, 도 8의 (g)는 도 2의 논리 회로(37)의 출력 전압 DYn의 파형도, 도 8의 (h)는 제2 전극(Y1∼Yn)의 서스테인 펄스 YS의 파형도, 도 8의 (i)는 도 1의 논리 회로(12)의 출력 전압 DYS1의 파형도, 도 8의 (j)는 도 1의 논리 회로(19)의 출력 전압 DYS2 파형도이다.
또, 도 8에 있어서, 다른 파형도는 본 발명의 다른 실시예를 설명하기 위한것으로, 이것에 대해서는 후술한다.
도 8에 있어서, 각 파형도는 리세트 기간(전방면 소거 기간이라고도 한다), 스캔 기간(어드레스 기간이라고도 한다) 및 서스테인 기간(방전 유지 기간이라고도한다)으로 나누어 도시되어 있다. 리세트 기간에 있어서, 도 8의 (a) 내지 도 8의 (c)에 도시한 바와 같이, 제1 전극 X와 제2 전극(Y1∼Yn)에 교대로 펄스 전압이 공급되어 전면 방전이 행해진다. 그 후의 스캔 기간에 있어서, 제1 전극 X에는 도 8 (a)에 도시한 바와 같이, 정전압이 공급된다. 또한, 도 8의 (b), (c)에 도시한 바와 같이, 제2 전극(Y1∼Yn)에 순차 마이너스의 펄스가 공급됨과 함께, 도 8의 (e), (d)에 도시한 바와 같이, 어드레스 전극(A1∼An)에는 서스테인 기간에 있어서 점등시키지 않는 셀을 제외하고, 순차 플러스의 펄스(어드레스 펄스)가 공급되고, 다음의 서스테인 기간에 있어서 점등시키는 셀을 선택한다. 서스테인 기간에 있어서, 도 8의 (a)∼도 8의 (c)에 도시한 바와 같이, 제2 전극(Y1∼Yn)과 제1 전극 X에 교대로 방전을 유지하기 위한 서스테인 전압이 공급된다.
도 2의 종래의 플라즈마 디스플레이 장치에 있어서는, 도 8의 (f), 도 8의 (g)에 도시한 바와 같이, 논리 회로(35) 및 논리 회로(37)의 출력에는 각각 스캔 기간에 필요한 스캔 신호 DY1, DYn이 추출된다. 도 8의 (h)에 도시한 바와 같이 서스테인 기간에 필요한 서스테인 펄스 YS는 제2 전극 서스테인 회로(82)로부터 추출되고, 다이오드(45, 53)를 통해 제2 전극 Y1∼Y2에 공급된다.
이에 대해, 본 실시예에서는, 논리 회로(12)의 출력에는 도 8의 (i)에 도시한 바와 같이, 스캔 기간과 서스테인 기간에 필요한 전압 DYS1이 추출되고, 제2 전극 Y1에 공급된다. 또한, 논리 회로(19)의 출력에는 도 8의 (j)에 도시한 바와 같이, 스캔 기간과 서스테인 기간에 필요한 전압 DYSn이 추출되고, 제2 전극 Yn에 공급된다.
이와 같이, 본 실시예에서는, 논리 회로(12, 19)의 출력에 전압 DYS1, DYSn을 출력시킴으로써, 종래예에 있어서의 제2 전극 서스테인 회로(82)와 스캔 드라이브 회로(34)를, 1개의 라인 드라이브 회로(2)로 구성할 수가 있다.
도 3은 본 발명에 따른 디스플레이 장치의 제2 실시예를 나타내는 블록도이다. 도 3에 있어서, 참조 번호 28은 스캔 전원 입력 단자, 29는 제2 전극의 서스테인 전원 입력 단자, 4O은 스위치 수단이며, 이 스위치 수단(40)은 파형 제어 회로(11)에 의해 제어된다. 도 1의 실시예와 비교하여, 이들 단자(28, 29) 및 스위치 수단이 설치되는 점이 다르다. 도 3에 도시한 실시예에서는, 라인 드라이브 전원의 전압 Vcc를 스위치 수단(40)을 이용하여, 스캔 전원 Vscn, 또는 서스테인 전원 Vsy로 형성하고 있다.
도 8의 (k)는 라인 드라이브 전원의 전압 Vcc의 파형도, 도 8의 (l)은 스캔 전원 입력 단자(28)로부터 입력되는 스캔 전원의 전압 Vscn의 파형도, 도 8의 (m)은 제2 전극의 서스테인 전원의 전압 VSY의 파형도이다. 라인 드라이브 전원의 전압 Vcc는, 스캔 펄스를 발생하는 스캔 기간에 있어서, 전압 Vscn이 되도록 스위치 수단(40)에 의해 전환되고, 다른 기간에는 서스테인 전원의 전압 Vsy가 되도록 스위치 수단(40)에 의해 전환된다. 따라서, 이 실시예에서는, 도 8의 (m)에 도시한 바와 같이 제2 전극(Y1 내지 Yn)의 서스테인 전원의 전압 VSY에는, 리세트 기간에 공급하는 리세트 전압이 중첩되어 있다. 이 스위치 수단(40)의 제어는, 예를 들면, 스위치 수단(40)은 단자(28)측(전압 Vscn측)에 접속되어 있고, 서스테인 기간의 최초의 서스테인 전압의 상승으로 스위치 수단(40)을 단자(29: 전압 Vsy측)로전환하고, 스캔 기간의 제2 전극(Y1∼Yn)의 전압의 상승으로 스위치 수단(40)을 단자(28)측으로 전환하도록 하면 좋다.
도 3에 도시한 본 발명의 제2 실시예에 따르면, 스캔 기간에 공급하는 스캔 펄스의 전압치를 독립적으로 설정하는 것이 가능해지고, 오방전에 의한 화면 열화를 저감할 수 있다.
도 4는 본 발명의 제3 실시예를 나타내는 블록도이다. 본 실시예는 도 3의 실시예와 비교하여 제1 전극 X용 전력 회수 회로(42) 및 제2 전극용 전력 회수 회로(41)가 설치되어 있는 점이 다르다. 도 4에 있어서, 참조 번호 41은 제2 전극용 전력 회수 회로, 42는 제1 전극용 전력 회수 회로, 43, 44, 45, 46, 52, 53은 다이오드, 47, 48, 54, 55는 코일, 49, 50, 56, 57은 스위치 수단, 51, 58은 컨덴서이다. 제2 전극용 전력 회수 회로(41)는 코일(47, 48), 스위치 수단(50, 49), 컨덴서(51)를 이용하여 구성되며, 제1 전극용 전력 회수 회로(42)는 코일(54, 55), 스위치 수단(56, 57), 컨덴서(58), 다이오드(53, 52)에 의해 구성된다. 제2 전극 전력 회수 회로(41)를 설치하였기 때문에, 라인 드라이브 회로(2)에는, 다이오드(43, 44, 45, 46)가 더욱 설치된다.
도 4에 있어서, 제1 전극용 전력 회수 회로(42)는 플라즈마 디스플레이 패널(3)의 제1 전극 X로 제1 전극 서스테인 펄스가 인가될 때에 동작하고, 제1 전극 드라이브 회로에서의 파워 MOSFET(25, 26)의 전력 손실을 저감시키는 기능을 하고 있다. 제1 전극용 전력 회수 회로(42)에 있어서, 스위치 수단(57)은 제1 전극 서스테인 펄스의 상승 시에 도통하고, 컨덴서(58)로부터 코일(55), 다이오드(52)를통해, 제1 전극 X로 전력을 공급하고 있다. 또한, 스위치 수단(56)은 제1 서스테인 펄스의 하강 시에 도통하고, 제1 전극 X의 부유 컨덴서(도시하지 않음)로부터 다이오드(53), 코일(54)을 통해 컨덴서(58)로 전력(전하)을 복귀시키고 있다. 이 제1 전극용 전력 회수 회로(42)의 동작에 의해, 파워 MOSFET(25, 26)에 흘리는 전류를 줄여, 전력 손실을 저감시킬 수가 있다. 전력 회수 시에, 제1 전극용 전력 회수 회로(42)에서는 전력 손실을 억제하기 위해서, 코일(54, 55)과 플라즈마 디스플레이 패널(3)이 갖는 부유 용량 등에 의해 생기는 공진을 이용하고 있다.
또한, 제2 전극용 전력 회수 회로(41)에서는, 플라즈마 디스플레이 패널(3)의 제2 전극(Y1∼Yn)으로 제2 전극(Y1∼Yn)의 서스테인 펄스가 인가될 때에 동작하고, 제2 전극 드라이브 회로(80)에 있어서의 파워 MOSFET(14, 15, 21, 22)의 전력 손실을 저감시키는 기능을 하고 있다. 제2 전극용 전력회수 회로(41)에 있어서, 스위치 수단(49)은 제2 전극(Y1∼Yn)에 공급되는 서스테인 펄스의 상승 시에 도통하고, 컨덴서(51)로부터 코일(48), 다이오드(44, 46)를 통해, 제2 전극(Y1∼Yn)으로 전류를 공급하고 있다. 또한, 스위치 수단(50)은, 제2 전극(Y1∼Yn)에 공급되는 서스테인 펄스의 하강 시에 도통하고, 플라즈마 디스플레이 패널(3)의 부유 용량에 축적된 전하가 제2 전극(Y1∼Yn)으로부터 다이오드(43, 45), 코일(47)을 통해, 컨덴서(51)로 전력(전하)을 복귀시키고 있다.
상기 제2 전극용 전력 회수 회로(41)의 동작에 의해, 파워 MOSFET(14, 15, 21, 22)에 흘리는 전류를 저감하여, 전력 손실을 저감시킬 수가 있다. 전력 회수 시에, 제2 전극용 전력 회수 회로(41)에서는 전력 손실을 억제하기 위해서,코일(47, 48)과 플라즈마 디스플레이 패널(3)이 갖는 부유 용량 등(도시하지 않음)에 의해 생기는 공진을 이용하고 있다.
도 8의 (n)는 파형 제어 회로(11)로부터 스위치 수단(49)에 공급되는 스위치 수단 구동 신호 V49의 전압 파형도, 도 8의 (o)는 파형 제어 회로(11)로부터 스위치 수단(50)에 공급되는 스위치 수단 구동 신호 V50의 전압 파형도를 도시한다.
도 8의 (n)에 도시한 바와 같이, 스위치 수단 구동 신호 V49는 제2 전극(Y1∼Yn)에 공급되는 서스테인 펄스의 상승에 동기한 신호이며, 이 신호에 의해, 스위치 수단(49)은 온한다. 또한, 도 8의 (o)에 도시한 바와 같이, 스위치 수단 구동 신호 V50은 제2 전극(Y1∼Yn)에 공급되는 서스테인 펄스의 하강 시에 동기한 신호이며, 이 신호에 의해 스위치 수단(50)은 온한다.
도 4에 도시한 플라즈마 디스플레이 장치에서는, 라인 드라이브 회로(2)에 각 제2 전극(Y1∼Yn)에 대응한 다이오드(45, 46, 43, 44)를 설치함으로써, 제2 전극용 전력 회수 회로(41)를 적용하는 것이 가능해지고, 라인 드라이브 회로의 전력 손실을 저감시킬 수가 있다. 파워 MOSFET(14, 21)에 턴 오프 시간이 500㎱ 이하의 고속 소자를 이용함으로써, 제2 전극용 전력 회수 회로(41)에 의해 파워 MOSFET(14, 21)의 소스 전압을 강제적으로 강하시킨 경우에서도, 파워 MOSFET(14, 21)를 확실하게 오프할 수가 있다. 전력 회수에 의해, 다이오드(45, 46)의 접속점의 전압, 즉 파워 MOSFET(14, 21)의 소스 전압이 강제적으로 저하된 경우에서도, 파워 MOSFET(14, 21)에 고속 소자를 이용하면, 파워 MOSFET(14, 21)의 게이트와 소스 사이에 전하가 남지 않기 때문에, 파워 MOSFET(14, 21)가 온하는 것을 방지할수 있다.
도 5는 본 발명에 따른 디스플레이 장치의 제4 실시예를 나타내는 블록도이다. 도 5에 있어서, 참조 번호 60, 61은 스위치 수단이며, 도 5의 실시예는, 도 4의 실시예와 비교하여 스위치 수단(60, 61)이 설치되어 있는 점에서 다르다.
도 2에 도시한 종래의 플라즈마 디스플레이 장치에서는, 스캔 드라이브 회로(34)의 파워 MOSFET(42, 50)를 오프시키기 위해서, 전단의 파워 MOSFET(40, 48)를 오프하고, 파워 MOSFET(42, 50)의 게이트·소스 사이에 축적된 전하는, 저항(41, 49)을 통해 방출하고 있다. 이 회로 구성을 도 4에 도시한 플라즈마 디스플레이 장치에 이용한 경우, 제2 전극(Y1∼Yn)의 서스테인 펄스의 하강 시에 있어서, 플라즈마 디스플레이 패널(3)의 부유 용량으로부터 다이오드(45, 43)를 통해 컨덴서(51)에 전류가 흐르도록 제2 전극용 전력 회수 회로(41)가 기능할 때, 라인 드라이브 회로(2)의 파워 MOSFET(14, 21)의 소스 전압은, 강제적으로 강하된다. 이 결과, 파워 MOSFET(14, 21)의 게이트와 소스 사이에 전위차가 발생하고, 파워 MOSFET(14, 21)의 게이트·소스 사이 전압이 임계 전압을 초과하여 파워 MOSFET(14, 21)가 도통할 가능성이 있다.
도 5에 도시한 제4 실시예에서는, 파워 MOSFET(14, 21)가 강제적으로 온되는 것을 방지하기 위해, 파워 MOSFET(14, 21)의 게이트·소스 사이에 스위치 수단(60, 61)을 설치하고 있다. 제2 전극(Y1∼Yn)의 서스테인 펄스의 하강 시에 있어서, 이 스위치 수단(60, 61)을 온시킴으로써, 파워 MOSFET(14, 21)의 게이트와 소스 사이를 단락시켜서, 파워 MOSFET(14, 21)를 고속으로 오프시킬 수 있다. 따라서, 제2전극용 전력 회수 회로(41)에 의해 파워 MOSFET(14, 21)의 소스 전압을 강제적으로 강하한 경우에도, 파워 MOSFET(14, 21)가 온하는 것을 확실하게 방지할 수 있다.
도 6은 본 발명에 따른 디스플레이 장치의 제5 실시예를 나타내는 블록도이다. 도 6에 있어서, 참조 번호 62, 63은 P 채널의 파워 MOSFET, 64, 65는 스위치 수단이다. 도 6에 도시한 플라즈마 디스플레이 장치에서는, 도 5에 도시한 N 채널의 파워 MOSFET(14, 21)를 대신하여, P 채널의 파워 MOSFET(62, 63)를 이용하고, 스위치 수단(60, 61)을 대신하여, 스위치 수단(64, 65)을 이용하고 있다. 이 회로 구성을 이용한 경우에도, 제2 전극(Y1∼Yn)의 서스테인 펄스의 하강 시에 있어서, 플라즈마 디스플레이 패널(3)의 부유 용량으로부터 다이오드(45, 43)를 통해 컨덴서(51)에 전류가 흐르도록 제2 전극용 전력 회수 회로(41)가 기능하고, P 채널의 파워 MOSFET(62, 63)가 강제적으로 온된 경우에도, 스위치 수단(64, 65)을 온시킴으로써, P 채널의 파워 MOSFET(62, 63)를 고속으로 오프시킬 수 있다. 이와 같이, 제2 전극용 전력 회수 회로(41)에 의해 파워 MOSFET(62, 63)의 드레인 전압을 강제적으로 강하시킨 경우에도, 파워 MOSFET(62, 63)가 온하는 것을 확실하게 방지할 수 있다. 따라서, 도 6에 도시한 제5 실시예를 이용한 경우에도, 도 5에 도시한 제4 실시예와 마찬가지의 효과가 얻어진다. 본 발명에 있어서는, 제4 실시예, 제5 실시예에서 이용한 스위치 수단(60, 61, 64, 65)을 대신하여, 다른 수단, 예를 들면 파워 MOSFET의 게이트·소스 사이에 축적된 전하를 고속으로 방출시키는 수단을 이용하도록 하여도 마찬가지의 효과가 얻어진다.
도 7은 본 발명에 따른 디스플레이 장치의 제6 실시예를 나타내는 블록도이다. 도 7에 있어서, 참조 번호 73, 76은 P 채널의 파워 MOSFET, 72, 75는 N 채널의 파워 MOSFET, 74, 77은 정전압원이다. 도 7에 있어서, 파워 MOSFET(72)와 정전압원(74), 및, 파워 MOSFET(75)와 정전압원(77)을 이용하여 게이트 접지 회로가 구성되어 있다. 도 7에 도시한 플라즈마 디스플레이 장치에서는, 라인 드라이브 회로(2)의 출력부의 구성으로서 상기 게이트 접지 회로를 이용하고 있다. 이 구성에 있어서, 파워 MOSFET, 72, 75는 각각 파워 MOSFET(73, 76)가 온할 때에는 온하고, 오프할 때에는 오프하도록 구성되어 있다. 제2 전극(Y1∼Yn)의 서스테인 펄스의 하강 시에 있어서, 플라즈마 디스플레이 패널(3)의 부유 용량으로부터 다이오드(45, 43)를 통해 컨덴서(51)에 전류가 흐르고, 파워 MOSFET(73, 76)의 드레인 전압이 강제적으로 저하한 경우에도, 파워 MOSFET(74, 77)는 하이 임피던스로 계속 될 수 있다. 따라서, 제2 전극용 전력 회수 회로(41)에 의해 파워 MOSFET(73, 76)의 드레인 전압이 강제적으로 강하되고, 파워 MOSFET(73, 76)가 온하는 것을 확실하게 방지할 수 있다.
이상의 각 실시예에서는, 라인 드라이브 회로(2)에 파워 MOSFET를 이용한 경우에 대해 설명하였지만, IGBT 등 다른 스위치 소자로 치환하여도 좋다.
또한, 전력 회수 회로를 어드레스 드라이브 회로(10)에 접속하여 설치하여도 좋다.
본 발명에 따르면, 제2 전극 드라이브 회로를, 스캔 펄스와 제2 전극(Y1∼Yn)의 서스테인 펄스의 양자를 출력 가능한 공용 회로에서 구성할 수가있으므로, 제2 전극 드라이브 회로의 회로 구성을 간략하게 할 수가 있다.
본 발명은, 그 정신 또는 주요한 특징으로부터 일탈하지 않고, 상기 실시예의 다른 형태에서도 실시하는 것이 가능하다. 따라서, 상기 실시예는, 모든 점에서 본 발명의 단순한 일 예시에 지나지 않으며, 한정적으로 해석되어서는 안된다. 본 발명의 범위는, 특허 청구의 범위에 의해 설명되고 있다. 또한, 이 특허 청구의 범위의 균등 범위에 속하는 변형이나 변경은, 전부 본 발명의 범위 내의 것이다.

Claims (11)

  1. 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서,
    영상 입력 신호에 기초하는 어드레스 펄스로 구동되는 어드레스 전극과, 상기 어드레스 전극에 대해 화소의 방전부를 끼워 교차형으로 설치되고 서스테인 펄스로 구동되는 서스테인 전극을 포함하는 표시 패널과,
    상기 서스테인 펄스와 스캔 펄스를 형성하는 회로로서, 상기 서스테인 펄스의 하이 레벨 전압의 상기 서스테인 전극으로의 공급과 상기 스캔 펄스의 하이 레벨 전압의 상기 서스테인 전극으로의 공급을 행하는 제1 스위치 소자와, 상기 서스테인 펄스의 로우 레벨 전압의 상기 서스테인 전극으로의 공급과 상기 스캔 펄스의 로우 레벨 전압의 상기 서스테인 전극으로의 공급을 행하는 제2 스위치 소자를 포함하여 구성되고, 구동하는 라인마다 설치되는 서스테인 전극 드라이브 회로와,
    상기 어드레스 펄스를 형성하여 출력하는 어드레스 드라이브 회로와,
    상기 서스테인 전극 드라이브 회로에서의 상기 서스테인 펄스의 형성과 상기 스캔 펄스 펄스의 형성 중 어느 것을 행할지를 제어하는 제어 신호를 형성하는 제어 신호 형성 회로
    를 포함하고,
    상기 제1 스위치 소자와 상기 제2 스위치 소자는 대략 동등한 전류 용량과 스위칭 속도를 갖고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 서스테인 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 서스테인 펄스에 의한 상기 서스테인 전극의 전계에 의해 상기 어드레스된 화소를 점등시키고, 상기 서스테인 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하여 영상 표시하도록 한 것을 특징으로 하는 디스플레이 장치.
  2. 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서,
    어드레스 전극과, 상기 어드레스 전극에 대해 방전부를 끼워 교차형으로 설치되고 상호 대략 평행하게 된 제1, 제2 전극을 포함하는 표시 패널과,
    상기 제1 전극을 구동하기 위한 제1 전극 서스테인 펄스를 형성하는 제1 전극 드라이브 회로와,
    상기 제2 전극을 구동하기 위한 제2 전극 서스테인 펄스와 스캔 펄스를 형성하는 회로로서, 상기 제2 전극 서스테인 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제1 스위치 소자와, 상기 제2 전극 서스테인 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제2 스위치 소자를 포함하여 구성되고, 구동하는 라인마다 설치되는 제2 전극 드라이브 회로와,
    영상 신호에 기초하는 어드레스 펄스로 상기 어드레스 전극을 구동하는 어드레스 드라이브 회로와,
    상기 제2 전극 드라이브 회로에서의 상기 제2 전극 서스테인 펄스의 형성과 상기 스캔 펄스의 형성 중 어느 것을 행할지를 제어하는 제어 신호를 형성하는 제어 신호 형성 회로
    를 포함하고,
    상기 제1 스위치 소자와 상기 제2 스위치 소자는 대략 동등한 전류 용량과 스위칭 속도를 갖고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 제2 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스된 화소를, 상기 제1 전극 서스테인 펄스, 상기 제2 전극 서스테인 펄스에 의한 상기 제1, 제2 전극 사이의 전계에 의해 점등시키고, 상기 제2 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하여 영상 표시하도록 한 것을 특징으로 하는 디스플레이 장치.
  3. 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서,
    어드레스 전극과, 상기 어드레스 전극에 대해 방전부를 끼워 교차형으로 설치되고 상호 대략 평행하게 된 제1, 제2 전극을 포함한 표시 패널과,
    상기 제1 전극을 구동하기 위한 제1 전극 서스테인 펄스를 형성하는 제1 전극 드라이브 회로와,
    상기 제2 전극을 구동하기 위한 제2 전극 서스테인 펄스와 스캔 펄스를 형성하는 회로로서, 상기 제2 전극 서스테인 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 하이 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제1 스위치 소자와, 상기 제2 전극 서스테인 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급과 상기 스캔 펄스의 로우 레벨 전압의 상기 제2 전극으로의 공급을 행하는 제2 스위치 소자를 포함하여 구성되고, 구동하는 라인마다 설치되는 제2 전극 드라이브 회로와,
    영상 신호에 기초하는 어드레스 펄스로 상기 어드레스 전극을 구동하는 어드레스 드라이브 회로와,
    상기 스캔 펄스 형성용의 스캔 전원과 상기 제2 전극 서스테인 펄스 형성용의 서스테인 전원을 전환하는 스위치부와,
    상기 스위치부 및 상기 제2 전극 드라이브 회로에서의 상기 제2 전극 서스테인 펄스의 형성과 상기 스캔 펄스의 형성 중 어느 것을 행할지를 제어하는 제어 신호를 형성하는 제어 신호 형성 회로
    를 포함하고,
    상기 제1 스위치 소자와 상기 제2 스위치 소자는 대략 동등한 전류 용량과 스위칭 속도를 갖고, 상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 제2 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스된 화소를, 상기 제1 전극 서스테인 펄스, 상기 제2 전극 서스테인 펄스에 의한 상기 제1, 제2 전극 사이의 전계에 의해 점등시키고, 상기 제2 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하여 영상 표시하도록 한 것을 특징으로 하는 디스플레이 장치.
  4. 표시 패널의 화소의 점등에 의해 영상 표시를 행하는 디스플레이 장치에 있어서,
    어드레스 전극과, 상기 어드레스 전극에 대해 방전부를 끼워 교차형으로 설치되고 상호 대략 평행하게 된 제1, 제2 전극을 포함한 표시 패널과,
    상기 제1 전극을 구동하기 위한 제1 전극 서스테인 펄스를 형성하는 제1 전극 드라이브 회로와,
    작동 상태를 바꿈으로써 스캔 펄스의 형성과, 상기 제2 전극을 구동하기 위한 제2 전극 서스테인 펄스의 형성에 공용되는 공용 회로부를 포함하고 상기 양 펄스를 상기 제2 전극으로 출력하는 제2 전극 드라이브 회로와,
    영상 신호에 기초하는 어드레스 펄스로 상기 어드레스 전극을 구동하는 어드레스 드라이브 회로와,
    코일, 스위치 수단 및 컨덴서를 포함하고, 상기 제1 전극 드라이브 회로, 상기 제2 전극 드라이브 회로 중 어느 한쪽 또는 양쪽의 출력단에 다이오드를 통해 접속된 전력 회수 회로와,
    상기 제2 전극 드라이브 회로의 상기 작동 상태, 및 상기 스위치 수단의 작동 상태를 바꾸기 위한 제어 신호를 형성하는 제어 신호 형성 회로
    를 포함하고,
    상기 스캔 펄스와 상기 어드레스 펄스에 따라서 상기 제2 전극과 상기 어드레스 전극 사이에 형성되는 전계에 의해 화소의 어드레스 동작을 행하고, 상기 어드레스한 화소를, 상기 제1 전극 서스테인 펄스, 상기 제2 전극 서스테인 펄스에 의한 상기 제1, 제2 전극 사이의 전계에 의해 점등시키고, 상기 제2 전극 드라이브 회로를 상기 어드레스 동작과 상기 점등 동작의 양쪽에 공용하고, 또한, 상기 제1 전극 서스테인 펄스 또는 상기 제2 전극 서스테인 펄스의 펄스 하강 시에, 상기 전력 회수 회로의 상기 스위치 수단을 상기 제어 신호 형성 회로에 의해 도통 상태로 하고, 상기 코일에 의한 공진을 이용하여, 상기 제1, 제2 전극 중 어느 한쪽 또는 양쪽으로부터 전력을 상기 컨덴서측으로 회수한 상태에서 영상 표시하도록 한 것을 특징으로 하는 디스플레이 장치.
  5. 제2항에 있어서,
    상기 제2 전극 드라이브 회로가, 논리 회로부, 드라이브 회로부, 및 스위치 소자를 포함하여 구성되는 것을 특징으로 하는 디스플레이 장치.
  6. 삭제
  7. 제2항에 있어서,
    상기 제2 전극 드라이브 회로는, 출력단이 파워 MOSFET 또는 IGBT를 이용하여 구성되는 것을 특징으로 하는 디스플레이 장치.
  8. 제4항에 있어서,
    상기 전력 회수 회로의 상기 스위치 수단은, 상기 제1 전극 서스테인 펄스 또는 상기 제2 전극 서스테인 펄스의 펄스 상승 시에도, 상기 제어 신호 형성 회로에 의해 도통 상태로 되고, 상기 코일에 의한 공진을 이용하여, 상기 컨덴서측으로부터 상기 제1, 제2 전극 중 어느 한쪽 또는 양쪽에 전력을 공급하는 구성인 것을 특징으로 하는 디스플레이 장치.
  9. 제5항에 있어서,
    상기 스위치 소자는, 턴 오프 시간이 500㎱ 이하인 것을 특징으로 하는 디스플레이 장치.
  10. 제2항에 있어서,
    상기 어드레스 동작이 서브 필드의 어드레스 기간에 행해지고, 상기 점등 동작이 상기 서브 필드의 서스테인 기간에 행해지는 플라즈마 디스플레이 장치인 것을 특징으로 하는 디스플레이 장치.
  11. 제2항에 있어서,
    상기 제1, 제2 전극에 대해, 상기 제1 전극 서스테인 펄스와 제2 전극 서스테인 펄스가 상호 AC적으로 인가되는 플라즈마 디스플레이 장치인 것을 특징으로 하는 디스플레이 장치.
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