KR100349922B1 - Apparatus for driving plasma display panel - Google Patents

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Abstract

본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법은 시분할 계조 표시를 위한 서브-필드 단위로 리셋, 어드레스 및 유지-방전 단계들이 순차적으로 수행되는 구동 방법이다. 리셋 단계에서는 플라즈마 디스플레이 패널 내의 방전 공간의 상태가 초기화된다. 어드레스 단계에서는, 플라즈마 디스플레이 패널의 어드레스 전극 라인들에 인가되는 디스플레이 데이터 신호 및 어드레스 전극 라인들에 대하여 직교하게 배열된 Y 전극 라인들에 인가되는 주사 신호에 의하여 방전셀들중에서 선택된 방전셀들에 벽전하들이 형성된다. 유지-방전 단계에서는, 벽전하들이 형성된 방전셀들에서 유지-방전을 일으키기 위하여 서로 평행하게 배열된 X 및 Y 전극 라인들에 유지-방전용 펄스가 주기적으로 인가된다. 여기서, 어드레스 단계에서 인가되는 주사 신호 및 이에 상응하는 디스플레이 데이터 신호의 펄스폭은 이전 서브-필드에서의 유지-방전 단계의 수행 시간에 반비례한다.The driving method of the plasma display panel according to the present invention is a driving method in which the reset, address and sustain-discharge steps are sequentially performed in sub-field units for time division gray scale display. In the reset step, the state of the discharge space in the plasma display panel is initialized. In the addressing step, a wall is placed on the discharge cells selected from among the discharge cells by a display data signal applied to the address electrode lines of the plasma display panel and a scan signal applied to the Y electrode lines arranged orthogonally to the address electrode lines. Charges are formed. In the sustain-discharge step, sustain-discharge pulses are periodically applied to X and Y electrode lines arranged parallel to each other to cause sustain-discharge in discharge cells in which wall charges are formed. Here, the pulse width of the scan signal and corresponding display data signal applied in the address step is inversely proportional to the execution time of the sustain-discharge step in the previous sub-field.

Description

플라즈마 디스플레이 패널의 구동 방법{Apparatus for driving plasma display panel}{Apparatus for driving plasma display panel}

본 발명은, 플라즈마 디스플레이 패널의 구동 방법에 관한 것으로서, 보다 상세하게는, 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구동 방법에 관한 것이다.The present invention relates to a method of driving a plasma display panel, and more particularly, to a method of driving a plasma display panel of a three-electrode surface discharge method.

도 1은 일반적인 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여준다. 도 2는 도 1의 플라즈마 디스플레이 패널의 전극 라인 패턴을 보여준다. 도 3은 도 1의 패널의 한 방전셀을 보여준다. 도면들을 참조하면, 일반적인 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm), 유전체층(11, 15), Y 전극 라인들(Y1, ..., Yn), X 전극 라인들(X1, ..., Xn), 형광층(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.1 shows the structure of a conventional three-electrode surface discharge plasma display panel. 2 illustrates an electrode line pattern of the plasma display panel of FIG. 1. 3 shows one discharge cell of the panel of FIG. 1. Referring to the drawings, between the front and rear glass substrates 10 and 13 of the general surface discharge plasma display panel 1, the address electrode lines A R1 , A G1 , ..., A Gm , A Bm , Dielectric layers 11 and 15, Y electrode lines Y 1 , ..., Y n , X electrode lines X 1 , ..., X n , fluorescent layer 16, barrier rib 17 And a magnesium monoxide (MgO) layer 12 as a protective layer.

어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)은 뒤쪽 글라스 기판(13)의 앞면에 일정한 패턴으로 형성된다. 하부 유전체층(15)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)의 앞에서 형성된다. 하부 유전체층(15)의 앞면에는 격벽(17)들이 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 방전셀의 방전 영역을 구획하고 각 방전셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은 격벽(17)들 사이에 형성된다.The address electrode lines A R1 , A G1 ,..., A Gm , A Bm are formed in a predetermined pattern on the front surface of the rear glass substrate 13. The lower dielectric layer 15 is formed in front of the address electrode lines A R1 , A G1 ,..., A Gm , A Bm . The barrier ribs 17 are formed on the front surface of the lower dielectric layer 15 in a direction parallel to the address electrode lines A R1 , A G1 ,..., A Gm and A Bm . These partitions 17 function to partition the discharge area of each discharge cell and to prevent optical cross talk between each discharge cell. The fluorescent layer 16 is formed between the partition walls 17.

X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒷면에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 방전셀을 규정한다. 각 X 전극 라인(X1, ..., Xn)과 각 Y 전극 라인(Y1, ..., Yn)은 투명한 도전성 재질의 ITO(Indium Tin Oxide) 전극 라인(도 3의 Xna, Yna)과 금속 재질의 버스 전극 라인(도 3의 Xnb, Ynb)이 결합되어 형성된다. 상부 유전체층(11)은 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)의 뒤에 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 일산화마그네슘(MgO)층(12)은 상부 유전체층(11)의 뒷면에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.The X electrode lines (X 1 , ..., X n ) and the Y electrode lines (Y 1 , ..., Y n ) are the address electrode lines (A R1 , A G1 , ..., A Gm , A Bm ) is formed in a predetermined pattern on the rear surface of the front glass substrate 10 to be orthogonal to each other. Each intersection defines a corresponding discharge cell. Each X electrode line (X 1 , ..., X n ) and each Y electrode line (Y 1 , ..., Y n ) are indium tin oxide (ITO) electrode lines (X na in FIG. 3) of a transparent conductive material. , Y na ) and a bus electrode line (X nb , Y nb of FIG. 3) of a metal material are formed to be combined with each other. The upper dielectric layer 11 is formed after the X electrode lines X 1 ,..., X n and the Y electrode lines Y 1 ,..., Y n . A magnesium monoxide (MgO) layer 12 for protecting the panel 1 from a strong electric field is formed by applying the entire surface to the back surface of the upper dielectric layer 11. The plasma forming gas is sealed in the discharge space 14.

이와 같은 플라즈마 디스플레이 패널에 기본적으로 적용되는 구동 방식은,리셋, 어드레스 및 유지방전 단계가 단위 서브필드에서 순차적으로 수행되게 하는 방식이다. 리셋 단계에서는 이전(以前) 서브필드에서의 잔여 벽전하들이 소거되고 공간 전하들이 고르게 생성되도록 구동한다. 어드레스 단계에서는 선택된 방전셀들에서 벽전하들이 형성되도록 구동한다. 그리고 유지방전 단계에서는 어드레싱 방전 단계에서 벽전하들이 형성된 방전셀들에서 빛이 발생되도록 구동한다. 즉, 모든 X 전극 라인들(X1, ..., Xn)과 모든 Y 전극 라인들(Y1, ..., Yn)에 상대적으로 높은 전압의 펄스를 교호하게 인가하면, 벽전하들이 형성된 방전셀들에서 면 방전을 일으킨다. 이때, 가스층에서 플라즈마가 형성되고, 그 자외선 방사에 의하여 형광층(16)이 여기되어 빛이 발생된다.The driving method basically applied to the plasma display panel is a method in which reset, address, and sustain discharge steps are sequentially performed in the unit subfield. In the reset step, the residual wall charges in the previous subfield are erased and driven so that the space charges are generated evenly. In the address step, the wall charges are driven to be formed in the selected discharge cells. In the sustain discharge step, light is driven in the discharge cells in which the wall charges are formed in the addressing discharge step. That is, when a pulse of a relatively high voltage is alternately applied to all the X electrode lines X 1 , ..., X n and all the Y electrode lines Y 1 , ..., Y n , the wall charge Causes surface discharge in the formed discharge cells. At this time, a plasma is formed in the gas layer, and the fluorescent layer 16 is excited by the ultraviolet radiation to generate light.

위에서 설명된 구동 방식에 있어서, 플라즈마 디스플레이 패널에 계조 디스플레이가 수행되게 하기 위하여 단위 디스플레이 주기인 프레임을 서로 다른 디스플레이 시간의 서브필드들(subfields)로 분할하여 계조 디스플레이를 수행하는 시분할 구동 방법이 적용된다. 8비트의 영상 데이터로써 256(28) 계조 디스플레이를 수행시키기 위하여 단위 프레임마다 8개의 서브필드들이 설정되는 경우를 설명하면 다음과 같다.In the above-described driving method, in order to perform gradation display on a plasma display panel, a time division driving method is performed in which a gradation display is performed by dividing a frame, which is a unit display period, into subfields of different display times. . A case in which eight subfields are set per unit frame in order to perform 256 (2 8 ) grayscale display with 8-bit image data will be described below.

이와 같은 플라즈마 디스플레이 패널의 구동 방법에 있어서, 종래에는, 어드레스 단계에서 인가되는 주사 신호 및 이에 상응하는 상기 디스플레이 데이터 신호의 펄스폭이 모든 서브-필드들에서 언제나 일정하다. 도 4는 플라즈마 디스플레이 패널의 종래의 구동 방법을 보여준다.In such a method of driving a plasma display panel, conventionally, the pulse width of the scan signal applied in the address step and the corresponding display data signal is always constant in all the sub-fields. 4 shows a conventional driving method of a plasma display panel.

도 4를 참조하면, 단위 프레임은 시분할 계조 디스플레이를 실현하기 위하여 8 개의 서브필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브필드(SF1, ..., SF8)는 어드레스 주기(A1, ..., A8)와 유지방전 주기(S1, ..., S8)로 분할된다.Referring to FIG. 4, a unit frame is divided into eight subfields SF1,..., SF8 to realize time division gray scale display. Further, each subfield SF1, ..., SF8 is divided into address periods A1, ..., A8 and sustain discharge periods S1, ..., S8.

각 어드레스 주기(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)에 디스플레이 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 디스플레이 데이터 신호가 인가되면 상응하는 방전셀에서 어드레스 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.In each address period A1, ..., A8, a display data signal is applied to the address electrode lines (A R1 , A G1 , ..., A Gm , A Bm in FIG. 1) and each Y electrode line Scan pulses corresponding to (Y 1 , ..., Y n ) are applied sequentially. Accordingly, when a high level display data signal is applied while the scan pulse is applied, wall charges are formed by the address discharge in the corresponding discharge cell, and wall charges are not formed in the discharge cell that is not.

여기서, 각 어드레스 주기(A1, ..., A8)에서 인가되는 주사 신호 및 이에 상응하는 디스플레이 데이터 신호의 펄스폭이 모든 서브-필드들(SF1, ..., SF8)에서 언제나 일정하다.Here, the pulse widths of the scan signal and corresponding display data signal applied in each address period A1, ..., A8 are always constant in all the sub-fields SF1, ..., SF8.

각 유지방전 주기(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 유지방전용 펄스가 교호하게 인가되어, 상응하는 어드레스 주기(A1, ..., A6)에서 벽전하들이 형성된 방전셀들에서 디스플레이 방전을 일으킨다. 따라서 플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지방전 주기(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 유지방전 주기(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 디스플레이되지 않은 경우를 포함하여 256 계조로써 디스플레이할 수 있다.In each sustain discharge period (S1, ..., S8), the milky way is applied to all Y electrode lines (Y 1 , ..., Y n ) and all X electrode lines (X 1 , ..., X n ). Dedicated pulses are alternately applied, causing display discharge in discharge cells in which wall charges are formed in corresponding address periods A1, ..., A6. Therefore, the luminance of the plasma display panel is proportional to the length of the sustain discharge periods S1, ..., S8 occupy in the unit frame. The lengths of the sustain discharge cycles S1, ..., S8 occupy a unit frame are 255T (T is the unit time). Therefore, it can be displayed in 256 gray levels, including the case where it is not displayed once in a unit frame.

여기서, 제1 서브필드(SF1)의 유지방전 주기(S1)에는 20에 상응하는 시간(1T)이, 제2 서브필드(SF2)의 유지방전 주기(S2)에는 21에 상응하는 시간(2T)이, 제3 서브필드(SF3)의 유지방전 주기(S3)에는 22에 상응하는 시간(4T)이, 제4 서브필드(SF4)의 유지방전 주기(S4)에는 23에 상응하는 시간(8T)이, 제5 서브필드(SF5)의 유지방전 주기(S5)에는 24에 상응하는 시간(16T)이, 제6 서브필드(SF6)의 유지방전 주기(S6)에는 25에 상응하는 시간(32T)이, 제7 서브필드(SF7)의 유지방전 주기(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브필드(SF8)의 유지방전 주기(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.Here, the time 1T corresponding to 2 0 in the sustain discharge period S1 of the first subfield SF1 and the time corresponding to 2 1 in the sustain discharge period S2 of the second subfield SF2 2T) is, the third time (4T) corresponding to include 22 sustain discharge period (S3) of the subfield (SF3) is the fourth, the sustain discharge period (S4) of the subfield (SF4) corresponding to 23 The time 8T corresponds to 2 4 in the sustain discharge period S5 of the fifth subfield SF5, and the time 16T corresponds to 2 5 in the sustain discharge period S6 of the sixth subfield SF6. The corresponding time 32T corresponds to the time 64T corresponding to 2 6 in the sustain discharge period S7 of the seventh subfield SF7, and the sustain discharge period S8 of the eighth subfield SF8. Times 128T corresponding to 2 7 are set respectively.

이에 따라, 8 개의 서브필드들중에서 디스플레이될 서브필드를 적절히 선택하면, 어느 서브필드에서도 디스플레이되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있음을 알 수 있다.Accordingly, when the subfield to be displayed among the 8 subfields is appropriately selected, it can be seen that display of 256 gray levels can be performed including all zero (zero) gray levels that are not displayed in any of the subfields.

위에서 언급된 바와 같이, 종래의 구동 방법에 의하면, 각 어드레스 주기(A1, ..., A8)에서 인가되는 주사 신호 및 이에 상응하는 디스플레이 데이터 신호의 펄스폭이 모든 서브-필드들(SF1, ..., SF8)에서 언제나 일정하다. 그러나, 어느 한 서브-필드의 어드레스 주기(예를 들어, A2)에서의 공간 전하량은 이전(以前) 서브-필드에서의 유지-방전 주기(예를 들어, S1)에 비례한다. 따라서, 이전(以前) 서브-필드에서의 유지-방전 주기(예를 들어, S1)가 짧을수록 그 다음 서브-필드의 어드레스 주기(예를 들어, A2)에서 충분한 어드레싱이 수행되지 못하여, 화질을 떨어뜨릴 수 있다. 이러한 현상은 낮은 계조의 디스플레이 화면에서 더욱 심각하다.As mentioned above, according to the conventional driving method, the pulse widths of the scan signal and the corresponding display data signal applied in each address period A1, ..., A8 are all sub-fields SF1,. .., always constant in SF8). However, the amount of space charge in the address period (eg A2) of either sub-field is proportional to the sustain-discharge period (eg S1) in the previous sub-field. Therefore, the shorter the sustain-discharge period (eg, S1) in the previous sub-field, the less addressing is performed in the address period (eg, A2) of the next sub-field, so that image quality is improved. You can drop it. This phenomenon is more severe in low gray display screens.

본 발명의 목적은, 플라즈마 디스플레이 패널의 구동 방법에 있어서, 시분할 계조 표시를 위한 각 서브-필드에서의 어드레스 방전 특성이 균일하여 화질이 향상될 수 있게 하는 구동 방법을 제공하는 것이다.SUMMARY OF THE INVENTION An object of the present invention is to provide a driving method for driving a plasma display panel in which the address discharge characteristic in each sub-field for time division gray scale display is uniform and the image quality can be improved.

도 1은 일반적인 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.1 is a perspective view showing an internal structure of a conventional three-electrode surface discharge plasma display panel.

도 2는 도 1의 플라즈마 디스플레이 패널의 전극 라인 패턴도이다.FIG. 2 is an electrode line pattern diagram of the plasma display panel of FIG. 1.

도 3은 도 1의 패널의 한 방전셀을 보여주는 단면도이다.3 is a cross-sectional view illustrating one discharge cell of the panel of FIG. 1.

도 4는 플라즈마 디스플레이 패널의 종래의 구동 방법을 보여주는 구동 타이밍도이다.4 is a driving timing diagram illustrating a conventional driving method of the plasma display panel.

도 5는 본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법을 보여주는 구동 타이밍도이다.5 is a driving timing diagram illustrating a method of driving a plasma display panel according to the present invention.

도 6은 도 5의 구동 방법에 의한 어느 한 서브-필드에서의 구동 신호들을 보여주는 타이밍도이다.FIG. 6 is a timing diagram showing driving signals in any one sub-field by the driving method of FIG. 5.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

1...플라즈마 디스플레이 패널, 10...앞쪽 글라스 기판,1 ... plasma display panel, 10 ... front glass substrate,

11, 15...유전체층, 12...일산화마그네슘층,11, 15 dielectric layer, 12 magnesium monoxide layer,

13...뒤쪽 글라스 기판, 14...방전 공간,13 ... back glass substrate, 14 ... discharge space,

16...형광층, 17...격벽,16 fluorescent layers, 17 bulkheads,

X1, ..., Xn...X 전극 라인, Y1, ..., Yn...Y 전극 라인,X 1 , ..., X n ... X electrode line, Y 1 , ..., Y n ... Y electrode line,

AR1, AG1, ..., AGm, ABm...어드레스 전극 라인,A R1 , A G1 , ..., A Gm , A Bm ... address electrode line,

Xna, Yna...ITO 전극 라인, Xnb, Ynb...버스 전극 라인,X na , Y na ... ITO electrode line, X nb , Y nb ... bus electrode line,

SF1, ..., SF8...서브필드, A1, ..., A8...어드레스 주기,SF1, ..., SF8 ... subfield, A1, ..., A8 ... address cycle,

S1, ..., S8...유지방전 주기.S1, ..., S8 ... Diversion.

상기 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 패널의 구동 방법은 시분할 계조 표시를 위한 서브-필드 단위로 리셋, 어드레스 및 유지-방전 단계들이 순차적으로 수행되는 구동 방법이다. 상기 리셋 단계에서는 플라즈마 디스플레이 패널 내의 방전 공간의 상태가 초기화된다. 상기 어드레스 단계에서는, 상기 플라즈마 디스플레이 패널의 어드레스 전극 라인들에 인가되는 디스플레이 데이터 신호 및 상기 어드레스 전극 라인들에 대하여 직교하게 배열된 Y 전극 라인들에 인가되는 주사 신호에 의하여 방전셀들중에서 선택된 방전셀들에 벽전하들이 형성된다. 상기 유지-방전 단계에서는, 상기 벽전하들이 형성된 방전셀들에서 유지-방전을 일으키기 위하여 서로 평행하게 배열된 X 및 Y 전극 라인들에 유지-방전용 펄스가 주기적으로 인가된다. 여기서, 상기 어드레스 단계에서 인가되는 주사 신호 및 이에 상응하는 상기 디스플레이 데이터 신호의 펄스폭은 이전 서브-필드에서의 상기 유지-방전 단계의 수행 시간에 반비례한다.The driving method of the plasma display panel of the present invention for achieving the above object is a driving method in which the reset, address and sustain-discharge steps are sequentially performed in sub-field units for time division gray scale display. In the reset step, the state of the discharge space in the plasma display panel is initialized. In the address step, a discharge cell selected from among the discharge cells is selected by a display data signal applied to address electrode lines of the plasma display panel and a scan signal applied to Y electrode lines arranged orthogonally to the address electrode lines. Wall charges are formed in the field. In the sustain-discharge step, sustain-discharge pulses are periodically applied to X and Y electrode lines arranged in parallel with each other to cause sustain-discharge in the discharge cells in which the wall charges are formed. Here, the pulse width of the scan signal applied in the address step and the corresponding display data signal is inversely proportional to the execution time of the sustain-discharge step in the previous sub-field.

본 발명의 상기 구동 방법에 의하면, 전체적인 구동 시간을 연장하지 않으면서도 이전(以前) 서브-필드에서의 유지-방전 주기에 영향을 받지 않게 할 수 있다. 이에 따라, 각 서브-필드에서의 어드레스 방전 특성이 균일해지므로, 화질이 향상될 수 있다.According to the driving method of the present invention, it is possible not to be influenced by the sustain-discharge cycle in the previous sub-field without extending the overall driving time. Accordingly, the address discharge characteristic in each sub-field becomes uniform, so that the image quality can be improved.

이하, 본 발명에 따른 바람직한 실시예를 상세히 설명한다.Hereinafter, preferred embodiments of the present invention will be described in detail.

도 5를 참조하면, 단위 프레임은 시분할 계조 디스플레이를 실현하기 위하여 8 개의 서브필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브필드(SF1, ..., SF8)는 어드레스 주기(A1, ..., A8)와 유지방전 주기(S1, ..., S8)로 분할된다.Referring to FIG. 5, a unit frame is divided into eight subfields SF1,..., SF8 to realize time division gray scale display. Further, each subfield SF1, ..., SF8 is divided into address periods A1, ..., A8 and sustain discharge periods S1, ..., S8.

각 어드레스 주기(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)에 디스플레이 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 디스플레이 데이터 신호가 인가되면 상응하는 방전셀에서 어드레스 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.In each address period A1, ..., A8, a display data signal is applied to the address electrode lines (A R1 , A G1 , ..., A Gm , A Bm in FIG. 1) and each Y electrode line Scan pulses corresponding to (Y 1 , ..., Y n ) are applied sequentially. Accordingly, when a high level display data signal is applied while the scan pulse is applied, wall charges are formed by the address discharge in the corresponding discharge cell, and wall charges are not formed in the discharge cell that is not.

여기서, 각 어드레스 주기(A1, ..., A8)에서 인가되는 주사 신호 및 이에 상응하는 디스플레이 데이터 신호의 펄스폭은 이전 서브-필드에서의 유지-방전 주기(S1, ..., S8)에 반비례한다. 따라서, 각 어드레스 주기(A1, ..., A8)도 이전 서브-필드에서의 유지-방전 주기(S1, ..., S8)에 반비례해진다. 즉, A2 > A3 > A4A5 > A6 > A7 > A8 > A1의 조건식이 적용된다.Here, the pulse widths of the scan signal and the corresponding display data signal applied in each address period A1, ..., A8 are equal to the sustain-discharge periods S1, ..., S8 in the previous sub-field. Inversely Therefore, each address period A1, ..., A8 is also inversely proportional to the sustain-discharge periods S1, ..., S8 in the previous sub-field. That is, the conditional expression of A2> A3> A4A5> A6> A7> A8> A1 is applied.

각 유지방전 주기(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 유지방전용 펄스가 교호하게 인가되어, 상응하는 어드레스 주기(A1, ..., A6)에서 벽전하들이 형성된 방전셀들에서 디스플레이 방전을 일으킨다. 따라서 플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지방전 주기(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 유지방전 주기(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 디스플레이되지 않은 경우를 포함하여 256 계조로써 디스플레이할 수 있다.In each sustain discharge period (S1, ..., S8), the milky way is applied to all Y electrode lines (Y 1 , ..., Y n ) and all X electrode lines (X 1 , ..., X n ). Dedicated pulses are alternately applied, causing display discharge in discharge cells in which wall charges are formed in corresponding address periods A1, ..., A6. Therefore, the luminance of the plasma display panel is proportional to the length of the sustain discharge periods S1, ..., S8 occupy in the unit frame. The lengths of the sustain discharge cycles S1, ..., S8 occupy a unit frame are 255T (T is the unit time). Therefore, it can be displayed in 256 gray levels, including the case where it is not displayed once in a unit frame.

여기서, 제1 서브필드(SF1)의 유지방전 주기(S1)에는 20에 상응하는 시간(1T)이, 제2 서브필드(SF2)의 유지방전 주기(S2)에는 21에 상응하는 시간(2T)이, 제3 서브필드(SF3)의 유지방전 주기(S3)에는 22에 상응하는 시간(4T)이, 제4 서브필드(SF4)의 유지방전 주기(S4)에는 23에 상응하는 시간(8T)이, 제5 서브필드(SF5)의 유지방전 주기(S5)에는 24에 상응하는 시간(16T)이, 제6 서브필드(SF6)의 유지방전 주기(S6)에는 25에 상응하는 시간(32T)이, 제7 서브필드(SF7)의 유지방전 주기(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브필드(SF8)의 유지방전 주기(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.Here, the time 1T corresponding to 2 0 in the sustain discharge period S1 of the first subfield SF1 and the time corresponding to 2 1 in the sustain discharge period S2 of the second subfield SF2 2T) is, the third time (4T) corresponding to include 22 sustain discharge period (S3) of the subfield (SF3) is the fourth, the sustain discharge period (S4) of the subfield (SF4) corresponding to 23 The time 8T corresponds to 2 4 in the sustain discharge period S5 of the fifth subfield SF5, and the time 16T corresponds to 2 5 in the sustain discharge period S6 of the sixth subfield SF6. The corresponding time 32T corresponds to the time 64T corresponding to 2 6 in the sustain discharge period S7 of the seventh subfield SF7, and the sustain discharge period S8 of the eighth subfield SF8. Times 128T corresponding to 2 7 are set respectively.

이에 따라, 8 개의 서브필드들중에서 디스플레이될 서브필드를 적절히 선택하면, 어느 서브필드에서도 디스플레이되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있음을 알 수 있다.Accordingly, when the subfield to be displayed among the 8 subfields is appropriately selected, it can be seen that display of 256 gray levels can be performed including all zero (zero) gray levels that are not displayed in any of the subfields.

위에서 언급된 바와 같이, 본 발명에 따른 구동 방법에 의하면, 각 어드레스 주기(A1, ..., A8)에서 인가되는 주사 신호 및 이에 상응하는 디스플레이 데이터 신호의 펄스폭은 이전 서브-필드에서의 유지-방전 주기(S1, ..., S8)에 반비례한다. 이를 달리 표현하면, 각 어드레스 주기(A1, ..., A8)도 이전 서브-필드에서의 유지-방전 주기(S1, ..., S8)에 반비례해진다. 즉, A2 > A3 > A4 > A5 > A6 > A7 > A8 > A1의 조건식이 적용된다. 따라서, 본 발명의 상기 구동 방법에 의하면, 전체적인 구동 시간을 연장하지 않으면서도 이전(以前) 서브-필드에서의 유지-방전 주기에 영향을 받지 않게 할 수 있다. 이에 따라, 각 서브-필드(SF1, ..., SF8)에서의 어드레스 방전 특성이 균일해지므로, 화질이 향상될 수 있다.As mentioned above, according to the driving method according to the present invention, the pulse width of the scan signal and corresponding display data signal applied in each address period A1, ..., A8 is maintained in the previous sub-field. -Inversely proportional to the discharge cycle (S1, ..., S8). In other words, each address period A1, ..., A8 is also inversely proportional to the sustain-discharge periods S1, ..., S8 in the previous sub-field. That is, the conditional expression of A2> A3> A4> A5> A6> A7> A8> A1 is applied. Therefore, according to the driving method of the present invention, it is possible to be free from the sustain-discharge cycle in the previous sub-field without extending the overall driving time. Accordingly, the address discharge characteristic in each of the sub-fields SF1, ..., SF8 becomes uniform, so that image quality can be improved.

도 6은 도 5의 구동 방법에 의한 어느 한 서브-필드에서의 구동 신호들을 보여준다.FIG. 6 shows driving signals in any one sub-field by the driving method of FIG. 5.

도 6에서 참조부호 SA는 각 어드레스 전극 라인(도 1의 AR1, AG1, ..., AGm, ABm)에 인가되는 구동 신호를, Sx는 X 전극 라인들(도 1의 X1, ..., Xn)에 인가되는 구동 신호를, 그리고 SY1, ..., SYn은 각 Y 전극 라인(도 1의 Y1, ..., Yn)에 인가되는 구동 신호를 가리킨다. 도 5를 참조하면, 단위 서브-필드(SF)에서의 어드레스주기(A)는 리셋 주기(A1, A2, A3)와 주 어드레스 주기(A4)로 구분된다.In FIG. 6, reference numeral S A denotes a drive signal applied to each address electrode line (A R1 , A G1 ,..., A Gm , A Bm of FIG. 1), and S x denotes X electrode lines (FIG. 1). X 1 , ..., X n ) drive signal applied to, and S Y1 , ..., S Yn is applied to each Y electrode line (Y 1 , ..., Y n in FIG. 1) Point to a signal. Referring to FIG. 5, the address period A in the unit sub-field SF is divided into a reset period A1, A2, A3 and a main address period A4.

표시방전 주기(S)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 X 전극 라인들(X1, ..., Xn)에 정극성 전압 VXB보다 높은 전압 VS의 공통 펄스가 교호하게 인가되어, 상응하는 어드레스 주기(A)에서 벽전하들이 형성된 방전-셀들에서 표시방전을 일으킨다. 이 표시방전 주기(S)에서 최종 펄스가 X 전극 라인들(X1, ..., Xn)에 인가되는 경우, 선택되어 표시된 방전-셀들의 X 전극 주위에는 전자들이, 그리고 Y 전극 주위에는 양전하들이 형성된다. 이에 따라 제1 리셋 주기(A1)에서는, X 전극 라인들(X1, ..., Xn)에 정극성 전압 VXB보다 낮은 전압 VRX가 인가되어, 벽전하들을 일차적으로 소거시키는 방전이 수행된다. 또한, 제2 리셋 주기(A2)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)에 전압 VS의 세폭 펄스가 인가되어, 남아있는 벽전하들을 이차적으로 소거시키는 방전이 수행된다. 그리고, 제3 리셋 주기(A3)에서는, X 전극 라인들(X1, ..., Xn)에 전압 VRX가 다시 인가되어, 벽전하들을 최종적으로 소거시키는 방전이 수행된다. 이에 따라 방전 공간 내에는 모든 벽전하들이 소거될 수 있고 공간 전하들이 균일하게 분포될 수 있다.In the display discharge period S, the voltage V higher than the positive polarity voltage V XB in all the Y electrode lines Y 1 , ..., Y n and the X electrode lines X 1 , ..., X n . A common pulse of S is applied alternately, causing display discharge in the discharge-cells in which wall charges are formed in the corresponding address period A. FIG. In this display discharge period S, when the last pulse is applied to the X electrode lines X 1 ,..., X n , electrons are around the X electrode of the selected and displayed discharge-cells, and around the Y electrode. Positive charges are formed. Accordingly, in the first reset period A1, a voltage V RX lower than the positive voltage V XB is applied to the X electrode lines X 1 ,..., X n , so that a discharge for first erasing the wall charges is generated. Is performed. In addition, in the second reset period A2, a narrow pulse of voltage V S is applied to all of the Y electrode lines Y 1 ,..., Y n to perform discharge to secondly erase remaining wall charges. do. In the third reset period A3, the voltage V RX is applied again to the X electrode lines X 1 ,..., X n to perform a discharge for finally erasing wall charges. Accordingly, all the wall charges can be erased and the space charges can be uniformly distributed in the discharge space.

주 어드레스 주기(A4)에서는, 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 각 어드레스 전극 라인(AR1, AG1, ..., AGm, ABm)에 인가되는 표시 데이터 신호는 방전-셀을 선택할 경우에 정극성 전압 Va가, 그렇지 않을 경우에 접지 전압인 0 [V]가 인가된다. 각 Y 전극 라인(Y1, ..., Yn)에는, 주사되지 않는 시간에 바이어스 전압 VYB가 인가되며, 주사되는 시간에 0 [V]가 인가된다. 이에 따라 0 [V]의 주사 펄스가 인가되는 동안에 전압 Va의 표시 데이터 신호가 인가되면 상응하는 방전-셀에서 어드레스 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전-셀에서는 벽전하들이 형성되지 않는다. 여기서, 보다 정확하고 효율적인 어드레스 방전을 위하여, X 전극 라인들(X1, ..., Xn)에 전압 VS보다 낮고 VYB보다 높은 전압 VXB가 인가된다.In the main address period A4, the display data signal is applied to the address electrode lines A R1 , A G1 , ..., A Gm , A Bm and at the same time, each Y electrode line Y 1 , ..., Y scan pulses corresponding to n ) are applied sequentially. The display data signal applied to each of the address electrode lines A R1 , A G1 , ..., A Gm , A Bm has a positive polarity Va when the discharge-cell is selected, and a ground voltage of 0 [otherwise. V] is applied. The bias voltage V YB is applied to each of the Y electrode lines Y 1 ,..., And Y n at a time not being scanned, and 0 [V] is applied at the time of being scanned. Accordingly, when the display data signal of voltage Va is applied while the scan pulse of 0 [V] is applied, wall charges are formed by the address discharge in the corresponding discharge cell, and wall charges are not formed in the discharge cell. . Here, for more accurate and efficient address discharge, the voltage V XB lower than the voltage V S and higher than V YB is applied to the X electrode lines X 1 ,..., X n .

위에서 언급된 바와 같이, 주 어드레스 주기(A4)에서 인가되는 주사 신호 및 이에 상응하는 디스플레이 데이터 신호의 펄스폭(TA)은 이전 서브-필드에서의 유지-방전 주기(S1, ..., S8)에 반비례한다. 이에 따라, 전체적인 구동 시간을 연장하지 않으면서도 이전(以前) 서브-필드에서의 유지-방전 주기에 영향을 받지 않게 할 수 있다. 이에 따라, 각 서브-필드(SF)에서의 어드레스 방전 특성이 언제나 균일해지므로, 화질이 향상될 수 있다.As mentioned above, the pulse width T A of the scan signal and the corresponding display data signal applied in the main address period A4 is the sustain-discharge period S1, ..., S8 in the previous sub-field. Inversely proportional to Thus, it is possible to be free from the sustain-discharge cycle in the previous sub-field without extending the overall driving time. Accordingly, since the address discharge characteristic in each sub-field SF is always uniform, the image quality can be improved.

이상 설명된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동 방법에 의하면, 전체적인 구동 시간을 연장하지 않으면서도 이전(以前) 서브-필드에서의 유지-방전 주기에 영향을 받지 않게 할 수 있다. 이에 따라, 각 서브-필드에서의 어드레스 방전 특성이 균일해지므로, 화질이 향상될 수 있다.As described above, according to the driving method of the plasma display panel according to the present invention, it is possible not to be influenced by the sustain-discharge cycle in the previous sub-field without extending the overall driving time. Accordingly, the address discharge characteristic in each sub-field becomes uniform, so that the image quality can be improved.

본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.The present invention is not limited to the above embodiments, but may be modified and improved by those skilled in the art within the spirit and scope of the invention as defined in the claims.

Claims (1)

시분할 계조 표시를 위한 서브-필드 단위로 리셋, 어드레스 및 유지-방전 단계들이 순차적으로 수행되고, 상기 리셋 단계에서 플라즈마 디스플레이 패널 내의 방전 공간의 상태가 초기화되며, 상기 어드레스 단계에서, 상기 플라즈마 디스플레이 패널의 어드레스 전극 라인들에 인가되는 디스플레이 데이터 신호 및 상기 어드레스 전극 라인들에 대하여 직교하게 배열된 Y 전극 라인들에 인가되는 주사 신호에 의하여 방전셀들중에서 선택된 방전셀들에 벽전하들이 형성되고, 상기 유지-방전 단계에서, 상기 벽전하들이 형성된 방전셀들에서 유지-방전을 일으키기 위하여 서로 평행하게 배열된 X 및 Y 전극 라인들에 유지-방전용 펄스가 주기적으로 인가되는 플라즈마 표시 패널의 구동 방법에 있어서,Reset, address, and sustain-discharge steps are sequentially performed in sub-field units for time division gray scale display, and in the reset step, the state of the discharge space in the plasma display panel is initialized, and in the address step, Wall charges are formed in the discharge cells selected from among the discharge cells by the display data signal applied to the address electrode lines and the scan signal applied to the Y electrode lines arranged perpendicular to the address electrode lines. In the discharge step, the driving method of the plasma display panel in which the sustain-discharge pulses are periodically applied to the X and Y electrode lines arranged in parallel to each other in order to cause sustain-discharge in the discharge cells in which the wall charges are formed , 상기 어드레스 단계에서 인가되는 주사 신호 및 이에 상응하는 상기 디스플레이 데이터 신호의 펄스폭이 이전 서브-필드에서의 상기 유지-방전 단계의 수행 시간에 반비례하는 구동 방법.And the pulse width of the scan signal applied in the address step and the corresponding display data signal is inversely proportional to the execution time of the sustain-discharge step in a previous sub-field.
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