KR100299900B1 - 병렬 접속된 고역 통과신호 경로와 저역 통과신호 경로를 갖는반도체 이상기 - Google Patents
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Abstract
반도체 이상기에 있어서, 고역통과 신호경로와 저역통과 신호경로가 입력단자 (IN) 와 출력단자 (OUT) 사이에 병렬로 접속된다. 고역통과 신호경로는 λ/4 의 실효길이를 갖고 입력단자와 출력단자에 접속된 제 1 및 제 2 전송선, 상기 제 1 전송선과 상기 제 2 전송선 간에 접속된 하나이상의 제 1 전계효과 트랜지스터, 및 상기 제 1 전계효과 트랜지스터들중의 하나의 트랜지스터와 접지단자에 접속된 2개이상의 제 2 전계효과 트랜지스터를 구비하며, 여기서 λ 는 전파하는 신호의 파장이다. 저역통과 경로는 λ/4 의 실효길이를 갖고 입력단자와 출력단자에 접속된 제 4 및 제 5 전송선, 상기 제 4 전송선과 상기 제 5 전송선 간에 접속된 하나이상의 제 6 전송선, 및 상기 제 6 전송선과 접지단자에 각각 접속된 2개이상의 제 2 전계효과 트랜지스터를 구비한다. 제 3 및 제 6 전송선은 각각 인덕터로서 기능한다.
Description
본 발명은 위상 어레이 레이터 등에 사용되는 반도체 이상기 (phase shifter; 移相器) 에 관한 것이다.
제 1 종래의 반도체 이상기 (1972년 5월자로 발행된 IEEE Trans. of Microwave Theory and Techniques, Vol.MTT-20, No. 5, 페이지 314∼323, Robert V. Garrer 의 "Broad-Band Diode Phase Shifters" 참조) 에서는, T형 고역통과 필터 및 T형 저역통과 필터가 스위치를 배열하여 스위치된다. 이는 차후에 좀더 자세히 설명하기로 한다.
그러나, 이 제 1 종래기술의 반도체 이상기에서는, 2가지 제어 바이어스가 필요하여, 2개의 스위치가 요구되므로, 큰 삽입손실 (insertion loss) 이 발생되게 된다.
또, 제 2 종래기술의 반도체 이상기 (JPA 1-202007 호 참조)에서는, 단지하나의 제어 바이어스만이 제공된다. 이 또한, 차후에 좀더 상세히 설명하기로 한다.
그러나, 이 제 2 종래기술의 반도체 이상기에서는, 전파신호의 주파수가 원하는 주파수로부터 소량 천이하는 경우에도, 위상 변이가 벗어나게 되어, 반도체 이상기가 협대역이 된다.
따라서, 본 발명의 목적은 삽입손실을 저감시키면서도 증대된 복귀손실 뿐만 아니라 넓은 동작 대역폭을 얻는 것이 가능한 반도체 이상기를 제공하는데 있다.
본 발명에 따르면, 반도체 이상기에 있어서, 고역통과 신호경로와 저역통과 신호경로가 입력단자와 출력단자 사이에서 병렬로 접속된다. 고역통과 경로는 λ/4 의 실효길이를 갖고 입력단자와 출력단자에 접속된 제 1 및 제 2 전송선, 상기 제 1 전송선과 상기 제 2 전송선 간에 접속된 하나이상의 제 1 전계효과 트랜지스터, 및 상기 제 1 전계효과 트랜지스터와 접지단자에 접속된 2개이상의 제 2 전계효과 트랜지스터를 구비하며, 여기서 λ 는 전파하는 신호의 파장이다. 저역통과 경로는 λ/4 의 실효길이를 갖고 입력단자와 출력단자에 접속된 제 4 및 제 5 전송선, 상기 제 4 전송선과 상기 제 5 전송선 간에 접속된 하나이상의 제 6 전송선, 및 상기 제 6 전송선과 접지단자에 각각 접속된 2개이상의 제 2 전계효과 트랜지스터를 구비한다. 제 3 및 제 6 전송선은 각각 인덕터로서 기능한다.
이하, 첨부도면을 참조하여, 종래기술과 비교하여 설명한 하기 설명으로부터 본 발명을 명확히 이해할 수 있을 것이다.
도 1 은 제 1 종래기술의 반도체 이상기를 나타낸 회로도.
도 2 는 제 2 종래기술의 반도체 이상기를 나타낸 회로도.
도 3a 및 3b 는 고역통과 경로가 활성화되고 저역통과 경로가 비활성화된, 도 2 의 반도체 이상기의 등가회로도.
도 4 는 저역통과 경로가 활성화되고 고역통과 경로가 비활성화된, 도 2 의 반도체 이상기의 등가 회로도.
도 5 는 본 발명에 따른 반도체 이상기의 제 1 실시예를 나타낸 회로도.
도 6a 내지 6b 는 도 5 의 반도체 이상기의 등가 회로도.
도 7 은 도 5 의 반도체 이상기의 위상변이 특성을 나타낸 그래프.
도 8 은 본 발명에 따른 반도체 이상기의 제 2 실시예를 나타낸 회로도.
도 9a 및 9b 는 도 8 의 반도체 이상기의 등가 회로도.
도 10 은 도 8 의 반도체 이상기의 위상변이 특성을 나타낸 그래프.
도 11 은 본 발명에 따른 반도체 이상기의 제 3 실시예를 나타낸 회로도.
도 12 는 도 11 의 반도체 이상기의 위상변이 특성을 나타낸 그래프.
도 13 은 도 5 의 반도체 이상기의 변형예를 나타낸 회로도.
※ 도면의 주요부분에 대한 부호의 설명
1a, 1b, 2a, 2b, 2c, 5a, 5b, 6a 및 6b : 전송선
3a, 3b, 7a, 7b 및 7c : FET 4 : 분리 레지스터
8 : 분리 레지스터 9 : 분포상수 FET
103 및 104 : 스위치 CONT1 및 CONT2 : 제어단자
바람직한 실시예를 설명하기 전에, 도 1, 2, 3a, 3b 및 4 를 참조하여, 종래기술의 반도체 이상기를 설명하기로 한다.
제 1 종래기술의 반도체 이상기 (1972년 5월자로 발행된 IEEE Trans. of Microwave Theory and Techniques, Vol.MTT-20, No. 5, 페이지 314∼323, Robert V. Garrer 의 "Broad-Band Diode Phase Shifters" 참조) 를 나타낸 도 1 에서는, 스위치 (103 및 104) 를 배열하여, T형 고역통과 필터 (101) 및 T형 저역통과 필터 (102) 를 스위칭한다. 고역통과 필터 (101) 는 캐패시터 (1011 및 1012) 및 션트(shunt) 캐패시터 (1013) 와 직렬로 형성되어 위상 선행을 제공한다. 저역통과 필터 (102) 는 캐패시터 (1021 및 1022) 및 션트(shunt) 캐패시터 (1023) 와 직렬로 형성되어 위상 지연을 제공한다. 참조부호 IN 은 입력단자를 지시하고 OUT 는 출력단자를 나타낸다.
도 1 에서는, 고역통과 필터 (101) 가 활성화되고 저역통과 필터 (102) 가 비활성화되는 경우에는, 무선 주파수 신호의 위상 (φH) 은,
로 표현되며, 이때, X 는 정규화 리액턴스이며, B 는 정규화된 서셉턴스이다.
한편, 도 1 에서, 저역통과 필터 (102) 가 활성화되고 고역통과 필터 (101) 가 비활성화되는 경우에는, 위상 (φL) 은,
로 표현된다.
따라서, 식 1 및 식 2 로부터, 위상변이 (△φ) 는,
로 주어진다.
그러나, 도 1 의 반도체 이상기는, 2개의 제어 바이어스가 필요하여, 2개의 스위치 (103 및 104) 가 요구되므로, 큰 삽입손실을 발생하게 된다.
제 2 종래기술의 이상기 (JPA 1-202007호 참조) 를 나타낸 도 2 에서는, 단지 하나의 제어 바이어스가 제공된다. 즉, 직렬 인덕터 (201 및 202), 션트 캐패시터 (203) 및 병렬 인덕터 (204) 가 제공된다. 또한, 그 인덕터 (201) 과 인덕터 (202) 사이에 전계효과 트랜지스터 (TFT) 로 구성된 스위치 (205) 가 접속되며, 병렬 인덕터 (204) 에 FET 로 구성된 스위치 (206) 가 직렬 접속된다. FET (205 및 206) 는 제어단자 (CONT) 에서 전압에 의해 제어됨에 주의하여야 한다.
도 2 에서, FET (205 및 206) 가 턴-온되는 경우, 인덕터 (201 및 202) 의 종점이 회로단락되며, 도 2 의 회로가, 도 3a 에 나타낸 바와 같이, T형 고역통과 필터로 변화된다. 이때, 만약 캐패시터 (203) 의 용량 (C) 및 인덕터 (204) 의 인덕턴스 (L) 가, 소망의 주파수 (f0), 즉,
에서 공진회로를 형성하도록 선택되면, 도 2 의 회로는 도 3b 에 나타낸 바와 같이 간단한 회로로 표현될 수 있다.
한편, 도 2 에서, FET (205 및 206) 가 턴-오프되는 경우에는, 도 2 의 회로는 도 4 에 나타낸 바와 같이 T형 저역통과 필터로서 표현될 수 있다.
그러므로, 식 4 로부터, 위상변이 (△φ)는,
으로 주어진다.
그러나, 도 2 의 반도체 이상기는, 만약 전파 신호의 주파수가 원하는 주파수 f0로부터 조금이라도 변이되게 되면, 위상변이 (△φ) 가 이탈하여, 도 2 의 반도체 이상기는 협대역이 된다.
본 발명의 제 1 실시예를 나타낸 도 5 에서, 고역통과신호 경로는 실효길이 (λ/4, 3λ/4, 5λ/4, ... ) 를 각각 가지는 전송선 (1a 및 1b), 인덕터로서기능하는 전송선 (2a, 2b 및 2c), 및 전송선 (1a) 과 전송선 (1b) 사이에 접속되어 분리 레지스터 (4) 를 통하여 제어단자 (CONT1) 의 전압에 의해 제어되는 FET (3a 및 3b) 로 형성된 스위치로 구성되며, 여기서, λ 는 전파하는 신호의 실효길이이다.
또한, 저역통과 신호 경로는 실효길이 (λ/4, 3λ/4, 5λ/4, ... ) 를 각각 가지는 전송선 (5a 및 5b), 전송선 (5a) 과 전송선 (5b) 사이에 접속되어 인덕터로서 기능하는 전송선 (6a), 및 전송선 (5a) 과 전송선 (5b) 사이에 접속되어 분리 레지스터 (8) 를 통해 제어단자 (CONT1) 의 전압에 의해 제어되는 FET (7a 및 7b) 로 형성된 스위치로 구성된다.
일반적으로, 각 전송선 (1a, 1b, 5a 및 5b) 의 실효길이는, 서로 다를 수도 있으며, (2n+1)λ/4 로 표현되며, 여기서 n 은 0, 1, 2, ...... 이다.
도 5 에서, FET (3a 및 3b) 가 제어단자 (CONT1) 의 전압에 의해 오프되고 FET (7a 및 7b) 가 제어단자 (CONT2) 의 전압에 의해 온되는 경우에, 도 5 의 회로는 도 6a 에 나타낸 바와 같이 고역통과 필터로 변화되어 위상선행을 제공한다. 이때, 전송선 (5a 및 5b) 이 접지되므로, 이로부터 어떠한 반사도 발생되지 않게 된다.
한편, 도 5 에서, FET (3a 및 3b) 가 제어단자 (CONT1) 의 전압에 의해 온되고 FET (7a 및 7b) 가 제어단자 (CONT2) 의 전압에 의해 오프되는 경우에, 도 5 의 회로는 도 6b 에 나타낸 바와 같이 저역통과 필터로 변화되어 위상지연을 제공한다. 이때, 전송선 (1a 및 1b) 이 접지되므로, 이로부터 어떠한 반사도 발생되지 않게 된다.
도 5 의 반도체 이상기에서는, FET (3a, 3b, 7a 및 7b) 가 인덕터 뿐만 아니라 고역통과 경로 및 저역통과 경로를 스위칭하는 스위치로서 기능하므로, 도 1 의 반도체 이상기의 스위치 (103 및 104) 가 불필요하게 되어, 삽입손실이 저감되게 된다.
도 5 의 반도체 이상기의 예에서는, 각 FET (3a, 3b, 7a 및 7b) 는 0.15㎛ 의 게이트길이와 100㎛ 의 게이트 폭을 갖는 AlGaAs 이종접합 FET 이다. 이 경우, 이 FET 가 오프되는 경우 용량은 40fF 이고, 이 FET 가 온되는 경우에는 온 저항은 8Ω 이다. 각 전송선 (1a 및 1b) 이 10㎛ 의 폭과 280㎛의 길이를 가지는 마이크로스트립 (microstrip) 선이며, 각 전송선 (2a, 2b 및 2c) 은 10㎛ 의 폭과 190㎛의 길이를 가지는 마이크로스트립 선이다. 또한, 각 전송선 (5a 및 5b) 은 10㎛ 의 폭과 350㎛의 길이를 가지는 마이크로스트립 선이며, 전송선 (6a) 은 10㎛ 의 폭과 260㎛의 길이를 가지는 마이크로스트립 선이다. 상술한 도 5 의 반도체 이상기의 예의 위상특성은 도 7 에 나타낸 바와 같다. 즉, 위상변위는 77GHz 의 주파수에서 43.4° 이다. 또, 70 GHz 내지 80 GHz 의 넓은 대역폭에 걸쳐서 우수한 위상변이가 관찰된다. 또, 77GHz 에서의 삽입손실이 작으며 1.2 dB 이하이고, 77 GHz 에서의 복귀손실은 크고 25dB 이상이다.
본 발명의 제 2 실시예를 나타낸 도 8 에서는, 도 5 의 전송선 (6a) 과 동일구조를 가지는 전송선 (6b), 및 FET (7a 및 7b) 와 동일한 구조를 가지는 FET(7c) 로 형성된 스위치가 도 5 의 저역통과 신호 경로에 부가된다.
도 8 에서, FET (3a 및 3b) 가 제어단자 (CONT1) 의 전압에 의해 오프되고 FET (7a, 7b 및 7c) 가 제어단자 (CONT2) 의 전압에 의해 온되는 경우, 도 8 의 회로는 도 9a 에 나타낸 바와 같이 고역통과 필터로 변화되어, 위상선행을 제공한다. 이 경우, 전송선 (5a 및 5b) 이 접지되므로, 이로부터 어떠한 반사도 일어나지 않게 된다.
한편, 도 8 에서, FET (3a 및 3b) 가 제어단자 (CONT1) 의 전압에 의해 온되고 FET (7a, 7b 및 7c) 가 제어단자 (CONT2) 의 전압에 의해 오프되는 경우, 도 8 의 회로는 도 9b 에 나타낸 바와 같이 저역통과 필터로 변화되어, 위상지연을 제공한다.
또한, 도 8 의 반도체 이상기는, FET (3a, 3b, 7a, 7b 및 7c) 가 인덕터 뿐만 아니라 고역통과 신호경로와 저역통과 신호경로를 스위칭하는 스위치로서 기능하므로, 도 1 의 반도체 이상기의 스위치 (103 및 104) 가 불필요하게 되어, 삽입손실이 감소되게 된다.
상술한 예와 동일한 사이즈 특성을 갖는 도 8 의 반도체 이상기의 위상 특성은 도 10 에 나타낸 바와 같다. 즉, 위상변이는 75 GHz 의 주파수에서 93.3° 이다. 또, 70 GHz 내지 80GHz 의 넓은 대역폭에 걸쳐서 우수한 위상변이가 관찰된다. 또, 75 GHz 에서의 삽입손실이 작으며 1.3 dB 이하이고, 75 GHz 에서의 복귀손실은 크며 22 dB 이상이다.
본 발명의 제 3 실시예를 나타낸 도 11 에서는, 분포상수 FET (9) 가 도8 의 전송선 (6a 및 6b) 및 FET (7a, 7b 및 7c) 대신에 제공된다. 이 분포상부 FET (9) 는 게이트 전극과 이 게이트 전극을 샌드위치시키는 제 1 및 제 2 오믹 전극을 구비한 트랜지스터, 및 이 트랜지스터를 포위하는 활성층 (active layer) 으로 구성되며, 제 1 오믹전극은 접지되며 제 2 오믹전극의 단부는 FET (9) 의 입출력 단자로 기능한다. 분포상수 FET (9) 의 게이트 전극은 분리 레지스터 (8) 를 통하여 제어단자 (CONT2) 에 접속된다.
도 11 의 반도체 이상기의 예에서, 각 FET (3a 및 3b) 는 0.15㎛ 의 게이트 길이와 100㎛ 의 게이트 폭을 갖는 AlGaAs 이종접합 FET 이다. 이 경우, 이 FET 가 오프되는 경우, 용량은 40fF 이며, 이 FET 가 온되는 경우, 온 저항은 8Ω 이다.
각 전송선 (1a 및 1b) 이 10㎛ 의 폭과 280㎛의 길이를 가지는 마이크로스트립 선이며, 각 전송선 (2a, 2b 및 2c) 은 10㎛ 의 폭과 190㎛의 길이를 가지는 마이크로스트립 선이다. 또한, 각 전송선 (5a 및 5b) 은 10㎛ 의 폭과 190㎛의 길이를 가지는 마이크로스트립 선이다. 또, 분포상수 FET (9) 는 30㎛ 의 드레인 전극폭과 400㎛의 게이트 핑거 길이를 갖는다. 상술한 도 11 의 반도체 이상기의 예의 위상특성은 도 12 에 나타낸 바와 같다. 즉, 이상기는 77GHz 의 주파수에서 24.8° 이다. 또, 70 GHz 내지 80 GHz 의 넓은 대역폭에 걸쳐서 우수한 위상변이가 관찰된다. 또, 77GHz 에서의 삽입손실이 작으며 1.4 dB 이하이고, 77 GHz 에서의 복귀손실은 크고 23dB 이상이다.
상술한 실시예에서는, 3개의 전송선 (2a, 2b 및 2c) 및 2개의 FET (3a 및3b) 가 고역통과 신호경로에 제공되었지만, 2개, 4개이상의 전송선과, 1개, 3개이상의 FET 가 제공될 수도 있다. 이와 유사하게, 제 1 및 제 2 실시예에서는, 1개 또는 2개의 전송선 (6a 및 6b) 및 2개 또는 3개의 FET (7a, 7b 및 7c) 가 저역통과신호경로로서 제공되었지만, 3개이상의 전송선과 4개이상의 FET 가 제공될 수도 있다. 또한, FET 는 MOS 트랜지스터로 구성될 수도 있다.
또한, 본 발명은 도 13 에 나타낸 바와 같은 T형 고역통과 필터를 갖는 반도체 이상기에도 응용할 수 있다.
이상 설명한 바와 같이, 본 발명에 따르면, 삽입손실이 저감될 수 있으며, 또한, 넓은 동작 대역폭이 얻어질 수 있다. 또한, 복귀손실이 증대될 수 있다.
Claims (12)
- 입력단자 (IN);출력단자 (OUT); 및상기 입력단자와 상기 출력단자 사이에서 병렬 접속된 고역통과 신호경로와 저역통과 신호경로를 구비하되,상기 고역통과 신호경로는,상기 입력단자에 접속되며 (2n1+1)·λ/4 (n1= 0, 1, 2, ....) 의 실효길이를 갖는 제 1 전송선으로서, 이때 λ 는 전파하는 신호의 파장인, 제 1 전송선 (1a);상기 출력단자에 접속되며 (2n2+1)·λ/4 (n2=0, 1, 2,...) 의 실효길이를 갖는 제 2 전송선 (1b);상기 제 1 전송선과 상기 제 2 전송선 간에 접속된 하나 이상의 제 1 전계효과 트랜지스터 (3a, 3b); 및상기 제 1 전계효과 트랜지스터와 접지단자에 각각 접속되어, 인덕터로서 각각 기능하는 2개 이상의 제 3 전송선 (2a, 2b, 2c) 를 구비하고,상기 저역통과 신호경로는,상기 입력단자에 접속되며 (2n3+1)·λ/4 (n3= 0, 1, 2, ....) 의 실효길이를 갖는 제 4 전송선 (5a);상기 출력단자에 접속되며 (2n4+1)·λ/4 (n4=0, 1, 2,...) 의 실효길이를 갖는 제 5 전송선 (5b);상기 제 4 전송선과 상기 제 5 전송선 간에 접속되어 인덕터로서 각각 기능하는 하나이상의 제 6 전송선 (6a, 6b); 및상기 제 6 전송선과 상기 접지단자에 각각 접속된 2개이상의 제 2 전계효과 트랜지스터 (7a, 7b, 7c) 를 구비하는 것을 특징으로 하는 반도체 이상기.
- 제 1 항에 있어서,상기 제 6 전송선과 상기 제 2 전계효과 트랜지스터는 분포상수 전계효과 트랜지스터로 이루어지는 것을 특징으로 하는 반도체 이상기.
- 제 2 항에 있어서,상기 분포상수 전계효과 트랜지스터는,제 1 및 제 2 오믹전극에 의해 샌드위치되며, 상기 제 1 및 제 2 오믹전극의 단부가 상기 분포상수 트랜지스터의 입출력단자로서 기능하는, 트랜지스터; 및상기 트랜지스터를 포위하는 활성층을 구비하는 것을 특징으로 하는 반도체 이상기.
- 제 1 항에 있어서,상기 제 1 전계효과 트랜지스터의 게이트 전극에 접속된 제 1 제어단자 (CONT1); 및상기 제 2 전계효과 트랜지스터의 게이트전극에 접속된 제 2 제어단자 (CONT2) 를 더 구비하는 것을 특징으로 하는 반도체 이상기.
- 제 1 항에 있어서,상기 제 1 및 제 2 전계효과 트랜지스터는 각각 AlGaAs 이종접합 전계효과 트랜지스터를 포함하는 것을 특징으로 하는 반도체 이상기.
- 제 1 항에 있어서,상기 제 1 및 제 2 전계효과 트랜지스터는 각각 MOS 전계효과 트랜지스터를 포함하는 것을 특징으로 하는 반도체 이상기.
- 입력단자 (IN);출력단자 (OUT); 및상기 입력단자와 상기 출력단자 사이에서 병렬 접속된 고역통과 신호경로와 저역통과 신호경로를 구비하되,상기 고역통과 신호경로는,상기 입력단자에 접속되며 (2n1+1)·λ/4 (n1= 0, 1, 2, ....) 의 실효길이를 갖는 제 1 전송선으로서, 이때 λ 는 전파하는 신호의 파장인, 제 1 전송선 (1a);상기 출력단자에 접속되며 (2n2+1)·λ/4 (n2=0, 1, 2,...) 의 실효길이를 갖는 제 2 전송선 (1b);상기 제 1 전송선과 상기 제 2 전송선 간에 접속된 2개이상의 제 1 전계효과 트랜지스터 (3a, 3b); 및상기 제 1 전계효과 트랜지스터와 접지단자에 접속되어, 인덕터로서 기능하는 하나이상의 제 3 전송선 (2a, 2b, 2c) 를 구비하고,상기 저역통과 신호경로는,상기 입력단자에 접속되며 (2n3+1)·λ/4 (n3= 0, 1, 2, ....) 의 실효길이를 갖는 제 4 전송선 (5a);상기 출력단자에 접속되며 (2n4+1)·λ/4 (n4=0, 1, 2,...) 의 실효길이를 갖는 제 5 전송선 (5b);상기 제 4 전송선과 상기 제 5 전송선 간에 접속되어 인덕터로서 각각 기능하는 하나이상의 제 6 전송선 (6a, 6b); 및상기 제 6 전송선과 상기 접지단자에 각각 접속된 2개이상의 제 2 전계효과 트랜지스터 (7a, 7b, 7c) 를 구비하는 것을 특징으로 하는 반도체 이상기.
- 제 7 항에 있어서,상기 제 6 전송선과 상기 제 2 전계효과 트랜지스터는 분포상수 전계효과 트랜지스터로 이루어지는 것을 특징으로 하는 반도체 이상기.
- 제 8 항에 있어서,상기 분포상수 전계효과 트랜지스터는,제 1 및 제 2 오믹전극에 의해 샌드위치되며, 상기 제 1 및 제 2 오믹전극의 단부가 상기 분포상수 트랜지스터의 입출력단자로서 기능하는, 트랜지스터; 및상기 트랜지스터를 포위하는 활성층을 구비하는 것을 특징으로 하는 반도체 이상기.
- 제 7 항에 있어서,상기 제 1 전계효과 트랜지스터의 게이트 전극에 접속된 제 1 제어단자 (CONT1); 및상기 제 2 전계효과 트랜지스터의 게이트전극에 접속된 제 2 제어단자 (CONT2) 를 더 구비하는 것을 특징으로 하는 반도체 이상기.
- 제 7 항에 있어서,상기 제 1 및 제 2 전계효과 트랜지스터는 각각 AlGaAs 이종접합 전계효과트랜지스터를 포함하는 것을 특징으로 하는 반도체 이상기.
- 제 7 항에 있어서,상기 제 1 및 제 2 전계효과 트랜지스터는 각각 MOS 전계효과 트랜지스터를 포함하는 것을 특징으로 하는 반도체 이상기.
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