KR100252400B1 - 디지탈 신호 기록장치 - Google Patents

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야코부스 반 게스텔 빌헬무스
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요트.게.아. 롤페즈
코닌클리케 필립스 일렉트로닉스 엔.브이.
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Abstract

헬리컬 주사 레코더에서 n-비트 제1코드워드(W1) 및 n-비트 제2코드워드(W2)의 순서는 어떤 경우, 트랙(T1, T2...)의 시초를 형성하는 제2트랙 부분(TP2)에 기억되며 상기 코드워드는 2개의 PR1 검출 및 PR4 검출이 재생가능하도록 형성된다.
상기 제2코드워드는 제1코드워드의 반전 형태이다.
제1코드워드의 선택은 다음과 같다. 즉, "0001110001110000011100011"이다.

Description

디지탈 신호 기록장치
제1도 내지 제5도는 다수의 디지탈 신호에 대한 PR1 및 PR4 검출 방법의 도시도.
제6도는 본 발명에 따른 장치와 더불어 얻어진 바와 같은 트랙 패턴의 도시도.
제7도는 트랙에 기록될 정보 내용의 도시도.
제8도는 기록될 정보에서 파일롯 신호를 얻기 위해 제1및 제2코드워드의 순차 도시도.
제9도 및 제10도는 동기 블럭의 정보 내용 도시도.
제11도는 트랙에 기록될 정보 내용의 다른 표시의 도면.
제12도는 본 발명에 따른 기록 장치의 도시도.
제13도는 제12도에 도시된 장치에서 메모리 내용의 도시도.
* 도면의 주요부분에 대한 부호의 설명
57 : ID 발생기 59 : 2T 프리코더
62 : CPU 63 : 코드워드 발생기
본 발명은 자기 기록 캐리어상의 트랙에서 디지탈 비디오 신호와 같은, 디지탈 신호를 기록하기 위한 장치에 관한 것으로, 상기 트랙은 기록 캐리어상에서 서로 병렬로 이 기록캐리어의 가로축에 관계한 각으로 런되며, 상기 디지탈 신호는 트랙중 제1트랙 부분에 기록되며, 상기 장치는 디지탈 신호를 수신하기 위한 입력 단자와 제1트랙 부분에서 디지탈 신호를 기록하기 위한 기록 수단을 구비한다.
이런 형태의 장치는, 1980년 1월 자기의 IEEE 보고서 MAG16권 1호의 104 내지 110 페이지에서 에스.나까가와 등에 의해 명칭 "NRZ 기록의 검출방법 학습"으로부터 공지되어 있다.
상기 장치가 판독을 목적으로 기록 캐리어상에서 비디오 신호가 기록될 때 판독될 신호로 트랙 판독시 판독용으로 사용된 검출 방법에 의존하여 빠르고 양호한 방법으로 로크될 때 중요해진다.
본 발명의 목적은 루비스트 방법으로 비트 클럭에 대해 볼 수 있는 장치를 제공하는데 있으며, 상기 클럭 비트는 트랙의 시초로부터 판독되는 정보에 존재한다.
따라서 본 발명에 따른 장치는 n 비트 제1코드워드를 발생하기 위해 설계된 코드워드 발생 수단을 구비하며 기록 수단은 트랙의 시초를 형성하는 제2트랙 부분에서 n비트 제1코드워드를 기록하기 위해 설계되며, 상기 제1코드워드는 제1의 2진값을 갖는 P비트, 제12 진값의 반전 2진값이 되는 제2의 2진값을 갖는 q비트의 연속적인 순서를 포함하며, p.q.r은 우수 정수이며 p≥3, q≥3, r≥3을유지한다.
본 발명은 신호 패턴이 클래스 부분 응답 검출이 재생되고 클래스 Ⅳ부분 응답 검출이 사용되는 경우에 제2트랙 부분에 기록되는 신호 패턴을 채우도록 트랙의 시초에서 제2트랙 부분에 기록되는 것으로 이해하는데 기초하며, 제2트랙 부분으로부터 판독된 신호 클럭에 대해 로크하는 것이 가능하다.
상기 클래스 Ⅰ부분 응답 검출(PRI)은 나가가와에 의해 출판된 것에서 광범위하게 논의되어 있으며 NRZ기록의 진폭검출 또는 NRZI 기록의 진폭 검출로 설명된다. 상기 클래스 Ⅰ부분 응답 검출 방법에서 상기 검출은 나이키스트 1필터링에 기초하며 클럭 순간에서 상호 심벌 간섭이 없다. 상기 클럭 순간은 판독신호(나이키스트(1) 필터링 다음)의 최대값으로부터 유도된다.
상기 클래스 Ⅳ부분 응답 검출(PR4)은 전술된 사설에 기술되어 있다. 상기 클래스 Ⅳ부분 응답 검출시 대역폭은 나이키스트(1) 필터의 대역폭보다 작다. 상호 심벌 간섭은 발생하지 않는다. 그러므로 이 상호 심벌 간섭은 2개의 인접비트에 대해 억제된다. 상기 클럭 순간은 판독되는 신호의 제로 교차로부터 유도된다.
PR1 및 PR1 검출 방법의 다른 상술은 유럽특허 출원 제317013(PHN 12.328)호에 언급되어 있다.
PR1 뿐아니라 PR4 검출은 인에이블링하기 위한 이유는 하나가 신호 포맷을 매우 초기단에서 설정하고 디지털(비디오)신호가 자기 기록 캐리어상에서 기록, 즉, 아직 공지되지 않은 순간에서 설정하는 것을 요구하며, 상기 검출 방법의 형태는 재생용으로 사용된다. 재생 장치의 제조는 어떻게 그들의 재생장치에서 클럭 추출이 실현되는가를 선택할 수 있다.
본 발명에 따른 형성에 의해, P"0", q"1" 및 r"0", q"1", p"0", r"1" 이 순서의 PR1 및 PR4 검출은 2개의 검출방법에 의해 얻어진 신호로부터 적당한 비트 클럭이 가능해지도록 구성된다.
제2블럭 색숀에서 제1비트 롱 코드워드를 포함하므로써, 판독 신호 다음에 발생하는 동기 워드 위치를 이들 동기 워드의 검출을 간략히 하도록 예측할 수 있도록 워드 클럭으로 볼 수 있는 가능성이 존재한다.
덧붙이면, 상기 장치는 n비트 제2의 코드워드를 발생하고 제2트랙 부분에서 제2코드워드를 기록하기 위해 설계되며, 제2코드워드는 제1코드워드의 반전 코드워드이다.
이는 기록될 정보에서 부가적인 파일롯 신호를 포함하는 것을 가능하게 만든다. 상기는 정보가 재생될 때 트래킹을 인에이블하며, 이런 특징을 제공하는 장치는 제2트랙 부분에 기록된 정보의 파일롯 신호 발생을 위해 상기 파일롯 신호가 기록된 정보에 따라 비교적 낮은 주파수를 갖는 캐리어로 구성되는 것을 특징으로 하며, 상기 장치는 필수적으로 기록된 정보의 평균값이 비교적 낮은 주파수 캐리어 변화에 따라 변화하도록 제2트랙 부분에서 다른 색숀의 제1코드워드 및 제2코드워를 기록하기 위해 설계되며, 이를 목적으로 제1및 제2코드워드의 불일치는 제로가 아니다.
트래킹은 재생동안 판독될 트랙에 관계한 판독 헤드를 적당히 위치시키는데 필요하다. 그러므로, 트랙에 기록될 신호(비디오)를 형성하는 정보 워드는 파일롯 신호가 채널워드의 직렬 데이터 스트림에 포함되는 방법으로 채널 워드에 코드되며, 상기 파일롯 신호는 판독될 트랙에 관계한 판독 헤드 위치가 영향을 받으므로서 트래킹 제어 신호를 유도하기 위해 재생동안 사용된다. 이 파일롯 신호는 공지된 구성으로 실현되며 기록될 채널 워드의 직렬 데이터 스트림의 현행 디지털 함값은 시간에 대해 플롯된 요구 패턴 즉, 스퀘어 웨이브의 싸인 형태로의 동작을 보여준다.
기록될 디지털 채널 신호의 현행 디지털 값 영향에 의해 파일롯 신호를 고정시키는 예는, 유럽특허 339.724(PHN 12.553)호 또는 네덜란드왕국 특허 90.02.772호(PHN13.537)에 기술되어 있다.
본 발명에 따라 불일치는 제1코드워드와 같으며, 여기서 a는 제로가 아닌 정수이며 불일치는 제2코드워드에 대해 a와 동일하다. 상기는 기록될 디지털 정보에서 파일롯 신호, 즉, 시간에 따라 플롯된 제2트랙 부분에 기록될 디지털 정보의 현행 디지털 값이 파일롯 신호의 요구 패턴에 따라 동작하는 것을 보여주는 방법으로 제1 및 제2코드를 포함하는 것이 가능하다.
상기 제1 및 제2코드워드는 25-비트 디지털 워드의 형태이다. 네덜란드왕국 특허 제90.02.772호는 자기 기록 캐리어상의 25비트 채널 워드의 기록을 기술한다. 비디오 정보는 1 비트 디지털 워드가 25비트 정보 워드를 얻기 위해 고정되는 24비트 정보 워드에 포함된다. 이들 25비트 정보워드는 2T 프리코더에서 25비트 채널 워드로 인코드되며, 다음에 이들 채널 워드는 기록 캐리어상의 트랙중 제1트랙 부분에 기록된다. 전에 상술한 바와같은 제1(가능하게 및 제2코드워드)은 2T 프리코더 다음의 채널 워드중 직렬 데이터 스트림으로 고정된다.
본 발명은 첨부한 도면을 참고로 하여 여러 실시예에 의해 설명될 것이다.
제1도 내지 제5도는 PR1 검출 동작 방법과 5개의 디지털 신호에 대한 PR4 검출 방법을 기술한다.
제1a도는 자기 기록 캐리어상의 트랙에서 기록될 디지털 입력 신호를 도시한다. 상기 디지털 신호는 "0" 및 "1" 변화에 의해 형성된다. 상기 디지털 신호내의 클럭 주파수는 ½ T와 같다. PR1 검출에 의해 제1a도의 신호 판독은 제1b를 참고로하여 기술되고 PR4 검출에 의한 제1a도의 신호판독은 제1c도를 참고로하여 기술된다.
제1b도는 제1a도 신호에서 t=to 순간에서 상승 엣지에 대한 시간 신호 A1응답(즉 PR1 검출을 판독하는 발생신호)을 도시한다.
상기 곡선 A1에서 순간 클럭은 곡선의 최대 및 곡선에 교차하는 제로 순간에서 동시에 위치한다. 이들 클럭 순간은 제1b도의 시간축에 따라 표시되며 시간 간격 T 와는 떨어져 있다. to 순간에서 곡선 A1의 최대치는 제1a도 신호의 to 순간에서 상승 엣지와 일치한다.
상기 시간 신호 A2는 제1a도 신호에서 t=t1=t0+T 순간에서 하강 엣지이다. 곡선 A2의 최대치는 제1a도 신호의 하강 엣지 t=t1와 일치한다. 제1a도 신호의 t=t2=t0+2T 순간에서 상승 엣지는 2T의 시간 간격만큼 오른쪽으로 이동된 곡선 A1에서 다시 발생한다. 제1a도 신호의 t=t3=t1+2T에서 하강 엣지는 또한 2T의 시간 간격만큼 오른쪽으로 이동된 곡선 A2에서 발생한다.
전체 응답 또는 제1a도 신호는(즉, 판독신호) 응답 A1및 A2및 이동된 응답 A1및 A2의 합이다. 이는 A1+A2를 가진 제1b도에 표시된 곡선을 발생한다. 상기 클럭 순간은 최대를 보여주는 신호 A1+A2순간에서와 동일하다. PR1 검출이 제공될 때, 상기 클럭 추출은, 여기에서 명백한 바와 같이 판독 신호의 최대 검출을 토대로 하여, 쉽게 실현된다. 덧붙이면, 내부 심벌 인터페이스가 아니다.
제1c도는 제1a 신호에서 t=t0 인 순간에서 상승 엣지에 대한 응답을 (즉, PR4 검출로 판독되는 신호) 시간신호 A1로 도시한다. 제1c도 곡선 A1의 최대치는 제1a도 신호에서 t=t0인 순간에서의 상승 엣지와 일치한다. 곡선 A1에서 클럭 순간은 시간 간격 T와 떨어져 있으며, 제1b도에서 곡선 A1에서 클럭 순간과 관계한 시간 간격 T/2에 의해 이동된다. 이는 최대치 근처에서 곡선 A1이 비제로인 2개의 클럭 순간이 존재하며, 다른 클럭 순간에서, 곡선 A1실로 제로인 것을 의미한다. 상기는 2개의 근접 비트사이의 인터 심벌 간섭이 존재하는 것을 도시한다.
제1c도에서 시간 신호 A2제1a도 신호에서 t=t1=t0+T인 순간에서 하강 엣지에 응답한다. 곡선 A2의 최대치는 하강 엣지에서 다시 발생한다.
제1a도 신호의 t=t2=t0+2T 순간에서 상승 엣지는 곡선 A1에서 발생되며, 시간간격 2T만큼 오른쪽으로 이동한다. 제1a도 신호에서 t=t3=t1+2T순간에서 하강 엣지는 곡선 A2에서 발생하며 시간간격 2T만큼 오른쪽으로 이동한다.
제1a도 신호에 대한 전체 응답(즉, PR4 검출을 판독하여 발생하는 신호)은 응답 A1및 A2와 모두 이동된 응답 A1+A2의 합이다. 이는 시간신호 A1+A2에 의해 제1c도에 표시된 바와같은 제로 신호를 발생한다. 이는 또한 제1d도에 표시된 바와 같이 PR4 검출의 주파수 응답 H(f)가 설명되는 경우에 자명해진다. 이 주파수 응답 H(f)는 f=½T의 주파수를 갖는 제1a도의 신호는 PR4 검출에 의해 검출되지 않는다.
제2a도는 자기 기록 캐리어상의 트랙에 기록되는 디지털 입력 신호를 표시한다. 상기 디지털 신호는 2개의 다른 쌍 "0" 및 "1"에 의해 형성된다. 이 신호의 비트 클럭은 다시 T와 동일하다. 상기 신호는 T인 주파수 f를 갖는다.
전의 아날로그에 대해서는 PR1 검출이 제2b도에 표시된 시간간격 A1을 발생한후 제2a도 신호의 순간 t=t0에서 상승 엣지를 기술한다. 제2b도의 곡선 A1은 다시 제1b도의 곡선 A1과 동일하다. 제2a도 신호의 순간 t=t1에서 하강 엣지는 PR1 검출후 제2b도에 도시된 시간 신호 A2를 발생한다. 제2b도의 곡선 A2는 제1b도의 곡선 A2와 일치한다.
제2b도는 제2a도 신호에 대해 PR1 검출후 전체응답을 곡선 A1+A2에서 도시한다. 반의 클럭 순간은 제2b도의 시간신호 A2+A2로부터 나타난 바와 같이 시간신호와 일치한다. PR1검출이 제공될 때, 클럭 추출이 쉽게 실현된다.
더구나, 전의 상술과 유사하게, 제2a도 신호에서 순간 t=t2에서의 상승 엣지는 PR4검출후, 제2c도에 도시된 시간 신호 A1을 발생한다. 제2c도의 곡선 A1은 또한 제1c로의 곡선 A1과 일치한다. 제2a도 신호의 순간 t=t1에서 하강 엣지는 PR4 검출후, 제2c도에 도시된 시간 신호 A2를 발생한다. 제2c도에서의 곡선 A2는 제1c도의 곡선 A2와 같다.
제2c도는 시간신호 A1+A2에서, 제2a도 신호에 대해, PR4 검출후 전체 응답을 도시한다. 이미 전에 상술한 바와 같이 PR4 검출을 갖는 클럭 추출은 신호 A1+A2의 제로 크로스 검출에 의해 실행된다. 그러므로, 이 신호에서 제로 크로스는 클럭 순간과는 일치하지 않는다. 이는 양호한 비트 추출이 어렵다는 것을 의미한다.
제3a도는 자기 기록 캐리어상의 트랙에 기록된 디지탈 입력 신호를 도시한다. 입력 신호는 3개의 "1" 및 3개의 "0"의 다른 셋에 의해 형성된다. 이 신호에서 비트 클럭은 T와 같다. 상기 신호는 1/6 T와 같은 주파수를 갖는다.
제3b도는 제3a도에 도시된 신호에서 순간 t=t0에서 PR1 검출후, 상승 엣지에 대한 응답을 도시한다. 시간신호 A2는 순간 t=t1에서 하강 엣지에 대해, PR1 검출후의 응답을 도시한다. 제3a도에 도시된 신호에 대해, PR1 검출후, 전체 응답은 시간신호 A1+A2에 의해 제3b도에 표시된다. 개별적으로 도시된 것은 적당한 클럭 추출이 가능해지도록 클럭 순간과 신간호의 최대치가 일치하는 것을 의미한다.
제3c도의 신호 A1은 t=t0순간에서 상승 엣지에 대해, PR4 검출후의, 응답을 표시한다. 신호 A2는 t=t1순간에서 하강 엣지에 대해 PR4 검출후의 응답을 표시한다. 제3c도의 신호 A1+A2는 다시 제3a도에 도시된 신호에 대해, PR4 검출후의, 전체 응답을 표시한다. 명백하게 주목할 것은, 적당한 비트 클럭 추출이 다시 가능해지도록, 클럭 순간과 동시에 일치한 신호 A1+A2도 "제로"라는 사실이다.
이는 PR1 검출과 PR4 검출하여 제3도에 도시된 신호로부터 비트 클럭 추출이 가능하다는 것을 의미한다.
제4도는 제4a도 신호중 PR1 검출(제4b도)과 PR4 검출(제4c도)을 도시하며, 상기는 자기 기록 캐리어상의 트랙에 기록된다. 상기 신호는 교대로 5개의 "1"과 5개의 "0"을 구비한다.
제4b도는 각각, 제4a도 신호에 대해, PR1 검출후에, 적당한 클럭 추출이 가능해지도록 클럭 순간과 일치한 신호로 최대인 전체 응답을 표시하는 신호 A1+A2를 표시한다. 제4c도의 신호 A1+A2에서, 즉 PR4 검출후의 전체 응답시, 상기 제로 크로스는 클럭 순간과 계속 일치한다.
따라서, 이 경우는 적당한 비트 클럭 추출이 2개 검출 방법에 대해 가능하도록 유지한다.
제4c도의 A1+A2곡선에서 상기 사실은 t0인 순간에서 제로 교차가 네가티브 방향으로 비교적 작은 최대치를 갖는 신호에 대해 포지티브 방향으로 큰 절대 최대를 갖는 신호로 부터의 변형을 표시하며 t2인 순간의 제로 교차는 네가티브 방향의 큰 절대치를 갖는 신호에 대해 포지티브 방향의 비교적 작은 최대치를 갖는 신호로부터의 변형을 표시한다. 상기 작은 최대치는(t0및 t1인 순간 사이에서 네가티브 방향으로 t1및 t2사이에서는 포지티브 방향으로) 계속 제로 교차가 가능한 적당한 검출을 구성할만큼 크게 된다는 것이다.
제5도는 제5a도에 도시된 4개의 "제로" 및 4개의 "1"의 변형을 갖는 신호의 PR4 검출을 도시한다. 제5b도의 전체 응답 A1+A2는 t0및 t1과 같이 클럭 순간에 일치한 제로 교차 사이를 도시하며, 그들 사이의 반에 위치한 또다른 제로 교차가 존재한다. 이 결과는 곡선 A1+A2에서는 비교적 극단적이 되며 t=t0및 t=t1사이에 위치된 제로 교차의 적당한 검출이 가능하도록 작게 된다.
신호 PR4 검출에 대한 같은 지지는 P "제로" 및 P "1"의 변화에 의해 형성되며, 여기서 P는 6과 동일하거나 큰 이븐 넘버이다. 덧붙이면, 서로 "1" 및 "0"가 존재하는 경우, 기록될 신호의 변형은 넓은 부분이 되며, 결국 PR1 또는 PR4 검출후의 클럭 추출은 더욱 어렵게 설명된다. 이는 이 경우에 대해 조차도 P는 5보다 큰 우수인 것을 의미하며, PR1 또는 PR4 검출후의 클럭 추출은, 가능한 경우, 더욱 어렵게 된다.
제6도는 디지탈 비디오 신호와 디지탈 오디오 신호가 상기 기록 캐리어의 가로축에 따라 각으로 배열된 트랙 T1, T2에 기록되는 자기 기록 캐리어(1)의 다이어그램을 도시한다. 이 트랙은 화살표(2)에 의해 표시된 바와 같은 방향으로 트랙위에서 이동하는 판독 헤드(도시하지 않음)에 의해 판독된다. 트랙의 제1트랙 부분 TP1에서 디지탈 비디오 정보가 기억된다. 제2트랙 부분 TP2는, 트랙의 시초를 형성하며, 제1트랙 부분 TP1으로 진행한다.
예를들어, PCM 오디오 신호와 같은, 디지탈 오디오 정보는 새드 색숀으로서 도시된 제3트랙 부분 TP3에 기억된다. 상기 제1트랙 부분 TP1 및 제3트랙 부분 TP3는 제4트랙 부분, 다른 말로하면, 에디트 갭으로 명명된 TP4에 의해 분리된다.
T1및 T2와 같은 2개의 트랙들은 연속적으로 2개의 분리헤드, 즉, α의 방위각에서의 하나의 헤드 및 β의 방위각에서의 다른 헤드에 의해 기록되어진다. 상기 헤드는 회전가능한 헤드 드럼의 상태 둘레에 180°에 걸쳐서 위치되며, 반면 기록 캐리어는 180° 이상의 헤드 드럼 둘레에 감싸인다. 헤드 드럼의 반 리솔루션 동안에 T1과 같은 트랙은 2개 헤드중 하나에 의해 기록된다. 헤드 드럼의 다음 리솔 루션 동안에, 상기 트랙 T2는 다른 헤드에 의해 기록된다. 바꿔말하면, 2개 헤드의 결합 동작을 하는 것이 가능하다. 이 경우에 그들은 헤드 드럼의 원주에 함께 폐쇄되며 서로 쉽게 기계적으로 접속된다. 결합된 헤드에 의해 기록 캐리어의 단일 주사시 트랙 T1및 T2는 순간적으로 기록된다.
매화상당 625 비디오 라인을 갖는 50㎐ 시스템에서 단일 비디오 프레임에 기억된 정보는 12개 연속 트랙의 제1트랙 부분 TP1에 기억된 단일 비디오 화상과 동일하다. 매화상당 525 라인을 가진 60㎐ 시스템에서 단일 비디오 프레임에 기억된 정보는 10개의 연속 트랙중 제1트랙 부분 TP1에 기억된다.
제3트랙에 있는 2개 오디오 채널 기록에 대해서 비디오 프레임당 6개 연속 트랙중 제3트랙 부분은 50㎐ 시스템에서 이용 가능하다. 60㎐ 시스템에 대해서는 비디오 프레임당 5개의 연속 트랙의 제3트랙 부분이 존재한다.
단일 트랙에서의 정보 콘텐트가 또한 아래에 기술되어 있다. 제7도는 단일 트랙에 기록된 바와 같이 신호의 정보 콘텐트를 개략적으로 도시한다. 상기 콘텐트는 상부에서 하부까지 좌우로 연속적으로 판독하는 수평 라인을 갖는 직각형태로 제7도에 도시된다. 제1의 콘텐트는 제2트랙 부분 TP2에 기록되는 n비트 코드워드중 2개의 라인이 된다. 이 예에서는 n은 25가 된다. 각각의 라인은 47개의 코드워드를 구비한다. 제2트랙 부분 TP2에 기록될 전체 정보 콘텐트는 9425비트 코드워드가 된다. 제2트랙부분 TP2 후에 들어오는 부분인 제1트랙부분 TP1에 기록된 정보는 (81+7=)88 라인 정보를 포함하며, 각각 47m(=25) 비트 채널 워드를 포함한다. 상기 제1트랙 부분 TP1은 제4트랙부분 TP4(에디트 갭)에 따른다. 제1트랙 부분으로서 제4트랙 부분에서 47n(=25)-비트 코드워드 각각의 2개 라인이 기록된다. 제4트랙 부분에 따르는 제3트랙 부분 TP3에서, 정보는 (6+3=)9 라인에 존재하여 기록되며, 각각의 라인은 다시 47n(=25) 비트 채널 워드를 포함한다. 625 라인 시스템에 대해 이 제5트랙 부분은 1325 비트를 조정하며, 즉, 정확하게는 53 코드워드이다. 525 라인 시스템에 대해 제5트랙 부분은 1445 비트를 조정한다. 이 수단(57)은 25비트 코드워드와 첨가적 코드워드의 또다른 20 제1비트를 완성한다. 선택 이유인 위의 수단에서 제5트랙 부분의 콘텐트는 아래에 설명되어 있다. p"0", q"1" 및 r"0"의 마지막 연속적 순간에서 포함되는 트랙 부분 TP2, TP4 및 TP5 n-비트 제1코드워드에서, 또는 바꿔말하면, p"1", q"0" 및 r"1"이 기록된다. p, q 및 r은 p≥3, q≥3, r≥3을 유지하는 우수의 정수이다.
제1도 내지 5도에 따른 기술로부터 이들 코드워드와 함께 제2트랙 부분으로부터 판독되는 정보의 PR1 검출 및 PR4 검출이 가능하게 된다. 제1코드워드에 대한 여러 가능성이 또한 기술된다.
상기 제1코드워드는 아래에 따른다(p=q=r=3)...
000111000 .....
25비트 제1코드워드는 아래에 따른다.
000111000111000111000111
코드워드 4개의 "0"라기보다는 4개의 "1"에서 코드워드 또는 다소의 단부에서 로우로 알 수 있으며 PR1 검출 및 PR4 검출에 대한 거부가 없다.
상기 제1코드워드는 아래에 따른다(p=q=r=5)...
000001111100000...
상기 경우에는 연속적인 제1코드 워드 사이의 변형에서 로우로 10개의 "0" 또는 10개의 "1" 때문에 연속적인 5개의 순차 "1" 및 5개의 "0"로부터 25비트 제1코드 워드를 형성하지 못하며, 상기는 예를들어, 적당한 비트 클럭 추출과 같은, 여러 이유에 대해 바람직하지 못하다.
또다른 가능성은 3개의 "1"과 5개의 "0" 순서의 조합이며, 다른 방법은 아래와 같다.
...11100011100000...
n=25인 제1코드워드의 특별한 실시예는 다음과 같다.
0001110001110000011100011
상기 제2트랙 부분에서 제1코드워드를 기록하는 것은 트랙의 판독이 설명될 때 제2트랙 부분으로부터 판독되는 정보에서 비트 클럭에 대한 목적을 가진다. 이는 위상 고정 루프에 대해 판독 정보를 공급하므로서 실현된다. 상기 전압 제어 발진기는 따라서 비트 클럭의 주파수 또는 멀티플에 셋되도록 제어된다.
상기 위상 고정 루프가 로크되는 경우, 상기 시스템은 제2트랙 부분으로부터 판독되는 정보의 비트 클럭상에 로크된다. 덧붙이면, 상기 제2트랙 부분에서 제1코드워드를 기록할 때 비트 클럭이 판독 동작 동안에 로크된 후에 상기 제1코드워드의 비트 패턴들은 제2트랙 부분들이 판독장치에 판돌될 때 워드 클럭비로 로크되도록 알려져 있다. 25-비트 제1코드워드에 대한 워드 클럭은 비트 클럭의 이다. 상기 장치는 워드 클럭 비트로 로크되는 경우, 제1트랙 부분(아래)에 위치한 동기 코드워드의 어떤 검출이 가능해진다.
만일, 덧붙혀, 하나가 트랙이 판독되는 동안 트랙킹을 제공하는 경우, 또한 정보가 판독동안 제2트랙 부분으로부터 판독되는 동안 파이롯 신호는 기록된 정보에 삽입되며, 즉, 정보의 현행 디지탈 합 값 영향에 의한 트래킹이 기록된다. 위에서 상술한 네덜랜드왕국 특허출원 제90.02.772호(PHN 13.537)는 기록될 정보로 삽입되는 파일롯 신호가 어떻게 되는가를 기술한다.
이는 기록될 정보의 비트 주파수와 비교되어 비교적 저주파수를 갖는 캐리어와 비슷하게 동작하는 데이터 스트림에서 현행 디지탈 합 값 이하로 작게 한다. 제2트랙 부분에 역시 기록될 정보에 대해 파일롯 신호를 고정시키기 위해, 상기 제1및 제2코드워드는 제2트랙 부분에 기록되며, 제2코드워드 또한 제1코드워드의 반전으로 n비트 길게 되며 덧붙이면, 제1코드워드 및 제2코드워드는 제로와 동일하지 않는 불일치를 가진다.
앞의 예에서 제1코드워드 W1에 대한 비트 순서는 아래와 같이 선택되며,
0001110001110000011100011
제1코드워드 W1의 불일치는 -3과 동일하다.
제2코드워드 W2는 아래의 비트 순서를 가진다.
1110001110001111100011100
그리고 +3의 불일치를 가진다.
제8도는 제2트랙 부분에 기록될 신호에 고정되는 것과 같이 시간에 대해 플롯된 파일롯 신호를 도시한다. 이를 실현하기 위해, 제1 및 제2코드워드는 제8b도에 도시된 바와 같이 관련된 파일롯 신호가 얻어지도록 서로 뒤에 위치된다. 제8c도는 그들이 제2트랙 부분에 기록되는 것과 같이, 시간에 대해 플롯된 제1 및 제2코드워드의 순서를 도시한다. t1순간에 대해서 정의 불일치를 갖는 제2코드워드 W2는 트랙에 기록된다. 상기 현행 디지탈 합값은 제8a도의 신호에서 최대값이 유지되는, t1순간까지, 제8a도에서, 계속해서 증가한다. 상기 순간에서 제1코드워드 W1이 고정된다. 이들 코드워드 W1은 네가티브 불일치를 갖는다. 상기 현행 디지탈 합값은 t2순간까지지 감소되며, 제8a도의 최대값이 유지된다. 그때 다시 제2코드워드가 고정된다.
파일롯 신호를 조정하는 트랙에서 제1 및 제2코드워드의 순차는 교대로 이들 트랙의 제2트랙 부분에 기록되고 파일롯 신호를 조절할 필요가 없는 트랙에서 다른 구성으로 예로, 3개의 "0" 3개의 "1", 3개의 "0"로 충분히 기록될 수 있다. 양호하게, 다른 제1 및 제2코드워드는 W1, W2, W1, W2...를 수행한다.
트랙에서 제4트랙부분 TP4(에디트 갭) 및 제5트랙부분 TP5는 양호하게 같은 트랙의 제2트랙 부분 TP2로 채워지는 것처럼 정보의 같은 형태로 채워진다. 상기 에디트 갭 TP4는 상기 트랙 부분 TP3에서 오디오 신호의 에디팅 분리를 가능하게 하도록 도입된다. 상기 오디오 신호가 에디트된 경우, 이는 에디트 갭에서의 비트 패턴이 더 이상 분포되지 않는 것을 의미한다. 상기 비디오 신호와 에디트 오디오 신호의 연속적인 재생으로, 이는 재생 시스템의 언로킹을 유동하는 에디트 갭에서 계속되는 비트 패턴이 부족하다. 제2트랙 부분에서와 같이 에디트 갭에서 같은 코드워드의도입으로, 상기 시스템은 매우 빠르게 다시 로크된다.
트랙에서 상기 제1트랙 부분 TP1은 비디오 정보를 포함한다. 제9도는 트랙의 제1트랙 부분에 동기 블럭 기록의 콘텐트를 표시한다. 동기 블럭은 실제로 파트 기준 TP1내에 제7도에 도시된 수평 라인이다.
전의 상술과 같이, 이 라인(이 동기 블럭)은 47채널워드를 포함하며 각각은(이 경우는) 25비트를 포함하며, 번호 CW, CW2... CW46, CW47이다. 각각의 25-비트 채널워드는 실제로 4개의 부분 즉, CW4에 대해 제9도에 도시된 바와 같이, 8비트층 및 하나의 1비티층 부분인 3개의 균형 부분을 구비한다.
전에 상술한 네덜란드왕국 특허출원 제90.02.772호(PHN 13.537호)는 이들 25-비트 채널 워드가 예로, 파일롯 신호가 이 정보 스트림으로 삽입을 목적으로, 연속적인 25-비트 정보 워드의 직렬 정보내의 현행 디지탈 값 영향을 단일 비트가 고정시킨후 24-비트 정보 워드로 매 3개의 8비트 비디오 정보워드 조합에 의해 어떻게 얻어지는가를 도시한다. 또다른 가능성은 특정 주파수에서 정보 스트림의 주파수 스펙트럼에서 딥을 실현하는 것이다.
차후에, 25비트 정보 워드는 그들이 자기 기록 캐리어상에 기록된 후, 2T 프리코더로 25비트 채널 워드로 변환된다.
매라인(매 동기 클럭)에서 제1채널 워드 CW1은 동기 워드를 구비한다. 상기 동기 워드는 제1채널워드 CW1에서 제17비트에 의해 형성된다. 25비트 정보 워드에 동기워드를 포함하고 25비트 채널 워드로 이 25비트 정보 워드를 프리코딩하는 것은 위에서 상술되어 이 출원서에 포함되어 고려된 네덜란드왕국 특허출원 제90.02. 772(PHN 13.537)호에 기술되어 있다.
후에, 식별 정보 ID는 제1채널 워드 CW1의 마지막 8비트 및 제2채널 워드 CW2의 비트 2 내지 17에 포함된다. 상기 식별 정보 ID는 예로, 비디오 프레임중 10 또는 12트랙에 정보가 기억되는 것을 표시하는 트랙 넘버(4비트)와 같은 것을 포함하여, 프레임 넘버(2비트)는 특정 비디오 프레임을 표시하며, 1비트 워드는 동기 블럭에서의 데이터가 오디오 또는 비디오 데이터인지를 표시한다.
더구나, 상기 식별 정보는 번호 TP1 또는 TP2로 제7도에 도시된 직각 부분의 수평 라인을 표시하는 라인 넘버를 포함한다. 상기 라인 넘버는 제1 및 제3트랙에서 모든 라인(모든 동기블럭)이 식별되도록 1에서 97까지 런된다. 7비트는 라인 넘버에 대하여 이용 가능하며, 8비트는 식별 정보 및 2개 비트에 대해 패리티 바이트를 형성하여 아이들된다.
7보다 더 큰 라인 넘버를 갖는 동기 블럭은 보조 데이터를 포함하는 8비트 워드를 갖는다. 보조 데이터에 대해 하나는 캐릭터 데이터(콘텐트 테이블), 채크 데이터(50 또는 60㎐ 비디오 신호가 관계되는지를 표시, 오디오 신호의 샘플링비 표시) 또는 텔레텍스트 데이터로 생각되어진다. 라인(동기 블럭)에서 2개의 채널 워드 CW1및 CW2는 완전히 채워진다. 상기 동기 블럭은 또한 채널 워드 CW3내지 CW44를 포함한다. 이들 채널 워드는 (42×3=) 1268 비트 비디오 워드를 포함한다.
상기 채널 워드 CW45의 비트 2 내지 9는 또한 8비트 비디오 워드를 포함한다. 따라서, 동기 블럭은 1278비트 비디오 워드(즉, 127비디오 바이트)를 조정한다. 동기 블럭은 또한 채널 워드 CW45및 채널워드 CW46, CW47의 비트 10 내지 25를 조정한다. 이 정보는 수평 패리티를 구비한다.
부분 TP1에서 라인(동기 블럭)이 8보다 적은 라인 넘버를 갖고 관계되는 경우 채널워드 CW2의 비트 18 내지 채널워드 CW45의 비트 9로부터 라인 부분은 보조 데이터 및 비디오 정보의 수직 패리티를 포함한다.
상기 수평 및 수직 패리티는 판독 비디오 정보의 에러 보정을 가능하게 하도록 비디오 정보를 기록하기 위해 고정된다.
제10도는 라인 콘텐트(동기 블럭)를 도시하며, 트랙중 제3트랙 부분에 기록된다. 실제 동기 블럭은 번호 TP3 부분내에 위치된 제7도에 도시된 수평 라인이 된다.
상기 라인은 다시 전에 이미 상술한 바와 같이 동기 정보 및 식별 정보를 모두 포함한다. 채널워드 CW2의 마지막 8비트, 채널워드 CW3내지 CW37및 채널 워드 38의 비트 2 내지 17은 전체 108(=3×35+3) 8비트 오디오 워드(즉 108 오디오 바이트)에 대응한 오디오 정보를 포함한다. 상기 채널 워드 CW38의 마지막 8비트, 채널워드 CW39내지 CW44및 채널워드 CW45의 비트 2 내지 9는 전체 20(=3×6+2) 8비트 데이터 워드(즉, 20데이타 바이트)에 대응하는 보조 데이터 정보를 포함한다. 이 보조 데이터 정보는 제1트랙 부분내의 보조 데이터 정보와 상당히 일치한다.
더구나, 채널 워드 CW45에서 비트 10으로부터 수평 패리티는 제9도를 참고로하여 기술된 바와 같다.
상술된 콘텐트는 부분 TP3에서 이들 6개의 라인에 공급된다. 부분 TP3에서 나머지 3개의 라인에 대해 상기는 수평 패리티가 오디오 바이트 및 보조 데이터 바이트의 라인에 포함되게 유지된다. 상기 수평 및 수직 패리티는 다시 오디오 정보의 에러 보정과 판독될 보조 데이터를 인에이블링하기 위해 다시 가산된다.
제11도는 트랙에 기록된 직렬 데이터 스트림은 하나의 개략 형태를 도시한다. 제2트랙 부분 TP2에 기록된 제1 및/또는 제2코드 워드를 초기화한다. 그때 정보는 제1트랙 부분 TP1에 기록된다. 먼저 동기 블럭 SB1내지 SB7은 동기 워드(S) 및 식별 정보(ID)에 덧붙혀, 수평 및 수직 패리티 VP 및 HP를 각각 포함한다. 따라서 동기 블럭 SB8내지 SB88은 수직 패리티의 보조 정보(AUX) 및 비디오 정보(VD)를 포함한다. 마지막으로, 제1 및/또는 제2코드 워드는 제4트랙 부분 TP4에 기록된다.
그때 제3트랙 부분 TP3에 기록된 정보로 부터 들어온다. 먼저 동기 블럭 SB1내지 SB6는 오디오 정보(AD), 보조정보(AUX) 및 수평 패리티(HP)에 덧붙혀 동기 코드(S) 및 식별 정보(ID)를 포함한다. 따라서 동기 블럭 SB7, SB8및 SB9는 오디오 및 보조 정보의 수직 패리티(VP)를 포함하고 있다. 마지막으로 제1및/또는 제2코드 워드는 제5트랙 부분 TP5에 기록된다.
비디오 정보에 대한 수직 패리티가 트랙 전면에 위치하는 이유는, 즉, 트랙의 비디오 정보전에 위치하는 이유는 아래에 따른다.
하나의 이유는 트릭 모드가 기록 캐리어에 기록된 정보가 판독될 때 가능하다는 것이다. 트릭 모드에서 기록 캐리어는 정상 재생의 투영 속도보다 다른 투영 속도를 갖는 것이다. 이 다른 투영 속도에서 판독 헤드 트레이스는 트랙과 병렬로 되어 있지 않으며, 결국 트랙에 교차한다. 판독 헤드가 트랙모드 동안 트랙위에 위치되는 동안에 시간 간격에서, 판독 헤드는 이 트랙으로부터 비디오 정보를 포함하는 다수의 동기 블럭을 판독한다. 각각의 동기 블럭은 제1트랙 부분에서 동기 블럭의 문제로, 비디오 정보와 수평 패리티를 포함한다. 이들 수평 패리티는 보조 데이터의 에러 보정과 동기 블럭의 비디오 데이터에 대해 의도된다. 트릭 모드로 판독하기 위해 그리고 동기 블럭에 포함된 정보 판독에 대해, 에러 보정은 판독될 동기 블럭에 포함된 수평 패리티 정보 그라운드상에서 가능해진다.
상기 수직 패리티는 제7도에 도시된 직각의 비트 칼럼에 대해 에러 보정을 공급하는 경향이 있다. 이를 목적으로 판독될 칼럼에서 이들 비트에 대해 필요해진다. 전의 상술과 같이, 트랙의 동기 블럭과는 별개로 트랙 모드에서 판독된다. 이는 일반적으로 트랙 모드에서 제7도의 직각 칼럼에서의 모든 정보가 판독되는 것을 의미한다. 이는 또한 트릭 모드에서 수직 패리티 정보가 트랙으로 부터 판독된 정보의 에러 보정을 실현하기 위해 사용되지 않는 것을 의미한다.
트릭 모드에서 수직 패리티 정보의 판독은 매우 유용하지 않다는 것이다. 상기는 기록 캐리어상에서 통로를 트래이스하는 동안 가능한 만큼 요구된 비디오 정보를 포함하는 많은 동기 블럭처럼 판독되는 판독 헤드를 허용하여 사용된다.
그러므로, 요구된 정보는 기록 캐리어의 중심에서 가능한 많이 상기 측면에서 가능한만큼 만이 수직 패리티 정보를 기록한다. 이 경우 비디오 정보는 트랙에서 오디오 정보에 앞서 기록되며, 이는 비디오 정보에 속한 수직 패리티는 비디오 정보전에 기록된다. 오디오 정보에 속한 수직 패리티는 트랙에서 오디오 정보 후에 기록된다.
상기 오디오 정보가 비디오 정보전에 트랙에 기록되는 경우를 관찰할 필요성이 있으며, 오디오 정보에 속하는 수직 패리티 정보는 비디오 정보 다음의 비디오 정보에 속한 오디오 정보 및 수직 패리티 정보앞의 트랙에 기록된다.
더구나, 정상 재생 에러를 갖고 정보가 트랙 단부에서 판독될 때 즉, 기록 캐리어의 하나의 측면에 발생한다. 트랙의 중심에 대해 비디오 및 오디오 정보 기록에 의해, 트랙의 가로방향으로 볼 수 있으며, 정보를 사용하는 판독 챤스(수평 패리티에 의해 표시된)가 향상된다.
제12도는 오디오, 비디오 및 트랙에서의 보조 정보를 기록하기 위한 장치의 예를 도시한다.
오디오 신호처리시 스테레오 오디오 신호와 같은 유닛 50 오디오 신호는 라인(53)상의 메모리(56)에 공급된 8비트 오디오 워드로부터(오디오 바이트) 변환된다.
제13도는 이 메모리(56)의 콘텐트의 보조 분할을 개략적으로 도시한다. 인용된 Ⅰ메모리 색숀에서 이들 오디오 바이트들이(모두 108 오디오 바이트중 6라인) 기억된다.
비디오 신호처리시, 정보량을 감소시키기 위해 화상 인코딩에 받아들인 후, 유닛(51) 비디오 신호는 라인(54)상에서 메모리(56)에 공급된 8비트 비디오 워드(비디오 바이트)로 변환된다. 메모리 색숀 Ⅱ에서 비디오 바이트가 (127 비디오 바이트의 전체 81 라인) 기억된다.
보조 신호 처리기(52)에서 보조 신호는 8비트 보조 데이터 워드(보조 바이트)로 변환된다. 라인(55)상에서 이들 바이트들은 메모리(56)에 공급되며 그들은 색숀 Ⅲ 및 Ⅳ에 기억된다. 색숀 Ⅲ1에서 보조 바이트는 81 라인 각각에 기억된다. 색숀 Ⅳ는 20 보조 바이트 각각의 전체 6라인을 조정한다.
후에, 에러 보호 동작은 색숀 Ⅱ 및 Ⅲ에 기억된 정보에 대해 수행된다. 이는 색숀 Va에 기억된 수직 패리티와 색숀 Ⅵa에 기억된 수평 패리티에 기억된다. 처음에, 에러 보호 동작은 각각의 색숀 Ⅱ 및 Ⅲ에서 칼럼에 기억된 정보에 대해 칼럼-바이-컬럼을 수행한다. 이는 색숀 Va을 통해 대응 칼럼에 기억된 수직 패리티 정보를 제공한다. 이 구성으로 메모리 색숀 Ⅱ 및 Ⅲ의 모든 칼럼에 대한 동작 완성 후에, 에러 보정 동작은 색숀 Ⅱ, Ⅲ 및 Va에서 각각의 라인에 기억된 정보에 대해 라인-바이-라인을 수행한다. 이는 색숀 Ⅵa에서 대응 라인에 기억된 수평 패리티 정보를 제공한다.
색숀 Ⅵa의 라인에 기억된 수평 패리티 정보와 메모리 색숀 Ⅱ 및 Ⅲ의 같은 라인에 기억된 정보와 함께 요구된 바와 같이 검출하고 교정하기 위해 재생이 가능해지며, 에러는 이 조합된 메모리 색숀 Ⅱ, Ⅲ 및 Ⅵa에서 발생한다.
색숀 Ⅴa의 칼럼에 기억된 수직 패리티 정보와 메모리 색숀 Ⅱ(또는 Ⅲ)의 같은 칼럼에 기억된 정보와 함께 요구된 바와 같이 검출 및 보정을 하기 위해 재생이 가능해진다. 에러 보호 동작 또한 색숀 Ⅰ 및 Ⅳ에 기억된 정보에 대해 수행된다. 이는 색숀 Ⅴb에 기억되는 수직 패리티와 색숀 Ⅵb에 기억된 수평 패리티를 발생한다.
또한 이 경우는 에러 보호 동작은 색숀 Ⅰ 및 Ⅳ의 각 칼럼에 기억된 병보에 대하여 수행된다. 이는 메모리 색숀 Ⅴb에서의 대응 칼럼에 기억된 수직 패리티 정보를 제공한다. 메모리 색숀 Ⅰ 및 Ⅳ에서의 모든 칼럼이 이 방법으로 처리된 후, 라인-바이-라인 에러 보호 동작은 색숀 Ⅰ, Ⅳ 및 Ⅴb에서 각 라인에 기억된 정보에 대해 수행된다. 이는 색숀 Ⅵb에서 대응 라인에 기억된 수평 패리티 정보를 제공한다.
더구나, ID발생기(57)은 색숀 Ⅶa 및 Ⅶb에 기억된 확인 정보를 제공한다. 이 색숀 Ⅶa에서는 ID바이트 각각의 88라인이 존재하여 색숀 Ⅶb에서 3ID바이트 각각의 9라인이 존재한다.
후에, 상기 메모리(56)는 라인-바이-라인과 스크램블러에 스크램블된 값은 유닛(58)에 공급된다. 이는 바이트가 유닛(58)에 매번 공급되는 것을 의미한다.
네덜란드왕국 특허 제90.02.772호(PHN 13.537)에서 유닛(58)과 2T 프리코더(59)의 동작이 확장하여 기술되어 있다. 이 동작 설명에 대해서 참고문헌은 특허 출원서로 구성된다.
이 접속에서 유닛(58)에 대해 메모리(56)에 의해 공급된 매 3개의 8비트 워드는 1비트(또는 "0" 또는 "1"중 하나)만큼 확장된 결과로서 유닛(58)의 단일 25-비트 정보워드로 변환된다. 상기 2T 프리코더(59)에서 25비트 정보워드는 스위치(60)가 a-b에 존재할 때 기록 장치(61)에 공급된 25-비트 채널 워드로 변환된다.
메모리(56)으로부터 정보 판독전에 스위치(60)는 중앙 처리 유닛에 의해 스위치(60)에 공급된 제어 신호에 응답하여 위치 c-b에 위치한다.
상기 장치는 제1 및 제2코드워드를 발생시키기 위해 설계된 코드워드 발생기(63)를 구비한다. 주파수 f1을 갖는 파일롯 신호가 제2트랙 부분 TP2에 기록될 정보로 삽입되는 것을 의미하는 경우, 상기 발생기(63)는 제8도를 참고로 설명한 것처럼 제1 및 제2코드워드를 다른 구성에서 발생시키기 위해 제어 신호 발생기(64)에 의해 발생된 주파수 f1을 갖는 스퀘어파 형태로 제어 신호에 응답한다.
스위치(60)는 발생기(63)가 기록장치(61)에 대해 94 25비트 코드워드를 갖을때까지 위치 c-b를 유지한다. 그때 스위치(60)는 위치 a-b로 변화한다. 다음에, 유닛(58)에서 동기 워드 및 메모리(56)의 제1라인의 제1바이트는 2T 프리코딩후 기록장치(61)에 공급된 제1 25-비트 정보 워드를 형성하기 위해 조합된다. 유닛(58)에 의해 실현된 것처럼 직렬 데이터 스트림으로 동기 워드를 삽입하는 것은 위에서 상술된 네덜란드왕국 특허 제90.02.772(PHN 13.537)호에 광범위하게 기술되어 있다.
후에, 메모리의 제1라인에 기억된 나머지 바이트는 유닛(58)에서 25-비트 정보 워드로 변환되고 3의 그룹에 조합되며, 2T 프리코드(59)에 프리코딩하는 것을 받은 후, 기록 캐리어의 트랙에 기록된다.
다음에, 유닛(58)에서 동기 워드와 상기 메모리(56)에서 제2라인의 제1바이트는 프리코더(59)에서 프리코딩된 후 기록장치(61)에 공급된 다음 25비트 정보 워드 형태로 조합된다. 따라서, 3바이트는 메모리(56)의 제2라인에 매번 기억되며, 유닛(58)에서 25비트 정보로 조합되고 변환된다. 이 동작은 메모리(56)의 전체 제2라인이 판독될때까지 계속된다. 이 동작은 메모리(56)의 88번째 라인이 판독될때까지 메모리(56)의 연속 라인에 대해 반복된다. 메모리 색숀 Ⅱ, Ⅲ, Ⅴa, Ⅵa 및 Ⅶa에 기억된 정보는 메모리(56)에서 판독되고 기록 캐리어상의 트랙, 즉, 제1트랙 부분 TP1에서 기록된다.
스위치(60)는 위치 c-b로 되돌아간다. 상기 코드워드 발생기(63)는 기록장치(61)에 의해 트랙에 기록되고 4개의 트랙 부분을 형성하는 94 코드워드(제1 및 제2코드워드)를 발생한다.
결국, 스위치(60)는 위치 a-b로 돌아간다. 이 수단에서 전에 기술되는 메모리(56)에 기억된 나머지 정보가 판독되고 동기 정보가 가산되고 유닛(58)에서 처리된 후 그리고 프리코더(59)가 발생된 후 트랙에 기록된다. 이 구성으로 제3트랙 부분이 발생한다. 그때 다시 스위치(60)는 위치 c-b로 되돌아가며 또다른 47코드워드는 발생기(63)에 의해 기록장치(61)에 공급되고 제5트랙 부분의 형태로 되도록, 트랙에 기록된다.
전에 기술된 단계는 예로, 처리 유닛(62)과 같은, 중앙 처리 유닛에 의해 제13도에 도시된 장치에서 여러 구성부분에 공급된 제어 신호에 응답하여 구성된다.
기술의 단순함, 명확성에 대해서는 이들 제어 신호들은 더 이상 논의되지 않았다.
전에는 제5트랙 부분 TP5가 1325 또는 1445비트를 포함하며 50㎐-625 라인 시스템 또는 60㎐-525 라인 시스템이 관계되는지 아닌지에 의존한다. 이 이유에 대해 이것은 상기 장치의 입력(70)에 대해 존재하는 비디오 신호가 비디오 신호 처리 유닛(51)에 공급되는 신호전에 아날로그대 디지탈 변환기(71)에 샘플되는 클럭 주파수 f1과 기록 헤드가 기록 캐리어(채널 비트비)상의 디지탈 정보를 기록하는 주파수 f2사이에서 간단한 결합을 이룰 수 있다.
여기와 같이 50㎐-625 라인 시스템을 수행할 때, 상기는 f1=864×625×25=13.5㎒를 유지하며 여기서 하나의 비디오 라인으로 클럭 펄스 넘버에 대해 864 표준과, 프레임의 라인 넘버에 대해 625, 매초당 프레임 넘버에 대해서는 25가 유지된다.
상기 채널 비트비 f2에 대해서는 단일 트랙으로 120.000비트(47×191×25+1325=)가 유지된다.
채널 비트비 f2에 대해서 단일 헤드는 120.000×300/2=18M 비트/S이며, 여기서 300은 매초당 기록된 트랙 넘버이다.
f1과 f2사이에는 간단한 4/3비가 존재한다. 위상 고정 루프( 도시하지 않음)는 입력(70)에 공급된 비디오 신호로 공급되며, 이 비디오 신호로부터 13.5㎒ 클럭비를 유도한다. 멀티플라잉시 4/3의 비, 18㎒ 클럭비는 기록 캐리어내의 디지탈 정보를 기록하기 위해 기록 유닛(61)에 대한 필요성이 얻어진다.

Claims (11)

  1. (정정) 자기 기록 캐리어 상의 트랙에 디지털 비디오 신호와 같은 디지털 신호를 기록하기 위한 장치로서, 상기 트랙들은 기록 캐리어에 대해 서로 병렬로 또한 이 기록 캐리어의 길이 방향 축에 대하여 각도를 갖고 런(주행)되고, 상기 장치는 상기 디지털 신호를 수신하기 위한 입력 단자와 상기 디지털 신호를 제1의 트랙 부분에 기록하기 위한 기록수단을 포함하는 디지털 신호를 기록하기 위한 장치에 있어서, n 비트의 제1의 코드워드를 생성하기 위하여 고안된 코드워드 생성 수단을 포함하고, 상기 기록 수단은 n 비트의 제1의 코드워드를 상기 트랙들의 시작부를 형성하는 제2의 트랙 부분에 기록하기 위하여 고안되고, 상기 제1의 코드워드는 연속적으로 제1의 2진값을 갖는 p 비트, 제1의 2진값의 반전 2진값인 제2의 2진값을 갖는 q 비트, 및 제1의 2진값을 갖는 r 비트의 순서를 포함하고, p, q 및 r은 p≥3, q≥3 및 r≥3의 관계를 유지하는 우수인 것인을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  2. (정정) 제1항에 있어서, 상기 장치는 n비트의 제2의 코드워드를 생성하고 제2의 코드워드를 제2의 트랙 부분에 기록하기 위하여 추가로 고안되고, 상기 제2의 코드워드는 제1의 코드워드의 반전 코드워드인 것을 특징으로 하는 디지탈 신호를 기록하기 위한 장치.
  3. (정정) 제1항 또는 제2항에 있어서, r은 p와 동일한 것을 특징으로 하는 디지탈 신호를 기록하기 위한 장치.
  4. (정정) 제3항에 있어서, 상기 제1의 코드워드는 제1의 2진값을 갖는 p 비트, 제2의 2진값을 갖는 q비트, 제1의 2진값을 갖는 p비트 및 제2의 2진값을 갖는 q 비트의 연속적인 순서를 포함하는 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  5. (정정) 제1항에 있어서, 상기 제1의 코드워드는 부가적으로 제1의 2진값의 p + 2의 연속적인 비트를 포함하는 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  6. (정정) 제1항에 있어서, 상기 제1의 코드워드는 부가적인 제2의 2진값의 q + 2의 연속적인 비트를 포함하는 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  7. (정정) 제1항에 있어서, p, q 및 r은 3 또는 5인 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  8. (정정) 제1항에 있어서, 기록된 정보의 주파수와 비교하여 비교적 낮은 주파수를 갖는 캐리어로 이루어지고, 제2의 기록 트랙부에 기록된 정보 내에 있는 파일럿 신호를 생성하기 위하여, 제2의 트랙 내에 제1의 코드워드와 제2의 코드워드를 교대로 기록하여 기록된 평균값이 필수적으로 비교적 낮은 주파수 캐리어의 변화에 따라 변하도록 상기 장치가 고안되는 것을 특징으로 하는 디지탈 신호를 기록하기 위한 장치.
  9. (정정) 제8항에 있어서, 상기 파일럿 신호를 생성하기 위하여 제1 및 제2의 코드워드의 일치하지 않는 값이 0이 되지 않는 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  10. (정정) 제1항에 있어서, n=25인 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
  11. (정정) 제1항에 있어서, 제1의 코드워드는 25비트의 2진수(00011 10001 11000 00111 00011)와 동일한 것을 특징으로 하는 디지털 신호를 기록하기 위한 장치.
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