KR100201798B1 - 확산 스펙트럼 상관기 - Google Patents

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KR100201798B1
KR100201798B1 KR1019930703360A KR930703360A KR100201798B1 KR 100201798 B1 KR100201798 B1 KR 100201798B1 KR 1019930703360 A KR1019930703360 A KR 1019930703360A KR 930703360 A KR930703360 A KR 930703360A KR 100201798 B1 KR100201798 B1 KR 100201798B1
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로버트 씨 딕슨
제프리에스 밴더풀
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에블린 골드파인
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Abstract

의사 잡음 코드로 변조되어 RF 확산 스펙트럼 신호로 송신된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코딩하기 위한 장치가 제시된다. 제1 기준 레지스터는 제1 의사 잡음 신호(22)를 유지하고, 제2 기준 레지스터는 제2 의사 잡음 신호(25)를 유지하며, 수신 레지스터는 수신된 확산 스펙트럼 신호(27)을 유지한다. 제1 모듈로 가산기(26)은 수신된 확산 스펙트럼 신호의 각각의 칩과 제1 의사 잡음 신호의 각각의 칩을 가산하여 다수의 제1 칩 비교 신호를 발생한다. 제1 합산기는 다수의 제1 칩 비교 신호를 가산하여 제1 상관 신호를 발생한다. 비교기는 상부 임계 레벨과 하부 임계 레벨에 상관 신호를 비교하여 제1 데이타 심볼 신호 또는 제2 데이타 심볼 신호를 각각 발생한다.

Description

[발명의 명칭]
확산 스펙트럼 상관기
[도면의 간단한 설명]
본 명세서에 실현되고 본 명세서의 일부를 구성하는 첨부된 도면은 본 발명의 원리를 설명하기 위한 상세한 설명과 함께 본 발명의 양호한 실시예를 도시한다.
제1도는 본 발명에 따른 송신기의 특정 실시예에 대한 블럭도.
제2도는 본 발명에 따른 특정 신호에 대한 타이밍도.
제3도는 본 발명에 따른 수신기의 한 실시예를 도시한 도면.
제4도는 본 발명에 따른 송신기의 제2실시예의 블럭도.
제5도는 본 발명에 따른 수신기의 제2 실시예의 블럭도.
제6도는 표면 음향파(SAW) 상관기에 의해 예시된 것과 같은, 본 발명의 아날로그 실시예를 도시한 도면.
[발명의 상세한 설명]
[발명의 배경]
본 발명은 스펙트럼 통신, 특히 비코드 동기 확산 통신 시스템에 관한 것이다.
[종래 기술의 설명]
확산 스펙트럼 시스템은 송신된 정보를 전송하는데 필요한 최대 대역폭보다 높은 대역에 걸쳐 신호가 확산되는 시스템이다. 직접 시퀸스 확산 스펙트럼 변조를 위한 기술은 안전한 통신을 보장하기 위해 수년동안 개발되어 왔다. 변조는 송신될 정보를 주기적 의사 잡음(PN) 코드와 혼합함으로써 이루어진다. 그 결과는 정보에 비교하여 매우 넓은 대역폭과 낮은 스펙트럼 밀도를 갖는 sin(X)/X 신호이다. 이 스펙트럼 밀도는 다른 무선 감지 장치와의 간섭을 감소시킬 뿐만 아니라, 대역내 간섭 및 재밍(jamming)에 대한 신호의 감도를 감소시킨다. 스펙트럼 확산 시스템에서 나타나는 다른 장점들 중에서 선택적인 어드레싱 능력, 다중 억세스를 위한 코드 분할 멀티플렉싱 및 매우 정밀한 래인징 능력이 있다.
신호의 엔코드 성질에 기인하여, 복조는 통상의 통신 시스템에서보다 더 관련된 프로세스이고, 송신되어 수신된 코드에 동기되는 것과 동일한 기준 코드와 관련된다. 이 프로세스에서의 어려움은 매우 높은 정도의 동기가 이루어질 때까지 수신된 코드와 기준 코드 사이의 어느 정도의 비동기를 표시할 수 없다는 것이다. 또한, PN 코드를 발생시키는데 사용된 송신과 수신 발진기 사이의 부정합은 송신기와 수신기 사이의 동기의 드리프트를 발생시키는 경향이 있다.
2개의 의사 잡음 파형 및 MARK 또는 SPACE를 지정하기 위한 2개의 상관기를 사용하는 종래 기술의 통신 시스템은 본 명세서에 참고로 사용된, 1981년 1월 27일자로 하우러(Hauer)에서 허여된 미합중국 특허 제 4,247,942호에 개시되어 있다. 하우어는 통신 시스템에서, 지연 라인에 연속 입력 펄스를 공급하기 위한 다중 간격 탭을 갖는 제1지연 라인을 개시하고 있다. 각각의 입력 펄스에 응답하여, 다양하게 지연된 펄스는 지연 라인의 탭에 나타나고, MARK 또는 SPACE를 나타내는 펄스를 발생시키는데 사용된다. 그의 개시는 동기 검출기 및 캐리어 송신된 펄스를 검출기에 공급하기 위한 수단을 포함한다.
종래 기술의 어느 것도 하나의 상관기를 사용하여 스펙트럼 확산 신호를 획득하기 위한 장치를 제시하지 못하였으며, 또한 매 데이타 비트상에서 데이타 비트의 시간 주기와 동일한 스펙트럼 확산 신호의 획득 시간을 갖는 장치를 제시하지 못한다. 또한, 종래 기술의 어느 것도 제1데이타 심볼 및 제2 데이타 심볼이 하나의 상관기에서 동일한 정밀도로 결정될 수 있도록 하나의 상관기내에서 2종 임계 검출 또는 코드 속도 또는 신호 획득 시간을 증가시킴이 없이 각각의 부가적인 2중 임계 검출 상관기를 위한 데이타 속도의 배가를 달성하기 위해 다수의 그러한 2중 임계 검출 상관기의 사용을 제시하지 못한다.
본 발명의 목적은 직접적이고, 저렴하고, 사용하기 간단한 하나의 상관기를 사용하여 확산 스펙트럼 신호를 획득하기 위한 장치를 제공하기 위한 것이다.
본 발명의 다른 목적은 제1데이타 심볼 또는 제2데이타 심볼의 발생을 결정하기 위해 하나의 상관기에서 2중 임계 검출 능력을 갖는 스펙트럼 확산 신호를 획득하기 위한 장치를 제공하기 위한 것이다.
본 발명의 또 다른 목적은 동기 기준 코드를 사용함이 없이 확산 스펙트럼 신호를 검출하기 위한 장치를 제공하기 위한 것이다.
본 발명의 또 다른 목적은 코드 동기에 기인한 시간 손실 없이 그리고 어떤 코드 동기 프리앰블을 사용하지 않고 데이타가 송신되는 속도로 수신된 각 데이타 비트상에서 확산 스펙트럼 신호를 획득하는 장치를 제공하기 위한 것이다.
본 발명의 또 다른 목적은 다수의 2중 임계 검출 상관기(DTDC)를 사용할 수 있는 능력을 제공하기 위한 것이다.
본 발명의 또 다른 목적은 송신 및 수신된 데이타 심볼 속도가 송신 및 수신된 코드 비트 속도를 증가시키지 않고 또는 사용된 주파수 스펙트럼의 대역폭을 증가시키지 않고서 증가될 수 있도록 다수의 DTDC를 제공하기 위한 것이다.
본 발명의 부가적인 목적은 다수의 DTDC를 위해, 송신 및 수신된 데이타 심볼 속도가 수신기내의 필요한 수의 상관기가 하나씩 증가하는 동안 2의 인자만큼 증가될 수 있게 하는 것이다.
본 발명의 부가적인 목적은 다수의 DTDC를 위해 확산 스펙트럼 신호를 획득하기 위한 시간이 송신 및 수신된 데이타 심볼 속도가 증가할 때에도 일정하게 유지하게 하는 것이다.
상세한 설명의 실시예와 같은 본 발명에 따라, PN 코드로 변조된 데이타 신호를 포함하는 수신 확산 스펙트럼 신호를 디코딩하기 위한 장치가 제공되고, 이 장치는 임계 셋팅 수단, 제1 기준 시퀀스 저장 수단, 수신 시퀀스 저장 수단, 제1 상관 수단 및 비교 수단을 포함한다. 제1 상관 수단은 제1 칩 비교 수단 및 제1 합산기 수단을 포함할 수 있다. 본 발명은 제2 기준 시퀀스 저장 수단 및 제2 상관 수단을 더 포함할 수 있다. 제2 상관 수단은 제2 칩 비교 수단 및 제2 합산기 수단을 포함할 수 있다.
임계 셋팅 수단은 획득되는 코드당 칩의 총 수와 같거나 그보다 작게 정합되기 위한 임계를 셋트할 수 있다. 임계 셋팅 수단은 확산 스펙트럼 신호, 잡음 환경 및 데이타 신호로 사용된 에러 교정량을 사용하여 송신 및/또는 수신되는 데이타의 패턴 및 응용을 분석할 수 있다. 이러한 분석은 응답하여, 임계 셋팅 수단은 임계 레벨을 발생한다. 임계 셋팅 수단은 특정 장치, 응용 또는 동작 환경을 위해 각각의 임계를 선정하기 위해 사용될 수 있고, 또는 확산 스펙트럼 수신기와 결합할 수 있고, 그리고 응용 또는 동작 환경이 변함에 따라 하나 또는 그 이상의 임계 레벨을 세트하여 조절하기 위해 사용될 수 있다.
2중 임계 능력을 갖는 1개의 상관기의 경우에, 제1 기준 시퀀스 저장 수단은 제1 의사 잡음 신호를 저장하고, 수신 시퀀스 저장 수단은 수신된 확산 스펙트럼 신호를 저장한다. 제1 기준 시퀀스 저장 수단 및 수신 시퀀스 저장 수단과 결합되는 제1 칩 비교 수단은 다수의 제1 칩 비교 신호를 발생하기 위해 제1 의사 잡음 신호의 각가의 칩과 수신된 확산 스펙트럼 신호의 각각의 칩을 비교한다. 제1 칩 비교 신호과 겹합되는 제1 합산기 수단은 다수의 제1 칩 비교 수단을 가산하여 제1 상관 신호에 응답하여 비교 수단은 제1 데이타 심볼 신호를 발생한다. 하부 임계 레벨보다 작은 제1 상관 신호에 응답하여, 비교 수단은 제2 데이타 심볼 신호를 발생한다.
아날로그 상관기 장치의 경우에, 아날로그 임계 레벨보다 큰 제1 상관 신호에 응답하여, 비교 수단은 제1 데이타 심볼상관 신호를 발생한다. 아날로그 임계 레벨보다 큰 제1 반전 상관 신호에 응답하여, 비교 수단은 제2 데이타 심볼 상관 신호를 발생한다.
2중 임계 능력을 각각 갖는 2개의 상관기의 경우, 제1 기준 시퀀스 저장 수단은 제1 의사 잡음 신호를 저장하고, 제2 기준 시퀀스 저장 수단은 제2 의사 잡음 신호를 저장하며, 수신 시퀀스 저장 수단은 수신된 확산 스펙트럼 신호를 저장한다. 제1 칩 비교 수단은 제1 기준 시퀀스 저장 수단과 수신 레지스터 수단에 결합된다. 수신된 확산 스펙트럼 신호에 응답하여, 제1 칩 비교 수단은 수신된 확산 스펙트럼 신호의 각각의 칩을 제1 의사 잡음 신호의 각각의 칩에 비교하여 다수의 제1 칩 비교 신호를 발생한다. 제1 합산기 수단은 제1 칩 비교 수단과 결합된다. 제1 칩 비교 수단으로부터의 다수의 제1 칩 비교 신호에 응답하여, 제1 합산기 수단은 다수의 제1 칩 비교 신호를 가산하여 제1 상관 신호를 발생한다.
제2 칩 비교 수단은 제2 기준 시퀀스 저장 수단과 수신 시퀀스 저장 수단에 결합된다. 수신된 확산 스펙트럼 신호에 응답하여, 제2 칩 비교 수단은 수신된 확산 스펙트럼 신호의 각각의 칩을 제2 의사 잡음 신호의 각각의 칩에 비교하여 다수의 제2 칩 비교 신호를 발생한다. 제2 합산기 수단은 제2 칩 비교 수단과 결합된다. 다수의 제2 칩 비교 신호에 응답하여, 제2 합산기 수단은 다수의 제2 칩 비교 신호를 가산하여 제2 상관 신호를 발생한다.
비교 수단은 제1 합산기 수단과 및 제2 합산기 수단에 결합된다. 디지탈 상관기 장치용 비교 수단은 각각의 기준 시퀀스 저장 수단을 위한 상부 및 하부 임계 레벨을 포함한다. 상부 임계 레벨보다 큰 제1 상관 신호에 응답하여, 비교 수단은 제1 데이타 심볼 신호를 발생한다. 하부 임계 레벨보다 작은 제1 상관 신호에 응답하여, 비교 수단은 제2 데이타 심볼 신호를 발생한다. 하부 임계 레벨보다 작은 제2 상관 신호에 응답하여, 비교 수단은 제3 데이타 심볼 신호를 발생한다. 상부 임계 레벨보다 큰 제2 상관 신호에 응답하여, 비교 수단은 제4 데이타 심볼 신호를 발생한다.
아날로그 상관기 장치용 비교 수단은 각각의 기준 시퀀스 저장 수단에 대해 동일할 수 있는 제1 및 제2 임계 레벨를 포함한다. 제1 임계 레벨보다 큰 제1 상관 신호에 응답하여, 비교 수단은 제1 데이타 심볼 신호를 발생한다. 제2 임계 레벨보다 큰 제1 반전 상관 신호에 응답하여, 비교 수단은 제2 데이타 심볼 신호를 발생한다. 제2 임계 레벨보다 큰 제2 반전 상관 신호에 응답하여, 비교 수단은 제3 데이타 심볼 신호를 발생한다. 제1 임계 레벨보다 큰 제2 상관 신호에 응답하여, 비교 수단은 제4 데이타 심볼 신호를 발생한다.
통계적으로, 부분적으로 임계 레벨 셋팅에 의존하는 검출의 정확성은 몇가지 변수의 함수인데, 그 변수들은 다음과 같다: 데이타 심볼 베이시스당 칩의 총수와 정합된 칩의 총수, 입력 신호의 에러 비율과 전치 에러 교정의 정도 및 진행될 데이타 스트림이 지속되는지, 주기적으로 반복하는지, 패턴되는지, 일시적인지, 정지되는지 또는 임의적인 지의 여부.
본 발명은 수신된 확산 스펙트럼 신호를 다수의 의사 잡음 신호에 상관시키기 위한 수단을 갖는 다수의 의사 잡음 신호를 저장하기 위한 다수의 기준 시퀀스 저장 수단을 더 포함한다. 상관 수단은 특정 수신된 확산 스펙트럼 신호에 의존하여 다수의 상관 신호를 발생할 것이다. 이와 마찬가지로, 비교 수단은 DTDC 기준 시퀀스 저장 수단 중 하나의 수단에서 특정 임계 레벨을 교차하는 상관 신호에 응답하여 다수의 데이타 심볼 신호 중 1개의 데이타 심볼 신호를 발생시키기 위해 다수의 상관 신호에 응답할 것이다.
본 발명의 부가적인 목적 및 장점은 후술되는 상세한 설명에서 잘 설명될 것이고, 일부는 상세한 설명으로부터 명백할 것이며, 또는 본 발명의 실시에 의해 익힐 수 있을 것이다.
[양호한 실시예]
첨부된 도면에서 도시된 본 발명의 본 양호한 실시예에 대해 상세한 설명을 기술한다.
본 발명은 확산 스펙트럼 신호를 생성하기 위해 PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 송신 및 디코딩하기 위한 장치를 포함한다. 제1도에 도시된 바와 같이, 송신기는 코드 클럭발생기(21), 코드 선택기(28), 코드 발생기(22), 코드 클럭 분할기(23), 펄스 발생기(24), 데이타 발생기(25), 모듈로 2 가산기(26), 캐리어(29) 및 위상 편이 키이(phase shift keyed; PSK) 변조기 및 RF 송신기(27)을 포함한다. 코드 클럭 발생기(21)은 코드 발생기(22)와 클럭 분할기(23)에 공급되는 클럭 신호를 발생한다. 클럭 발생기(23)을 이용하여, 송신기(27)의 코드 및 데이타는 데이타 클럭 주파수의 코드 길이(L)와 동일하게 되는 다중 코드 클럭 주파수와 동기되어, 길이(L)의 PN코드 시퀀스당 하나의 데이타 비트를 허용한다. 코드 클럭 분할기(23)으로부터의 데이타 클럭 신호는 펄스 발생기(24)와 데이타 발생기(25)에 공급된다. 데이타 발생기(25)는 통신 시스템을 따라 송신될 데이타 신호의 소스이다. 펄스 발생기(24)의 출력 신호는 코드 선택기(28)에 의해 선택된 PN 코드를 발생하는 코드 발생기(22)에 공급된다. 그후 반복적인 PN코드는 코드 발생기(22)에서 공급되어 모듈로 2 가산기(26)에서 모듈로 2가 데이타 발생기(25)로부터 공급된 데이타에 가산된다. 모듈로 가산기(26)의 출력은 PSK 변조기 및 RF 송신기(27)내에서 캐리어(29)에 의해 변조된 위상 편이 키이된 PN 코드로 변조된 데이타 신호이다.
제1도의 코드와 클럭 신호의 타이밍의 예가 제2도에 도시된다. 타이밍도는 코드 클럭 신호, 코드의 길이(L)에 의해 분할된 코드 클럭 신호인 데이타 클럭 신호, 펄스 발생기 리셋 신호, 코드 신호, 데이타 신호 및 엔코드된 데이타 신호를 도시한다. 데이타 신호와 가산된 모듈로 2가 엔코드 신호를 발생할 때와 RF 캐리어에 의해 변조될 때, 코드 신호는 확산 스펙트럼 신호를 생성한다. 송신된 확산 스펙트럼 신호는 제3도에 도시된 수신기에 의해 수신될 수 있다.
제3도가 본 발명의 하나의 2중 임계 검출 상관기 수신기의 특정 실시예를 도시하지만, 본 발명은 일반적으로 PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코딩하기 위한 장치를 포함한다. 그 장치는 임계 수단, 제1 기준 시퀀스 저장 수단, 수신 시퀀스 저장 수단, 제1 상관 수단 및 비교 수단을 포함한다. 제1 상관 수단은 제1 칩 비교 수단과 제1 합산기 수단을 포함할 수 있다. 제3도를 참조하면, 제1기준 시퀀스 저장 수단은 기준 레지스터(33)으로서 실현될 수 있고, 수신 시퀀스 저장 수단은 수신 레지스터(39)로서 실현될 수 있고, 제1 칩 비교 수단은 제1 가산기(40)으로서 실현될 수 있으며, 제1 합산기 수단은 제1 합산기(41)로서 실현될 수 있고, 비교 수단은 제1 및 제2 심볼 비교기(42,43)으로서 실현될 수 있다. 임계 셋팅 수단은 임계 셋터 장치(45)로서 실현될 수 있다. 제1 가산기(40)은 제1 기준 레지스터(33)과 수신 레지스터(39)와 결합된다. 제1 합산기(41)은 제1 가산기(40)과 결합된다.
제3도에 도시된 전형적인 구성에서, 계수 제어기(30)은 코드 발생기(32)와 기준 레지스터(33)에 접속된 코드 클럭 발생기(31)과 결합될 수 있다. 코드 발생기(32)는 또한 기준 레지스터(33)에 접속된다. 코드 선택 회로(34)는 코드 발생기(32)와 결합된다. 계수 제어기(30)은 수신기에 의해 검출되는 코드 선택 회로(34)에 의해 선택된 특정 의사 잡음 신호의 길이를 제어하고, 제1 기준 레지스터(33)에 코드 발생기(32)가 길이(L)의 코드를 출력하게 하는 코드 클럭 발생기(31)로 신호를 출력한다. 계수 제어기(30)은 코드 발생기(32)와 제1 기준 레지스터(33)을 트리거하는 코드 클럭 발생기(32)를 트리거한다. 코드 발생기(32)는 코드 선택 회로(34)에 의해 결정된 바와 같이 제1 기준 레지스터(33)에 특정 의사 잡음 신호를 출력한다. 코드 선택 회로(34)는 다수의 의사 잡음 코드를 통한 주사(scan)를 가능하게 하는 코드 발생기(32)에 신호를 제공할 수 있다. 동작시, 신호 코드는 제1 기준 레지스터 내로, 또는 주사 모드로 로드될 수 있고, 제1 기준 레지스터(33)은 수신괸 코드 발생에 정합될 때까지 일정하게 변화하는 코드에 의해 주기적으로 로드될 수 있다.
또한 제3도는 국부발진기(LO)(37)과 저역 통과 필터(LPF)(38)에 결합된 곱검출기(36)과 결합된 RF 및 IF 증폭기(35)를 도시한다. 저역 통과 필터(38)은 수신 레지스터(39)와 클럭 회복 회로(46)에 결합된다.
2중 임계 능력을 갖는 하나의 상관기의 경우, 제1 기준 레지스터(33)은 제1 의사 잡음 신호를 저장하고, 수신 레지스터(39)는 수신된 확산 스펙트럼 신호를 저장한다. 제1 가산기(40)은 다수의 제1 칩 비교 신호를 발생하기 위해 수신된 확산 스펙트럼 신호의 각각의 칩을 제1 의사 잡음 신호의 각각의 칩과 비교한다. 제1 합산기(41)은 다수의 제1 칩 비교 신호를 가산하여 제1 상관 신호를 발생한다. 상부 임계 레벨보다 큰 제1 상관 신호에 응답하여, 비교기(42)는 제1 데이타 심볼 신호를 발생한다. 하부 임계 레벨보다 작은 제1 상관 신호에 응답하여, 비교기(42)는 제2 데이타 심볼 신호를 발생한다.
동작시 PN코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호는 수신 레지스터(39)내에 저장될 것이고, 제1 의사 잡음 신호의 전체 길이(L)는 기준 레지스터(33)내에 저장될 것이다. 수신된 확산 스펙트럼 신호의 각각의 칩은 제1 가산기(40)에 의해 제1 기준 의사 잡음 신호의 각각의 칩에 의해 가산된 모듈로 2이다. 2개의 신호의 이러한 모듈로 가산은 제1 가산기(40)으로부터 제1 합산기(41)에 전달되는 다수의 제1 칩 비교 신호를 발생할 것이다. 제1 합산기(41)은 제1 상관 신호를 발생하기 위해 다수의 제1 신호를 가산한다.
제1 심볼 비교기(42)와 제2 심볼 비교기(43)은 제1 합산기(41)과 결합된다. 비교기(42,43)은 상부 임계 레벨과 하부 임계 레벨를 가진다. 상부 임계 레벨보다 큰 제1 상관 신호에 응답하여, 제1 심볼 비교기(42)는 제1 데이타 심볼 신호를 발생한다. 하부 임계 레벨보다 작은 제1 상관 신호에 응답하여, 제2 심볼 비교기는 제2 데이타 심볼 신호를 발생한다. 데이타 발생기(47)은 각각 제1 또는 제2 데이타 심볼 신호당 제1 또는 제2 데이타 심볼을 발생한다. 제1 및 제2 데이타 심볼 신호는 각각 1비트 및 O비트 데이타 신호이다.
본 발명은 2개 또는 그 이상으로 N개 까지의 서로 다른 반복적인 시퀀스의 사용을 더 포함할 수 있는데, 제4도에서는 예로 2개를 사용한다. 이러한 특정한 경우에, 제1 코드 발생기(52)와 제2 코드 발생기(52)는 확산 스펙트럼 코드 신호를 발생하기 위해 코드 선택기(62)에 의해 선택된 것과 같은 서로 다른 반복적인 시퀀스를 각각 발생한다. 코드 클럭 발생기(51)은 분할기(54) 뿐만 아니라 코드 발생기 A(52)와 코드 발생기 B(53)에 코드 클럭을 공급한다. L/2의 분할은 길이(L)의 코드 시퀀스의 2배와 동일한 주기를 갖는 클럭 신호를 분할기2(56), 2개의 스테이지 편이 레지스터(58) 및 데이타 발생기(55)에 공급한다. 따라서, 코드 길이(L)당 2개의 데이타 비트가 데이타 발생기(55)에 의해 발생되어 2개의 스테이지 편이 레지스터(58)에 병렬로 저장된다. 분할기(56)은 길이(L)의 하나의 코드 세그먼트당 클럭 신호를 샘플기(57) 및 코드 발생기 A(52)와 코드 발생기(53)을 리셋하는 펄스 발생기(59)에 공급한다. 샘플기(57)은 2개의 신호를 선택기(60)으로 출력하는데, 선택기는 코드 발생기 A(52)와 코드 발생기 B(53)으로부터 신호를 수신하는 4개의 코드 세그먼트(코드 A, 반전 코드 A, 코드 B, 반전 코드 B) 중의 하나를 결정한다. 그후 변조된 코드는 선택기(60)으로부터 코드가 송신기에서 RF 캐리어(63)에 의해 PSK 변조되는 PSK 변조기 및 RF 송신기(61)로 전달된다. 제4도의 회로를 사용하는 확산 스펙트럼 신호 송신은 본 발명의 특정 실시예로 제5도에 도시된 것과 같은 장점을 가지고, 수신기는 4개의 가능한 확산 스펙트럼 수신코드를 검출하기 위해 2개의 상관기만을 사용하여 장치될 수 있다. 특정 코드는 실제적으로 180도로 위상 반전된 2개의 확산 스펙트럼 PN 코드이다.
따라서, 본 발명은 제2 기준 시퀀스 저장 수단, 제2 칩 비교 수단 및 제2 합산기 수단을 더 포함할 수 있다. 제2 기준 시퀀스 저장 수단은 제2 기준 레지스터(73)으로서 실현될 수 있고, 제2 칩 비교 수단은 제2 가산기(80)으로서 실현될 수 있고, 제2 합산기는 제2 합산기(81)로서 실현될 수 있다. 제2 기준 레지스터(73)은 제2 의사 잡음 신호를 저장한다. 제2 가산기(80)은 제2 기준 레지스터(73)과 수신 레지스터(39)와 결합된다.
예시적으로 2개의 상관기가 사용된 경우가 도면에 도시되는데, 각각은 2중 임계 능력을 갖고, 제1 가산기(40)은 수신된 확산 스펙트럼 신호의 각각의 칩을 제1 의사 잡음 신호의 각각의 칩과 비교하여 다수의 제1 칩 비교 신호를 발생한다. 제1 합산기(41)은 제1 가산기(40)과 결합된다. 제1 가산기(40)으로부터의 다수의 제1 칩 비교 신호에 응답하여, 제1 합산기(41)은 다수의 제1 칩 비교 신호를 가산하여 제1 상관 신호를 발생한다.
제2 가산기(80)은 제2 기준 레지스터(73)과 수신 레지스터(39)에 결합된다. 수신된 확산 스펙트럼 신호에 응답하여, 제2 가산기(80)은 수신된 확산 스펙트럼 신호의 각각의 칩을 제2 의사 잡음 신호의 각각의 칩과 비교하여 제2 다수의 칩 비교 신호를 발생한다. 제2 합산기(81)은 제2 가산기(80)에 결합된다. 다수의 제2 칩 비교 신호에 응답하여, 제2 합산기(81)은 제2 다수의 모듈로 가산 신호를 가산하여 제2 상관 신호를 발생한다.
본 특정 실시예에서, 비교 수단은 비교 회로(97)로 실현된다. 비교 회로(97)은 상부 및 하부 임계 레벨을 갖는다. 비교 회로(97)은 제1 합산기(41)과 제2 합산기(81)에 결합된다. 상부 임계 레벨보다 큰 제1 합산기(41)로부터의 제1 상관 신호에 응답하여, 비교 회로(97)은 제1 데이타 심볼상관 신호를 발생한다. 하부 임계 레벨보다 작은 합산기(41)로부터의 제1 상관 신호에 응답하여, 비교 회로(97)은 제2 데이타 심볼 상관 신호를 발생한다. 상부 임계 레벨보다 큰 제2 합산기(81)로부터의 제2 상관 신호에 응답하여, 비교 회로(97)은 제3 데이타 심볼 상관 신호를 발생한다. 하부 임계 레벨보다 작은 제2 합산기(81)로부터의 제2 상관 신호에 응답하여, 비교 회로(97)은 제4 데이타 심볼 신호를 발생한다. 그후 데이타 발생기(98)은 수신된 데이타 심볼 상관 신호에 대응하는 데이타 심볼을 발생한다. 제1, 제2, 제3 및 제4 데이타 심볼 신호는 예를 들어, 데이타 비트 00, 01, 10 및 11로 표시될 수 있다.
본 발명이 제3도에 도시된 제1 상관기 또는 제5도에 도시된 제1과 제2 상관기 중의 어느 하나를 사용한다고 설명되지만, 본 발명은 디코딩이 다수의 데이타 심볼 신호를 디코드하는 다수의 상관기를 사용하기 위해 확장될 수 있다.
수신기에서 다수의 DTDC를 사용함으로써, 길이(L)의 코드는 수신기내의 DTDC의 수의 2배와 동일한 다수의 데이타 심볼을 송신 및 수신하기 위해 사용될 수 있다. 다수의 DTDC를 사용하는 것의 다른 장점은 송신 및 수신된 데이타 심볼 속도가 각각의 부가적인 DTDC, 코드 길이(L), 집합 코드 칩 속도의 2배이면서, 사용된 스펙트럼의 대역폭은 모두 고정되게 남는다는 것이다. 더욱이, 확산 스펙트럼 신호를 획득하기 위한 시간은 고정되게 남고, 시스템은 저렴하고 간단하게 된다. 코드 선택 회로는 다수의 의사 잡음 코드를 통해 주사하기 위해 코드 발생기를 엔에이블하는 코드 발생기에 신호를 제공할 수 있다. 동작시, 신호 코드 셋트는 기준 레지스터내로 또는 주사 모드내에 로드될 수 있고, 기준 레지스터는 수신된 코드 발생과 정합될 때까지 계속적으로 변화하는 코드에 의해 주기적으로 로드될 수 있다.
본 발명에 의해 제공된 시스템에서, 의사 잡음 신호는 Lx(Rd/Sd)와 동일한 클럭 속도를 갖도록 생성된 L 비트를 갖는 PN 코드 세그먼트를 포함하는데, 여기서 Rd는 변조되는 데이타의 클럭 속도이고, Sd는 길이(L)의 코드 세그먼트당 데이타 비트의 수이다. 예를 들어, 하나의 데이타 비트에 대해 송신될 데이타 속도는 100㎑이고, 코드 길이(L)은 100이면, 코드 속도 Rc는 Lx(Rd/Sd)=(100)×(100㎑/1)=10.0㎒와 동일하다. 코드당 2개의 데이타 비트인 경우에, 데이타 속도는 200㎑로 상승하지만, 코드 속도 Rc=(100)×(200㎑/2)=10㎒이다. 따라서, 데이타 속도는 코드 속도의 증가 등이 없이도 증가할 수 있다. 길이(L)의 코드 세그먼트당 생성된 데이타 상부 심볼의 수는 Sd=코드 세그먼트당 데이타 비트의 수인 경우 2sd이다.
송신기에서, 길이(L)의 코드 세그먼트의 개시는 2sd 데이타 심볼을 생성할 수 있는 코드 세그먼트당 데이타 비트의 수에 의해 한정된 각각의 데이타 셋트와 동기하여 정렬된다. 예를 들어, 코드 세그먼트당 2개의 데이타 비트가 송신된 후, 데이타 심볼은 2sd=4인데, 이것은 00, 01, 10 및 11로 표시될 수 있다. 제1 데이타 심볼이 송신되면, 제1 코드가 보내질 것이다. 제1 데이타 심볼이 송신되면, 제1 코드의 반전이 보내질 것이다. 제2 데이타 심볼이 송신되면, 제1 코드의 반전이 보내질 것이다. 동일한 과정이 제2 코드의 반전이 사용될 제3 데이타 심볼과 정상적인 제2 코드가 사용될 제4 데이타 심볼에 수행된다. 수신기에서, 송신기내의 것과 동일한 제1 기준 코드와 제2 코드 세그먼트는 2개의 상관기의 저장 소자내에 로드되어 안정하게 유지된다. 수신된 신호는 그후 상관기를 통과하고, 제1 상관기로부터의 상관기 스코어가 임계값(T)를 초과할 때, 제1 데이타 심볼 상관 신호가 생성된다. 상관 스코어가 L-T보다 작다면, 제2 데이타 심볼 상관 신호가 생성된다. 제2 상관기 스코어가 L-T보다 작을 때 제3 데이타 심볼에 대해, 그리고 제2 상관기가 T보다 클 때 제4 데이타 심볼에 대해서도 같은 결과가 나온다.
본 발명의 제2 양호한 실시예가 예를 들어, 기준 시퀀스 저장 장치와 수신 시퀀스 저장 장치를 포함하는 아날로그 장치로서 표면 음향파 장치와 같은 아날로그 장치를 사용할 수 있다. 표면 음향파(SAW) 장치는 가산기(40)과 합산기(41)을 부가적으로 포함할 수 있고, 완전한 자기 내장 상관 유니트로서 기능할 수 있다. 부가적으로, 기준 시퀀스 저장 장치의 다수의 셋트는 다수의 의사 잡음 신호를 디코딩하기 위해 매우 소형의 수단을 형성하기 위해 수신 시퀀스 저장 장치와 함께 하나의 특정 표면 음향파 장치상에 구성될 수 있다.
지연 라인 정합 필터 또는 SAW 상관기는 디지탈 상관기로서 동작하지만, 기저대역에서의 전압 레벨보다는 RF 신호에서 위상 편이의 상관을 통해 상관을 달성하는 코드 칩의 특정한 시퀀스를 인식하기 위해 설계된 수동 장치이므로, 고잡음 또는 간섭/재밍과 같은, 디지탈 상관기의 많은 고유한 문제점을 제거할 수 있다.
상관기 내부의 각각의 지연 소자는 각각의 소자가 어느 한 주기에서 하나의 칩에만 대응하도록 송신된 코드 클럭의 주기와 동일한 지연을 갖는다. 수신된 신호가 지연 라인 아래로 전파할 때, 각각의 소자의 위상 구조는 전파된 PN 엔커드 파와 동상 또는 이상으로 가산되고, 모든 지연 소자의 출력은 그후 총 상관값에 도달하기 위해 합산된다. 소자의 모든 위상 편이 구조가 전파된 파의 위상 편이와 정합할 때, 최대합과 상관이 달성된다.
원하는 상관을 달성하기 위해, 정확한 기준 코드가 SAW 장치내에 로드되어야 한다. 본 논의는 BPSK 장치에 대한 것이지만, 본 발명은 확장되어 MSK, QPSK 등과 같은 소정의 PSK를 포함한다. 2상(bi-phase) 편이 키이 신호를 가정하면, 위상 반전은 PN 코드의 각각의 1/0 전이시에 발생될 것이다. 이것은 보통 2가지 방법 중의 1가지로 달성된다. 첫번째는 각각의 소자내에 모든 위상을 철력할 수 있는 프로그램가능한 상관기를 통하는 것이다. 제6도에서 도시된 바와 같이, 2상 편이 키이 장치를 위해 계수 제어기(101)은 L클럭 신호를 코드 발생기(104)와 기준 레지스터(105)에 보내는 코드 클럭 발생기(102)를 제어한다. 코드 발생기(104)는 그후 코드 선택기(103)에 의해 결정된대로 단일 코드를 생성하고, 그것을 기준 레지스터(105)내로 로드한다. 코드가 기준 레지스터(105)내에 저장될 때, 0/1의 패턴은 지연 라인 상관기(106)내로 로드되어 레지스터 A(2)의 내용은 소자 T(2)와 소자 A(L)에 접속된다. 그후 상관기는 제1 데이타 심볼에 대응하는 소자의 모든 출력이 합산 장치(108, 110)에 접속되고, 제2 데이타 심볼에 대응하는 소자의 모든 출력은 합산 장치(109, 111)에 접속되도록 프로그램된다. 이러한 예에서, 제1 데이타 심볼은 제1 위상 심볼로서 실현되고, 제2 데이타 심볼은 제2 위상 심볼로서 실현된다.
프로그램 불가능 장치에서, 이러한 위상 편이는 기본적인 위상 정합을 이루기 위해 각각의 소자에 배치된 변환기를 통해서 구성될 때 프로그램되고, 사용자에 의해 바뀔 수 없으므로 1개의 코드 시퀀스만이 상관될 수 있다. 그다음 반전 및 비반전 위상 소자는 프로그램가능한 장치에서처럼 함께 합산된다.
PN 코드, PSK 변조 및 RF 주파수를 갖는 신호가 SAW상관기에서 수신된 신호와 동일할 때, 수신된 신호가 증폭되고, (그리고 하향 변환할 수 있고, IF 주파수로의 하향 변환이 필요하지 않다면 사용되지 않을) 지연 라인 상관기(106)에 공급된다. 파가 상관기의 표면을 가로질러 전파할 때, 각각의 지연 소자 내의 에너지는 기준 소자의 위상 대 수신된 신호 위상에 의해 결정된 인자만큼 증가한다.
제1 위상과 동상인 지연 소자의 출력은 합산기(108, 110)에서 합산되고, 제1 위상과 180도 이상되는 지연 소자의 출력은 합산기(109, 111)에서 합산된다. 비반전된 코드 세그먼트, 장치를 통하여 전파하는 상관기내에 기준된 것과 같은 동일한 PN 코드 위상 편이를 갖는 PSK 변조된 신호 및 제1 코드 칩 지연 라인의 단부에 도달할 때, 수신된 신호의 모든 위상 편이는 상관기를 포함하는 소자의 위상 편이와 정합하고, 제1 위상 최대 에너지가 얻어진다. 반전된 제1 위상 합산기(109)의 출력은 위상 반전기(112)에 의해 반전되고, 합산기(114)내의 제1 위상 합산기(108)의 출력과 동상으로 합산된다. 합산기(114)의 출력이 임계 셋터(118)에 의해 임계 검출기(116)내의 임계 셋트를 초과하면, 제1 데이타 심볼 상관 신호가 임계 검출기(116)에 의해 발생되어 제1 데이타 심볼 신호를 생성하는 데이타 발생기(119)에 공급된다.
반전된 코드 세크먼트, 장치를 통해서 전파하는 상관기내에 기준된 위상 편이가 동일한 비반전된 PN 코드 위상 편이를 갖는 PSK 변조된 신호 및 제1 코드 칩 지연 장치의 단부에 도달할 때, 수신된 신호의 모든 위상 편이는 비교기를 포함하는 모든 소자의 위상 편이와 정합하고, 반전된 제1 위상 최대 에너지가 얻어진다. 제1 위상 합산기(110)의 출력은 위상 반전기(113)에 의해 반전되고, 합산기(115)에서 반전된 제1 위상 합산기(111)의 출력과 동상으로 합산된다. 합산기(115)의 출력이 임계 셋터(118)에 의해 임계 검출기(117)내의 임계 셋트를 초과하면, 제2 데이타 심볼 상관 신호가 임계 검출기(117)에 의해 발생되어 제2 데이타 심볼 신호를 생성하는 데이타 발생기(119)에 공급된다.
본 발명의 방법 및 장치와 종래 기술의 방법 및 장치 사이의 차이점은 상관 펄스가 데이타 심볼을 직접 유도하기 위해 사용되고, 다른 시스템은 인입 수신된 코드 신호에 매우 긴 기준 코드 신호를 동기시키기 위한 펄스를 사용할 수 있다는 것이다.
SAW 장치와 디지탈 상관기 사이의 차이점은 사용되는 주파수 대역에 있다. SAW 장치는 일반적으로 IF에서 사용되지만, RF에서도 사용될 수 있다. 디지탈 상관기는 일반적으로 기저 대역에서 사용된다. 다른 차이점은 SAW 장치는 위상 편이 비교를 수행하고, 디지탈 상관기는 전압 레벨 비교를 수행한다는 것이다. 더나아가, SAW 장치는 디지탈 상관기의 출력과 다르게 출력을 합산하다. 또한, 본 발명이 SAW 상관기로서 실현될 때, 수신 코드 클럭은 PN 코드를 상관하기 위해 요구되지 않는다. SAW 상관기를 사용하는 본 발명은 소수의 부품을 사용하여 실현될 수 있다.
본 발명은 PN 코드로 변조되고, 확산 스펙트럼 RF 신호를 생성하기 위해 RF 캐리어로 변조된 데이타 신호를 포함하는 수신된 PSK 확산 스펙트럼 신호를 디코딩하기 위한 상관기를 사용하는 방법을 더 포함한다. 제1방법은 디지탈 상관기를 사용하는 단계, 임계 셋팅 수단을 사용하여 상부 및 하부 임계 레벨을 셋팅하는 단계, 기준 시퀀스 저장 수단내에 의사 잡음 신호를 저장하는 단계, 기준 시퀀스 저장 수단내에 수신된 확산 스펙트럼 신호를 저장하는 단계, 상관 신호를 발생하기 위해 수신된 확산 스펙트럼 신호를 의사 잡음 신호에 상관시키는 단계, 상부 임계 레벨과 하부 임계 레벨과 상관 신호를 비교하는 단계, 상부 임계 레벨보다 큰 상관 신호에 응답하여 제1 데이타 심볼을 발생하는 단계 및 하부 임계 레벨보다 작은 상관 신호에 응답하여 제2 데이타 심볼을 발생하는 단계를 포함한다.
제2 방법은 SAW 상관기에 의해 실현된 것과 같은 아날로그 상관기를 사용하는 단계, 임계 셋팅 수단을 사용하여 동일 할 수 있는 2개의 임계 레벨을 셋팅하는 단계, 기준 시퀀스 저장 수단내에 의사 잡음 신호를 저장하는 단계, 기준 시퀀스 저장 수단내에 수신된 확산 스펙트럼 신호를 저장하는 단계, 2개의 상관 신호를 발생하기 위해 수신된 확산 스펙트럼 신호를 의사 잡음 신호에 상관시키는 단계, 제1 임계 레벨에 제1 상관 신호를 비교하고 제2 임계 레벨과 반전 상관 신호를 비교하는 단계 및 제1 임계 레벨보다 큰 제1 상관 신호에 응답하여 제1 데이타 심볼을 발생하고 제2 임계 레벨보다 큰 반전 상관 신호에 응답하여 제2 데이타 심볼을 발생하는 단계를 포함한다.
본 기술에 숙련된 자들에게는 본 발명의 범위 및 취지를 벗어남이 없이 확산 스펙트럼으로 변조된 데이타 신호를 포함하는 수신된 확산 스펙트럼 신호를 디코딩하기 위한 장치에 대한 다양한 변형이 이루어질 수 있음이 명백할 것이고, 본 발명은 첨부된 특허 청구의 범위내에 제공되는 장치 변형과 수정을 표함한다.

Claims (25)

  1. PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치에 있어서, 데이타 신호, 잡음 환경 및 에러 교정량의 패턴 및 인가를 분석하고, 상부 및 하부 임계 레벨을 결정하기 위한 임계 셋팅 수단(threshold setting means), 제1 의사 잡음 신호를 저장하기 위한 제1 기준 시퀀스 저장 수단, 제2 의사 잡음 신호를 저장하기 위한 제2 기준 시퀀스 저장 수단, 수신된 확산 스펙트럼 신호를 저장하기 위한 수신 시퀀스 저장 수단, 상기 제1 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단에 결합되고, 수신된 확산 스펙트럼 신호에 응답하여, 다수의 제1 칩 비교 신호를 발생하도록 제1 의사 잡음 신호의 각각의 칩과 수신된 확산 스펙트럼 신호의 각각의 칩을 비교하기 위한 제1 칩 비교 수단, 상기 제1 칩 비교 수단에 결합되고, 다수의 제1 칩 비교 신호에 응답하여, 제1 상관 신호(correlation signal)를 발생시키도록 다수의 제1 칩 비교 신호를 가산하기 위한 제1 합산기 수단(summer means), 상기 제2 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단에 결합되고, 수신된 확산 스펙트럼 신호에 응답하여, 닫수의 제2 칩 비교 신호를 발생시키도록 제2 의사 잡음 신호의 각각의 칩과 수신된 확산 스펙트럼 신호의 각각의 칩을 비교하기 위한 제2 칩 비교 수단, 상기 제2 칩 비교 수단에 결합되고, 다수의 제2 칩 비교 신호에 응답하여, 제2 상관 신호를 발생시키도록 다수의 제2 칩 비교 신호를 가산하기 위한 제2 합산기 수단 및 상기 제1 합산기 수단과 상기 제2 합산기 수단에 결합되고, 제1 데이타 심볼 신호를 발생시키도록 상부 임계 레벨보다 큰 제1 상관 신호에 응답하며, 제2 데이타 심볼 신호를 발생시키도록 하부 임계 레벨보다 작은 제1 상관 신호에 응답하고, 제3 데이타 심볼 신호를 발생시키도록 하부 임계 레벨보다 작은 제2 상관 신호에 응답하며, 제4 데이타 심볼 신호를 발생시키도록 상부 임계 레벨보다 큰 제2 상관 신호에 응답하는 비교 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  2. 제1항에 있어서, 상기 제1 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단은 표면 음향파 장치(surface acoustic-wave device)를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  3. 제2항에 있어서, 상기 표면 음향파 장치는 상기 제1 칩 비교 수단과 상기 제1 합산기 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  4. 제3항에 있어서, 상기 표면 음향파 장치는 상기 제2 칩 비교 수단과 상기 제2 합산기 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  5. PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치에 있어서, 데이타 신호, 잡음 환경 및 에러 교정량의 패턴 및 인가를 분석하고, 상부 및 하부 임계 레벨를 결정하기 위한 임계 셋팅 수단, 제1 의사 잡음 신호를 저장하기 위한 제1 기준 시퀀스 저장 수단, 수신된 확산 스펙트럼 신호를 저장하기 위한 수신 시퀀스 저장 수단, 상기 제1 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단에 결합되고, 수신된 확산 스펙트럼 신호에 응답하여, 다수의 제1 칩 비교 신호를 발생시키도록 제1 의사 잡음 신호의 각각의 칩과 수신된 확산 스펙트럼 신호의 각각의 칩을 비교하기 위한 제1 칩 비교 수단, 상기 제1 칩 비교 수단에 결합되고, 다수의 제1 칩 비교 신호에 응답하여, 제1 상관 신호를 발생시키도록 다수의 제1 칩 비교 신호를 가산하기 위한 제1 합산기 수단 및 상기 제1 합산기 수단에 결합되고, 제1 데이타 심볼 신호를 발생시키도록 상부 임계 레벨보다 큰 제1 상관 신호에 응답하며, 제2 데이타 심볼 신호를 발생시키도록 하부 임계 레벨보다 작은 제1 상관 신호에 응답하는 비교 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  6. 제5항에 있어서, 상기 제1 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  7. 제6항에 있어서, 상기 표면 음향파 장치는 상기 제1 칩 비교 수단과 상기 제1 합산기 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  8. 제7항에 있어서, 상기 표면 음향파 장치는 상기 제2 칩 비교 수단과 상기 제2 합산기 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  9. PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치에 있어서, 제1 의사 잡음 신호를 저장하기 위한 제1 기준 시퀀스 저장 수단, 수신된 확산 스펙트럼 신호를 저장하기 위한 수신 시퀀스 저장 수단, 상기 제1 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단에 결합되고, 수신된 확산 스펙트럼 신호에 응답하여, 다수의 제1 칩 비교 신호를 발생시키도록 제1 의사 잡음 신호의 각각의 칩과 수신된 확산 스펙트럼 신호의 각각의 칩을 비교하기 위한 제1 칩 비교 수단, 상기 제1 칩 비교 수단에 결합되고, 다수의 제1 칩 비교 신호에 응답하며, 제1 상관 신호를 발생시키도록 다수의 제1 칩 비교 신호를 가산하기 위한 제1 합산기 수단 및 상기 제1 합산기 수단에 결합되며, 제1 데이타 심볼 신호를 발생시키도록 상부 임계 레벨보다 큰 제1 상관 신호에 응답하는 상부 임계 레벨을 갖고 있는 비교 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  10. 제9항에 있어서, 상기 제1 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  11. 제10항에 있어서, 상기 표면 음향파 장치는 상기 제1 칩 비교 수단과 상기 제1 합산기 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  12. 제10항에 있어서, 상기 표면 음향파 장치는 상기 제2 칩 비교 수단과 상기 제2 합산기 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  13. PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치에 있어서, 다수의 의사 잡음 신호를 저장하기 위한 다수의 기준 시퀀스 저장 수단, 수신된 확산 스펙트럼 신호를 저장하기 위한 수신 시퀀스 저장 수단, 다수의 기준 시퀀스 저장 수단과 상기 수신 시퀀스 저장 수단에 결합되고, 수신된 확산 스펙트럼 신호에 응답하여, 다수의 칩 비교 신호의 셋트를 발생시키도록 다수의 의사 잡음 신호의 각각의 대응 칩에 의해 수신된 확산 스펙트럼 신호의 각각의 칩을 비교하기 위한 다수의 칩 비교 수단, 상기 다수의 칩 비교 수단에 각각 결합되고, 다수의 칩 비교 신호의 각각의 셋트에 응답하여, 다수의 상관 신호를 발생시키도록 각각의 셋트 내부에 다수의 칩 비교 신호를 가산하기 위한 다수의 합산기 수단 및 상기 다수의 합산기 수단에 결합되고, 다수의 데이타 심볼 신호 중 1개의 데이타 심볼 신호를 발생시키도록 다수의 임계 레벨 중 1개의 임계 레벨과 다수의 상관 신호에 응답하는 비교 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  14. 제13항에 있어서, 상기 다수의 기준 레지스터 수단과 상기 수신 시퀀스 저장 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  15. 제14항에 있어서, 상기 다수의 합산기 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  16. PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치에 있어서, 의사 잡음 신호를 저장하기 위한 코드 레지스터 수단, 수신된 확산 스펙트럼 신호를 저장하기 위한 수신 시퀀스 저장 수단, 상관 신호를 발생시키도록 수신된 확산 스펙트럼 신호를 의사 잡음 신호에 상관시키기 위한 수단 및 상관 신호가 상부 임계 레벨보다 클 때에는 제1 데이타 심볼 신호를 발생시키고, 상관 신호가 하부 임계 레벨보다 작을 때에서는 제2 데이타 심볼 신호를 발생시키도록 상관 신호에 응답하는 비교 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  17. 제16항에 있어서, 상기 코드 레지스터 수단과 상기 수신 시퀀스 저장 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  18. 제17항에 있어서, 상기 코드 레지스터 수단, 상기 수신 시퀀스 저장 수단 및 상기 상관 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  19. PN 코드로 변조된 데이타 신호를 갖는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치에 있어서, 다수의 의사 잡음 신호를 저장하기 위한 코드 레지스터 수단, 수신된 확산 스펙트럼 신호를 저장하기 위한 수신 시퀀스 저장 수단, 각각 다수의 상관 신호를 발생시키기 위해 상기 수신된 확산 스펙트럼 신호를 상기 다수의 의사 잡음 신호에 상관시키기 위한 수단 및 다수의 임계 레벨의 특정 셋트를 교차시키는 상관 신호에 응답하며 다수의 데이타 심볼 신호중 하나를 각각 발생시키는 다수의 상관 신호에 응답하는 비교 수단을 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  20. 제19항에 있어서, 상기 코드 레지스터 수단과 상기 수신 시퀀스 저장 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위한 장치.
  21. 제20항에 있어서, 상기 코드 레지스터 수단, 상기 수신 시퀀스 저장 수단 및 상기 상관 수단은 표면 음향파 장치를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코도하기 위한 장치.
  22. PN 코드로 변조된 데이타 신호를 갖고 있는 수신된 확산 스펙트럼 신호를 디코드하기 위해 상관기를 사용하는 방법에 있어서, 코드 레지스터 수단에 의사 잡음 신호를 저장하는 단계, 수신 시퀀스 저장 수단에 수신된 확산 스펙트럼 신호를 저장하는 단계, 상관 신호를 발생시키도록 수신된 확산 스펙트럼 신호를 의사 잡음 신호에 상관시키는 단계, 상관 신호를 상부 임계 레벨 및 하부 임계 레벨과 비교하는 단계, 상부 임계 레벨보다 큰 상관 신호에 응답하여 1 비트 데이타 신호를 발생시키는 단계 및 하부 임계 레벨보다 작은 상관 신호에 응답하여 0 비트 데이타 신호를 발생시키는 단계를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위해 상관기를 사용하는 방법.
  23. PN 코드로 변조된 데이타 신호를 갖고 있는 수신된 확산 스펙트럼 신호를 디코드하기 위해 상관기를 사용하는 방법에 있어서, 코드 레지스터 수단에 의사 잡음 신호를 저장하는 단계, 수신 시퀀스 저장 수단에 수신된 확산 스펙트럼 신호를 저장하는 단계, 상관 신호를 발생시키기 위해 수신된 확산 스펙트럼 신호를 의사 잡음 신호에 상관시키는 단계, 상관 신호를 상부 임계 레벨과 비교하는 단계 및 상부 임계 레벨보다 큰 상관 신호에 응답하여 1 비트 데이타 신호를 발생시키는 단계를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위해 상관기를 사용하는 방법.
  24. PN 코드로 변조된 데이타 신호를 갖고 있는 수신된 확산 스펙트럼 신호를 디코드하기 위해 상관기를 사용하는 방법에 있어서, 코드 레지스터 수단에 다수의 의사 잡음 신호를 저장하는 단계, 수신 시퀀스 저장 수단에 수신된 확산 스펙트럼 신호를 저장하는 단계, 다수의 상관 신호를 발생시키기 위해 수신된 확산 스펙트럼 신호를 다수의 의사 잡음 신호에 상관시키는 단계, 다수의 상관 신호를 다수의 임계 레벨과 비교하는 단계 및 비교 단계에 응답하여 다수의 데이타 심볼 신호 중 하나의 데이타 심볼 신호를 발생시키는 단계를 포함하는 것을 특징으로 하는 수신된 확산 스펙트럼 신호를 디코드하기 위해 상관기를 사용하는 방법.
  25. 확산 스펙트럼으로 변조된 데이타 신호를 갖는 송신된 신호를 송신하기 위한 장치에 있어서, 데이타 심볼을 갖는 데이타 신호를 발생시키기 위한 수단 및 L칩을 갖는 의사 잡음 신호를 발생시키고, 의사 잡음 신호의 L칩에 의해 데이타 신호의 각각의 데이타 심볼을 변조시키기 위한 수단을 포함하는 것을 특징으로 하는 확산 스펙트럼으로 변조된 데이타 신호를 갖는 송신된 신호를 송신하기 위한 장치.
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