KR0133612B1 - Isdn망에서 프레임 릴레이 접속장치 - Google Patents

Isdn망에서 프레임 릴레이 접속장치

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Abstract

본 발명은 광대역 ISDN망 정합장치에 관한 것으로, PSDN망 및 광대역 ISDN망에서 R 접속점을 통해 사용자 단말기를 접속하여 고속의 패킷데이타 송수신을 최대 2.048Mbps까지 가변할 수 있도록 한 것이다.
본 발명은 PSDN망에 사용되는 사용자단말기와 2.048Mbps의 고속데이타 송수신을 수행하므로 시스템사용에 신뢰성이 제공된다.

Description

ISDN망에서 프레임 릴레이 접속장치
제 1 도는 종래의 PSDN망과 사용자단말기의 개략적 연결도.
제 2 도는 본 발명에 따른 광대역 ISDN망과 사용자단말기의 개략적 연결도.
제 3 도는 본 발명에 따른 ISDN망에서 프레임 릴레이 접속장치 구성블럭도.
* 도면의 주요 부분에 대한 부호의 설명 *
10 : PSDN 사용자단말기20 : PSDN
100 : 망 정합장치200 : PSDN 사용자단말기
300 : 광대역 ISDN망101 : CPU
102 : 로컬 메모리103 : MFP(Multi Function Peripheral
104 : FRC(Frame Relay Controller)
105 : LANCE(LAN Controller for Ethernet)
106,108 : 버퍼
107 : VIC(VME bus Interface Controller)
109 : VME 버스공통메모리
110 : FPGA(Field Programable Gate Array)
본 발명은 광대역 ISDN망 정합장치에 관한 것으로, 특히 PSDN망 및 광대역 ISDN망에서 R 접속점을 통해 사용자단말기를 접속하여 고속의 패킷 데이타 송수신을 최대 2.048Mbps까지 가변할 수 있도록 한 ISDN망에서 프레임 릴레이 접속장치에 관한 것이다.
종래의 PSDN망에서는 프레임 릴레이 서비스를 제공하기 위해 선로상의 각 노드에서 LAPB(Link Access Protocol Balanced)라는 복잡한 프로토콜(Protocol)을 사용하여 프레임제어를 수행하므로 56Kbps라는 속도의 한계를 갖게 된다. 따라서 이를 극복하기 위해 프레임 릴레이 정합을 이용하여 선로상의 각 노드에서 프로토콜을 간소화하고 그 부담을 사용자측으로 이관시켜 전송속도를 최대 1.544Mbps의 속도까지 향상시켰으나 PSDN망의 사용으로 망정합장치가 사용되지 않은 상태로 운용되므로 광대역 ISDN망의 사용자가 아닌 단말기와 광대역 ISDN망과 고속의 패킷전송을 수행할 수 없는 문제점이 있었다.
본 발명은 전술한 문제점을 감안하여 안출한 것으로 그 목적은 광대역 ISDN망의 사용자가 아닌 단말기와 광대역 ISDN망과 고속의 패킷전송을 위한 망정합장치의 전송속도를 최대 2.048Mbps까지 가변활용하도록 하여 신뢰성 있는 데이타통신을 제공하도록 한 것이다.
이와 같은 목적을 달성하기 위한 본 발명의 특징은, ISDN망 정합장치에 있어서, 광대역 ISDN망과 PSDN망 사용자단말기간의 패킷데이타송수신에 대한 전반적인 프로토콜을 제어하는 CPU와, 패킷데이타가 변조정에 대한 전반적인 프로토콜 데이타와 광대역 ISDN망으로부터 수신되는 데이타를 저장하는 로컬 메모리수단과, 디버깅과 프로그램의 다운로드를 수행하는 MFP와, 망 정합장치에서 송수신되는 데이타를 처리하는 FRC와, 시스템사용에 대한 확장시 인터페이싱을 수행하는 LANCE와, 송수신되는 패킷데이타의 전송속도를 완충하는 버퍼와, VME 버스상의 다른 보드와 접속되는 인터페이싱을 제어하는 VIC와, VME 버스를 통해 송수신되는 패킷데이타를 저장하는 VME 버스공통메모리 및, 각 디바이스의 DMA 중재와 처리우선순위를 설정하는 FPGA로 이루어지는 것을 특징으로 하는 ISDN망에서 프레임 릴레이 접속장치를 제공한다.
이하 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 상세히 설명하면 다음과 같다.
제 2 도는 본 발명에 따른 광대역 ISDN망과 사용자단말기의 개략적 연결도이고, 제 3 도는 본 발명에 따른 ISDN망에서 프레임 릴레이 접속장치의 구성블럭도이다.
제 2 도에서 알 수 있는 바와 같이 본 발명은 패킷데이타의 고속전송을 수행하는 광대역 ISDN망(300)과 PSDN망에 사용되는 사용자단말기(200)를 접속하여 패킷데이타 송수신을 중재하는 망정합장치(100)로 이루어지는데, 망 정합장치(100)는 제 3 도에서 알 수 있는 바와 같이, CPU(101), 로컬메모리(102), MFP(103), FRC(104), LANCE(105), 버퍼(106)(108), VIC(107), VME 버스 공통메모리(109), FPGA(110)로 구성된다.
CPU(101)는 광대역 ISDN망과 PSDN 사용자단말기간의 패킷데이타 송수신에 대한 전반적인 프로토콜을 제어한다. 로컬메모리(102)는 패킷데이타 가변조정에 대한 전반적인 프로토콜 데이타가 저장된다. MFP(Multi Function Peripheral ; 103)는 디버깅과 프로그램의 다운로드를 수행한다. FRC(Frame Relay Controller; 104)는 망정합장치에서 송수신되는 데이타(V.35/T1/E1)를 처리한다. LANCE(LAN Controller for Ethernet ; 105)은 시스템사용에 대한 확장시 인터페이싱을 수행한다. 버퍼(106)(108)는 송수신되는 패킷데이타의 전송속도를 완충한다. VIC(VME bus Interface Controller ; 107)는 VME 버스상의 다른 보드와 접속되는 인터페이싱을 제어한다. VME 버스공통메모리(109)는 VME 버스를 통해 송수신되는 패킷데이타를 저장한다. FPGA(Field Programable Gate Array ; 110)는 각 디바이스의 DMA(Direct Memory Access) 중재와 제어신호를 담당한다.
전술한 바와 같은 기능으로 이루어지는 본 발명의 동작을 설명하면 다음과 같다.
FRC(104)를 통해 광대역 ISDN망으로부터 수신되는 고속 패킷데이타(V.35/T1/E1)는 FRC(104)내의 FIFO(First In First Out)에 저장한다. 이때 수신되어 저장되는 데이타가 오버 플러워되는 레벨인 18바이트에 이르게 되면 FRC(104)는 CPU(101)측에 인터럽트 신호를 발생시켜 DMA(Direct Memory Access)동작으로 로컬메모리(102)에 기록한다. 로컬메모리(102)에 저장된 데이타를 CPU(101)가 다시 VME 버스 공통 메모리(109)에 저장한 후 VIC(107)를 통해 DMA 방식으로 정합장치인 BPA 보드로 전송한다.
이때 R 인터페이스로부터 대량의 군집성 데이타가 수신되더라도 FRC(104)에 저장되는 데이타가 오버플러워 레벨에 이르면 버스트(Burst)하게 DMA 방식의 동작을 수행하므로 2.048Mbps의 전송속도에 충분히 대응되며, VIC(107)가 인터페이스를 통해 전송하는 데이타의 크기는 롱워드(long word) 단위로 출력된다.
또한, LANCE(105)는 시스템의 용량확장시 접속되는 LAN과 데이타 송수신에 사용되는데, 송수신되는 데이타의 흐름도 전술한 바와 같이 동작되며, 송수신되는 데이타의 처리순위는 FRC, LANCE, VIC 순으로 처리되며 우선순위가 가장 높은 FRC의 데이타를 항상 받아들이도록 동작된다. 이와 같은 데이타 우선순위의 결정은 CPU와 중재회로인 FPGA에 의해 설정된다.
이상에서 설명한 바와 같이 본 발명은 PSDN망에 사용되는 사용자단말기와 광대역 ISDN망의 2.048Mbps 고속데이타 송수신을 수행하게 되므로 시스템사용에 신뢰성이 제공된다.

Claims (1)

  1. ISDN망 정합장치에 있어서, 광대역 ISDN망과 PSDN망 사용자단말기간의 패킷데이타송수신에 대한 전반적인 프로토콜을 제어하는 CPU와, 패킷데이타가변조정에 대한 전반적인 프로토콜 데이타와 광대역 ISDN망으로부터 수신되는 데이타를 저장하는 로컬 메모리수단과, 디버깅과 프로그램의 다운로드를 수행하는 MFP와, 망 정합장치에서 송수신되는 데이타를 처리하는 FRC와, 시스템사용에 대한 확장시 인터페이싱을 수행하는 LANCE와, 송수신되는 패킷데이타의 전송속도를 완충하는 버퍼와, VME 버스상의 다른 보드와 접속되는 인터페이싱을 제어하는 VIC와, VME 버스를 통해 송수신되는 패킷데이타를 저장하는 VME 버스공통메모리 및, 각 디바이스의 DMA 중재와 처리우선순위를 설정하는 FPGA로 이루어지는 것을 특징으로 하는 ISDN망에서 프레임 릴레이 접속장치.
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