JPWO2023170800A5 - - Google Patents
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Description
上記目的を達成するため、本開示に係るプログラマブルロジックコントローラは、第1CPUユニットと第2CPUユニットとが独立して制御の対象となる機器の制御を行うことが可能である。プログラマブルロジックコントローラは、第1CPUユニットの内部電源の電圧低下が検知された場合、第2CPUユニットの動作を停止させるための動作停止信号を第1CPUユニットから第2CPUユニットへ出力させるか否かを選択する出力選択部を備える。また、プログラマブルロジックコントローラは、出力選択部が動作停止信号を出力させることを選択した場合、第1CPUユニットに動作停止信号を出力させる一方、出力選択部が動作停止信号を出力させないことを選択した場合、第1CPUユニットに動作停止信号を出力させない出力制御部とを備える。
Claims (11)
- 第1CPUユニットと第2CPUユニットとが独立して制御の対象となる機器の制御を行うことが可能なプログラマブルロジックコントローラであって、
前記第1CPUユニットの内部電源の電圧低下が検知された場合、前記第2CPUユニットの動作を停止させるための動作停止信号を前記第1CPUユニットから前記第2CPUユニットへ出力させるか否かを選択する出力選択部と、
前記出力選択部が前記動作停止信号を出力させることを選択した場合、前記第1CPUユニットに前記動作停止信号を出力させる一方、前記出力選択部が前記動作停止信号を出力させないことを選択した場合、前記第1CPUユニットに前記動作停止信号を出力させない出力制御部と、
を備えるプログラマブルロジックコントローラ。 - 第1CPUユニットと第2CPUユニットとが独立して制御の対象となる機器の制御を行うことが可能なプログラマブルロジックコントローラであって、
前記第1CPUユニットは、前記第1CPUユニットの内部電源の電圧低下が検知されない場合、前記第1CPUユニットの動作を確認するための動作確認信号を前記第2CPUユニットに出力する出力部を備え、
前記第2CPUユニットが前記動作確認信号を取得しない場合、前記第2CPUユニットの動作を停止させるか否かを選択する動作停止選択部と、
前記動作停止選択部が前記第2CPUユニットの動作を停止させることを選択した場合、前記第2CPUユニットの動作を停止させる一方、前記動作停止選択部が前記第2CPUユニットの動作を停止させないことを選択した場合、前記第2CPUユニットの動作を停止させない動作停止制御部と、
を備えるプログラマブルロジックコントローラ。 - 前記第1CPUユニットは、前記第1CPUユニットの内部電源の電圧低下が検知されない場合、前記第1CPUユニットの動作を確認するための動作確認信号を前記第2CPUユニットに出力する出力部を備え、
前記第2CPUユニットが前記動作確認信号を取得しない場合、前記第2CPUユニットの動作を停止させるか否かを選択する動作停止選択部と、
前記動作停止選択部が前記第2CPUユニットの動作を停止させることを選択した場合、前記第2CPUユニットの動作を停止させる一方、前記動作停止選択部が前記第2CPUユニットの動作を停止させないことを選択した場合、前記第2CPUユニットの動作を停止させない動作停止制御部と、を更に備える、
請求項1に記載のプログラマブルロジックコントローラ。 - 前記第1CPUユニットの外部又は前記第2CPUユニットの外部に設けられた切替スイッチを更に備え、
前記選択部は、前記切替スイッチからの出力に基づいて、前記第2CPUユニットの動作を停止させるか否かを選択する、
請求項1に記載のプログラマブルロジックコントローラ。 - 前記選択部は、予め設定された設定情報に基づいて前記第2CPUユニットの動作を停止させるか否かを選択し、
前記設定情報は、前記第1CPUユニット又は前記第2CPUユニットに接続可能なエンジニアリングツールから取得される、
請求項1に記載のプログラマブルロジックコントローラ。 - プログラマブルロジックコントローラに装着されている他のCPUユニットとは独立して制御の対象となる機器の制御を行うことが可能なCPUユニットであって、
前記CPUユニットの内部電源の電圧低下が検知された場合、前記他のCPUユニットの動作を停止させるための動作停止信号を出力する出力部と、
前記他のCPUユニットに前記動作停止信号を出力させるか否かを選択する出力選択部と、
前記CPUユニットの内部電源の電圧低下が検知された場合、前記出力選択部が前記動作停止信号を出力させることを選択していれば前記出力部に前記動作停止信号を出力させる一方、前記出力選択部が前記動作停止信号を出力させないことを選択していれば前記出力部に前記動作停止信号を出力させない出力制御部と、
を備えるCPUユニット。 - プログラマブルロジックコントローラに装着されている他のCPUユニットとは独立して制御の対象となる機器の制御を行うことが可能なCPUユニットであって、
前記他のCPUユニットから前記他のCPUユニットの動作を確認するための動作確認信号を取得しなかった場合、前記CPUユニットの動作を停止させるか否かを選択する動作停止選択部と、
前記他のCPUユニットから前記動作確認信号を取得しなかった場合、前記動作停止選択部が前記CPUユニットの動作を停止させることを選択していれば前記CPUユニットの動作を停止させる一方、前記動作停止選択部が前記CPUユニットの動作を停止させないことを選択していれば前記CPUユニットの動作を停止させない動作停止制御部と、
を備えるCPUユニット。 - 第1CPUユニットと第2CPUユニットとが装着されているプログラマブルロジックコントローラの制御方法であって、
前記第1CPUユニットの内部電源の電圧低下が検知された場合、前記第2CPUユニットの動作を停止させるための動作停止信号を前記第1CPUユニットから前記第2CPUユニットへ出力させるか否かを選択する出力選択ステップと、
前記出力選択ステップにおいて前記動作停止信号を出力させることを選択した場合、前記第1CPUユニットに前記動作停止信号を出力させる一方、前記出力選択ステップにおいて前記動作停止信号を出力させないことを選択した場合、前記第1CPUユニットに前記動作停止信号を出力させない出力制御ステップと、
を含む制御方法。 - 第1CPUユニットと第2CPUユニットとが装着されているプログラマブルロジックコントローラの制御方法であって、
前記第1CPUユニットから前記第1CPUユニットの動作を確認するための動作確認信号を前記第2CPUユニットが取得しない場合、前記第2CPUユニットの動作を停止させるか否かを選択する動作停止選択ステップと、
前記動作停止選択ステップにおいて前記第2CPUユニットの動作を停止させることを選択した場合、前記第2CPUユニットの動作を停止させる一方、前記動作停止選択ステップにおいて前記第2CPUユニットの動作を停止させないことを選択した場合、前記第2CPUユニットの動作を停止させない動作停止制御ステップと、
を含む制御方法。 - 第1CPUユニットと第2CPUユニットとが装着されているプログラマブルロジックコントローラを、
前記第1CPUユニットの内部電源の電圧低下が検知された場合、前記第2CPUユニットの動作を停止させるための動作停止信号を前記第1CPUユニットから前記第2CPUユニットへ出力させるか否かを選択する出力選択部、
前記出力選択部が前記動作停止信号を出力させることを選択した場合、前記第1CPUユニットに前記動作停止信号を出力させる一方、前記出力選択部が前記動作停止信号を出力させないことを選択した場合、前記第1CPUユニットに前記動作停止信号を出力させない出力制御部、
として機能させるプログラム。 - 第1CPUユニットと第2CPUユニットとが装着されているプログラマブルロジックコントローラを、
前記第1CPUユニットから前記第1CPUユニットの動作を確認するための動作確認信号を前記第2CPUユニットが取得しない場合、前記第2CPUユニットの動作を停止させるか否かを選択する動作停止選択部、
前記動作停止選択部が前記第2CPUユニットの動作を停止させることを選択した場合、前記第2CPUユニットの動作を停止させる一方、前記動作停止選択部が前記第2CPUユニットの動作を停止させないことを選択した場合、前記第2CPUユニットの動作を停止させない動作停止制御部、
として機能させるプログラム。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2022/010122 WO2023170800A1 (ja) | 2022-03-08 | 2022-03-08 | プログラマブルロジックコントローラ、cpuユニット、制御方法及びプログラム |
Publications (3)
Publication Number | Publication Date |
---|---|
JP7204057B1 JP7204057B1 (ja) | 2023-01-13 |
JPWO2023170800A1 JPWO2023170800A1 (ja) | 2023-09-14 |
JPWO2023170800A5 true JPWO2023170800A5 (ja) | 2024-02-14 |
Family
ID=84888467
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2022545855A Active JP7204057B1 (ja) | 2022-03-08 | 2022-03-08 | プログラマブルロジックコントローラ、cpuユニット、制御方法及びプログラム |
Country Status (2)
Country | Link |
---|---|
JP (1) | JP7204057B1 (ja) |
WO (1) | WO2023170800A1 (ja) |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57191770A (en) * | 1981-05-21 | 1982-11-25 | Nec Corp | Transmission system for stop indicating signal |
JPS61267164A (ja) * | 1985-05-22 | 1986-11-26 | Hitachi Ltd | マルチプロセツサシステムにおける異常処理方式 |
WO2021111639A1 (ja) * | 2019-12-06 | 2021-06-10 | 三菱電機株式会社 | コントローラ |
-
2022
- 2022-03-08 WO PCT/JP2022/010122 patent/WO2023170800A1/ja active Application Filing
- 2022-03-08 JP JP2022545855A patent/JP7204057B1/ja active Active
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