JPWO2020095550A1 - 駆動回路、電子機器、および、駆動回路の制御方法 - Google Patents
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Abstract
Description
[電子機器の構成例]
まず、本実施形態による電子機器について図1を用いて説明する。本実施形態による電子機器EDは、本技術の第1実施形態による駆動回路1を備えている。図1は、本技術の第1の実施の形態における電子機器EDの一構成例を示すブロック図である。電子機器EDは、バッテリ9と、バッテリ9に接続された駆動回路1と、駆動回路1に接続された容量性負荷8とを備えている。電子機器EDとして、例えば、撮像装置、スマートフォンやロボットが想定される。
図2は、本技術の第1実施形態による駆動回路1の一構成例を示すブロック図である。
図2に示すように、駆動回路1は、バッテリ9(図2では不図示)に接続された電圧生成回路15と、駆動信号Sdが入力される制御回路13(第一制御回路の一例)と、電圧生成回路15および制御回路13に接続されたエネルギー転送回路11とを有している。エネルギー転送回路11には、容量性負荷8(第一容量性負荷の一例)が接続されている。
次に、本実施形態による駆動回路の駆動方法について図3を参照しつつ図4および図5を用いて説明する。図4は、本実施形態による駆動回路1の制御方法を説明するための制御波形の一例を示す図である。図4中の1段目は、スイッチ素子111sのゲート端子Gに印加されるゲート信号(制御信号)の電圧波形を示し、図4中の2段目は、スイッチ素子131gbのゲート端子Gに印加されるゲート信号(制御信号)の電圧波形を示している。図4中の3段目は、スイッチ素子131gcのゲート端子Gに印加されるゲート信号(制御信号)の電圧波形を示し、図4中の4段目は、スイッチ素子113sのゲート端子Gに印加されるゲート信号(制御信号)の電圧波形を示している。図4中の5段目は、スイッチ素子131gaのゲート端子Gに印加されるゲート信号(制御信号)の電圧波形を示し、図4中の2段目は、スイッチ素子131gdのゲート端子Gに印加されるゲート信号(制御信号)の電圧波形を示している。図4では、図中左から右に向かって時の経過が示されている。図5は、図4中の四角枠αで囲んだ部分およびその前後の部分の電圧波形に基づく各スイッチ素子の状態を示している。
本技術の第2実施形態による駆動回路、電子機器、および、駆動回路の制御方法について図6を用いて説明する。本実施形態による電子機器は、上記第1実施形態による電子機器EDと同様の構成を有し、同様の機能を発揮するため、説明は省略する。また、本実施形態による駆動回路は、上記第1実施形態による駆動回路1と同様の構成例を有するため、ブロック図の図示は省略する。さらに、本実施形態の駆動回路の構成要素に関し、上記第1実施形態による駆動回路と同一の作用・機能を奏する構成要素には、同一の符号を付してその説明は省略する。
図6は、本実施形態による駆動回路2の一構成例を示す回路図である。駆動回路2は、逆バイアスダイオードの接続が駆動回路1と異なる点に特徴を有している。
駆動回路2は、上記第1実施形態による駆動回路1と同じ構成のブリッジ回路131およびエネルギー転送回路11を備えている。このため、駆動回路2の制御方法は、上記第1実施形態による駆動回路1の制御方法と同様であるため、その説明は省略する。
本技術の第3実施形態による駆動回路、電子機器、および、駆動回路の制御方法について図7を用いて説明する。本実施形態による電子機器は、上記規第1実施形態による電子機器EDと同様の構成を有し、同様の機能を発揮するため、説明は省略する。また、本実施形態による駆動回路は、上記第1実施形態による駆動回路1と同様の構成例を有するため、ブロック図の図示は省略する。さらに、本実施形態の駆動回路の構成要素に関し、上記第1実施形態による駆動回路と同一の作用・機能を奏する構成要素には、同一の符号を付してその説明は省略する。
図7に示すように、本実施形態による駆動回路3は、容量性負荷8への交流電圧の印加を制御する制御回路13を備えている。駆動回路3は、容量性負荷8とともに閉回路311c(第一閉回路の一例)を構成する誘導性素子115を備えている。駆動回路3は、容量性負荷8及び誘導性素子115の間で誘導性素子115に直列に接続されて閉回路311cを構成するダイオード311d(第一ダイオード型素子の一例)を備えている。ダイオード311dは、例えばPN接合型ダイオードで構成されている。駆動回路3は、容量性負荷8及び誘導性素子115の間でダイオード311dと直列に接続されて閉回路311cを構成するスイッチ素子311s(第一スイッチ素子の一例)を備えている。スイッチ素子311sは、例えばP型の電界効果トランジスタで構成されている。
駆動回路3は、P型の電界効果トランジスタで構成されたスイッチ素子311sをエネルギー転送部311に有している。これに対し、上記第1実施形態による駆動回路1は、N型の電界効果トランジスタで構成されたスイッチ素子111sをエネルギー転送部111に有している。このため、本実施形態による駆動回路3の制御方法は、スイッチ素子311sのゲート信号が上記第1実施形態による駆動回路1の制御方法におけるスイッチ素子111sのゲート信号(図4参照)と異なる。具体的には、スイッチ素子311sのゲート信号は、スイッチ素子111sのゲート信号と反転タイミングは同一であるが電圧レベルは逆転した信号となる。図4を参照して説明すると、スイッチ素子311sのゲート信号は、時刻t0から時刻t2までハイレベルであり、時刻t2から時刻t4までローレベルであり、時刻t4以降がハイレベルである電圧波形となる。これにより、駆動回路3に設けられたエネルギー転送部311は、駆動回路1に設けられたエネルギー転送部111と同様に動作することができる。その結果、駆動回路3は、駆動回路1と同様に制御されることができる。
次に、第1実施形態から第3実施形態による駆動回路に適用可能な駆動回路の制御方法の変形例について図8Aおよび図8Bを用いて説明する。図8Aおよび図8Bは、本変形例を説明するための制御波形の一例を示す図である。図8Aは、本変形例による駆動回路の制御方法を適用した場合の制御波形の一例を示している。図8Bは、本変形例による駆動回路の制御方法を適用していない場合の比較例の制御波形の一例を示している。図8A中および図8B中のそれぞれの上段には、駆動回路の制御信号の電圧波形が示され、下段には、駆動回路の制御信号の電流波形が示されている。図8A中および図8B中に示す「Vd」は、容量性負荷を駆動するための駆動電源の電圧波形を表している。図8A中および図8B中に示す「Vr」は、容量性負荷に印加される負荷電圧の電圧波形を表している。図8A中および図8B中に示す「Ir」は、容量性負荷に流れる負荷電流の電流波形を表している。なお、本変形例の説明において、図3に示す上記第1実施形態による駆動回路の参照符号を用いて説明する。
本技術の第4実施形態による駆動回路、電子機器、および、駆動回路の制御方法について図9から図11を用いて説明する。本実施形態による電子機器は、複数の容量性負荷を駆動できる点を除いて、上記第1実施形態による電子機器EDと同様の構成を有し、同様の機能を発揮するため、説明は省略する。なお、本実施形態では、電子機器に設けられたバッテリは、上記第1実施形態による電子機器EDに設けられた「バッテリ9」を用いて説明する。
図9は、本技術の第4実施形態による駆動回路4の一構成例を示すブロック図である。
図9に示すように、駆動回路4は、バッテリ9(図9では不図示)に接続された電圧生成回路45と、駆動信号Sd4が入力される制御回路43(第一制御回路の一例)とを有している。駆動回路4は、駆動信号Sd5が入力される制御回路53(第二制御回路の一例)および駆動信号Sd6が入力される制御回路63(第二制御回路の一例)を有している。駆動回路4は、電圧生成回路45および制御回路43に接続されたエネルギー転送回路41と、電圧生成回路45および制御回路53に接続されたエネルギー転送回路51と、電圧生成回路45および制御回路63に接続されたエネルギー転送回路61とを有している。エネルギー転送回路41には、容量性負荷84(第一容量性負荷の一例)が接続されている。エネルギー転送回路51には、容量性負荷85(第二容量性負荷の一例)が接続されている。エネルギー転送回路61には、容量性負荷86(第二容量性負荷の一例)が接続されている。
図10に示すように、駆動回路4は、容量性負荷85への交流電圧の印加を制御する制御回路53を備えている。駆動回路4は、容量性負荷85及び誘導性素子415の間で誘導性素子415に直列に接続されて閉回路511c(第三閉回路の一例)を構成するダイオード511d(第三ダイオード型素子の一例)を備えている。ダイオード511dは、例えばPN接合型ダイオードで構成されている。駆動回路4は、容量性負荷85及び誘導性素子415の間でダイオード511dと直列に接続されて閉回路511cを構成するスイッチ素子511s(第三スイッチ素子の一例)を備えている。スイッチ素子511sは、例えばP型の電界効果トランジスタで構成されている。
図10に示すように、駆動回路4は、誘導性素子415とともに閉回路611c(第三閉回路の一例)を構成し容量性負荷86への交流電圧の印加を制御する制御回路63を備えている。駆動回路4は、容量性負荷86及び誘導性素子415の間で誘導性素子415に直列に接続されて閉回路611cを構成するダイオード611d(第三ダイオード型素子の一例)を備えている。ダイオード611dは、例えばPN接合型ダイオードで構成されている。駆動回路4は、容量性負荷86及び誘導性素子415の間でダイオード611dと直列に接続されて閉回路611cを構成するスイッチ素子611s(第三スイッチ素子の一例)を備えている。スイッチ素子611sは、例えばP型の電界効果トランジスタで構成されている。
次に、本実施形態による駆動回路の制御方法について図10を参照しつつ図11を用いて説明する。図11中の1段目には、エネルギー転送回路41および制御回路43の制御信号の電圧波形の一例が図示されている。図11中の2段目には、エネルギー転送回路51および制御回路53の制御信号の電圧波形の一例が図示されている。図11中の3段目には、エネルギー転送回路61および制御回路63の制御信号の電圧波形が図示されている。図11において、左から右に向かって時の経過が表されている。
上記第1から第4実施形態では、各ダイオードおよび各逆バイアスダイオードは、PN接合型ダイオードで構成されているが、本技術はこれに限られない。例えば、各ダイオードおよび各逆バイアスダイオードは、ダイオード接続されたトランジスタで構成されていてもよい。
本開示に係る技術は、いわゆる「物のインターネット」であるIoT(Internet of things)と呼ばれる技術へ応用可能である。IoTとは、「物」であるIoTデバイス9100が、他のIoTデバイス9003、インターネット、クラウド9005などに接続され、情報交換することにより相互に制御する仕組みである。IoTは、農業、家、自動車、製造、流通、エネルギー、など様々な産業に利用できる。
(1)
第一容量性負荷への交流電圧の印加を制御する第一制御回路と、
前記第一容量性負荷とともに第一閉回路を構成する誘導性素子と、
前記第一容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続されて前記第一閉回路を構成する第一ダイオード型素子と、
前記第一容量性負荷及び前記誘導性素子の間で前記第一ダイオード型素子と直列に接続されて前記第一閉回路を構成する第一スイッチ素子と
を備える駆動回路。
(2)
前記第一容量性負荷及び前記誘導性素子の間と第一直流電位の第一供給端との間に接続されて前記第一直流電位によって逆バイアスが印加される第一逆バイアスダイオード型素子と、
前記第一容量性負荷及び前記誘導性素子の間と第二直流電位の第二供給端との間に接続されて前記第二直流電位によって逆バイアスが印加される第二逆バイアスダイオード型素子を備える
前記(1)に記載の駆動回路。
(3)
前記誘導性素子に直列かつ前記第一ダイオード型素子及び前記第一スイッチ素子に並列に接続されて第二閉回路を構成する第二ダイオード型素子と、
前記第二ダイオード型素子に直列かつ前記第一ダイオード型素子及び前記第一スイッチ素子に並列に接続されて前記第一閉回路を構成する第二スイッチ素子と
を備える
前記(2)に記載の駆動回路。
(4)
前記第一閉回路及び前記第二閉回路は、前記第一供給端及び前記第二供給端に直結されていない
前記(3)に記載の駆動回路。
(5)
前記第一制御回路は、
複数のスイッチ素子を有する第一スイッチ素子群で構成されて前記第一容量性負荷の両端に接続された第一ブリッジ回路と、
前記複数のスイッチ素子、前記第一スイッチ素子及び前記第二スイッチ素子のスイッチングを制御する制御信号を生成する第一制御信号生成部と
を有する
前記(3)又は(4)に記載の駆動回路。
(6)
前記誘導性素子、前記第一ダイオード型素子及び前記第一スイッチ素子で構成され、前記第一容量性負荷に蓄積されているエネルギーを転送する第一エネルギー転送部と、
前記誘導性素子、前記第二ダイオード型素子及び前記第二スイッチ素子で構成され、前記第一容量性負荷に蓄積されているエネルギーを転送する第二エネルギー転送部と
を有するエネルギー転送回路を備える
前記(5)に記載の駆動回路。
(7)
前記第一スイッチ素子、前記第二スイッチ素子及び前記第一スイッチ素子群に設けられた前記複数のスイッチ素子は、電界効果トランジスタで構成されている
前記(5)又は(6)に記載の駆動回路。
(8)
第二容量性負荷への交流電圧の印加を制御する第二制御回路と、
前記第二容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続されて前記第三閉回路を構成する第三ダイオード型素子と、
前記第二容量性負荷及び前記誘導性素子の間で前記第三ダイオード型素子と直列に接続されて前記第三閉回路を構成する第三スイッチ素子と、
前記第一容量性負荷及び前記誘導性素子の間で前記第一容量性負荷及び前記誘導性素子に直列に接続されて前記第一閉回路及び前記第二閉回路から前記誘導性素子を電気的に切断する第一切断スイッチ素子と、
前記第二容量性負荷及び前記誘導性素子の間で前記第二容量性負荷及び前記誘導性素子に直列に接続されて前記第三閉回路から前記誘導性素子を電気的に切断する第二切断スイッチ素子と
を備える前記(3)から(7)までのいずれか一項に記載の駆動回路。
(9)
前記誘導性素子に直列かつ前記第三ダイオード型素子及び前記第三スイッチ素子に並列に接続されて第四閉回路を構成する第四ダイオード型素子と、
前記第四ダイオード型素子に直列かつ前記第三ダイオード型素子及び前記第三スイッチ素子に並列に接続されて前記第四閉回路を構成する第四スイッチ素子と
を備える
前記(8)に記載の駆動回路。
(10)
前記第二制御回路は、
複数のスイッチ素子を有する第二スイッチ素子群で構成されて前記第二容量性負荷の両端に接続された第二ブリッジ回路と、
前記第三スイッチ素子、前記第四スイッチ素子及び前記第二スイッチ素子群のスイッチングを制御する制御信号を生成する第二制御信号生成部と
を有する
前記(9)に記載の駆動回路。
(11)
前記誘導性素子、前記第三ダイオード型素子及び前記第三スイッチ素子で構成され、前記第二容量性負荷に蓄積されているエネルギーを転送する第三エネルギー転送部と、
前記誘導性素子、前記第四ダイオード型素子及び前記第四スイッチ素子で構成され、前記第二容量性負荷に蓄積されたエネルギーを転送する第四エネルギー転送部と
を有する第二エネルギー転送回路を備える
前記(9)又は(10)に記載の駆動回路。
(12)
前記第三スイッチ素子、前記第四スイッチ素子及び前記第二スイッチ素子群に設けられた前記複数のスイッチ素子は、電界効果トランジスタで構成されている
前記(10)又は(11)に記載の駆動回路。
(13)
前記(1)から(12)までのいずれか一項に記載の駆動回路を備える電子機器。
(14)
第一容量性負荷に直列に接続された誘導性素子と、前記第一容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続された第一ダイオード型素子と、前記第一容量性負荷及び前記誘導性素子の間で前記第一ダイオード型素子と直列に接続された第一スイッチ素子とで構成された第一閉回路の前記第一スイッチ素子をオフ状態からオン状態に移行し、
前記第一閉回路を介して前記第一容量性負荷に印加された電圧の極性を反転し、
前記第一スイッチ素子をオン状態からオフ状態に移行し、
前記第一容量性負荷に印加されている電圧と同極性の交流電圧を第一制御回路から印加する
駆動回路の制御方法。
(15)
前記第一制御回路から前記同極性の交流電圧を前記第一容量性負荷に印加した後に、
前記誘導性素子に直列かつ前記第一ダイオード型素子及び前記第一スイッチ素子に並列に接続されて第二閉回路を構成し、互いに直列に接続された第二ダイオード型素子及び第二スイッチ素子の前記第二スイッチ素子をオフ状態からオン状態に移行し、
前記第二閉回路を介して前記第一容量性負荷に印加された電圧の極性を反転し、
前記第二スイッチ素子をオン状態からオフ状態に移行し、
前記第一容量性負荷に印加されている電圧と同極性の交流電圧を前記第一制御回路から印加する
前記(14)に記載の駆動回路の制御方法。
(16)
前記第一制御回路は、1回目の交流電圧の電圧レベルを2回目以降の交流電圧の電圧レベルよりも低くして前記第一容量性負荷に印加する
前記(14)又は(15)に記載の駆動回路の制御方法。
(17)
前記誘導性素子と、第二容量性負荷と、前記第二容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続された第三ダイオード型素子と、前記第二容量性負荷及び前記誘導性素子の間で前記第三ダイオード型素子と直列に接続された第三スイッチ素子とで構成されて第三閉回路の前記第三スイッチ素子のオン状態及びオフ状態を制御する制御信号と、前記第一スイッチ素子のオン状態及びオフ状態を制御する制御信号との初期位相差に基づいて、前記第一スイッチ素子及び前記第三スイッチ素子のうちの後にオフ状態からオン状態に移行するスイッチ素子を有する閉回路である後続閉回路から前記誘導性素子を電気的に切り離し、
前記第一スイッチ素子及び前記第三スイッチ素子のうちの先にオフ状態からオン状態に移行するスイッチ素子を有する閉回路である先行閉回路を構成するスイッチ素子をオフ状態からオン状態に移行し、
前記先行閉回路を介して前記先行閉回路を構成する容量性負荷に印加された電圧の極性を反転し、
前記後続閉回路を構成する容量性負荷に印加されている交流電圧とは逆極性の交流電圧を該容量性負荷に印加し、
前記後続閉回路を構成する前記スイッチ素子をオン状態からオフ状態に移行する
前記(14)から(16)までのいずれか一項に記載の駆動回路の制御方法。
(18)
前記先行閉回路を構成する容量性負荷及び前記後続閉回路を構成する容量性負荷に所定回数の交流電圧を印加したのちに、前記第一スイッチ素子を制御する前記制御信号と前記第三スイッチ素子を制御する前記制御信号との位相差を前記初期位相差に戻す
前記(17)に記載の駆動回路の制御方法。
8,84,85,86 容量性負荷
9 バッテリ
11,31,41,51,61 エネルギー転送回路
13,43,53,63 制御回路
15,45 電圧生成回路
17a,17b,174a,174b,175a,175b,176a,176b 供給端
46a,46b,56a,56b,66a,66b 切断スイッチ素子
111,113,311,313,411,413,511,513,611,613 エネルギー転送部
111c,113c,311c,313c,411c,413c,415c,511c,513c,611c,613c 閉回路
111d,113d,311d,313d,411d,413d,511d,513d,611d,613d ダイオード
111s,113s,131ga,131gb,131gc,131gd,311s,313s,411s,413s,431ga,431gb,431gc,431gd,511s,513s,531ga,531gb,531gc,531gd,611s,613s,631ga,631gb,631gc,631gd スイッチ素子
115,415 誘導性素子
117,119,217,219,317,319,417a,417b,419,419a,419b 逆バイアスダイオード
131,431,531,631 ブリッジ回路
131g,431g,531g,631g スイッチ素子群
133,433,533,633 制御信号生成部
135,435,535,635 コンデンサ
9000 システム
9001 デバイス
9002 ゲートウエイ
9003 デバイス
9004 サーバ
9005 クラウド
9006 外部サーバ
9008 コンピュータ
9100 デバイス
ED 電子機器
Claims (18)
- 第一容量性負荷への交流電圧の印加を制御する第一制御回路と、
前記第一容量性負荷とともに第一閉回路を構成する誘導性素子と、
前記第一容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続されて前記第一閉回路を構成する第一ダイオード型素子と、
前記第一容量性負荷及び前記誘導性素子の間で前記第一ダイオード型素子と直列に接続されて前記第一閉回路を構成する第一スイッチ素子と
を備える駆動回路。 - 前記第一容量性負荷及び前記誘導性素子の間と第一直流電位の第一供給端との間に接続されて前記第一直流電位によって逆バイアスが印加される第一逆バイアスダイオード型素子と、
前記第一容量性負荷及び前記誘導性素子の間と第二直流電位の第二供給端との間に接続されて前記第二直流電位によって逆バイアスが印加される第二逆バイアスダイオード型素子を備える
請求項1に記載の駆動回路。 - 前記誘導性素子に直列かつ前記第一ダイオード型素子及び前記第一スイッチ素子に並列に接続されて第二閉回路を構成する第二ダイオード型素子と、
前記第二ダイオード型素子に直列かつ前記第一ダイオード型素子及び前記第一スイッチ素子に並列に接続されて前記第一閉回路を構成する第二スイッチ素子と
を備える
請求項2に記載の駆動回路。 - 前記第一閉回路及び前記第二閉回路は、前記第一供給端及び前記第二供給端に直結されていない
請求項3に記載の駆動回路。 - 前記第一制御回路は、
複数のスイッチ素子を有する第一スイッチ素子群で構成されて前記第一容量性負荷の両端に接続された第一ブリッジ回路と、
前記複数のスイッチ素子、前記第一スイッチ素子及び前記第二スイッチ素子のスイッチングを制御する制御信号を生成する第一制御信号生成部と
を有する
請求項3に記載の駆動回路。 - 前記誘導性素子、前記第一ダイオード型素子及び前記第一スイッチ素子で構成され、前記第一容量性負荷に蓄積されているエネルギーを転送する第一エネルギー転送部と、
前記誘導性素子、前記第二ダイオード型素子及び前記第二スイッチ素子で構成され、前記第一容量性負荷に蓄積されているエネルギーを転送する第二エネルギー転送部と
を有するエネルギー転送回路を備える
請求項5に記載の駆動回路。 - 前記第一スイッチ素子、前記第二スイッチ素子及び前記第一スイッチ素子群に設けられた前記複数のスイッチ素子は、電界効果トランジスタで構成されている
請求項5に記載の駆動回路。 - 第二容量性負荷への交流電圧の印加を制御する第二制御回路と、
前記第二容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続されて第三閉回路を構成する第三ダイオード型素子と、
前記第二容量性負荷及び前記誘導性素子の間で前記第三ダイオード型素子と直列に接続されて前記第三閉回路を構成する第三スイッチ素子と、
前記第一容量性負荷及び前記誘導性素子の間で前記第一容量性負荷及び前記誘導性素子に直列に接続されて前記第一閉回路及び前記第二閉回路から前記誘導性素子を電気的に切断する第一切断スイッチ素子と、
前記第二容量性負荷及び前記誘導性素子の間で前記第二容量性負荷及び前記誘導性素子に直列に接続されて前記第三閉回路から前記誘導性素子を電気的に切断する第二切断スイッチ素子と
を備える請求項3に記載の駆動回路。 - 前記誘導性素子に直列かつ前記第三ダイオード型素子及び前記第三スイッチ素子に並列に接続されて第四閉回路を構成する第四ダイオード型素子と、
前記第四ダイオード型素子に直列かつ前記第三ダイオード型素子及び前記第三スイッチ素子に並列に接続されて前記第四閉回路を構成する第四スイッチ素子と
を備える
請求項8に記載の駆動回路。 - 前記第二制御回路は、
複数のスイッチ素子を有する第二スイッチ素子群で構成されて前記第二容量性負荷の両端に接続された第二ブリッジ回路と、
前記第三スイッチ素子、前記第四スイッチ素子及び前記第二スイッチ素子群のスイッチングを制御する制御信号を生成する第二制御信号生成部と
を有する
請求項9に記載の駆動回路。 - 前記誘導性素子、前記第三ダイオード型素子及び前記第三スイッチ素子で構成され、前記第二容量性負荷に蓄積されているエネルギーを転送する第三エネルギー転送部と、
前記誘導性素子、前記第四ダイオード型素子及び前記第四スイッチ素子で構成され、前記第二容量性負荷に蓄積されたエネルギーを転送する第四エネルギー転送部と
を有する第二エネルギー転送回路を備える
請求項9に記載の駆動回路。 - 前記第三スイッチ素子、前記第四スイッチ素子及び前記第二スイッチ素子群に設けられた前記複数のスイッチ素子は、電界効果トランジスタで構成されている
請求項10に記載の駆動回路。 - 請求項1に記載の駆動回路を備える電子機器。
- 第一容量性負荷に直列に接続された誘導性素子と、前記第一容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続された第一ダイオード型素子と、前記第一容量性負荷及び前記誘導性素子の間で前記第一ダイオード型素子と直列に接続された第一スイッチ素子とで構成された第一閉回路の前記第一スイッチ素子をオフ状態からオン状態に移行し、
前記第一閉回路を介して前記第一容量性負荷に印加された電圧の極性を反転し、
前記第一スイッチ素子をオン状態からオフ状態に移行し、
前記第一容量性負荷に印加されている電圧と同極性の交流電圧を第一制御回路から印加する
駆動回路の制御方法。 - 前記第一制御回路から前記同極性の交流電圧を前記第一容量性負荷に印加した後に、
前記誘導性素子に直列かつ前記第一ダイオード型素子及び前記第一スイッチ素子に並列に接続されて第二閉回路を構成し、互いに直列に接続された第二ダイオード型素子及び第二スイッチ素子の前記第二スイッチ素子をオフ状態からオン状態に移行し、
前記第二閉回路を介して前記第一容量性負荷に印加された電圧の極性を反転し、
前記第二スイッチ素子をオン状態からオフ状態に移行し、
前記第一容量性負荷に印加されている電圧と同極性の交流電圧を前記第一制御回路から印加する
請求項14に記載の駆動回路の制御方法。 - 前記第一制御回路は、1回目の交流電圧の電圧レベルを2回目以降の交流電圧の電圧レベルよりも低くして前記第一容量性負荷に印加する
請求項14に記載の駆動回路の制御方法。 - 前記誘導性素子と、第二容量性負荷と、前記第二容量性負荷及び前記誘導性素子の間で前記誘導性素子に直列に接続された第三ダイオード型素子と、前記第二容量性負荷及び前記誘導性素子の間で前記第三ダイオード型素子と直列に接続された第三スイッチ素子とで構成されて第三閉回路の前記第三スイッチ素子のオン状態及びオフ状態を制御する制御信号と、前記第一スイッチ素子のオン状態及びオフ状態を制御する制御信号との初期位相差に基づいて、前記第一スイッチ素子及び前記第三スイッチ素子のうちの後にオフ状態からオン状態に移行するスイッチ素子を有する閉回路である後続閉回路から前記誘導性素子を電気的に切り離し、
前記第一スイッチ素子及び前記第三スイッチ素子のうちの先にオフ状態からオン状態に移行するスイッチ素子を有する閉回路である先行閉回路を構成するスイッチ素子をオフ状態からオン状態に移行し、
前記先行閉回路を介して前記先行閉回路を構成する容量性負荷に印加された電圧の極性を反転し、
前記後続閉回路を構成する容量性負荷に印加されている交流電圧とは逆極性の交流電圧を該容量性負荷に印加し、
前記後続閉回路を構成する前記スイッチ素子をオン状態からオフ状態に移行する
請求項14に記載の駆動回路の制御方法。 - 前記先行閉回路を構成する容量性負荷及び前記後続閉回路を構成する容量性負荷に所定回数の交流電圧を印加したのちに、前記第一スイッチ素子を制御する前記制御信号と前記第三スイッチ素子を制御する前記制御信号との位相差を前記初期位相差に戻す
請求項17に記載の駆動回路の制御方法。
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