JPWO2015002125A1 - Pwm制御回路およびスイッチング電源装置 - Google Patents
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Abstract
Description
変調信号を入力する変調信号入力端子と、
タイミング(位相)の異なる2つの被変調信号を出力する第1および第2の被変調信号出力端子と、
前記方形波信号の立ち上がりに同期して第1のランプ波の掃引を開始する第1ランプ波発生回路と、
前記方形波信号の立ち下がりに同期して第2のランプ波の掃引を開始する第2ランプ波発生回路と、
前記第1のランプ波と前記変調信号とを比較し、比較結果に応じてレベルを反転させることにより第1の被変調信号を発生する第1比較回路と、
前記第2のランプ波と前記変調信号とを比較し、比較結果に応じてレベルを反転させることにより第2の被変調信号を発生する第2比較回路と、
を備えたことを特徴とする。
前記第2ランプ波発生回路は、基準電位(GND)と電源との間に接続された、第2のキャパシタを含む第2の時定数回路と、前記第2の時定数回路に対して直列接続され、前記方形波信号のレベルに応じてオン/オフ状態が変化する第2スイッチ素子と、前記方形波信号の立ち上がりに同期して前記第2の時定数回路の状態をリセットする第2のリセット回路とを備えて、第2の時定数回路の出力電圧を前記第2のランプ波として出力する構成であることが好ましい。
前記第2ランプ波発生回路は、基準電位(GND)側を第2のキャパシタとする第2の時定数回路と、前記第2の時定数回路に対して直列接続され、前記方形波信号のレベルに応じてオン/オフ状態が変化する第2スイッチ素子と、この第2スイッチ素子を介して第2のキャパシタの放電電流が流れる向きに第2のキャパシタに接続されたダイオードとを備え、
第1比較回路が入力する変調信号を前記第1スイッチ素子の状態に応じてレベルシフトする第1のレベルシフト回路および、第2比較回路が入力する変調信号を前記第2スイッチ素子の状態に応じてレベルシフトする第2のレベルシフト回路を備えた構成であることが好ましい。
前記スイッチング制御回路に、上記(1)〜(7)のいずれかに記載のPWM制御回路を備え、
前記変調信号を、スイッチング電源回路の出力フィードバック信号とし、前記第1の被変調信号および前記第2の被変調信号を前記2つのスイッチング素子の制御信号としたことを特徴とする。
図1は本発明の第1の実施の形態であるPWM制御回路101のブロック図である。このPWM制御回路101は、方形波信号を入力する方形波信号入力端子11、変調信号入力端子12、第1の被変調信号出力端子21、第2の被変調信号出力端子22を備えている。
図4は第2の実施形態であるPWM制御回路102の回路図である。このPWM制御回路102は、第1ランプ波発生回路31、第2ランプ波発生回路32、第1比較回路41および第2比較回路42を備えている。第1の実施形態で図2に示したPWM制御回路101と異なるのは、定電流回路CC1,CC2に代えて、抵抗R11、R21を設けた点である。すなわち、このPWM制御回路102においては、抵抗R11と第1のキャパシタC11とによって第1の時定数回路51が構成されている。同様に、抵抗R21と第2のキャパシタC21とによって第2の時定数回路52が構成されている。
図7は第3の実施形態であるPWM制御回路103の回路図である。このPWM制御回路103は電源Vdc1を電源電圧として動作する。第1ランプ波発生回路31は、定電流回路CC1、第1のキャパシタC11、ダイオードD11、抵抗R12、第1スイッチ素子SW11および反転回路29で構成されている。第2ランプ波発生回路32は、定電流回路CC2、第2のキャパシタC21、ダイオードD21、抵抗R22および第2スイッチ素子SW21で構成されている。第1比較回路41および第2比較回路42はいずれもコンパレータで構成されている。
図9は第4の実施形態であるPWM制御回路104の回路図である。このPWM制御回路104は、第1ランプ波発生回路31、第2ランプ波発生回路32、第1比較回路41および第2比較回路42を備えている。第3の実施形態で図7に示したPWM制御回路103と異なるのは、定電流回路CC1,CC2に代えて、抵抗R11、R21を設けた点である。すなわち、このPWM制御回路104においては、抵抗R11,R12と第1のキャパシタC11とによって第1の時定数回路51が構成されている。同様に、抵抗R21,R22と第2のキャパシタC21とによって第2の時定数回路52が構成されている。
第5の実施形態ではスイッチング電源装置の構成例を示す。図12は第5の実施形態のスイッチング電源装置201の回路図である。このスイッチング電源装置201は、トランスT、コンデンサCr、インダクタLr、ドライバー回路211,212、スイッチング素子Q1,Q2、出力フィードバック回路220、エラーアンプ221およびPWM制御回路101を備えている。PWM制御回路101はスイッチング素子Q1,Q2を制御するスイッチング制御回路として作用する。このPWM制御回路101は、図1に示したPWM制御回路101であるが、別の実施形態のPWM制御回路102,103,104のいずれかであってもよい。
C21…第2のキャパシタ
CC1,CC2…定電流回路
Cload…容量性負荷
Cr…共振コンデンサ
D11,D12,D21,D22…ダイオード
L1…インダクタ
Lr…共振インダクタ
Q1…ローサイドスイッチング素子
Q2…ハイサイドスイッチング素子
SW11…第1スイッチ素子
SW21…第2スイッチ素子
T…トランス
Vdc1…電源
11…方形波信号入力端子
12…変調信号入力端子
21…第1の被変調信号出力端子
22…第2の被変調信号出力端子
29…反転回路
31…第1ランプ波発生回路
32…第2ランプ波発生回路
41…第1比較回路
42…第2比較回路
51…第1の時定数回路
52…第2の時定数回路
61…第1のリセット回路
62…第2のリセット回路
71…第1のレベルシフト回路
72…第2のレベルシフト回路
102,103,104…PWM制御回路
201…スイッチング電源装置
211,212…ドライバー回路
220…出力フィードバック回路
221…エラーアンプ
Claims (8)
- 方形波信号を外部から入力する、または内部で生成する、方形波信号設定手段と、
変調信号を入力する変調信号入力端子と、
タイミングの異なる2つの被変調信号を出力する第1および第2の被変調信号出力端子と、
前記方形波信号の立ち上がりに同期して第1のランプ波の掃引を開始する第1ランプ波発生回路と、
前記方形波信号の立ち下がりに同期して第2のランプ波の掃引を開始する第2ランプ波発生回路と、
前記第1のランプ波と前記変調信号とを比較し、比較結果に応じてレベルを反転させることにより第1の被変調信号を発生する第1比較回路と、
前記第2のランプ波と前記変調信号とを比較し、比較結果に応じてレベルを反転させることにより第2の被変調信号を発生する第2比較回路と、
を備えたことを特徴とするPWM制御回路。 - 前記第1のランプ波は、前記方形波信号の立ち下がりと立ち上がりの間で掃引を開始する電位にリセットされ、
前記第2のランプ波は、前記方形波信号の立ち上がりと立下りの間で掃引を開始する電位にリセットされる、請求項1に記載のPWM制御回路。 - 前記第1のランプ波は、前記方形波信号の立ち上がりで掃引を開始する電位にリセットされ、
前記第2のランプ波は、前記方形波信号の立ち下がりで掃引を開始する電位にリセットされる、請求項1または2に記載のPWM制御回路。 - 前記第1のランプ波は、前記方形波信号の立ち下がりで掃引を開始する電位にリセットされ、
前記第2のランプ波は、前記方形波信号の立ち上がりで掃引を開始する電位にリセットされる請求項1または2に記載のPWM制御回路。 - 前記第1ランプ波発生回路は、基準電位と電源との間に接続された、第1のキャパシタを含む第1の時定数回路と、前記第1の時定数回路に対して直列接続され、前記方形波信号のレベルに応じてオン/オフ状態が変化する第1スイッチ素子と、前記方形波信号の立ち下がりに同期して前記第1の時定数回路の状態をリセットする第1のリセット回路とを備えて、第1の時定数回路の出力電圧を前記第1のランプ波として出力し、
前記第2ランプ波発生回路は、基準電位と電源との間に接続された、第2のキャパシタを含む第2の時定数回路と、前記第2の時定数回路に対して直列接続され、前記方形波信号のレベルに応じてオン/オフ状態が変化する第2スイッチ素子と、前記方形波信号の立ち上がりに同期して前記第2の時定数回路の状態をリセットする第2のリセット回路とを備えて、第2の時定数回路の出力電圧を前記第2のランプ波として出力する、請求項3に記載のPWM制御回路。 - 前記第1ランプ波発生回路は、基準電位側を第1のキャパシタとする第1の時定数回路と、前記第1の時定数回路に対して直列接続され、前記方形波信号のレベルに応じてオン/オフ状態が変化する第1スイッチ素子と、この第1スイッチ素子を介して第1のキャパシタの放電電流が流れる向きに第1のキャパシタに接続されたダイオードとを備え、
前記第2ランプ波発生回路は、基準電位側を第2のキャパシタとする第2の時定数回路と、前記第2の時定数回路に対して直列接続され、前記方形波信号のレベルに応じてオン/オフ状態が変化する第2スイッチ素子と、この第2スイッチ素子を介して第2のキャパシタの放電電流が流れる向きに第2のキャパシタに接続されたダイオードとを備え、
第1比較回路が入力する変調信号を前記第1スイッチ素子の状態に応じてレベルシフトする第1のレベルシフト回路および、第2比較回路が入力する変調信号を前記第2スイッチ素子の状態に応じてレベルシフトする第2のレベルシフト回路を備えた、請求項4に記載のPWM制御回路。 - 前記第1の時定数回路は、前記第1のキャパシタへ一定の充電電流を供給する第1の定電流回路を備え、前記第2の時定数回路は、前記第2のキャパシタへ一定の充電電流を供給する第2の定電流回路を備えた、請求項5または6に記載のPWM制御回路。
- 少なくとも2つのスイッチング素子と、これらのスイッチング素子を制御するスイッチング制御回路と、を備えたスイッチング電源装置において、
前記スイッチング制御回路に、請求項1〜7のいずれかに記載のPWM制御回路を備え、
前記変調信号を、スイッチング電源回路の出力フィードバック信号とし、前記第1の被変調信号および前記第2の被変調信号を前記2つのスイッチング素子の制御信号とした、スイッチング電源装置。
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