JPWO2005101304A1 - 半導体集積回路、及びこれを搭載した非接触型情報システム - Google Patents
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Abstract
Description
アンテナコイルが受信した電磁波によって電源電圧の供給を受ける一方、前記アンテナコイルを介してデータの送受信を行う半導体集積回路であって、
データが格納されるメモリ回路と、
前記アンテナコイルが接続される一対の端子と、
送信するデータに応じて、前記端子間の負荷を変化させることによって、前記アンテナコイルを介してデータを送信する変調送信回路と、
前記メモリ回路に格納されたデータを前記変調送信回路に出力する送信制御回路と、
前記電源電圧が所定の閾値を下回った場合に、前記送信制御回路をリセットするリセット信号を前記送信制御回路に出力するリセット信号発生回路とを備え、
前記送信制御回路は、データを送信中の状態であることを示す送信状態信号を出力するように構成され、
前記リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記送信状態信号が出力されていない期間よりも前記閾値を低くするように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
前記リセット信号発生回路は、前記電源電圧を分圧する分圧抵抗器を有し、前記分圧抵抗器によって分圧された電圧が所定の基準電圧よりも低い場合に、前記リセット信号を出力するように構成されていることを特徴とする。
請求項2の半導体集積回路であって、
前記リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記分圧された電圧が、前記送信状態信号が出力されていない期間よりも高くなるように分圧比を変更するように構成されていることを特徴とする。
請求項3の半導体集積回路であって、
前記分圧抵抗器は、3個以上の抵抗器から成る直列抵抗器であり、
前記リセット信号発生回路は、前記電源電圧を分圧する前記直列抵抗器の個数を変更することによって前記分圧比を変更するように構成されていることを特徴とする。
請求項1から請求項4のうちの何れか1項の半導体集積回路であって、
前記送信制御回路は、前記メモリ回路に格納されたデータを前記変調送信回路に出力すると同時に前記送信状態信号を出力するように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
前記送信制御回路は、前記メモリ回路に格納されたデータを保持するバッファを有し、前記バッファに保持したデータを前記変調送信回路に出力するように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
前記送信制御回路は、前記変調送信回路へのデータの出力が終了し、前記変調送信回路にデータを出力するために要した時間以上の時間が経過した後に、前記送信状態信号の出力を停止するように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
さらに、前記電源電圧が所定の閾値を超えた場合に、前記送信制御回路をリセットするリセット信号を前記送信制御回路に出力する高電圧側リセット信号発生回路を備え、
前記高電圧側リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記送信状態信号が出力されていない期間よりも前記閾値を低くするように構成されていることを特徴とする。
請求項8の半導体集積回路であって、
前記高電圧側リセット信号発生回路は、前記電源電圧を分圧する分圧抵抗器を有し、前記分圧抵抗器によって分圧した電圧が所定の基準電圧よりも高い場合に、前記リセット信号を出力するように構成されていることを特徴とする。
請求項9の半導体集積回路であって、
前記高電圧側リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記分圧した電圧が、前記送信状態信号が出力されていない期間よりも高くなるように分圧比を変更するように構成されていることを特徴とする。
請求項10の半導体集積回路であって、
前記分圧抵抗器は、3個以上の抵抗器から成る直列抵抗器であり、
前記高電圧側リセット信号発生回路は、前記電源電圧を分圧する前記直列抵抗器の個数を変更することによって前記分圧比を変更するように構成されていることを特徴とする。
請求項1に記載の半導体集積回路、および前記半導体集積回路に接続されて電磁波を送受信するアンテナコイルを有する非接触型情報媒体と、
前記非接触型情報媒体に対し、電磁波によって電源電圧の供給、およびデータの送受信を行うデータ送受信装置と、
を備えたことを特徴とする。
110 整流回路
111 ダイオード
112 ダイオード
120 電源回路
130 クロック発生回路
140 復調回路
150 変調回路
151 変調度調整抵抗
152 変調用トランジスタ
160 リセット発生回路
161 インバータ
162 リセット検知下限電圧設定用トランジスタ
163〜165 抵抗器
166 参照電圧発生回路
167 比較器
200 ロジック回路部
300 不揮発性メモリ回路部
410 コイル端子
420 コイル端子
1000 非接触ICカード
1100 非接触ICカード用LSI
1200 アンテナコイル
1300 同調用容量
2000 リーダーライタ
2100 アンテナコイル
3000 ホスト機
(非接触ICカードシステムの構成)
図1は、本発明の実施形態1に係る非接触型情報システム(非接触ICカードシステム)の構成の概要を示すブロック図である。この非接触ICカードシステムは非接触ICカード1000とリーダーライタ2000とから構成されている。また、リーダーライタ2000は、所定のデータ処理を行うホスト機3000と接続されて通信を行うようになっている。
非接触ICカード1000は、図2に示すように、非接触ICカード用LSI1100、アンテナコイル1200、および同調用容量1300とを備えて構成され、リーダーライタ2000のアンテナコイル2100から出力された電磁波をアンテナコイル1200で受信し、受信した電磁波によって非接触ICカード用LSI1100が電源電圧の供給を受けて動作するようになっている。
アナログ回路部100は、図2に示すように整流回路110、電源回路120、クロック発生回路130、復調回路140、変調回路150、およびリセット発生回路160を備えて構成されている。
変調回路150は、図3に示すように、変調度調整抵抗151と変調用トランジスタ152とを備えて構成された負荷変調型の変調回路であり、ロジック回路部200から入力された返信信号TXDATAを変調し、変調された信号をコイル端子410・420に出力するようになっている。アンテナコイル1200の両端に発生した交流電圧(コイル端子410・420間の電圧)は、変調回路150の変調用トランジスタ152と変調度調整抵抗151で変化する。すなわち、非接触ICカード1000の負荷が変化することになる。
リセット発生回路160は、ロジック回路部200から入力されるスイッチ信号SW(Highレベルの場合に、非接触ICカード1000からリーダーライタ2000へのデータの返信期間中であることを示す信号)に応じて切り替えられる閾値(リセット検知下限電圧Vreset)と、電源電圧Vddとを比較し、リセット検知下限電圧Vresetよりも電源電圧Vddが下回った場合に、ロジック回路部200をリセットするリセット信号RESETをLowレベル(Lレベル)からHighレベル(Hレベル)に遷移させてロジック回路部200に出力し、またリセット検知下限電圧Vresetに達した場合に、リセット信号RESETをHレベルからLレベルに遷移させる。スイッチ信号SWがLレベルの期間(データの返信以外の動作をしている期間)にリセット検知下限電圧Vresetとして用いられる値(Vre1)は、非接触ICカード用LSI1100の全体が誤動作を引き起こさない程度の電圧レベルに設定される。また、スイッチ信号SWがHレベルの期間(データの返信期間)に用いられる値(Vre2)は、少なくともロジック回路部200が誤動作を引き起こさない程度の電圧レベルであって、かつ後述するようにデータの返信により電源電圧Vdd(コイル端子410・420間の電圧)が低下した状態よりも低い電圧に設定される(不揮発性メモリ回路部300は、この電圧で誤動作する可能性があってもよい。)。
リセット発生回路160は、具体的には、図6に示すように、インバータ161、リセット検知下限電圧設定用トランジスタ162、抵抗器163〜165、参照電圧発生回路166、および比較器167を備えて構成される。
(式1)R1+R2+R3=1000[kΩ]
(式2)4.5/(R1+R2+R3)=1.2/R3
《スイッチ信号SWがLレベルの場合に、リセット発生回路160の抵抗器に流れる電流値》
(式3)3.0/(R2+R3)=1.2/R3
《スイッチ信号SWがHレベルの場合に、リセット発生回路160の抵抗器に流れる電流値》
上記(式1)〜(式3)より、抵抗器163〜165のそれぞれの抵抗値は、R1=333.33[kΩ]、R2=400.00[kΩ]、およびR3=266.67[kΩ]となる。
ロジック回路部200は、非接触ICカード1000からリーダーライタ2000へデータの返信が行われる場合に、前記リセット検知下限電圧Vresetを切り替えるために、スイッチ信号SWをリセット発生回路160に出力するようになっている。具体的には、データの返信期間には、Hレベルのスイッチ信号SWを出力し、データの返信期間以外の期間には、Lレベルのスイッチ信号SWを出力する。スイッチ信号SWをHレベルに遷移させるタイミングは、データを変調回路150に出力するのと同時である。これにより、電源電圧がリセット検知下限電圧よりも低下する前に、前記リセット検知下限電圧を低く切り替えることができる。
上記のように構成された、非接触ICカードシステムでは、データの送受信が行われる場合に、非接触ICカード1000がリーダーライタ2000に対して所定の距離内に近づけられるとアンテナコイル1200に交流電圧が発生し、整流回路110で整流された後、電源回路120により電源電圧Vddとして出力され、非接触ICカード用LSI1100全体に対して供給される。リーダーライタ2000から送信されたデータは、アンテナコイル1200で受信された後、整流回路110を介して復調回路140に入力されて復調される。
リセット発生回路160に対し比較器167の出力を反転させるインバータが付加された高電圧側リセット発生回路を実施形態1の非接触ICカード用LSI1100に、さらに設けてもよい。
アンテナコイルが受信した電磁波によって電源電圧の供給を受ける一方、前記アンテナコイルを介してデータの送受信を行う半導体集積回路であって、
データが格納されるメモリ回路と、
前記アンテナコイルが接続される一対の端子と、
送信するデータに応じて、前記端子間の負荷を変化させることによって、前記アンテナコイルを介してデータを送信する変調送信回路と、
前記メモリ回路に格納されたデータを前記変調送信回路に出力する送信制御回路と、
前記電源電圧が所定の閾値を下回った場合に、前記送信制御回路をリセットするリセット信号を前記送信制御回路に出力するリセット信号発生回路とを備え、
前記送信制御回路は、データを送信中の状態であることを示す送信状態信号を出力するように構成され、
前記リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記送信状態信号が出力されていない期間よりも前記閾値を低くするように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
前記リセット信号発生回路は、前記電源電圧を分圧する分圧抵抗器を有し、前記分圧抵抗器によって分圧された電圧が所定の基準電圧よりも低い場合に、前記リセット信号を出力するように構成されていることを特徴とする。
請求項2の半導体集積回路であって、
前記リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記分圧された電圧が、前記送信状態信号が出力されていない期間よりも高くなるように分圧比を変更するように構成されていることを特徴とする。
請求項3の半導体集積回路であって、
前記分圧抵抗器は、3個以上の抵抗器から成る直列抵抗器であり、
前記リセット信号発生回路は、前記電源電圧を分圧する前記直列抵抗器の個数を変更することによって前記分圧比を変更するように構成されていることを特徴とする。
請求項1から請求項4のうちの何れか1項の半導体集積回路であって、
前記送信制御回路は、前記メモリ回路に格納されたデータを前記変調送信回路に出力すると同時に前記送信状態信号を出力するように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
前記送信制御回路は、前記メモリ回路に格納されたデータを保持するバッファを有し、前記バッファに保持したデータを前記変調送信回路に出力するように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
前記送信制御回路は、前記変調送信回路へのデータの出力が終了し、前記変調送信回路にデータを出力するために要した時間以上の時間が経過した後に、前記送信状態信号の出力を停止するように構成されていることを特徴とする。
請求項1の半導体集積回路であって、
さらに、前記電源電圧が所定の閾値を超えた場合に、前記送信制御回路をリセットするリセット信号を前記送信制御回路に出力する高電圧側リセット信号発生回路を備え、
前記高電圧側リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記送信状態信号が出力されていない期間よりも前記閾値を低くするように構成されていることを特徴とする。
請求項8の半導体集積回路であって、
前記高電圧側リセット信号発生回路は、前記電源電圧を分圧する分圧抵抗器を有し、前記分圧抵抗器によって分圧した電圧が所定の基準電圧よりも高い場合に、前記リセット信号を出力するように構成されていることを特徴とする。
請求項9の半導体集積回路であって、
前記高電圧側リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記分圧した電圧が、前記送信状態信号が出力されていない期間よりも高くなるように分圧比を変更するように構成されていることを特徴とする。
請求項10の半導体集積回路であって、
前記分圧抵抗器は、3個以上の抵抗器から成る直列抵抗器であり、
前記高電圧側リセット信号発生回路は、前記電源電圧を分圧する前記直列抵抗器の個数を変更することによって前記分圧比を変更するように構成されていることを特徴とする。
請求項1に記載の半導体集積回路、および前記半導体集積回路に接続されて電磁波を送受信するアンテナコイルを有する非接触型情報媒体と、
前記非接触型情報媒体に対し、電磁波によって電源電圧の供給、およびデータの送受信を行うデータ送受信装置と、
を備えたことを特徴とする。
(非接触ICカードシステムの構成)
図1は、本発明の実施形態1に係る非接触型情報システム(非接触ICカードシステム)の構成の概要を示すブロック図である。この非接触ICカードシステムは非接触ICカード1000とリーダーライタ2000とから構成されている。また、リーダーライタ2000は、所定のデータ処理を行うホスト機3000と接続されて通信を行うようになっている。
非接触ICカード1000は、図2に示すように、非接触ICカード用LSI1100、アンテナコイル1200、および同調用容量1300とを備えて構成され、リーダーライタ2000のアンテナコイル2100から出力された電磁波をアンテナコイル1200で受信し、受信した電磁波によって非接触ICカード用LSI1100が電源電圧の供給を受けて動作するようになっている。
アナログ回路部100は、図2に示すように整流回路110、電源回路120、クロック発生回路130、復調回路140、変調回路150、およびリセット発生回路160を備えて構成されている。
変調回路150は、図3に示すように、変調度調整抵抗151と変調用トランジスタ152とを備えて構成された負荷変調型の変調回路であり、ロジック回路部200から入力された返信信号TXDATAを変調し、変調された信号をコイル端子410・420に出力するようになっている。アンテナコイル1200の両端に発生した交流電圧(コイル端子410・420間の電圧)は、変調回路150の変調用トランジスタ152と変調度調整抵抗151で変化する。すなわち、非接触ICカード1000の負荷が変化することになる。
リセット発生回路160は、ロジック回路部200から入力されるスイッチ信号SW(Highレベルの場合に、非接触ICカード1000からリーダーライタ2000へのデータの返信期間中であることを示す信号)に応じて切り替えられる閾値(リセット検知下限電圧Vreset)と、電源電圧Vddとを比較し、リセット検知下限電圧Vresetよりも電源電圧Vddが下回った場合に、ロジック回路部200をリセットするリセット信号RESETをLowレベル(Lレベル)からHighレベル(Hレベル)に遷移させてロジック回路部200に出力し、またリセット検知下限電圧Vresetに達した場合に、リセット信号RESETをHレベルからLレベルに遷移させる。スイッチ信号SWがLレベルの期間(データの返信以外の動作をしている期間)にリセット検知下限電圧Vresetとして用いられる値(Vre1)は、非接触ICカード用LSI1100の全体が誤動作を引き起こさない程度の電圧レベルに設定される。また、スイッチ信号SWがHレベルの期間(データの返信期間)に用いられる値(Vre2)は、少なくともロジック回路部200が誤動作を引き起こさない程度の電圧レベルであって、かつ後述するようにデータの返信により電源電圧Vdd(コイル端子410・420間の電圧)が低下した状態よりも低い電圧に設定される(不揮発性メモリ回路部300は、この電圧で誤動作する可能性があってもよい。)。
リセット発生回路160は、具体的には、図6に示すように、インバータ161、リセット検知下限電圧設定用トランジスタ162、抵抗器163〜165、参照電圧発生回路166、および比較器167を備えて構成される。
(式1)R1+R2+R3=1000[kΩ]
(式2)4.5/(R1+R2+R3)=1.2/R3
《スイッチ信号SWがLレベルの場合に、リセット発生回路160の抵抗器に流れる電流値》
(式3)3.0/(R2+R3)=1.2/R3
《スイッチ信号SWがHレベルの場合に、リセット発生回路160の抵抗器に流れる電流値》
上記(式1)〜(式3)より、抵抗器163〜165のそれぞれの抵抗値は、R1=333.33[kΩ]、R2=400.00[kΩ]、およびR3=266.67[kΩ]となる。
ロジック回路部200は、非接触ICカード1000からリーダーライタ2000へデータの返信が行われる場合に、前記リセット検知下限電圧Vresetを切り替えるために、スイッチ信号SWをリセット発生回路160に出力するようになっている。具体的には、データの返信期間には、Hレベルのスイッチ信号SWを出力し、データの返信期間以外の期間には、Lレベルのスイッチ信号SWを出力する。スイッチ信号SWをHレベルに遷移させるタイミングは、データを変調回路150に出力するのと同時である。これにより、電源電圧がリセット検知下限電圧よりも低下する前に、前記リセット検知下限電圧を低く切り替えることができる。
上記のように構成された、非接触ICカードシステムでは、データの送受信が行われる場合に、非接触ICカード1000がリーダーライタ2000に対して所定の距離内に近づけられるとアンテナコイル1200に交流電圧が発生し、整流回路110で整流された後、電源回路120により電源電圧Vddとして出力され、非接触ICカード用LSI1100全体に対して供給される。リーダーライタ2000から送信されたデータは、アンテナコイル1200で受信された後、整流回路110を介して復調回路140に入力されて復調される。
リセット発生回路160に対し比較器167の出力を反転させるインバータが付加された高電圧側リセット発生回路を実施形態1の非接触ICカード用LSI1100に、さらに設けてもよい。
110 整流回路
111 ダイオード
112 ダイオード
120 電源回路
130 クロック発生回路
140 復調回路
150 変調回路
151 変調度調整抵抗
152 変調用トランジスタ
160 リセット発生回路
161 インバータ
162 リセット検知下限電圧設定用トランジスタ
163〜165 抵抗器
166 参照電圧発生回路
167 比較器
200 ロジック回路部
300 不揮発性メモリ回路部
410 コイル端子
420 コイル端子
1000 非接触ICカード
1100 非接触ICカード用LSI
1200 アンテナコイル
1300 同調用容量
2000 リーダーライタ
2100 アンテナコイル
3000 ホスト機
Claims (12)
- アンテナコイルが受信した電磁波によって電源電圧の供給を受ける一方、前記アンテナコイルを介してデータの送受信を行う半導体集積回路であって、
データが格納されるメモリ回路と、
前記アンテナコイルが接続される一対の端子と、
送信するデータに応じて、前記端子間の負荷を変化させることによって、前記アンテナコイルを介してデータを送信する変調送信回路と、
前記メモリ回路に格納されたデータを前記変調送信回路に出力する送信制御回路と、
前記電源電圧が所定の閾値を下回った場合に、前記送信制御回路をリセットするリセット信号を前記送信制御回路に出力するリセット信号発生回路とを備え、
前記送信制御回路は、データを送信中の状態であることを示す送信状態信号を出力するように構成され、
前記リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記送信状態信号が出力されていない期間よりも前記閾値を低くするように構成されていることを特徴とする半導体集積回路。 - 請求項1の半導体集積回路であって、
前記リセット信号発生回路は、前記電源電圧を分圧する分圧抵抗器を有し、前記分圧抵抗器によって分圧された電圧が所定の基準電圧よりも低い場合に、前記リセット信号を出力するように構成されていることを特徴とする半導体集積回路。 - 請求項2の半導体集積回路であって、
前記リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記分圧された電圧が、前記送信状態信号が出力されていない期間よりも高くなるように分圧比を変更するように構成されていることを特徴とする半導体集積回路。 - 請求項3の半導体集積回路であって、
前記分圧抵抗器は、3個以上の抵抗器から成る直列抵抗器であり、
前記リセット信号発生回路は、前記電源電圧を分圧する前記直列抵抗器の個数を変更することによって前記分圧比を変更するように構成されていることを特徴とする半導体集積回路。 - 請求項1から請求項4のうちの何れか1項の半導体集積回路であって、
前記送信制御回路は、前記メモリ回路に格納されたデータを前記変調送信回路に出力すると同時に前記送信状態信号を出力するように構成されていることを特徴とする半導体集積回路。 - 請求項1の半導体集積回路であって、
前記送信制御回路は、前記メモリ回路に格納されたデータを保持するバッファを有し、前記バッファに保持したデータを前記変調送信回路に出力するように構成されていることを特徴とする半導体集積回路。 - 請求項1の半導体集積回路であって、
前記送信制御回路は、前記変調送信回路へのデータの出力が終了し、前記変調送信回路にデータを出力するために要した時間以上の時間が経過した後に、前記送信状態信号の出力を停止するように構成されていることを特徴とする半導体集積回路。 - 請求項1の半導体集積回路であって、
さらに、前記電源電圧が所定の閾値を超えた場合に、前記送信制御回路をリセットするリセット信号を前記送信制御回路に出力する高電圧側リセット信号発生回路を備え、
前記高電圧側リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記送信状態信号が出力されていない期間よりも前記閾値を低くするように構成されていることを特徴とする半導体集積回路。 - 請求項8の半導体集積回路であって、
前記高電圧側リセット信号発生回路は、前記電源電圧を分圧する分圧抵抗器を有し、前記分圧抵抗器によって分圧した電圧が所定の基準電圧よりも高い場合に、前記リセット信号を出力するように構成されていることを特徴とする半導体集積回路。 - 請求項9の半導体集積回路であって、
前記高電圧側リセット信号発生回路は、前記送信状態信号が出力されている期間は、前記分圧した電圧が、前記送信状態信号が出力されていない期間よりも高くなるように分圧比を変更するように構成されていることを特徴とする半導体集積回路。 - 請求項10の半導体集積回路であって、
前記分圧抵抗器は、3個以上の抵抗器から成る直列抵抗器であり、
前記高電圧側リセット信号発生回路は、前記電源電圧を分圧する前記直列抵抗器の個数を変更することによって前記分圧比を変更するように構成されていることを特徴とする半導体集積回路。 - 請求項1に記載の半導体集積回路、および前記半導体集積回路に接続されて電磁波を送受信するアンテナコイルを有する非接触型情報媒体と、
前記非接触型情報媒体に対し、電磁波によって電源電圧の供給、およびデータの送受信を行うデータ送受信装置と、
を備えたことを特徴とする非接触型情報システム。
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