JPS6446847U - - Google Patents

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JPS6446847U
JPS6446847U JP14128287U JP14128287U JPS6446847U JP S6446847 U JPS6446847 U JP S6446847U JP 14128287 U JP14128287 U JP 14128287U JP 14128287 U JP14128287 U JP 14128287U JP S6446847 U JPS6446847 U JP S6446847U
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JP
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read
memory
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control
control processing
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JP14128287U
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  • Techniques For Improving Reliability Of Storages (AREA)

Description

【図面の簡単な説明】
第１図は本実施例のＲＯＭの誤装着検知装置の
回路図を含むシステムブロツク図、第２図は一パ
ルス出力回路の具体的回路図、第３図は第一ワー
ド検出回路の具体的回路図、第４図ａは並列使用
のＲＯＭチツプ７ａの構成図、第４図ｂは並列使
用のＲＯＭチツプ７ｂの構成図、第５図ａ，ｂは
本実施例で誤装着の判別ができないＲＯＭチツプ
７ａ，７ｂの構成図、第６図ａは直列使用のＲＯ
Ｍチツプ７ａ′の構成図、第６図ｂは直列使用の
ＲＯＭチツプ７ｂ′の構成図、第７図は比較器の
全体構成図、第８図は比較器の具体的構成図、第
９図はＲＯＭ７の異なる構成を説明する構成図で
ある。 １……ＲＯＭの誤装着検知回路、２……一パル
ス出力回路、２ａ……ＤＦ．Ｆ、２ｂ……ＯＲゲ
ート、３……Ｆ．Ｆ、４……第１ワード検出回路
、４ａ……ＮＯＲゲート、４ｂ……ＮＡＮＤゲー
ト、５……エラー表示部、６……ＣＰＵ、７……
ＲＯＭ、７ａ，７ｂ，７ａ′，７ｂ′，７ｃ，７
ｄ……ＲＯＭチツプ、８……ＲＳＴ、９……比較
器、１０ａ〜１０ｈ……ＥＸＯＲゲート、１１ａ
〜１１ｈ……ジヤンパ線、１２……ＯＲゲート。

Claims (1)

    【実用新案登録請求の範囲】
  1. 制御プログラムが記憶された読出し専用メモリ
    と、該読出し専用メモリに記憶された前記制御プ
    ログラムデータに従つて制御動作う行う制御処理
    手段と、初期動作時、前記制御処理手段により前
    記読出し専用メモリの特定番地から読み出された
    プログラムデータと、予め決められた特定データ
    との一致を検出する一致検出回路とを備えたこと
    を特徴とする読出し専用メモリの誤装着検知装置
    。
JP14128287U 1987-09-16 1987-09-16 Pending JPS6446847U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP14128287U JPS6446847U (ja) 1987-09-16 1987-09-16

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP14128287U JPS6446847U (ja) 1987-09-16 1987-09-16

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Publication Number Publication Date
JPS6446847U true JPS6446847U (ja) 1989-03-23

Family

ID=31406220

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14128287U Pending JPS6446847U (ja) 1987-09-16 1987-09-16

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