JPS6435534U - - Google Patents
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- Publication number
- JPS6435534U JPS6435534U JP12805487U JP12805487U JPS6435534U JP S6435534 U JPS6435534 U JP S6435534U JP 12805487 U JP12805487 U JP 12805487U JP 12805487 U JP12805487 U JP 12805487U JP S6435534 U JPS6435534 U JP S6435534U
- Authority
- JP
- Japan
- Prior art keywords
- data
- memory
- control signal
- address
- rotation speed
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000015654 memory Effects 0.000 claims description 12
- 238000005259 measurement Methods 0.000 claims description 3
- 230000004044 response Effects 0.000 claims 1
- 230000001360 synchronised effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
Description
第1図はこの考案の一実施例を示すブロツク図
、第2図はデータ出力/変更手段の他の例を示す
ブロツク図、第3図は従来例を説明する為の波形
図である。 図において、1はテープ、2は回転ヘツド、6
はPLL回路、8は周波数カウンタ、9は計数ラ
ツチ回路、10はデイジタルコンパレータ、11
と11Aはアドレス発生器、12と12Aはカウ
ンタ初期値メモリ、23はアツプダウンパルス発
生器、24は基準値データメモリ、AはPLL回
路手段、Bは周期計測手段、Cは比較手段、Dと
DAはデータ出力/変更手段、Eは速度制御手段
である。なお、図中、同一符号は同一、又は相当
部分を示す。
、第2図はデータ出力/変更手段の他の例を示す
ブロツク図、第3図は従来例を説明する為の波形
図である。 図において、1はテープ、2は回転ヘツド、6
はPLL回路、8は周波数カウンタ、9は計数ラ
ツチ回路、10はデイジタルコンパレータ、11
と11Aはアドレス発生器、12と12Aはカウ
ンタ初期値メモリ、23はアツプダウンパルス発
生器、24は基準値データメモリ、AはPLL回
路手段、Bは周期計測手段、Cは比較手段、Dと
DAはデータ出力/変更手段、Eは速度制御手段
である。なお、図中、同一符号は同一、又は相当
部分を示す。
Claims (1)
- 【実用新案登録請求の範囲】 (1) テープに記録された信号を再生する回転ヘ
ツドを有するテープレコーダ装置であつて、前記
回転ヘツドによつて再生された再生信号に同期す
るクロツク信号およびPLLロツクがかゝつてい
るかいないかを示すPLLロツク信号を生成する
PLL回路手段と、このPLL回路手段の出力側
に接続され、前記クロツク信号の周期を計測して
計測データを生成する周期計測手段と、この周期
計測手段の出力側に接続され、前記計測データと
予め設定しておいたデータとを比較して制御信号
を生成する比較手段と、この比較手段および前記
PLL回路手段の出力側に接続され、前記回転ヘ
ツドが設けられたドラムの回転数を指定するデー
タを格納しているメモリを含み、前記制御信号に
応じたドラム回転数指定データを出力すると共に
このドラム回転数指定データを変更し得るデータ
出力/変更手段と、このデータ出力/変更手段の
出力側に接続され、前記ドラム回転数指定データ
に応じて前記テープと前記回転ヘツドの相対速度
が一定になるように前記ドラムの回転速度を制御
する速度制御手段とを備えたことを特徴とするテ
ープレコーダ装置。 (2) 周期計測手段はPLL回路手段から出力さ
れたクロツク信号を分周する分周回路、この分周
回路で分周されたクロツク信号の周期を計測する
カウンタおよびこのカウンタの計測データをラツ
チするラツチ回路によつて構成され、比較手段は
デイジタルコンパレータであることを特徴とする
実用新案登録請求の範囲第1項記載のテープレコ
ーダ装置。 (3) データ出力/変更手段は、PLL回路手段
からPLLロツク信号が入力される場合には、比
較手段からの制御信号に応じたアドレス制御信号
を発生し、このアドレス制御信号でメモリのアド
レスを特定し、もつて対応するドラム回転数指定
データを前記メモリから出力させるが、前記PL
Lロツク信号が入力されない場合には、前記制御
信号と無関係に前記PLLロツク信号が入力され
るまでアドレス制御信号を順次変更し、ひいては
アドレスおよびドラム回転数指定データを順次変
更させるアドレス発生器を含むことを特徴とする
実用新案登録請求の範囲第1項または第2項記載
のテープレコーダ装置。 (4) データ出力/変更手段は、PLL回路手段
からPLLロツク信号が入力される場合には、比
較手段からの制御信号に応じたパルスを発生し、
このパルスでメモリのアドレスを特定し、もつて
対応するドラム回転数指定データを前記メモリか
ら出力させるパルス発生器を含むことを特徴とす
る実用新案登録請求の範囲第1項または第2項記
載のテープレコーダ装置。 (5) データ出力/変更手段は、メモリとしての
カウンタ初期値メモリおよびパルス発生器として
のアツプダウンパルス発生器を加えて、PLL回
路手段からPLLロツク信号が入力されない場合
には、前記PLLロツク信号が入力されるまでア
ドレス制御信号を順次発生し、これにより他のメ
モリとしての基準値データメモリの出力データを
順次変更させ、ひいては前記カウンタ初期値メモ
リに記憶されるドラム回転数指定データを順次変
更させるアドレス発生器を含むことを特徴とする
実用新案登録請求の範囲第4項記載のテープレコ
ーダ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12805487U JPS6435534U (ja) | 1987-08-25 | 1987-08-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12805487U JPS6435534U (ja) | 1987-08-25 | 1987-08-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6435534U true JPS6435534U (ja) | 1989-03-03 |
Family
ID=31381032
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12805487U Pending JPS6435534U (ja) | 1987-08-25 | 1987-08-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6435534U (ja) |
-
1987
- 1987-08-25 JP JP12805487U patent/JPS6435534U/ja active Pending
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