JPS643413B2 - - Google Patents
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- JPS643413B2 JPS643413B2 JP56183373A JP18337381A JPS643413B2 JP S643413 B2 JPS643413 B2 JP S643413B2 JP 56183373 A JP56183373 A JP 56183373A JP 18337381 A JP18337381 A JP 18337381A JP S643413 B2 JPS643413 B2 JP S643413B2
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- JP
- Japan
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- signal
- circuit
- decoder
- rom
- gate
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- 239000000872 buffer Substances 0.000 description 5
- 230000010355 oscillation Effects 0.000 description 4
- 238000004806 packaging method and process Methods 0.000 description 4
- 238000001514 detection method Methods 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 125000004122 cyclic group Chemical group 0.000 description 1
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- 230000004044 response Effects 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B5/00—Near-field transmission systems, e.g. inductive loop type
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
- H04W88/00—Devices specially adapted for wireless communication networks, e.g. terminals, base stations or access point devices
- H04W88/02—Terminal devices
- H04W88/022—Selective call receivers
- H04W88/025—Selective call decoders
- H04W88/026—Selective call decoders using digital address codes
Description
【発明の詳細な説明】
(1) 発明の属する分野
本発明は無線選択呼出受信機に関する。特に複
数の個別選択呼出番号を小規模の回路構成で実現
した受信機に関する。
数の個別選択呼出番号を小規模の回路構成で実現
した受信機に関する。
(2) 発明の背景
近年の無線個別選択呼出受信機は、情報量の増
大および加入者数の増加に伴い、従来のトーン信
号処理からデイジタル信号処理へと移行しつつあ
る。第１図に後者の一例として英国のBRITISH
TELECOMが提案している通称POCSAG（Pcst
Office Code Standardisation Advisory
Group）コードと呼ばれている信号構成を示す。
また第２図は、第１図に示す信号のアドレス信号
部に用いられているアドレス符号の構成図であ
り、巡回符号の一種であるBCH３１，２１符号
に、１ビツトのイーブンパリテイビツトを付加し
た構成である。ここで情報ビツト２１ビツト中識
別ビツトであるMSB（Most Significant Bit）１
ビツトを除く20ビツトは個別選択呼出番号を形成
するが、このPOCSAGシステムでは、情報ビツ
ト20ビツトのLSB（Least Significant Bit）２ビ
ツトを操作することによつて、４種の異なる符号
を個人に割り当てている。このように個人が複数
の番号を持つシステムをマルチアドレスシステム
という。
大および加入者数の増加に伴い、従来のトーン信
号処理からデイジタル信号処理へと移行しつつあ
る。第１図に後者の一例として英国のBRITISH
TELECOMが提案している通称POCSAG（Pcst
Office Code Standardisation Advisory
Group）コードと呼ばれている信号構成を示す。
また第２図は、第１図に示す信号のアドレス信号
部に用いられているアドレス符号の構成図であ
り、巡回符号の一種であるBCH３１，２１符号
に、１ビツトのイーブンパリテイビツトを付加し
た構成である。ここで情報ビツト２１ビツト中識
別ビツトであるMSB（Most Significant Bit）１
ビツトを除く20ビツトは個別選択呼出番号を形成
するが、このPOCSAGシステムでは、情報ビツ
ト20ビツトのLSB（Least Significant Bit）２ビ
ツトを操作することによつて、４種の異なる符号
を個人に割り当てている。このように個人が複数
の番号を持つシステムをマルチアドレスシステム
という。
(3) 従来技術の説明
受信機では、Ｐ・ROM（Programmable Read
Only Memory）に独立に書込まれた前記マルチ
アドレスに対応するコードを読み出し、同時に４
種の符号を受信入力信号と比較する必要がある
が、従来のＰ・ROMではデコーダとＰ・ROM
との配線本数が多く実装をを困難にしている。同
時にデコーダに大規模な回路構成を必要とした。
第３図に従来のＰ・ROMの回路構成の一例を示
す。
Only Memory）に独立に書込まれた前記マルチ
アドレスに対応するコードを読み出し、同時に４
種の符号を受信入力信号と比較する必要がある
が、従来のＰ・ROMではデコーダとＰ・ROM
との配線本数が多く実装をを困難にしている。同
時にデコーダに大規模な回路構成を必要とした。
第３図に従来のＰ・ROMの回路構成の一例を示
す。
第３図は、ダイオード１００−１２３、トラン
ジスタ１３０−１５３、抵抗１６０−１８３から
構成されていて、前記ダイオードを破壊するか、
しないかによつて、データ読出し信号線Ａ１，Ａ
２……Ａ８に印加された電圧が前記各トランジス
タのベースに供給されたり、あるいは供給されな
いように制御され、これにより前記各トランジス
タはオン・オフし、出力信号線Ｂ１，Ｂ２……Ｂ
８に論理「１」，「０」のデータが読出される。こ
のトランジスタはオーブンコレクタ構成としてあ
るので、実際にはデータを利用するデコーダ側で
前記出力信号線Ｂ１，Ｂ２……Ｂ８を抵抗を介し
て電源に接続する必要がある。このように従来の
ROMでは、僅か64bitのデータを処理するために
デコーダとＰ・ROM間の配線本数として16本が
必要である。
ジスタ１３０−１５３、抵抗１６０−１８３から
構成されていて、前記ダイオードを破壊するか、
しないかによつて、データ読出し信号線Ａ１，Ａ
２……Ａ８に印加された電圧が前記各トランジス
タのベースに供給されたり、あるいは供給されな
いように制御され、これにより前記各トランジス
タはオン・オフし、出力信号線Ｂ１，Ｂ２……Ｂ
８に論理「１」，「０」のデータが読出される。こ
のトランジスタはオーブンコレクタ構成としてあ
るので、実際にはデータを利用するデコーダ側で
前記出力信号線Ｂ１，Ｂ２……Ｂ８を抵抗を介し
て電源に接続する必要がある。このように従来の
ROMでは、僅か64bitのデータを処理するために
デコーダとＰ・ROM間の配線本数として16本が
必要である。
第４図は前述のような構成の２種の符号を受信
するシステムを前記Ｐ・ROMを用いた場合につ
いて、デコーダの構成およびデコーダとＰ・
ROM間の配線例を示す。
するシステムを前記Ｐ・ROMを用いた場合につ
いて、デコーダの構成およびデコーダとＰ・
ROM間の配線例を示す。
すなわち第４図において、デコーダは少なくと
もカウンタを構成するＤタイプのフリツプフロツ
プ２００−２０４と、Ｐ・ROMの読出し個所を
指定するNORゲート２１０−２１７、バツフア
２２０−２２７と、Ｐ・ROMからのデータの送
出個所を指定するNORゲート２３０−２３３と、
インバータ２７０−２７６と、NANDゲート２
４０，２４１と、２種のＰ・ROMの記憶内容と
受信データを比較するEXORゲート２６０，２
６１、および前記EXORゲートの出力から受信
信号が目的の信号であるかどうかを判断する判定
回路とを必要とし、Ｐ・ROM間の配線本数は16
本必要である。
もカウンタを構成するＤタイプのフリツプフロツ
プ２００−２０４と、Ｐ・ROMの読出し個所を
指定するNORゲート２１０−２１７、バツフア
２２０−２２７と、Ｐ・ROMからのデータの送
出個所を指定するNORゲート２３０−２３３と、
インバータ２７０−２７６と、NANDゲート２
４０，２４１と、２種のＰ・ROMの記憶内容と
受信データを比較するEXORゲート２６０，２
６１、および前記EXORゲートの出力から受信
信号が目的の信号であるかどうかを判断する判定
回路とを必要とし、Ｐ・ROM間の配線本数は16
本必要である。
従つて前述のPOCSAGコードを受信するシス
テムでは、４種の個別選択呼出番号を同時に受信
する必要があるが、このとき、受信機に使用する
Ｐ・ROMを第３図で示したようなＰ・ROMを
用いたのでは、第４図の例でも分かるようにデコ
ーダの回路規模およびデコーダとＰ・ROM間の
配線本数が多くなつて、近年の小形化および高密
度実装化への流れに逆行することになる。
テムでは、４種の個別選択呼出番号を同時に受信
する必要があるが、このとき、受信機に使用する
Ｐ・ROMを第３図で示したようなＰ・ROMを
用いたのでは、第４図の例でも分かるようにデコ
ーダの回路規模およびデコーダとＰ・ROM間の
配線本数が多くなつて、近年の小形化および高密
度実装化への流れに逆行することになる。
(4) 発明の目的
本発明は、個別選択呼出番号を記憶するＰ・
ROMに、デコーダを内蔵し記憶内容を直列に読
出すことによつてデコーダとＰ・ROM間の配線
本数を削減し高密度実装を可能とした無線選択呼
出受信機を提供することを目的とする。
ROMに、デコーダを内蔵し記憶内容を直列に読
出すことによつてデコーダとＰ・ROM間の配線
本数を削減し高密度実装を可能とした無線選択呼
出受信機を提供することを目的とする。
本発明の他の目的は、デコーダを内蔵したＰ・
ROMを用いて、機器の高密度実装化を図ると共
に複数の個別選択呼出番号を受信できる無線個別
選択呼出受信機を提供することにある。
ROMを用いて、機器の高密度実装化を図ると共
に複数の個別選択呼出番号を受信できる無線個別
選択呼出受信機を提供することにある。
(5) 本発明の要旨
本発明の装置は、
Ｎ種の情報を記憶するデコーダ内蔵のＰ・
ROMを備え、 受信信号のデータ速度に対応するクロツクのＮ
倍以上の周波数のクロツクでこのＰ・ROMの記
憶内容を直列に読出し、 この読出出力を同時に受信信号が自局宛ての目
的の信号であるか否かを判別することを特徴とす
る。
ROMを備え、 受信信号のデータ速度に対応するクロツクのＮ
倍以上の周波数のクロツクでこのＰ・ROMの記
憶内容を直列に読出し、 この読出出力を同時に受信信号が自局宛ての目
的の信号であるか否かを判別することを特徴とす
る。
また、上記構成において、Ｐ・ROMの各記憶
情報が Ａ１，Ａ２・……，Am，Ｂ１，Ｂ２・……
Bm，……，Ｘ１，Ｘ２，……Xm のようにｍビツト構成で与えられるとき、前記
Ｐ・ROMの出力が Ａ１，Ｂ１，……Ｘ１，Ａ２，Ｂ２，……，Ｘ
２，……Am，Bm，……Xm のように対応ビツト単位にまとめて出力される構
成が望ましい。
情報が Ａ１，Ａ２・……，Am，Ｂ１，Ｂ２・……
Bm，……，Ｘ１，Ｘ２，……Xm のようにｍビツト構成で与えられるとき、前記
Ｐ・ROMの出力が Ａ１，Ｂ１，……Ｘ１，Ａ２，Ｂ２，……，Ｘ
２，……Am，Bm，……Xm のように対応ビツト単位にまとめて出力される構
成が望ましい。
ただし、上記Ｎは２以上の整数、ｍは２以上の
整数、まとめて出力されるビツト単位内での順番
は、各ビツト単位で同じであれば任意でよい。
整数、まとめて出力されるビツト単位内での順番
は、各ビツト単位で同じであれば任意でよい。
(6) 実施例による説明
実施例図面に用いて本発明をさらに詳細に説明
する。
する。
第５図はデコーダ内蔵のＰ・ROMの一構成例
を示すブロツク図である。３００はｍ進カウン
タ、３１０はカウンタである。３２０は、第３図
で説明したメモリーセルがマトリツクス状に配列
された記憶回路である。３３０−３３３はアンド
ゲート３４０はORゲートである。第６図はこの
装置の各部の動作タイムチヤートを示す。
を示すブロツク図である。３００はｍ進カウン
タ、３１０はカウンタである。３２０は、第３図
で説明したメモリーセルがマトリツクス状に配列
された記憶回路である。３３０−３３３はアンド
ゲート３４０はORゲートである。第６図はこの
装置の各部の動作タイムチヤートを示す。
その動作を説明すると、先ずＰ・ROMの読出
クロツクがｍ進カウンタ３００へ入力されると、
マトリツクス状の配列をもつ記憶回路３２０の読
出制御線TS１，TS２……TSmがクロツクに応
答し順次電圧の印加がなされ、各印加された制御
線に対応する列の記憶内容が読出される。これは
アンドゲート３３０−３３３の一方の入力端子に
供給される。しかし、前記ｍ進カウンタ３００に
応答するカウンタ３１０の計数値が「０」である
とき、出力Ｒ１のみが論理「Ｈ」レベルで、他の
出力Ｒ２−Rnは論理「Ｌ」レベルであるので、
結局アンドゲード３３０−３３３の中で動作する
ものはアンドゲート３３０だけで他は動作しな
い。
クロツクがｍ進カウンタ３００へ入力されると、
マトリツクス状の配列をもつ記憶回路３２０の読
出制御線TS１，TS２……TSmがクロツクに応
答し順次電圧の印加がなされ、各印加された制御
線に対応する列の記憶内容が読出される。これは
アンドゲート３３０−３３３の一方の入力端子に
供給される。しかし、前記ｍ進カウンタ３００に
応答するカウンタ３１０の計数値が「０」である
とき、出力Ｒ１のみが論理「Ｈ」レベルで、他の
出力Ｒ２−Rnは論理「Ｌ」レベルであるので、
結局アンドゲード３３０−３３３の中で動作する
ものはアンドゲート３３０だけで他は動作しな
い。
カウンタ３１０は出力TS１，TS２……TSm
が順次論理「Ｈ」レベルとなり、再び出力TS１
が論理「Ｈ」レベルとなる度にカウンタ３１０は
計数され、その結果出力Ｒ１−Rnは順次論理
「Ｈ」レベルとなり、各出力Ｒ１−Rnに接続され
たアンドゲートが活性化される。その出力はOR
ゲート３４０を介して読出される。
が順次論理「Ｈ」レベルとなり、再び出力TS１
が論理「Ｈ」レベルとなる度にカウンタ３１０は
計数され、その結果出力Ｒ１−Rnは順次論理
「Ｈ」レベルとなり、各出力Ｒ１−Rnに接続され
たアンドゲートが活性化される。その出力はOR
ゲート３４０を介して読出される。
このようなＰ・ROMを用いた第１図のような
信号構成のシステムで、Ａに示す個別選択呼出番
号が全く独立な２種の符号を受信できるように構
成された受信機のブロツク図を第７図に示す。
信号構成のシステムで、Ａに示す個別選択呼出番
号が全く独立な２種の符号を受信できるように構
成された受信機のブロツク図を第７図に示す。
第７図で、４００はアンテナで、第１図に示す
信号で変調された搬送波を受信し、無線部５００
に供給する。無線部５００ではこの信号を復調
し、デコーダ６００にこれを供給する。デコーダ
６００では、個別選択呼出番号が記憶されている
Ｐ・ROM７００の内容と受信信号とを比較し両
者の一致が確認されると、受信信号に対応する鳴
音回路を起動し、バツフア８００を介してスピー
カ９００をを駆動し、受信機所持者に呼出しがあ
つた旨を知らせる。受信機所持者は、必要ならば
スイツチ１１００をプツシユすることによつて、
鳴音を停止させることができる。
信号で変調された搬送波を受信し、無線部５００
に供給する。無線部５００ではこの信号を復調
し、デコーダ６００にこれを供給する。デコーダ
６００では、個別選択呼出番号が記憶されている
Ｐ・ROM７００の内容と受信信号とを比較し両
者の一致が確認されると、受信信号に対応する鳴
音回路を起動し、バツフア８００を介してスピー
カ９００をを駆動し、受信機所持者に呼出しがあ
つた旨を知らせる。受信機所持者は、必要ならば
スイツチ１１００をプツシユすることによつて、
鳴音を停止させることができる。
デコーダ６００の内部の説明を第８図に示すタ
イムチヤートを用いて行なう。目的の受信信号
（例えば200bit／ｓのNRZ符号）に対応するクロ
ツク（第８図ｂ）（例えば200Hz）、およびその２
倍のクロツクを発生する発振回路６３０の動作に
よつて、Ｄ−タイプのフリツプフロツプで構成さ
れる同期回路６１０が駆動される。同期回路６１
０の出力に受信信号（第８図ａ）が出力されると
この信号は、プリアンブルおよびSC検出回路６
２０の接続される。さて、電源の印加を間欠的に
行つて（俗称バツテリー・セービングという）、
電源の有効利用を図つている受信機は電源が印加
されている期間に予め定められたプリアンブル信
号を検出すると前記バツテリー・セービングを仮
解除し、引続いて送られてくるフレーム同期を確
立するためのSC信号の検出をするのに十分な期
間だけ、電源を連続的に印加する。
イムチヤートを用いて行なう。目的の受信信号
（例えば200bit／ｓのNRZ符号）に対応するクロ
ツク（第８図ｂ）（例えば200Hz）、およびその２
倍のクロツクを発生する発振回路６３０の動作に
よつて、Ｄ−タイプのフリツプフロツプで構成さ
れる同期回路６１０が駆動される。同期回路６１
０の出力に受信信号（第８図ａ）が出力されると
この信号は、プリアンブルおよびSC検出回路６
２０の接続される。さて、電源の印加を間欠的に
行つて（俗称バツテリー・セービングという）、
電源の有効利用を図つている受信機は電源が印加
されている期間に予め定められたプリアンブル信
号を検出すると前記バツテリー・セービングを仮
解除し、引続いて送られてくるフレーム同期を確
立するためのSC信号の検出をするのに十分な期
間だけ、電源を連続的に印加する。
このSC信号が受信されフレーム同期が確立す
ると、引続いて送られてくる個別選択呼出番号を
検出するために、アンドゲート６９０を活性化
し、信号（第８図ｃ）でＮ種（本実施例ではＮ＝
２）の個別選択呼出番号が記憶されているＰ・
ROM７００の内容を読出す。こうして直列に読
出されたＰ・ROM７００の記憶内容は、アンド
ゲート６９３，６９４の一方の入力端子に供給さ
れ、前記アンドゲート６９３，６９４の他方の入
力信号の論理によつて、比較回路を構成する２入
力EXORゲート６４０，６４１の一方の入力端
子に供給される。
ると、引続いて送られてくる個別選択呼出番号を
検出するために、アンドゲート６９０を活性化
し、信号（第８図ｃ）でＮ種（本実施例ではＮ＝
２）の個別選択呼出番号が記憶されているＰ・
ROM７００の内容を読出す。こうして直列に読
出されたＰ・ROM７００の記憶内容は、アンド
ゲート６９３，６９４の一方の入力端子に供給さ
れ、前記アンドゲート６９３，６９４の他方の入
力信号の論理によつて、比較回路を構成する２入
力EXORゲート６４０，６４１の一方の入力端
子に供給される。
また、同期回路６１０の出力（第８図ａ）は、
アンドゲート６９１，６９２の一方の入力端子に
接続され、前記アンドゲート６９１，６９２の他
方の入力信号の論理によつて、前記EXORゲー
ト６４０，６４１の他方の入力端子に供給され
る。このようにしてEXORゲート６４０では受
信入力信号の読出しクロツク（第８図ｂ）の正の
半周期に、またEXORゲート６４１では前記読
出しクロツクの負の半周期に、それぞれ受信入力
信号とＰ・ROM７００から読出された内容とを
比較し、不一致のビツト数の計数および判定タイ
ミングを作るカウンタ６５０，６５１にその出力
を供給する。
アンドゲート６９１，６９２の一方の入力端子に
接続され、前記アンドゲート６９１，６９２の他
方の入力信号の論理によつて、前記EXORゲー
ト６４０，６４１の他方の入力端子に供給され
る。このようにしてEXORゲート６４０では受
信入力信号の読出しクロツク（第８図ｂ）の正の
半周期に、またEXORゲート６４１では前記読
出しクロツクの負の半周期に、それぞれ受信入力
信号とＰ・ROM７００から読出された内容とを
比較し、不一致のビツト数の計数および判定タイ
ミングを作るカウンタ６５０，６５１にその出力
を供給する。
このとき、前記カウンタ６５０，６５１の計数
値が予め定められた数（本実施例では「１」）以
下のときは、目的の個別選択呼出番号が検出され
たものとして、第８図ｅのように、Ａコール鳴音
回路６６０を起動させ、ORゲート６８０・バツ
フア８００を介して、スピーカ９００を駆動させ
る。この結果受信機所持者は呼出しがなされたこ
とを確認することができる。
値が予め定められた数（本実施例では「１」）以
下のときは、目的の個別選択呼出番号が検出され
たものとして、第８図ｅのように、Ａコール鳴音
回路６６０を起動させ、ORゲート６８０・バツ
フア８００を介して、スピーカ９００を駆動させ
る。この結果受信機所持者は呼出しがなされたこ
とを確認することができる。
第８図ｈのように、受信機所持者が呼出を確認
してプツシユスイツチ１１００を操作すると、受
信機はＡコールの鳴音を停止する。さらに前記Ａ
コールの鳴音停止後第８図ｆのようにＢコールの
検出がなされると、Ｂコール鳴音回路６７０の出
力がORゲート６８０・バツフア８００を介して
スピーカ９００を駆動する。このとき一般にＡコ
ール、Ｂコールの鳴音周期が異なるように設計し
てあるので、受信機所持者はＢコールの呼出しが
なされたことを確認することができる。
してプツシユスイツチ１１００を操作すると、受
信機はＡコールの鳴音を停止する。さらに前記Ａ
コールの鳴音停止後第８図ｆのようにＢコールの
検出がなされると、Ｂコール鳴音回路６７０の出
力がORゲート６８０・バツフア８００を介して
スピーカ９００を駆動する。このとき一般にＡコ
ール、Ｂコールの鳴音周期が異なるように設計し
てあるので、受信機所持者はＢコールの呼出しが
なされたことを確認することができる。
ここで、発振回路６３０はトランジスタを用い
た非安定マルチバイブレータやCR発振回路など
である。Ｄタイプ・フリツプフロツプ６１０はこ
の例ではμPD4013（NEC製）、EXOR６４０，６
４１はμPD4030（NEC製）、カウンタ６５０，６
５１はμPD4017或はμPD4020（NEC製）などによ
り構成された。以上のように本実施例によれば第
４図および第７図を比べれば明らかなように、デ
コーダとＰ・ROM間の配線本数を16本から２本
に削減することができる。
た非安定マルチバイブレータやCR発振回路など
である。Ｄタイプ・フリツプフロツプ６１０はこ
の例ではμPD4013（NEC製）、EXOR６４０，６
４１はμPD4030（NEC製）、カウンタ６５０，６
５１はμPD4017或はμPD4020（NEC製）などによ
り構成された。以上のように本実施例によれば第
４図および第７図を比べれば明らかなように、デ
コーダとＰ・ROM間の配線本数を16本から２本
に削減することができる。
(7) 本発明の効果
本発明によれば、Ｎ個の個別選択呼出番号を記
憶するＰ・ROMにデコーダを内蔵し、読出しク
ロツクに応答し記憶内容を直列に出力するＰ・
ROMを用い、デコーダでは、目的の受信信号の
データ速度に対応するクロツクのＮ倍のクロツク
をＰ・ROMの読出しクロツクとし、受信信号と
読出されたＰ・ROMの記憶内容とを比較し、Ｎ
個の個別選択呼出番号を同時に検出する回路構成
とすることによつて、マルチアドレスを受信する
小形で高密度実装を可能とした受信機を実現でき
る。
憶するＰ・ROMにデコーダを内蔵し、読出しク
ロツクに応答し記憶内容を直列に出力するＰ・
ROMを用い、デコーダでは、目的の受信信号の
データ速度に対応するクロツクのＮ倍のクロツク
をＰ・ROMの読出しクロツクとし、受信信号と
読出されたＰ・ROMの記憶内容とを比較し、Ｎ
個の個別選択呼出番号を同時に検出する回路構成
とすることによつて、マルチアドレスを受信する
小形で高密度実装を可能とした受信機を実現でき
る。
第１図は、個別選択呼出受信機に採用されてい
る信号構成の一例を示す図。第２図は、個別選択
呼出信号（第１図Ａ）の符号の一例でBCH３１，
２１＋１符号の場合を示す図。第３図は、個別選
択呼出受信機に使用されている従来のＰ・ROM
の回路構成の一例を示す図。第４図は、２種の32
ビツトからなる個別選択呼出番号を受信するシス
テムで第３図のＰ・ROMを用いた場合の回路構
成の一例を示す図。第５図は、デコーダ内蔵の
Ｐ・ROMのブロツク回路構成例を示す図。第６
図は第５図に示す回路の動作をタイムチヤート。
第７図は、本発明の実施例装置の要部ブロツク構
成図。第８図は、その動作タイムチヤート。 １００−１２３……ダイオード、１３０−１５
３……トランジスタ、１６０−１８３……抵抗、
２００−２０４……Ｄタイプのフリツプフロツ
プ、２１０−２１７……３入力NORゲート、２
２０−２２７……バツフアゲート、２３０−２３
３……２入力NOR、２４０，２４１……４入力
NAND、２５０−２５７……２入力NAND、２
６０，２６１……EXORゲート、２７０−２７
６……インバータゲート、２８０……判定回路、
３００……ｍ進カウンタ、３１０……カウンタ、
３２０……記憶回路、３３０−３３３……２入力
ANDゲート、３４０……ORゲート、４００……
アンテナ、５００……無線部、６００……デコー
ダ、６１０……同期回路、６２０……プリアンブ
ルおよびSC検出回路、６３０……発振回路、６
４０，６４１……EXORゲート、６５０，６５
１……カウンタ、６６０……Ａコール鳴音回路、
６７０……Ｂコール鳴音回路、６８０……２入力
ORゲート、６９０−６９４……２入力ANDゲー
ト、６０５……インバータゲート、７００……
Ｐ・ROM、８００……バツフア回路、９００…
…スピーカ、１０００……抵抗、１１００……プ
ツシユ・スイツチ。
る信号構成の一例を示す図。第２図は、個別選択
呼出信号（第１図Ａ）の符号の一例でBCH３１，
２１＋１符号の場合を示す図。第３図は、個別選
択呼出受信機に使用されている従来のＰ・ROM
の回路構成の一例を示す図。第４図は、２種の32
ビツトからなる個別選択呼出番号を受信するシス
テムで第３図のＰ・ROMを用いた場合の回路構
成の一例を示す図。第５図は、デコーダ内蔵の
Ｐ・ROMのブロツク回路構成例を示す図。第６
図は第５図に示す回路の動作をタイムチヤート。
第７図は、本発明の実施例装置の要部ブロツク構
成図。第８図は、その動作タイムチヤート。 １００−１２３……ダイオード、１３０−１５
３……トランジスタ、１６０−１８３……抵抗、
２００−２０４……Ｄタイプのフリツプフロツ
プ、２１０−２１７……３入力NORゲート、２
２０−２２７……バツフアゲート、２３０−２３
３……２入力NOR、２４０，２４１……４入力
NAND、２５０−２５７……２入力NAND、２
６０，２６１……EXORゲート、２７０−２７
６……インバータゲート、２８０……判定回路、
３００……ｍ進カウンタ、３１０……カウンタ、
３２０……記憶回路、３３０−３３３……２入力
ANDゲート、３４０……ORゲート、４００……
アンテナ、５００……無線部、６００……デコー
ダ、６１０……同期回路、６２０……プリアンブ
ルおよびSC検出回路、６３０……発振回路、６
４０，６４１……EXORゲート、６５０，６５
１……カウンタ、６６０……Ａコール鳴音回路、
６７０……Ｂコール鳴音回路、６８０……２入力
ORゲート、６９０−６９４……２入力ANDゲー
ト、６０５……インバータゲート、７００……
Ｐ・ROM、８００……バツフア回路、９００…
…スピーカ、１０００……抵抗、１１００……プ
ツシユ・スイツチ。
Claims (1)
- 【特許請求の範囲】 １ Ｎ種（Ｎは２以上の整数）の情報を記憶しデ
コーダを内蔵するプログラマブル・読出専用メモ
リ（Ｐ・ROM）と、 受信信号のデータ速度に対応するクロツクのＮ
倍以上の周波数のクロツクで上記プログラマブ
ル・読出専用メモリの記憶内容を直列に読出す手
段と、 この手段により得られる読出出力のＮ種の記憶
内容を同時に受信信号と比較しその受信信号が目
的の信号であるか否かを判断する手段と を含む無線選択呼出受信機。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56183373A JPS5884549A (ja) | 1981-11-16 | 1981-11-16 | 無線選択呼出受信機 |
| US06/440,724 US4591853A (en) | 1981-11-16 | 1982-11-10 | Paging receiver with a decoder-P-ROM |
| GB08232214A GB2112188B (en) | 1981-11-16 | 1982-11-11 | Paging receiver |
| AU90487/82A AU552687B2 (en) | 1981-11-16 | 1982-11-15 | Paging receiver |
| KR8205172A KR860001043B1 (ko) | 1981-11-16 | 1982-11-16 | 페이징 리시버(Paging Receiver) |
| CA000415658A CA1202371A (en) | 1981-11-16 | 1982-11-16 | Paging receiver |
| HK604/90A HK60490A (en) | 1981-11-16 | 1990-08-09 | Paging receiver |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56183373A JPS5884549A (ja) | 1981-11-16 | 1981-11-16 | 無線選択呼出受信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5884549A JPS5884549A (ja) | 1983-05-20 |
| JPS643413B2 true JPS643413B2 (ja) | 1989-01-20 |
Family
ID=16134632
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56183373A Granted JPS5884549A (ja) | 1981-11-16 | 1981-11-16 | 無線選択呼出受信機 |
Country Status (7)
| Country | Link |
|---|---|
| US (1) | US4591853A (ja) |
| JP (1) | JPS5884549A (ja) |
| KR (1) | KR860001043B1 (ja) |
| AU (1) | AU552687B2 (ja) |
| CA (1) | CA1202371A (ja) |
| GB (1) | GB2112188B (ja) |
| HK (1) | HK60490A (ja) |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0759104B2 (ja) * | 1985-12-18 | 1995-06-21 | 日本電気株式会社 | 表示付無線選択呼出受信機 |
| US4849750A (en) * | 1987-10-20 | 1989-07-18 | Telefind Corp. | Paging receiver with dynamically programmable channel frequencies and functionality |
| WO1989004025A1 (en) * | 1987-10-20 | 1989-05-05 | Telefind Corporation | Paging receiver with programmable areas of reception |
| US4853688A (en) * | 1987-10-20 | 1989-08-01 | Telefind Corp. | Paging receiver displaying place of origin of pages |
| US4935732A (en) * | 1987-10-20 | 1990-06-19 | Telefind Corporation | Paging receiver with programmable areas of reception |
| US4857915A (en) * | 1987-10-20 | 1989-08-15 | Telefind Corp. | Paging receiver with paging receiver identification code digits transmitted in order of increasing significance |
| US4876538A (en) * | 1988-02-22 | 1989-10-24 | Telefind Corp. | Paging system sublocal switch |
| US4875039A (en) * | 1988-02-22 | 1989-10-17 | Telefind Corp. | Paging system with transmission protocol compatible with analog and digital transmitters |
| JPH0778991B2 (ja) * | 1988-07-26 | 1995-08-23 | 株式会社東芝 | 半導体メモリ |
| US4975693A (en) * | 1989-01-30 | 1990-12-04 | Motorola, Inc. | Programmable multi-address pager receiver and method of characterizing same |
Family Cites Families (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US2973507A (en) * | 1958-09-02 | 1961-02-28 | Collins Radio Co | Call recognition system |
| GB1545117A (en) * | 1976-05-25 | 1979-05-02 | Nat Res Dev | Comparison apparatus eg for use in character recognition |
| JPS5858858B2 (ja) * | 1976-08-04 | 1983-12-27 | 日本電信電話株式会社 | 選択呼出通信方式 |
| US4142177A (en) * | 1976-08-12 | 1979-02-27 | Motorola, Inc. | Digital tone decoder system |
| GB1547730A (en) * | 1976-12-01 | 1979-06-27 | Raytheon Co | Monolithic intergrated circuit memory |
| US4103286A (en) * | 1977-02-22 | 1978-07-25 | Motorola, Inc. | Digital binary group call circuitry arrangement |
| US4160240A (en) * | 1978-01-13 | 1979-07-03 | Motorola, Inc. | Binary digital pager having an eight function code read-out |
| US4245212A (en) * | 1978-03-13 | 1981-01-13 | The United States Of America As Represented By The Secretary Of The Navy | Serial digital data decoder |
| JPS5593334A (en) * | 1979-01-10 | 1980-07-15 | Nec Corp | Radio selection call receiver |
| JPS5665537A (en) * | 1979-11-01 | 1981-06-03 | Nec Corp | Individual selection callout receiver with display |
| NL176889C (nl) * | 1980-01-30 | 1985-06-17 | Nira Int Bv | Personenzoekontvanger. |
| JPS56136050A (en) * | 1980-03-28 | 1981-10-23 | Nec Corp | Individual selective call reception system |
| US4518961A (en) * | 1980-10-01 | 1985-05-21 | Motorola, Inc. | Universal paging device with power conservation |
| US4414676A (en) * | 1981-03-31 | 1983-11-08 | Motorola, Inc. | Signal synchronization system |
| GB2103402B (en) * | 1981-07-27 | 1984-09-05 | Standard Telephones Cables Ltd | Synchronisation of digital radio pager |
-
1981
- 1981-11-16 JP JP56183373A patent/JPS5884549A/ja active Granted
-
1982
- 1982-11-10 US US06/440,724 patent/US4591853A/en not_active Expired - Lifetime
- 1982-11-11 GB GB08232214A patent/GB2112188B/en not_active Expired
- 1982-11-15 AU AU90487/82A patent/AU552687B2/en not_active Ceased
- 1982-11-16 KR KR8205172A patent/KR860001043B1/ko active
- 1982-11-16 CA CA000415658A patent/CA1202371A/en not_active Expired
-
1990
- 1990-08-09 HK HK604/90A patent/HK60490A/xx not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| US4591853A (en) | 1986-05-27 |
| CA1202371A (en) | 1986-03-25 |
| AU9048782A (en) | 1983-05-26 |
| AU552687B2 (en) | 1986-06-12 |
| HK60490A (en) | 1990-08-17 |
| GB2112188B (en) | 1985-07-10 |
| KR840002780A (ko) | 1984-07-16 |
| JPS5884549A (ja) | 1983-05-20 |
| GB2112188A (en) | 1983-07-13 |
| KR860001043B1 (ko) | 1986-07-28 |
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