JPS6384217A - 多重化伝送方式 - Google Patents
多重化伝送方式Info
- Publication number
- JPS6384217A JPS6384217A JP22822686A JP22822686A JPS6384217A JP S6384217 A JPS6384217 A JP S6384217A JP 22822686 A JP22822686 A JP 22822686A JP 22822686 A JP22822686 A JP 22822686A JP S6384217 A JPS6384217 A JP S6384217A
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- JP
- Japan
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- data
- speed line
- low
- speed
- line
- Prior art date
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- Granted
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- 230000005540 biological transmission Effects 0.000 title claims abstract description 23
- 238000000034 method Methods 0.000 claims description 7
- 239000000872 buffer Substances 0.000 abstract description 11
- 230000003247 decreasing effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 6
- 230000000694 effects Effects 0.000 description 1
- 102220184965 rs117987946 Human genes 0.000 description 1
- 102220067506 rs150937126 Human genes 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
（産業上の利用分野）
この発明は、多重化伝送方式の改良に関するものでおる
。
。
（従来の技術）
従来の多重化伝送方式を採用した伝送システムを、第８
図に示す。多重分離化部１と多重分離化部２とは、高速
回線３で接続され、多重分離化部１には、バス４を介し
て低速回線アダプタ５１．５２．５３．・・・が接続さ
れ、多重分離化部２にはバス６を介して、低速回線アダ
プタ７１，７□。
図に示す。多重分離化部１と多重分離化部２とは、高速
回線３で接続され、多重分離化部１には、バス４を介し
て低速回線アダプタ５１．５２．５３．・・・が接続さ
れ、多重分離化部２にはバス６を介して、低速回線アダ
プタ７１，７□。
７３・・・が接続されている。低速回線アダプタ５１．
５２．５３．・・・には低速回線８１．８２，８３゜・
・・が接続され低速回線アダプタ７１，７２，７３、・
・・には、低速回線９１，９２．９３．・・・が接続さ
れている。
５２．５３．・・・には低速回線８１．８２，８３゜・
・・が接続され低速回線アダプタ７１，７２，７３、・
・・には、低速回線９１，９２．９３．・・・が接続さ
れている。
かかる伝送システムにおいて、高速回線３を用いたデー
タ伝送では、第９図（Ａ）に示すように同期符号Ｆで挟
まれたｎビットのデータフィールドの所要ビットを各低
速回線８１，８２．８３゜・・・に割当てていた。簡単
のために各低速回線８１．８２．８３．・・・の各４ビ
ツトを高速回線３の１フレームに配置するものとすれば
、多重分離化部１は低速回線アダプタ５１，５２，５３
．・・・を介して受取った各４ビツトのデータ［）ｉｉ
−Ｄ１２．Ｄ１３゜０１４・Ｄ２１・Ｄ２２・Ｄ２３・
０２４・Ｄ３１・Ｄ３２・°°。
タ伝送では、第９図（Ａ）に示すように同期符号Ｆで挟
まれたｎビットのデータフィールドの所要ビットを各低
速回線８１，８２．８３゜・・・に割当てていた。簡単
のために各低速回線８１．８２．８３．・・・の各４ビ
ツトを高速回線３の１フレームに配置するものとすれば
、多重分離化部１は低速回線アダプタ５１，５２，５３
．・・・を介して受取った各４ビツトのデータ［）ｉｉ
−Ｄ１２．Ｄ１３゜０１４・Ｄ２１・Ｄ２２・Ｄ２３・
０２４・Ｄ３１・Ｄ３２・°°。
を第９図（Ａ＞に示すように連続的に１フレームＸに配
置して多重化し、伝送していた。そして、高速回線３を
介して、かかる多重化データを受取った多重分離化部２
では、第９図（Ｂ）のように各ビットＤ１１・Ｄ１２・
Ｄ１３・Ｄ１４・（Ｄ２１・Ｄ２２・Ｄ２３− Ｄ２４
．Ｄ３１−０３２−）・・・を、クロックに基づいて分
離し、バス６を介して、４ビツトづつ低速回線アダプタ
７、．７２．７３．−・・に送出する。
置して多重化し、伝送していた。そして、高速回線３を
介して、かかる多重化データを受取った多重分離化部２
では、第９図（Ｂ）のように各ビットＤ１１・Ｄ１２・
Ｄ１３・Ｄ１４・（Ｄ２１・Ｄ２２・Ｄ２３− Ｄ２４
．Ｄ３１−０３２−）・・・を、クロックに基づいて分
離し、バス６を介して、４ビツトづつ低速回線アダプタ
７、．７２．７３．−・・に送出する。
低速回線アダプタ７１は低速回線９１の回線速度に応じ
て４ビツトづつのデータＤｌｌ−０１２−Ｄ１３−Ｄ１
４．Ｄｌｌ、Ｄ１□−Ｄ１３．Ｄ１４−・・・を低速回
線９１に、第９図（Ｃ）の如く送出する。他の低速回線
アダプタ７２，７３．・・・も、上記低速回線アダプタ
７１と同様の動作を行う。
て４ビツトづつのデータＤｌｌ−０１２−Ｄ１３−Ｄ１
４．Ｄｌｌ、Ｄ１□−Ｄ１３．Ｄ１４−・・・を低速回
線９１に、第９図（Ｃ）の如く送出する。他の低速回線
アダプタ７２，７３．・・・も、上記低速回線アダプタ
７１と同様の動作を行う。
このような従来の多重化伝送方式では、低速回線のｎビ
ットのデータ全てを、高速回線の１フレーム内に連続的
に配置しているため、多重分離化部が分離したデータが
ｎビット同時に低速回線アダプタに与えられるようにな
っていた。このため低速回線アダプタはｎピット分のデ
ータバッファが必要となり、システムの構成が大型化、
複雑化し、コストが高くなるという欠点がめった。
ットのデータ全てを、高速回線の１フレーム内に連続的
に配置しているため、多重分離化部が分離したデータが
ｎビット同時に低速回線アダプタに与えられるようにな
っていた。このため低速回線アダプタはｎピット分のデ
ータバッファが必要となり、システムの構成が大型化、
複雑化し、コストが高くなるという欠点がめった。
（発明が解決しようとする問題点）
上記のように、従来の多重化伝送方式によると、低速回
線アダプタにはｎビットのデータが同時に与えられるた
め、ｎピット分のデータバッフ１が必要となり、システ
ムの構成が大型化、複雑化し、コストが高くなるという
欠点があった。本発明は、このような従来の多重化伝送
方式の欠点に鑑みなされたもので、その目的は、低速回
線アダプタのデータバッフ１数を少なくすることができ
、システムの構成が小型化、簡素化でき、コストを低く
することのできる多重化伝送方式を提供することである
。
線アダプタにはｎビットのデータが同時に与えられるた
め、ｎピット分のデータバッフ１が必要となり、システ
ムの構成が大型化、複雑化し、コストが高くなるという
欠点があった。本発明は、このような従来の多重化伝送
方式の欠点に鑑みなされたもので、その目的は、低速回
線アダプタのデータバッフ１数を少なくすることができ
、システムの構成が小型化、簡素化でき、コストを低く
することのできる多重化伝送方式を提供することである
。
［発明の構成］
（問題点を解決するための手段）
本発明では、複数の低速回線からデータを受取って多重
化し、高速回線を介して伝送した後、多重化データを分
離して複数の低速回線へ分配する多重化伝送方式におけ
る多重化前のデータを伝送する上記低速回線から受取っ
た所定ビットのデータを上記高速回線での１フレーム内
に離散させて配置し伝送するようにしたものである。
化し、高速回線を介して伝送した後、多重化データを分
離して複数の低速回線へ分配する多重化伝送方式におけ
る多重化前のデータを伝送する上記低速回線から受取っ
た所定ビットのデータを上記高速回線での１フレーム内
に離散させて配置し伝送するようにしたものである。
（作用）
上記によると、１の低速回線に対して、高速回線におけ
る１フレーム内に離散されたごットデータが所定の時間
間隔で順次に与えられ得るので、従来のように、１つの
低速回線に割当てられた所定ビットのデータ全てが同時
に与えられる場合に比べて、低速回線アダプタ内のデー
タバッファを減少させることができる。
る１フレーム内に離散されたごットデータが所定の時間
間隔で順次に与えられ得るので、従来のように、１つの
低速回線に割当てられた所定ビットのデータ全てが同時
に与えられる場合に比べて、低速回線アダプタ内のデー
タバッファを減少させることができる。
（実施例）
以下、図面を参照して本発明を説明する。第１図は本発
明の一実施例の方式を採用した伝送システムのブロック
図である。同図において、１０１゜１０２は多重分離化
部を示す。多重分離化部１０１と多重分離化部１０２と
は、高速回線１０３を介してデータ伝送を行う。１０４
４． １０４□、１０４３．・・・は低速回線であり低
速回線１０４１． １０４□、 １０４３・・・より
送られてきたデータは、低速回線アダプタ１０５１、
１０５２． １０５３．・・・に取込まれバス１０＆を
介して多重分離化部１０１へ送出される。多重分離化部
１０１は、バス１０６を介して受取ったデータを多重化
して高速回線１０３へ送出するのであるが、この多重化
は制御部１０７から与えられるビット配置情報ａに基づ
いて、行われる。即ち、低速回線アダプタ１０５１．
１０５□、１０５３．・・・は、低速回線１０４１．
１０４２． １０４３．・・・の回線速度と１フレーム
を構成しているビット数との情報を検出し、この情報を
バス１０８を介して制御部１０７へ送出する。制御部１
０７は、上記の与えられた情報に基づき、低速回線１ｏ
ａ１． １ｏａ２． １ｏａ３．・・・の各所定ビット
のデータを高速回線１０３における１フレーム内に離散
的に配置するビット配！！情報ａを作成する。例えば低
速回線１０４１． １０４２． １０４３・・・の回線
速度が全て同一であり、各１フレームがｎビットからな
り、回線数がｍであるときには、第２図、第３図に示す
ように高速回線１０３における１フレームＹｋ：おいて
は、各低速回線の１フレームの１ビツトを夫々配置して
、ｍビットで１ブロツクを構成し、このブロックをｎブ
ロック送出して１フレームＹとなるようにピッ＋配置情
報ａを作り出す。Ｄｉｊは、低速回線１０４１のｊ番目
のデータを示している。このように、第３図の如く多重
化されて伝送されたデータを取込んだ多重分離化部１０
２は、多重化されているデータを分離しバス１０９へ送
出する。このときの送出のタイミングは、予め定められ
ていても良いし、制御部１１０から与えられる情報によ
って制御されるようにしても良い。バス１０９のデータ
は、低速回線アダプター１１１，１１１２，１１１３．
・・・が所定のタイミングで取込み低速回１ｊｌ １１
２ 、 １１２２． １１２３．・・・へ送出する。
明の一実施例の方式を採用した伝送システムのブロック
図である。同図において、１０１゜１０２は多重分離化
部を示す。多重分離化部１０１と多重分離化部１０２と
は、高速回線１０３を介してデータ伝送を行う。１０４
４． １０４□、１０４３．・・・は低速回線であり低
速回線１０４１． １０４□、 １０４３・・・より
送られてきたデータは、低速回線アダプタ１０５１、
１０５２． １０５３．・・・に取込まれバス１０＆を
介して多重分離化部１０１へ送出される。多重分離化部
１０１は、バス１０６を介して受取ったデータを多重化
して高速回線１０３へ送出するのであるが、この多重化
は制御部１０７から与えられるビット配置情報ａに基づ
いて、行われる。即ち、低速回線アダプタ１０５１．
１０５□、１０５３．・・・は、低速回線１０４１．
１０４２． １０４３．・・・の回線速度と１フレーム
を構成しているビット数との情報を検出し、この情報を
バス１０８を介して制御部１０７へ送出する。制御部１
０７は、上記の与えられた情報に基づき、低速回線１ｏ
ａ１． １ｏａ２． １ｏａ３．・・・の各所定ビット
のデータを高速回線１０３における１フレーム内に離散
的に配置するビット配！！情報ａを作成する。例えば低
速回線１０４１． １０４２． １０４３・・・の回線
速度が全て同一であり、各１フレームがｎビットからな
り、回線数がｍであるときには、第２図、第３図に示す
ように高速回線１０３における１フレームＹｋ：おいて
は、各低速回線の１フレームの１ビツトを夫々配置して
、ｍビットで１ブロツクを構成し、このブロックをｎブ
ロック送出して１フレームＹとなるようにピッ＋配置情
報ａを作り出す。Ｄｉｊは、低速回線１０４１のｊ番目
のデータを示している。このように、第３図の如く多重
化されて伝送されたデータを取込んだ多重分離化部１０
２は、多重化されているデータを分離しバス１０９へ送
出する。このときの送出のタイミングは、予め定められ
ていても良いし、制御部１１０から与えられる情報によ
って制御されるようにしても良い。バス１０９のデータ
は、低速回線アダプター１１１，１１１２，１１１３．
・・・が所定のタイミングで取込み低速回１ｊｌ １１
２ 、 １１２２． １１２３．・・・へ送出する。
尚、バス１１３、制御部１１０は、多重分離化部１０２
がデータを送出するときに、上述のバス１０８、制御部
１０７と同様の機能をはたす。
がデータを送出するときに、上述のバス１０８、制御部
１０７と同様の機能をはたす。
このように構成された伝送システムにおいて、低速回１
１０４１より受取った４ビツトのデータを高速回線１０
３における１フレームＹの中に配置する場合には、第４
図のように、ｍビット毎にデータＤ１１．Ｄ１２＝ Ｄ
１３− Ｄ１４と配置するように、ビット配置情報ａが
多重分離化部１０１へ制御部１０７から与えられる。そ
こで多重分離化部１０１は、第５図（Ａ）に示す如くに
データを多重化して高速回線１０３へ送出する。多重分
離化部１０２はこの多重化データを受取り分離してバス
９ヘデータＤ１１゜Ｄ１２− Ｄ１３．Ｄ１４＝ Ｄ１
１＝・・・を第５図（Ｂ）のタイミングで送出する。低
速回線アダプタ１１１１は第５図（Ｂ）のタイミングで
データＤｉｉ−Ｄ１２−Ｄ１３− ｏｉａ−Ｄｌｌ、・
・・を取込み、第５図（Ｃ）のタイミング（低速回線１
１２１の回線速度に対応したタイミング）で低速回線１
１２１へ送出する。このため、低速回線アダプタ１１１
１は、バス１０９から取込んだデータを同時に２ビツト
保持する必要がないから、データバッファは１ビツト分
で済む低速回線アダプタ１１１２、１１１３、・・・に
ついても同様であるから、システム全体としてデータバ
ッファを従来より少なくすることができる。特に、低速
回線の回線速度を考慮して、高速回線の１フレームに所
定ビットを離散配置するならば、データバッファを最小
にすることが可能である。
１０４１より受取った４ビツトのデータを高速回線１０
３における１フレームＹの中に配置する場合には、第４
図のように、ｍビット毎にデータＤ１１．Ｄ１２＝ Ｄ
１３− Ｄ１４と配置するように、ビット配置情報ａが
多重分離化部１０１へ制御部１０７から与えられる。そ
こで多重分離化部１０１は、第５図（Ａ）に示す如くに
データを多重化して高速回線１０３へ送出する。多重分
離化部１０２はこの多重化データを受取り分離してバス
９ヘデータＤ１１゜Ｄ１２− Ｄ１３．Ｄ１４＝ Ｄ１
１＝・・・を第５図（Ｂ）のタイミングで送出する。低
速回線アダプタ１１１１は第５図（Ｂ）のタイミングで
データＤｉｉ−Ｄ１２−Ｄ１３− ｏｉａ−Ｄｌｌ、・
・・を取込み、第５図（Ｃ）のタイミング（低速回線１
１２１の回線速度に対応したタイミング）で低速回線１
１２１へ送出する。このため、低速回線アダプタ１１１
１は、バス１０９から取込んだデータを同時に２ビツト
保持する必要がないから、データバッファは１ビツト分
で済む低速回線アダプタ１１１２、１１１３、・・・に
ついても同様であるから、システム全体としてデータバ
ッファを従来より少なくすることができる。特に、低速
回線の回線速度を考慮して、高速回線の１フレームに所
定ビットを離散配置するならば、データバッファを最小
にすることが可能である。
尚、本実施例では、ｍ個の低速回線アダプタがある場合
に、ｍビット毎に１ビツトのデータを配置したが、低速
回線の回線速度が遅い場合には、第６図に示すように、
２ｍビット毎（一般的には１ｍビット毎、ｌ：自然数）
であっても良し、低速回線の回線速度が速い場合には逆
に、ｍ／１ビツト毎でも良い。また、等間隔である必要
はなく第７図のように、夫々のビットのデータが異なる
間隔で多重化されるようにしても良い。また、高速回線
の１フレームに配置すべき、１の低速回線から受取るデ
ータのビット数は、本実施例のように４ビツトでなくと
も良い。
に、ｍビット毎に１ビツトのデータを配置したが、低速
回線の回線速度が遅い場合には、第６図に示すように、
２ｍビット毎（一般的には１ｍビット毎、ｌ：自然数）
であっても良し、低速回線の回線速度が速い場合には逆
に、ｍ／１ビツト毎でも良い。また、等間隔である必要
はなく第７図のように、夫々のビットのデータが異なる
間隔で多重化されるようにしても良い。また、高速回線
の１フレームに配置すべき、１の低速回線から受取るデ
ータのビット数は、本実施例のように４ビツトでなくと
も良い。
［発明の効果］
以上説明したように本発明によれば、１つの低速回線へ
送られるべきデータが、高速回線の１フレーム内で離散
されて配置されるので、低速回線アダプタのデータバッ
ファを減少させることができ、システムの構成を小型化
、簡素化でき、コストを低下させることができる。
送られるべきデータが、高速回線の１フレーム内で離散
されて配置されるので、低速回線アダプタのデータバッ
ファを減少させることができ、システムの構成を小型化
、簡素化でき、コストを低下させることができる。
第１図は本発明の一実施例による伝送システムのブロッ
ク図、第２図、第４図は多重化のためにデータを配置す
る手法を示す図、第３図、第５図、第６図、第７図は多
重化されたデータを示す図、第８図は従来の多重化伝送
方式を採用した伝送システムのブロック図、第９図は従
来の多重化伝送方式により多重化されたデータを示す図
である。 １０１．１０２・・・多重分離化部 １０３・・・高速回線 １０４．１０４１０４ １・ １１２２゜ １２・３＝”” １１２３、・・・低速回線 １０７．１１０・・・制御部
ク図、第２図、第４図は多重化のためにデータを配置す
る手法を示す図、第３図、第５図、第６図、第７図は多
重化されたデータを示す図、第８図は従来の多重化伝送
方式を採用した伝送システムのブロック図、第９図は従
来の多重化伝送方式により多重化されたデータを示す図
である。 １０１．１０２・・・多重分離化部 １０３・・・高速回線 １０４．１０４１０４ １・ １１２２゜ １２・３＝”” １１２３、・・・低速回線 １０７．１１０・・・制御部
Claims (2)
- （１）複数の低速回線からデータを受取って多重化し、
高速回線を介して伝送した後、多重化データを分離して
複数の低速回線へ分配する多重化伝送方式において、多
重化前のデータを伝送する前記低速回線から受取った所
定ビットのデータを、前記高速回線での１フレーム内に
離散させて配置し伝送することを特徴とする多重化伝送
方式。 - （２）離散の間隔を、低速回線の回線速度に基づいて決
定することを特徴とする特許請求の範囲第（１）項記載
の多重化伝送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61228226A JPH0779326B2 (ja) | 1986-09-29 | 1986-09-29 | 多重化伝送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61228226A JPH0779326B2 (ja) | 1986-09-29 | 1986-09-29 | 多重化伝送方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6384217A true JPS6384217A (ja) | 1988-04-14 |
| JPH0779326B2 JPH0779326B2 (ja) | 1995-08-23 |
Family
ID=16873147
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61228226A Expired - Fee Related JPH0779326B2 (ja) | 1986-09-29 | 1986-09-29 | 多重化伝送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0779326B2 (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS534413A (en) * | 1976-07-02 | 1978-01-17 | Hitachi Ltd | Hybrid multiplez transmission systen for broacdast lines and telephone lines |
| JPS5316519A (en) * | 1976-07-29 | 1978-02-15 | Nec Corp | Time division multiplication system and its apparatus |
-
1986
- 1986-09-29 JP JP61228226A patent/JPH0779326B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS534413A (en) * | 1976-07-02 | 1978-01-17 | Hitachi Ltd | Hybrid multiplez transmission systen for broacdast lines and telephone lines |
| JPS5316519A (en) * | 1976-07-29 | 1978-02-15 | Nec Corp | Time division multiplication system and its apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0779326B2 (ja) | 1995-08-23 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |