JPS6378249A - コンピユ−タのメモリアドレス拡張方式 - Google Patents
コンピユ−タのメモリアドレス拡張方式Info
- Publication number
- JPS6378249A JPS6378249A JP22432686A JP22432686A JPS6378249A JP S6378249 A JPS6378249 A JP S6378249A JP 22432686 A JP22432686 A JP 22432686A JP 22432686 A JP22432686 A JP 22432686A JP S6378249 A JPS6378249 A JP S6378249A
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- JP
- Japan
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- address
- data
- memory
- register
- memory address
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- Pending
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- 238000000034 method Methods 0.000 claims description 4
- 230000007423 decrease Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000004575 stone Substances 0.000 description 1
Landscapes
- Executing Machine-Instructions (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明はコンピュータのメモリアドレス拡張に係り、特
に処理能力を低下させることなく、メモリのアドレス拡
張を可能とする方式に関する。
に処理能力を低下させることなく、メモリのアドレス拡
張を可能とする方式に関する。
(従来の技術)
現在実用化されているマイクロコンピュータは、取り扱
うデータのピント数が4ビツトから8ビツト、16ビツ
ト、さらに32ビツトへと増加しているが、これに伴い
処理能力が向」ニすると共にメモリアドレス空間も拡張
されている。
うデータのピント数が4ビツトから8ビツト、16ビツ
ト、さらに32ビツトへと増加しているが、これに伴い
処理能力が向」ニすると共にメモリアドレス空間も拡張
されている。
(発明が解決しようとする問題点)
上記従来例のようにピントの増加によりメモリアドレス
空間を拡張すると、ビット増加に伴いシステム規模が膨
大となるだけでなく、処理速度が必ずしも向上しない。
空間を拡張すると、ビット増加に伴いシステム規模が膨
大となるだけでなく、処理速度が必ずしも向上しない。
このため、メモリアドレス空間拡張のためだけに、16
ビツトや32ビツトマシンを適用することはできない。
ビツトや32ビツトマシンを適用することはできない。
そこで、データのビットを増加せずに、アドレスのビッ
トのみ増加させることが考えられる。しかし、ただ単純
に増加させると、処理能力が低下する。
トのみ増加させることが考えられる。しかし、ただ単純
に増加させると、処理能力が低下する。
今、8ビツトのデータを取り扱う8ビツトマシンを例に
説明すると、命令語によりメモリアドレスを指示する時
には、8ピントの整数倍により指示すると、最も効率的
に指示できるため、一般的には、8X2=16ビツトで
メモリアドレスを指示して、64にバイトのメモリ空間
を直接指示する。
説明すると、命令語によりメモリアドレスを指示する時
には、8ピントの整数倍により指示すると、最も効率的
に指示できるため、一般的には、8X2=16ビツトで
メモリアドレスを指示して、64にバイトのメモリ空間
を直接指示する。
このアドレスをプログラムにより直接指示するために2
バイトのデータを必要とするが、メモリ空・間を、アド
レスのビット増加により拡張する場合には、上記アドレ
ス指示データを2バイトで指示できなくなり、この増加
分だけ命令語長が長くなり、処理能力が低下する。
バイトのデータを必要とするが、メモリ空・間を、アド
レスのビット増加により拡張する場合には、上記アドレ
ス指示データを2バイトで指示できなくなり、この増加
分だけ命令語長が長くなり、処理能力が低下する。
(問題点を解決するための手段)
上記問題点は、データの8ビツトに対応して。
下位アドレスを命令語により」6ビツトで指示し、アド
レス拡張のための上位アドレスを、マイクロコンピュー
タ内のアドレス拡張用のレジスタにより指示するものと
し、この上位アドレスを上記アドレス拡張用レジスタに
データを格納する命令語を有する。又、上記の上位アド
レス拡張用レジスタを複数とし、上記レジスタ群を選択
使用する命令語体系を有することで解決される。
レス拡張のための上位アドレスを、マイクロコンピュー
タ内のアドレス拡張用のレジスタにより指示するものと
し、この上位アドレスを上記アドレス拡張用レジスタに
データを格納する命令語を有する。又、上記の上位アド
レス拡張用レジスタを複数とし、上記レジスタ群を選択
使用する命令語体系を有することで解決される。
(作用)
」二記のように、上位アドレス指示のためのレジスタ群
と、これにデータを格納するための命令語と、これらを
使用してデータのメモリへのリード、フェッチ又はライ
トを可能とする命令語体系を有することにより、上位ア
ドレスをプログラムにより直接指示しないため」1位ア
ドレスがプログラムデータに含まれず、プログラムバイ
ト数を増加せずにメモリアドレス拡張が可能となるだけ
でなく、例えば、あるデータを読みだして他のアドレス
に格納する場合に、」1記レジスタが1個ならば一々レ
ジスタを書き替える必要があるが、複数個を有すること
により、データをリードする時に成る上位アドレス拡張
用レジスタにより上位アドレスを指示してリードし、ラ
イトする時には他の上位アドレス拡張用レジスタにより
アドレスを指示してライトするようプログラミングすれ
ば、上位アドレス拡張用レジスタのデータを書き替えろ
頻度を少なくすることができ、効率的に命令を実行する
マイクロコンピュータを実現することができる。
と、これにデータを格納するための命令語と、これらを
使用してデータのメモリへのリード、フェッチ又はライ
トを可能とする命令語体系を有することにより、上位ア
ドレスをプログラムにより直接指示しないため」1位ア
ドレスがプログラムデータに含まれず、プログラムバイ
ト数を増加せずにメモリアドレス拡張が可能となるだけ
でなく、例えば、あるデータを読みだして他のアドレス
に格納する場合に、」1記レジスタが1個ならば一々レ
ジスタを書き替える必要があるが、複数個を有すること
により、データをリードする時に成る上位アドレス拡張
用レジスタにより上位アドレスを指示してリードし、ラ
イトする時には他の上位アドレス拡張用レジスタにより
アドレスを指示してライトするようプログラミングすれ
ば、上位アドレス拡張用レジスタのデータを書き替えろ
頻度を少なくすることができ、効率的に命令を実行する
マイクロコンピュータを実現することができる。
(実施例)
以ド、第1図により本特許の実施例を説明する。
なお、本実施例では、8ピツ1へマシンを例に、説明す
るものとする。
るものとする。
本実施例では、データアドレス拡張用第ルジスタ2.デ
ータアドレス拡張用第2レジスタ4.プロゲラ11アド
レス拡張用レジスタ6、スタックアドレス拡張用レジス
タ8のレジスタを有し、各レジスタは4ビツトから構成
される。 データアドレス拡張用第1.第2レジスタ2
〜4は、コンピュータがデータをリード又はライトする
メモリの1−位アドレスを指示し、プロゲラ11アドレ
ス拡張用レジスタ6は、命令語をメモリからフェッチす
る時の1−位アドレスを指示し、スタックアドレス拡張
用レジスタ8は、スタックポインタの上位アドレスを指
示する。これに対し、下位アドレスは16ビツトから構
成され、データアドレスの下位アドレスを、第】〜nレ
ジスタ10〜1−2により。
ータアドレス拡張用第2レジスタ4.プロゲラ11アド
レス拡張用レジスタ6、スタックアドレス拡張用レジス
タ8のレジスタを有し、各レジスタは4ビツトから構成
される。 データアドレス拡張用第1.第2レジスタ2
〜4は、コンピュータがデータをリード又はライトする
メモリの1−位アドレスを指示し、プロゲラ11アドレ
ス拡張用レジスタ6は、命令語をメモリからフェッチす
る時の1−位アドレスを指示し、スタックアドレス拡張
用レジスタ8は、スタックポインタの上位アドレスを指
示する。これに対し、下位アドレスは16ビツトから構
成され、データアドレスの下位アドレスを、第】〜nレ
ジスタ10〜1−2により。
プログラムの下位アドレスを、プログラムカウンタ14
により、スタックアドレスの下位アドレスを、スタック
ポインタ16により指示する。各々の上位アドレスは上
位メモリアドレス指示部18から、下位アドレスは下位
メモリアドレス指示部20から、コンピュータ外部に出
力される。これら上位、下位アドレス合わせて20ビツ
トにより1Mバイトのメモリ空間をアクセスすることが
できる。ただし、1Mバイトを連続してアクセスするこ
とはできず、連続では64にバイトまでであり、上位ア
ドレスレジスタを書き替えることにより、64KX16
=IMバイトのメモリをアクセスすることができる。こ
れを、第2図に図示する。
により、スタックアドレスの下位アドレスを、スタック
ポインタ16により指示する。各々の上位アドレスは上
位メモリアドレス指示部18から、下位アドレスは下位
メモリアドレス指示部20から、コンピュータ外部に出
力される。これら上位、下位アドレス合わせて20ビツ
トにより1Mバイトのメモリ空間をアクセスすることが
できる。ただし、1Mバイトを連続してアクセスするこ
とはできず、連続では64にバイトまでであり、上位ア
ドレスレジスタを書き替えることにより、64KX16
=IMバイトのメモリをアクセスすることができる。こ
れを、第2図に図示する。
次に、本実施例で追加された命令語について説明する。
各上位アドレスは、
命令語
MOVE Seg、n (Data>16により指
示できるものとする。なお、Seg、nのnは、指示し
たい拡張用レジスタを示す。
示できるものとする。なお、Seg、nのnは、指示し
たい拡張用レジスタを示す。
データをメモリからリードするには、
命令語
MOVE I Re g、 n M (Ad d、
>13又は。
>13又は。
MOVE2 Reg、n M (Add、 )13
によるものとする。MOVE の次に示された1゜2
の数字は、データアドレス拡張用レジスタの第1又は2
のどちらにより上位アドレスを指示するかを示す。又、
M(Add、>13の(Add、石は、プログラムによ
り指示される下位アドレスを示す。
によるものとする。MOVE の次に示された1゜2
の数字は、データアドレス拡張用レジスタの第1又は2
のどちらにより上位アドレスを指示するかを示す。又、
M(Add、>13の(Add、石は、プログラムによ
り指示される下位アドレスを示す。
又、Reg、nは、メモリからリードしたデータをRe
g、nに格納することを示す9 同様に、データをメモリにライトするには、命令語 MOVEI M (Add、 崩 Reg、n又は、 MOVE2 M (Add、)E Rag、nによ
るものとする。
g、nに格納することを示す9 同様に、データをメモリにライトするには、命令語 MOVEI M (Add、 崩 Reg、n又は、 MOVE2 M (Add、)E Rag、nによ
るものとする。
次に、具体的なプログラミング例を示す。
1 ; MOVE Seg、1 (0)
+62; MOVE Seg、2 (F)
e3 ; MOVEI Reg、I M
(OL23)B4; MOVE2 M(45
67)E Reg、1上記は、メモリアドレス(00
123))3に格納されているデータを、コンピュータ
内部のRe g。
+62; MOVE Seg、2 (F)
e3 ; MOVEI Reg、I M
(OL23)B4; MOVE2 M(45
67)E Reg、1上記は、メモリアドレス(00
123))3に格納されているデータを、コンピュータ
内部のRe g。
1を経由して、メモリアドレス(F4567)+6に転
送するプログラムである。このように、上位アドレス(
0石のデータを上位アドレス(F )+6に転送するの
に、これ以降データアドレス拡張用レジスタを書き替え
る必要がない、しかし、データアドレス拡張用レジスタ
が1個の場合、上記のように64にバイトを越えてデー
タを転送するには、−々データアドレス拡張用レジスタ
を書き替える必要がある。
送するプログラムである。このように、上位アドレス(
0石のデータを上位アドレス(F )+6に転送するの
に、これ以降データアドレス拡張用レジスタを書き替え
る必要がない、しかし、データアドレス拡張用レジスタ
が1個の場合、上記のように64にバイトを越えてデー
タを転送するには、−々データアドレス拡張用レジスタ
を書き替える必要がある。
又、プログラムアドレス拡張用レジスタ6およびスタッ
クアドレス拡張用レジスタ8を、上記の命令語 MOV
E Seg、n (Data)16により指示する
ことで、データアドレスと同様にアドレスを拡張するこ
とができる。
クアドレス拡張用レジスタ8を、上記の命令語 MOV
E Seg、n (Data)16により指示する
ことで、データアドレスと同様にアドレスを拡張するこ
とができる。
(発明の効果)
本発明によれば、コンピュータの処理能力を低下させる
ことなく、効率的に命令を実行するコンピュータのメモ
リアドレス拡張方式を実現できる効果がある。
ことなく、効率的に命令を実行するコンピュータのメモ
リアドレス拡張方式を実現できる効果がある。
4 図面の説明
第1図は、本発明によるコンピュータの構成概要を示す
。
。
第2図は、実施例によるメモリアドレス拡張の詳細を示
すメモリマツプ図である。
すメモリマツプ図である。
Claims (1)
- メモリからデータおよび命令語をリード、フェッチ又は
ライトするための入出力部と上記メモリのリード、フェ
ッチ又はライトするためのアドレスを指示するメモリア
ドレス指示部とメモリよりフェッチした命令語を解析す
る命令解析部と命令処理部より成るコンピュータにおい
て、メモリアドレス拡張用の複数のレジスタ群と上記メ
モリアドレス拡張用レジスタ群にデータを格納する手段
と上記レジスタ群から特定のレジスタを選択使用して上
位アドレスを指示する命令語体系とこれに対応して拡張
メモリアドレスを指示する指示部を設たことを特徴とす
る、コンピュータのメモリアドレス拡張方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22432686A JPS6378249A (ja) | 1986-09-22 | 1986-09-22 | コンピユ−タのメモリアドレス拡張方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22432686A JPS6378249A (ja) | 1986-09-22 | 1986-09-22 | コンピユ−タのメモリアドレス拡張方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6378249A true JPS6378249A (ja) | 1988-04-08 |
Family
ID=16812000
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22432686A Pending JPS6378249A (ja) | 1986-09-22 | 1986-09-22 | コンピユ−タのメモリアドレス拡張方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6378249A (ja) |
-
1986
- 1986-09-22 JP JP22432686A patent/JPS6378249A/ja active Pending
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