JPS6356689A - ビットマップメモリの書込み制御方法 - Google Patents
ビットマップメモリの書込み制御方法Info
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- JPS6356689A JPS6356689A JP61201956A JP20195686A JPS6356689A JP S6356689 A JPS6356689 A JP S6356689A JP 61201956 A JP61201956 A JP 61201956A JP 20195686 A JP20195686 A JP 20195686A JP S6356689 A JPS6356689 A JP S6356689A
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- Japan
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- control information
- control
- pattern
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- 230000015654 memory Effects 0.000 title claims description 23
- 238000000034 method Methods 0.000 claims description 10
- 230000006870 function Effects 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 8
- CETPSERCERDGAM-UHFFFAOYSA-N ceric oxide Chemical compound O=[Ce]=O CETPSERCERDGAM-UHFFFAOYSA-N 0.000 description 4
- 229910000422 cerium(IV) oxide Inorganic materials 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
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- Digital Computer Display Output (AREA)
- Document Processing Apparatus (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔目次〕
概要
産業上の利用分野
従来の技術
発明が解決しようとする問題点
問題点を解決するための手段（第１図）作用
実施例
（ａ）一実施例の説明（第２図、第３図、第４図、第５
図） （ｂ）他の実施例の説明 発明の効果 〔概要〕 制御情報により制御部がパターン格納部をアクセスし、
パターンを取出し、ビットマツプメモリに書込むビット
マツプメモリの書込み制御方式において、該制御部に制
御情報が無動作を意味するか否かの判定機能を設けるこ
とによって、無動作を意味する制御情報に対するパター
ン格納部へのアクセスを実行しないようにして、書込み
処理速度を向上させるものである。
図） （ｂ）他の実施例の説明 発明の効果 〔概要〕 制御情報により制御部がパターン格納部をアクセスし、
パターンを取出し、ビットマツプメモリに書込むビット
マツプメモリの書込み制御方式において、該制御部に制
御情報が無動作を意味するか否かの判定機能を設けるこ
とによって、無動作を意味する制御情報に対するパター
ン格納部へのアクセスを実行しないようにして、書込み
処理速度を向上させるものである。
本発明は、プリンタやディスプレイ等のパターン格納の
ために用いられるビットマツプメモリにパターンを書込
むための書込み制御方式に関し、特に高速に書込み処理
しうるビットマツプメモリの書込み制御方式に関する。
ために用いられるビットマツプメモリにパターンを書込
むための書込み制御方式に関し、特に高速に書込み処理
しうるビットマツプメモリの書込み制御方式に関する。
プリンタやディスプレイの１画素（１ドツト）に１ビツ
トを対応させたビットマツプメモリが広く用いられてい
る。
トを対応させたビットマツプメモリが広く用いられてい
る。
ビットマツプメモリは、パターンを自由にメモリ上で展
開でき、ウィンド機能を容易に実現でき、しかもプリン
タ、ディスプレイが非同期でビットマツプメモリをアク
セスし、印刷、表示でき、高機能化に都合がよい。
開でき、ウィンド機能を容易に実現でき、しかもプリン
タ、ディスプレイが非同期でビットマツプメモリをアク
セスし、印刷、表示でき、高機能化に都合がよい。
このようなビットマツプメモリにおいては、表示又は印
刷形態の多様化の要求と、パターンの展開に対し高速度
が求められている。
刷形態の多様化の要求と、パターンの展開に対し高速度
が求められている。
第６図は従来技術の説明図である。
図中、１は制御情報格納部であり、書込むべきパターン
の制御情報が格納されているもの、２は制御部であり、
パターン書込み処理を行うもの、３はパターン格納部で
あり、文字等のパターンを格納してお（もの、４はビッ
トマツプメモリであり、パターンが書込まれるもの、５
はプロセッサであり、全体制御のためのもの、６はバス
であり、これらを接続するものである。
の制御情報が格納されているもの、２は制御部であり、
パターン書込み処理を行うもの、３はパターン格納部で
あり、文字等のパターンを格納してお（もの、４はビッ
トマツプメモリであり、パターンが書込まれるもの、５
はプロセッサであり、全体制御のためのもの、６はバス
であり、これらを接続するものである。
図示しないホストコンピュータから送られてきた表示又
は印刷のための制御情報はプロセッサ（以下ＭＰＵと称
す）５の制御の元に制御情報格納部（以下ＣＭと称す）
１に格納される。この制御情報には文字コード等が含ま
れ、制御部（以下Ｃ’ＧＣと称す）２は、ＣＭＩの制御
情報を第６図（Ａ）の如く読出し、解析し、次に第６図
（Ｂ）の如く制御情報によりパターン格納部（以下ＣＧ
と称す）３をアクセスし、対応するパターンを引出す。
は印刷のための制御情報はプロセッサ（以下ＭＰＵと称
す）５の制御の元に制御情報格納部（以下ＣＭと称す）
１に格納される。この制御情報には文字コード等が含ま
れ、制御部（以下Ｃ’ＧＣと称す）２は、ＣＭＩの制御
情報を第６図（Ａ）の如く読出し、解析し、次に第６図
（Ｂ）の如く制御情報によりパターン格納部（以下ＣＧ
と称す）３をアクセスし、対応するパターンを引出す。
引出されたパターンはＣＧＣ２によって、第６図（Ｃ）
に示す如く制御情報に指示されたビットマツプメモリ
（以下ＢＭＭと称す）４に書込まれ、これによって１文
字分の書込みが終了する。
に示す如く制御情報に指示されたビットマツプメモリ
（以下ＢＭＭと称す）４に書込まれ、これによって１文
字分の書込みが終了する。
ＣＧＣ２はこの動作を繰返し、８ＭＭ４にホストコンピ
ュータの指示したパターンの書込みを行う。
ュータの指示したパターンの書込みを行う。
このようなホストコンピュータからの制御情報は、近年
の文書のデータベース化に伴い、ホストコンピュータは
真単位でデータを格納していることから、頁単位の領域
のデータを全て′送信してくる。
の文書のデータベース化に伴い、ホストコンピュータは
真単位でデータを格納していることから、頁単位の領域
のデータを全て′送信してくる。
このため、制御情報は、１頁分の全てのデータを含み、
空白に対応するものもコード化してＣＭｌに格納され、
ＣＧＣ２は、制御情報を差別することなく、前述の動作
を行っていた。
空白に対応するものもコード化してＣＭｌに格納され、
ＣＧＣ２は、制御情報を差別することなく、前述の動作
を行っていた。
特に、文書においては、比較的空白部が多く、ホストコ
ンピュータがこれらを含めて１１分のデータとして送信
してくることから、ＣＭＩには１頁分の全領域の制御情
報が格納され、ＣＧＣ２は書込み処理の共通化のため、
制御情報に対し同一の処理を実行し、結果的に空白とな
る制御情報に対しても、通常の文字の制御情報と同一の
処理を行う。
ンピュータがこれらを含めて１１分のデータとして送信
してくることから、ＣＭＩには１頁分の全領域の制御情
報が格納され、ＣＧＣ２は書込み処理の共通化のため、
制御情報に対し同一の処理を実行し、結果的に空白とな
る制御情報に対しても、通常の文字の制御情報と同一の
処理を行う。
このため、８ＭＭ４に空白を書込むという無駄な動作を
行っており、１頁分の書込み時間に無駄が多く、書込み
処理時間が長くなるという問題が生じていた。
行っており、１頁分の書込み時間に無駄が多く、書込み
処理時間が長くなるという問題が生じていた。
本発明は、ビットマツプメモリへのパターン書込み時間
を短縮し、高速書込みの可能なビットマツプメモリの書
込み制御方式を提供することを目的とする。
を短縮し、高速書込みの可能なビットマツプメモリの書
込み制御方式を提供することを目的とする。
第１図は本発明の原理説明図である。
図中、第６図で示したものと同一のものは同一の記号で
示してあり、２ａは判定機能を示し、ＣｅＯ２に設けら
れ、ＣＭＩの制御情報が無動作を意味するものか否かを
判定するためのものであり、無動作と判定すると、制御
情報によるＣＧ３へのアクセスを実行しないようにする
ためのものである。
示してあり、２ａは判定機能を示し、ＣｅＯ２に設けら
れ、ＣＭＩの制御情報が無動作を意味するものか否かを
判定するためのものであり、無動作と判定すると、制御
情報によるＣＧ３へのアクセスを実行しないようにする
ためのものである。
本発明では、ＣｅＯ２の判定機能２ａによって、ＣｅＯ
２が無動作を意味する制御情報を認識でき、ＣＧ３への
アクセスを行わず、直ちにＣＭＩの次の制御情報の処理
に移行できる。
２が無動作を意味する制御情報を認識でき、ＣＧ３への
アクセスを行わず、直ちにＣＭＩの次の制御情報の処理
に移行できる。
従って、ＣＭＩに格納された制御情報列に対する８ＭＭ
４へのパターン書込み処理時間を短縮することができる
。
４へのパターン書込み処理時間を短縮することができる
。
（ａ）一実施例の説明
第２図は本発明の一実施例構成図である。
図中、第１図及び第６図で示したものと同一のものは同
一の記号で示してあり、７はインターフェイス部であり
、ホストコンピュータとデータ、コマンドのやりとりを
行うもの、２０はプロセッサであり、例えば、ビットス
ライスプロセッサで構成され、前述の判定機能２ａを含
む書込み処理をプログラムの実行によって行うもの、２
１はリードオンリーメモリ （以下ＲＯＭと称す）であ
り、プロセッサ２０の動作に必要なプログラム、パラメ
ータを格納しておくものである。
一の記号で示してあり、７はインターフェイス部であり
、ホストコンピュータとデータ、コマンドのやりとりを
行うもの、２０はプロセッサであり、例えば、ビットス
ライスプロセッサで構成され、前述の判定機能２ａを含
む書込み処理をプログラムの実行によって行うもの、２
１はリードオンリーメモリ （以下ＲＯＭと称す）であ
り、プロセッサ２０の動作に必要なプログラム、パラメ
ータを格納しておくものである。
ここで、ＭＰＵ５はホストからのデータを第４図に示す
フローで制御情報に変換してＣＭＩに書込み、８ＭＭ４
の内容はプリンタ又はディスプレイに与えられ、表示又
は印刷に供される。
フローで制御情報に変換してＣＭＩに書込み、８ＭＭ４
の内容はプリンタ又はディスプレイに与えられ、表示又
は印刷に供される。
第３図は制御情報の説明図、第４図は制御情報作成フロ
ー図である。
ー図である。
ホストコンピュータからのデータは、例えば１行分をと
り出すと、第３図（Ａ）の如く、文字コードｒＡＪ、ｒ
ＢＪ、ｒＣＪ、ｒ Ｄ Ｊ −と、空白部のスペースコ
ード「Ｓ」と、改行コマンドで示されており、その他に
改頁コマンドがある。
り出すと、第３図（Ａ）の如く、文字コードｒＡＪ、ｒ
ＢＪ、ｒＣＪ、ｒ Ｄ Ｊ −と、空白部のスペースコ
ード「Ｓ」と、改行コマンドで示されており、その他に
改頁コマンドがある。
インターフェイス部７に与えられたホストコンピュータ
からのデータはバス６を介しＭＰＵ５に与えられ、ＭＰ
Ｕ５の入力がバッファに蓄えられる。
からのデータはバス６を介しＭＰＵ５に与えられ、ＭＰ
Ｕ５の入力がバッファに蓄えられる。
ＭＰＵ５は、入カバソファのホストデータを読出し、文
字コードがスペースコードかを判定する。
字コードがスペースコードかを判定する。
スペースコードであれば第３図（Ｂ）の制御フラグをオ
ンとし、無動作を指示し、スペースコードでなければ第
３図（Ｂ）の制御フラグをオフにする。
ンとし、無動作を指示し、スペースコードでなければ第
３図（Ｂ）の制御フラグをオフにする。
即ち、書込み不要のものが予め判っているものには無動
作を示すデータを付与する。
作を示すデータを付与する。
この例では、制御情報は、第３図（Ｂ）の如く、制御フ
ラグと、文字コードのＣＧａ上のアドレスと、Ｂ Ｍ
Ｍ ４の書込みアドレス、回転等の編集指定で構成され
る。
ラグと、文字コードのＣＧａ上のアドレスと、Ｂ Ｍ
Ｍ ４の書込みアドレス、回転等の編集指定で構成され
る。
ＭＰＵ５は読出した内容が文字コード（スペースコード
を含む）であれば、図示しないアドレス変換テーブルを
用いてＣＧ３の文字コードに対応するパターンの格納ア
ドレス等を引き出し、ＣＧアドレスとしてセットし、８
ＭＭ４への書込みアドレスは、ホストからの何行目のデ
ータでその行の何番目のデータであるかによって演算に
よって求め、８ＭＭ書込みアドレスとしてセントし、更
に回転等の指定があれば、これを編集指定としてセット
し、第３図（Ｂ）の制御情報を編集する。
を含む）であれば、図示しないアドレス変換テーブルを
用いてＣＧ３の文字コードに対応するパターンの格納ア
ドレス等を引き出し、ＣＧアドレスとしてセットし、８
ＭＭ４への書込みアドレスは、ホストからの何行目のデ
ータでその行の何番目のデータであるかによって演算に
よって求め、８ＭＭ書込みアドレスとしてセントし、更
に回転等の指定があれば、これを編集指定としてセット
し、第３図（Ｂ）の制御情報を編集する。
これをＣＭＩへ書込み、同様に次のデータを編集する。
このようにして、ＭＰＵ５はホストからの１頁分のデー
タの全てを編集し、ＣＭＩに制御情報を書込む。
タの全てを編集し、ＣＭＩに制御情報を書込む。
第５図はＣｅＯ２の書込み処理フロー図である。
■ ＣｅＯ２では、ＭＰＵ２０が、ＣＭＬに書込まれた
制御情報列の先頭から制御情報を読出す。
制御情報列の先頭から制御情報を読出す。
■ ＭＰＵ２０は、読出した制御情報の制御フラグを調
べ、制御フラグがオンであれば、空白書込みであるから
、無動作指示として、ステップ■に戻り、次の制御情報
を続出す。
べ、制御フラグがオンであれば、空白書込みであるから
、無動作指示として、ステップ■に戻り、次の制御情報
を続出す。
■ ＭＰＵ２０は、制御フラグがオフであれば、制御情
報の内容を解析する。
報の内容を解析する。
■ そして、ＭＰＵ２０は、制御情報のＣＧアドレスに
よってバス６を介しＣＧ３をアクセスし、対応するパタ
ーンを読出す。
よってバス６を介しＣＧ３をアクセスし、対応するパタ
ーンを読出す。
ＭＰＵ２０は１扁集指定で回転等が指定されていれば、
読出したパターンを指定された編集処理する。
読出したパターンを指定された編集処理する。
■ 次に、ＭＰＵ２０は、こパターンを制御情報の８Ｍ
Ｍ書込みアドレスに従い、バス６を介し８ＭＭ４に書込
み、ステップ■に戻る。
Ｍ書込みアドレスに従い、バス６を介し８ＭＭ４に書込
み、ステップ■に戻る。
ＭＰＵ２０は読出した制御情報中にｒＥＮＤＪ（終了コ
マンド）が存在することを検出するまで、これを繰返し
、指示されたパターンを８ＭＭ４へ書込む。
マンド）が存在することを検出するまで、これを繰返し
、指示されたパターンを８ＭＭ４へ書込む。
このようにして空白となる書込みを防止し、ビットマツ
プメモリ４への書込みを高速化する。
プメモリ４への書込みを高速化する。
又、内容解析前に制御フラグで無動作を認識できるので
、内容解析も省略できる。
、内容解析も省略できる。
（ｂ）他の実施例の説明
上述の実施例では、制御フラグを用いて無動作を認識し
ているが、これを用いず、ＣＧアドレスを用いて無動作
を認識するようにしてもよ（、制御情報も第３図のもの
に限られない。
ているが、これを用いず、ＣＧアドレスを用いて無動作
を認識するようにしてもよ（、制御情報も第３図のもの
に限られない。
文字コードは、漢字コード、記号、図形等のものであっ
てもよい。
てもよい。
以上本発明を実施例により説明したが、本発明は本発明
の主旨に従い種々の変形が可能であり、本発明からこれ
らを排除するものではない。
の主旨に従い種々の変形が可能であり、本発明からこれ
らを排除するものではない。
以上説明した様に、本発明によれば１．結果的に空白書
込みとなる動作を防止することができ、ピントマツプメ
モリへの書込み速度が向上するという効果を奏し、多様
化するビットマツプメモリへの書込みの高速化が図れ、
高速グリンタやディスプレイの待ち時間を短縮すること
に寄与する。
込みとなる動作を防止することができ、ピントマツプメ
モリへの書込み速度が向上するという効果を奏し、多様
化するビットマツプメモリへの書込みの高速化が図れ、
高速グリンタやディスプレイの待ち時間を短縮すること
に寄与する。
第１図は本発明の原理説明図、
第２図は本発明の一実施例構成図、
第３図は本発明の一実施例制御情報説明図、第４図は第
２図における制御情報作成フロー図、第５図は第２図に
おける書込み処理フロー図、第６図は従来技術の説明図
である。 図中、１− 制御情報格納部、 ２− 制御部、 ３− パターン格納部、 ４−・ ビットマツプメモリ。
２図における制御情報作成フロー図、第５図は第２図に
おける書込み処理フロー図、第６図は従来技術の説明図
である。 図中、１− 制御情報格納部、 ２− 制御部、 ３− パターン格納部、 ４−・ ビットマツプメモリ。
Claims (1)
- 【特許請求の範囲】 制御情報を格納する制御情報格納部（１）と、パターン
を格納するパターン格納部（３）と、パターンが書込ま
れるビットマップメモリ（４）と、制御部（２）とを有
し、 該制御部（２）が該制御情報格納部（１）の制御情報を
読出し、該制御情報により該パターン格納部（３）をア
クセスし、対応するパターンを取り出し、該ビットマッ
プメモリ（４）に書込むビットマップメモリの書込み制
御方式において、該制御部（２）に該制御情報が無動作
を意味するものであるか否かの判定機能を設け、 該制御部（２）が読出した制御情報が無動作を意味する
ものと判定した場合に、該制御情報による該パターン格
納部（３）へのアクセスを実行しないようにしたことを 特徴とするビットマップメモリの書込み制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61201956A JPH0740181B2 (ja) | 1986-08-28 | 1986-08-28 | ビットマップメモリの書込み制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61201956A JPH0740181B2 (ja) | 1986-08-28 | 1986-08-28 | ビットマップメモリの書込み制御方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6356689A true JPS6356689A (ja) | 1988-03-11 |
| JPH0740181B2 JPH0740181B2 (ja) | 1995-05-01 |
Family
ID=16449553
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61201956A Expired - Fee Related JPH0740181B2 (ja) | 1986-08-28 | 1986-08-28 | ビットマップメモリの書込み制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0740181B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0675962A (ja) * | 1992-05-01 | 1994-03-18 | Internatl Business Mach Corp <Ibm> | 空マルチメディアデータオブジェクトの自動検出／処理方法及び装置 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5997187A (ja) * | 1982-11-27 | 1984-06-04 | カシオ計算機株式会社 | スペ−スキヤラクタ表示方式 |
| JPS59223833A (ja) * | 1983-06-01 | 1984-12-15 | Mitsubishi Electric Corp | 空白編集回路 |
| JPS61114295A (ja) * | 1984-11-09 | 1986-05-31 | 日本電気株式会社 | 文字・図形表示方法 |
| JPS62202748A (ja) * | 1986-03-04 | 1987-09-07 | Canon Inc | 文書処理装置 |
-
1986
- 1986-08-28 JP JP61201956A patent/JPH0740181B2/ja not_active Expired - Fee Related
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5997187A (ja) * | 1982-11-27 | 1984-06-04 | カシオ計算機株式会社 | スペ−スキヤラクタ表示方式 |
| JPS59223833A (ja) * | 1983-06-01 | 1984-12-15 | Mitsubishi Electric Corp | 空白編集回路 |
| JPS61114295A (ja) * | 1984-11-09 | 1986-05-31 | 日本電気株式会社 | 文字・図形表示方法 |
| JPS62202748A (ja) * | 1986-03-04 | 1987-09-07 | Canon Inc | 文書処理装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0675962A (ja) * | 1992-05-01 | 1994-03-18 | Internatl Business Mach Corp <Ibm> | 空マルチメディアデータオブジェクトの自動検出／処理方法及び装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0740181B2 (ja) | 1995-05-01 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |