JPS6333829A - 半導体ウエ−ハを修復する方法 - Google Patents
半導体ウエ−ハを修復する方法Info
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- 238000000034 method Methods 0.000 title claims description 32
- 239000004065 semiconductor Substances 0.000 title claims description 25
- 238000004151 rapid thermal annealing Methods 0.000 claims description 35
- 238000001312 dry etching Methods 0.000 claims description 18
- 238000005530 etching Methods 0.000 claims description 14
- 239000012535 impurity Substances 0.000 claims description 11
- 239000013078 crystal Substances 0.000 claims description 8
- 235000012431 wafers Nutrition 0.000 description 95
- 239000010410 layer Substances 0.000 description 46
- 238000001020 plasma etching Methods 0.000 description 43
- 229910052710 silicon Inorganic materials 0.000 description 22
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 21
- 239000010703 silicon Substances 0.000 description 21
- 238000004140 cleaning Methods 0.000 description 13
- 239000007789 gas Substances 0.000 description 13
- 230000008569 process Effects 0.000 description 11
- 238000004380 ashing Methods 0.000 description 9
- 239000000203 mixture Substances 0.000 description 9
- 238000002128 reflection high energy electron diffraction Methods 0.000 description 9
- 238000000137 annealing Methods 0.000 description 7
- 238000002474 experimental method Methods 0.000 description 7
- 239000000463 material Substances 0.000 description 7
- 239000002253 acid Substances 0.000 description 6
- 238000005259 measurement Methods 0.000 description 6
- 238000012545 processing Methods 0.000 description 5
- 238000011109 contamination Methods 0.000 description 4
- 229910052760 oxygen Inorganic materials 0.000 description 4
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 4
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 3
- 230000004888 barrier function Effects 0.000 description 3
- 230000015572 biosynthetic process Effects 0.000 description 3
- 125000005843 halogen group Chemical group 0.000 description 3
- 150000002500 ions Chemical class 0.000 description 3
- 229910052751 metal Inorganic materials 0.000 description 3
- 239000002184 metal Substances 0.000 description 3
- 150000002739 metals Chemical class 0.000 description 3
- 239000001301 oxygen Substances 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- 239000004215 Carbon black (E152) Substances 0.000 description 2
- ZAMOUSCENKQFHK-UHFFFAOYSA-N Chlorine atom Chemical compound [Cl] ZAMOUSCENKQFHK-UHFFFAOYSA-N 0.000 description 2
- 229910052799 carbon Inorganic materials 0.000 description 2
- 239000003795 chemical substances by application Substances 0.000 description 2
- 229910052801 chlorine Inorganic materials 0.000 description 2
- 239000000460 chlorine Substances 0.000 description 2
- 230000007547 defect Effects 0.000 description 2
- 238000009792 diffusion process Methods 0.000 description 2
- 238000000572 ellipsometry Methods 0.000 description 2
- 238000005247 gettering Methods 0.000 description 2
- 229910052736 halogen Inorganic materials 0.000 description 2
- 150000002367 halogens Chemical class 0.000 description 2
- 229930195733 hydrocarbon Natural products 0.000 description 2
- 150000002430 hydrocarbons Chemical class 0.000 description 2
- 238000007654 immersion Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 230000003647 oxidation Effects 0.000 description 2
- 238000007254 oxidation reaction Methods 0.000 description 2
- 230000008439 repair process Effects 0.000 description 2
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 2
- 229910052721 tungsten Inorganic materials 0.000 description 2
- 239000010937 tungsten Substances 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Chemical compound O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- DASQIKOOFDJYKA-UHFFFAOYSA-N CCIF Chemical compound CCIF DASQIKOOFDJYKA-UHFFFAOYSA-N 0.000 description 1
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- PXGOKWXKJXAPGV-UHFFFAOYSA-N Fluorine Chemical compound FF PXGOKWXKJXAPGV-UHFFFAOYSA-N 0.000 description 1
- GRYLNZFGIOXLOG-UHFFFAOYSA-N Nitric acid Chemical compound O[N+]([O-])=O GRYLNZFGIOXLOG-UHFFFAOYSA-N 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 239000000356 contaminant Substances 0.000 description 1
- 239000008367 deionised water Substances 0.000 description 1
- 229910021641 deionized water Inorganic materials 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 230000001627 detrimental effect Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 239000006185 dispersion Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 229910052731 fluorine Inorganic materials 0.000 description 1
- 239000011737 fluorine Substances 0.000 description 1
- 125000001153 fluoro group Chemical group F* 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 238000000097 high energy electron diffraction Methods 0.000 description 1
- 238000010849 ion bombardment Methods 0.000 description 1
- 229910017604 nitric acid Inorganic materials 0.000 description 1
- 239000012299 nitrogen atmosphere Substances 0.000 description 1
- 230000035515 penetration Effects 0.000 description 1
- 229920006254 polymer film Polymers 0.000 description 1
- 238000012805 post-processing Methods 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 238000011160 research Methods 0.000 description 1
- 238000000682 scanning probe acoustic microscopy Methods 0.000 description 1
- 238000002791 soaking Methods 0.000 description 1
- 230000002269 spontaneous effect Effects 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
- 230000001629 suppression Effects 0.000 description 1
- 239000002344 surface layer Substances 0.000 description 1
- 238000004381 surface treatment Methods 0.000 description 1
- 229910001868 water Inorganic materials 0.000 description 1
- 238000003631 wet chemical etching Methods 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02041—Cleaning
- H01L21/02057—Cleaning during device manufacture
- H01L21/0206—Cleaning during device manufacture during, before or after processing of insulating layers
- H01L21/02063—Cleaning during device manufacture during, before or after processing of insulating layers the processing being the formation of vias or contact holes
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
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- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
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- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
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- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
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- H01L21/31105—Etching inorganic layers
- H01L21/31111—Etching inorganic layers by chemical means
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
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- H01L21/31111—Etching inorganic layers by chemical means
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- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
A、産業上の利用分野
この発明は乾式エツチングに関するものであり。
特に、乾式エツチング処理後のウェーハの特性を回復さ
せる方法に関するものである。
せる方法に関するものである。
B、従来技術
乾式エツチング、特に反応性イオン・エツチングは、半
導体工業における微小な装置の製造の主要な処理工程と
なっている。残念なことに、乾式エツチングを行うと、
エネルギーの大きいイオンの衝突および残渣のよる汚染
のため、エツチングされる半導体の表面特性が変化する
ことが知られている。
導体工業における微小な装置の製造の主要な処理工程と
なっている。残念なことに、乾式エツチングを行うと、
エネルギーの大きいイオンの衝突および残渣のよる汚染
のため、エツチングされる半導体の表面特性が変化する
ことが知られている。
反応性イオン・エツチングを行った半導体ウェーハの表
面に、ある種のRIE処理中に生じる化学反応の結果、
異物残渣の層が形成されることが研究により明らかにな
った。
面に、ある種のRIE処理中に生じる化学反応の結果、
異物残渣の層が形成されることが研究により明らかにな
った。
最近の研究によれば、反応性イオン・エツチングを行っ
た半導性ウェーハの表層下の表層近くに転位、空格子点
、格子間型等の結晶欠陥を有する損傷層があり、エツチ
ング材料等の不純物を含有することもある、ということ
が、明らかになった。
た半導性ウェーハの表層下の表層近くに転位、空格子点
、格子間型等の結晶欠陥を有する損傷層があり、エツチ
ング材料等の不純物を含有することもある、ということ
が、明らかになった。
この層の深さは、使用するイオンのエネルギーによって
、数十ないし数百オングストロームの範囲である。RI
E後の洗浄により、この損傷した層を完全に回復させ、
または除去しないと、装置の性質に有害な影響を及ぼす
ことがある。02プラズマ・アッシング等、標準的な後
洗浄法はこのような結晶の損傷を除去するには効果的で
はない。
、数十ないし数百オングストロームの範囲である。RI
E後の洗浄により、この損傷した層を完全に回復させ、
または除去しないと、装置の性質に有害な影響を及ぼす
ことがある。02プラズマ・アッシング等、標準的な後
洗浄法はこのような結晶の損傷を除去するには効果的で
はない。
犠牲的酸化物皮膜の成長または半導体材料の湿式化学エ
ツチングにより、この損傷した領域を除去することが可
能である。しかし、これらの方法によりこの損傷した領
域を除去することは、材料の除去が現在の装置のミクロ
ンまたはサブミクロンの寸法に適合しないため、不適当
である。半導体ウェーハを高温の炉でアニーリングして
RIEによる結晶の損傷を修正する代替の方法も、原子
の拡散が著しくなる傾向があるため、適当ではない。
ツチングにより、この損傷した領域を除去することが可
能である。しかし、これらの方法によりこの損傷した領
域を除去することは、材料の除去が現在の装置のミクロ
ンまたはサブミクロンの寸法に適合しないため、不適当
である。半導体ウェーハを高温の炉でアニーリングして
RIEによる結晶の損傷を修正する代替の方法も、原子
の拡散が著しくなる傾向があるため、適当ではない。
このような高温拡散は、現在の半導体装置に必要な幾何
学的形状を破壊する。
学的形状を破壊する。
これらの欠点をさけ、しかもRIEに露出した半導体の
表面特性を回復させる各種の方法が提案されている。た
とえば、短時間アニーリング法がRansomらにより
、第5回国際プラズマ処理シンポジウム(the Fi
fth International Symposi
um onPlasma Processing) 、
1984年10月7〜14日で開示された。Rans
omらは、シリコン・ウェーハのCCQ F、/H,R
I E、およびCCQF。
表面特性を回復させる各種の方法が提案されている。た
とえば、短時間アニーリング法がRansomらにより
、第5回国際プラズマ処理シンポジウム(the Fi
fth International Symposi
um onPlasma Processing) 、
1984年10月7〜14日で開示された。Rans
omらは、シリコン・ウェーハのCCQ F、/H,R
I E、およびCCQF。
/H2RIEとO,−RIE/HF浸漬併用表面処理後
、950℃、1050℃、1150℃で、短時間のアニ
ーリングを用いたものである。Ransomらは、この
種の処理は、ダイオードの特性の回復には効果がないと
判断した。反対に、Fonashら(Journal
of Applied Physics 58
(2)、 15.1985年7月、p、862)は、
CCQ、、 −RIEにより損傷したシリコンの表面特
性の部分的に回復させるため、急速熱アニーリング法に
成功している。Ran5on+らの結晶化度の回復の不
成功、および、Fonashらの結晶化度の部分的成功
を考慮して、両者の研究における急速熱アニーリングは
、実質的に残渣または皮膜がない半導体表面について行
われなければならないことが推測される。この点で、R
ansomらが用いた種類の塩・フッ素化炭素ガスはシ
リコン表面に、炭素、塩素およびフッ素原子を含有する
汚染皮膜を形成することが知られている。したがって、
塩・フッ素化炭素による反応性イオン・エツチングをし
だウェーハについては、RIE後に形成される炭素質の
汚染皮膜は、急速熱アニーリングを行う前に、この発明
の発明者らにより除去された。しかし、この表面回復の
方法を使用すると、このエツチングされた半導体材料上
に形成するダイオードに、予期しない大きい直列抵抗が
生じ、このため半導体の表面は完全に回復されないこと
が示された。
、950℃、1050℃、1150℃で、短時間のアニ
ーリングを用いたものである。Ransomらは、この
種の処理は、ダイオードの特性の回復には効果がないと
判断した。反対に、Fonashら(Journal
of Applied Physics 58
(2)、 15.1985年7月、p、862)は、
CCQ、、 −RIEにより損傷したシリコンの表面特
性の部分的に回復させるため、急速熱アニーリング法に
成功している。Ran5on+らの結晶化度の回復の不
成功、および、Fonashらの結晶化度の部分的成功
を考慮して、両者の研究における急速熱アニーリングは
、実質的に残渣または皮膜がない半導体表面について行
われなければならないことが推測される。この点で、R
ansomらが用いた種類の塩・フッ素化炭素ガスはシ
リコン表面に、炭素、塩素およびフッ素原子を含有する
汚染皮膜を形成することが知られている。したがって、
塩・フッ素化炭素による反応性イオン・エツチングをし
だウェーハについては、RIE後に形成される炭素質の
汚染皮膜は、急速熱アニーリングを行う前に、この発明
の発明者らにより除去された。しかし、この表面回復の
方法を使用すると、このエツチングされた半導体材料上
に形成するダイオードに、予期しない大きい直列抵抗が
生じ、このため半導体の表面は完全に回復されないこと
が示された。
C1発明が解決しようとする問題点
この発明は、上記の汚染の除去、および結晶性回復の問
題の解決を意図したものである。この発明により、CC
QF、/H,L:=よるRIE後の半導体表面を回復す
る問題が解決され、他のRIE混合気体に対し、表面特
性および結晶性回復が増強され机 り6問題点を解決するための手段 簡単にいえば、この発明は、反応性イオン・エツチング
または他の形式の乾式エツチングにより生じた結晶性の
損傷を有する単結晶半導体ウェーハを修復する方法であ
る。この方法は下記の工程からなる。
題の解決を意図したものである。この発明により、CC
QF、/H,L:=よるRIE後の半導体表面を回復す
る問題が解決され、他のRIE混合気体に対し、表面特
性および結晶性回復が増強され机 り6問題点を解決するための手段 簡単にいえば、この発明は、反応性イオン・エツチング
または他の形式の乾式エツチングにより生じた結晶性の
損傷を有する単結晶半導体ウェーハを修復する方法であ
る。この方法は下記の工程からなる。
半導体ウェーハの選択した部分に乾式エツチングを行い
、 半導体ウェーハのエツチングされた部分から乾式エツチ
ングの残渣の層をすべて除去し、エツチングされた部分
の上に酸化物の層を形成し。
、 半導体ウェーハのエツチングされた部分から乾式エツチ
ングの残渣の層をすべて除去し、エツチングされた部分
の上に酸化物の層を形成し。
ウェーハを急速熱アニーリングすることにより、酸化物
の層をわずかにウェーハ中に浸透させ、不純物をゲッタ
リングして酸化物層の下の結晶性を修復した後、 酸化物層を除去する。
の層をわずかにウェーハ中に浸透させ、不純物をゲッタ
リングして酸化物層の下の結晶性を修復した後、 酸化物層を除去する。
この発明の実施例では、乾式エツチング工程は、結晶性
のm傷を生じる化学的に活性な気体によるエツチングと
、ウェーハのエツチングされた部分上の残渣皮膜の形成
からなる。残渣の層の除去および酸化物形成工程は、ウ
ェーハを酸素アッシングして残渣の皮膜を除去する工程
である。この実施例では、急速熱アニーリング工程は、
ウェーハを900℃ないし1100℃の温度に30秒未
満加熱する工程である。この実施例における酸化物除去
工程は、単にHF浸漬または低電力乾式エツチングによ
り実施される。
のm傷を生じる化学的に活性な気体によるエツチングと
、ウェーハのエツチングされた部分上の残渣皮膜の形成
からなる。残渣の層の除去および酸化物形成工程は、ウ
ェーハを酸素アッシングして残渣の皮膜を除去する工程
である。この実施例では、急速熱アニーリング工程は、
ウェーハを900℃ないし1100℃の温度に30秒未
満加熱する工程である。この実施例における酸化物除去
工程は、単にHF浸漬または低電力乾式エツチングによ
り実施される。
E、実施例
この発明は、乾式エツチングを行った後のウェーハの結
晶性およびウェーハの電気的特性の修復を目的とするも
のである。特に、この発明は、ウェーハの表面に近い領
域における損傷部分の修復を目的とする。半導体ウェー
ハの選択した部分上に乾式エツチングを行うことにより
損傷したウェーハの表面特性の修復は、まず、ウェーハ
の選択した部分から、乾式エツチングの残渣の層、およ
び不純物をすべて除去し、その上に酸化物の層を形成さ
せた後、ウェーハを急速熱アニーリングして酸化物層を
わずかにウェーハの損傷した領域に浸透させて、不純物
を酸化物と半導体との境界面にゲッタリングさせてこの
酸化物層の下の結晶性を修復し、次にこの酸化物層をゲ
ッタリングした不純物とともに除去することにより行う
。この酸化物形成、急速熱アニーリング、および酸化物
層の除去をこの順序で行う特異な一連の工程は5表面特
性の修復にきわめて効果的であることが見出された。
晶性およびウェーハの電気的特性の修復を目的とするも
のである。特に、この発明は、ウェーハの表面に近い領
域における損傷部分の修復を目的とする。半導体ウェー
ハの選択した部分上に乾式エツチングを行うことにより
損傷したウェーハの表面特性の修復は、まず、ウェーハ
の選択した部分から、乾式エツチングの残渣の層、およ
び不純物をすべて除去し、その上に酸化物の層を形成さ
せた後、ウェーハを急速熱アニーリングして酸化物層を
わずかにウェーハの損傷した領域に浸透させて、不純物
を酸化物と半導体との境界面にゲッタリングさせてこの
酸化物層の下の結晶性を修復し、次にこの酸化物層をゲ
ッタリングした不純物とともに除去することにより行う
。この酸化物形成、急速熱アニーリング、および酸化物
層の除去をこの順序で行う特異な一連の工程は5表面特
性の修復にきわめて効果的であることが見出された。
この発明は、5in2を被覆したシリコン・ウェーハを
CCQ、F3/H,による反応性イオン・エツチングす
る実験について説明する。もちろん、この発明はシリコ
ン・ウェーハおよびこの特別なエツチング・ガス混合物
に限定されるものではなく、各種の半導体材料およびエ
ツチング・ガス混合物に広く応用することが可能である
。しかし、この発明は特にCCQ F、/H2によるエ
ツチングを行ったシリコンの表面の修復に適している。
CCQ、F3/H,による反応性イオン・エツチングす
る実験について説明する。もちろん、この発明はシリコ
ン・ウェーハおよびこの特別なエツチング・ガス混合物
に限定されるものではなく、各種の半導体材料およびエ
ツチング・ガス混合物に広く応用することが可能である
。しかし、この発明は特にCCQ F、/H2によるエ
ツチングを行ったシリコンの表面の修復に適している。
この発明を説明するのに用いる特定の実験で、c c
a F 3 / H2反応性イオン・エツチング・ガス
混合物は、S i O,とSiの相対エツチング比が8
=1になるように、1:1の比とした。この選択性の高
いCCIF、/H2によるRIEによって、RIE露出
により生ずる3つの有害な損傷または汚染層、すなわち
Si表面上の残渣層、表面近くの不純物の浸透した層、
および損傷したSiの層のすべてを形成した。
a F 3 / H2反応性イオン・エツチング・ガス
混合物は、S i O,とSiの相対エツチング比が8
=1になるように、1:1の比とした。この選択性の高
いCCIF、/H2によるRIEによって、RIE露出
により生ずる3つの有害な損傷または汚染層、すなわち
Si表面上の残渣層、表面近くの不純物の浸透した層、
および損傷したSiの層のすべてを形成した。
この実験で、5in2を被覆したシリコン・ウェーハの
cc QF、/H2エツチングは、上部電極を取外した
柔軟なダイオード形のRIE装置により行った。エツチ
ングに用いたウェーハはN型の(100)配向Siで、
抵抗率は0.8ないし2.0Ω−備である。ウェーハを
標準的な酸・塩基洗浄した後、このウェーハ上に熱酸化
物を約1850オングストロームの厚みに成長させた。
cc QF、/H2エツチングは、上部電極を取外した
柔軟なダイオード形のRIE装置により行った。エツチ
ングに用いたウェーハはN型の(100)配向Siで、
抵抗率は0.8ないし2.0Ω−備である。ウェーハを
標準的な酸・塩基洗浄した後、このウェーハ上に熱酸化
物を約1850オングストロームの厚みに成長させた。
酸化の後、酸化物皮膜を介してウェーハをCCQ F、
/H2に露出してエツチングを行った。
/H2に露出してエツチングを行った。
エツチングには下記のパラメータを用いた。ガス流量:
200SCCM、圧カニ15ミリトル、RF電力密度:
0.25W/J、全RF電カニ約1000ワット。こ
れらのパラメータにより、酸化物のエツチング速度は約
400オングストローム/分であった。Si○2皮膜の
エッチ・スルーを決定するための終点の検出は、He−
Ne(6238人)レーザ・インターフェロメータを用
いて行った。S i O2の終点を検出した後、シリコ
ン・ウェーハのCCQ F、/H2によるRIEをさら
に2.5分間続け、約50%のオーバーエツチングとし
た。
200SCCM、圧カニ15ミリトル、RF電力密度:
0.25W/J、全RF電カニ約1000ワット。こ
れらのパラメータにより、酸化物のエツチング速度は約
400オングストローム/分であった。Si○2皮膜の
エッチ・スルーを決定するための終点の検出は、He−
Ne(6238人)レーザ・インターフェロメータを用
いて行った。S i O2の終点を検出した後、シリコ
ン・ウェーハのCCQ F、/H2によるRIEをさら
に2.5分間続け、約50%のオーバーエツチングとし
た。
上記の酸化したウェーハのうちの一部はこのRIE工程
を行わず、希薄HFエツチング(H2O:HF=7:1
)を行った。この湿式エツチングを行ったウェーハは、
この実験の対照として使用した。
を行わず、希薄HFエツチング(H2O:HF=7:1
)を行った。この湿式エツチングを行ったウェーハは、
この実験の対照として使用した。
アルゴンによるスパッタ・エッチ速度を50人/分とし
たオージェ電子分光分析により、対照ウェーハの湿式エ
ツチングした表面と比較して、RIEに露出したウェー
ハの表面には、炭素質残渣の層が形成されていることが
判明した。
たオージェ電子分光分析により、対照ウェーハの湿式エ
ツチングした表面と比較して、RIEに露出したウェー
ハの表面には、炭素質残渣の層が形成されていることが
判明した。
CCQF、/H2によりオーバーエツチングした表面上
に形成したこの残渣の層は塩素およびフッ素を含有し、
厚みは約35オングストロームであると推定される。こ
の残渣層の組成は、Si約5 r+ t 。
に形成したこの残渣の層は塩素およびフッ素を含有し、
厚みは約35オングストロームであると推定される。こ
の残渣層の組成は、Si約5 r+ t 。
%、05at、%、C42at、%、F6at、%、C
Q17at、%、H25at、%である。
Q17at、%、H25at、%である。
反射高エネルギ電子回折(RHEED)パターンを、対
照およびRIEエツチングした表面を特徴づけるために
使用した。第1A図は、湿式エツチングを行った対照ウ
ェーハのn−(100)Si表面のRHEEDパターン
である。このRHEEDパターンは垂直ストリーク10
と、これから枝分れした菊池線11を示し、これは洗浄
で平滑な単結晶(100)のSiの表面を特徴づけるも
のである。第1B図は、CCQ F、/H,によるRI
Eでオーバーエツチングしたシリコン・ウェーハの表面
のRHEEDパターンである。第1B図は、炭素質の残
渣層の下に、損傷したSiが存在することを示している
。特に、第1B図に示されるリング状のパターンはSi
の(111)。
照およびRIEエツチングした表面を特徴づけるために
使用した。第1A図は、湿式エツチングを行った対照ウ
ェーハのn−(100)Si表面のRHEEDパターン
である。このRHEEDパターンは垂直ストリーク10
と、これから枝分れした菊池線11を示し、これは洗浄
で平滑な単結晶(100)のSiの表面を特徴づけるも
のである。第1B図は、CCQ F、/H,によるRI
Eでオーバーエツチングしたシリコン・ウェーハの表面
のRHEEDパターンである。第1B図は、炭素質の残
渣層の下に、損傷したSiが存在することを示している
。特に、第1B図に示されるリング状のパターンはSi
の(111)。
(220)および(311)の面からの屈折を示すもの
で、これは多結晶シリコンを示す種類のものである。第
1B図のハロー・パターン13、および背景のヘイズ1
4も、残渣の層およびおそらくはある程度非晶化Siに
よるものであろう。
で、これは多結晶シリコンを示す種類のものである。第
1B図のハロー・パターン13、および背景のヘイズ1
4も、残渣の層およびおそらくはある程度非晶化Siに
よるものであろう。
次に、標準的なハイ・バリアA u / n −S i
ショットキー・ダイオード(幅1圃、ドツトの厚み10
00オングストローム)を、対照ウェーハおよびRIE
でエツチングしたウェーハの表面上に形成させた後、洗
浄した。すべてのウェーハの裏面にアルミニウムを蒸着
させ、ウェーハとオーム接触させた。これらの各ショッ
ト・ダイオードのI−V特性を第2図に示す。説明を容
易にするため、このI−Vグラフは、フォワード・バイ
アス特性の上に各曲線のリバース・バイアス特性を重ね
合わせたものである。したがって、下の4つの曲線は反
対方向、すなわちグラフの左方に見られる曲線であるリ
バース・ダイオード特性からなる。
ショットキー・ダイオード(幅1圃、ドツトの厚み10
00オングストローム)を、対照ウェーハおよびRIE
でエツチングしたウェーハの表面上に形成させた後、洗
浄した。すべてのウェーハの裏面にアルミニウムを蒸着
させ、ウェーハとオーム接触させた。これらの各ショッ
ト・ダイオードのI−V特性を第2図に示す。説明を容
易にするため、このI−Vグラフは、フォワード・バイ
アス特性の上に各曲線のリバース・バイアス特性を重ね
合わせたものである。したがって、下の4つの曲線は反
対方向、すなわちグラフの左方に見られる曲線であるリ
バース・ダイオード特性からなる。
この図では、実線で示した曲線2OAは、対照ウェーハ
のダイオードのダイオード特性で、ウェーハ処理後に得
られ”る好ましいダイオード特性を示している。曲線2
OAは、対照ウェーハのフォーワード・ダイオード・バ
イアス曲線であり、曲線20Bは対照ウェーハのリバー
ス・バイアス特性を示す。曲線30Aは、あと処理を行
う前の、R■iに露出したシリコン・ウェーハのフォー
ワード・バイアス・ダイオード特性であり、曲線30B
は、同じ<RIEに露出したシリコン・ウェーハのリバ
ース・バイアス・ダイオード特性である。
のダイオードのダイオード特性で、ウェーハ処理後に得
られ”る好ましいダイオード特性を示している。曲線2
OAは、対照ウェーハのフォーワード・ダイオード・バ
イアス曲線であり、曲線20Bは対照ウェーハのリバー
ス・バイアス特性を示す。曲線30Aは、あと処理を行
う前の、R■iに露出したシリコン・ウェーハのフォー
ワード・バイアス・ダイオード特性であり、曲線30B
は、同じ<RIEに露出したシリコン・ウェーハのリバ
ース・バイアス・ダイオード特性である。
RIEに露出したウェーハの曲線30Aは、フォワード
I−V特性が悪く、アイデアリティ・ファクターが大き
い(n≧2.8)。対照ウェーハのフォワード電流より
下のフォワード電流の抑制は、リバース・ダイオード電
流の増大(Siの損傷による)とともに、境界層の存在
を示す。対照つ工−ハと比較してRIEに露出したウェ
ーハのフォワードI−V特性が悪いことにより、RIE
によってウェーハの接触抵抗が著しく増大することが明
らかである。このように、RIEに露出したウェーハの
リバースI−V特性30Bは、これらのダイオードを流
れる洩れ電流が、ショットキー・ダイオードのシリコン
損傷によるバリアの低下(ダイオードの損傷による正の
電荷)によって、対照ウェーハと比較して、対称的に大
きくなることを示す。したがって、RIE露出による損
傷(n型材料におけるバリアの低下)は、リバース・バ
イアス・モードにおいて支配的であり、一方CCfl
F、/H2によるRIEによって生じる絶縁体様の残渣
層が、フォワード・バイアス・モードにおいて支配的で
あることがわかる。したがって、このようなRIEに露
出したSiの表面はvLSIの製造には適さない。(こ
れらの表面はテバイスの品質ではない)。
I−V特性が悪く、アイデアリティ・ファクターが大き
い(n≧2.8)。対照ウェーハのフォワード電流より
下のフォワード電流の抑制は、リバース・ダイオード電
流の増大(Siの損傷による)とともに、境界層の存在
を示す。対照つ工−ハと比較してRIEに露出したウェ
ーハのフォワードI−V特性が悪いことにより、RIE
によってウェーハの接触抵抗が著しく増大することが明
らかである。このように、RIEに露出したウェーハの
リバースI−V特性30Bは、これらのダイオードを流
れる洩れ電流が、ショットキー・ダイオードのシリコン
損傷によるバリアの低下(ダイオードの損傷による正の
電荷)によって、対照ウェーハと比較して、対称的に大
きくなることを示す。したがって、RIE露出による損
傷(n型材料におけるバリアの低下)は、リバース・バ
イアス・モードにおいて支配的であり、一方CCfl
F、/H2によるRIEによって生じる絶縁体様の残渣
層が、フォワード・バイアス・モードにおいて支配的で
あることがわかる。したがって、このようなRIEに露
出したSiの表面はvLSIの製造には適さない。(こ
れらの表面はテバイスの品質ではない)。
前述のように、この発明は、RIEに露出したウェーハ
の表面特性および電気的性質を修復するための一連の工
程からなるものである。これらの工程は、ウェーハのエ
ツチングした部分から、乾式エツチングの残渣の層をす
べて除去し、これらのエツチングされた部分に酸化物層
を形成する工程、ウェーハを熱アニーリングして、酸化
物層をわずかにウェーハの損傷した領域に浸透させると
同時に、シリコン中の不純物を酸化物とSiとの境界面
にゲッタリングし、酸化物層の下の結晶性を修復する工
程、および損傷した領域の上部に浸透させた酸化物層を
、ゲッタリングした不純物とともに除去する工程からな
る。
の表面特性および電気的性質を修復するための一連の工
程からなるものである。これらの工程は、ウェーハのエ
ツチングした部分から、乾式エツチングの残渣の層をす
べて除去し、これらのエツチングされた部分に酸化物層
を形成する工程、ウェーハを熱アニーリングして、酸化
物層をわずかにウェーハの損傷した領域に浸透させると
同時に、シリコン中の不純物を酸化物とSiとの境界面
にゲッタリングし、酸化物層の下の結晶性を修復する工
程、および損傷した領域の上部に浸透させた酸化物層を
、ゲッタリングした不純物とともに除去する工程からな
る。
この一連の工程の第1段階は、シリコン・ウェーハのエ
ツチングされた部分からRIEの残渣層を除去し、これ
らのエツチングされた部分に酸化物を形成させることで
、多くの方法により行うことができる。ウェーハのエツ
チングした部分からRIEの残渣を除去する必要がない
場合は、標準的な酸化物形成方法を用いることができる
。このCCΩF 3 / H2によるRIEを用いる実
験では。
ツチングされた部分からRIEの残渣層を除去し、これ
らのエツチングされた部分に酸化物を形成させることで
、多くの方法により行うことができる。ウェーハのエツ
チングした部分からRIEの残渣を除去する必要がない
場合は、標準的な酸化物形成方法を用いることができる
。このCCΩF 3 / H2によるRIEを用いる実
験では。
ウェーハのエツチングした部分から炭素質の残渣を除去
すると同時に、その上に薄い酸化物の層を形成させるの
に、酸素アッシングを使用することができる。この0□
アツシングは、たとえば下記のパラメータで行うことが
できる。アッシング時間二60分、プラズマ電力=30
0ワット、ガス流量:50cc/分、ガス圧: 500
ミリトル。この工程により、ウェーハのRIEに露出し
てエツチングした部分に形成した炭素質の残渣層の大部
分が効果的に除去される。さらに、この工程により、こ
れらのエツチングされた部分上に、厚みがプラズマ露出
パラメータにより、数十オンゲス1−ローム台の酸化物
層が形成される。
すると同時に、その上に薄い酸化物の層を形成させるの
に、酸素アッシングを使用することができる。この0□
アツシングは、たとえば下記のパラメータで行うことが
できる。アッシング時間二60分、プラズマ電力=30
0ワット、ガス流量:50cc/分、ガス圧: 500
ミリトル。この工程により、ウェーハのRIEに露出し
てエツチングした部分に形成した炭素質の残渣層の大部
分が効果的に除去される。さらに、この工程により、こ
れらのエツチングされた部分上に、厚みがプラズマ露出
パラメータにより、数十オンゲス1−ローム台の酸化物
層が形成される。
一連の工程の次の段階は、望ましくない金属や有機物を
ウェーハのエツチングされた部分から除去する任意の洗
浄工程である。望ましくない金属や有機物を除去するた
めに使用するためには、各種の洗浄方法および洗浄溶液
がある。たとえば、この実験では、85℃のH2So4
/HNO3の洗浄液で10分間洗浄した後、120℃の
H2SO。
ウェーハのエツチングされた部分から除去する任意の洗
浄工程である。望ましくない金属や有機物を除去するた
めに使用するためには、各種の洗浄方法および洗浄溶液
がある。たとえば、この実験では、85℃のH2So4
/HNO3の洗浄液で10分間洗浄した後、120℃の
H2SO。
で20分間洗浄したが、この方法に限定するものではな
い。02アツシングを行い、酸で洗浄したRIEに露出
したウェーハのRHEEDパターンは、ウェーハの表面
から大部分の残渣層が除去されたことを示す。このRH
EEDパターンを第1C図に示す。しかし、第1C図の
ヘイズから、多結晶Siを示すリング状のパターン12
が認められる。このRHEEDパターンは、02アツシ
ングと酸洗浄とにより、単結晶の基板を覆っていた材料
の一部が除去されたことを示す。これは、菊池線の特徴
の一部が、わずかながら再生しているのが見られるため
である。また、このパターンには多結晶シリコンのリン
グ状のパターンも認められる。しかし、これらのリング
は背景のヘイズによりほとんど失われている。これらは
おそらく02アツシングにより生成した酸化物の存在に
よるものと考えられる。
い。02アツシングを行い、酸で洗浄したRIEに露出
したウェーハのRHEEDパターンは、ウェーハの表面
から大部分の残渣層が除去されたことを示す。このRH
EEDパターンを第1C図に示す。しかし、第1C図の
ヘイズから、多結晶Siを示すリング状のパターン12
が認められる。このRHEEDパターンは、02アツシ
ングと酸洗浄とにより、単結晶の基板を覆っていた材料
の一部が除去されたことを示す。これは、菊池線の特徴
の一部が、わずかながら再生しているのが見られるため
である。また、このパターンには多結晶シリコンのリン
グ状のパターンも認められる。しかし、これらのリング
は背景のヘイズによりほとんど失われている。これらは
おそらく02アツシングにより生成した酸化物の存在に
よるものと考えられる。
これらの洗浄工程に引続き、ウェーハに急速熱アニーリ
ングを行う。この急速熱アニーリングは、酸化物層を下
のシリコンの損傷した領域に、浸透させる作用を行う。
ングを行う。この急速熱アニーリングは、酸化物層を下
のシリコンの損傷した領域に、浸透させる作用を行う。
浸透の深さは、アニーリングの温度および時間によって
決まる。1100℃で10秒間アニーリングした場合、
この酸化物の深さは250人である。この急速熱アニー
リングにより、同時にシリコン中の不純物がSiと酸化
物との境界面にゲッタリングされる。最後に、この急速
熱アニーリングにより、酸化物層の下のシリンの結晶構
造が修復される。この急速熱アニーリングにも各種の方
法がある。たとえば、タングステン/ハロゲン・フラッ
シュ・ランプによるパルスを、窒素雰囲気中で30秒未
満の間与えることができる。一実施例では、このパルス
をタングステン/ハロゲン・ランプにより約10秒間与
え、ウェーハの温度を効果的に1100”Cまで上昇さ
せることができる。他のウェーハは700℃および95
0℃の温度で急速熱アニーリングした。
決まる。1100℃で10秒間アニーリングした場合、
この酸化物の深さは250人である。この急速熱アニー
リングにより、同時にシリコン中の不純物がSiと酸化
物との境界面にゲッタリングされる。最後に、この急速
熱アニーリングにより、酸化物層の下のシリンの結晶構
造が修復される。この急速熱アニーリングにも各種の方
法がある。たとえば、タングステン/ハロゲン・フラッ
シュ・ランプによるパルスを、窒素雰囲気中で30秒未
満の間与えることができる。一実施例では、このパルス
をタングステン/ハロゲン・ランプにより約10秒間与
え、ウェーハの温度を効果的に1100”Cまで上昇さ
せることができる。他のウェーハは700℃および95
0℃の温度で急速熱アニーリングした。
急速熱アニーリングを行った後のウェーハ表面から得た
RHEEDパターンを第1D図に示す。
RHEEDパターンを第1D図に示す。
この図を点検すると、背景のヘイズにより、リングがほ
とんど見えないことがわかる。単結晶の特徴は検出され
ない。これは、この酸化物が第1C図の酸化物より厚い
ことを意味する。この02アツシング、酸洗浄および急
速熱アニーリング処理を行った表面上に全接点ショット
キ・ダイオードを形成すると、第2図の曲線40Bが示
すように、電圧・電流測定により、優秀なリバースI−
■特性を示す。この電気的I−V特性は、ウェーハ表而
」二の酸化物層の下のSiは、急速熱アニーリングによ
り完全に回復したことを示唆する。しかし、曲線4OA
で示す測定したフォワード・バイアスI−V特性は、急
速熱アニーリングの前に得たフォワード・バイアス曲線
30Aに比べて、あまり改善されていない。急速熱アニ
ーリング後もフォワード・バイアス曲線が不良であるこ
とは驚異的であり、フォワード・バイアス・モードでは
直列抵抗が大きいことを示す。
とんど見えないことがわかる。単結晶の特徴は検出され
ない。これは、この酸化物が第1C図の酸化物より厚い
ことを意味する。この02アツシング、酸洗浄および急
速熱アニーリング処理を行った表面上に全接点ショット
キ・ダイオードを形成すると、第2図の曲線40Bが示
すように、電圧・電流測定により、優秀なリバースI−
■特性を示す。この電気的I−V特性は、ウェーハ表而
」二の酸化物層の下のSiは、急速熱アニーリングによ
り完全に回復したことを示唆する。しかし、曲線4OA
で示す測定したフォワード・バイアスI−V特性は、急
速熱アニーリングの前に得たフォワード・バイアス曲線
30Aに比べて、あまり改善されていない。急速熱アニ
ーリング後もフォワード・バイアス曲線が不良であるこ
とは驚異的であり、フォワード・バイアス・モードでは
直列抵抗が大きいことを示す。
この発明の最終工程は、ウェーハからの酸化物層の除去
である。これは、急速熱アニーリング時にSi中に成長
した酸化物である。このアニーリング時に、酸化物の下
の損傷したSiが再成長し、不純物がSiと酸化物との
境界面にゲッタリングされた。したがって、酸化物を除
去すると、これらのゲッタリングされた不純物も除去さ
れ、°損傷したSiは酸化物中に包含される。この酸化
物除去を行うには、多くの方法が用いられる。この発明
を説明するために用いた実験では、ウェーハを5%HF
のHF浸漬液に5秒間浸漬した後、脱イオン水ですすい
だ。この酸化物除去後、第1E図のRHEEDパターン
が得られた。このパターンは、垂直ストリークおよび菊
池線が再び現われたことを示し、洗浄で平滑なSi (
100)面を示すものである。このように、このパター
ンは第1D図に見られる多結晶シリコンが除去されたこ
とを示す。急速熱アニーリングに続いてHF浸漬を含む
上記の工程で処理した表面上に形成した金ショットキ・
ダイオード接点を介して行った電流・電圧測定により、
第2図のフォワードおよびリバース・バイアス特性曲線
50Aおよび50Bが得られる。曲線50Aは、0□ア
ツシング、酸洗浄および急速熱アニーリングを連続して
行った後のフォワード・バイアス・モードにおける大き
い直列抵抗が除去されたことを示す。要するに、曲線5
0Aおよび50Bは、対照ウェーハのI−V曲線20A
および20Bとほぼ同じであり、これにより、RIEに
露出したシリコンの表面が完全に修復されたことを示す
。
である。これは、急速熱アニーリング時にSi中に成長
した酸化物である。このアニーリング時に、酸化物の下
の損傷したSiが再成長し、不純物がSiと酸化物との
境界面にゲッタリングされた。したがって、酸化物を除
去すると、これらのゲッタリングされた不純物も除去さ
れ、°損傷したSiは酸化物中に包含される。この酸化
物除去を行うには、多くの方法が用いられる。この発明
を説明するために用いた実験では、ウェーハを5%HF
のHF浸漬液に5秒間浸漬した後、脱イオン水ですすい
だ。この酸化物除去後、第1E図のRHEEDパターン
が得られた。このパターンは、垂直ストリークおよび菊
池線が再び現われたことを示し、洗浄で平滑なSi (
100)面を示すものである。このように、このパター
ンは第1D図に見られる多結晶シリコンが除去されたこ
とを示す。急速熱アニーリングに続いてHF浸漬を含む
上記の工程で処理した表面上に形成した金ショットキ・
ダイオード接点を介して行った電流・電圧測定により、
第2図のフォワードおよびリバース・バイアス特性曲線
50Aおよび50Bが得られる。曲線50Aは、0□ア
ツシング、酸洗浄および急速熱アニーリングを連続して
行った後のフォワード・バイアス・モードにおける大き
い直列抵抗が除去されたことを示す。要するに、曲線5
0Aおよび50Bは、対照ウェーハのI−V曲線20A
および20Bとほぼ同じであり、これにより、RIEに
露出したシリコンの表面が完全に修復されたことを示す
。
上記の表面修復は、偏光解析パラメータのデルタによっ
ても示される。この測定は、自動分光偏光解析装置によ
って行われる。第3図はデルタの値をエネルギー(e
V)についてプロットしたものである。曲線60は、対
照ウェーハのデルタの測定値を示す0曲線70は、02
アツシング後、金属および有機物を除去するための酸洗
浄を行い、その後の処理をしないRIEに露出したウェ
ーハのデルタの測定値を示す。反対に、第4図はこの発
明を説明する各種のデルタをプロットしたものである。
ても示される。この測定は、自動分光偏光解析装置によ
って行われる。第3図はデルタの値をエネルギー(e
V)についてプロットしたものである。曲線60は、対
照ウェーハのデルタの測定値を示す0曲線70は、02
アツシング後、金属および有機物を除去するための酸洗
浄を行い、その後の処理をしないRIEに露出したウェ
ーハのデルタの測定値を示す。反対に、第4図はこの発
明を説明する各種のデルタをプロットしたものである。
特に、曲線60は、この図でも対照ウェーハのデルタ曲
線である。曲線80は、急速熱アニーリングを1100
℃で行い、後の酸化物除去を行わないウェーハのデルタ
値をプロットしたものである。同様に、曲線90は、1
100℃で急速熱アニーリングを行い、後の酸化物除去
を行わないウェーハのデルタ値をプロットシたものであ
る。曲線100は、1000℃で急速熱アニーリングを
行った後、酸化物除去のためHF浸漬を行ったこの発明
の全工程を行ったウェーハ・サンプルのデルタ値をプロ
ットしたものである。
線である。曲線80は、急速熱アニーリングを1100
℃で行い、後の酸化物除去を行わないウェーハのデルタ
値をプロットしたものである。同様に、曲線90は、1
100℃で急速熱アニーリングを行い、後の酸化物除去
を行わないウェーハのデルタ値をプロットシたものであ
る。曲線100は、1000℃で急速熱アニーリングを
行った後、酸化物除去のためHF浸漬を行ったこの発明
の全工程を行ったウェーハ・サンプルのデルタ値をプロ
ットしたものである。
曲線100から容易にわかるように、一連の工程の最後
に酸化物除去を行うことにより、RIEに露出したウェ
ーハのデルタ測定値は、対照ウェーへのデルタ測定値の
近くまで修復される。したがってこれらのプロットは、
RIEに露出したウェーハの表面が完全に修復されたこ
とも示す。
に酸化物除去を行うことにより、RIEに露出したウェ
ーハのデルタ測定値は、対照ウェーへのデルタ測定値の
近くまで修復される。したがってこれらのプロットは、
RIEに露出したウェーハの表面が完全に修復されたこ
とも示す。
ショットキI−V特性は、急速熱アニーリング温度の関
数として徐々に改善されることが判明した。したがって
、700℃、950℃、および1100℃の3種類の温
度では、1100℃が好ましい。しかし、RIEに露出
したウェーハの表面特性は、700℃および950℃の
急速熱アニーリング温度でも著しく改善されることがわ
かった。したがって、高温の急速熱アニーリングにより
、温度の拡散を生じるおそれのある極端に深い接合部を
有するデバイスの設計では、ウェーハの損傷したシリコ
ン領域を著しく修復するために、このような低目の温度
での急速熱アニーリングを使用することができる。しか
し一般には、急速熱アニーリング温度は、900℃ない
し1200℃の範囲で行うのが好ましい。
数として徐々に改善されることが判明した。したがって
、700℃、950℃、および1100℃の3種類の温
度では、1100℃が好ましい。しかし、RIEに露出
したウェーハの表面特性は、700℃および950℃の
急速熱アニーリング温度でも著しく改善されることがわ
かった。したがって、高温の急速熱アニーリングにより
、温度の拡散を生じるおそれのある極端に深い接合部を
有するデバイスの設計では、ウェーハの損傷したシリコ
ン領域を著しく修復するために、このような低目の温度
での急速熱アニーリングを使用することができる。しか
し一般には、急速熱アニーリング温度は、900℃ない
し1200℃の範囲で行うのが好ましい。
この発明は、酸化物バを除去する最終の工程に高温酸洗
浄およびDHF浸漬を使用することができる。この洗浄
および酸化物除去は、ウェーハ処理枝別で周知の一連の
おだやかな乾式エツチングにより実施することができる
。02アツシング後、ウェーハをそのままにして直ちに
急速熱アニーリングすることも、またはウェーハを真空
下で急速熱アニーリング装置に移送することもできる。
浄およびDHF浸漬を使用することができる。この洗浄
および酸化物除去は、ウェーハ処理枝別で周知の一連の
おだやかな乾式エツチングにより実施することができる
。02アツシング後、ウェーハをそのままにして直ちに
急速熱アニーリングすることも、またはウェーハを真空
下で急速熱アニーリング装置に移送することもできる。
この急速熱アニーリングの後、ウェーハを反応性イオン
・エツチング装置、または表面の酸化物および他の汚染
物質が、下のシリコンに対して選択的にエツチングされ
るラジカル・ビーム装置に移すこともできる。この最終
の酸化物除去にRIEを使用する場合は、低電力、高圧
でのCCQ、またはCF4等のプラズマ放電を使用する
ことができる。このような放電は、シリコンの表面に重
合体皮膜または残渣を残さないことが知られている。
・エツチング装置、または表面の酸化物および他の汚染
物質が、下のシリコンに対して選択的にエツチングされ
るラジカル・ビーム装置に移すこともできる。この最終
の酸化物除去にRIEを使用する場合は、低電力、高圧
でのCCQ、またはCF4等のプラズマ放電を使用する
ことができる。このような放電は、シリコンの表面に重
合体皮膜または残渣を残さないことが知られている。
さらに、このような低電力のRIEは、イオン・エネル
ギーを約50eV未満に維持すれば、下のシリコン表面
を著しく損傷することはない。
ギーを約50eV未満に維持すれば、下のシリコン表面
を著しく損傷することはない。
この発明を、 CCQ F、/H,のエツチング・ガス
混合物について説明した。もちろん、この発明はCF、
/H,、CHF、、その他の炭化水素、または非炭化水
素エツチング・ガス混合物を含む各種の他のエツチング
・ガス混合物に適用することができる。
混合物について説明した。もちろん、この発明はCF、
/H,、CHF、、その他の炭化水素、または非炭化水
素エツチング・ガス混合物を含む各種の他のエツチング
・ガス混合物に適用することができる。
F1発明の効果
要約すれば、この発明は、乾式エツチング(RIEに露
出したものを含む)ウェーハの表面および電気特性を、
エツチングに用いた特定のガス混合物により形成された
残渣層の有無に関係なく、完全に修復する一連の工程に
関するものである。
出したものを含む)ウェーハの表面および電気特性を、
エツチングに用いた特定のガス混合物により形成された
残渣層の有無に関係なく、完全に修復する一連の工程に
関するものである。
乾燥エツチングを行い、乾式エツチングによりウェーハ
のエツチングした部分に形成された残渣層をすべて除去
した後、ウェーハのこれらのエツチングした部分に酸化
物層を形成させることが有利であることが見出された0
次に、この酸化物層から酸素を下の損傷した半導体ウェ
ーハの表面に少量浸透させ、この拡散した酸化物層の下
の結晶性を修復するため、急速熱アニーリングを行う。
のエツチングした部分に形成された残渣層をすべて除去
した後、ウェーハのこれらのエツチングした部分に酸化
物層を形成させることが有利であることが見出された0
次に、この酸化物層から酸素を下の損傷した半導体ウェ
ーハの表面に少量浸透させ、この拡散した酸化物層の下
の結晶性を修復するため、急速熱アニーリングを行う。
この急速熱アニーリングの後、酸化物の除去する。
急速熱アニーリングの後、酸化物の除去を行うこの一連
の工程は、乾式エツチングに露出したウェーハの表面特
性を完全に回復するために不可欠であることが判明した
。
の工程は、乾式エツチングに露出したウェーハの表面特
性を完全に回復するために不可欠であることが判明した
。
第1A図ないし第1E図は、対照ウェーハおよびRIE
に露出したウェーハの表面の反射高エネルギ電子回折(
RHEED)パターンを示す写真、第2図は、CCQ
F、/H,でRIEを行ったシリコンの表面上に形成し
たショットキー・ダイオードのフォワード・バイアス(
ボルト)および電流(アンペア)の関係を示すグラフ、
第3図および第4図は、偏光解析計算におけるデルタの
測定値を、光子エネルギ(e V)に対してプロットし
た図である。 第1八ドロ 箆mlJて 笥l Cjgi バイアス(VOLT、S) 第2図 第3図 フォトン・L子ノ叶” (EV) 釘4図 手続補正書(′j5幻 昭和62年8月27日 特許庁長官 小 川 邦 夫 殿 1、事件の表示 昭和62年 特許願 第117266号2、発明の名称 半導体ウェーハを修復する方法 3、補正をする者 事件との関係 特許出願人 4、復代理人 (1)明細書の図面の簡単な説明の欄 (2)図 面 7、補正の内容 (1)明細書の第25頁第8行ないし同第10行に[第
1A図ないし第1E図は、・・・・パターンを示す写真
、」とあるのを、「第1八図ないし第1E図は、反射高
エネルギ電子線回折(RHEED]パターンによる、対
照ウェーハおよびRIEに露出したウェーハの表面の結
晶構造の写真、」と訂正する。 (2)願書に添付した第1A図ないし第1E図の図面に
代る写真を、添付の訂正された第1八図ないし第1Ef
ifflの図面に代る写真の通りに訂正する。 第1A図 訂正図面 訂正図面 訂正図面 第1D図 訂正図面 第1E図 手続補正帯(自発) 昭和62年8月27日 特許庁長官 小 川 邦 夫 殿 1、事件の表示 昭和62年 特許願 第117266号2、発明の名称 半導体ウェーハを修復する方法 3、補正をする者 事件との関係 特許出願人 4、復代理人 6、補正の対象 明細書の発明の詳細な説明の欄 7、補正の内容 (1)発明の詳細な説明の欄を次の通りに補正する。 fa)明細書第11頁第11行及び同第12行に[垂直
ス1−リーク10と5これから枝分れした菊池線11を
示し、」とあるのを、[垂直ストリークと、これから枝
分れした菊池線を示し、」と訂正する。 (b)明細書第12頁第2行及び第3行に「ハロー・パ
ターン13、および背景のヘイズ14も、」とあるのを
、[ハロー・パターン、および背景のヘイズも、」と訂
正する。 (e)明細書第16頁第20行に「リング状のパターン
12」とあるのを、 「リング状のパターン」と訂正す
る。
に露出したウェーハの表面の反射高エネルギ電子回折(
RHEED)パターンを示す写真、第2図は、CCQ
F、/H,でRIEを行ったシリコンの表面上に形成し
たショットキー・ダイオードのフォワード・バイアス(
ボルト)および電流(アンペア)の関係を示すグラフ、
第3図および第4図は、偏光解析計算におけるデルタの
測定値を、光子エネルギ(e V)に対してプロットし
た図である。 第1八ドロ 箆mlJて 笥l Cjgi バイアス(VOLT、S) 第2図 第3図 フォトン・L子ノ叶” (EV) 釘4図 手続補正書(′j5幻 昭和62年8月27日 特許庁長官 小 川 邦 夫 殿 1、事件の表示 昭和62年 特許願 第117266号2、発明の名称 半導体ウェーハを修復する方法 3、補正をする者 事件との関係 特許出願人 4、復代理人 (1)明細書の図面の簡単な説明の欄 (2)図 面 7、補正の内容 (1)明細書の第25頁第8行ないし同第10行に[第
1A図ないし第1E図は、・・・・パターンを示す写真
、」とあるのを、「第1八図ないし第1E図は、反射高
エネルギ電子線回折(RHEED]パターンによる、対
照ウェーハおよびRIEに露出したウェーハの表面の結
晶構造の写真、」と訂正する。 (2)願書に添付した第1A図ないし第1E図の図面に
代る写真を、添付の訂正された第1八図ないし第1Ef
ifflの図面に代る写真の通りに訂正する。 第1A図 訂正図面 訂正図面 訂正図面 第1D図 訂正図面 第1E図 手続補正帯(自発) 昭和62年8月27日 特許庁長官 小 川 邦 夫 殿 1、事件の表示 昭和62年 特許願 第117266号2、発明の名称 半導体ウェーハを修復する方法 3、補正をする者 事件との関係 特許出願人 4、復代理人 6、補正の対象 明細書の発明の詳細な説明の欄 7、補正の内容 (1)発明の詳細な説明の欄を次の通りに補正する。 fa)明細書第11頁第11行及び同第12行に[垂直
ス1−リーク10と5これから枝分れした菊池線11を
示し、」とあるのを、[垂直ストリークと、これから枝
分れした菊池線を示し、」と訂正する。 (b)明細書第12頁第2行及び第3行に「ハロー・パ
ターン13、および背景のヘイズ14も、」とあるのを
、[ハロー・パターン、および背景のヘイズも、」と訂
正する。 (e)明細書第16頁第20行に「リング状のパターン
12」とあるのを、 「リング状のパターン」と訂正す
る。
Claims (1)
- 【特許請求の範囲】 乾式エッチングにより生じた結晶性の損傷を有する単結
晶半導体ウェーハを修復する方法であって、 半導体ウェーハの選択された部分に乾式エッチングを行
ない、 前記半導体ウェーハのエッチングされた部分から乾式エ
ッチングの残余の層をすべて除去し、そして、前記選択
されてエッチングされた部分上に酸化物の層を形成し、 前記ウェーハを急速熱アニーリングして、前記酸化物の
層をわずかに前記ウェーハ内にドライブし、不純物をゲ
ッタリングして前記酸化物の層の下の結晶性を修復し、
そして 前記酸化物の層を除去する、 各工程を有することを特徴とする半導体ウェーハを修復
する方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US06/882,116 US4897154A (en) | 1986-07-03 | 1986-07-03 | Post dry-etch cleaning method for restoring wafer properties |
US882116 | 1986-07-03 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6333829A true JPS6333829A (ja) | 1988-02-13 |
JP2544383B2 JP2544383B2 (ja) | 1996-10-16 |
Family
ID=25379916
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62117266A Expired - Lifetime JP2544383B2 (ja) | 1986-07-03 | 1987-05-15 | 半導体ウエ−ハを修復する方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4897154A (ja) |
EP (1) | EP0252262B1 (ja) |
JP (1) | JP2544383B2 (ja) |
DE (1) | DE3782558T2 (ja) |
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JP2008251889A (ja) * | 2007-03-30 | 2008-10-16 | Seiko Epson Corp | キャパシタの製造方法 |
US8305730B2 (en) | 2007-01-15 | 2012-11-06 | Seiko Epson Corporation | Capacitor and its manufacturing method |
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-
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- 1987-05-22 EP EP87107478A patent/EP0252262B1/en not_active Expired
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