JPS63304228A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JPS63304228A JPS63304228A JP13973487A JP13973487A JPS63304228A JP S63304228 A JPS63304228 A JP S63304228A JP 13973487 A JP13973487 A JP 13973487A JP 13973487 A JP13973487 A JP 13973487A JP S63304228 A JPS63304228 A JP S63304228A
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- liquid crystal
- circuit
- crystal display
- display device
- reset circuit
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- Pending
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- 239000004973 liquid crystal related substance Substances 0.000 title claims abstract description 62
- 238000000034 method Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 230000003111 delayed effect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、液晶表示装置に関し、特に、時分割駆動方式
の液晶表示装置番;適用して有効な技術にに関するもの
である。
の液晶表示装置番;適用して有効な技術にに関するもの
である。
コンピュータ、卓上計算機等のディスプレイには1時分
割駆動力式の液晶表示装置が使用されている。この種の
液晶表示装置は、走査電極と表示電極との間に液晶分子
を封入し、走査電極及び表示電極が選択された領域の液
晶分子で点灯画素を形成するように構成されている。
割駆動力式の液晶表示装置が使用されている。この種の
液晶表示装置は、走査電極と表示電極との間に液晶分子
を封入し、走査電極及び表示電極が選択された領域の液
晶分子で点灯画素を形成するように構成されている。
前記走査電極は1行方向に延在し、列方向に複数本配置
されている。走査電極は、走査電極駆動回路に接続され
ている。走査電極駆動回路は、外付は或は内蔵されたコ
ントローラの表示開始信号に基づき、所定の走査電極を
順次選択するように構成されている。
されている。走査電極は、走査電極駆動回路に接続され
ている。走査電極駆動回路は、外付は或は内蔵されたコ
ントローラの表示開始信号に基づき、所定の走査電極を
順次選択するように構成されている。
前記表示電極は、前記走査電極と交差する行方向に延在
し1列方向に複数本配置されている0表示電極は、表示
電極駆動回路に接続されている。
し1列方向に複数本配置されている0表示電極は、表示
電極駆動回路に接続されている。
表示電極駆動回路は、前記コントローラの表示データ信
号に基づき、所定の表示電極を選択するように構成され
ている。
号に基づき、所定の表示電極を選択するように構成され
ている。
なお、時分割駆動方式の液晶表示装置については、例え
ば、日経マグロウヒル社、「日経エレクトロニクスJ、
19J10年8月18日号*pp、150〜174に記
載されている。
ば、日経マグロウヒル社、「日経エレクトロニクスJ、
19J10年8月18日号*pp、150〜174に記
載されている。
本発明者は、前述の時分割駆動方式の液晶表示装置の開
発中に1次のような問題点が生じることを見出した。前
記液晶表示装置の走査電極駆動回路にはコントローラか
らの表示開始信号が直接入力し、表示電極駆動回路には
同様にコントローラからの表示データ信号が直接入力し
ている。ところが、液晶表示装置の電源投入時からしば
らくの間、コントローラから出力される表示開始信号。
発中に1次のような問題点が生じることを見出した。前
記液晶表示装置の走査電極駆動回路にはコントローラか
らの表示開始信号が直接入力し、表示電極駆動回路には
同様にコントローラからの表示データ信号が直接入力し
ている。ところが、液晶表示装置の電源投入時からしば
らくの間、コントローラから出力される表示開始信号。
表示データ信号が不確定であるので、液晶表示が異常に
乱れる。つまり、走査電極、表示電極の夫々が不必要に
選択され、液晶層に余分な直流成分が印加される。この
ため、液晶表示素子の耐久性が劣化するという問題点を
生じる。
乱れる。つまり、走査電極、表示電極の夫々が不必要に
選択され、液晶層に余分な直流成分が印加される。この
ため、液晶表示素子の耐久性が劣化するという問題点を
生じる。
また、液晶表示装置の電源投入時からしばらくの間、液
晶表示が非常に見苦しいという問題点を生じる。
晶表示が非常に見苦しいという問題点を生じる。
本発明の目的は1時分割駆動方式の液晶表示装置におい
て、液晶表示素子の耐久性を向上することが可能な技術
を提供することにある。
て、液晶表示素子の耐久性を向上することが可能な技術
を提供することにある。
本発明の他の目的は、時分割駆動方式の液晶表示装置に
おいて、電源投入時から所定の期間、液晶表示部を表示
させないことが可能な技術を提供することにある。
おいて、電源投入時から所定の期間、液晶表示部を表示
させないことが可能な技術を提供することにある。
本発明の他の目的は1時分割駆動方式の液晶表示装置に
おいて、電源投入時から所定の期間における液晶表示の
見苦しさを低減することが可能な技術を提供することに
ある。
おいて、電源投入時から所定の期間における液晶表示の
見苦しさを低減することが可能な技術を提供することに
ある。
本発明の他の目的は、前記夫々の目的を簡単な構成によ
って達成することが可能な技術を提供することにある。
って達成することが可能な技術を提供することにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述及び添付図面によって明らかになるであろ
う。
明細書の記述及び添付図面によって明らかになるであろ
う。
本願において開示される発明のうち、代表的なものの概
要を簡単に説明すれば、下記のとおりである。
要を簡単に説明すれば、下記のとおりである。
時分割駆動方式の液晶表示装置において、電源投入時か
ら所定の期間、前記走査電極を全べて非選択状態にする
リセット回路を設ける。
ら所定の期間、前記走査電極を全べて非選択状態にする
リセット回路を設ける。
上述した手段によれば、電源投入時から所定の期間、液
晶層に余分な直流成分が印加されないので、液晶表示素
子の耐久性を向上することができる。
晶層に余分な直流成分が印加されないので、液晶表示素
子の耐久性を向上することができる。
また、電源投入時から所定の期間、液晶表示を行わない
ので、液晶表示の見苦しさを低減することができる。
ので、液晶表示の見苦しさを低減することができる。
以下、本発明の構成について、コンピュータや卓上計算
機で使用される時分割駆動方式の液晶表示装置に本発明
を適用した実施例とともに説明する。
機で使用される時分割駆動方式の液晶表示装置に本発明
を適用した実施例とともに説明する。
なお、実施例を説明するための全図において、同一機能
を有するものは同一符号を付け、その繰り返しの説明は
省略する。
を有するものは同一符号を付け、その繰り返しの説明は
省略する。
(実施例り
本発明の実施例■である時分割駆動方式の液晶表示装置
の概略構成を第1図(ブロック図)で示す。
の概略構成を第1図(ブロック図)で示す。
第1図に示すように、時分割駆動方式の液晶表示装置は
、走査電極2及び表示電極3で液晶表示部1を構成して
いる。走査電極2と表示部#@3との間には、配向膜を
介して、液晶分子が封入されている。
、走査電極2及び表示電極3で液晶表示部1を構成して
いる。走査電極2と表示部#@3との間には、配向膜を
介して、液晶分子が封入されている。
前記走査電極2は1行方向に延在し1列方向に複数本配
置されている。夫々の走査電極2は、走査電極駆動回路
4に接続されている。
置されている。夫々の走査電極2は、走査電極駆動回路
4に接続されている。
走査電極駆動回路4は、シフトレジスタ回路4A及びセ
レクトスイッチ回路4Bで構成されている。シフトレジ
スタ回路4Aは、コントローラ回路6から出力される表
示開始信号FLMと、この。
レクトスイッチ回路4Bで構成されている。シフトレジ
スタ回路4Aは、コントローラ回路6から出力される表
示開始信号FLMと、この。
表示開始信号FLMをシフトするクロック信号CL工と
が入力される。表示開始信号FLMは、一画面走査開始
時(第一番目の走査電極2の選択時)に、走査電極2が
ハイレベル“H”となる信号である。セレクトスイッチ
回路4Bは、複数の電源レベルを形成する電源回路7か
らの所定電圧と、交流化信号Mとが入力される。前記コ
ントローラ回路6は、通常1時分割駆動方式の液晶表示
装置に外付けされているが、それに内蔵されていてもよ
い。
が入力される。表示開始信号FLMは、一画面走査開始
時(第一番目の走査電極2の選択時)に、走査電極2が
ハイレベル“H”となる信号である。セレクトスイッチ
回路4Bは、複数の電源レベルを形成する電源回路7か
らの所定電圧と、交流化信号Mとが入力される。前記コ
ントローラ回路6は、通常1時分割駆動方式の液晶表示
装置に外付けされているが、それに内蔵されていてもよ
い。
この走査電極駆動回路4は、コントローラ回路”6の表
示開始信号FLM”H”に基づき、走査電極2を順次選
択するように構成されている。
示開始信号FLM”H”に基づき、走査電極2を順次選
択するように構成されている。
前記表示電極3は、前記走査電極2と交差する列方向に
延在し、行方向に複数本配置されている。
延在し、行方向に複数本配置されている。
表示電極3は、表示電極駆動回路5に接続されている。
表示電極駆動回路5は、シフトレジスタ回路5A、デー
タラッチ回路5B及びセレクトスイッチ回路5Cで構成
されている。シフトレジスタ回路5Aは、前記コントロ
ーラ回路6からの表示データ信号りと、この表示データ
信号りをシフトするクロック信号CL、とが入力される
0表示データ信号りは、選択される表示電極3を“H”
とし、非選択の表示電極3を“L”とする、データラッ
チ回路5Bは、走査電極駆動回路4のシフトレジスタ回
路4Aとの同期を取るため、クロック信号CL1が入力
される。セレクトスイッチ回路5Cには、電源回路7か
らの所定電圧と、交流化信号Mとが入力される。
タラッチ回路5B及びセレクトスイッチ回路5Cで構成
されている。シフトレジスタ回路5Aは、前記コントロ
ーラ回路6からの表示データ信号りと、この表示データ
信号りをシフトするクロック信号CL、とが入力される
0表示データ信号りは、選択される表示電極3を“H”
とし、非選択の表示電極3を“L”とする、データラッ
チ回路5Bは、走査電極駆動回路4のシフトレジスタ回
路4Aとの同期を取るため、クロック信号CL1が入力
される。セレクトスイッチ回路5Cには、電源回路7か
らの所定電圧と、交流化信号Mとが入力される。
この表示電極駆動回路5は、前記コントローラ回路6か
らの表示データ信号りに基づき、各表示電極3を同時に
選択あるいは非選択の状態にするように構成されている
。
らの表示データ信号りに基づき、各表示電極3を同時に
選択あるいは非選択の状態にするように構成されている
。
走査電極2、表示電極3の夫々が選択された領域の液晶
表示部は、点灯画素を形成するように構成されている。
表示部は、点灯画素を形成するように構成されている。
このように構成される時分割駆動方式の液晶表示装置は
、走査電極駆動回路4のシフトレジスタ回路4Aとコン
トローラ回路6との間に、リセット回路8が設けられて
いる。リセット回路8は。
、走査電極駆動回路4のシフトレジスタ回路4Aとコン
トローラ回路6との間に、リセット回路8が設けられて
いる。リセット回路8は。
液晶表示装置の電源投入時から所定の期間、走査な極2
を全べて非選択状態(ロウレベル“L”)にするように
構成されている。
を全べて非選択状態(ロウレベル“L”)にするように
構成されている。
リセット回路8は1図示しない電源投入スイッチを介在
させて電源Vに接続された抵抗素子R1この抵抗素子R
に直列接続された容量素子C1及び一端子にコントロー
ラ回路6からの表示開始信号FLMが直接入力し、他端
子に前記電源Vからの遅延された電源が入力するアンド
回路ANDで構成されている。アンド回路ANDの出力
は、シフトレジスタ回路4Aに入力される。つまり、リ
セット回路8は、電源を投入すると、電源Vから抵抗素
子Rを通して流れた電流によって容量素子Cが充電され
、この容量素子Cの充電後の充電レベルと表示開始信号
FLMとの論理積によって、シフトレジスタ回路4Aに
表示開始信号FLMが入力されるように構成されている
。このリセット回路8は、電源を投入後、容量素子Cが
充電されるまでの間、シフトレジスタ回路4Aにはアン
ド回路ANDから“L”を出力し、全べての走査電極2
を非選択状態にすることができる。この表示開始信号F
LMの遅延時間(電源投入時から所定の期間)は、コン
トローラ回路6からの表示データ信号り及びクロック信
号CL1.CL、が確定(安定)する時間よりも長くす
る0表示開始信号FLMの遅延時間は、前記抵抗素子R
と容量素子Cとで制御する。
させて電源Vに接続された抵抗素子R1この抵抗素子R
に直列接続された容量素子C1及び一端子にコントロー
ラ回路6からの表示開始信号FLMが直接入力し、他端
子に前記電源Vからの遅延された電源が入力するアンド
回路ANDで構成されている。アンド回路ANDの出力
は、シフトレジスタ回路4Aに入力される。つまり、リ
セット回路8は、電源を投入すると、電源Vから抵抗素
子Rを通して流れた電流によって容量素子Cが充電され
、この容量素子Cの充電後の充電レベルと表示開始信号
FLMとの論理積によって、シフトレジスタ回路4Aに
表示開始信号FLMが入力されるように構成されている
。このリセット回路8は、電源を投入後、容量素子Cが
充電されるまでの間、シフトレジスタ回路4Aにはアン
ド回路ANDから“L”を出力し、全べての走査電極2
を非選択状態にすることができる。この表示開始信号F
LMの遅延時間(電源投入時から所定の期間)は、コン
トローラ回路6からの表示データ信号り及びクロック信
号CL1.CL、が確定(安定)する時間よりも長くす
る0表示開始信号FLMの遅延時間は、前記抵抗素子R
と容量素子Cとで制御する。
このように1時分割駆動方式の液晶表示装置に。
電源投入時から所定の期間、前記走査電極2を全べて非
選択状態にするリセット回路8を設けることにより、電
源投入時から所定の期間、液晶層に余分な直流成分が印
加されないので、液晶表示素子の耐久性を向上すること
ができる。
選択状態にするリセット回路8を設けることにより、電
源投入時から所定の期間、液晶層に余分な直流成分が印
加されないので、液晶表示素子の耐久性を向上すること
ができる。
また、電源投入時から所定の期間、液晶表示部1の表示
を行わないので、液晶表示の見苦しさを低減することが
できる。
を行わないので、液晶表示の見苦しさを低減することが
できる。
また、走査電極駆動回路4とコントローラ回路6との間
にリセット回路8を設けることにより、リセット回路B
自体を簡単な構成にすることができる。液晶表示部1の
表示を行わないようにするために、電源回路7にスイッ
チ等を設けると、電源回路7そのものが複雑な構成にな
り、又表示電極駆動回路5にリセット回路を設けると1
表示データ信号りが複数の場合に複数のリセット回路が
必要となる。すなわち1本実施例の時分割駆動方式の液
晶表示装置は、1つのリセット回路8によって、電源投
入時から所定の期間、液晶表示部1の表示を行わないよ
うにすることができる。
にリセット回路8を設けることにより、リセット回路B
自体を簡単な構成にすることができる。液晶表示部1の
表示を行わないようにするために、電源回路7にスイッ
チ等を設けると、電源回路7そのものが複雑な構成にな
り、又表示電極駆動回路5にリセット回路を設けると1
表示データ信号りが複数の場合に複数のリセット回路が
必要となる。すなわち1本実施例の時分割駆動方式の液
晶表示装置は、1つのリセット回路8によって、電源投
入時から所定の期間、液晶表示部1の表示を行わないよ
うにすることができる。
(実施例■)
本実施例■は1時分割駆動方式の液晶表示装置に、前記
実施例!と異なるリセット回路−を設けた。
実施例!と異なるリセット回路−を設けた。
本発明の他の実施例である。
本発明の実施例■である時分割駆動方式の液晶表示装置
に設けられたリセット回路を第2図(回路図)で示す。
に設けられたリセット回路を第2図(回路図)で示す。
第2図に示すように1時分割駆動方式の液晶表示装置に
設けられたリセット回路8は、容量素子C1抵抗素子R
、インバータ回路INV及びアンド回路ANDで構成さ
れている。このリセット回路8は、前記実施例■と同様
に、容量素子Cの充電レベルと表示開始信号FLMとの
論理積によって、表示開始信号FLMを遅延するように
構成されている。
設けられたリセット回路8は、容量素子C1抵抗素子R
、インバータ回路INV及びアンド回路ANDで構成さ
れている。このリセット回路8は、前記実施例■と同様
に、容量素子Cの充電レベルと表示開始信号FLMとの
論理積によって、表示開始信号FLMを遅延するように
構成されている。
以上、本発明者によってなされた発明を、前記実施例に
基づき具体的に説明したが、本発明は、前記実施例に限
定されるものではなく、その要旨を逸脱しない範囲にお
いて種々変更可能であることは勿論である。
基づき具体的に説明したが、本発明は、前記実施例に限
定されるものではなく、その要旨を逸脱しない範囲にお
いて種々変更可能であることは勿論である。
本願において開示される発明のうち代表的なものによっ
て得られる効果を簡単に説明すれば、下記のとおりであ
る。
て得られる効果を簡単に説明すれば、下記のとおりであ
る。
時分割駆動方式の液晶表示装置において、液晶表示部の
液晶表示素子の耐久性を向上することができる。
液晶表示素子の耐久性を向上することができる。
第1図は、本発明の実施例Iである時分割駆動方式の液
晶表示装置の概略構成を示すブロック図。 第2図は9本発明の実施例■である時分割駆動方式の液
晶表示装置に設けられたリセット回路の回路図である。 図中、1・・・液晶表示部、2・・・走査電極、3・・
・表示電極、4・・・走査電極駆動回路、5・・・表示
電極駆動回路、6・・・コントローラ回路、8・・・リ
セット回路、■・・・電源、R・・・抵抗素子、C・・
・容量素子、AND・・・アンド回路、PLM・・・表
示開始信号である。 第7図 ?
晶表示装置の概略構成を示すブロック図。 第2図は9本発明の実施例■である時分割駆動方式の液
晶表示装置に設けられたリセット回路の回路図である。 図中、1・・・液晶表示部、2・・・走査電極、3・・
・表示電極、4・・・走査電極駆動回路、5・・・表示
電極駆動回路、6・・・コントローラ回路、8・・・リ
セット回路、■・・・電源、R・・・抵抗素子、C・・
・容量素子、AND・・・アンド回路、PLM・・・表
示開始信号である。 第7図 ?
Claims (1)
- 【特許請求の範囲】 1、走査電極を選択する走査電極駆動回路及び表示電極
を選択する表示電極駆動回路を有する時分割駆動方式の
液晶表示装置において、電源投入時から所定の期間、前
記走査電極を全べて非選択状態にするリセット回路を設
けたことを特徴とする液晶表示装置。 2、前記リセット回路は、電源投入時から所定の期間、
外部又は内部コントローラから前記走査電極駆動回路に
出力される表示開始信号をロウレベルに保持するように
構成されていることを特徴とする特許請求の範囲第1項
に記載の液晶表示装置。 3、前記リセット回路は、前記走査電極駆動回路と前記
コントローラとの間に設けられていることを特徴とする
特許請求の範囲第2項に記載の液晶表示装置。 4、前記リセット回路は、抵抗素子、容量素子及びアン
ド回路で構成されていることを特徴とする特許請求の範
囲第1項乃至第3項に記載の夫々の液晶表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13973487A JPS63304228A (ja) | 1987-06-05 | 1987-06-05 | 液晶表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13973487A JPS63304228A (ja) | 1987-06-05 | 1987-06-05 | 液晶表示装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63304228A true JPS63304228A (ja) | 1988-12-12 |
Family
ID=15252134
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13973487A Pending JPS63304228A (ja) | 1987-06-05 | 1987-06-05 | 液晶表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63304228A (ja) |
Cited By (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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WO2000021063A1 (fr) * | 1998-10-06 | 2000-04-13 | Canon Kabushiki Kaisha | Procede de commande d'affichage d'image |
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-
1987
- 1987-06-05 JP JP13973487A patent/JPS63304228A/ja active Pending
Cited By (22)
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