JPS6329850B2 - - Google Patents
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- JPS6329850B2 JPS6329850B2 JP55087000A JP8700080A JPS6329850B2 JP S6329850 B2 JPS6329850 B2 JP S6329850B2 JP 55087000 A JP55087000 A JP 55087000A JP 8700080 A JP8700080 A JP 8700080A JP S6329850 B2 JPS6329850 B2 JP S6329850B2
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- tuning
- automatic
- down counter
- circuit
- Prior art date
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Links
- 238000010408 sweeping Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 9
- 238000006243 chemical reaction Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 238000013459 approach Methods 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
- H03J7/18—Automatic scanning over a band of frequencies
- H03J7/20—Automatic scanning over a band of frequencies where the scanning is accomplished by varying the electrical characteristics of a non-mechanically adjustable element
- H03J7/28—Automatic scanning over a band of frequencies where the scanning is accomplished by varying the electrical characteristics of a non-mechanically adjustable element using counters or frequency dividers
Landscapes
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Description
【発明の詳細な説明】
本発明はテレビジヨン受像機及びFM、AMラ
ジオ受信機等に利用できる自動掃引デイジタル同
調回路に関するものである。
ジオ受信機等に利用できる自動掃引デイジタル同
調回路に関するものである。
近年、テレビジヨン受像機及びFM、AMラジ
オ受信機等において、同調回路の容量に可変容量
ダイオードを用い、これに同調電圧を加えて同調
をとる電子同調チユーナが主流となつてきたが、
可変容量ダイオードに与える同調電圧をデイジタ
ル量として処理するいわゆるボルテージ・シンセ
サイザ方式により、同調周波数を自動掃引させて
放送局をとらえる（以下「サーチ機能」という。）
ことのできる機種が出回つて来た。
オ受信機等において、同調回路の容量に可変容量
ダイオードを用い、これに同調電圧を加えて同調
をとる電子同調チユーナが主流となつてきたが、
可変容量ダイオードに与える同調電圧をデイジタ
ル量として処理するいわゆるボルテージ・シンセ
サイザ方式により、同調周波数を自動掃引させて
放送局をとらえる（以下「サーチ機能」という。）
ことのできる機種が出回つて来た。
以下、第１図に示す従来の自動掃引デイジタル
同調回路についてサーチ機能を説明する。
同調回路についてサーチ機能を説明する。
第１図において、スイツチ手段１から自動掃引
制御回路２に信号が送られ、これによつて自動掃
引制御回路２はアツプダウンカウンタ３にパルス
を供給しアツプカウントさせる。アツプダウンカ
ウンタ３のデイジタル出力はデイジタル／アナロ
グ（Ｄ／Ａ）変換器４に送られて、直流電圧に変
換され、そのアナログ出力は、電子同調チユーナ
５に印加されて同調周波数が与えられる。アツプ
ダウンカウンタ３がアツプカウントすると同調周
波数は高周波数側へ掃引される。６は自動周波数
微調整（AFC）回路である。
制御回路２に信号が送られ、これによつて自動掃
引制御回路２はアツプダウンカウンタ３にパルス
を供給しアツプカウントさせる。アツプダウンカ
ウンタ３のデイジタル出力はデイジタル／アナロ
グ（Ｄ／Ａ）変換器４に送られて、直流電圧に変
換され、そのアナログ出力は、電子同調チユーナ
５に印加されて同調周波数が与えられる。アツプ
ダウンカウンタ３がアツプカウントすると同調周
波数は高周波数側へ掃引される。６は自動周波数
微調整（AFC）回路である。
同調周波数が掃引されて放送電波の存在する付
近に来たとき掃引を停止する。第２図はこの判定
回路の一例を示す回路図、第３図ａ，ｂおよびｃ
はその動作を説明するための信号波形図である。
第２図において、１１および１２は電圧比較器、
１３は同調点近傍においてＳ字カーブの変化をす
るAFC電圧の印加端子、１４および１５はそれ
ぞれ電圧比較器１１および１２への基準電圧供給
端子、１６および１７はそれぞれの比較出力端子
である。端子１４には基準電圧V1、端子１５に
は基準電圧V2が供給され、端子１３には第３図
ａに実線で示すようなAFC電圧が印加される。
AFC電圧の基準電圧をV0とすると、V1＞V0＞V2
に選ばれている。電圧比較器１１の出力は、
AFC電圧が基準電圧V1より低いときは“Ｌ”レ
ベルとなり、AFC電圧がV1より高いときは“Ｈ”
レベルとなる。また、電圧比較器１２の出力は、
AFC電圧が基準電圧V2より高ければ“Ｌ”レベ
ル、AFC電圧がV2より低ければ“Ｈ”レベルに
なる。したがつて、AFC電圧のＳ字カーブに対
して出力端子１６および１７の出力レベルは、そ
れぞれ第３図ｂおよびｃに示すようになる。
近に来たとき掃引を停止する。第２図はこの判定
回路の一例を示す回路図、第３図ａ，ｂおよびｃ
はその動作を説明するための信号波形図である。
第２図において、１１および１２は電圧比較器、
１３は同調点近傍においてＳ字カーブの変化をす
るAFC電圧の印加端子、１４および１５はそれ
ぞれ電圧比較器１１および１２への基準電圧供給
端子、１６および１７はそれぞれの比較出力端子
である。端子１４には基準電圧V1、端子１５に
は基準電圧V2が供給され、端子１３には第３図
ａに実線で示すようなAFC電圧が印加される。
AFC電圧の基準電圧をV0とすると、V1＞V0＞V2
に選ばれている。電圧比較器１１の出力は、
AFC電圧が基準電圧V1より低いときは“Ｌ”レ
ベルとなり、AFC電圧がV1より高いときは“Ｈ”
レベルとなる。また、電圧比較器１２の出力は、
AFC電圧が基準電圧V2より高ければ“Ｌ”レベ
ル、AFC電圧がV2より低ければ“Ｈ”レベルに
なる。したがつて、AFC電圧のＳ字カーブに対
して出力端子１６および１７の出力レベルは、そ
れぞれ第３図ｂおよびｃに示すようになる。
同調周波数が高周波数側へ掃引されてAFC電
圧のＳ字カーブに近づくと、まず、図示Ａ点で出
力端子１６の出力が“Ｈ”レベルになり、続いて
図示Ｂ点で“Ｌ”レベルになる。そして更に続い
て、図示Ｄ点で出力端子１７の出力が“Ｌ”レベ
ルから“Ｈ”レベルになる。この状態を判定して
掃引を停止させれば、その時の同調周波数は
AFC電圧のＳ字カーブのＤ点近傍にすることが
できる。
圧のＳ字カーブに近づくと、まず、図示Ａ点で出
力端子１６の出力が“Ｈ”レベルになり、続いて
図示Ｂ点で“Ｌ”レベルになる。そして更に続い
て、図示Ｄ点で出力端子１７の出力が“Ｌ”レベ
ルから“Ｈ”レベルになる。この状態を判定して
掃引を停止させれば、その時の同調周波数は
AFC電圧のＳ字カーブのＤ点近傍にすることが
できる。
この後、自動周波数微調整回路６を働かせて、
同調周波数を最適同調点Ｃ点に引き込むことにな
る。第４図に自動周波数微調整回路６の具体例を
示す。
同調周波数を最適同調点Ｃ点に引き込むことにな
る。第４図に自動周波数微調整回路６の具体例を
示す。
第４図において、１８，１９はアンドゲート、
２０はパルス発生回路であり、アンドゲート１８
は、電圧比較器１１の出力端子１６の出力が
“Ｈ”レベルの時開いて、パルス発生器２０から
パルスをアツプダウンカウンタ３に印加して、ア
ツプカウントさせる。一方、アンドゲート１９
は、電圧比較器１２の出力端子１７の出力が
“Ｈ”レベルの時開いて、アツプダウンカウンタ
３にパルスを印加して、ダウンカウントさせる。
したがつて、上記自動周波数微調整回路６によれ
ば、第３図ａにおいて同調周波数がＡ点からＥ点
の間にあれば、最適同調点Ｃ点に引き込むことが
できる。
２０はパルス発生回路であり、アンドゲート１８
は、電圧比較器１１の出力端子１６の出力が
“Ｈ”レベルの時開いて、パルス発生器２０から
パルスをアツプダウンカウンタ３に印加して、ア
ツプカウントさせる。一方、アンドゲート１９
は、電圧比較器１２の出力端子１７の出力が
“Ｈ”レベルの時開いて、アツプダウンカウンタ
３にパルスを印加して、ダウンカウントさせる。
したがつて、上記自動周波数微調整回路６によれ
ば、第３図ａにおいて同調周波数がＡ点からＥ点
の間にあれば、最適同調点Ｃ点に引き込むことが
できる。
ところで、アツプダウンカウンタ３のデイジタ
ル情報をＤ／Ａ変換器４を介してアナログ量に変
換する際に時間遅れが発生する。また、同調周波
数に対するAFC電圧の応答の遅れがある。した
がつて、同調周波数を高周波数側に掃引して行き
上記のように放送電波の付近、すなわち第３図ａ
のＤ点で停止させたとき、上記時間遅れのために
アツプダウンカウンタ３のデイジタル出力は、
Ｄ／Ａ変換器４のアナログ出力に対応する値より
も上にある。このため、引き続き、自動周波数微
調整回路６を働かせる時に、Ｄ／Ａ変換器４の直
流電圧出力は高い方、すなわち高周波数側にずれ
てしまう。一般にAFC電圧のＳ字カーブにおい
てＡ点、Ｂ点間の周波数幅は広いが、Ｄ点、Ｅ点
間の周波数幅は狭い。したがつて、掃引を停止
し、自動周波数微調整回路６を働かせた時、同調
周波数がＥ点より高周波数側にずれて、Ｃ点への
引き込みができなくなる。また、これを防ぐため
に、掃引するスピードを遅くすると、全周波数範
囲を掃引するのに要する時間が長くなるという欠
点があつた。
ル情報をＤ／Ａ変換器４を介してアナログ量に変
換する際に時間遅れが発生する。また、同調周波
数に対するAFC電圧の応答の遅れがある。した
がつて、同調周波数を高周波数側に掃引して行き
上記のように放送電波の付近、すなわち第３図ａ
のＤ点で停止させたとき、上記時間遅れのために
アツプダウンカウンタ３のデイジタル出力は、
Ｄ／Ａ変換器４のアナログ出力に対応する値より
も上にある。このため、引き続き、自動周波数微
調整回路６を働かせる時に、Ｄ／Ａ変換器４の直
流電圧出力は高い方、すなわち高周波数側にずれ
てしまう。一般にAFC電圧のＳ字カーブにおい
てＡ点、Ｂ点間の周波数幅は広いが、Ｄ点、Ｅ点
間の周波数幅は狭い。したがつて、掃引を停止
し、自動周波数微調整回路６を働かせた時、同調
周波数がＥ点より高周波数側にずれて、Ｃ点への
引き込みができなくなる。また、これを防ぐため
に、掃引するスピードを遅くすると、全周波数範
囲を掃引するのに要する時間が長くなるという欠
点があつた。
本発明は、以上のような欠点に鑑みてなされた
もので、掃引スピードを遅くすることなく、確実
に最適同調周波数を見つけ出す自動掃引デイジタ
ル同調回路を提供するものである。
もので、掃引スピードを遅くすることなく、確実
に最適同調周波数を見つけ出す自動掃引デイジタ
ル同調回路を提供するものである。
第５図は本発明の一実施例を示すブロツク回路
構成図である。スイツチ手段１によつて自動掃引
制御回路２からアツプダウンカウンタ３にアツプ
パルスが送られ、アツプダウンカウンタ３はアツ
プカウントし、そのデイジタル出力はＤ／Ａ変換
器４を介して直流電圧に変換されて、チユーナ５
の可変容量ダイオードに印加されて、チユーナ５
の同調周波数は高周波数側に掃引される。同調周
波数が前述したようにAFC電圧のＳ字カーブの
Ｄ点のところに来ると、掃引を停止する。この時
アツプダウンカウンタ３のデイジタル出力はＤ／
Ａ変換の時間遅れ及びAFC電圧の応答の遅れの
ために、Ｄ点より高周波数側の点に対応する値に
なつているが、図示しない制御線により自動掃引
制御回路２からアツプダウンカウンタ３の停止信
号を受けた時ダウンパルス印加手段７はアツプダ
ウンカウンタ３にダウンパルスを送ることにより
アツプダウンカウンタ３のデイジタル出力はＡ点
からＥ点の範囲内の周波数に対応する値に減じ
る。したがつて、引き続いて働く自動周波数微調
整回路６により、同調周波数を最適同調点Ｃ点に
引き込むことができる。
構成図である。スイツチ手段１によつて自動掃引
制御回路２からアツプダウンカウンタ３にアツプ
パルスが送られ、アツプダウンカウンタ３はアツ
プカウントし、そのデイジタル出力はＤ／Ａ変換
器４を介して直流電圧に変換されて、チユーナ５
の可変容量ダイオードに印加されて、チユーナ５
の同調周波数は高周波数側に掃引される。同調周
波数が前述したようにAFC電圧のＳ字カーブの
Ｄ点のところに来ると、掃引を停止する。この時
アツプダウンカウンタ３のデイジタル出力はＤ／
Ａ変換の時間遅れ及びAFC電圧の応答の遅れの
ために、Ｄ点より高周波数側の点に対応する値に
なつているが、図示しない制御線により自動掃引
制御回路２からアツプダウンカウンタ３の停止信
号を受けた時ダウンパルス印加手段７はアツプダ
ウンカウンタ３にダウンパルスを送ることにより
アツプダウンカウンタ３のデイジタル出力はＡ点
からＥ点の範囲内の周波数に対応する値に減じ
る。したがつて、引き続いて働く自動周波数微調
整回路６により、同調周波数を最適同調点Ｃ点に
引き込むことができる。
第６図にダウンパルス印加手段７の具体例を示
す。第６図において、２１はアンドゲート、２２
はその一方の入力端子、２３はパルス発生回路で
ある。同調周波数がAFC電圧のＳ字カーブのＤ
点になると掃引は停止し、入力端子２２への入力
信号は“Ｌ”レベルから“Ｈ”レベルになる。端
子２２の電位が“Ｈ”レベルになると、パルス発
生回路２３から出力されるパルスは、アンドゲー
ト２１を介してアツプダウンカウンタ３に印加さ
れ、アツプダウンカウンタ３はダウンカウントす
る。端子２２の電位は所定の時間経過すると
“Ｈ”から“Ｌ”になり、アツプダウンカウンタ
３に印加されるダウンパルスは停止する。この
時、アツプダウンカウンタ３をダウンさせる値
は、端子２２の電位が“Ｈ”になつている時間で
制御することができ、システムの設計を行う際、
自動掃引のスピード、Ｄ／Ａ変換による時間遅
れ、及びAFC電圧の応答の遅れ等を考慮して容
易に決定することができる。
す。第６図において、２１はアンドゲート、２２
はその一方の入力端子、２３はパルス発生回路で
ある。同調周波数がAFC電圧のＳ字カーブのＤ
点になると掃引は停止し、入力端子２２への入力
信号は“Ｌ”レベルから“Ｈ”レベルになる。端
子２２の電位が“Ｈ”レベルになると、パルス発
生回路２３から出力されるパルスは、アンドゲー
ト２１を介してアツプダウンカウンタ３に印加さ
れ、アツプダウンカウンタ３はダウンカウントす
る。端子２２の電位は所定の時間経過すると
“Ｈ”から“Ｌ”になり、アツプダウンカウンタ
３に印加されるダウンパルスは停止する。この
時、アツプダウンカウンタ３をダウンさせる値
は、端子２２の電位が“Ｈ”になつている時間で
制御することができ、システムの設計を行う際、
自動掃引のスピード、Ｄ／Ａ変換による時間遅
れ、及びAFC電圧の応答の遅れ等を考慮して容
易に決定することができる。
以上のように、本発明によれば、同調周波数の
自動掃引の停止後、その掃引を少し引きもどし、
自動掃引の行き過ぎを補正するようにしたので、
同調周波数の掃引スピードを減じることなしに、
確実に放送電波をとらえ、最適同調点に引き込む
自動掃引デイジタル同調回路を構成することがで
きる。
自動掃引の停止後、その掃引を少し引きもどし、
自動掃引の行き過ぎを補正するようにしたので、
同調周波数の掃引スピードを減じることなしに、
確実に放送電波をとらえ、最適同調点に引き込む
自動掃引デイジタル同調回路を構成することがで
きる。
第１図は従来の自動掃引デイジタル同調回路を
示すブロツク構成図、第２図はこの従来例におけ
る同調周波数が放送電波周波数の近傍になつたこ
とを判定する判定回路の一例を示す回路図、第３
図ａ，ｂおよびｃはその動作を説明するための信
号波形図、第４図は上記従来例における自動周波
数微調整回路の具体例を示す回路図、第５図は本
発明の一実施例を示すブロツク回路構成図、第６
図はこの実施例におけるダウンパルス印加手段の
具体例を示す回路図である。 図において、１はスイツチ手段、２は自動掃引
制御回路、３はアツプダウンカウンタ、４はデイ
ジタル／アナログ変換器、５は電子同調チユー
ナ、６は自動周波数微調整回路、７はダウンパル
ス印加手段である。なお、図中同一符号は同一ま
たは相当部分を示す。
示すブロツク構成図、第２図はこの従来例におけ
る同調周波数が放送電波周波数の近傍になつたこ
とを判定する判定回路の一例を示す回路図、第３
図ａ，ｂおよびｃはその動作を説明するための信
号波形図、第４図は上記従来例における自動周波
数微調整回路の具体例を示す回路図、第５図は本
発明の一実施例を示すブロツク回路構成図、第６
図はこの実施例におけるダウンパルス印加手段の
具体例を示す回路図である。 図において、１はスイツチ手段、２は自動掃引
制御回路、３はアツプダウンカウンタ、４はデイ
ジタル／アナログ変換器、５は電子同調チユー
ナ、６は自動周波数微調整回路、７はダウンパル
ス印加手段である。なお、図中同一符号は同一ま
たは相当部分を示す。
Claims (1)
- １ パルス信号の供給を受けてこのパルス信号を
カウントアツプまたはカウントダウンするアツプ
ダウンカウンタ、このアツプダウンカウンタのデ
イジタル出力信号を直流電圧に変換するデイジタ
ル／アナログ変換器、上記直流電圧が同調電圧の
少なくとも一部として加えられる電子同調チユー
ナ、スイツチ手段の制御の下に上記アツプダウン
カウンタをカウントアツプさせ、上記電子同調チ
ユーナの同調周波数が所定受信周波数の近傍に達
したとき上記カウントアツプを停止させる自動掃
引制御回路、および上記アツプダウンカウンタの
カウントアツプの停止による同調周波数の自動掃
引の停止後に上記電子同調チユーナの同調周波数
を微調整して上記所定受信周波数に一致させる自
動周波数微調整回路を備えたものにおいて、上記
自動掃引制御回路による同調周波数の自動掃引の
停止信号を受けて上記アツプダウンカウンタを所
定値だけカウントダウンさせるダウンパルス印加
手段を設け、このダウンパルス印加手段による上
記アツプダウンカウンタのカウントダウン後に、
上記自動周波数微調整回路を働かせるようにした
ことを特徴とする自動掃引デイジタル同調回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8700080A JPS5710523A (en) | 1980-06-23 | 1980-06-23 | Automatic sweep digital tuning circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8700080A JPS5710523A (en) | 1980-06-23 | 1980-06-23 | Automatic sweep digital tuning circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5710523A JPS5710523A (en) | 1982-01-20 |
| JPS6329850B2 true JPS6329850B2 (ja) | 1988-06-15 |
Family
ID=13902598
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8700080A Granted JPS5710523A (en) | 1980-06-23 | 1980-06-23 | Automatic sweep digital tuning circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5710523A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0683506U (ja) * | 1993-05-17 | 1994-11-29 | 住友エール株式会社 | 電気式フォ−クリフトにおけるバッテリの安全ロック機構 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61280114A (ja) * | 1985-06-04 | 1986-12-10 | Mitsubishi Electric Corp | 自動掃引デイジタル同調回路 |
| US5348397A (en) * | 1993-03-29 | 1994-09-20 | Ferrari R Keith | Medical temperature sensing probe |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5459816A (en) * | 1977-10-21 | 1979-05-14 | Hitachi Ltd | Tuning voltage sweep circuit |
| JPS54123806A (en) * | 1978-03-17 | 1979-09-26 | Sanyo Electric Co Ltd | Digital preset tuner |
-
1980
- 1980-06-23 JP JP8700080A patent/JPS5710523A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5459816A (en) * | 1977-10-21 | 1979-05-14 | Hitachi Ltd | Tuning voltage sweep circuit |
| JPS54123806A (en) * | 1978-03-17 | 1979-09-26 | Sanyo Electric Co Ltd | Digital preset tuner |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0683506U (ja) * | 1993-05-17 | 1994-11-29 | 住友エール株式会社 | 電気式フォ−クリフトにおけるバッテリの安全ロック機構 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5710523A (en) | 1982-01-20 |
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