JPS63286713A - シンクロ・デイジタル変換装置 - Google Patents
シンクロ・デイジタル変換装置Info
- Publication number
- JPS63286713A JPS63286713A JP12340987A JP12340987A JPS63286713A JP S63286713 A JPS63286713 A JP S63286713A JP 12340987 A JP12340987 A JP 12340987A JP 12340987 A JP12340987 A JP 12340987A JP S63286713 A JPS63286713 A JP S63286713A
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- 238000006243 chemical reaction Methods 0.000 claims description 3
- 230000002441 reversible effect Effects 0.000 description 9
- 230000001360 synchronised effect Effects 0.000 description 8
- 238000010586 diagram Methods 0.000 description 6
- 230000000694 effects Effects 0.000 description 3
- 230000007423 decrease Effects 0.000 description 2
- 238000006073 displacement reaction Methods 0.000 description 2
Landscapes
- Transmission And Conversion Of Sensor Element Output (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、トラッキング型のシンクロ・ディジタル(
以下s/Dと呼ぶ)変換装置に関するものである。
以下s/Dと呼ぶ)変換装置に関するものである。
第2図は従来のトラッキング型S/D変換装置を示す構
成図である。第2図において、(9)はシンクロ発信器
又はディジタル・シンクロ変換装置からのシンクロ信号
ンレゾルバ信号に変換するスコット・トランス、(1)
はレゾルバ信号の角度の象限により・レゾルバ信号の極
性を切換えて出力する象限選択器、(2)は象限選択器
(11のsin出力を入力し、余弦の乗算を行う余弦乗
算器、(3)は象限選択回路(1)のCO5出力を入力
し、正弦の乗算を行う正弦乗算器、(4)は2つの信号
を引いて、その差暑求める引き算器、α〔は基准交流信
号7アイソレーシヨンするトランス、(5)は引き算器
(4)の出力信号の搬送波を検波・整流する位相検波器
、al)は位相検波器(51の出力信号によりクロック
信号ケ出力する電圧制御発信器、 03は電圧制御発信
器αυの出力であるクロック信号と位相検波器(51の
出力信号により、上昇又は下降する可逆カウンタである
。
成図である。第2図において、(9)はシンクロ発信器
又はディジタル・シンクロ変換装置からのシンクロ信号
ンレゾルバ信号に変換するスコット・トランス、(1)
はレゾルバ信号の角度の象限により・レゾルバ信号の極
性を切換えて出力する象限選択器、(2)は象限選択器
(11のsin出力を入力し、余弦の乗算を行う余弦乗
算器、(3)は象限選択回路(1)のCO5出力を入力
し、正弦の乗算を行う正弦乗算器、(4)は2つの信号
を引いて、その差暑求める引き算器、α〔は基准交流信
号7アイソレーシヨンするトランス、(5)は引き算器
(4)の出力信号の搬送波を検波・整流する位相検波器
、al)は位相検波器(51の出力信号によりクロック
信号ケ出力する電圧制御発信器、 03は電圧制御発信
器αυの出力であるクロック信号と位相検波器(51の
出力信号により、上昇又は下降する可逆カウンタである
。
従来のトラッキング型S/D変換装置は、第2図のよう
に構成されており、シンクロ発信器からのシンクロ信号
(イ)、(財)、Cゾはスコット・トランス(9)でレ
ゾルバ信号ヒ)、(ロ)に変換される。そのレゾルバ信
号[1,cdが象限選択器(1)において、可逆カウン
タ口zの出力(へ)の内の180度90度の重み信号に
より象限選択された信号出力(ロ)、(ホ)になる。
に構成されており、シンクロ発信器からのシンクロ信号
(イ)、(財)、Cゾはスコット・トランス(9)でレ
ゾルバ信号ヒ)、(ロ)に変換される。そのレゾルバ信
号[1,cdが象限選択器(1)において、可逆カウン
タ口zの出力(へ)の内の180度90度の重み信号に
より象限選択された信号出力(ロ)、(ホ)になる。
ここでシンクロ発信器の角度をθ、シンクロ信号の最大
振幅YK、基草基量信号)をsinωtとすると。
振幅YK、基草基量信号)をsinωtとすると。
象限選択器filの出力信号(ロ)、(ホ)はそれぞれ
(ハ)=K・sinωt1sinθ、 6t4=K +
sinωt―Cosθになる。次に信号(ロ)は余弦乗
算器(2)で余弦の掛け算が行なわね、その出力(ト1
は可逆カウンタ0zのディジタル信号の角度ンφとする
と。
(ハ)=K・sinωt1sinθ、 6t4=K +
sinωt―Cosθになる。次に信号(ロ)は余弦乗
算器(2)で余弦の掛け算が行なわね、その出力(ト1
は可逆カウンタ0zのディジタル信号の角度ンφとする
と。
(ト1=に一5inωt ・sinθ” cosφとな
る。 又信号(ホ)は正弦乗算器(3)で正弦の掛け算
が行なわれ、その出力(イ)はチ=に一5inωt −
cosθ・sinφ となる。
る。 又信号(ホ)は正弦乗算器(3)で正弦の掛け算
が行なわれ、その出力(イ)はチ=に一5inωt −
cosθ・sinφ となる。
上記信号(ト)、(イ)は次の引き算器(4)で引き算
される。
される。
この引き算器(4)の出力(ワ)は
(す)=(ト1−p自=)(*3i11ωt −si
n θ ” CO3φ−に一5inωt” cosθ
−5inφ=xのsinωt(sinθ・cosφ−c
osθ@Sinφ) 三角法の定理より (すl=に一5inωt a 5in(θ−φ)となる
。
n θ ” CO3φ−に一5inωt” cosθ
−5inφ=xのsinωt(sinθ・cosφ−c
osθ@Sinφ) 三角法の定理より (すl=に一5inωt a 5in(θ−φ)となる
。
次に位相検波器(51で信−1’; (!J)はトラン
スaGの出力信号(/−1により検波される。この検波
信号(支)は(支)二に一5in(θ−φ)となる。こ
の出力(支)は電圧制御発信器011に入力され、その
大きさに比例したクロック信号印が出力される。このク
ロック信号(力と位相検波器(5)の出力図とが可逆カ
ウンタα2に入力さね、可逆カウンタ0zが上昇又は下
降する。電圧制御発信器alま位相検波器(51の出力
(ロ)の電圧がθVすなわち(θ−φ)=0になる寸で
可逆カウンタ(13を動作させろ。この結果θ=φとな
りシンクロ発信器の角度と同じディジタル値(へ)が得
られる。このディジタル値(へ)がS /D変換装置の
出力になる。
スaGの出力信号(/−1により検波される。この検波
信号(支)は(支)二に一5in(θ−φ)となる。こ
の出力(支)は電圧制御発信器011に入力され、その
大きさに比例したクロック信号印が出力される。このク
ロック信号(力と位相検波器(5)の出力図とが可逆カ
ウンタα2に入力さね、可逆カウンタ0zが上昇又は下
降する。電圧制御発信器alま位相検波器(51の出力
(ロ)の電圧がθVすなわち(θ−φ)=0になる寸で
可逆カウンタ(13を動作させろ。この結果θ=φとな
りシンクロ発信器の角度と同じディジタル値(へ)が得
られる。このディジタル値(へ)がS /D変換装置の
出力になる。
上記のような従来のS/D変換装置においては。
位相検波器の出力電圧の大きさにかかわらず、電圧制御
発信器の出力により可逆カウンタはディジタル値馨1つ
づつ変化する。このため高速に回転するシンクロ信号に
対しては追従できないという問題点があった。
発信器の出力により可逆カウンタはディジタル値馨1つ
づつ変化する。このため高速に回転するシンクロ信号に
対しては追従できないという問題点があった。
この発明はかかる問題点を解決するためになされたもの
で1位相検波器の出力信号によシディジタル値乞変化さ
せ従来の装置よシも高速に回転するシンクロ信号に追従
させること7目的とする。
で1位相検波器の出力信号によシディジタル値乞変化さ
せ従来の装置よシも高速に回転するシンクロ信号に追従
させること7目的とする。
この発明に係るS/D変換装置は位相検波器の出力電圧
ケアナログ・ディジタル変換しディジタル値に加算して
ディジタル値を一度に複数値変化させるものである。
ケアナログ・ディジタル変換しディジタル値に加算して
ディジタル値を一度に複数値変化させるものである。
この発明においては誤差(θ−φ)に相当した値により
ディジタル値乞変化させるものである。
ディジタル値乞変化させるものである。
第1図はこの発明の一実施例乞示す図であり。
(1)〜f5+、 f91. Ql)は上記従来の装置
と全く同一のものである。(61は位相検波器(5)の
出力をアナログ信号からディジタル信号に変換するアナ
ログ・ディジタル変換器、(7)はアナログ・ディジタ
ル変換器の出力(イ)とディジタル値(へ)ケ加算する
加算器、(8)はディジタル値四を保持してお(レジス
タである。
と全く同一のものである。(61は位相検波器(5)の
出力をアナログ信号からディジタル信号に変換するアナ
ログ・ディジタル変換器、(7)はアナログ・ディジタ
ル変換器の出力(イ)とディジタル値(へ)ケ加算する
加算器、(8)はディジタル値四を保持してお(レジス
タである。
上記のように構成されたS/D変換装置においては、シ
ンクロ信号(イ)tLA(7′lの入力から位相検波器
(5)寸での動作は従来の装置と全く同一である。位相
検波器(5)の出力電圧(支)をアナログ・ディジタル
変換器(6)によりディジタル信号(イ)に変換する。
ンクロ信号(イ)tLA(7′lの入力から位相検波器
(5)寸での動作は従来の装置と全く同一である。位相
検波器(5)の出力電圧(支)をアナログ・ディジタル
変換器(6)によりディジタル信号(イ)に変換する。
このディジタル信号頭はシンクロ発振器の角変θとディ
ジタル値(へ)の角変φの差に相当する。アナログ・デ
ィジタル変換器(6)の出力とディジタル値(へ)は加
算器(7)により加算され新しいディジタル値(ヲが計
算される。外部クロック(7)により新しいディジタル
値四が更新されろ。以上の動作乞くりかえしθ=φにな
るまでディジタル値(へ)に誤差5in(θ−φ)を加
算し、シンクロ信号ンデイジタル値に変換することがで
きる。
ジタル値(へ)の角変φの差に相当する。アナログ・デ
ィジタル変換器(6)の出力とディジタル値(へ)は加
算器(7)により加算され新しいディジタル値(ヲが計
算される。外部クロック(7)により新しいディジタル
値四が更新されろ。以上の動作乞くりかえしθ=φにな
るまでディジタル値(へ)に誤差5in(θ−φ)を加
算し、シンクロ信号ンデイジタル値に変換することがで
きる。
なお上記実施例ではレジスタの出力信号(へ)kS/D
7Ij″換器の出力信号として使用したが加算器(7)
の出力信号1fi−1g使用しても同様の効果を期待で
きる。
7Ij″換器の出力信号として使用したが加算器(7)
の出力信号1fi−1g使用しても同様の効果を期待で
きる。
この発明は以上説明したとおり位相検波器(5)の出力
電圧図に相当した値によりディジタル値(へ)ン変化さ
せ、S/D変換装置の大きな追従速度を得ることができ
る。
電圧図に相当した値によりディジタル値(へ)ン変化さ
せ、S/D変換装置の大きな追従速度を得ることができ
る。
第1図はこの発明の一実施例を示す図、第2図は従来の
S/D変換装置ン示す図である。 図において、(1)は象限選択回路、(2)は余弦乗算
器、(3)は正弦乗算器、(4)は引き算器、(5)は
位相検波器、(61はアナログ・ディジタル変換器、(
7)は加算器、(81はレジスタ、(9)はスコット・
トランス。 aOはトランス、 nilは電圧制御発振器、0zは可
逆カウンタである。 なお、各図中同一符号は同一または相当部分を示す。
S/D変換装置ン示す図である。 図において、(1)は象限選択回路、(2)は余弦乗算
器、(3)は正弦乗算器、(4)は引き算器、(5)は
位相検波器、(61はアナログ・ディジタル変換器、(
7)は加算器、(81はレジスタ、(9)はスコット・
トランス。 aOはトランス、 nilは電圧制御発振器、0zは可
逆カウンタである。 なお、各図中同一符号は同一または相当部分を示す。
Claims (1)
- 3相のシンクロ信号を入力し、2相のレゾルバ信号に変
換するスコット・トランスと、2つの入力端を有し、そ
の入力端に2相のレゾルバ信号を入力し、角度の象限に
より2つの信号を出力する象限選択回路と、第1の入力
端に前記象限選択回路の2つの出力信号の一方の正弦波
の信号を入力し、第2の入力端に後述のレジスタのディ
ジタル信号を入力しディジタル信号の角度の余弦の値を
正弦波の信号に掛け算する余弦乗算器と、第1の入力端
に前記象限選択回路の2つの出力信号の一方の余弦波の
信号を入力し、第2の入力端に前記レジスタのディジタ
ル信号を入力しディジタル信号の角度の正弦の値を余弦
波の信号に掛け算する正弦乗算器と、第1の入力端に余
弦乗算器の出力を入力し、第2の入力端に正弦乗算器の
出力を入力し、2つの信号を引き算する引き算器と、第
1の入力端に前記引き算器の出力を入力し、第2の入力
端に基準信号を入力し、その基準信号により検波、整流
する位相検波器と、入力端に前記位相検波器の出力を入
力し、ディジタル信号に変換するアナログ・ディジタル
変換器と、第1の入力端に前記アナログ・ディジタル変
換器の出力を入力し、第2の入力端に前記レジスタのデ
ィジタル信号を入力し、加え合わせる加算器と、第1の
入力端にクロックを入力し、第2の入力端に上記加算器
の出力を入力し第1の入力端に与えられた信号で第2の
入力端に与えられた信号を一時保持するレジスタとを備
えたことを特徴とするシンクロ・ディジタル変換装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12340987A JPS63286713A (ja) | 1987-05-20 | 1987-05-20 | シンクロ・デイジタル変換装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12340987A JPS63286713A (ja) | 1987-05-20 | 1987-05-20 | シンクロ・デイジタル変換装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63286713A true JPS63286713A (ja) | 1988-11-24 |
Family
ID=14859841
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12340987A Pending JPS63286713A (ja) | 1987-05-20 | 1987-05-20 | シンクロ・デイジタル変換装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63286713A (ja) |
-
1987
- 1987-05-20 JP JP12340987A patent/JPS63286713A/ja active Pending
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