JPH04140925A - アナログ・ディジタル変換装置 - Google Patents
アナログ・ディジタル変換装置Info
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- JPH04140925A JPH04140925A JP26339990A JP26339990A JPH04140925A JP H04140925 A JPH04140925 A JP H04140925A JP 26339990 A JP26339990 A JP 26339990A JP 26339990 A JP26339990 A JP 26339990A JP H04140925 A JPH04140925 A JP H04140925A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
この発明はレゾルバ信号及びシンクロ信号をディジタル
値に変換する、アナログ・ディジタル変換装置に関する
ものである。
値に変換する、アナログ・ディジタル変換装置に関する
ものである。
第５図は従来のレゾルバ信号をディジタル値に変換する
トラッキング型アナログ・ディジタル変換装置を示す構
成図である。第５図において、３はレゾルバ発信器また
はディジタル・レゾルバ変換装置からのレゾルバ信号を
角度の象限により、レゾルバ信号の極性を切り換えて出
力する象限選択器、８は象限選択器３のＳＩＮ出力を入
力し、余弦の乗算を行う余弦乗算器、９は象限選択器３
のＣＯＳ出力を入力し、正弦の乗算を行う正弦乗算器、
１０は２つの信号を引いて、その差を求める引き算器、
・１１は引き算器１０の出力信号の搬送波を検波する位
相検波器、１２は位相検波器１１の出力信号によりクロ
ック信号を出力する電圧制御発信器、１）は電圧制御発
信器１２の出力信号であるクロック信号と位相検波器１
１の出力信号により、上昇または下降する可逆カウンタ
である。 従来のレゾルバ信号をディジタル信号に変換するトラッ
キング型アナログ・ディジタル変換装置は第５図のよう
に構成されており、レゾルバ発信器からのレゾルバ信号
（ニ）、（ホ）は象限選択器３において可逆カウンタ１
）の出力信号（力）の内の１８０度、９０度の重み信号
により象限選択された出力信号（へ）、 （ト）にな
る。 ここでレゾルバ発信器の角度をθ、レゾルバ信号の最大
振幅をＫ、基準信号（ソ）をＳＩＮωｔとすると、象限
選択器３の出力信号（））、（へ）はそれぞれ （ト）＝に一５ＩＮωｔ−５ＩＮθ （へ）＝に一５ＩＮωｔ−ｃｏｓθ になる０次の信号（へ）は余弦乗算器８で余弦の掛は算
が行われる。その出力（ツ）は可逆カウンタ１）のディ
ジタル信号の角度をφとすると、（’７） ＝ Ｋ −
５ＩＮａ＋ ｔ −ＳＩＮθ・ＣＯ３−となる。また信
号（ネ）は正弦乗算器９で正弦の掛は算が行われる、そ
の出力（ネ）は、（ネ）＝に一５ＩＮωｔ−ｃｏｓθ・
ＳＩＮφとなる。上記信号（ツ）、（ネ）は次の引き算
器１０で引き算される。この引き算器１０の出力信号（
す）は、 （す）＝（ツ）−（ネ） ＝に一５ＩＮωｔ−５ＩＮθ・ＣＯ８θ−Ｋ −ＳＩＮ
ωｔ−ｃｏｓθ・ＳＩＮφ＝に一５ＩＮωｔ （ＳＩ
Ｎθ・ＣＯ８φ−ＣＯ３θ ・ＳＩＮφ） 三角法の定理により （す）＝に一５ＩＮωｔ−５ＩＮ（θ−φ）となる８次
に位相検波器１１で引き算器１０の出力信号（す）は、
基準信号（ソ）により検波される。この検波信号（う）
は、 （う）−Ｍ＜・５ＩＮ（θ−φ） となる、この出力信号（つ）は電圧制御発信器Ｉ２に入
力され、その大きさに比例したクロック信号（ム）が出
力される。このクロック信号（ム）と位相検波器１１の
出力信号（う）とが可逆カウンタ１）に入力され、可逆
カウンタ１）が上昇または下降する。電圧制御発信器１
２は位相検波器１１の出力（う）の電圧がＯｖすなわち
ＳＩＮ （θ−φ）＝Ｏになるまで可逆カウンタ１）を
動作させる。この結果θ−φとなりレゾルバ発信器の角
度と同じディジタル値（力）が得られる。、二のディジ
タル値（力）がレゾルバ信号をディジタル信号に変換す
るアナログ・ディジタル変換装置の出力信号になる。 第６図は従来のシンクロ信号をディジタル値に変換１′
るト・）・７キング型アナログ・ディジタル変換装置を
示す構成図ごある。第６図におい°ζ、１はシンクロ発
信器またはディジタル・レゾルバ変換装置からのシンク
ロ信号をレゾルバ信号に変換するスコア）・・トランス
、３はレゾルバ恰゛号を角度の象限により２、レゾルバ
信号の極性を切り換えで出力する象限選択器、８は象限
選択器３のＳＩＮ出力を入力１，２、余弦の乗算を行う
余弦乗算器、９は象限選択器３のＣＯＳ出力を入力し１
、正弦の乗算を行・）正弦乗算器、１０は２つの信号を
引いで、その差を求める引き算器、１１は引き算器１０
の出力信号の搬・送波を検波する位相検波器、１２は位
相検波器１」、の出力信号によりクロック信号を出力す
る電圧制御発信器、１）は電圧制御発信器１２の出力信
号であるクロック信号と位相検波器１１の出力信号によ
り、土塀または下降する可逆カウンタ、７は基準交流信
号をアイツレ−・ジョンするトランスである。 従来のシンクロ信号をディジタル信号に変換するトラッ
キング型アナログ・ディジタル変換装置は第６図のよう
に構成されており、シンクロ発信器からのシンクロ信号
（イ）、（ロ）、（ハ）はスコツト・・トランス１でし
・ゾルバ他号（ニ）。 （ホ）に変換される。レゾルバ信号（：３ 、 （ホ）
は象限選択器３において可逆カウンタ１）の出力信号（
力）の内の１８０度、９０Ｊｆの重み信号により象限選
択された出力信′号（へ）、（Ｊ）になる。 ここでレゾルバ発信器の角度をθ、レゾルバ信号の最大
振幅をに、基準信号（ソ）をＳＩＮωｔとすると、象限
選択器３の出力信号（ト）、 （＝）はそれぞれ （ト） ＝Ｋ ＝ＳＩＮＯＪｔ −５ＩＮθ（へ）
−に−５ＩＮωｔ−ｃｏｓθ になる。次に信号（−・）は余弦乗算器８で余弦の掛は
算が行われる。その出力（ツ）は可逆カウンタ１）のデ
ィジタル信号の角度をφとすると、（ツ）＝に一５ＩＮ
ωｔ−５ＩＮθ・ＣＯ３−となる。また信号（ネ）は正
弦乗算器９は正弦の掛は算が行われる、その出力（ネ）
は、（ネ）＝に一５ＩＮωｔ−ｃｏｓθ・ＳＩＮφとな
る。上記信号（ツ）、（ネ）は次の引き算器１０で引き
算される。この引き算器１０の出力信号（す）は、 （ノー）・−（ツ）−（ネ） ＝に＝ＳＩＮωｔ−５ＩＮθ・ＣＯ３−−に−５ＩＮｏ
Ｊｔ−ＣＯＳθ−３ＩＮφ鴫−に−５ＩＮωｆｆｉ （
ＳＩＮθ・ＣＯ５φ〜ＣＯＳθ・ＳＩＮφ） 三角法の定理により （す）−に−３ＩＮωｔ、−５ＩＮ（θ−φ）となる。 次に位相検波器１１で引き算器１０の出力信号（す）は
、基準信号（ソ）により検波される。この検波信号（う
）は、 （う）＝に一３ＩＮ（θ−φ） となる、ご７の出力信号（つ）は電圧制御発信器１２に
入力され、その大きさに比例したクロック信号（ム）が
出力される。このクロック信号（ム）と位相検波器１１
の出力信号（う）とが可逆カウンタ１）に入力され、可
逆カウンタ１）が上昇または下降する。電圧制御発信器
１２は位相検波器１１の出力（う）の電圧がＯ■すなわ
ちＳＩＮ （θ−φ）＝０になるまで可逆カウンタ１）
を動作させる。この結果θ＝φとなりレゾルバ発信器の
角度と同じディジタル値（力）が得られる。このディジ
タル値（力）がシンクロ信号をディジタル信号に変換す
るアナログ・ディジタル変換装置の出力信号になる。
トラッキング型アナログ・ディジタル変換装置を示す構
成図である。第５図において、３はレゾルバ発信器また
はディジタル・レゾルバ変換装置からのレゾルバ信号を
角度の象限により、レゾルバ信号の極性を切り換えて出
力する象限選択器、８は象限選択器３のＳＩＮ出力を入
力し、余弦の乗算を行う余弦乗算器、９は象限選択器３
のＣＯＳ出力を入力し、正弦の乗算を行う正弦乗算器、
１０は２つの信号を引いて、その差を求める引き算器、
・１１は引き算器１０の出力信号の搬送波を検波する位
相検波器、１２は位相検波器１１の出力信号によりクロ
ック信号を出力する電圧制御発信器、１）は電圧制御発
信器１２の出力信号であるクロック信号と位相検波器１
１の出力信号により、上昇または下降する可逆カウンタ
である。 従来のレゾルバ信号をディジタル信号に変換するトラッ
キング型アナログ・ディジタル変換装置は第５図のよう
に構成されており、レゾルバ発信器からのレゾルバ信号
（ニ）、（ホ）は象限選択器３において可逆カウンタ１
）の出力信号（力）の内の１８０度、９０度の重み信号
により象限選択された出力信号（へ）、 （ト）にな
る。 ここでレゾルバ発信器の角度をθ、レゾルバ信号の最大
振幅をＫ、基準信号（ソ）をＳＩＮωｔとすると、象限
選択器３の出力信号（））、（へ）はそれぞれ （ト）＝に一５ＩＮωｔ−５ＩＮθ （へ）＝に一５ＩＮωｔ−ｃｏｓθ になる０次の信号（へ）は余弦乗算器８で余弦の掛は算
が行われる。その出力（ツ）は可逆カウンタ１）のディ
ジタル信号の角度をφとすると、（’７） ＝ Ｋ −
５ＩＮａ＋ ｔ −ＳＩＮθ・ＣＯ３−となる。また信
号（ネ）は正弦乗算器９で正弦の掛は算が行われる、そ
の出力（ネ）は、（ネ）＝に一５ＩＮωｔ−ｃｏｓθ・
ＳＩＮφとなる。上記信号（ツ）、（ネ）は次の引き算
器１０で引き算される。この引き算器１０の出力信号（
す）は、 （す）＝（ツ）−（ネ） ＝に一５ＩＮωｔ−５ＩＮθ・ＣＯ８θ−Ｋ −ＳＩＮ
ωｔ−ｃｏｓθ・ＳＩＮφ＝に一５ＩＮωｔ （ＳＩ
Ｎθ・ＣＯ８φ−ＣＯ３θ ・ＳＩＮφ） 三角法の定理により （す）＝に一５ＩＮωｔ−５ＩＮ（θ−φ）となる８次
に位相検波器１１で引き算器１０の出力信号（す）は、
基準信号（ソ）により検波される。この検波信号（う）
は、 （う）−Ｍ＜・５ＩＮ（θ−φ） となる、この出力信号（つ）は電圧制御発信器Ｉ２に入
力され、その大きさに比例したクロック信号（ム）が出
力される。このクロック信号（ム）と位相検波器１１の
出力信号（う）とが可逆カウンタ１）に入力され、可逆
カウンタ１）が上昇または下降する。電圧制御発信器１
２は位相検波器１１の出力（う）の電圧がＯｖすなわち
ＳＩＮ （θ−φ）＝Ｏになるまで可逆カウンタ１）を
動作させる。この結果θ−φとなりレゾルバ発信器の角
度と同じディジタル値（力）が得られる。、二のディジ
タル値（力）がレゾルバ信号をディジタル信号に変換す
るアナログ・ディジタル変換装置の出力信号になる。 第６図は従来のシンクロ信号をディジタル値に変換１′
るト・）・７キング型アナログ・ディジタル変換装置を
示す構成図ごある。第６図におい°ζ、１はシンクロ発
信器またはディジタル・レゾルバ変換装置からのシンク
ロ信号をレゾルバ信号に変換するスコア）・・トランス
、３はレゾルバ恰゛号を角度の象限により２、レゾルバ
信号の極性を切り換えで出力する象限選択器、８は象限
選択器３のＳＩＮ出力を入力１，２、余弦の乗算を行う
余弦乗算器、９は象限選択器３のＣＯＳ出力を入力し１
、正弦の乗算を行・）正弦乗算器、１０は２つの信号を
引いで、その差を求める引き算器、１１は引き算器１０
の出力信号の搬・送波を検波する位相検波器、１２は位
相検波器１」、の出力信号によりクロック信号を出力す
る電圧制御発信器、１）は電圧制御発信器１２の出力信
号であるクロック信号と位相検波器１１の出力信号によ
り、土塀または下降する可逆カウンタ、７は基準交流信
号をアイツレ−・ジョンするトランスである。 従来のシンクロ信号をディジタル信号に変換するトラッ
キング型アナログ・ディジタル変換装置は第６図のよう
に構成されており、シンクロ発信器からのシンクロ信号
（イ）、（ロ）、（ハ）はスコツト・・トランス１でし
・ゾルバ他号（ニ）。 （ホ）に変換される。レゾルバ信号（：３ 、 （ホ）
は象限選択器３において可逆カウンタ１）の出力信号（
力）の内の１８０度、９０Ｊｆの重み信号により象限選
択された出力信′号（へ）、（Ｊ）になる。 ここでレゾルバ発信器の角度をθ、レゾルバ信号の最大
振幅をに、基準信号（ソ）をＳＩＮωｔとすると、象限
選択器３の出力信号（ト）、 （＝）はそれぞれ （ト） ＝Ｋ ＝ＳＩＮＯＪｔ −５ＩＮθ（へ）
−に−５ＩＮωｔ−ｃｏｓθ になる。次に信号（−・）は余弦乗算器８で余弦の掛は
算が行われる。その出力（ツ）は可逆カウンタ１）のデ
ィジタル信号の角度をφとすると、（ツ）＝に一５ＩＮ
ωｔ−５ＩＮθ・ＣＯ３−となる。また信号（ネ）は正
弦乗算器９は正弦の掛は算が行われる、その出力（ネ）
は、（ネ）＝に一５ＩＮωｔ−ｃｏｓθ・ＳＩＮφとな
る。上記信号（ツ）、（ネ）は次の引き算器１０で引き
算される。この引き算器１０の出力信号（す）は、 （ノー）・−（ツ）−（ネ） ＝に＝ＳＩＮωｔ−５ＩＮθ・ＣＯ３−−に−５ＩＮｏ
Ｊｔ−ＣＯＳθ−３ＩＮφ鴫−に−５ＩＮωｆｆｉ （
ＳＩＮθ・ＣＯ５φ〜ＣＯＳθ・ＳＩＮφ） 三角法の定理により （す）−に−３ＩＮωｔ、−５ＩＮ（θ−φ）となる。 次に位相検波器１１で引き算器１０の出力信号（す）は
、基準信号（ソ）により検波される。この検波信号（う
）は、 （う）＝に一３ＩＮ（θ−φ） となる、ご７の出力信号（つ）は電圧制御発信器１２に
入力され、その大きさに比例したクロック信号（ム）が
出力される。このクロック信号（ム）と位相検波器１１
の出力信号（う）とが可逆カウンタ１）に入力され、可
逆カウンタ１）が上昇または下降する。電圧制御発信器
１２は位相検波器１１の出力（う）の電圧がＯ■すなわ
ちＳＩＮ （θ−φ）＝０になるまで可逆カウンタ１）
を動作させる。この結果θ＝φとなりレゾルバ発信器の
角度と同じディジタル値（力）が得られる。このディジ
タル値（力）がシンクロ信号をディジタル信号に変換す
るアナログ・ディジタル変換装置の出力信号になる。
上記のような従来のアナログ・ディジタル変換装置にお
いては、位相検波器の出力の大きさにかかわらず、電圧
制御発信器の出力により可逆カウンタはディジタル値を
１ずつ変化する。このために高速に回転するレゾルバ信
号及びシンクロ信号には追従できないという課題があっ
た。 この発明はかかる課題を解決するためになされたもので
、記憶器のデータによりディジタル値を複数値変化させ
従来の装置よりも高速に回転する信号に追従させること
を目的とする。 おき、アナログ・ディジタル変換器からのＳＩＮ信号と
、ディジタル値と、基準信号を入力し乗算結果を出力す
る記憶器、４ｂはあらかじめレゾルバ信号のＣＯＳ信号
とディジタル値の乗算結果を記憶しておき、アナログ・
ディジタル変換器からのＣＯ８信号と、ディジタル値と
、基準信号を入力し乗算結果を出力する記憶器、５は３
つの信号を入力してその和を出力する加算器、６はディ
ジタル値を一時保持しておくレジスタである。 レゾルバ発信器またはディジタル・シンクロ変換器から
のレゾルバ信号（ニ）、（ホ）はアナログ・ディジタル
変換器２ａ、２ｂにより複数ビットのディジタル信号（
へ）、（ト）に変換される。 アナログ・ディジタル変換器２ａの出力（へ）と基準信
号（ソ）とディジタル値（力）は記憶器４ａのアドレス
に入力される、記憶器４ａはＳＩＮ信号とディジタル値
（力）の余弦値と基準信号（ソ）の符号を掛は合わせた
値を記憶している、記憶器４ａの出力（ヌ）は、 （ヌ） −（ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳφ
となる。 アナログ・ディジタル変換器２ｂの出力（ト）と基準信
号（ソ）とディジタル値（力）は記憶器４ｂのアドレス
に入力される、記憶器４ｂはＣＯ８信号とディジタル値
（力）の正弦値と基準信号（ソ）の符号を掛は合わせた
値の負数を記憶している、記憶器４ｂの出力（ル）は、 （ル）−−１・ （ＳＩＮωｔの符号）・ＣＯＳθ・Ｓ
ＩＮφ となる。 記憶器４ａの出力信号（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信号（ヲ）は現在のディジタル値（力
）に誤差に相当する値を加算した新しいディジタル値に
なる、（ヲ）は、（ヲ）＝（力）＋（ヌ）＋（ル） ＝（現在のディジタル値）＋（ＳＩＮωｔの符号）・Ｓ
ＩＮθ・ＣＯＳφ＋（−１・（ＳＩＮωｔの符号）・Ｃ
ＯＳθ・ＳＩＮφ）＝（現在のディジタル値）＋（ＳＩ
Ｎωｔの符号）・ＳＩＮθ・ＣＯＳφ−ＣＯＳθ・ＳＩ
Ｎφ）となる、加算器５により計算された新しいディジ
タル値はレジスタ６に入力され、外部クロック７により
新しいディジタル値（力）が更新される。 以上の動作を繰り返しθ＝φになるまでディジタル値（
力）に誤差を加算しレゾルバ信号と同じディジタル値（
力）かえられる、このディジタル値（力）がレゾルバ信
号をディジタル値に変換するアナログ・ディジタル変換
装置の出力信号になる。 第２図はこの発明の第２の実施例を示す図であり、２ａ
はレゾルバ信号のＳＩＮ信号を複数ビットのディジタル
信号に変換するアナログ・ディジタル変換器、２ｂはレ
ゾルバ信号のＣＯＳ信号を複数ビットのディジタル信号
に変換するアナログ・ディジタル変換器、３はレゾルバ
信号の角度の象限により、レゾルバ信号の極性を切り換
えて出力する象限選択器、４ａはあらかじめレゾルバ信
号のＳＩＮ信号とディジタル値の乗算結果を記憶してお
き、象限選択器３からのＳＩＮ信号と、ディジタル値と
、基準信号を入力し乗算結果を出力する記憶器、４ｂは
あらかじめレゾルバ信号のＣＯ５信号とディジタル値の
乗算結果を記憶しておき、象限選択器３からのＣＯ５信
号と、ディジタル値と、基準信号を入力し乗算結果を出
力する記憶器、１５は３つの信号を入力してその和を出
力する加算器、６はディジタル値を一時保持しておくレ
ジスタである。 レゾルバ発信器またはディジタル・シンクロ変換器から
のレゾルバ信号（ニ）、（ホ）は−アナログ・ディジタ
ル変換器２ａ、２ｈにより複数ビットのディジタル（符
号゛（へ）、 （ト）に変換される。 このディジタル信号（へ）、 （ト）は象限選択器３
によりレジスタ６の１８０度と９０度の重み信号により
象限選択された複数ビットのＳＩＮ信号（チ）とＣＯ５
信号（ワ）になる、象限選択器３のＳＩＮ出力（チ）と
基準信号（ソ）とディジタル値（力）は記憶器４ａのア
ドレスに入力される。記憶器４ａはＳＩＮ信号とディジ
タル値（力）の余弦値と基準信号（ソ）の符号を掛は金
わセた値を記憶している、記憶器４ａの出力（ヌ）は、
。 （ヌ）＝ （ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳφ
となる。 象限選択、器３のＣＯＳ出力（す）と基準信号（ソ）と
ディジタル値（力）は記憶器４ｂのアドレスに入力され
る、記憶器４ｂはＣＯ５信号とディジタル値（力）の正
弦値と基準信号（ソ）の符号を掛は金わ→、！：た値の
負数を記憶している、記憶ｔａｂの出力（ル）は、 （ル）−１・ （ＳＩＮωｔの符号）・ＣＯＳθ・ＳＩ
Ｎφ となる。 記憶器４ａの出力信号（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信号（ヲ）は現在のＦイジタル値（力
）に誤差に相当する値を加算し７だ新し、いディジタル
値になる、（ヲ）は、（））−（力）＋（ヌ）＋（ル） −（現在のディジタル値’） ＋（ＳＩＮωｔの符号
）・ＳＩＮθ・ＣＯＳφ斗 （−１・（ＳＩＮωｔの符
号）・ＣＯＳθ・ＳＩＮφ）−（現在のディジタル値）
’−，（ＳＩＮωｔ、の符号）・ＳＩＮθ・ＣＯＳφ
−ＣＯＳθ・ＳＩＮφ）となる、加算器５により計算さ
れた新、２いディジタル値はレジスタ６に入力され、外
部クロ’７り（ワ）により新し２いディジタル値（力）
が更新される。以−トの動作を繰り返し２θ−φになる
までディジタル値く力）に誤差を加算しレゾルバ信号と
同じディジタル値（力）かえられる。このディジタル値
（力）がレゾルバ信号をディジタル値に変換するアナロ
グ・ディジタル変換装置の出力信号になる。 第３図はこの発明の第３の実施例を示す図であり、１は
シンクロ発信器またはディジタル・シンクロ変換器から
のシンクロ信号をレゾルバ信号に変換するスコツト・）
・ランスまたは変換回路、２ａはレゾルバ信号のＳＩＮ
信号庖複数ピントのディジタル信号に変換するアナログ
・ディジタル変換器、２ｂはレゾルバ信号のＣＯＳ信号
を杓数ビットのディジタル信号に変換するアナログ・デ
ィジタル変換器、４ａはあらかじめレゾルバ信号のＳＩ
Ｎ信号とディジタル値の乗算結果を記憶しておき、アナ
ログ・ディジタル変換器からのＳＩＮ信号と、ディジタ
ル値と、基準信号を入力し乗算結犀を出力する記憶器、
４ｂはあらかじめレゾルバ信号のＣＯ３信号とディジタ
ル値の乗算結果を記憶しておき、アナログ・ディジタル
変換器からのＣＯＳ信号と、ディジタル値と、基準化゛
号を入力し重重結果を出力する記憶器、５は３つの信号
を入力してその和を出力する加算器、６はディジタル値
を一時保持しておくレジスタ、７は基準信号をアイソレ
ーションするトランスである。 シンクロ発信゛器またはディジタル・シンクロ変換器か
らのシンクロ信号 （イ）、（ロ）、（）＼）はスコッ
ト・トランス１でＬ／ソ°ルバ信号（ニ）９（ホ）に変
換する、レゾルバ信号（ニ）、（ホ）はアナログ・ディ
ジタル変換器２ａ、２ｂにより複数ビットのディジタル
化−号（へ）、（））に変換される。 アナログ・ディジタル変換器２ａの信号（−）と基準信
号（ソ）とディジタル値（力）は記憶器４ａのアドレス
に入力される、記憶器４ａはＳＩＮ信号とディジタル値
（力）の余弦値と基準信号（ソ）の符号を掛は合わせた
値を記憶している、記憶器４ａの出力（ヌ）は、 （ヌ） ＝ （ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳ
φとなる。 アナログ・ディジタル変換器２ｂの出力（ト）と基準信
号（ソ）とディジタル値（力）は記憶器４ｂのアドレス
に入力される、記憶器４ｂはＣＯ８信号とディジタル値
（力）の正弦値と基準信号（ソ）の符号を掛は合わせた
値の負数を記憶している、記憶器４ｂの出力（ル）は、 （ル） ＝ １ ・（ＳＩＮａ＋ｔ（７）符号＞−Ｃ
ＯＳθ・ＳＩＮφ となる。 記憶器４ａの出力信号（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信号（ヲ）は現在のディジタル値（力
）に誤差に相当する値を加算した新しいディジタル値に
なる、（ヲ）は、（ヲ）＝（力）＋（ヌ）＋（ル） ＝（現在のディジタル値’） ＋（ＳＩＮωｔの符号
）・ＳＩＮθ・ＣＯＳφ＋（−１・（ＳＩＮωｔの符号
）・ＣＯＳθ・ＳＩＮφ）＝（現在のディジタル値）
＋（ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳφ−ＣＯＳ
θ・ＳＩＮφ）となる、加算器５により計算された新し
いディジタル値はレジスタ６に入力され、外部クロック
（ワ）により新しいディジタル値（力）が更新される０
以上の動作を繰り返しθ＝φになるまでディジタル値（
力）に誤差を加算しレゾルバ信号と同じディジタル値（
力）かえられる、このディジタル値（力）がシンクロ信
号をディジタル値に変換するアナログ・ディジタル変換
装置の出力信号になる。 第４図はこの発明の第４の実施例を示す図であり、ｌは
シンクロ発信器またはディジタル・シンクロ変換器から
のシンクロ信号をレゾルバ信号に変換するスコット・ト
ランスまたは変換回路、２ａはレゾルバ信号のＳＩＮ信
号を複数ビットのディジタル信号に変換するアナログ・
ディジタル変換器、２ｂはレゾルバ信号のＣＯＳ信号を
複数ピントのディジタル信号に変換するアナログ・ディ
ジタル変換器、３はレゾルバ信号の角度の象限により、
レゾルバ信号の極性を切り換えて出力する象限選択器、
４ａはあらかじめレゾルバ信号のＳＩＮ信号とディジタ
ル値の乗算結果を記憶しておき、象限選択器３からのＳ
ＩＮ信号と、ディジタル値と、基準信号を入力し乗算結
果を出力する記憶器、４ｂはあらかじめレゾルバ信号の
ＣＯ８信号とディジタル値の乗算結果を記憶しておき、
象限選択器３からのＣＯ８信号と、ディジタル値と、基
準信号を入力し乗算結果を出力する記憶器、５は３つの
信号を入力してその和を出力する加算器、６はディジタ
ル値を一時保持しておくレジスタ、７は基準信号をアイ
ソレーシヨンするトランスである。 シンクロ発信器またはディジタル・シンクロ変換器から
のシンクロ信号（イ）、（ロ）、（ハ）はスコット・ト
ランス１でレゾルバ信号（ニ）。 （ホ）に変換する、スコット・トランス１からのレゾル
バ信号（ニ）、（ホ）はアナログ・ディジタル変換器２
ａ、２ｂにより複数ビットのディジタル信号（へ）、
（ト）に変換される。 このディジタル信号（へ）、（ト）は象限選択器３によ
りレジスタ６の１８０度と９０度の重み信号により象限
選択された複数ビットのＳＩＮ信号（チ）とＣＯ３信号
（す）になる、象限選択器３のＳＩＮ出力（チ）と基準
信号（ソ）とディジタル値（力）は記憶器４ａのアドレ
スに入力される、記憶器４ａはＳＩＮ信号とディジタル
値（力）の余弦値と基準信号（ソ）の符号を掛は合わせ
た値を記憶している、記憶器４ａの出力（ヌ）は゛、（
ヌ） ＝ （ＳＩＮωｔ （７）符号）−ＳＩＮθ・Ｃ
Ｏ３−となる。 象限選択器３のＣＯＳ出力（す）と基準信号（ソ）とデ
ィジタル値（力）は記憶器４ｂのアドレスに入力される
、記憶器４ｂはｃｏｓ信号とディジタル値（力）の正弦
値と基準信号（ソ）の符号を掛は合わせた値の負数を記
憶している、記憶器４ｂの出力（ル）は、 （ル）・・−Ｉ・ （ＳＩＮ６１ｔの符号）・ＣＯＳθ
・ＳＩＮφ となる。 記憶器４ａの出力信ぢ（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信ぢ（ヲ）は現在のディジタル値（力
）に誤差に相当する稙を加算した新しいディジタルＨに
なる、（ヲ）は１、（ヲ）＝（力）＋（ヌ）−１（ル） ・ （現在のア゛イジタル値） −１（ＳＩＮωｔの符
勺）・ＳＩＮθ・ＣＯＳφ」 （−１・（ＳＩＮωｔの
符号）・ＣＯＳθ・ＳＩＮφ）−（現在のディジタル値
） ＋（ＳＩＮＯＪ＋、の符号）・ＳＩＮθ・ＣＯＳφ
−ＣＯＳθ・ＳＩＮφ）となる、加算Ｈ５により計算さ
れた新しいディジタル値はレジスタ６に入力され、外部
クロック（ワ）により新し、いディジタル値（力）が更
新される。以１−の動作を繰り返しθ−φになるまでデ
ィジタル値く力）に誤差を加算し、レゾルバ信号と同じ
ゲイ・ンタル値（力）がえられる。ごの／イジタル値（
力）がシンクロ信号をう１イジタル（ａに変換するアナ
ログ・ディジタル変換装面の出力信号になる。 なお、これらの実施例ではレジスタの出力信号（力）を
アナログ・デイ・ソクル変換装置の出力信号としで使用
したが加算：器５の出力信号をアナｉｆｆグ・ディジタ
ル変換装「の出力信号とし７°ても同様の動作を期待す
ることができる。 また象限選択器３、加算器５、レジスタ６の総てまたは
一部をマイクロブロセ・ノサ等のソノ１ウニ、アにより
処理しても同様の動作壱期待できる。
いては、位相検波器の出力の大きさにかかわらず、電圧
制御発信器の出力により可逆カウンタはディジタル値を
１ずつ変化する。このために高速に回転するレゾルバ信
号及びシンクロ信号には追従できないという課題があっ
た。 この発明はかかる課題を解決するためになされたもので
、記憶器のデータによりディジタル値を複数値変化させ
従来の装置よりも高速に回転する信号に追従させること
を目的とする。 おき、アナログ・ディジタル変換器からのＳＩＮ信号と
、ディジタル値と、基準信号を入力し乗算結果を出力す
る記憶器、４ｂはあらかじめレゾルバ信号のＣＯＳ信号
とディジタル値の乗算結果を記憶しておき、アナログ・
ディジタル変換器からのＣＯ８信号と、ディジタル値と
、基準信号を入力し乗算結果を出力する記憶器、５は３
つの信号を入力してその和を出力する加算器、６はディ
ジタル値を一時保持しておくレジスタである。 レゾルバ発信器またはディジタル・シンクロ変換器から
のレゾルバ信号（ニ）、（ホ）はアナログ・ディジタル
変換器２ａ、２ｂにより複数ビットのディジタル信号（
へ）、（ト）に変換される。 アナログ・ディジタル変換器２ａの出力（へ）と基準信
号（ソ）とディジタル値（力）は記憶器４ａのアドレス
に入力される、記憶器４ａはＳＩＮ信号とディジタル値
（力）の余弦値と基準信号（ソ）の符号を掛は合わせた
値を記憶している、記憶器４ａの出力（ヌ）は、 （ヌ） −（ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳφ
となる。 アナログ・ディジタル変換器２ｂの出力（ト）と基準信
号（ソ）とディジタル値（力）は記憶器４ｂのアドレス
に入力される、記憶器４ｂはＣＯ８信号とディジタル値
（力）の正弦値と基準信号（ソ）の符号を掛は合わせた
値の負数を記憶している、記憶器４ｂの出力（ル）は、 （ル）−−１・ （ＳＩＮωｔの符号）・ＣＯＳθ・Ｓ
ＩＮφ となる。 記憶器４ａの出力信号（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信号（ヲ）は現在のディジタル値（力
）に誤差に相当する値を加算した新しいディジタル値に
なる、（ヲ）は、（ヲ）＝（力）＋（ヌ）＋（ル） ＝（現在のディジタル値）＋（ＳＩＮωｔの符号）・Ｓ
ＩＮθ・ＣＯＳφ＋（−１・（ＳＩＮωｔの符号）・Ｃ
ＯＳθ・ＳＩＮφ）＝（現在のディジタル値）＋（ＳＩ
Ｎωｔの符号）・ＳＩＮθ・ＣＯＳφ−ＣＯＳθ・ＳＩ
Ｎφ）となる、加算器５により計算された新しいディジ
タル値はレジスタ６に入力され、外部クロック７により
新しいディジタル値（力）が更新される。 以上の動作を繰り返しθ＝φになるまでディジタル値（
力）に誤差を加算しレゾルバ信号と同じディジタル値（
力）かえられる、このディジタル値（力）がレゾルバ信
号をディジタル値に変換するアナログ・ディジタル変換
装置の出力信号になる。 第２図はこの発明の第２の実施例を示す図であり、２ａ
はレゾルバ信号のＳＩＮ信号を複数ビットのディジタル
信号に変換するアナログ・ディジタル変換器、２ｂはレ
ゾルバ信号のＣＯＳ信号を複数ビットのディジタル信号
に変換するアナログ・ディジタル変換器、３はレゾルバ
信号の角度の象限により、レゾルバ信号の極性を切り換
えて出力する象限選択器、４ａはあらかじめレゾルバ信
号のＳＩＮ信号とディジタル値の乗算結果を記憶してお
き、象限選択器３からのＳＩＮ信号と、ディジタル値と
、基準信号を入力し乗算結果を出力する記憶器、４ｂは
あらかじめレゾルバ信号のＣＯ５信号とディジタル値の
乗算結果を記憶しておき、象限選択器３からのＣＯ５信
号と、ディジタル値と、基準信号を入力し乗算結果を出
力する記憶器、１５は３つの信号を入力してその和を出
力する加算器、６はディジタル値を一時保持しておくレ
ジスタである。 レゾルバ発信器またはディジタル・シンクロ変換器から
のレゾルバ信号（ニ）、（ホ）は−アナログ・ディジタ
ル変換器２ａ、２ｈにより複数ビットのディジタル（符
号゛（へ）、 （ト）に変換される。 このディジタル信号（へ）、 （ト）は象限選択器３
によりレジスタ６の１８０度と９０度の重み信号により
象限選択された複数ビットのＳＩＮ信号（チ）とＣＯ５
信号（ワ）になる、象限選択器３のＳＩＮ出力（チ）と
基準信号（ソ）とディジタル値（力）は記憶器４ａのア
ドレスに入力される。記憶器４ａはＳＩＮ信号とディジ
タル値（力）の余弦値と基準信号（ソ）の符号を掛は金
わセた値を記憶している、記憶器４ａの出力（ヌ）は、
。 （ヌ）＝ （ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳφ
となる。 象限選択、器３のＣＯＳ出力（す）と基準信号（ソ）と
ディジタル値（力）は記憶器４ｂのアドレスに入力され
る、記憶器４ｂはＣＯ５信号とディジタル値（力）の正
弦値と基準信号（ソ）の符号を掛は金わ→、！：た値の
負数を記憶している、記憶ｔａｂの出力（ル）は、 （ル）−１・ （ＳＩＮωｔの符号）・ＣＯＳθ・ＳＩ
Ｎφ となる。 記憶器４ａの出力信号（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信号（ヲ）は現在のＦイジタル値（力
）に誤差に相当する値を加算し７だ新し、いディジタル
値になる、（ヲ）は、（））−（力）＋（ヌ）＋（ル） −（現在のディジタル値’） ＋（ＳＩＮωｔの符号
）・ＳＩＮθ・ＣＯＳφ斗 （−１・（ＳＩＮωｔの符
号）・ＣＯＳθ・ＳＩＮφ）−（現在のディジタル値）
’−，（ＳＩＮωｔ、の符号）・ＳＩＮθ・ＣＯＳφ
−ＣＯＳθ・ＳＩＮφ）となる、加算器５により計算さ
れた新、２いディジタル値はレジスタ６に入力され、外
部クロ’７り（ワ）により新し２いディジタル値（力）
が更新される。以−トの動作を繰り返し２θ−φになる
までディジタル値く力）に誤差を加算しレゾルバ信号と
同じディジタル値（力）かえられる。このディジタル値
（力）がレゾルバ信号をディジタル値に変換するアナロ
グ・ディジタル変換装置の出力信号になる。 第３図はこの発明の第３の実施例を示す図であり、１は
シンクロ発信器またはディジタル・シンクロ変換器から
のシンクロ信号をレゾルバ信号に変換するスコツト・）
・ランスまたは変換回路、２ａはレゾルバ信号のＳＩＮ
信号庖複数ピントのディジタル信号に変換するアナログ
・ディジタル変換器、２ｂはレゾルバ信号のＣＯＳ信号
を杓数ビットのディジタル信号に変換するアナログ・デ
ィジタル変換器、４ａはあらかじめレゾルバ信号のＳＩ
Ｎ信号とディジタル値の乗算結果を記憶しておき、アナ
ログ・ディジタル変換器からのＳＩＮ信号と、ディジタ
ル値と、基準信号を入力し乗算結犀を出力する記憶器、
４ｂはあらかじめレゾルバ信号のＣＯ３信号とディジタ
ル値の乗算結果を記憶しておき、アナログ・ディジタル
変換器からのＣＯＳ信号と、ディジタル値と、基準化゛
号を入力し重重結果を出力する記憶器、５は３つの信号
を入力してその和を出力する加算器、６はディジタル値
を一時保持しておくレジスタ、７は基準信号をアイソレ
ーションするトランスである。 シンクロ発信゛器またはディジタル・シンクロ変換器か
らのシンクロ信号 （イ）、（ロ）、（）＼）はスコッ
ト・トランス１でＬ／ソ°ルバ信号（ニ）９（ホ）に変
換する、レゾルバ信号（ニ）、（ホ）はアナログ・ディ
ジタル変換器２ａ、２ｂにより複数ビットのディジタル
化−号（へ）、（））に変換される。 アナログ・ディジタル変換器２ａの信号（−）と基準信
号（ソ）とディジタル値（力）は記憶器４ａのアドレス
に入力される、記憶器４ａはＳＩＮ信号とディジタル値
（力）の余弦値と基準信号（ソ）の符号を掛は合わせた
値を記憶している、記憶器４ａの出力（ヌ）は、 （ヌ） ＝ （ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳ
φとなる。 アナログ・ディジタル変換器２ｂの出力（ト）と基準信
号（ソ）とディジタル値（力）は記憶器４ｂのアドレス
に入力される、記憶器４ｂはＣＯ８信号とディジタル値
（力）の正弦値と基準信号（ソ）の符号を掛は合わせた
値の負数を記憶している、記憶器４ｂの出力（ル）は、 （ル） ＝ １ ・（ＳＩＮａ＋ｔ（７）符号＞−Ｃ
ＯＳθ・ＳＩＮφ となる。 記憶器４ａの出力信号（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信号（ヲ）は現在のディジタル値（力
）に誤差に相当する値を加算した新しいディジタル値に
なる、（ヲ）は、（ヲ）＝（力）＋（ヌ）＋（ル） ＝（現在のディジタル値’） ＋（ＳＩＮωｔの符号
）・ＳＩＮθ・ＣＯＳφ＋（−１・（ＳＩＮωｔの符号
）・ＣＯＳθ・ＳＩＮφ）＝（現在のディジタル値）
＋（ＳＩＮωｔの符号）・ＳＩＮθ・ＣＯＳφ−ＣＯＳ
θ・ＳＩＮφ）となる、加算器５により計算された新し
いディジタル値はレジスタ６に入力され、外部クロック
（ワ）により新しいディジタル値（力）が更新される０
以上の動作を繰り返しθ＝φになるまでディジタル値（
力）に誤差を加算しレゾルバ信号と同じディジタル値（
力）かえられる、このディジタル値（力）がシンクロ信
号をディジタル値に変換するアナログ・ディジタル変換
装置の出力信号になる。 第４図はこの発明の第４の実施例を示す図であり、ｌは
シンクロ発信器またはディジタル・シンクロ変換器から
のシンクロ信号をレゾルバ信号に変換するスコット・ト
ランスまたは変換回路、２ａはレゾルバ信号のＳＩＮ信
号を複数ビットのディジタル信号に変換するアナログ・
ディジタル変換器、２ｂはレゾルバ信号のＣＯＳ信号を
複数ピントのディジタル信号に変換するアナログ・ディ
ジタル変換器、３はレゾルバ信号の角度の象限により、
レゾルバ信号の極性を切り換えて出力する象限選択器、
４ａはあらかじめレゾルバ信号のＳＩＮ信号とディジタ
ル値の乗算結果を記憶しておき、象限選択器３からのＳ
ＩＮ信号と、ディジタル値と、基準信号を入力し乗算結
果を出力する記憶器、４ｂはあらかじめレゾルバ信号の
ＣＯ８信号とディジタル値の乗算結果を記憶しておき、
象限選択器３からのＣＯ８信号と、ディジタル値と、基
準信号を入力し乗算結果を出力する記憶器、５は３つの
信号を入力してその和を出力する加算器、６はディジタ
ル値を一時保持しておくレジスタ、７は基準信号をアイ
ソレーシヨンするトランスである。 シンクロ発信器またはディジタル・シンクロ変換器から
のシンクロ信号（イ）、（ロ）、（ハ）はスコット・ト
ランス１でレゾルバ信号（ニ）。 （ホ）に変換する、スコット・トランス１からのレゾル
バ信号（ニ）、（ホ）はアナログ・ディジタル変換器２
ａ、２ｂにより複数ビットのディジタル信号（へ）、
（ト）に変換される。 このディジタル信号（へ）、（ト）は象限選択器３によ
りレジスタ６の１８０度と９０度の重み信号により象限
選択された複数ビットのＳＩＮ信号（チ）とＣＯ３信号
（す）になる、象限選択器３のＳＩＮ出力（チ）と基準
信号（ソ）とディジタル値（力）は記憶器４ａのアドレ
スに入力される、記憶器４ａはＳＩＮ信号とディジタル
値（力）の余弦値と基準信号（ソ）の符号を掛は合わせ
た値を記憶している、記憶器４ａの出力（ヌ）は゛、（
ヌ） ＝ （ＳＩＮωｔ （７）符号）−ＳＩＮθ・Ｃ
Ｏ３−となる。 象限選択器３のＣＯＳ出力（す）と基準信号（ソ）とデ
ィジタル値（力）は記憶器４ｂのアドレスに入力される
、記憶器４ｂはｃｏｓ信号とディジタル値（力）の正弦
値と基準信号（ソ）の符号を掛は合わせた値の負数を記
憶している、記憶器４ｂの出力（ル）は、 （ル）・・−Ｉ・ （ＳＩＮ６１ｔの符号）・ＣＯＳθ
・ＳＩＮφ となる。 記憶器４ａの出力信ぢ（ヌ）と記憶器４ｂの出力信号（
ル）とディジタル値（力）は加算器５により加算される
、加算器５の出力信ぢ（ヲ）は現在のディジタル値（力
）に誤差に相当する稙を加算した新しいディジタルＨに
なる、（ヲ）は１、（ヲ）＝（力）＋（ヌ）−１（ル） ・ （現在のア゛イジタル値） −１（ＳＩＮωｔの符
勺）・ＳＩＮθ・ＣＯＳφ」 （−１・（ＳＩＮωｔの
符号）・ＣＯＳθ・ＳＩＮφ）−（現在のディジタル値
） ＋（ＳＩＮＯＪ＋、の符号）・ＳＩＮθ・ＣＯＳφ
−ＣＯＳθ・ＳＩＮφ）となる、加算Ｈ５により計算さ
れた新しいディジタル値はレジスタ６に入力され、外部
クロック（ワ）により新し、いディジタル値（力）が更
新される。以１−の動作を繰り返しθ−φになるまでデ
ィジタル値く力）に誤差を加算し、レゾルバ信号と同じ
ゲイ・ンタル値（力）がえられる。ごの／イジタル値（
力）がシンクロ信号をう１イジタル（ａに変換するアナ
ログ・ディジタル変換装面の出力信号になる。 なお、これらの実施例ではレジスタの出力信号（力）を
アナログ・デイ・ソクル変換装置の出力信号としで使用
したが加算：器５の出力信号をアナｉｆｆグ・ディジタ
ル変換装「の出力信号とし７°ても同様の動作を期待す
ることができる。 また象限選択器３、加算器５、レジスタ６の総てまたは
一部をマイクロブロセ・ノサ等のソノ１ウニ、アにより
処理しても同様の動作壱期待できる。
この発明は以上説明したように、ディジタル値の角度ψ
とレゾルバ信号またはシンクｏ偲号の角度θの差に相当
した値によりディジタル値を変化させアづログ・デイ・
ソタル変換装置の込きな追従速度を得るこＪができる。
とレゾルバ信号またはシンクｏ偲号の角度θの差に相当
した値によりディジタル値を変化させアづログ・デイ・
ソタル変換装置の込きな追従速度を得るこＪができる。
第１図・・−第４図は、二の発明の第１〜・第４の実施
例を示す図、第５図、第６図は従来のアナｌ」グ・ディ
パジタル変換装置をポず図である。 図に才９いで、１はスフ７ト・トランス７．２はｉ１′
すＬ１グ・ディジタル変換器、７３は象限選択器、４は
記憶器、ｊ）は加算器、６はレジスタ、ｌはトランス、
８は余弦乗ｐ器９，９は正弦乗算器、１ｏは引きν器、
１１は位相検波器、１２は電）１制御発イδ器、２ 工
３は司逆カウンタである。 なお、図中同一符号ば同一 または相当部分をＡ＼す。 代 理 人 人 岩 増 雄 第 図 第 図 第 ５図 第
例を示す図、第５図、第６図は従来のアナｌ」グ・ディ
パジタル変換装置をポず図である。 図に才９いで、１はスフ７ト・トランス７．２はｉ１′
すＬ１グ・ディジタル変換器、７３は象限選択器、４は
記憶器、ｊ）は加算器、６はレジスタ、ｌはトランス、
８は余弦乗ｐ器９，９は正弦乗算器、１ｏは引きν器、
１１は位相検波器、１２は電）１制御発イδ器、２ 工
３は司逆カウンタである。 なお、図中同一符号ば同一 または相当部分をＡ＼す。 代 理 人 人 岩 増 雄 第 図 第 図 第 ５図 第
Claims (4)
- （１）入力端に２相のレゾルバ信号の一方の正弦波の信
号を入力し、ディジタル信号に変換する第１のアナログ
・ディジタル変換器と、入力端に２相のレゾルバ信号の
一方の余弦波の信号を入力し、ディジタル信号に変換す
る第２のアナログ・ディジタル変換器と、アドレス信号
を入力し、アドレスにより指定されたデータを出力する
第１の記憶器と、アドレス信号を入力し、アドレスによ
り指定されたデータを出力する第２の記憶器と、３つの
信号を入力し３つの信号の和を出力する加算器と、２つ
の信号を入力し第１の入力信号により第２の入力信号を
一時保持するレジスタとにより構成された、アナログ・
ディジタル変換装置において、３つの入力端の第１の入
力端に前記第１のアナログ・ディジタル変換器の出力信
号を入力し、第２の入力端に基準信号を入力し、第３の
入力端に前記レジスタの出力信号を入力し、３つの入力
信号に従がい記憶したデータを出力する第１の記憶器と
、３つの入力端の第１の入力端に前記第２のアナログ・
ディジタル変換器の出力信号を入力し、第２の入力端に
基準信号を入力し、第３の入力端に前記レジスタの出力
信号を入力し、３つの入力信号に従がい記憶したデータ
を出力する第１の記憶器と、３つの入力端の第１の入力
端に前記第１の記憶器の出力信号を入力し、第２の入力
端に前記第２の記憶器の出力信号を入力し、第３の入力
端に前記レジスタの出力信号を入力し３つの信号をたし
算する加算器と、２つの入力端の第１の入力端にクロッ
ク信号を入力し、第２の入力端に前記加算器の出力信号
を入力し第１の入力端に与えられた信号により第２の入
力端に与えられた信号を一時保持するレジスタとを備え
たことを特徴とするアナログ・ディジタル変換装置。 - （２）入力端に２相のレゾルバ信号の一方の正弦波の信
号を入力し、ディジタル信号に変換する第１のアナログ
・ディジタル変換器と、入力端に２相のレゾルバ信号の
一方の余弦波の信号を入力し、ディジタル信号に変換す
る第２のアナログ・ディジタル変換器と、第１の入力端
に前記第１のアナログ・ディジタル変換器の出力信号を
入力し、第２の入力端に前記第２のアナログ・ディジタ
ル変換器の出力信号を入力し、角度の象限により象限を
切り換えた信号を出力する象眼選択器と、アドレス信号
を入力し、アドレスにより指定されたデータを出力する
第１の記憶器と、アドレス信号を入力し、アドレスによ
り指定されたデータを出力する第２の記憶器と、３つの
信号を入力し３つの信号の和を出力する加算器と、２つ
の信号を入力し第１の入力信号により第２の入力信号を
一時保持するレジスタとにより構成された、アナログ・
ディジタル変換装置において、３つの入力端の第１の入
力端に前記象限選択器の正弦波信号を入力し、第２の入
力端に基準信号を入力し、第３の入力端に前記レジスタ
の出力信号を入力し、３つの入力信号に従がい記憶した
データを出力する第１の記憶器と、３つの入力端の第１
の入力端に前記象限選択器の余弦波信号を入力し、第２
の入力端に基準信号を入力し、第３の入力端に前記レジ
スタの出力信号を入力し、３つの入力信号に従がい記憶
したデータを出力する第１の記憶器と、３つの入力端の
第１の入力端に前記第１の記憶器の出力信号を入力し、
第２の入力端に前記第２の記憶器の出力信号を入力し、
第３の入力端に前記レジスタの出力信号を入力し３つの
信号をたし算する加算器と、２つの入力端の第１の入力
端にクロック信号を入力し、第２の入力端に前記加算器
の出力信号を入力し第１の入力端に与えられた信号によ
り第２の入力端に与えられた信号を一時保持するレジス
タとを備えたことを特徴とするアナログ・ディジタル変
換装置。 - （３）３相のシンクロ信号を入力し２相のレゾルバ信号
に変換するスコット・トランス又は変換回路と、入力端
に前記スコット・トランスの出力の２相のレゾルバ信号
の一方の正弦波の信号を入力し、ディジタル信号に変換
する第１のアナログ・ディジタル変換器と、入力端に前
記スコット・トランスの出力の２相のレゾルバ信号の一
方の余弦波の信号を入力し、ディジタル信号に変換する
第２のアナログ・ディジタル変換器と、アドレス信号を
入力し、アドレスにより指定されたデータを出力する第
１の記憶器と、アドレス信号を入力し、アドレスにより
指定されたデータを出力する第２の記憶器と、３つの信
号を入力し３つの信号の和を出力する加算器と、２つの
信号を入力し第１の入力信号により第２の入力信号を一
時保持するレジスタとにより構成された、アナログ・デ
ィジタル変換装置において、３つの入力端の第１の入力
端に前記第１のアナログ・ディジタル変換器の出力信号
を入力し、第２の入力端に基準信号を入力し、第３の入
力端に前記レジスタの出力信号を入力し、３つの入力信
号に従がい記憶したデータを出力する第１の記憶器と、
３つの入力端の第１の入力端に前記第２のアナログ・デ
ィジタル変換器の出力信号を入力し、第２の入力端に基
準信号を入力し、第３の入力端に前記レジスタの出力信
号を入力し、３つの入力信号に従がい記憶したデータを
出力する第１の記憶器と、３つの入力端の第１の入力端
に前記第１の記憶器の出力信号を入力し、第２の入力端
に前記第２の記憶器の出力信号を入力し、第３の入力端
に前記レジスタの出力信号を入力し３つの信号をたし算
する加算器と、２つの入力端の第１の入力端にクロック
信号を入力し、第２の入力端に前記加算器の出力信号を
入力し第１の入力端に与えられた信号により第２の入力
端に与えられた信号を一時保持するレジスタとを備えた
ことを特徴とするアナログ・ディジタル変換装置。 - （４）３相のシンクロ信号を入力し２相のレゾルバ信号
に変換するスコット・トランス又は変換回路と、入力端
に前記スコット・トランスの出力の２相のレゾルバ信号
の一方の正弦波の信号を入力し、ディジタル信号に変換
する第１のアナログ・ディジタル変換器と、入力端に前
記スコット・トランスの出力の２相のレゾルバ信号の一
方の余弦波の信号を入力し、ディジタル信号に変換する
第２のアナログ・ディジタル変換器と、第１の入力端に
前記第１のアナログ・ディジタル変換器の出力信号を入
力し、第２の入力端に前記第２のアナログ・ディジタル
変換器の出力信号を入力し、角度の象眼により象眼を切
り換えた信号を出力する象限選択器と、アドレス信号を
入力し、アドレスにより指定されたデータを出力する第
１の記憶器と、アドレス信号を入力し、アドレスにより
指定されたデータを出力する第２の記憶器と、３つの信
号を入力し３つの信号の和を出力する加算器と、２つの
信号を入力し第１の入力信号により第２の入力信号を一
時保持するレジスタとにより構成された、アナログ・デ
ィジタル変換装置において、３つの入力端の第１の入力
端に前記象限選択器の正弦波信号を入力し、第２の入力
端に基準信号を入力し、第３の入力端に前記レジスタの
出力信号を入力し、３つの入力信号に従がい記憶したデ
ータを出力する第１の記憶器と、３つの入力端の第１の
入力端に前記象限選択器の余弦波信号を入力し、第２の
入力端に基準信号を入力し、第３の入力端の前記レジス
タの出力信号を入力し、３つの入力信号に従がい記憶し
たデータを出力する第１の記憶器と、３つの入力端の第
１の入力端に前記第１の記憶器の出力信号を入力し、第
２の入力端に前記第２の記憶器の出力信号を入力し、第
３の入力端に前記レジスタの出力信号を入力し３つの信
号をたし算する加算器と、２つの入力端の第１の入力端
にクロック信号を入力し、第２の入力端に前記加算器の
出力信号を入力し第１の入力端に与えられた信号により
第２の入力端に与えられた信号を一時保持するレジスタ
とを備えたことを特徴とするアナログ・ディジタル変換
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26339990A JPH04140925A (ja) | 1990-10-01 | 1990-10-01 | アナログ・ディジタル変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26339990A JPH04140925A (ja) | 1990-10-01 | 1990-10-01 | アナログ・ディジタル変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04140925A true JPH04140925A (ja) | 1992-05-14 |
Family
ID=17388960
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26339990A Pending JPH04140925A (ja) | 1990-10-01 | 1990-10-01 | アナログ・ディジタル変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04140925A (ja) |
-
1990
- 1990-10-01 JP JP26339990A patent/JPH04140925A/ja active Pending
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