JPS63285049A - 集積回路のバス線における回路装置 - Google Patents
集積回路のバス線における回路装置Info
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- JPS63285049A JPS63285049A JP63101210A JP10121088A JPS63285049A JP S63285049 A JPS63285049 A JP S63285049A JP 63101210 A JP63101210 A JP 63101210A JP 10121088 A JP10121088 A JP 10121088A JP S63285049 A JPS63285049 A JP S63285049A
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- 230000005540 biological transmission Effects 0.000 claims abstract description 10
- 238000007599 discharging Methods 0.000 abstract description 3
- 230000000903 blocking effect Effects 0.000 description 6
- 230000007423 decrease Effects 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 230000003936 working memory Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4063—Device-to-bus coupling
- G06F13/4068—Electrical coupling
- G06F13/4072—Drivers or receivers
- G06F13/4077—Precharging or discharging
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、データ送信器とデータ受信器との間でデー
タを伝送するための集積回路のバス線における回路装置
であって、予充電段階の間にバス線が特定の電圧レベル
に充電され、またデータ伝送段階の間に、伝送すべきデ
ィジタル情報に相応して、バス線の電圧レベルがそのま
まにしておかれ、または充電状態切換段階の間に充電状
態を切換えられるものに関する。
タを伝送するための集積回路のバス線における回路装置
であって、予充電段階の間にバス線が特定の電圧レベル
に充電され、またデータ伝送段階の間に、伝送すべきデ
ィジタル情報に相応して、バス線の電圧レベルがそのま
まにしておかれ、または充電状態切換段階の間に充電状
態を切換えられるものに関する。
集積回路ではデータ伝送のためにすべてのデータ送信器
（たとえば作業メモリ）およびすべてのデータ受信器（
たとえば中央ユニット）が、アドレス、データおよび制
御バスに分割されていてよい共通のバス線に接続されて
いる。各バスは、その基礎となっているオペレーティン
グシステムに応じて、データ伝送のためにいわゆる予充
電段階の間に特定の電圧レベル、たとえばＶＣＣに予充
電される複数のバス線から成っている。この電圧レベル
が既に２値論理レベルＬ（低）またはＨ（高）の範囲内
にあり、この論理レベルの伝送のためにバス線の充電状
態切換を行わずにすむことは好ましい。
（たとえば作業メモリ）およびすべてのデータ受信器（
たとえば中央ユニット）が、アドレス、データおよび制
御バスに分割されていてよい共通のバス線に接続されて
いる。各バスは、その基礎となっているオペレーティン
グシステムに応じて、データ伝送のためにいわゆる予充
電段階の間に特定の電圧レベル、たとえばＶＣＣに予充
電される複数のバス線から成っている。この電圧レベル
が既に２値論理レベルＬ（低）またはＨ（高）の範囲内
にあり、この論理レベルの伝送のためにバス線の充電状
態切換を行わずにすむことは好ましい。
バス線の充電状態切換は、逆の論理レベルを伝送すべき
ときには常に必要である。マイクロコンピュータの動作
速度を低下させないように、この充電状態切換は十分な
ノイズ電圧マージンの考慮のもとに、また信鯨性のある
状態認識の保証のもとに、できるかぎり短時間で終了さ
れなければならない。
ときには常に必要である。マイクロコンピュータの動作
速度を低下させないように、この充電状態切換は十分な
ノイズ電圧マージンの考慮のもとに、また信鯨性のある
状態認識の保証のもとに、できるかぎり短時間で終了さ
れなければならない。
集積密度が高（なると共に必然的にバス線が長くなり、
従ってまたバス線のキャパシタンスが大きくなり、この
ことは、充電状態切換の制御の仕方は同一であるとして
、充電状態切換の時間を長くし、従ってまた伝送速度を
低くすることに通ずる。
従ってまたバス線のキャパシタンスが大きくなり、この
ことは、充電状態切換の制御の仕方は同一であるとして
、充電状態切換の時間を長くし、従ってまた伝送速度を
低くすることに通ずる。
この問題を解決するため、たとえばドイツ連邦共和国特
許出願公開第３２２８０１３Ａ１号および米国特許第４
．４９８，０２１号明細書には、伝送すべきディジタル
情報に相応して、バス線の電圧レベルがそのままにして
おかれ、または充電状態切換段階の間に、予め定められ
たトリガレベルの到達時にバス線の追加的な加速された
放電または充電を生じさせるトリガ回路により充電状態
を切換えられる。
許出願公開第３２２８０１３Ａ１号および米国特許第４
．４９８，０２１号明細書には、伝送すべきディジタル
情報に相応して、バス線の電圧レベルがそのままにして
おかれ、または充電状態切換段階の間に、予め定められ
たトリガレベルの到達時にバス線の追加的な加速された
放電または充電を生じさせるトリガ回路により充電状態
を切換えられる。
本発明の課題は、２値レベル状態の一方から他方へ充電
状態を切換えるのに必要な時間をなお一層短縮するトリ
ガ回路をバス線に接続することである。
状態を切換えるのに必要な時間をなお一層短縮するトリ
ガ回路をバス線に接続することである。
この課題は、本発明によれば、冒頭に記載した種類のバ
ス線において、バス線がＮの部分線に分割され、その各
々が、トリガレベルをそのつどの電圧レベルと比較する
スイッチ回路を介して論理ゲートの入力端に接続されて
おり、また論理ゲートの出力端が放電トランジスタを各
個の部分線の迅速な充電状態切換のために駆動すること
により解決される。
ス線において、バス線がＮの部分線に分割され、その各
々が、トリガレベルをそのつどの電圧レベルと比較する
スイッチ回路を介して論理ゲートの入力端に接続されて
おり、また論理ゲートの出力端が放電トランジスタを各
個の部分線の迅速な充電状態切換のために駆動すること
により解決される。
その際に、先ず常に１つの部分線にのみ現れるバス線の
充電状態切換のための信号はトリガ回路により残りの部
分線に伝達される０本発明によれば、そのためにすべて
の部分線が論理ゲートを介して、すべての部分線の加速
された個別の充電状態切換が行われるように論理結合さ
れなければならない。
充電状態切換のための信号はトリガ回路により残りの部
分線に伝達される０本発明によれば、そのためにすべて
の部分線が論理ゲートを介して、すべての部分線の加速
された個別の充電状態切換が行われるように論理結合さ
れなければならない。
その際、トリガレベルが充電状態切換段階の開始後に遅
滞な（、いかなる場合でもできるかぎり早く到達される
ように、トリガレベルを選定する必要がある。
滞な（、いかなる場合でもできるかぎり早く到達される
ように、トリガレベルを選定する必要がある。
Ｎの部分線にバス線を分割することにより、を効なバス
線キャパシタンスが出力キャパシタンスの１／Ｎに、従
ってまた充電状態切換時間が既に公知のトリガ回路装置
により短縮された充電状態切換時間の１／Ｎに減じ得る
。
線キャパシタンスが出力キャパシタンスの１／Ｎに、従
ってまた充電状態切換時間が既に公知のトリガ回路装置
により短縮された充電状態切換時間の１／Ｎに減じ得る
。
〔実施例〕
図面には公知の実施形態および２つの本発明による好ま
しい実施例が示されている。これらについて以下に第１
図ないし第５図により詳細に説明する。
しい実施例が示されている。これらについて以下に第１
図ないし第５図により詳細に説明する。
第４図の公知例では、バスキャパシタンスＣＬを有する
バス線ＢＬにデータ送信キャパシタンスＤＷＩないしＤ
ＷＹおよびデータ受信器ＤＲＩないしＤＲＸが接続され
ている。同じくバス線ＢＬに接続されている予充電トラ
ンジスタＴｏを介して、バス線ＢＬが特定の電圧レベル
に予充電される。バス線ＢＬに接続されているトリガ回
路ＴＣは、電圧レベルをトリガレベルＳと比較し、また
その出力端を介して放電トランジスタＴ１に作用するス
イッチ回路ＳＧを含んでおり、放電トランジスタＴＩの
後に阻止トランジスタＴ２が接続されている。
バス線ＢＬにデータ送信キャパシタンスＤＷＩないしＤ
ＷＹおよびデータ受信器ＤＲＩないしＤＲＸが接続され
ている。同じくバス線ＢＬに接続されている予充電トラ
ンジスタＴｏを介して、バス線ＢＬが特定の電圧レベル
に予充電される。バス線ＢＬに接続されているトリガ回
路ＴＣは、電圧レベルをトリガレベルＳと比較し、また
その出力端を介して放電トランジスタＴ１に作用するス
イッチ回路ＳＧを含んでおり、放電トランジスタＴＩの
後に阻止トランジスタＴ２が接続されている。
第４図による回路装置の作動の仕方を、予充電段階およ
びそれに続く充電状態切換段階の間のバス線ＢＬ上の電
圧経過を示す第５図により説明する。予充電段階ＶＰｈ
Ｏ間は、充電信号ＰＨ１を介して駆動される予充電トラ
ンジスタＴｏを介して、供給電圧がバス線ＢＬに与えら
れ、それによってバス線ＢＬが内部の論理レベルＨに高
められる。その際に相異なる電位の間の短絡を排除する
ため、逆の充電信号ｎＰＨＩが阻止トランジスタＴ２の
ゲートに与えられる。論理レベルＨに到達した際にバス
線は２値Ｈの伝送のための準備完了状態となる。
びそれに続く充電状態切換段階の間のバス線ＢＬ上の電
圧経過を示す第５図により説明する。予充電段階ＶＰｈ
Ｏ間は、充電信号ＰＨ１を介して駆動される予充電トラ
ンジスタＴｏを介して、供給電圧がバス線ＢＬに与えら
れ、それによってバス線ＢＬが内部の論理レベルＨに高
められる。その際に相異なる電位の間の短絡を排除する
ため、逆の充電信号ｎＰＨＩが阻止トランジスタＴ２の
ゲートに与えられる。論理レベルＨに到達した際にバス
線は２値Ｈの伝送のための準備完了状態となる。
しかし２値りを伝送すべき場合には、バス線ＢＬが電圧
レベルＬに充電状態を切換えられなければならない、こ
の充電状態切換は時点ｔ工で図示され′ζいない充電状
態切換制御部によりレリーズされる。トリガ回路ＴＣを
用いない場合には、その際に電圧レベルが破線で示され
ている充電状態切換曲線ｏＴＣに従ってＨからＬに向か
って低下し、ｔＬにおいてＬ状態に達する。しかし公知
のトリガ回路ＴＣを用いれば、トリガレベルＳの到達に
より放電トランジスタＴ１が導通し、それにより斗びバ
スＭＢＬが充電状態切換曲線ｍＴｃに従って加速されて
充電状態を切換えられ、また既に時点ｔｑＬでＬ状態に
達する。放電時間はそれによりＴ ＝ ｔ、 Ｌ
ｔ Ｈから’ｒ、＝ｍｔ、Ｌ ｔｌｌに短縮する。
レベルＬに充電状態を切換えられなければならない、こ
の充電状態切換は時点ｔ工で図示され′ζいない充電状
態切換制御部によりレリーズされる。トリガ回路ＴＣを
用いない場合には、その際に電圧レベルが破線で示され
ている充電状態切換曲線ｏＴＣに従ってＨからＬに向か
って低下し、ｔＬにおいてＬ状態に達する。しかし公知
のトリガ回路ＴＣを用いれば、トリガレベルＳの到達に
より放電トランジスタＴ１が導通し、それにより斗びバ
スＭＢＬが充電状態切換曲線ｍＴｃに従って加速されて
充電状態を切換えられ、また既に時点ｔｑＬでＬ状態に
達する。放電時間はそれによりＴ ＝ ｔ、 Ｌ
ｔ Ｈから’ｒ、＝ｍｔ、Ｌ ｔｌｌに短縮する。
第４図、第５図に示す公知の回路装置と異なり、本発明
による第１図の実施例では、バス線ＢＬはパスキャパシ
タンスＣＬ／Ｎを存するＮの部分線に分割され、また１
つの共通のトリガ回路ＴＣに接続されている。その際に
３つの部分線ＢＬＡ、ＢＬＢおよびＢＬＮにそれぞれデ
ータ送信器ＤＷＡ、ＤＷＢ、・・・、ＤＷＮ、データ受
信器ＤＲＡ。
による第１図の実施例では、バス線ＢＬはパスキャパシ
タンスＣＬ／Ｎを存するＮの部分線に分割され、また１
つの共通のトリガ回路ＴＣに接続されている。その際に
３つの部分線ＢＬＡ、ＢＬＢおよびＢＬＮにそれぞれデ
ータ送信器ＤＷＡ、ＤＷＢ、・・・、ＤＷＮ、データ受
信器ＤＲＡ。
ＤＲＢ、・・・、ＤＲＮおよび予充電トランジスタＴＯ
Ａ、ＴＯＢ、・・・、ＴＯＮが付設されている。トリガ
回路ＴＣは放電トランジスタＴ１Ａ、Ｔ１Ｂ、・・・、
Ｔ１Ｎ、スイッチ回路ＳＧＡ、、ＳＧＢ、・・・、ＳＧ
Ｎ、１つの論理ゲートＬＧおよび阻止トランジスタＴ２
Ａ、７２Ｂ、・・・、Ｔ２Ｎを含んでおり、その際に阻
止トランジスタ再び回路装置の保護のために逆の充電信
号ｎＰＨＩを与えられている。
Ａ、ＴＯＢ、・・・、ＴＯＮが付設されている。トリガ
回路ＴＣは放電トランジスタＴ１Ａ、Ｔ１Ｂ、・・・、
Ｔ１Ｎ、スイッチ回路ＳＧＡ、、ＳＧＢ、・・・、ＳＧ
Ｎ、１つの論理ゲートＬＧおよび阻止トランジスタＴ２
Ａ、７２Ｂ、・・・、Ｔ２Ｎを含んでおり、その際に阻
止トランジスタ再び回路装置の保護のために逆の充電信
号ｎＰＨＩを与えられている。
そのつどのスイッチ回路ＳＧＡ、、ＳＯＢ、・・・、Ｓ
ＧＮの出力端は論理ゲートＬＧと、その出力信号が放電
トランジスタＴ１Ａ、Ｔ１Ｂ、・・・、Ｔ１Ｎに作用し
、またすべてのＮの部分線の加速された個別の充電状態
切換に通ずるように論理結合さＪ′１ている。
ＧＮの出力端は論理ゲートＬＧと、その出力信号が放電
トランジスタＴ１Ａ、Ｔ１Ｂ、・・・、Ｔ１Ｎに作用し
、またすべてのＮの部分線の加速された個別の充電状態
切換に通ずるように論理結合さＪ′１ている。
第２図には第１図による回路装置の電圧経過が示されて
いる。この回路装置でも第４図による実施例と同様に予
充電段階７２６０間に、充電信号ＰＨ１を介して予充電
トランジスタＴＯＡ、Ｔ。
いる。この回路装置でも第４図による実施例と同様に予
充電段階７２６０間に、充電信号ＰＨ１を介して予充電
トランジスタＴＯＡ、Ｔ。
Ｂ１・・・、ＴＯＮが低抵抗に切換えられることによっ
て、部分線ＢＬＡ、ＢＬＢ、・・・ＢＬＮがそのつどの
予充電トランジスタＴＯＡ、ＴＯＢ、・・・、ＴＯＮを
介して論理レベルＨに充電される。阻止トランジスタＴ
２Ａ、７２Ｂ、・・・、Ｔ２Ｎはその間に再び、詳細に
は逆の充電信号ｎＰＨＩにより高抵抗状態にある。この
回路装置ではバス線がＮの部分線に分割されているにも
かかわらず、論理レベルＨの部分線の各データ送信器か
ら各任意のデータ受信器に、すなわち他の部分線にも伝
送され得る。
て、部分線ＢＬＡ、ＢＬＢ、・・・ＢＬＮがそのつどの
予充電トランジスタＴＯＡ、ＴＯＢ、・・・、ＴＯＮを
介して論理レベルＨに充電される。阻止トランジスタＴ
２Ａ、７２Ｂ、・・・、Ｔ２Ｎはその間に再び、詳細に
は逆の充電信号ｎＰＨＩにより高抵抗状態にある。この
回路装置ではバス線がＮの部分線に分割されているにも
かかわらず、論理レベルＨの部分線の各データ送信器か
ら各任意のデータ受信器に、すなわち他の部分線にも伝
送され得る。
論理レベルＬを伝送するためには、すべてのＮの部分線
の電圧レベルが充電状態を切換えられなければならない
、この充電状態切換は書込み用データ送信器により時点
ｔ、でレリーズされる。しかし、この書込み用データ送
信器は常に１つの部分線にのみ属しているので、先ずこ
の書込み用部分線ｓＬの電圧レベルのみが下げられ、他
方において残りの部分線ｒＬはまだ出力電圧レベルにと
どまる。しかし、低下する電圧レベルが書込み用部分線
ｓＬに属するスイッチ回路のトリガレベルＳに時点ｔ’
ｓで達すると直ちに、その出力が論理ゲートＬＧに通さ
れる。これによりいますべての放電トランジスタＴ１Ａ
、Ｔ１Ｂ、・・・、Ｔ１Ｎが開かれ、また残りの部分ｗ
ＡｒＬの加速された充電状態切換が開始される。書込み
用部分線ｓＬはこうして既に時点ｔ’ｓ＋、で論理レベ
ルＬの低い電圧レベルに達し、他方において残りの部分
線「Ｌは若干高い出力レベルに基づいてその後の時点ｔ
１．で初めてこれに続く。
の電圧レベルが充電状態を切換えられなければならない
、この充電状態切換は書込み用データ送信器により時点
ｔ、でレリーズされる。しかし、この書込み用データ送
信器は常に１つの部分線にのみ属しているので、先ずこ
の書込み用部分線ｓＬの電圧レベルのみが下げられ、他
方において残りの部分線ｒＬはまだ出力電圧レベルにと
どまる。しかし、低下する電圧レベルが書込み用部分線
ｓＬに属するスイッチ回路のトリガレベルＳに時点ｔ’
ｓで達すると直ちに、その出力が論理ゲートＬＧに通さ
れる。これによりいますべての放電トランジスタＴ１Ａ
、Ｔ１Ｂ、・・・、Ｔ１Ｎが開かれ、また残りの部分ｗ
ＡｒＬの加速された充電状態切換が開始される。書込み
用部分線ｓＬはこうして既に時点ｔ’ｓ＋、で論理レベ
ルＬの低い電圧レベルに達し、他方において残りの部分
線「Ｌは若干高い出力レベルに基づいてその後の時点ｔ
１．で初めてこれに続く。
第３図には、バス線が第１図による実施例の場合のよう
にＮの部分線に分割されており、また１つの共通のトリ
ガ回路に接続されている本発明による別の回路装置が示
されている。この実施例でも訃すガ回路ＴＣは放電トラ
ンジスタＴＩＡ、Ｔ１Ｂ、・・・、Ｔ１Ｎおよび阻止ト
ランジスタＴ２Ａ、Ｔ２Ｂ、・・・、７２Ｎを含んでお
り、その際に阻止トランジスタは再び回路装置の保護の
ために逆の充電信号ｎＰＨＩを与えられている。しかし
、スイッチ回路および論理ゲートは、ここに示されてい
る実施例では、Ｎの入力端を有する１つのナンド回路ル
により置換されている。すなわち、ナンド回路を使用す
る際には、分離したスイッチ回路は省略され得る。なぜ
ならば、ナンド回路の適当な１成により、たとえば入力
トランジスタのディメンバ）ｇニングにより内部トリガ
レベルが設定され得るい 第１図および第３図による本発明による回路装置により
、残りの部分線ｒＬの放電時間Ｔ□は書込み用部分線Ｔ
ｓ’の放電時間にくらべて確かに若干長いが、全体とし
ては全放電時間が明らかに短縮される。なぜならば、Ｎ
の部分線において各線のキャパシタンスが全キセパシタ
ンスＣＬの１／Ｎであるからである。従って、トリガ回
路ＴＣを有するＮ分割されたバス線の放１を時間Ｔ工ば
トリガ回路ＴＣを有する分割されていないバス線の放電
時間Ｔｓの約１／Ｎである。
にＮの部分線に分割されており、また１つの共通のトリ
ガ回路に接続されている本発明による別の回路装置が示
されている。この実施例でも訃すガ回路ＴＣは放電トラ
ンジスタＴＩＡ、Ｔ１Ｂ、・・・、Ｔ１Ｎおよび阻止ト
ランジスタＴ２Ａ、Ｔ２Ｂ、・・・、７２Ｎを含んでお
り、その際に阻止トランジスタは再び回路装置の保護の
ために逆の充電信号ｎＰＨＩを与えられている。しかし
、スイッチ回路および論理ゲートは、ここに示されてい
る実施例では、Ｎの入力端を有する１つのナンド回路ル
により置換されている。すなわち、ナンド回路を使用す
る際には、分離したスイッチ回路は省略され得る。なぜ
ならば、ナンド回路の適当な１成により、たとえば入力
トランジスタのディメンバ）ｇニングにより内部トリガ
レベルが設定され得るい 第１図および第３図による本発明による回路装置により
、残りの部分線ｒＬの放電時間Ｔ□は書込み用部分線Ｔ
ｓ’の放電時間にくらべて確かに若干長いが、全体とし
ては全放電時間が明らかに短縮される。なぜならば、Ｎ
の部分線において各線のキャパシタンスが全キセパシタ
ンスＣＬの１／Ｎであるからである。従って、トリガ回
路ＴＣを有するＮ分割されたバス線の放１を時間Ｔ工ば
トリガ回路ＴＣを有する分割されていないバス線の放電
時間Ｔｓの約１／Ｎである。
第１図はＮ分割されたバス線に対する本発明による回路
装置を示す図、第２図は第１図による回路装置により達
成可能な電圧経過を示す図、第３図はＮ分割されたバス
線に対する本発明による他の回路装置を示す図、第４図
は集積回路の１つのバス線に接続されている公知の回路
装置を示す図、第５図は第十図による回路装置により達
成可能な電圧経過を示す図である。 ＢＬ・・・バス線 ＢＬＡ〜ＢＬＮ・・・部分線 ＣＬ・・・パスキャパシタンス ＤＲＩ〜ＤＲＸ・・・データ受信器 ＤＷＩ〜ＤＷＹ・・・データ送信器 ＬＧ・・・論理ゲート ＰＬＩ・・・充電信号 Ｓ・・・トリガレベル ＳＧＡ ＮＳＧＮ・・・スイッチ回路 ＴＯ・・・予充電トランジスタ ＴＩ・・・放電トランジスタ Ｔ２・・・阻止トランジスタ ＴＯＡ−ＴＯＮ・・・予充電トランジスタＴＩＡ−Ｔ１
Ｎ・・・放電トランジスタＴ２Ａ−７２Ｎ・・・阻止ト
ランジスタＴＣ・・・トリガ回路 ｖ ｐ ｈ・・・予充電段階 侶：、］・笛 ＦＩＧ Ｉ ＦＩＧ ２ ＦＩＧ ３
装置を示す図、第２図は第１図による回路装置により達
成可能な電圧経過を示す図、第３図はＮ分割されたバス
線に対する本発明による他の回路装置を示す図、第４図
は集積回路の１つのバス線に接続されている公知の回路
装置を示す図、第５図は第十図による回路装置により達
成可能な電圧経過を示す図である。 ＢＬ・・・バス線 ＢＬＡ〜ＢＬＮ・・・部分線 ＣＬ・・・パスキャパシタンス ＤＲＩ〜ＤＲＸ・・・データ受信器 ＤＷＩ〜ＤＷＹ・・・データ送信器 ＬＧ・・・論理ゲート ＰＬＩ・・・充電信号 Ｓ・・・トリガレベル ＳＧＡ ＮＳＧＮ・・・スイッチ回路 ＴＯ・・・予充電トランジスタ ＴＩ・・・放電トランジスタ Ｔ２・・・阻止トランジスタ ＴＯＡ−ＴＯＮ・・・予充電トランジスタＴＩＡ−Ｔ１
Ｎ・・・放電トランジスタＴ２Ａ−７２Ｎ・・・阻止ト
ランジスタＴＣ・・・トリガ回路 ｖ ｐ ｈ・・・予充電段階 侶：、］・笛 ＦＩＧ Ｉ ＦＩＧ ２ ＦＩＧ ３
Claims (1)
- 【特許請求の範囲】 １）データ送信器（ＤＷ１、・・・、ＤＷＹ）とデータ
受信器（ＤＲ１、・・・、ＤＲＸ）との間でデータを伝
送するための集積回路のバス線（ＢＬ）における回路装
置であって、予充電段階（ＶＰｈ）の間にバス線（ＢＬ
）が特定の電圧レベルに充電され、またデータ伝送段階
の間に、伝送すべきディジタル情報に相応して、バス線
（ＢＬ）の電圧レベルがそのままにしておかれ、または
充電状態切換段階の間に充電状態を切換えられ、またバ
ス線（ＢＬ）の加速された充電状態切換のためにバス線
（ＢＬ）に、予め定められたトリガレベル（Ｓ）の到達
時にバス線（ＢＬ）の追加的な加速された放電または充
電を生じさせるトリガ回路（ＴＣ）が接続されている回
路装置において、バス線（ＢＬ）がＮの部分線（ＢＬＡ
、ＢＬＢ、・・・、ＢＬＮ）に分割され、その各々が、
トリガレベル（Ｓ）をそのつどの電圧レベルと比較する
スイッチ回路（ＳＧＡ、ＳＧＢ、・・・、ＳＧＮ）を介
して論理ゲート（ＬＧ）の入力端に接続され、また論理
ゲート（ＬＧ）の出力端が放電トランジスタ（Ｔ１Ａ、
Ｔ１Ｂ、・・・、Ｔ１Ｎ）を各個の部分線の迅速な充電
状態切換のために駆動することを特徴とする集積回路の
バス線における回路装置。 ２）スイッチ回路（ＳＧＡ、ＳＧＢ、・・・、ＳＧＮ）
および論理ゲート（ＬＧ）がＮの入力端を有するナンド
回路（＆）により置換されることを特徴とする請求項１
記載の回路装置。 ３）トリガレベル（Ｓ）がナンド回路（＆）のディメン
ジョニングにより決められることを特徴とする請求項２
記載の回路装置。 ４）トリガレベル（Ｓ）が、論理レベルの間のノイズ電
圧マージンの著しい減少なしに遅滞なく達成されるよう
に選定されることを特徴とする請求項１ないし３の１つ
に記載の回路装置。
Applications Claiming Priority (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE3714134 | 1987-04-28 | ||
| DE3714134.1 | 1987-12-23 | ||
| DE3743932.4 | 1987-12-23 | ||
| DE3743932 | 1987-12-23 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63285049A true JPS63285049A (ja) | 1988-11-22 |
| JPH0821954B2 JPH0821954B2 (ja) | 1996-03-04 |
Family
ID=25855029
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63101210A Expired - Lifetime JPH0821954B2 (ja) | 1987-04-28 | 1988-04-21 | 集積回路のバス線における回路装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5004937A (ja) |
| EP (1) | EP0288740B1 (ja) |
| JP (1) | JPH0821954B2 (ja) |
| AT (1) | ATE69321T1 (ja) |
| DE (1) | DE3866003D1 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5239661A (en) * | 1989-08-18 | 1993-08-24 | Mitsubishi Denki Kabushiki Kaisha | Hierarchical bus circuit having decoder generating local buses and devices select signals enabling switching elements to perform data transfer operations |
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