JPS63278098A - 表示装置の動作方法および表示装置 - Google Patents
表示装置の動作方法および表示装置Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は表示装置に関し、さらに詳細には、例えば液晶
表示要素を用いた表示装置に関する。
表示要素を用いた表示装置に関する。
従来の液晶表示装置は液晶表示要素のラチス(latt
ice)を有しており、それらの液晶表示要素はそれぞ
れ他の要素と独立に活性化しうる専用のドライバを有し
ている。各要素のオン/オフ期間はその要素に多数の表
示輝度レベルを与えるために変調されうる。
ice)を有しており、それらの液晶表示要素はそれぞ
れ他の要素と独立に活性化しうる専用のドライバを有し
ている。各要素のオン/オフ期間はその要素に多数の表
示輝度レベルを与えるために変調されうる。
本発明は、双安定表示要素のラチスと、1つの画像に対
する表示情報を表わす信号を記憶器に入力するための手
段と、 すべての双安定表示要素に対する表示情報の対応部分よ
りなる部分における1つの画像に対する表示情報を前記
記憶器から出力するための手段と、それぞれ前記ラチス
の1つの行または列に割当てられており、前記出力手段
からの信号の該当部分に従って前記各表示要素を1つの
状態に設定する複数のドライバと、 光出力を発生する手段と、 前記出力手段からの信号の有意性に従って光出力を変調
する手段を具備した表示装置を提供する。
する表示情報を表わす信号を記憶器に入力するための手
段と、 すべての双安定表示要素に対する表示情報の対応部分よ
りなる部分における1つの画像に対する表示情報を前記
記憶器から出力するための手段と、それぞれ前記ラチス
の1つの行または列に割当てられており、前記出力手段
からの信号の該当部分に従って前記各表示要素を1つの
状態に設定する複数のドライバと、 光出力を発生する手段と、 前記出力手段からの信号の有意性に従って光出力を変調
する手段を具備した表示装置を提供する。
このようにして、本発明の表示装置は各要素に対するド
ライバを必要としないので、構成を大幅に簡潔化できる
とともに、表示装置の多重化動作が可能である。
ライバを必要としないので、構成を大幅に簡潔化できる
とともに、表示装置の多重化動作が可能である。
好ましくは、1つの画像のための信号はワード(例えば
各ワードは8ビツトよりなる)のシーケンスよりなり、
各ワードは前記ラチスにおける1つの表示要素に対する
表示情報に対応している。
各ワードは8ビツトよりなる)のシーケンスよりなり、
各ワードは前記ラチスにおける1つの表示要素に対する
表示情報に対応している。
従って、出力手段は各記憶器から、各ワードにおける最
初のビットを取り出し、そしてそれらを順次的にラチス
に送るように動作することができる。
初のビットを取り出し、そしてそれらを順次的にラチス
に送るように動作することができる。
この動作はすべてのビットがこのようにして処理される
まで反復されうる。
まで反復されうる。
表示ワードにおける所定の位置の(例えば最初の)ビッ
トはドライバに達すると各ピクセルを対応した状態に設
定する。所定のビット位置に従ってラチス全体が設定さ
れると、光変調手段は、その所定のビット位置に従って
光を出力するように動作されうる。このようにして、所
定のビット位置がそのワードにおける最初のビットであ
り、これが最上術ビットとされれば、各要素がこの状態
にある場合の光出力が全体の出力の相当大きな割合を占
める。最上術ビット設定のための光出力は上位から二番
目の桁のビット設定のための光出力の2倍であり、その
二番目の桁のビット設定のための光出力は三番目のビッ
ト設定のための光出力の2倍であり、以下同様でありう
る。光変調手段は、光出力の強度を所定のビット位置に
従って規制するための手段および/または光出力の持続
期間を所定のビット位置に従って規制するための手段を
具備しうる。
トはドライバに達すると各ピクセルを対応した状態に設
定する。所定のビット位置に従ってラチス全体が設定さ
れると、光変調手段は、その所定のビット位置に従って
光を出力するように動作されうる。このようにして、所
定のビット位置がそのワードにおける最初のビットであ
り、これが最上術ビットとされれば、各要素がこの状態
にある場合の光出力が全体の出力の相当大きな割合を占
める。最上術ビット設定のための光出力は上位から二番
目の桁のビット設定のための光出力の2倍であり、その
二番目の桁のビット設定のための光出力は三番目のビッ
ト設定のための光出力の2倍であり、以下同様でありう
る。光変調手段は、光出力の強度を所定のビット位置に
従って規制するための手段および/または光出力の持続
期間を所定のビット位置に従って規制するための手段を
具備しうる。
好ましくは、この表示装置は所定のビット位置に対して
要素を設定しているあいだそれらの要素をブランクにす
るための手段を具備しうる。
要素を設定しているあいだそれらの要素をブランクにす
るための手段を具備しうる。
カラー表示のためには、この表示装置はそれぞれ3つの
表示要素を含む複数のグループで形成されたラチスを有
し、各グループの各要素は異なるカラーを発生しかつ別
々に設定されることが好ましい、他の実施例では、その
ラチスは単一のすなわちグループ化されていない表示要
素で形成され、それらの要素がそれぞれ3つのカラーの
光に順次的に露光され、各露光が終ると1個の要素がリ
セットされるようになされる。
表示要素を含む複数のグループで形成されたラチスを有
し、各グループの各要素は異なるカラーを発生しかつ別
々に設定されることが好ましい、他の実施例では、その
ラチスは単一のすなわちグループ化されていない表示要
素で形成され、それらの要素がそれぞれ3つのカラーの
光に順次的に露光され、各露光が終ると1個の要素がリ
セットされるようになされる。
本発明はまた、双安定表示要素のラチスを有するグレー
スケール表示装置を動作させる方法において、 1つの画像のための表示情報を表わす信号を記憶器に入
力し、 前記双安定表示要素のすべてに対する表示情報の対応部
分よりなる1つの画像のための表示情報の部分を前記記
憶器から出力し、 前記ラチスの行または列にそれぞれ割当てられた複数の
ドライバを用いて前記出力により得られた信号の該当部
分に従って前記各表示要素を1つの状態に設定し、 前記表示要素が設定されると、ビデオ信号の部分の有意
性に従って変調された光出力を発生し、前記双安定表示
要素のすべてに対する表示情報の異なる対応部分よりな
る前記表示情報の第2の部分を前記記憶器から出力しか
つ前記第2の部分に対する設定および変調動作を行い、 任意の他の対応部分に対して前記出力、設定および変調
動作を反復して行うことよりなる方法を提供する。
スケール表示装置を動作させる方法において、 1つの画像のための表示情報を表わす信号を記憶器に入
力し、 前記双安定表示要素のすべてに対する表示情報の対応部
分よりなる1つの画像のための表示情報の部分を前記記
憶器から出力し、 前記ラチスの行または列にそれぞれ割当てられた複数の
ドライバを用いて前記出力により得られた信号の該当部
分に従って前記各表示要素を1つの状態に設定し、 前記表示要素が設定されると、ビデオ信号の部分の有意
性に従って変調された光出力を発生し、前記双安定表示
要素のすべてに対する表示情報の異なる対応部分よりな
る前記表示情報の第2の部分を前記記憶器から出力しか
つ前記第2の部分に対する設定および変調動作を行い、 任意の他の対応部分に対して前記出力、設定および変調
動作を反復して行うことよりなる方法を提供する。
好ましくは、上記信号は各要素に対して8ビット・ワー
ドよりなり、各ワードの最上Jα桁ビットが表示を設定
するために記憶器から最初に出力される。その後で、各
ワードの上から二番目の桁のビットが設定および表示の
ために記憶器から出力され、この場合の全光出力は前の
出力の半分である。最下位桁のビットが表示されるまで
このシーケンスが反復される。
ドよりなり、各ワードの最上Jα桁ビットが表示を設定
するために記憶器から最初に出力される。その後で、各
ワードの上から二番目の桁のビットが設定および表示の
ために記憶器から出力され、この場合の全光出力は前の
出力の半分である。最下位桁のビットが表示されるまで
このシーケンスが反復される。
好ましくは、光出力の変調は光の強度および/または光
出力の持続期間を調整することによって行われる。
出力の持続期間を調整することによって行われる。
好ましくは、ラチスの各行および列は別々のドライバを
有している。あるいは、各列は別々のドライバを有し、
幾つかのあるいはすべての行は共通のドライバを有する
。
有している。あるいは、各列は別々のドライバを有し、
幾つかのあるいはすべての行は共通のドライバを有する
。
好ましくは、表示要素は1つまたはそれ以上の選択的に
設定可能な液晶セルよりなる。
設定可能な液晶セルよりなる。
本発明は、例えば蛍光管によって背後から照明される液
晶パネルの1つの表面上に映像が映出されるものや、あ
るいは光ビームの通路内に配置された液晶パネルによっ
て映像がスクリーン上に投影されるもの等の多くの形式
の表示装置に適用しうる。また、本発明はカラー表示装
置および白黒表示装置の両方に適用しうる。
晶パネルの1つの表面上に映像が映出されるものや、あ
るいは光ビームの通路内に配置された液晶パネルによっ
て映像がスクリーン上に投影されるもの等の多くの形式
の表示装置に適用しうる。また、本発明はカラー表示装
置および白黒表示装置の両方に適用しうる。
さらにまた、本発明は本明細書で定義されている表示装
置に適したおよび/またはそのために設計された信号の
発生、および/または伝送、および/または受信、およ
び/または処理のための装置としても実施しうる。
置に適したおよび/またはそのために設計された信号の
発生、および/または伝送、および/または受信、およ
び/または処理のための装置としても実施しうる。
以下図面を参照して本発明の実施例につき説明しよう。
第1図のテレビ受像機1は液晶材料で作成された表示要
素3のラチスで形成された液晶表示装置2を有しており
、各要素は個々に作動しうる。要素3のラチスは、光強
度と動作の持続期間を制御しうる多数の螢光管4によっ
て背面照明される。
素3のラチスで形成された液晶表示装置2を有しており
、各要素は個々に作動しうる。要素3のラチスは、光強
度と動作の持続期間を制御しうる多数の螢光管4によっ
て背面照明される。
テレビ受像機の人力のためのビデオ信号は14m5の走
査期間を与える70Hz走査速度を有し、かつ表示情報
の各画像に各表示要素に対する8ビット・ワードを含ん
でおり、1つのワードは最下位桁ビットで始まり、最下
位桁ビットで終る。この信号がアンテナ5を通じて受像
機lに入力されると、表示情報の1つの画像がフレーム
記憶器6に送られる。
査期間を与える70Hz走査速度を有し、かつ表示情報
の各画像に各表示要素に対する8ビット・ワードを含ん
でおり、1つのワードは最下位桁ビットで始まり、最下
位桁ビットで終る。この信号がアンテナ5を通じて受像
機lに入力されると、表示情報の1つの画像がフレーム
記憶器6に送られる。
ワードの最上位桁ビットの表示のための処理において、
フレーム記憶器6は各ワードの最初のビットを出力しそ
してラチスの各行と列に対して1つずつ割当てられたド
ライバ8のアレイに対する制御ユニット7にそれらのビ
ットを送る。そのドライバ・アレイは各要素をそれの最
上位桁ビア)に該当する状態(オンまたはオフ)に設定
する。
フレーム記憶器6は各ワードの最初のビットを出力しそ
してラチスの各行と列に対して1つずつ割当てられたド
ライバ8のアレイに対する制御ユニット7にそれらのビ
ットを送る。そのドライバ・アレイは各要素をそれの最
上位桁ビア)に該当する状態(オンまたはオフ)に設定
する。
ドライバ8のアレイがすべての要素を設定すると(所要
時間は1mS以下)、ドライバ制御ユニット7が光スィ
ッチ・ユニット9に指令を与え、そのユニット9が該当
するビット位置(この場合には最上位桁ビット)をチェ
ックし、そして3mSの時間のあいだかつ適当な出力を
与えるための輝度で螢光管4を作動させる。
時間は1mS以下)、ドライバ制御ユニット7が光スィ
ッチ・ユニット9に指令を与え、そのユニット9が該当
するビット位置(この場合には最上位桁ビット)をチェ
ックし、そして3mSの時間のあいだかつ適当な出力を
与えるための輝度で螢光管4を作動させる。
所要の出力が得られると、光スィッチ・ユニット9が螢
光管4を非動作状態にしかつフレーム記憶器6に指令し
、このフレーム記憶器6はドライバ制御ユニット7に対
して上位から二番目の桁のビットを出力するように進行
し、それによりすべての要素をこのビット位置に対して
設定する。この時点で、光スィッチ・ユニット9が前の
期間の半分(すなわち1.5m S )だけかつ同じ強
度で螢光管を動作させ、最上位桁ビットに対する出力の
半分の出力を発生させる。ワードのすべての8ビツトに
対してこのルーチンが反復され、光出力はその都度半分
になる。最下位桁ビットが表示されると(光出力の存続
期間は253である)、記憶器6が空にされ、そして表
示情報の次の画像が人力されかつ上述した処理が反復さ
れる。
光管4を非動作状態にしかつフレーム記憶器6に指令し
、このフレーム記憶器6はドライバ制御ユニット7に対
して上位から二番目の桁のビットを出力するように進行
し、それによりすべての要素をこのビット位置に対して
設定する。この時点で、光スィッチ・ユニット9が前の
期間の半分(すなわち1.5m S )だけかつ同じ強
度で螢光管を動作させ、最上位桁ビットに対する出力の
半分の出力を発生させる。ワードのすべての8ビツトに
対してこのルーチンが反復され、光出力はその都度半分
になる。最下位桁ビットが表示されると(光出力の存続
期間は253である)、記憶器6が空にされ、そして表
示情報の次の画像が人力されかつ上述した処理が反復さ
れる。
第2図は強誘電性液晶表示パネルのような双安定表示装
置上にオフエア・ビデオ画像を表示するためのシステム
10のブロック図である。ビデオ情報がアンテナ11で
受信されそして受信機12によって復調され、次にディ
ジタル化され(各ピクセルにつき4ビツト)そしてディ
ジタル・フレーム記憶器13に保持される。
置上にオフエア・ビデオ画像を表示するためのシステム
10のブロック図である。ビデオ情報がアンテナ11で
受信されそして受信機12によって復調され、次にディ
ジタル化され(各ピクセルにつき4ビツト)そしてディ
ジタル・フレーム記憶器13に保持される。
1つのビデオ・フレームを表示するためには、まずデー
タが4つの流れ(各ビットに対して1つ辺流れ)に分割
され、そして各バイトが8つのピクセルに対するデータ
を含むようにシフトレジスタ14によって圧縮される0
次にそのデータが4つのバッファRAM 15にロード
され、各RAMはビデオ情報の1つのフレームを1ビツ
トの深すで含む、RAM 15およびフレーム記憶器の
アクセスはアドレス発生器16の制御のもとで行われる
。
タが4つの流れ(各ビットに対して1つ辺流れ)に分割
され、そして各バイトが8つのピクセルに対するデータ
を含むようにシフトレジスタ14によって圧縮される0
次にそのデータが4つのバッファRAM 15にロード
され、各RAMはビデオ情報の1つのフレームを1ビツ
トの深すで含む、RAM 15およびフレーム記憶器の
アクセスはアドレス発生器16の制御のもとで行われる
。
順次的なグレースケール処理のために、データが一度に
1ビツトずつ表示装置に送られ、すなわち、RAM
Oからのすべてのデータが表示装置に送られ(最下位桁
ビット)、これに続いて他の3つのRAMのそれぞれか
らのデータが送られる。
1ビツトずつ表示装置に送られ、すなわち、RAM
Oからのすべてのデータが表示装置に送られ(最下位桁
ビット)、これに続いて他の3つのRAMのそれぞれか
らのデータが送られる。
また、液晶表示パネルにデータを書込むために、データ
の各ラインが多重方式によって決定された態様で呈示さ
れなければならない、この処理はデータ準備ブロック1
7によって行われる。データは多重制御器ブロック18
の制御のもとて表示パネルに送られうる形式を有してお
り、データの各ラインは列駆動チップ19内にラッチさ
れ、他方、行は行駆動チップ20によってストローブさ
れる。
の各ラインが多重方式によって決定された態様で呈示さ
れなければならない、この処理はデータ準備ブロック1
7によって行われる。データは多重制御器ブロック18
の制御のもとて表示パネルに送られうる形式を有してお
り、データの各ラインは列駆動チップ19内にラッチさ
れ、他方、行は行駆動チップ20によってストローブさ
れる。
この結果、データが表示装置にラッチされる。データの
完全なスクリーンが書き込まれた後で、表示されている
ビットの桁に対応した時間長さのあいだ背光がフランシ
ュされる。これは多重制御器ブロック18の制御のもと
てランプ駆動回路20によって行われる。
完全なスクリーンが書き込まれた後で、表示されている
ビットの桁に対応した時間長さのあいだ背光がフランシ
ュされる。これは多重制御器ブロック18の制御のもと
てランプ駆動回路20によって行われる。
16のグレーレベルをともなう完全な画像が表示される
ことになる事象のシーケンスは次の通りである。
ことになる事象のシーケンスは次の通りである。
1、フレーム記憶器13にロードする。
2、各バッファRAM 15に1つの有意ビットをロー
ドする。
ドする。
3、バッファRAM Oからのデータをラインごとに
データ準備ユニット17にロードする。
データ準備ユニット17にロードする。
4、バッファRAM 1からのデータをラインごとにデ
ータ準備ユニット17にロードする。
ータ準備ユニット17にロードする。
5、バッファRAM 2からのデータをラインごとにデ
ータ準備ユニット17にロードする。
ータ準備ユニット17にロードする。
6、バッファRAM 3からのデータをラインごとにデ
ータ準備ユニット17にロードする。
ータ準備ユニット17にロードする。
7、多重制御器ブロック18がデータ準備ユニット17
からのデータを列駆動チップ119に転送しかつ行駆動
チップ20を制御する。
からのデータを列駆動チップ119に転送しかつ行駆動
チップ20を制御する。
8、RAM0からのデータが表示装置にラッチされると
(すなわちフレームに対する最下位桁ビットが与えられ
ている場合に)、多重wI御器18がランプ駆動回路に
18号を送り、A msの時間のあいだフランシュす
る。
(すなわちフレームに対する最下位桁ビットが与えられ
ている場合に)、多重wI御器18がランプ駆動回路に
18号を送り、A msの時間のあいだフランシュす
る。
9゜RAM 1からのデータがラッチされ、背光が2A
msのあいだフラッシュされる。
msのあいだフラッシュされる。
10、RAM2からのデータがラッチされ、かつ背光が
4A mSのあいだフラッシュされる。
4A mSのあいだフラッシュされる。
11、 RAM 3からのデータがラッチされ、かつ背
光が8A mSのあいだフランシュされる。
光が8A mSのあいだフランシュされる。
12、画像が表示される。
40mSのフレーム時間を仮定して、表示を設定するの
にT msかかるとすると、4T+15A” =4
0mSとなる。
にT msかかるとすると、4T+15A” =4
0mSとなる。
第3図は、第1図および第2図のグレースケール処理に
加えであるいはそれに代えて使用するための2ビツト・
グレースケールを得るための液晶表示パネルの金属化パ
ターンの配列を示している。
加えであるいはそれに代えて使用するための2ビツト・
グレースケールを得るための液晶表示パネルの金属化パ
ターンの配列を示している。
列電極を有する基板30上では、ITO金IE 化ハタ
ーンは、各ビクセルが2つの部分31,32を有し、そ
れらの部分31,32がそれぞれライン35および36
を通じて可撓性pcbボード33および34上の適当な
駆動チップ(図示せず)によって別々に駆動される。各
ピクセルにおいて、部分31は最下位桁ビットに対応し
、部分32は最上位桁ビットに対応する0行電極は基板
3゛8上のITO金属化ストリップ37によって形成さ
れており、それらの電極はライン40を通じて可撓性p
cb39上の行駆動チップ(図示せず)によってストロ
ーブされうる。第3図の左側部分において、図示を簡単
にするために、基板は一点鎖線によって示されて省略さ
れており、列金属化部分が行金属化部分の上に存在する
ものとして示されている。
ーンは、各ビクセルが2つの部分31,32を有し、そ
れらの部分31,32がそれぞれライン35および36
を通じて可撓性pcbボード33および34上の適当な
駆動チップ(図示せず)によって別々に駆動される。各
ピクセルにおいて、部分31は最下位桁ビットに対応し
、部分32は最上位桁ビットに対応する0行電極は基板
3゛8上のITO金属化ストリップ37によって形成さ
れており、それらの電極はライン40を通じて可撓性p
cb39上の行駆動チップ(図示せず)によってストロ
ーブされうる。第3図の左側部分において、図示を簡単
にするために、基板は一点鎖線によって示されて省略さ
れており、列金属化部分が行金属化部分の上に存在する
ものとして示されている。
第1図は本発明による表示装置のブロック図、第2図は
本発明による表示装置の他のブロック図、第3図は本発
明による表示装置におけるピクセル配列を示す図である
。 図面において、1はテレビ受像機、2は表示装置、3は
表示装置、4は螢光管、5はアンテナ、6はフレーム記
憶器、7は制御ユニット、8はドライバ、9は光スィッ
チ・ユニット、13はフレーム記憶器、14はシフトレ
ジスタ、15はバッファRAM、16はアドレス発生器
、17はデータ準備ブロック、18は多重制御器ブロッ
ク、19は列駆動チップ、20は行駆動チップである。
本発明による表示装置の他のブロック図、第3図は本発
明による表示装置におけるピクセル配列を示す図である
。 図面において、1はテレビ受像機、2は表示装置、3は
表示装置、4は螢光管、5はアンテナ、6はフレーム記
憶器、7は制御ユニット、8はドライバ、9は光スィッ
チ・ユニット、13はフレーム記憶器、14はシフトレ
ジスタ、15はバッファRAM、16はアドレス発生器
、17はデータ準備ブロック、18は多重制御器ブロッ
ク、19は列駆動チップ、20は行駆動チップである。
Claims (1)
- 【特許請求の範囲】 1、双安定表示要素のラチスを有するグレースケール表
示装置を動作させる方法において、1つの画像のための
表示情報を表わす信号を記憶器に入力し、 前記双安定表示要素のすべてに対する表示情報の対応部
分よりなる1つの画像のための表示情報の部分を前記記
憶器から出力し、 前記ラチスの行または列にそれぞれ割当てられた複数の
ドライバを用いて前記出力により得られた信号の該当部
分に従って前記各表示要素を1つの状態に設定し、 前記表示要素が設定されると、ビデオ信号の部分の有意
性に従って変調された光出力を発生し、前記双安定表示
要素のすべてに対する表示情報の異なる対応部分よりな
る前記表示情報の第2の部分を前記記憶器から出力しか
つ前記第2の部分に対する設定および変調動作を行い、 任意の他の対応部分に対して前記出力、設定および変調
動作を反復して行うことよりなる方法。 2、特許請求の範囲第1項記載の方法において、前記信
号は各要素に対して8ビット・ワードよりなり、それら
のワードが設定および表示のために前記記憶器から最初
に出力されると、それらのワードの予め定められた桁の
ビットが、そしてその後で他の桁のビットが設定および
表示のための前記記憶器から出力され、全光出力が前の
出力の適当な割合を占め、すべてのビットが表示される
までこのシーケンスが反復される前記方法。 3、特許請求の範囲第1項または第2項記載の方法にお
いて、光出力の変調が光強度および/または光出力の存
続期間の調整によって行われる前記方法。 4、双安定表示要素のラチスと、 1つの画像に対する表示情報を表わす信号を記憶器に入
力するための手段と、 すべての双安定表示要素に対する表示情報の対応部分よ
りなる部分における1つの画像に対する表示情報を前記
記憶器から出力するための手段と、それぞれ前記ラチス
の1つの行または列に割当てられており、前記出力手段
からの信号の該当部分に従って前記各表示要素を1つの
状態に設定する複数のドライバと、 光出力を発生する手段と、 前記出力手段からの信号の有意性に従って光出力を変調
する手段を具備した表示装置。 5、特許請求の範囲第4項記載の表示装置において、1
つの画像に対する信号はそれぞれ前記ラチスの1つの表
示要素に対する表示情報に対応するワードのシーケンス
よりなり、かつ前記出力手段は各ワードの最初のビット
を前記記憶器から取り出してそれらを前記ラチスに順次
的に送り、そして各ワードの二番目のビットを前記記憶
器から取り出してそれらを前記ラチスに順次的に送り、
すべてのビットがそのように処理されるまでこの動作を
反復するようになされた手段を有している前記表示装置
。 6、特許請求の範囲第4項または第5項記載の表示装置
において、前記光変調手段は所定のビット位置に従って
光出力の強度を調整するための手段、および/または所
定のビット位置に従って光出力の存続期間を調整するた
めの手段を有している前記表示装置。 7、特許請求の範囲第4〜6項のうちの1つに記載され
た表示装置において、所定のビット位置に対して前記表
示要素を設定しているあいだそれらの要素をブランクに
する手段を具備している前記表示装置。 8、特許請求の範囲第4〜7項のうちの1つに記載され
た表示装置において、それぞれ3つの表示要素を含むグ
ループで形成されたラチスを具備しており、1つのグル
ープにおける各要素が異なるカラーを発生しかつ別々に
設定される前記表示装置。 9、特許請求の範囲第4〜8項のうちの1つに記載され
た表示装置において、前記ラチスが複数の単一表示要素
で形成されており、それらの要素はそれぞれ3つのカラ
ーの光に順次的に露光され、各露光のあとでリセットさ
れるようになされた前記表示装置。 10、特許請求の範囲第4〜9項のうちの1つに記載さ
れた表示装置において、各行および列が別々のドライバ
を有している前記表示装置。 11、特許請求の範囲第4〜10項のうちの1つに記載
された表示装置において、表示要素が選択的に設定可能
な液晶セルよりなる前記表示装置。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
GB868622711A GB8622711D0 (en) | 1986-09-20 | 1986-09-20 | Display device |
GB8622711 | 1987-07-09 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63278098A true JPS63278098A (ja) | 1988-11-15 |
Family
ID=10604535
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62235067A Pending JPS63278098A (ja) | 1986-09-20 | 1987-09-21 | 表示装置の動作方法および表示装置 |
Country Status (8)
Country | Link |
---|---|
EP (1) | EP0261897B1 (ja) |
JP (1) | JPS63278098A (ja) |
AT (1) | ATE79684T1 (ja) |
CA (1) | CA1295062C (ja) |
DE (1) | DE3781231T2 (ja) |
ES (1) | ES2033863T3 (ja) |
GB (1) | GB8622711D0 (ja) |
GR (1) | GR3005490T3 (ja) |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CA2063744C (en) * | 1991-04-01 | 2002-10-08 | Paul M. Urbanus | Digital micromirror device architecture and timing for use in a pulse-width modulated display system |
US6674562B1 (en) | 1994-05-05 | 2004-01-06 | Iridigm Display Corporation | Interferometric modulation of radiation |
US5668611A (en) * | 1994-12-21 | 1997-09-16 | Hughes Electronics | Full color sequential image projection system incorporating pulse rate modulated illumination |
GB2317290B (en) * | 1996-09-11 | 2000-12-06 | Seos Displays Ltd | Image display apparatus |
US8928967B2 (en) | 1998-04-08 | 2015-01-06 | Qualcomm Mems Technologies, Inc. | Method and device for modulating light |
WO1999052006A2 (en) | 1998-04-08 | 1999-10-14 | Etalon, Inc. | Interferometric modulation of radiation |
US7920135B2 (en) | 2004-09-27 | 2011-04-05 | Qualcomm Mems Technologies, Inc. | Method and system for driving a bi-stable display |
US7583429B2 (en) | 2004-09-27 | 2009-09-01 | Idc, Llc | Ornamental display device |
US7653371B2 (en) | 2004-09-27 | 2010-01-26 | Qualcomm Mems Technologies, Inc. | Selectable capacitance circuit |
US7808703B2 (en) | 2004-09-27 | 2010-10-05 | Qualcomm Mems Technologies, Inc. | System and method for implementation of interferometric modulator displays |
US7916980B2 (en) | 2006-01-13 | 2011-03-29 | Qualcomm Mems Technologies, Inc. | Interconnect structure for MEMS device |
US7903047B2 (en) | 2006-04-17 | 2011-03-08 | Qualcomm Mems Technologies, Inc. | Mode indicator for interferometric modulator displays |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5968784A (ja) * | 1982-10-13 | 1984-04-18 | シャープ株式会社 | ドツトマトリツクス表示パネルの駆動装置 |
JPS6169036A (ja) * | 1984-08-18 | 1986-04-09 | Canon Inc | 表示装置 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4006298A (en) * | 1975-05-20 | 1977-02-01 | Gte Laboratories Incorporated | Bistable matrix television display system |
US4378568A (en) * | 1981-01-29 | 1983-03-29 | Eastman Kodak Company | Light valve imaging apparatus and method for providing gray scale |
US4559535A (en) * | 1982-07-12 | 1985-12-17 | Sigmatron Nova, Inc. | System for displaying information with multiple shades of a color on a thin-film EL matrix display panel |
US4709995A (en) * | 1984-08-18 | 1987-12-01 | Canon Kabushiki Kaisha | Ferroelectric display panel and driving method therefor to achieve gray scale |
EP0193728B1 (en) * | 1985-03-08 | 1992-08-19 | Ascii Corporation | Display control system |
-
1986
- 1986-09-20 GB GB868622711A patent/GB8622711D0/en active Pending
-
1987
- 1987-09-18 DE DE8787308310T patent/DE3781231T2/de not_active Expired - Fee Related
- 1987-09-18 ES ES198787308310T patent/ES2033863T3/es not_active Expired - Lifetime
- 1987-09-18 EP EP87308310A patent/EP0261897B1/en not_active Expired - Lifetime
- 1987-09-18 AT AT87308310T patent/ATE79684T1/de not_active IP Right Cessation
- 1987-09-21 JP JP62235067A patent/JPS63278098A/ja active Pending
- 1987-09-21 CA CA000547373A patent/CA1295062C/en not_active Expired - Lifetime
-
1992
- 1992-08-20 GR GR920401830T patent/GR3005490T3/el unknown
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5968784A (ja) * | 1982-10-13 | 1984-04-18 | シャープ株式会社 | ドツトマトリツクス表示パネルの駆動装置 |
JPS6169036A (ja) * | 1984-08-18 | 1986-04-09 | Canon Inc | 表示装置 |
Also Published As
Publication number | Publication date |
---|---|
CA1295062C (en) | 1992-01-28 |
ATE79684T1 (de) | 1992-09-15 |
EP0261897B1 (en) | 1992-08-19 |
GR3005490T3 (ja) | 1993-05-24 |
EP0261897A3 (en) | 1989-01-18 |
EP0261897A2 (en) | 1988-03-30 |
DE3781231D1 (de) | 1992-09-24 |
DE3781231T2 (de) | 1993-03-11 |
ES2033863T3 (es) | 1993-04-01 |
GB8622711D0 (en) | 1986-10-29 |
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