JPS63276324A - 電力変換器の出力回路 - Google Patents
電力変換器の出力回路Info
- Publication number
- JPS63276324A JPS63276324A JP11159487A JP11159487A JPS63276324A JP S63276324 A JPS63276324 A JP S63276324A JP 11159487 A JP11159487 A JP 11159487A JP 11159487 A JP11159487 A JP 11159487A JP S63276324 A JPS63276324 A JP S63276324A
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- JP
- Japan
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- transistor
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- turned
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- power converter
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- Pending
Links
- 230000002411 adverse Effects 0.000 abstract description 4
- 230000000694 effects Effects 0.000 abstract description 4
- 230000006378 damage Effects 0.000 abstract description 2
- 230000006866 deterioration Effects 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 7
- 238000010304 firing Methods 0.000 description 7
- 238000005516 engineering process Methods 0.000 description 1
- 230000001939 inductive effect Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、トランジスタの誤点弧防止を兼ねた電力変
換器の出力回路に関するものである。
換器の出力回路に関するものである。
第２図は、例えは、三菱電機（株）昭和６０年１０月２
８日発行「′″８６三菱半導体データブック汎用工Ｏ編
Ｊ Ｐ、６−６５に示された従来の電力変換器の出力回
路の回路図で、（１）は第１のトランジスタ、（２）は
第２のトランジスタ、（３）は第１の還流ダイオード、
を改善する抵抗である０ 次に動作について説明する。
８日発行「′″８６三菱半導体データブック汎用工Ｏ編
Ｊ Ｐ、６−６５に示された従来の電力変換器の出力回
路の回路図で、（１）は第１のトランジスタ、（２）は
第２のトランジスタ、（３）は第１の還流ダイオード、
を改善する抵抗である０ 次に動作について説明する。
第３ 図Ｈ、ｎ ｐ ｎ ）ランジスタの接合容量を含
めて示す等価回路図である。
めて示す等価回路図である。
トランジスタは、例えば第３図に示したｎｐｎトランジ
スタのように、電極間に容量が存在する。
スタのように、電極間に容量が存在する。
このため、第３図で、コレクタ・エミッタ間に電圧変動
が印加されると１コレクタ・エミッタ間の容量ヲ通して
ベース電流が供給され誤点弧を生ずることがある。この
ことは、構造上すべてのトランジスタに共通である。
が印加されると１コレクタ・エミッタ間の容量ヲ通して
ベース電流が供給され誤点弧を生ずることがある。この
ことは、構造上すべてのトランジスタに共通である。
電力変換器の出力回路では、誘導性負荷が出力に接続さ
れた場合、第２のトランジスタ（２）のオンと第１のダ
イオード（３）のオンとが交互に繰り返えされ、第１の
トランジスタ（１）のコレクタ・エミッタ間に、直流電
源（５）の電圧程度の電圧変動が急峻に加えられる状態
が存在し得る。
れた場合、第２のトランジスタ（２）のオンと第１のダ
イオード（３）のオンとが交互に繰り返えされ、第１の
トランジスタ（１）のコレクタ・エミッタ間に、直流電
源（５）の電圧程度の電圧変動が急峻に加えられる状態
が存在し得る。
従って、従来の電力変換器の出力回路では）第１のトラ
ンジスタ（１）のベース・エミッタ間に抵抗（７）を接
続し、誤点弧を防止している。
ンジスタ（１）のベース・エミッタ間に抵抗（７）を接
続し、誤点弧を防止している。
上記のような従来の電力変換器の出力回路では、第１の
トランジスタ（１〕のベース・エミッタ間に抵抗（７）
が接続されているので、第１のトランジスタ（１）のオ
ン特性が悪化するという問題点があった。
トランジスタ（１〕のベース・エミッタ間に抵抗（７）
が接続されているので、第１のトランジスタ（１）のオ
ン特性が悪化するという問題点があった。
この発明は、かかる問題点を解決するためになされたも
ので、トランジスタのオン特性に悪影響を及ぼさずに誤
点弧を防止することを目的とする◇〔問題点を解決する
ための手段〕 この発明に係る電力変換器の出力回路は、第２のトラン
ジスタとともにオン・オフし、第２のトランジスタがオ
ン状態のときは第１のトランジスタのベースを低電位に
抑え、第１のトランジスタの誤点弧を防止するために、
新たに第３のトランジスタを設けたものである。
ので、トランジスタのオン特性に悪影響を及ぼさずに誤
点弧を防止することを目的とする◇〔問題点を解決する
ための手段〕 この発明に係る電力変換器の出力回路は、第２のトラン
ジスタとともにオン・オフし、第２のトランジスタがオ
ン状態のときは第１のトランジスタのベースを低電位に
抑え、第１のトランジスタの誤点弧を防止するために、
新たに第３のトランジスタを設けたものである。
この発明においては、新たに設けられた第３のトランジ
スタにより、出力トランジスタの制御電極のｔ位を低く
保ち、誤点弧を抑制する。
スタにより、出力トランジスタの制御電極のｔ位を低く
保ち、誤点弧を抑制する。
第１図は、この発明の一実施例を示す回路図であり、（
１）〜（６）は上記従来回路と全く同一のものである。
１）〜（６）は上記従来回路と全く同一のものである。
（８）はベースおよびエミッタが第２のトランジスタ（
２）のベースおよびエミッタとそれぞれ共通に接続され
、コレクタが第１のトランジスタ（１）のベースに接続
された第３のトランジスタである。
２）のベースおよびエミッタとそれぞれ共通に接続され
、コレクタが第１のトランジスタ（１）のベースに接続
された第３のトランジスタである。
上記のように構成されたこの実施例の電力変換器の出力
回路においては、第１のトランジスタ（１）がオンの時
には、第３のトランジスタ（８）は必スオフとなってい
るので、第３のトランジスタ（８）の接続によりオン特
性に悪影響を与えることはない。
回路においては、第１のトランジスタ（１）がオンの時
には、第３のトランジスタ（８）は必スオフとなってい
るので、第３のトランジスタ（８）の接続によりオン特
性に悪影響を与えることはない。
そして、第２のトランジスタ（２）がオンとなる時には
、第３のトランジスタ（８）も同時にオンとなり、第１
のトランジスタ（１）のベースとエミッタとをほぼ同電
位に保つので、上記従来例で述べた誤点弧を防止できる
。また、出力に接続された負荷により、第１のダイオー
ド（３）がオンとなる状態の時には、第２のトランジス
タ（２）はオフであり、当然筒３のトランジスタ（８）
もオフとなっているので、第１のトランジスタ（１）の
エミッタ・ベース間に高電圧が印加され破壊に到ること
も無い。
、第３のトランジスタ（８）も同時にオンとなり、第１
のトランジスタ（１）のベースとエミッタとをほぼ同電
位に保つので、上記従来例で述べた誤点弧を防止できる
。また、出力に接続された負荷により、第１のダイオー
ド（３）がオンとなる状態の時には、第２のトランジス
タ（２）はオフであり、当然筒３のトランジスタ（８）
もオフとなっているので、第１のトランジスタ（１）の
エミッタ・ベース間に高電圧が印加され破壊に到ること
も無い。
この発明は、以上説明したとおり、トランジスタを新た
に装備することにより、出力トランジスタのオン特性に
悪影響を与えずに誤点弧を防止し、出力トランジスタの
劣化・破損を抑制する効果がある。
に装備することにより、出力トランジスタのオン特性に
悪影響を与えずに誤点弧を防止し、出力トランジスタの
劣化・破損を抑制する効果がある。
第１図はこの発明の一実施例を示す回路図、第２図は従
来の電力変換器の出力回路を示す回路図、第３図は第１
図及び第２図の回路動作を説明するためのｎｐｎ）ラン
ジスタの等価回路図である。 図にお−て、（１）は第１のトランジスタ、（２）は第
２のトランジスタ、（３）は第１のダイオード、（４）
は第２のダイオード、（５）は直流電源、（６）は出力
端子、（８）は第３のトランジスタである。 なお、図中、同一符号は同一または相当部分を示す。
来の電力変換器の出力回路を示す回路図、第３図は第１
図及び第２図の回路動作を説明するためのｎｐｎ）ラン
ジスタの等価回路図である。 図にお−て、（１）は第１のトランジスタ、（２）は第
２のトランジスタ、（３）は第１のダイオード、（４）
は第２のダイオード、（５）は直流電源、（６）は出力
端子、（８）は第３のトランジスタである。 なお、図中、同一符号は同一または相当部分を示す。
Claims (1)
- （１）直流電源の両端間に第１及び第２のトランジスタ
の直列接続体を上記第１のトランジスタが上記直流電源
の高電位側にあるように接続し、第１及び第２のダイオ
ードをそれぞれ上記第１及び第２のトランジスタと逆並
列に接続し、 上記第１及び第２のトランジスタの直列接続点から出力
端子を引出して、１相分を構成した電力変換器の出力回
路において、 上記第２のトランジスタと同一導電形を有し、上記第２
のトランジスタの上記出力端子へ接続された第１の主電
極を除いた第２の主電極及び制御電極にそれぞれ対応す
る電極が接続され、 第１の主電極が上記第１のトランジスタの制御電極に接
続された第３のトランジスタを備えたことを特徴とする
電力変換器の出力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11159487A JPS63276324A (ja) | 1987-05-07 | 1987-05-07 | 電力変換器の出力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11159487A JPS63276324A (ja) | 1987-05-07 | 1987-05-07 | 電力変換器の出力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63276324A true JPS63276324A (ja) | 1988-11-14 |
Family
ID=14565319
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11159487A Pending JPS63276324A (ja) | 1987-05-07 | 1987-05-07 | 電力変換器の出力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63276324A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0606746A1 (en) * | 1992-12-17 | 1994-07-20 | STMicroelectronics, Inc. | A circuit for increasing the breakdown voltage of a bipolar transistor |
-
1987
- 1987-05-07 JP JP11159487A patent/JPS63276324A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0606746A1 (en) * | 1992-12-17 | 1994-07-20 | STMicroelectronics, Inc. | A circuit for increasing the breakdown voltage of a bipolar transistor |
| US5453905A (en) * | 1992-12-17 | 1995-09-26 | Sgs-Thomson Microelectronics, Inc. | Circuit for increasing the breakdown voltage of a bipolar transistor |
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