JPS63260235A - 送信制御方式 - Google Patents
送信制御方式Info
- Publication number
- JPS63260235A JPS63260235A JP62093063A JP9306387A JPS63260235A JP S63260235 A JPS63260235 A JP S63260235A JP 62093063 A JP62093063 A JP 62093063A JP 9306387 A JP9306387 A JP 9306387A JP S63260235 A JPS63260235 A JP S63260235A
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- JP
- Japan
- Prior art keywords
- transmission
- data
- error
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- register
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 84
- 238000000034 method Methods 0.000 claims 2
- 238000001514 detection method Methods 0.000 abstract description 14
- 238000010586 diagram Methods 0.000 description 3
- 230000004913 activation Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は伝送路に接続された端末の通信システムに係り
、特に送信を途中で打切る送信制御方式〔従来の技術〕 伝送路に接続された端末間でデータを伝送する場合、送
信元の端末では送信データの記憶されたメモリからデー
タバスを介して送信バッファレジスタへ送信データを転
送し、送信バッファレジスタから伝送路に送信データを
送信していた。送信データをメモリから送信バッファレ
ジスタに転送するときに前記データに、例えばパリティ
エラーを検出した場合は、送信バッファメモリに前記送
信データと一緒に誤り検出信号を書込み、送信中に送信
バッファレジスタから誤りの検出されたデータとともに
誤り検出信号が読出された時点で送信を打切り、送信打
切り信号を送信していた。
、特に送信を途中で打切る送信制御方式〔従来の技術〕 伝送路に接続された端末間でデータを伝送する場合、送
信元の端末では送信データの記憶されたメモリからデー
タバスを介して送信バッファレジスタへ送信データを転
送し、送信バッファレジスタから伝送路に送信データを
送信していた。送信データをメモリから送信バッファレ
ジスタに転送するときに前記データに、例えばパリティ
エラーを検出した場合は、送信バッファメモリに前記送
信データと一緒に誤り検出信号を書込み、送信中に送信
バッファレジスタから誤りの検出されたデータとともに
誤り検出信号が読出された時点で送信を打切り、送信打
切り信号を送信していた。
上記従来技術は送信元が送信データを送信バッファレジ
スタに転送する途中で誤りが検出されても送信バッファ
レジスタから誤り検出信号が読出されるまで送信を続け
ており、受信側では誤りの発生しているデータを送信打
切り信号を受信するまで受信し続けている。
スタに転送する途中で誤りが検出されても送信バッファ
レジスタから誤り検出信号が読出されるまで送信を続け
ており、受信側では誤りの発生しているデータを送信打
切り信号を受信するまで受信し続けている。
本発明の目的は、データ送信中に送信データの誤りを検
出した場合は、ただちに送信を打切り、送信打切り信号
を受信し、受信側の端末に送信デデータに誤りが検出さ
れたことをいち早く通知することにある。
出した場合は、ただちに送信を打切り、送信打切り信号
を受信し、受信側の端末に送信デデータに誤りが検出さ
れたことをいち早く通知することにある。
上記目的は、送信データを送信データの記憶されたメモ
リから送信バッファレジスタに転送するときに送信デー
タの誤りを検出し、誤りを検出したときはただちに送信
を打切ると同時に送信打切り信号を伝送路に送信するこ
とにより達成される。
リから送信バッファレジスタに転送するときに送信デー
タの誤りを検出し、誤りを検出したときはただちに送信
を打切ると同時に送信打切り信号を伝送路に送信するこ
とにより達成される。
本発明では、送信データを記憶しているメモリから送信
バッファレジスタに送信データを転送するときに誤りを
検出し、この誤り検出によりただちにデータの送信を打
切り送信打切り信号を送信する。これにより、送信元の
端末では誤り検出の時点で送信を打切ることができる為
伝送効率が向上し、さらに受信側ではデータに誤りが発
生したことをいち早く検出できるため受信データを記憶
するメモリを効率的に使用できる。
バッファレジスタに送信データを転送するときに誤りを
検出し、この誤り検出によりただちにデータの送信を打
切り送信打切り信号を送信する。これにより、送信元の
端末では誤り検出の時点で送信を打切ることができる為
伝送効率が向上し、さらに受信側ではデータに誤りが発
生したことをいち早く検出できるため受信データを記憶
するメモリを効率的に使用できる。
以下、本発明の一実施例を図を用いて説明する。
第２図に通信システムの構成を示す。伝送路３に通信装
置１を介して端末装置２が接続されている。各端末装置
２は通信装置１を介してデータの送受信を行う。
置１を介して端末装置２が接続されている。各端末装置
２は通信装置１を介してデータの送受信を行う。
通信装置１が伝送路上にデータを送信する場合について
第１図を用いて説明する。
第１図を用いて説明する。
端末装置２はデータを送信するときに送信起動信号１７
を出力し、送信データを記憶しているメモリ４からデー
タバス１９を介して送信バッファレジスタ５に送信デー
タを転送する。このとき送信起動信号１７によりフリッ
プフロップ７がリセットされる。フリップフロップ７の
出力１６によりＡＮＤゲート１５が付勢され、送信デー
タは送信バッファレジスタ５の出力２０からシフトレジ
スタ８へ供給される。シフトレジスタ８からシリアルデ
ータ２４の出力はドライバ９を介して伝送路３に送出さ
れる。
を出力し、送信データを記憶しているメモリ４からデー
タバス１９を介して送信バッファレジスタ５に送信デー
タを転送する。このとき送信起動信号１７によりフリッ
プフロップ７がリセットされる。フリップフロップ７の
出力１６によりＡＮＤゲート１５が付勢され、送信デー
タは送信バッファレジスタ５の出力２０からシフトレジ
スタ８へ供給される。シフトレジスタ８からシリアルデ
ータ２４の出力はドライバ９を介して伝送路３に送出さ
れる。
もしメモリ４からデータバス１９を介して送信バッファ
レジスタ５に送信データを転送するときに送信データに
誤りがあるとデータバス１９上のデータの誤りを検出す
る誤り検出回路６が送信データの誤りを検出する。デー
タの誤りにはノイズ等の原因によるデータ値の誤り、メ
モリから送信バッファレジスタへの送信データの転送が
とぎれるアングラインがあるが本実施例ではパリティチ
ェックを用いた場合について説明する。メモリ４には８
ビツトのデータに１ビツトのパリティを付加した送信デ
ータを記憶しておき、メモリ４から送信バッファレジス
タ５へ送信データを転送するときは送信データＤＯ〜Ｄ
７を８ビツト、パリティビットＰを１ビツト合計９ビッ
トをデータバス１９上にメモリ４から出力する。データ
バス１９上のデータにパリティエラーが発生していれば
第３図に示す誤り検出回路６によりパリティエラーを検
出し、誤り検出信号１８を出力する。誤り検出信号１８
を出力することにより送信バッファレジスタ５に既に転
送されている送信データを全て消去するとともに、フリ
ップフロップ７をセットする。フリップフロップ７の出
力によりＡＮＤゲート１４が付勢され送信打切り信号レ
ジスタ１３内に設定されている送信打切り信号がシフト
レジスタ８へ供給され、シリアルデータ２４はドライバ
９を介して伝送路３に送出される。送信打切り信号を伝
送路２に送出することにより、誤りが検出される前に既
に伝送路３に送出された送信データを受信している通信
装置は送信打切り信号を受信することにより受信を打切
る。
レジスタ５に送信データを転送するときに送信データに
誤りがあるとデータバス１９上のデータの誤りを検出す
る誤り検出回路６が送信データの誤りを検出する。デー
タの誤りにはノイズ等の原因によるデータ値の誤り、メ
モリから送信バッファレジスタへの送信データの転送が
とぎれるアングラインがあるが本実施例ではパリティチ
ェックを用いた場合について説明する。メモリ４には８
ビツトのデータに１ビツトのパリティを付加した送信デ
ータを記憶しておき、メモリ４から送信バッファレジス
タ５へ送信データを転送するときは送信データＤＯ〜Ｄ
７を８ビツト、パリティビットＰを１ビツト合計９ビッ
トをデータバス１９上にメモリ４から出力する。データ
バス１９上のデータにパリティエラーが発生していれば
第３図に示す誤り検出回路６によりパリティエラーを検
出し、誤り検出信号１８を出力する。誤り検出信号１８
を出力することにより送信バッファレジスタ５に既に転
送されている送信データを全て消去するとともに、フリ
ップフロップ７をセットする。フリップフロップ７の出
力によりＡＮＤゲート１４が付勢され送信打切り信号レ
ジスタ１３内に設定されている送信打切り信号がシフト
レジスタ８へ供給され、シリアルデータ２４はドライバ
９を介して伝送路３に送出される。送信打切り信号を伝
送路２に送出することにより、誤りが検出される前に既
に伝送路３に送出された送信データを受信している通信
装置は送信打切り信号を受信することにより受信を打切
る。
本実施例によれば、データ送信中メモリから送信バッフ
ァレジスタへ送信データを転送するときにデータにパリ
ティエラーが検出された時点でデータの送信を打切り、
送信打切り信号を送信できるため、システムの伝送効率
が向上する。
ァレジスタへ送信データを転送するときにデータにパリ
ティエラーが検出された時点でデータの送信を打切り、
送信打切り信号を送信できるため、システムの伝送効率
が向上する。
本発明によれば、データ送信中メモリから送信バッファ
レジスタへ送信データを転送するときにデータに誤りが
検出された時点でデータ送信を打切り、送信打切り信号
を送信できるためシステムの伝送効率が向上する
レジスタへ送信データを転送するときにデータに誤りが
検出された時点でデータ送信を打切り、送信打切り信号
を送信できるためシステムの伝送効率が向上する
第１図は本発明の一実施例の通信装置の構成図、第２図
は通信システムの構成図、第３図は誤り検出回路の一実
施例を示す図である。 ２・・・端末装置、４・・・メモリ、５・・・送信バッ
ファメモリ、６・・・誤り検出回路、１３・・・送信打
切り信号レジスタ、１７・・・送信起動信号、１８・・
・誤り検出信号、１９・・・データバス。
は通信システムの構成図、第３図は誤り検出回路の一実
施例を示す図である。 ２・・・端末装置、４・・・メモリ、５・・・送信バッ
ファメモリ、６・・・誤り検出回路、１３・・・送信打
切り信号レジスタ、１７・・・送信起動信号、１８・・
・誤り検出信号、１９・・・データバス。
Claims (1)
- 【特許請求の範囲】 １、伝送路に接続された複数の通信装置間で相互にデー
タを伝送するシステムにおいて、 前記通信装置は、送信データの誤りを検出する手段を有
し、前記手段によりデータ送信中に誤りが検出されると
、データ送信を打切り、誤りを表示するビットパターン
を送信することを特徴とする送信制御方式。 ２、前記通信装置は、送信データを記憶しているメモリ
から送信バッファレジスタにデータバスを介して送信デ
ーを転送するときに前記データバス上の送信データの誤
りを検出する手段を有し、前記送信データの誤りを検出
したときに送信を打切り、伝送路に送信打切りを表示す
るビットパターンを送信することを特徴とする特許請求
の範囲第１項記載の送信制御方式。 ３、前記通信装置は、送信データに誤りを検出したとき
に、送信バッファレジスタの内容を消去することを特徴
とする特許請求の範囲第２項記載の送信制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62093063A JPS63260235A (ja) | 1987-04-17 | 1987-04-17 | 送信制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62093063A JPS63260235A (ja) | 1987-04-17 | 1987-04-17 | 送信制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63260235A true JPS63260235A (ja) | 1988-10-27 |
Family
ID=14072056
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62093063A Pending JPS63260235A (ja) | 1987-04-17 | 1987-04-17 | 送信制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63260235A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012094081A (ja) * | 2010-10-29 | 2012-05-17 | Nec Engineering Ltd | バス調停回路及びバス調停方法 |
-
1987
- 1987-04-17 JP JP62093063A patent/JPS63260235A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012094081A (ja) * | 2010-10-29 | 2012-05-17 | Nec Engineering Ltd | バス調停回路及びバス調停方法 |
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