JPS63246932A - 四線二線変換回路 - Google Patents
四線二線変換回路Info
- Publication number
- JPS63246932A JPS63246932A JP8140287A JP8140287A JPS63246932A JP S63246932 A JPS63246932 A JP S63246932A JP 8140287 A JP8140287 A JP 8140287A JP 8140287 A JP8140287 A JP 8140287A JP S63246932 A JPS63246932 A JP S63246932A
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- JP
- Japan
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- signal
- amplifier
- adder
- output
- wire
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims description 8
- 239000002131 composite material Substances 0.000 claims description 4
- 230000005540 biological transmission Effects 0.000 abstract description 8
- 230000003321 amplification Effects 0.000 abstract description 4
- 238000003199 nucleic acid amplification method Methods 0.000 abstract description 4
- 230000000694 effects Effects 0.000 abstract description 3
- 230000002194 synthesizing effect Effects 0.000 abstract 2
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、データ伝送システムの変復調端末装置での、
送信と受信が、同時に可能な四線二線変換回路に関する
ものである。
送信と受信が、同時に可能な四線二線変換回路に関する
ものである。
従来の技術
データ伝送システムの変復調端末装置を用いて、データ
の送信、受信を行う際、前記変復調端末装置からの送信
信号と回線からの受信信号とを合成１分離する手段とし
て、四線二線変換回路がある。
の送信、受信を行う際、前記変復調端末装置からの送信
信号と回線からの受信信号とを合成１分離する手段とし
て、四線二線変換回路がある。
第２図は従来の四線二線変換回路のブロック図を示すも
のである。第２図において、反転増幅器１は、送出信号
端子２の信号を反転増幅し、回線結合器３を通じて、回
線４に送り出す。増幅器５は、送出信号端子２の信号を
固定増幅率で増幅して、この送出信号を、回線結合器３
を通じて入力されてきた受信信号および前記反転増幅器
１で増幅された送出信号の合成信号と共に、加算器６で
加算し、受信端子７にその加算信号を与える。ここで、
受信端子７に現れる前記加算信号中の、送出信号成分は
、送出信号端子２の信号とは、位相が反転しており、さ
らに、増幅器５により増幅されて、加算器６で、加算す
ることにより、はとんど除去される。したがって、受信
端子７の信号中には、送出信号の成分が存在しないよう
に回路設計がなされる。
のである。第２図において、反転増幅器１は、送出信号
端子２の信号を反転増幅し、回線結合器３を通じて、回
線４に送り出す。増幅器５は、送出信号端子２の信号を
固定増幅率で増幅して、この送出信号を、回線結合器３
を通じて入力されてきた受信信号および前記反転増幅器
１で増幅された送出信号の合成信号と共に、加算器６で
加算し、受信端子７にその加算信号を与える。ここで、
受信端子７に現れる前記加算信号中の、送出信号成分は
、送出信号端子２の信号とは、位相が反転しており、さ
らに、増幅器５により増幅されて、加算器６で、加算す
ることにより、はとんど除去される。したがって、受信
端子７の信号中には、送出信号の成分が存在しないよう
に回路設計がなされる。
発明が解決しようとする問題点
しかしながら、このような従来の回路では、現実には、
回線のインピーダンス変動が不可避であリ、このため、
送出信号の成分を完全に除去することはできない。
回線のインピーダンス変動が不可避であリ、このため、
送出信号の成分を完全に除去することはできない。
本発明は、かかる点に鑑みてなされたもので、回線のイ
ンピーダンス変動に関係なく、送出信号の成分を完全に
除去することを目的としている。
ンピーダンス変動に関係なく、送出信号の成分を完全に
除去することを目的としている。
問題点を解決するための手段
本発明は、上記問題点を解決するため、送出信号を増幅
器および反転増幅器に並行入力し、前記増幅器の出力と
、前記反転増幅器の出力および回線結合器を介して入力
される受信信号による合成信号とを、それぞれ、加算器
に供給し、前記加算器の出力で、前記増幅器を制御する
ように構成したものである。
器および反転増幅器に並行入力し、前記増幅器の出力と
、前記反転増幅器の出力および回線結合器を介して入力
される受信信号による合成信号とを、それぞれ、加算器
に供給し、前記加算器の出力で、前記増幅器を制御する
ように構成したものである。
作用
本発明は、上記した構成により、回線インピーダンスの
変動による送出信号の除去後残留成分を制御信号として
用い、送出信号の除去後残留成分を完全に無（すように
制御できるので、回線インピーダンスの変動に関係なく
効率よく除去できる。
変動による送出信号の除去後残留成分を制御信号として
用い、送出信号の除去後残留成分を完全に無（すように
制御できるので、回線インピーダンスの変動に関係なく
効率よく除去できる。
実施例
第１図は、本発明の四線二線変換回路の一実施例を示す
ブロック図である。第１図において、１は反転増幅器、
３は回線結合器、６は加算器であり、これらは、従来例
の構成と同じものである。
ブロック図である。第１図において、１は反転増幅器、
３は回線結合器、６は加算器であり、これらは、従来例
の構成と同じものである。
この図中、増幅器５０は、従来例のものと異なり、増幅
率の制御できる増幅器である。
率の制御できる増幅器である。
以下に本実施例の動作を説明する。
送出信号端子２の信号は、反転増幅器１により増幅され
、回線結合器３を通して、回線４に送り出される。受信
信号は、回線４から、回線結合器３を通して、四線二線
変換回路に入力される。すなわち、受信信号は、前記反
転増幅器１の出力と加算合成されて加算合成信号となり
、加算器６に入力される。従って、加算合成信号には、
送出信号の反転成分が含まれている。
、回線結合器３を通して、回線４に送り出される。受信
信号は、回線４から、回線結合器３を通して、四線二線
変換回路に入力される。すなわち、受信信号は、前記反
転増幅器１の出力と加算合成されて加算合成信号となり
、加算器６に入力される。従って、加算合成信号には、
送出信号の反転成分が含まれている。
増幅器５０には、送出信号端子２の信号が、入力され、
増幅されて、増幅信号となり、加算器６に入力される。
増幅されて、増幅信号となり、加算器６に入力される。
送出信号の反転増幅成分と送出信号の増幅成分とが、同
じ大きさであれば、加算器６の出力には、送出信号の成
分は、除去されて存在しない。しかし、前記加算合成信
号中の送出信号の反転成分は、回線インピーダンスの変
動の影響を受けて、振幅が変動するので、前記加算器６
の出力信号中に、残留してしまう。そこで、増幅器５０
では、この残留成分を検出しながら同残留成分が、存在
しな（なるように、増幅率を変え、増幅信号の振幅を制
御する。
じ大きさであれば、加算器６の出力には、送出信号の成
分は、除去されて存在しない。しかし、前記加算合成信
号中の送出信号の反転成分は、回線インピーダンスの変
動の影響を受けて、振幅が変動するので、前記加算器６
の出力信号中に、残留してしまう。そこで、増幅器５０
では、この残留成分を検出しながら同残留成分が、存在
しな（なるように、増幅率を変え、増幅信号の振幅を制
御する。
したがって、加算器６の出力信号、すなわち、受信端子
７の信号中には、送出信号の成分を、回線２１のインピ
ーダンス変動に関係なく、確実に除去できる。
７の信号中には、送出信号の成分を、回線２１のインピ
ーダンス変動に関係なく、確実に除去できる。
発明の効果
上記のように、本発明によると、増幅器の帰還制御機能
によって、送出信号の受信側への影響を除去することが
できる。
によって、送出信号の受信側への影響を除去することが
できる。
第１図は本発明の一実施例における四線二線変換回路の
ブロック図、第２図は従来の四線二線変換回路のブロッ
ク図である。 １・・・・・・反転増幅器、３・・・・・・回線結合器
、５゜５０・・・・・・増幅器、６・・・・・・加算器
。
ブロック図、第２図は従来の四線二線変換回路のブロッ
ク図である。 １・・・・・・反転増幅器、３・・・・・・回線結合器
、５゜５０・・・・・・増幅器、６・・・・・・加算器
。
Claims (1)
- 送出信号を増幅器および反転増幅器に並行入力し、前記
増幅器の出力と、前記反転増幅器の出力および回線結合
器を介して入力される受信信号による合成信号とを、そ
れぞれ、加算器に供給し、前記加算器の出力で前記増幅
器を制御するように構成された四線二線変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8140287A JPS63246932A (ja) | 1987-04-02 | 1987-04-02 | 四線二線変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8140287A JPS63246932A (ja) | 1987-04-02 | 1987-04-02 | 四線二線変換回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63246932A true JPS63246932A (ja) | 1988-10-13 |
Family
ID=13745323
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8140287A Pending JPS63246932A (ja) | 1987-04-02 | 1987-04-02 | 四線二線変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63246932A (ja) |
-
1987
- 1987-04-02 JP JP8140287A patent/JPS63246932A/ja active Pending
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