JPS63238512A - シンクロデジタル変換装置 - Google Patents
シンクロデジタル変換装置Info
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- JPS63238512A JPS63238512A JP7350187A JP7350187A JPS63238512A JP S63238512 A JPS63238512 A JP S63238512A JP 7350187 A JP7350187 A JP 7350187A JP 7350187 A JP7350187 A JP 7350187A JP S63238512 A JPS63238512 A JP S63238512A
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- 230000001360 synchronised effect Effects 0.000 title claims abstract description 9
- 239000000872 buffer Substances 0.000 claims abstract description 19
- 238000001514 detection method Methods 0.000 claims abstract description 18
- 238000006243 chemical reaction Methods 0.000 claims abstract description 13
- 101150065817 ROM2 gene Proteins 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 5
- GVGLGOZIDCSQPN-PVHGPHFFSA-N Heroin Chemical compound O([C@H]1[C@H](C=C[C@H]23)OC(C)=O)C4=C5[C@@]12CCN(C)[C@@H]3CC5=CC=C4OC(C)=O GVGLGOZIDCSQPN-PVHGPHFFSA-N 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000010363 phase shift Effects 0.000 description 2
- 238000009396 hybridization Methods 0.000 description 1
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- Transmission And Conversion Of Sensor Element Output (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
へ産業上の利用分野ン
本発明は、シンクｎ ３線信月（以下［シンクロ信号」
という）をデジタル値に変換するシンクロデジタル変換
装置の改善に関する。
という）をデジタル値に変換するシンクロデジタル変換
装置の改善に関する。
〈従来の技術さ
以下、従来の技術を第２図の従来のシンクロデジタル変
換装置の概要構成図を用いて説明する。
換装置の概要構成図を用いて説明する。
第２図において、シンクロ信号Ｓ＋ 、 Ｓ２ 、 Ｓ
コはシンクロ信号発信器１から出力される。この時のシ
ンクロ信号発信器１の各端子間のシンクロ電圧は、 Ｖ（Ｓ３ ｓ−＋ ン −ＶＳＪ、ｎ
（り ｌ−５ｉｎ θＶ（ｓ＋ ５２）＝ ＶＳｌｌｌＱ）１−３ｉｌｌ （０−１２０°）Ｖ（Ｓ
２ ８３）＝ Ｓｉｎωｌ−３ｉｌｌ（θ−２４０’）・・・（１） となっている。但し、θはシンクロ電気角、ωは入力周
波数。このシンクロ電圧は、スコツトトランスＳＴに導
かれてレゾルバ−信号〈電圧）に変換される。即ち、ス
コツ１へ１〜ランスＳＴの出力端子５３０−３ｌｏｔ
Ｓ４０ ５２０間には、Ｖ（ｓｚｏ ｓ＋ｏ）−
ＶＳｉｒｌ ω １−８ｉｎ θＶ（５４０ｓ ２
ｏ’）＝ＶＳｉｒｌω尤 ・ ＣＯ５θ・・・（２） なる電圧が（ｑられる。このスコツトトランスＳＴの電
圧出力は、象現選択部２にＪ３いて、夫々アップダウン
カウンタ３からのアップ又はダウン信号αに基づいて正
弦／余弦の象現選択をして符号が与えられる。Ｖ（Ｓ３
゜−５，。）に対応する電圧１直としてＥｏＫＳｆ７１
ω１−３ｉｎθがＣＯＳマルチプライヤ４に、Ｖ（ｓ４
ｏ ８２０）に対応する電圧値として−Ｅｏ ＫＳ
ｉ ｎωＪ−−ＣＯ１９がＳ ｊ、 Ｉｌマルチプライ
ヤ５に夫々出力する。但し、［０はシンクロ発信器のノ
ミプル電圧、には定数。
コはシンクロ信号発信器１から出力される。この時のシ
ンクロ信号発信器１の各端子間のシンクロ電圧は、 Ｖ（Ｓ３ ｓ−＋ ン −ＶＳＪ、ｎ
（り ｌ−５ｉｎ θＶ（ｓ＋ ５２）＝ ＶＳｌｌｌＱ）１−３ｉｌｌ （０−１２０°）Ｖ（Ｓ
２ ８３）＝ Ｓｉｎωｌ−３ｉｌｌ（θ−２４０’）・・・（１） となっている。但し、θはシンクロ電気角、ωは入力周
波数。このシンクロ電圧は、スコツトトランスＳＴに導
かれてレゾルバ−信号〈電圧）に変換される。即ち、ス
コツ１へ１〜ランスＳＴの出力端子５３０−３ｌｏｔ
Ｓ４０ ５２０間には、Ｖ（ｓｚｏ ｓ＋ｏ）−
ＶＳｉｒｌ ω １−８ｉｎ θＶ（５４０ｓ ２
ｏ’）＝ＶＳｉｒｌω尤 ・ ＣＯ５θ・・・（２） なる電圧が（ｑられる。このスコツトトランスＳＴの電
圧出力は、象現選択部２にＪ３いて、夫々アップダウン
カウンタ３からのアップ又はダウン信号αに基づいて正
弦／余弦の象現選択をして符号が与えられる。Ｖ（Ｓ３
゜−５，。）に対応する電圧１直としてＥｏＫＳｆ７１
ω１−３ｉｎθがＣＯＳマルチプライヤ４に、Ｖ（ｓ４
ｏ ８２０）に対応する電圧値として−Ｅｏ ＫＳ
ｉ ｎωＪ−−ＣＯ１９がＳ ｊ、 Ｉｌマルチプライ
ヤ５に夫々出力する。但し、［０はシンクロ発信器のノ
ミプル電圧、には定数。
どころで、ＣＯＳマルヂプライｌ′／４とＳｌｎマルチ
ブラーイヤ５には夫々アップダウンカウンタ３からデジ
タル角度φが導かれているので、これ等に基づく正弦、
余弦の角度φが定まるから、ＣＯＳマルチプライヤ４に
Ｊ５いては入力したＥｏＫＳｌｎω１− Ｓ Ｊ、 Ｉ
Ｉθと決定されたＣＯ８φとが乗口されてＥｏＫＳｉｎ
ωｊ：、−３ｌｎθ−ＣＯ５φが１りられ、５ｉｌｌマ
ルチプライヤ５においては入力した一ＥｏＫＳｉｌｌω
尤・ＣＯ８θと決定されたＳｉｎφとが乗算されて−Ｅ
ｏＫＳｉｎωＬ・ＣＯ８θ・Ｓｌｎφが得られる。この
ＣＯＳマルチブライ〜７４とＳｉｎマルチプライヤ５と
の出ツノは加口器Ｇにおいて加算される。加算出力はＥ
ＯＫ Ｓ ｌ ｎωｆ −Ｓ １１Ｌ（θ−φ）どなる
。この加算出力が位相検波部７に導かれる。位（ｌ検波
部７には基準電圧Ｖｒａ ｔ ＝Ｅｏ ＳｉｎωＬが入
力しているので５ｉｌｌ（θ−φ）に基づく極性と振幅
が１ｑられる。ここで極性出力はアップダウンカウンタ
３に導かれてアップ又はダウンを決定し、振幅出力はア
ップダウンカウンタ３の１ジタル出力φを変化させるた
めのＶＣＯ（可変周波数発信χ；）８の周波数を決定す
る。
ブラーイヤ５には夫々アップダウンカウンタ３からデジ
タル角度φが導かれているので、これ等に基づく正弦、
余弦の角度φが定まるから、ＣＯＳマルチプライヤ４に
Ｊ５いては入力したＥｏＫＳｌｎω１− Ｓ Ｊ、 Ｉ
Ｉθと決定されたＣＯ８φとが乗口されてＥｏＫＳｉｎ
ωｊ：、−３ｌｎθ−ＣＯ５φが１りられ、５ｉｌｌマ
ルチプライヤ５においては入力した一ＥｏＫＳｉｌｌω
尤・ＣＯ８θと決定されたＳｉｎφとが乗算されて−Ｅ
ｏＫＳｉｎωＬ・ＣＯ８θ・Ｓｌｎφが得られる。この
ＣＯＳマルチブライ〜７４とＳｉｎマルチプライヤ５と
の出ツノは加口器Ｇにおいて加算される。加算出力はＥ
ＯＫ Ｓ ｌ ｎωｆ −Ｓ １１Ｌ（θ−φ）どなる
。この加算出力が位相検波部７に導かれる。位（ｌ検波
部７には基準電圧Ｖｒａ ｔ ＝Ｅｏ ＳｉｎωＬが入
力しているので５ｉｌｌ（θ−φ）に基づく極性と振幅
が１ｑられる。ここで極性出力はアップダウンカウンタ
３に導かれてアップ又はダウンを決定し、振幅出力はア
ップダウンカウンタ３の１ジタル出力φを変化させるた
めのＶＣＯ（可変周波数発信χ；）８の周波数を決定す
る。
このように構成づることで、シンクロ信号θを、シンク
ロ角に対応したデジタル信号（最）φに変換して出力す
ることができる。
ロ角に対応したデジタル信号（最）φに変換して出力す
ることができる。
〈発明が解決しようとする問題点〉
しかしイ≧がら、この従来のシンクロデジタル変換装置
は、スコツトトランスでシンクロ信号からレゾルバ−信
号に変換する１を成となっているために、スコツトトラ
ンスの精度で変換装置全体の精度が決定されることとな
る。即ち、装置の変換精度を上げるためには、高精度の
スコツトトランスを用いる必要がある。ところが高精度
のスコツ１〜トランスは極めて高価である上にその形状
も大きくなるという問題点がある。
は、スコツトトランスでシンクロ信号からレゾルバ−信
号に変換する１を成となっているために、スコツトトラ
ンスの精度で変換装置全体の精度が決定されることとな
る。即ち、装置の変換精度を上げるためには、高精度の
スコツトトランスを用いる必要がある。ところが高精度
のスコツ１〜トランスは極めて高価である上にその形状
も大きくなるという問題点がある。
本発明は、この従来の技術の問題点に鑑みてなされたも
のであって、スコツトｌヘラシスを不要とすることで装
置全体を小形化し且つハイブリッド化し−５すく変換精
度を高精度とするシンクロデジタル変換装置を提供する
ことを目的どする。
のであって、スコツトｌヘラシスを不要とすることで装
置全体を小形化し且つハイブリッド化し−５すく変換精
度を高精度とするシンクロデジタル変換装置を提供する
ことを目的どする。
ご問題点を解決するだめの手段〉
上述の目的を達成するための本発明のシンクロデジタル
変換装置は、入力されるシンクロ３線信号を分圧して２
系統の分圧信号を出力する分圧回路と、前記２系統の分
圧信号を夫々をバッファリングするバッフ７部と、デジ
タル化された信号を出力すると共に該デジタル化された
信号の１２０ずつずれた信号を出力するデジタル出力部
と、前記バッファ部から出力される２系統のバッフ１信
号と前記デジタル出力部からの１２０°ずつずれた信号
とを夫々入力して夫々乗算した上で加陣する演算部と、
該演算部の演算れ一果を入力して基準電圧に基づいて位
相検波して前記デジタル出力部に位相検波信号を出力す
る位相検波部と、を具備してなることを特徴とＪるもの
である。
変換装置は、入力されるシンクロ３線信号を分圧して２
系統の分圧信号を出力する分圧回路と、前記２系統の分
圧信号を夫々をバッファリングするバッフ７部と、デジ
タル化された信号を出力すると共に該デジタル化された
信号の１２０ずつずれた信号を出力するデジタル出力部
と、前記バッファ部から出力される２系統のバッフ１信
号と前記デジタル出力部からの１２０°ずつずれた信号
とを夫々入力して夫々乗算した上で加陣する演算部と、
該演算部の演算れ一果を入力して基準電圧に基づいて位
相検波して前記デジタル出力部に位相検波信号を出力す
る位相検波部と、を具備してなることを特徴とＪるもの
である。
〈実施例〉
以下本発明を第１図の本発明の具体的実施例を示すシン
クロデジタル変換装置のブロック線図に基づき説明する
。尚第１図において第２図とｙｐ複する部分は同−Ｗ号
を付してその説明は省略する。
クロデジタル変換装置のブロック線図に基づき説明する
。尚第１図において第２図とｙｐ複する部分は同−Ｗ号
を付してその説明は省略する。
ｆ：Ｊｉ図において、９は抵抗Ｒで等負荷化描成された
分圧回路、１０は第１バツフ７ Ｂ、と第２バツフアＢ
２とから成るバッファ部、１１は第１１ｉ部１１ａと第
２乗算部１１ｂとから成る乗算部、６０は加算部、βは
■ｃＯ８どアップダウンカウンタ３と第１記憶要素ＲＯ
Ｍ ＋ と第２記１１！！要素１１０Ｍ２どから成る位
相シフト部１２どから成るデジタル出力部である。
分圧回路、１０は第１バツフ７ Ｂ、と第２バツフアＢ
２とから成るバッファ部、１１は第１１ｉ部１１ａと第
２乗算部１１ｂとから成る乗算部、６０は加算部、βは
■ｃＯ８どアップダウンカウンタ３と第１記憶要素ＲＯ
Ｍ ＋ と第２記１１！！要素１１０Ｍ２どから成る位
相シフト部１２どから成るデジタル出力部である。
この様な構成において、シンクロ信号Ｓ、 −Ｓ３は、
３相間の負荷インピーダンスが等しく又通常のＡペアン
プで取り扱える信号レベル（例えば±ｌ０ＶＰ−Ｐ程Ｉ
！りになるように抵抗値Ｒから成る抵抗Ｒで等負荀化イ
？４成された分圧回路９で受け、分圧される。この時、
分圧回路９は、シンクロ信号Ｓ１が接続される入力端子
Ｔ１と出力端子Ｔ１２との間に抵抗Ｒが接続され、シン
クロ信＠＄３が接続される入力端子Ｔ３と出力端子Ｔ３
２との間に抵抗Ｒが接続され、入力端子「瞥と入力端子
Ｔ３との間に抵抗Ｒ，Ｒが直列接続されて接続し、ａｉ
力端子ＴＩ２と出力端子Ｔ３２との間に抵抗Ｒ１Ｒが直
列接続されて接続し、シンクロ信号８２が接続される入
力端子Ｔ２と出力端子Ｔ Ｉ ２ ／ Ｔ３２間に接続
される抵抗Ｒ，Ｒの接続点ａとが接続し且つこれがシグ
ナルグランドに接続される構成となっている。
３相間の負荷インピーダンスが等しく又通常のＡペアン
プで取り扱える信号レベル（例えば±ｌ０ＶＰ−Ｐ程Ｉ
！りになるように抵抗値Ｒから成る抵抗Ｒで等負荀化イ
？４成された分圧回路９で受け、分圧される。この時、
分圧回路９は、シンクロ信号Ｓ１が接続される入力端子
Ｔ１と出力端子Ｔ１２との間に抵抗Ｒが接続され、シン
クロ信＠＄３が接続される入力端子Ｔ３と出力端子Ｔ３
２との間に抵抗Ｒが接続され、入力端子「瞥と入力端子
Ｔ３との間に抵抗Ｒ，Ｒが直列接続されて接続し、ａｉ
力端子ＴＩ２と出力端子Ｔ３２との間に抵抗Ｒ１Ｒが直
列接続されて接続し、シンクロ信号８２が接続される入
力端子Ｔ２と出力端子Ｔ Ｉ ２ ／ Ｔ３２間に接続
される抵抗Ｒ，Ｒの接続点ａとが接続し且つこれがシグ
ナルグランドに接続される構成となっている。
今、分圧回路９の入力端子Ｔ１〜Ｔ３に（１）式のよう
な２２９０４３号が入力すると、出力端−ＦＴ＋２から
第１バツフアＢ１には、 Ｋｏ ５ｉｎ（ｔ）１．−３ｉｌｌ （θ−１２０’
）−（３）が出力され、出力端子Ｔ３２から第２バツフ
アＢ２には、 Ｋｏ ５ｌｎ（ｔ）ｉ−５ｌｌｌ （θ＋ １２ｏ″＞
−（４）が出力される。但し、Ｋｏは定数。第１，
２バッファ８１，１３２においてこれ等分圧回路９の２
系統の分圧信号の出力が夫々バッファリングされる。
な２２９０４３号が入力すると、出力端−ＦＴ＋２から
第１バツフアＢ１には、 Ｋｏ ５ｉｎ（ｔ）１．−３ｉｌｌ （θ−１２０’
）−（３）が出力され、出力端子Ｔ３２から第２バツフ
アＢ２には、 Ｋｏ ５ｌｎ（ｔ）ｉ−５ｌｌｌ （θ＋ １２ｏ″＞
−（４）が出力される。但し、Ｋｏは定数。第１，
２バッファ８１，１３２においてこれ等分圧回路９の２
系統の分圧信号の出力が夫々バッファリングされる。
その後に第１．２バッファＢＴ、［３２の出力が第１乗
算部１１ａと第２乗算部１１ｂに夫々導かれる。
算部１１ａと第２乗算部１１ｂに夫々導かれる。
この時、デジタル出力部βにおいて、まず１ジタル化さ
れた信号φ（最初の時点では任意の値）を出力するアッ
プダウンカウンタ３からの出力φを１２０°ずつずらす
ために設置ノられたＲＯＭテーブルを有する第１記憶要
素ＲＯＭ＋ と第２記憶要素ＲＯＭ ２へ出力する。こ
のことにより、第１記憶要素ＲＯＭ ＋からＳｌｎ （
φ＋１２０＞７１）（第１乗算部１１ａｋ−１第２記憶
要素ＲＯ〜１２からＳ ｊ、 Ｉｔ（φ−１２０）が第
２乗算部１１ｂに夫々出力される。
れた信号φ（最初の時点では任意の値）を出力するアッ
プダウンカウンタ３からの出力φを１２０°ずつずらす
ために設置ノられたＲＯＭテーブルを有する第１記憶要
素ＲＯＭ＋ と第２記憶要素ＲＯＭ ２へ出力する。こ
のことにより、第１記憶要素ＲＯＭ ＋からＳｌｎ （
φ＋１２０＞７１）（第１乗算部１１ａｋ−１第２記憶
要素ＲＯ〜１２からＳ ｊ、 Ｉｔ（φ−１２０）が第
２乗算部１１ｂに夫々出力される。
第１乗算部１１ａと第２乗算部１１ｂにおいては、第１
．２バツフアＢ＋ 、［３２からの入力信号とデジタル
出力部βの第７，２記憶要素ＲＯＭ２．ＲＯＭ ２から
の１２０°ずつずれた信号を東等する。
．２バツフアＢ＋ 、［３２からの入力信号とデジタル
出力部βの第７，２記憶要素ＲＯＭ２．ＲＯＭ ２から
の１２０°ずつずれた信号を東等する。
そのｋｉ果、第１乗μ部１１ａからは、Ｋｏ ５ｉｎ（
ｔ）１−５ｉｌｌ （θ−１２０’ ）×５ｉｌｌ（φ
＋１２０）・・・（５）が出力され、第２乗口部１１ｂ
からは、Ｋｏ ５ｉｎｏｏＬ−９１１１Ｎ９＋１２０”
）ＸＳｉｎ （φ −１２０＞−（６ンが夫々用〕
〕され、加膣部６０にａ３いて加停される。
ｔ）１−５ｉｌｌ （θ−１２０’ ）×５ｉｌｌ（φ
＋１２０）・・・（５）が出力され、第２乗口部１１ｂ
からは、Ｋｏ ５ｉｎｏｏＬ−９１１１Ｎ９＋１２０”
）ＸＳｉｎ （φ −１２０＞−（６ンが夫々用〕
〕され、加膣部６０にａ３いて加停される。
加惇出力は、
（（３） ”２／ ２ ） Ｋｏ Ｓλ１１（θ−φ）
ｘ ｓ ｉｒｔωＬ・・・（７） どなる。この加暉出力は位相検波部７に導かれて基準電
圧Ｖｒｅｒを用いて位相検波され、５ｉｎ（θ−ψ）に
基づく極性と振幅とが抽出された位相検波信号が出力す
る。この位相検波信号はデジタル出力部βに導かれて、
位相検波信号の内の極性用ツノでアップダウンカウンタ
３のアップ又はダウンが決定され、位相検波信号の内の
振幅出力でアップダウンカウンタ３のカウント値である
デジタル出力φを変化させるためのＶＣＯ＜可変周波数
発信器）８の周波数が決定される。これら夫々の決定条
件に基づいてアップダウンカウンタ３の動作が決定され
、θ（φの内はデジタル出力φが第１記憶要素ＲＯＭ
＋ と第２記憶要素ＲＯＭ ２に導かれてθ＝φとなる
までこの制御系のループ動作が繰返され、θ＝φとなっ
た時にこのループ動作が停止するので、アップダウンカ
ウンタ３からはシンクロ信号θに対応するデジタル出力
φａが（ｑられることとなる。勿論このデジタル出力φ
ａはθ〜φの間も絶えず得られるがこの間は変化してい
るので採用されない。
ｘ ｓ ｉｒｔωＬ・・・（７） どなる。この加暉出力は位相検波部７に導かれて基準電
圧Ｖｒｅｒを用いて位相検波され、５ｉｎ（θ−ψ）に
基づく極性と振幅とが抽出された位相検波信号が出力す
る。この位相検波信号はデジタル出力部βに導かれて、
位相検波信号の内の極性用ツノでアップダウンカウンタ
３のアップ又はダウンが決定され、位相検波信号の内の
振幅出力でアップダウンカウンタ３のカウント値である
デジタル出力φを変化させるためのＶＣＯ＜可変周波数
発信器）８の周波数が決定される。これら夫々の決定条
件に基づいてアップダウンカウンタ３の動作が決定され
、θ（φの内はデジタル出力φが第１記憶要素ＲＯＭ
＋ と第２記憶要素ＲＯＭ ２に導かれてθ＝φとなる
までこの制御系のループ動作が繰返され、θ＝φとなっ
た時にこのループ動作が停止するので、アップダウンカ
ウンタ３からはシンクロ信号θに対応するデジタル出力
φａが（ｑられることとなる。勿論このデジタル出力φ
ａはθ〜φの間も絶えず得られるがこの間は変化してい
るので採用されない。
ところで、本発明は、デジタル出力部βを第１図のよう
な各ブロックで構成づることに限定されるしのではなく
、例えば位相検波部７のアナ【フグ出力をアナロクデジ
タル変換器を用いてデジタル変換すれば、デジタル出力
部βはマイクロコンピュータで構成してもよい。
な各ブロックで構成づることに限定されるしのではなく
、例えば位相検波部７のアナ【フグ出力をアナロクデジ
タル変換器を用いてデジタル変換すれば、デジタル出力
部βはマイクロコンピュータで構成してもよい。
〈発明の効果〉
以上、実施例と共に具体的に本発明を説明したように、
本発明のシンクロデジタル変換装置によれば、スコツト
トランスが不要となるために装置全体を小形化できる上
にハイブリッド化しゃずいとことなる。又スコツトトラ
ンスを用いる必要が無いので高精度な装置を比較的安価
に製作することができる等の効果がある。
本発明のシンクロデジタル変換装置によれば、スコツト
トランスが不要となるために装置全体を小形化できる上
にハイブリッド化しゃずいとことなる。又スコツトトラ
ンスを用いる必要が無いので高精度な装置を比較的安価
に製作することができる等の効果がある。
第１図は本発明の具体的実施例を示づシンクロデジタル
変換装置のブロック線図、第２図は従来のシンクロデジ
タル変換装置の概要構成図である。 １・・・シンクロ信号発信器、３・・・アップダウンカ
ウンタ、６・・・加鋒器、７・・・位相検波部、８・・
・ｖＣ○（可変周波数発信器）、９・・・分圧回路、１
０・・・バッファ部、１１・・・乗算部、６０・・・加
算部、１２・・・位相シフト部。
変換装置のブロック線図、第２図は従来のシンクロデジ
タル変換装置の概要構成図である。 １・・・シンクロ信号発信器、３・・・アップダウンカ
ウンタ、６・・・加鋒器、７・・・位相検波部、８・・
・ｖＣ○（可変周波数発信器）、９・・・分圧回路、１
０・・・バッファ部、１１・・・乗算部、６０・・・加
算部、１２・・・位相シフト部。
Claims (1)
- 入力されるシンクロ３線信号を分圧して２系統の分圧信
号を出力する分圧回路と、前記２系統の分圧信号を夫々
をバッファリングするバッファ部と、デジタル化された
信号を出力すると共に該デジタル化された信号の１２０
°ずつずれた信号を出力するデジタル出力部と、前記バ
ッファ部から出力される２系統のバッファ信号と前記デ
ジタル出力部からの１２０°ずつずれた信号とを夫々入
力して夫々乗算した上で加算する演算部と、該演算部の
演算結果を入力して基準電圧に基づいて位相検波して前
記デジタル出力部に位相検波信号を出力する位相検波部
と、を具備してなることを特徴とするシンクロデジタル
変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7350187A JPS63238512A (ja) | 1987-03-27 | 1987-03-27 | シンクロデジタル変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7350187A JPS63238512A (ja) | 1987-03-27 | 1987-03-27 | シンクロデジタル変換装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63238512A true JPS63238512A (ja) | 1988-10-04 |
| JPH054614B2 JPH054614B2 (ja) | 1993-01-20 |
Family
ID=13520065
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7350187A Granted JPS63238512A (ja) | 1987-03-27 | 1987-03-27 | シンクロデジタル変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63238512A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015117959A (ja) * | 2013-12-17 | 2015-06-25 | 多摩川精機株式会社 | シンクロ信号のデジタル変換方法及び装置 |
-
1987
- 1987-03-27 JP JP7350187A patent/JPS63238512A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015117959A (ja) * | 2013-12-17 | 2015-06-25 | 多摩川精機株式会社 | シンクロ信号のデジタル変換方法及び装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH054614B2 (ja) | 1993-01-20 |
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