JPS63136825A - 同期・非同期状態検出カウンタ−付位相ロツクル−プ - Google Patents
同期・非同期状態検出カウンタ−付位相ロツクル−プInfo
- Publication number
- JPS63136825A JPS63136825A JP61284651A JP28465186A JPS63136825A JP S63136825 A JPS63136825 A JP S63136825A JP 61284651 A JP61284651 A JP 61284651A JP 28465186 A JP28465186 A JP 28465186A JP S63136825 A JPS63136825 A JP S63136825A
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- JP
- Japan
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- synchronous
- phase
- counter
- frequency
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- Pending
Links
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- 238000001514 detection method Methods 0.000 claims description 13
- 238000010586 diagram Methods 0.000 description 2
- 206010011878 Deafness Diseases 0.000 description 1
- 235000019227 E-number Nutrition 0.000 description 1
- 239000004243 E-number Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 210000000744 eyelid Anatomy 0.000 description 1
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- 230000007704 transition Effects 0.000 description 1
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、電子・通信機器に使用するＰＬＬ（Ｐｈａ
ｒｅ ＬｏｃＫ Ｌｏｏｐ３に関するものであり０〔従
来の技術〕 第２図は従来の同期・非同期状態検出器付ＰＬＬであり
、図において、中ぽ入力信号、Ｉ２１に゛ 分周カウ
ンター、・３１は位相比較器、＋４１ｒｉ低域フイルタ
ー、Ｉ６１は゛電圧制御発振器、１６）は出力信号、１
７）は分周カウンター、（８）は同期・非同期状態検出
器である。
ｒｅ ＬｏｃＫ Ｌｏｏｐ３に関するものであり０〔従
来の技術〕 第２図は従来の同期・非同期状態検出器付ＰＬＬであり
、図において、中ぽ入力信号、Ｉ２１に゛ 分周カウ
ンター、・３１は位相比較器、＋４１ｒｉ低域フイルタ
ー、Ｉ６１は゛電圧制御発振器、１６）は出力信号、１
７）は分周カウンター、（８）は同期・非同期状態検出
器である。
次に動作について説明する。上圧制御発振器（５）がら
発酸された出力信号１６）は分周カクンター鬼フ）で分
周される。又、入力信号ｉｌ）は分局カウンタ−１２）
で分周される。この２つの信号の位相差差を位削比較器
１３１によって比較検出し、得られた位ｆ！１思差信号
を低域フィルタ（４１に通してノイズを除去する。次い
でこの制御信号？覗圧！１ｉ１１御発振器＋５１に送り
周波数を制御して出力信号＋６１を出力する。以下、出
力信号１６１を分周カウンター＋７１にフィード・バッ
クすることにより、電圧制御ｉａ発振器（５１の周波数
・位相が常に入力信号ＩＩＩの固ｅ数の位相ＶＣ一致す
るように制御する。更に位相比ｆ２器（３１より得られ
た位相誤差信号は同期・非同期状態検出器である積分回
路（８）？通って２値化して検出される。
発酸された出力信号１６）は分周カクンター鬼フ）で分
周される。又、入力信号ｉｌ）は分局カウンタ−１２）
で分周される。この２つの信号の位相差差を位削比較器
１３１によって比較検出し、得られた位ｆ！１思差信号
を低域フィルタ（４１に通してノイズを除去する。次い
でこの制御信号？覗圧！１ｉ１１御発振器＋５１に送り
周波数を制御して出力信号＋６１を出力する。以下、出
力信号１６１を分周カウンター＋７１にフィード・バッ
クすることにより、電圧制御ｉａ発振器（５１の周波数
・位相が常に入力信号ＩＩＩの固ｅ数の位相ＶＣ一致す
るように制御する。更に位相比ｆ２器（３１より得られ
た位相誤差信号は同期・非同期状態検出器である積分回
路（８）？通って２値化して検出される。
〔定期が解決しようと′４る問題点〕
従来の同期・非同期状態検出器付ＰＬＬは以上のように
構成されているので、１惧差畦圧を積分して２瞼化して
検出しなければならず、アナログ形検出であるのでＬＳ
Ｉに適さず、父、同期状態から非同期状態あるいに非同
期状態から同期状態になった時を正確に検出することが
できないなどの問題点があった。
構成されているので、１惧差畦圧を積分して２瞼化して
検出しなければならず、アナログ形検出であるのでＬＳ
Ｉに適さず、父、同期状態から非同期状態あるいに非同
期状態から同期状態になった時を正確に検出することが
できないなどの問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、ディジタル形検出であるのでＬＳＩ化するこ
とができるとともに、同期状態から非同期状態あるい汀
非同期状態力・ら同期状態になった時を正確に横用する
ことができる同期・非同期状聾検出話付ＰＬＬ’ｉ得る
ことを目的とする。
たもので、ディジタル形検出であるのでＬＳＩ化するこ
とができるとともに、同期状態から非同期状態あるい汀
非同期状態力・ら同期状態になった時を正確に横用する
ことができる同期・非同期状聾検出話付ＰＬＬ’ｉ得る
ことを目的とする。
〔間ｂ〕点を解決するための手段〕
この発明に係り同期・非同期状態検出カウンター付ＰＬ
Ｌは、同期・非同期状態を正確にディジタル的に検出す
るためにその装置としてカウンターと採用するとともに
位相検出器としてＫｘ−ＯＲ（排他的論理和）ヲ凝った
ものである。
Ｌは、同期・非同期状態を正確にディジタル的に検出す
るためにその装置としてカウンターと採用するとともに
位相検出器としてＫｘ−ＯＲ（排他的論理和）ヲ凝った
ものである。
〔作用〕
この発明におけろ同期・非同期状態検出カウンターは、
位相１嬰差信号？時間域でＰＮＭ化してディジタル１勺
に検出する。
位相１嬰差信号？時間域でＰＮＭ化してディジタル１勺
に検出する。
以下との′ＩＰ明の一実施例を図について説明する。第
１図において、巾は入力信号、＋２１１Ｌ′ｉ分周カク
ンター、（３１は位相比較器、＋４１は低域フィルター
、・６１は電圧制御発＠！器、１６）は出力信号、１７
）は分周カウンター、（９１け同期・非同期状態検出カ
ウンター、１Ｉｏｌｉこの同期・非同期状態検出カウン
ターへ入力する位相誤差信号を検出する位相比較器（１
！ｚ−ＯＲ）である。
１図において、巾は入力信号、＋２１１Ｌ′ｉ分周カク
ンター、（３１は位相比較器、＋４１は低域フィルター
、・６１は電圧制御発＠！器、１６）は出力信号、１７
）は分周カウンター、（９１け同期・非同期状態検出カ
ウンター、１Ｉｏｌｉこの同期・非同期状態検出カウン
ターへ入力する位相誤差信号を検出する位相比較器（１
！ｚ−ＯＲ）である。
次に動作について説明する。電圧制御発振器＋５１から
発振された出力信号ｔｅｌ ｉｊ分周カクンタ；７）で
’／Ｎに分周される。父、入力信号ｆｉ＋け分周カウン
タ１２１でｌ／Ｍに分周される。この２つの信号の位相
差を位柑才較器１３１によって比較検出し位相誤差信号
として出力する。こうして得られた位相１ｖＡ差信号を
低域フィルタ１４）に通してノイズを除去する。次いで
この制御信号を′醒圧制御発振４１６）に送り周波数全
制御して出力信号；６）を出力する。以下、出力信号１
Ｂ）ヲ分局カクンタＩ７）にフィード・バックすること
（支）より、ば圧制御発振器・５１の同波数・位相が常
に入力信号１１の同波数・位相に一致するように制御す
る。更に分周カウンタ（２１及び＋７１によって分周さ
れた２信号を’Ｆｉｘ −ＯＲ１１０１に入力し、出力
される位相誤差信号をロードとして、高同波である入力
信号目）をクロックパルスとして・６１期・非同期状態
検出力クンタ（９）に送り、状報・期間をカウントし、
ディジタル的に検出する。
発振された出力信号ｔｅｌ ｉｊ分周カクンタ；７）で
’／Ｎに分周される。父、入力信号ｆｉ＋け分周カウン
タ１２１でｌ／Ｍに分周される。この２つの信号の位相
差を位柑才較器１３１によって比較検出し位相誤差信号
として出力する。こうして得られた位相１ｖＡ差信号を
低域フィルタ１４）に通してノイズを除去する。次いで
この制御信号を′醒圧制御発振４１６）に送り周波数全
制御して出力信号；６）を出力する。以下、出力信号１
Ｂ）ヲ分局カクンタＩ７）にフィード・バックすること
（支）より、ば圧制御発振器・５１の同波数・位相が常
に入力信号１１の同波数・位相に一致するように制御す
る。更に分周カウンタ（２１及び＋７１によって分周さ
れた２信号を’Ｆｉｘ −ＯＲ１１０１に入力し、出力
される位相誤差信号をロードとして、高同波である入力
信号目）をクロックパルスとして・６１期・非同期状態
検出力クンタ（９）に送り、状報・期間をカウントし、
ディジタル的に検出する。
なお、上記実ｒＭ列では制御信号として位相誤差信号を
低域フィルタ１４１に通したものを用いたが、その代わ
りに同期・非同期状態検出力クンタから出力されるカウ
ントを制御信号としてもよい。
低域フィルタ１４１に通したものを用いたが、その代わ
りに同期・非同期状態検出力クンタから出力されるカウ
ントを制御信号としてもよい。
〔９明のぺ力束〕
以上のように、この発明ＶＣよれは同期・非同期状態検
出器さしてカウンターを採用し誤差゛砥圧を時間域でＰ
ＮＭ化して検出するようＶＣ［成したので、ディジタル
ＬＳＩ化ｖｃ贋し、状態を正確に得られる効果がある。
出器さしてカウンターを採用し誤差゛砥圧を時間域でＰ
ＮＭ化して検出するようＶＣ［成したので、ディジタル
ＬＳＩ化ｖｃ贋し、状態を正確に得られる効果がある。
第１図はこの発明の一実施例による同門ｅ非同期状態検
出カウンター付ＰＬＬ’ｉ：示でブロック図、第２図は
従来、同町・非同期状態検出器付ＰＬＬを示すブロック
図である。 図において、 １１は入力信号、２！け分周カウンタ
、（３１は位相比較器、（４１は低域フィルタ、（５）
は電圧ｉｔＪ＃発振器、１６）は出力信号、（７１は分
周カウンタ、（９）は同期・非同期検出力クンタ、１０
１１１−を位相比較器である。 なお、図中、同一符号は同一、又は相当部分を示す。
出カウンター付ＰＬＬ’ｉ：示でブロック図、第２図は
従来、同町・非同期状態検出器付ＰＬＬを示すブロック
図である。 図において、 １１は入力信号、２！け分周カウンタ
、（３１は位相比較器、（４１は低域フィルタ、（５）
は電圧ｉｔＪ＃発振器、１６）は出力信号、（７１は分
周カウンタ、（９）は同期・非同期検出力クンタ、１０
１１１−を位相比較器である。 なお、図中、同一符号は同一、又は相当部分を示す。
Claims (1)
- 発振器と入力信号の位相差を検出して制御する位相ロッ
クループにおいて、同期・非同期状態を検出するカウン
ターを回路に組み入れたことを特徴とする同期・非同期
状態検出カウンター付位相ロックループ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61284651A JPS63136825A (ja) | 1986-11-28 | 1986-11-28 | 同期・非同期状態検出カウンタ−付位相ロツクル−プ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61284651A JPS63136825A (ja) | 1986-11-28 | 1986-11-28 | 同期・非同期状態検出カウンタ−付位相ロツクル−プ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63136825A true JPS63136825A (ja) | 1988-06-09 |
Family
ID=17681223
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61284651A Pending JPS63136825A (ja) | 1986-11-28 | 1986-11-28 | 同期・非同期状態検出カウンタ−付位相ロツクル−プ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63136825A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63263919A (ja) * | 1987-04-22 | 1988-10-31 | Hitachi Ltd | 半導体集積回路装置及びｐｌｌ回路 |
| JP2007243877A (ja) * | 2006-03-13 | 2007-09-20 | Renesas Technology Corp | 遅延同期回路及び半導体集積回路装置 |
-
1986
- 1986-11-28 JP JP61284651A patent/JPS63136825A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63263919A (ja) * | 1987-04-22 | 1988-10-31 | Hitachi Ltd | 半導体集積回路装置及びｐｌｌ回路 |
| JP2007243877A (ja) * | 2006-03-13 | 2007-09-20 | Renesas Technology Corp | 遅延同期回路及び半導体集積回路装置 |
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