JPS63136472U - - Google Patents

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JPS63136472U
JPS63136472U JP2824087U JP2824087U JPS63136472U JP S63136472 U JPS63136472 U JP S63136472U JP 2824087 U JP2824087 U JP 2824087U JP 2824087 U JP2824087 U JP 2824087U JP S63136472 U JPS63136472 U JP S63136472U
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JP
Japan
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liquid crystal
crystal display
display panel
video signal
hold circuit
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JP2824087U
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  • Liquid Crystal Display Device Control (AREA)
  • Transforming Electric Information Into Light Information (AREA)

Description

【図面の簡単な説明】
第１図は本考案の一実施例におけるアクテイブ
・マトリクス型液晶表示装置の回路構成を示すブ
ロツク図、第２図は第１図の動作を説明するため
のタイミングチヤート、第３図はＴＦＴ液晶表示
パネルの電気的構成を示す図、第４図は従来にお
けるアクテイブ・マトリクス型液晶表示装置の回
路構成を示すブロツク図、第５図は第４図の液晶
表示装置に入力する映像信号の順番を切換える切
換回路の構成を示すブロツク図、第６図はＴＦＴ
液晶表示パネルのカラー画素配列順序を示す図、
第７図は第４図の動作を説明するためのタイミン
グチヤートである。 ２１ａ，２１ｂ，〜……サンプル回路、２２…
…シフトレジスタ、２３ａ，２３ｂ，〜……第１
のホールド回路、２４ａ，２４ｂ，〜……第２の
ホールド回路、２５ａ，２５ｂ，〜……切換スイ
ツチ、２６……ＴＦＴ液晶表示パネル、２７……
奇数側ゲート駆動回路、２８……偶数側ゲート駆
動回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 インタレース方式で送られてくる走査線Ｎ本の
    映像信号を走査線がほぼ２Ｎ本の液晶表示パネル
    に表示するアクテイブ・マトリクス型液晶表示装
    置において、 １Ｈの映像信号をサンプルホールドするホール
    ド回路と、このホールド回路にホールドした情報
    を次の水平消去期間中に時分割により上記液晶表
    示パネルのｎ（ｎは奇数又は偶数）番目及び ｎ＋１番目の走査線の各画素にチヤージさせる
    手段とを具備したことを特徴とするアクテイブ・
    マトリクス型液晶表示装置のフリツカ防止回路。
JP2824087U 1987-02-27 1987-02-27 Pending JPS63136472U (ja)

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JP2824087U JPS63136472U (ja) 1987-02-27 1987-02-27

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JP2824087U JPS63136472U (ja) 1987-02-27 1987-02-27

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JPS63136472U true JPS63136472U (ja) 1988-09-07

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ID=30831019

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JP2824087U Pending JPS63136472U (ja) 1987-02-27 1987-02-27

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